EP2815508B1 - Procede de transmission de mots de code correcteur d'erreur non binaire avec modulation ccsk, signal et dispositif correspondant - Google Patents
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Definitions
- the present invention relates to a method of transmitting symbols of non-binary error correcting code words with a view to their transmission in a communication channel. These codes are defined on non-binary sets.
- the invention finds, for example, an application in the transmission of LDPC (Low Density Parity Check) non-binary codes or of Reed-Salomon codes.
- the invention also relates to the corresponding signal transmitted and the reception of such a signal.
- LDPC codes are error correcting codes known to approach Shannon's theoretical limit. Due to their performance in terms of noise immunity, LDPC codes, and in particular non-binary LDPC codes, can find application in many systems, for example in wireless communication systems, optical fiber, cable. , digital data storage systems ...
- the non-binary LDPC codes are constructed in a non-binary Galois field of order q, classically noted GF (q).
- An LDPC code in GF (q) is defined by a sparse parity matrix H of dimension A x B whose elements belong to GF (q), A being the number of parity constraints and B being the number of elements of GF (q) in the code word.
- This matrix can also be represented by a bipartite graph (Tanner graph) having A parity nodes and B variable nodes receiving the symbols of the code word. Each column of the parity matrix is associated with a variable node and each row of the matrix is associated with a parity node.
- the demodulation is relatively complex to achieve since it requires making inter-correlation calculations (or “cross-correlations” in English) between each of the 2 p Walsh-Hadamard sequences and the noisy signal, which represents a cost in terms of implementation.
- the demodulation is carried out by means of 2 p adapted filters each associated with a predetermined Walsh-Hadamard sequence.
- An object of the invention is to overcome the aforementioned drawback.
- a cyclic code shift modulation or CCSK for Cyclic Code-Shift Keying
- CCSK Cyclic Code-Shift Keying
- the invention relates to a method of transmitting non-binary error correcting code word symbols through a transmission channel, each code word symbol comprising p bits, which method comprises a first modulation step associating with each p-bit code word symbol a sequence of at least 2 p chips from among 2 p possible sequences, a second modulation step to modulate the phase or amplitude of at least one carrier with the sequences associated with the words of code and a step of transmitting the modulated carrier through said transmission channel, remarkable in that the first modulation step is a spread spectrum modulation of the cyclic code shift modulation type using a basic pseudo-random sequence d 'at least 2 p chips, the 2 p possible sequences being obtained by circular shifting of the basic pseudo-random sequence and in that the method further comprises, after said second modulation step, a step of inserting a cyclic prefix in each symbol to be transmitted.
- reception demodulation can be performed by simple fast Fourier transform (OR FFT) and inverse fast Fourier transform (or IFFT) operations. Moreover, this method requires only one pseudo-random generator to generate the 2 p sequences.
- the basic pseudo-random sequence is generated, at least partially, by a looped shift register implementing a primitive polynomial of order p.
- the code words processed are, for example, non-binary LDPC code words or non-binary Reed Salomon code words.
- the invention also relates to a device for transmitting symbols of non-binary error correcting code words through a transmission channel, each code word symbol comprising p bits, which device comprises a first modulator associating with each symbol of code word of p bits a sequence of at least 2 p chips among 2 p possible sequences, a second modulator for modulating the phase or amplitude of a carrier with the sequences associated with the code words, and a transmitter for transmitting the carrier modulated through said transmission channel, remarkable in that the first modulator is a cyclic code shift type spread spectrum modulator using a basic pseudo-random sequence of at least 2 p chips, the 2 p possible sequences being obtained by circular shifting of the basic pseudo-random sequence and that it further comprises a circuit capable of inserting a cyclic prefix in each symbol to be transmitted.
- the first modulator is a cyclic code shift type spread spectrum modulator using a basic pseudo-random sequence of at least 2 p chips, the 2 p possible sequences being obtained by circular shifting of
- the invention also relates to a non-binary error correcting code signal intended to be transmitted by the method defined above.
- the invention also relates to a method of receiving a non-binary error correcting code signal transmitted on a single carrier by the method defined above, characterized in that it comprises a step of receiving the signal, a step of suppressing of the cyclic prefix of each symbol, a step of fast Fourier transform of the received signal to generate samples in the frequency domain, and a step of frequency equalization and of calculating values of logarithms of the likelihood ratio of said samples.
- cyclic code shift modulation and the insertion of a cyclic prefix in each symbol to be transmitted is more particularly suited to single-carrier wireless communication systems because the frequency equalization and the calculation of Log-likelihood ratio values can then be achieved by the same operations of FFT and IFFT.
- the invention also relates to a device for receiving a non-binary error correcting code signal transmitted on a single carrier by the transmission device defined above, characterized in that it comprises a receiver for the transmitted signal, a circuit capable of eliminating the cyclic prefix of each symbol, a circuit for fast Fourier transform of the received signal to generate samples in the frequency domain, and a circuit for frequency equalization and for calculating values of logarithms of the likelihood ratio of said samples.
- CCSK modulation for "Cyclic Code Shift Keying” in English.
- chip designates binary information in the code of a spread spectrum modulation.
- the figure 1 illustrates the steps of the method of the invention.
- the NB-LDPC codes are modulated with a CCSK modulation, the function of which is to associate with each NB-LDPC code word symbol of p bits a pseudo-random sequence comprising 2 p chips.
- the sequences from step 110 are modulated by digital modulation, the function of which is to modulate at least one carrier with the sequences produced from step 110.
- the modulation of step 120 is a BPSK modulation (for “Binary Phase-Shift Keying” in English).
- the sequences produced in step 110 modulate the phase of the carrier. Modulations, other than the BPSK modulation, modulating the phase or the amplitude of the carrier are of course possible for step 120.
- each symbol of p bits is associated a sequence of at least 2 p chips. More particularly, each symbol of p bits is converted into a particular sequence obtained by circular shifting of a basic pseudo-random sequence denoted PN 0 .
- PN 0 a basic pseudo-random sequence
- the basic pseudo-random sequence PN 0 is selected so as to have good performance in terms of autocorrelation. Many methods are known in the literature to achieve this. In the present case, a sequence of 63 chips is generated by a looped shift register, also called LFSR register (for Linear feedback Shift Register in English), to which an additional chip is added to obtain a pseudo-random sequence of 64 scraps. This extra bit is added at any location in the sequence. Other methods of generating pseudo-random sequences are possible.
- the basic pseudo-random sequence PN 0 is for example the following 64-bit sequence: 1000001000011000101001111010001110010010110111011001101010111111
- the autocorrelation of this basic pseudo-random sequence after BPSK modulation, exhibits a single main peak when the shift is zero and non-zero secondary peaks. It can therefore be deduced from this that the CCSK modulation is not orthogonal.
- this sequence exhibits good autocorrelation performance since the distance between the main peak and the secondary peaks (shifts of 24, 32 and 40 chips) is relatively large.
- PN 0 From this PN 0 sequence, 63 other sequences are generated by circularly shifting the PN 0 sequence, each sequence being associated with an element of the Galois body GF (64).
- the PN sequence 0 is associated with the null element of the Galois field GF (64).
- the other elements ⁇ k of GF (64), with k E [0.62], are obtained by circularly shifting the sequence PN 0 by k + 1 positions to the right.
- each signal z i is equalized by the associated factor h i.
- LLR X k ln P Z H
- X X k P Z H
- Y Y k P Z H
- y i y i 0 Gold
- Each of the two sums in the above expression is the correlation between the received signal weighted by the Rayleigh coefficients and one of the possible CCSK sequences. Therefore, it is possible to calculate the LLRs using FFT and IFFT operations as shown in the figure 3 .
- the performance of this treatment is illustrated by the curves of the figure 4 .
- the frame error rate FER (for Frame Error Rate in English) is evaluated on a channel affected by additive Gaussian white noise (AWGN) with or without CCSK modulation.
- AWGN additive Gaussian white noise
- the decoding algorithm used to obtain these curves is an EMS (for Extended Min Sum) type algorithm well known to those skilled in the art and which is described in detail in the document entitled " Simplified algorithms for the decoding of non-binary LDPC codes "by A.voicingla, D. Declercq, M.Fossorier and F.Verdier, GRETSI, Louvain-la-Neuve, Belgium, September 2005 .
- This algorithm is a suboptimal algorithm intended to reduce the complexity of the decoding. For each decoding iteration, the variable nodes and the parity nodes exchange only the n m most reliable LLR values.
- the third curve illustrating the performance of a theoretical AWGN channel corresponds to the transmission of a code of length 196x64 bits and a coding rate of 3/64. These two values correspond respectively to the effective code length and to the effective coding rate of the NB-LDPC coding with CCSK modulation.
- CCSK modulation improves the decoding performance. This improvement is explained by the diversity introduced by the CCSK modulation. CCSK modulation increases the effective code length and goes from 192x6 bits without CCSK modulation to 192x64 chips with CCSK modulation.
- the calculation of the values of LLR is carried out in the frequency domain via FFT and IFFT operations.
- This property of CCSK modulation is very interesting in the field of wireless communication systems using a single carrier with equalization in the frequency domain or SC-FDE (for Single Carrier-Frequency Domain Equalization).
- SC-FDE Single Carrier-Frequency Domain Equalization
- the values of FFT calculated for the received signal can then be used both for the calculation of the values of LLR and the frequency equalization.
- this gives single-carrier systems of type SC-FDE an advantage over multi-carrier systems of type OFDM (for Orthogonal Frequency Division Multiplexing in English) in which the equalization is carried out. on a temporal representation of the received signal.
- an NB-LDPC encoder performs an encoding step (step 100 for the SC-FDE system; step 200 for the OFDM system).
- This coding step consists in particular in adding redundancy in the input data so as to generate code words each comprising a predetermined number of symbols of the Galois body GF (q).
- Each code word symbol is then converted (step 110; step 210) to a CCSK sequence having a length greater than or equal to q chips.
- the CCSK sequences are then used to modulate a carrier during a BPSK modulation step (step 120; step 220).
- a cyclic prefix CP insertion (step 130) is performed after the carrier modulation step.
- This step comprises a serial / parallel conversion step 131, a cyclic prefix insertion step 132 proper and a reverse conversion step 133.
- the cyclic prefix CP is thus added directly to each symbol modulated in BPSK, called symbol SC.
- a q-point inverse fast Fourier transform (step 234) is applied to the BPSK modulated CCSK sequence to obtain OFDM symbols of q elements to which a cyclic prefix is added (step 232 ).
- a serial parallel conversion (step 233) is then performed after the insertion.
- the cyclic prefix is a symbol extension obtained by copying the last elements of each SC or OFDM symbol and placing them in front of the symbol.
- the length of the cyclic prefix is preferably greater than the maximum delay of the multipath channel.
- the effect of inter-symbol interference generated by one symbol on the next symbol is then confined within the cyclic prefix of the latter so that it will not affect the FFT of the next symbol.
- the SC and OFDM symbols are then transmitted (step 140; step 240) through a multipath channel to a remote receiver. Once the cyclic prefix is removed on reception, the received signal is convolved circularly with the impulse response of the channel so that the frequency equalization is done by dividing the fast Fourier transform of the signal received by the transfer function of the channel.
- the receiver receives (step 150 for the SC-FDE system; step 250 for the OFDM system) the transmitted symbols then performs a cyclic prefix deletion step (step 160; step 260), a serial-to-parallel conversion step (step 170). ; step 270) preceding an overall step of equalization and calculation of the LLR values (step 180; step 280).
- the calculated LLR values are then decoded by an NB-LDPC decoder (step 190; step 290).
- step 180 includes a single FFT step 181 serving both for equalizing and for calculating LLR values (step 182).
- An IFFT operation (step 183) is then applied to obtain the values of LLR.
- step 280 comprises two FFT steps, a first FFT step 281 preceding the equalization step 282 and a second FFT step 283 preceding the step of calculating the values of LLR 284.
- An IFFT step 285 is finally applied to obtain the values of LLR.
- the equalization is of the MMSE type (for Minimum Mean Square Error in English).
- the computation of the correlations is then carried out in the frequency domain.
- the equalized samples are thus transposed into the frequency domain by step 283 and the calculation of the correlations is then carried out by multiplying the FFT of Z by the conjugated FFT of the sequence PN 0 modulated in BPSK.
- the vector of correlation values is obtained by means of IFFT.
- a normalization makes it possible to obtain the vector of the values of LLR.
- ⁇ m H m ⁇ ⁇ H m ⁇ + ⁇ 2 ⁇ m ⁇ 0 , q - 1
- the vector of correlation values is then obtained by applying an IFFT to Z (step 285).
- the vector of LLR values is obtained by normalizing the vector of correlation values.
- the frequency equalization step and the step of calculating the values of the correlations can be merged into a single step.
- a single FFT step is then necessary on reception.
- the use of CCSK modulation is therefore particularly advantageous in single-carrier systems.
- the figure 7 illustrates the decoding performance of these two systems, SC-FDE and OFDM.
- This figure represents simulation results in the form of curves.
- a first curve represents the results of the OFDM system and a second curve represents the results of the SC-FDE system.
- the LDPC code used is set to GF (64), 1008 bits long and 1/2 performance.
- the EMS algorithm has the same parameters as those used for the simulations of the figure 4 . It is observed that the performances in terms of BER bit error rate are almost identical in the two systems.
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Description
- La présente invention concerne un procédé de transmission de symboles de mots de code correcteur d'erreur non binaire en vue de leur transmission dans un canal de communication. Ces codes sont définis sur des ensembles non binaires. L'invention trouve par exemple une application dans la transmission de codes LDPC (Low Density Parity Check en langue anglaise) non binaires ou de codes de Reed-Salomon. L'invention concerne également le signal correspondant transmis et la réception d'un tel signal.
- L'invention sera plus particulièrement décrite dans le cadre de codes LDPC non binaires. Les codes LDPC sont des codes correcteurs d'erreur connus pour approcher la limite théorique de Shannon. En raison de leurs performances en termes d'immunité au bruit, les codes LDPC, et notamment les codes LDPC non binaires, peuvent trouver une application dans de nombreux systèmes, par exemple dans les systèmes de communication sans fil, la fibre optique, le câble, les systèmes de stockage de données numériques...
- Les codes LDPC non binaires, appelés aussi codes NB-LDPC, sont construits dans un corps de Galois non binaire d'ordre q, noté classiquement GF(q). L'ordre q est généralement une puissance de 2, par exemple q=2p. Un code LDPC dans GF(q) est défini par une matrice de parité H creuse de dimension A x B dont les éléments appartiennent à GF(q), A étant le nombre de contraintes de parité et B étant le nombre d'éléments de GF(q) dans le mot de code. Pour un corps de Galois GF(4) composé de 4 éléments {0, α0, α1, α2}, la matrice de parité pour A=3 et B=6 est par exemple la suivante:
- Cette matrice peut également être représentée par un graphe bipartite (graphe de Tanner) ayant A nœuds de parité et B nœuds de variable recevant les symboles du mot de code. Chaque colonne de la matrice de parité est associée à un nœud de variable et chaque ligne de la matrice est associée à un nœud de parité.
- En vue de leur transmission dans un canal de communication qui est généralement bruité, il est connu de moduler les codes LDPC non binaires avec une modulation M-aire orthogonale à étalement de spectre comme décrit dans le document intitulé "Combine Non-Binary LDPC codes with M-ary Orthogonal spread spectrum modulation" Yu-zhen Huang, Yun-peng Cheng, Yu-ming Zhang, Guo-hai Yu, Jin Chen, 2010 International Conférence on Wireless Communications and Signal Processing (WCSP), 2010. L'utilisation d'une modulation à étalement de spectre permet notamment d'avoir une meilleure immunité aux bruits.
- Ce document divulgue plus particulièrement de moduler les symboles des mots de code NB-LDPC avec une modulation orthogonale à étalement de spectre utilisant 2M séquences de Walsh-Hadamard orthogonales entre elles, avec 2M égal à l'ordre q(=2p) du corps de Galois GF(q) des codes LDPC non binaires et M égal au nombre p de bits de chacun des symboles du corps de Galois GF(q). La taille 2M de la constellation de la modulation orthogonale est prise égale au nombre q=2p de symboles du corps des codes NB-LDPC pour qu'il n'y ait pas de perte d'information à la démodulation. Dans ce document, la démodulation est relativement complexe à réaliser puisqu'elle nécessite de faire des calculs d'inter-corrélation (ou "cross-correlations" en langue anglaise) entre chacune des 2p séquences de Walsh-Hadamard et le signal bruité, ce qui représente un coût en termes d'implémentation. Dans ce document, la démodulation est réalisée au moyen de 2p filtres adaptés associés chacun à une séquence de Walsh-Hadamard prédéterminée.
- Le document Chi-Han Kao et al.: "Performance analysis and simulations of 32-ary cyclic code-shift keying", décrit l'utilisation d'une modulation CCSK.
- Un but de l'invention est de pallier l'inconvénient précité.
- Selon l'invention, on propose d'utiliser une modulation à décalage de code cyclique (ou CCSK pour Cyclic Code-Shift Keying en langue anglaise), au lieu d'une modulation M-aire orthogonale, pour étaler le spectre du signal émis.
- Plus particulièrement, l'invention concerne un procédé de transmission de symboles de mot de code correcteur d'erreur non binaire à travers un canal de transmission, chaque symbole de mot de code comprenant p bits, lequel procédé comprend une première étape de modulation associant à chaque symbole de mot de code de p bits une séquence d'au moins 2p bribes parmi 2p séquences possibles, une deuxième étape de modulation pour moduler la phase ou l'amplitude d'au moins une porteuse avec les séquences associées aux mots de code et une étape de transmission de la porteuse modulée à travers ledit canal de transmission, remarquable en ce que la première étape de modulation est une modulation à étalement de spectre de type modulation par décalage de code cyclique utilisant une séquence pseudo-aléatoire de base d'au moins 2p bribes, les 2p séquences possibles étant obtenues par décalage circulaire de la séquence pseudo-aléatoire de base et en ce que le procédé comprend en outre, après ladite deuxième étape de modulation, une étape d'insertion d'un préfixe cyclique dans chaque symbole à transmettre.
- Avec ce procédé, la démodulation en réception peut être effectuée par des opérations simples de transformée de Fourier rapide (OU FFT en langue anglaise) et de transformée de Fourier rapide inverse (ou IFFT en langue anglaise). Par ailleurs, ce procédé ne requiert qu'un seul générateur pseudo-aléatoire pour générer les 2p séquences.
- La séquence pseudo-aléatoire de base est générée, au moins partiellement, par un registre à décalage rebouclé implémentant un polynôme primitif d'ordre p.
- Les mots de code traités sont par exemple des mots de code LDPC non binaire ou des mots de code de Reed Salomon non binaire.
- L'invention concerne également un dispositif d'émission de symboles de mots de code correcteur d'erreur non binaire à travers un canal de transmission, chaque symbole de mot de code comprenant p bits, lequel dispositif comprend un premier modulateur associant à chaque symbole de mot de code de p bits une séquence d'au moins 2p bribes parmi 2p séquences possibles, un deuxième modulateur pour moduler la phase ou l'amplitude d'une porteuse avec les séquences associées aux mots de code, et un émetteur pour transmettre la porteuse modulée à travers ledit canal de transmission, remarquable en ce que le premier modulateur est un modulateur à étalement de spectre de type à décalage de code cyclique utilisant une séquence pseudo-aléatoire de base d'au moins 2p bribes, les 2p séquences possibles étant obtenues par décalage circulaire de la séquence pseudo-aléatoire de base et ce qu'il comporte en outre un circuit apte à insérer un préfixe cyclique dans chaque symbole à transmettre.
- L'invention concerne aussi un signal de code correcteur d'erreur non binaire destiné à être transmis par le procédé défini précédemment.
- L'invention concerne également un procédé de réception d'un signal de code correcteur d'erreur non binaire transmis sur une porteuse unique par le procédé défini précédemment, caractérisé en ce qu'il comprend une étape de réception du signal, une étape de suppression du préfixe cyclique de chaque symbole, une étape de transformée de Fourier rapide du signal reçu pour générer des échantillons dans le domaine fréquentiel, et une étape d'égalisation fréquentielle et de calcul de valeurs de logarithmes de rapport de vraisemblance desdits échantillons.
- En effet, l'utilisation de la modulation par décalage de code cyclique et l'insertion d'un préfixe cyclique dans chaque symbole à transmettre est plus particulièrement adaptée aux systèmes de communication sans fil à porteuse unique car l'égalisation fréquentielle et le calcul des valeurs de logarithmes de rapport de vraisemblance peuvent alors être réalisés par les mêmes opérations de FFT et IFFT.
- Enfin, l'invention concerne également un dispositif de réception d'un signal de code correcteur d'erreur non binaire transmis sur une porteuse unique par le dispositif d'émission défini précédemment, caractérisé en ce qu'il comprend un récepteur du signal transmis, un circuit apte à supprimer le préfixe cyclique de chaque symbole, un circuit de transformée de Fourier rapide du signal reçu pour générer des échantillons dans le domaine fréquentiel, et un circuit d'égalisation fréquentielle et de calcul de valeurs de logarithmes de rapport de vraisemblance desdits échantillons.
- L'invention sera mieux comprise, et d'autres buts, détails, caractéristiques et avantages apparaîtront plus clairement au cours de la description explicative détaillée qui va suivre, en se référant ci-dessus aux dessins annexés, lesquels représentent:
- la
figure 1 , un schéma fonctionnel d'un traitement de signal conforme à l'invention comprenant une étape de modulation CCSK utilisant une séquence pseudo-aléatoire de base; - la
figure 2 , une courbe illustrant la corrélation d'une séquence pseudo-aléatoire de base avec une version décalée de cette séquence; - la
figure 3 , un schéma fonctionnel illustrant le calcul des valeurs de logarithme de rapport de vraisemblance en réception; - la
figure 4 , des courbes illustrant le taux d'erreur par trame en réception, avec et sans modulation CCSK en transmission, pour un canal gaussien; - la
figure 5 , un diagramme fonctionnel illustrant l'émission et la réception de codes NB-LDPC à travers un canal à trajets multiples, dans le cas d'une modulation à porteuse unique précédée d'une modulation CCSK; - la
figure 6 , un diagramme fonctionnel illustrant l'émission et la réception de codes NB-LDPC à travers un canal à trajets multiples, dans le cas d'une modulation OFDM précédée d'une modulation CCSK; et - la
figure 7 , des courbes illustrant le taux d'erreur binaire en réception dans le cas de la modulation à porteuse unique et le cas de la modulation OFDM. - Selon l'invention, il est proposé de moduler les symboles des mots de code NB-LDPC délivrés par un codeur NB-LDPC avec une modulation par décalage de code cyclique, appelée couramment modulation CCSK (pour "Cyclic Code Shift Keying" en langue anglaise), utilisant une séquence pseudo-aléatoire comprenant au moins 2p bribes (ou "chips" en langue anglaise). Le terme bribe désigne une information binaire dans le code d'une modulation à étalement de spectre.
- La
figure 1 illustre les étapes du procédé de l'invention. Selon une étape référencée 110, les codes NB-LDPC sont modulés avec une modulation CCSK dont la fonction est d'associer à chaque symbole de mot de code NB-LDPC de p bits une séquence pseudo-aléatoire comprenant 2p bribes. Puis, selon une étape référencée 120, les séquences issues de l'étape 110 sont modulées par une modulation numérique, dont la fonction est de moduler au moins une porteuse avec les séquences produites issues de l'étape 110. Dans l'exemple de lafigure 1 , la modulation de l'étape 120 est une modulation BPSK (pour "Binary Phase-Shift Keying" en langue anglaise). Dans cet exemple, les séquences produites à l'étape 110 modulent la phase de la porteuse. Des modulations, autres que la modulation BPSK, modulant la phase ou l'amplitude de la porteuse sont bien entendu possibles pour l'étape 120. - Pendant l'étape 110, à chaque symbole de p bits est associée une séquence d'au moins 2p bribes. Plus particulièrement, chaque symbole de p bits est converti en une séquence particulière obtenue par décalage circulaire d'une séquence pseudo-aléatoire de base notée PN0. Ainsi, les calculs à effectuer en réception pour déterminer la séquence transmise sont des calculs d'autocorrélation. Ces calculs d'autocorrélation peuvent être exécutés par des opérations de FFT et IFFT, ce qui contribue à simplifier le traitement de signal en réception.
- Un exemple de modulation CCSK est décrit ci-après pour des symboles de 6 bits appartenant au corps de Galois GF(64=26). Comme les symboles comportent 6 bits, la séquence pseudo-aléatoire doit comprendre au moins 64=26 bribes pour qu'il n'y ait pas de perte d'information. La séquence pseudo-aléatoire de base PN0 est sélectionnée de manière à présenter de bonnes performances en termes d'auto-corrélation. Plusieurs méthodes sont connues dans la littérature pour y parvenir. Dans le cas présent, une séquence de 63 bribes est générée par un registre à décalage rebouclé, aussi appelé registre LFSR (pour Linear feedback Shift Register en langue anglaise), à laquelle on rajoute une bribe supplémentaire pour obtenir une séquence pseudo-aléatoire de 64 bribes. Ce bit supplémentaire est rajouté à n'importe quel emplacement dans la séquence. D'autres méthodes de génération de séquences pseudo-aléatoires sont possibles.
- La séquence pseudo-aléatoire de base PN0 est par exemple la séquence suivante de 64 bits:
1000001000011000101001111010001110010010110111011001101010111111 - Cette séquence est générée par un registre LFSR implémentant le polynôme irréductible P(x)=1+x+x6 et un bit supplémentaire.
- Les propriétés d'auto-corrélation de cette séquence PN0 sont illustrées par la courbe de la
figure 2 obtenue avec une modulation BPSK telle que BPSK(x)=1-2x avec x ∈ {0, 1}. Comme on peut le voir sur cette figure, l'auto-corrélation de cette séquence pseudo-aléatoire de base, après modulation BPSK, présente un pic principal unique lorsque le décalage est nul et des pics secondaires non nuls. On peut donc en déduire que la modulation CCSK n'est pas orthogonale. Par ailleurs, cette séquence présente de bonnes performances d'autocorrélation puisque la distance entre le pic principal et les pics secondaires (décalages de 24, 32 et 40 bribes) est relativement grande. - A partir de cette séquence PN0, on génère 63 autres séquences en décalant circulairement la séquence PN0, chaque séquence étant associée à un élément du corps de Galois GF(64). La séquence PN0 est associée à l'élément nul du corps de Galois GF(64). Les autres éléments αk de GF(64), avec k E [0,62], sont obtenus en décalant circulairement la séquence PN0 de k+1 positions vers la droite.
- Le tableau récapitulatif ci-dessous montre les séquences de 64 bribes associées à chacun des éléments du corps de Galois GF(64):
Symboles de GF(64=26) Représentation binaire des éléments Séquences CCSK de 64 bribes 0 000000 1000001000011000101001111010001110010010110111011001101010111111 α0 000001 1100000100001100010100111101000111001001011011101100110101011111 α1 000010 1110000010000110001010011110100011100100101101110110011010101111 α2 000100 1111000001000011000101001111010001110010010110111011001101010111 α3 001000 1111100000100001100010100111101000111001001011011101100110101011 α4 010000 1111110000010000110001010011110100011100100101101110110011010101 α5 100000 1111111000001000011000101001111010001110010010110111011001101010 α6 000011 0111111100000100001100010100111101000111001001011011101100110101 α7 000110 1011111110000010000110001010011110100011100100101101110110011010 α8 001100 0101111111000001000011000101001111010001110010010110111011001101 α9 011000 1010111111100000100001100010100111101000111001001011011101100110 α10 110000 0101011111110000010000110001010011110100011100100101101110110011 α11 100011 1010101111111000001000011000101001111010001110010010110111011001 α12 000101 1101010111111100000100001100010100111101000111001001011011101100 α13 001010 0110101011111110000010000110001010011110100011100100101101110110 α14 010100 0011010101111111000001000011000101001111010001110010010110111011 α15 101000 1001101010111111100000100001100010100111101000111001001011011101 α16 010011 1100110101011111110000010000110001010011110100011100100101101110 α17 100110 0110011010101111111000001000011000101001111010001110010010110111 α18 001111 1011001101010111111100000100001100010100111101000111001001011011 α19 011110 1101100110101011111110000010000110001010011110100011100100101101 α20 111100 1110110011010101111111000001000011000101001111010001110010010110 α21 111011 0111011001101010111111100000100001100010100111101000111001001011 α22 110101 1011101100110101011111110000010000110001010011110100011100100101 α23 101001 1101110110011010101111111000001000011000101001111010001110010010 α24 010001 0110111011001101010111111100000100001100010100111101000111001001 α25 100010 1011011101100110101011111110000010000110001010011110100011100100 α26 000111 0101101110110011010101111111000001000011000101001111010001110010 α27 001110 0010110111011001101010111111100000100001100010100111101000111001 α28 011100 1001011011101100110101011111110000010000110001010011110100011100 α29 111000 0100101101110110011010101111111000001000011000101001111010001110 α30 110011 0010010110111011001101010111111100000100001100010100111101000111 α31 100101 1001001011011101100110101011111110000010000110001010011110100011 α32 001001 1100100101101110110011010101111111000001000011000101001111010001 α33 010010 1110010010110111011001101010111111100000100001100010100111101000 α34 100100 0111001001011011101100110101011111110000010000110001010011110100 α35 001011 0011100100101101110110011010101111111000001000011000101001111010 α36 010110 0001110010010110111011001101010111111100000100001100010100111101 α37 101100 1000111001001011011101100110101011111110000010000110001010011110 α38 011011 0100011100100101101110110011010101111111000001000011000101001111 α39 110110 1010001110010010110111011001101010111111100000100001100010100111 α40 101111 1101000111001001011011101100110101011111110000010000110001010011 α41 011101 1110100011100100101101110110011010101111111000001000011000101001 α42 111010 1111010001110010010110111011001101010111111100000100001100010100 α43 110111 0111101000111001001011011101100110101011111110000010000110001010 α44 101101 0011110100011100100101101110110011010101111111000001000011000101 α45 011001 1001111010001110010010110111011001101010111111100000100001100010 α46 110010 0100111101000111001001011011101100110101011111110000010000110001 α47 100111 1010011110100011100100101101110110011010101111111000001000011000 α48 1001101 0101001111010001110010010110111011001101010111111100000100001100 α49 011010 0010100111101000111001001011011101100110101011111110000010000110 α50 110100 0001010011110100011100100101101110110011010101111111000001000011 α51 101011 1000101001111010001110010010110111011001101010111111100000100001 α52 010101 1100010100111101000111001001011011101100110101011111110000010000 α53 101010 0110001010011110100011100100101101110110011010101111111000001000 α54 010111 0011000101001111010001110010010110111011001101010111111100000100 α55 101110 0001100010100111101000111001001011011101100110101011111110000010 α56 011111 0000110001010011110100011100100101101110110011010101111111000001 α57 111110 1000011000101001111010001110010010110111011001101010111111100000 α58 111111 0100001100010100111101000111001001011011101100110101011111110000 α59 111101 0010000110001010011110100011100100101101110110011010101111111000 α60 111001 0001000011000101001111010001110010010110111011001101010111111100 α61 110001 0000100001100010100111101000111001001011011101100110101011111110 α62 100001 0000010000110001010011110100011100100101101110110011010101111111 - Nous allons à présent décrire la démodulation du signal ainsi modulé après transmission du signal dans un canal bruité et plus particulièrement dans un canal de Rayleigh à évanouissements lents non sélectif en fréquence.
- Dans la suite de la description, on utilise les notations suivantes:
- X ∈ GF (64) est un symbole quelconque de mot de code;
- Y = [y0, y1, ..., y63] est le signal BPSK d'une séquence CCSK quelconque;
-
-
-
- Z = [z0, z1, ..., z63] est le signal bruité reçu avec
-
- ni est un échantillon de bruit blanc gaussien blanc ou AWGN (pour Additive White Gaussian Noise en langue anglaise) comprenant des échantillons indépendants et identiquement distribués ayant une moyenne nulle et une densité spectrale de puissance N0/2; et
- hi est décrit par la fonction de densité de probabilité de Rayleigh suivante:
H=[h0, h1, ..., h63] désigne l'ensemble des facteurs de Rayleigh associé à un symbole reçu de 64 bribes. Si hi=1 ∀i∈ [0, 63], le canal est un canal AWGN. - Par ailleurs, l'état du canal de transmission est supposé connu par le dispositif de réception. La transmission des informations d'état du canal est considérée comme idéale. En réception, chaque signal zi est égalisé par le facteur hi associé.
- Pour décoder le signal reçu, le décodeur doit recevoir en entrée des valeurs de logarithme de rapport de vraisemblance ou valeurs LLR (pour Log-Likelihood Ratio en langue anglaise). L'expression mathématique de ces valeurs LLR est la suivante :
On obtient alors: - Chacune des deux sommes dans l'expression ci-dessus est la corrélation entre le signal reçu pondéré par les coefficients de Rayleigh et une des séquences CCSK possibles. Par conséquent, il est possible de calculer les LLRs en utilisant des opérations de FFT et IFFT comme représenté sur la
figure 3 . - On calcule le conjugué complexe de la FFT de la séquence Y0 et la FFT du signal reçu Z pondéré par les coefficients de Rayleigh H. L'IFFT du produit de ces deux résultats est ensuite calculée pour obtenir les valeurs de corrélation requises, soit Z ⊗ Yk. On soustrait enfin la valeur de corrélation de Z ⊗ Y0 des valeurs de corrélations Z ⊗ Yk pour obtenir la valeur LLR (Xk). Dans cet exemple, on obtient LLR(X0)=0. En variante, il est possible de remplacer dans l'expression (1) de LLR(Xk) le terme P(Z/(H,X=X0)) par le terme ayant la plus faible valeur. Dans ce cas, les valeurs des LLRs sont toutes positives.
- Les performances de ce traitement sont illustrées par les courbes de la
figure 4 . Le taux d'erreur par trame FER (pour Frame Error Rate en langue anglaise) est évalué sur un canal affecté par un bruit blanc gaussien additif (AWGN) avec ou sans modulation CCSK. - L'algorithme de décodage employé pour obtenir ces courbes est un algorithme de type EMS (pour Extended Min Sum en langue anglaise) bien connu de l'homme du métier et qui est décrit de manière détaillée dans le document intitulé "Algorithmes simplifiés pour le décodage de codes LDPC non binaires" de A.Voicila, D.Declercq, M.Fossorier et F.Verdier, GRETSI, Louvain-la-Neuve, Belgique, Septembre 2005. Cet algorithme est un algorithme sous-optimal destiné à réduire la complexité du décodage. Pour chaque itération de décodage, les nœuds de variable et les nœuds de parité n'échangent que les nm valeurs LLR les plus fiables.
- La
figure 4 présente des résultats de simulation sous forme de courbes: - une première courbe illustre les performances du décodage sans modulation CCSK;
- une deuxième courbe illustre les performances du décodage avec modulation CCSK; et
- une troisième courbe illustre les performances d'un canal théorique AWGN.
- Les simulations sont réalisées avec les paramètres de codage et de décodage suivants:
- les codes NB-LDPC appartiennent au corps de Galois GF(64);
- la longueur des codes NB-LDPC est égal à 192 symboles, soit 192x6 bits;
- le taux de codage (rapport entre les bits d'information utile et l'ensemble des bits transmis) est égal à 0,5;
- le degré des lignes et le degré des colonnes de la matrice de parité employée pour le codage et le décodage sont respectivement de 4 et de 2;
- l'algorithme EMS ne prend en compte que les 24 valeurs de LLR les plus fiables;
- le nombre maximum d'itérations pour le décodage est limité à 8; et
- la séquence pseudo-aléatoire employée pour la modulation CCSK est la séquence PN0 défini précédemment.
- La troisième courbe illustrant les performances d'un canal AWGN théorique correspond à la transmission d'un code de longueur 196x64 bits et un taux de codage de 3/64. Ces deux valeurs correspondent respectivement à la longueur de code effective et au taux de codage effectif du codage NB-LDPC avec modulation CCSK.
- Ces courbes donnent le taux d'erreur par trame FER en fonction du rapport Eb/N0 exprimé en décibels, où Eb est l'énergie transmise par bit et N0 est la densité spectrale du bruit.
- A partir de ces courbes, on observe que la modulation CCSK améliore les performances du décodage. Cette amélioration s'explique par la diversité introduite par la modulation CCSK. La modulation CCSK augmente la longueur de code effective et on passe de 192x6 bits sans modulation CCSK à 192x64 bribes avec modulation CCSK.
- Par ailleurs, comme indiqué précédemment, le calcul des valeurs de LLR est effectué dans le domaine fréquentiel via des opérations de FFT et de IFFT. Cette propriété de la modulation CCSK est très intéressante dans le domaine des systèmes de communication sans fil utilisant une porteuse unique avec égalisation dans le domaine fréquentiel ou SC-FDE (pour Single Carrier-Frequency Domain Equalization en langue anglaise). En effet, les valeurs de FFT calculés pour le signal reçu peuvent alors servir à la fois pour le calcul des valeurs de LLR et l'égalisation fréquentielle. Dans le domaine des systèmes de communication sans fil, cela procure aux systèmes à porteuse unique de type SC-FDE un avantage sur les systèmes à porteuses multiples de type OFDM (pour Orthogonal Frequency Division Multiplexing en langue anglaise) dans lesquels l'égalisation est effectuée sur une représentation temporelle du signal reçu.
- Cet avantage est illustré par les
figures 5 et 6 qui représentent respectivement le schéma fonctionnel d'un système SC-FDE et le schéma fonctionnel d'un système OFDM, ces deux systèmes comportant une étape de modulation CCSK et une étape d'égalisation. - Dans les deux systèmes, un codeur NB-LDPC effectue une étape de codage (étape 100 pour le système SC-FDE; étape 200 pour le système OFDM). Cette étape de codage consiste notamment à rajouter de la redondance dans les données d'entrée de manière à générer des mots de code comprenant chacun un nombre prédéterminé de symboles du corps de Galois GF(q). Chaque symbole de mot de code est ensuite converti (étape 110; étape 210) en une séquence CCSK ayant une longueur supérieure ou égale à q bribes. Les séquences CCSK sont ensuite utilisées pour moduler une porteuse pendant une étape de modulation BPSK (étape 120; étape 220).
- Dans le système SC-FDE (
figure 5 ), une insertion de préfixe cyclique CP (étape 130) est réalisée après l'étape de modulation de porteuse. Cette étape comprend une étape 131 de conversion série/parallèle, une étape 132 d'insertion de préfixe cyclique proprement dite et une étape 133 de conversion inverse. Le préfixe cyclique CP est ainsi ajouté directement à chaque symbole modulé en BPSK, appelé symbole SC. - Dans le système OFDM (
figure 6 ), après conversion série/parallèle (étape 231), une transformée de Fourier rapide Inverse à q points (étape 234) est appliquée à la séquence CCSK modulée BPSK pour obtenir des symboles OFDM de q éléments auxquels on ajoute un préfixe cyclique (étape 232). Une conversion parallèle série (étape 233) est réalisée ensuite après l'insertion. Dans les deux systèmes, le préfixe cyclique est une extension de symbole obtenue en copiant les derniers éléments de chaque symbole SC ou OFDM et à les placer devant le symbole. La longueur du préfixe cyclique est de préférence supérieure au retard maximum du canal à trajets multiples. L'effet des interférences inter-symbole engendrées par un symbole sur le symbole suivant est alors confiné à l'intérieur du préfixe cyclique de ce dernier de sorte qu'il n'affectera pas la FFT du symbole suivant. Les symboles SC et OFDM sont ensuite transmis (étape 140; étape 240) à travers un canal à trajets multiples vers un récepteur distant. Une fois le préfixe cyclique supprimé en réception, le signal reçu est convolué circulairement avec la réponse impulsionnelle du canal de sorte que l'égalisation fréquentielle se fait en divisant la transformée de Fourier rapide du signal reçu par la fonction de transfert du canal. - Le récepteur reçoit (étape 150 pour le système SC-FDE; étape 250 pour le système OFDM) les symboles transmis puis effectue une étape de suppression de préfixe cyclique (étape 160; étape 260), une étape de conversion série-parallèle (étape 170; étape 270) précédant une étape globale d'égalisation et de calcul des valeurs LLR (étape 180; étape 280). Les valeurs LLR calculées sont ensuite décodées par décodeur NB-LDPC (étape 190; étape 290).
- Les étapes 180 et 280 d'égalisation et de calcul des valeurs LLR sont différentes. Dans le système SC-FDE, l'étape 180 comporte une étape 181 unique de FFT servant à la fois à l'égalisation et au calcul des valeurs de LLR (étape 182). Une opération IFFT (étape 183) est ensuite appliquée pour obtenir les valeurs de LLR. Dans le système OFDM, l'étape 280 comporte deux étapes FFT, une première étape FFT 281 précédant l'étape d'égalisation 282 et une deuxième étape de FFT 283 précédant l'étape de calcul des valeurs de LLR 284. Une étape de IFFT 285 est enfin appliquée pour obtenir les valeurs de LLR.
- L'égalisation et le calcul des valeurs de LLR sont décrits ci-après pour les deux systèmes. Pour ces étapes, on utilise les notations suivantes:
- x désigne la séquence CCSK modulée en BPSK;
- xOFDM = IFFT(x) est le symbole OFDM associé à x;
- xSC = x est le symbole SC;
- yOFDM est le symbole OFDM reçu après suppression du préfixe cyclique;
- ySC est le symbole SC reçu après suppression du préfixe cyclique;
- h est la réponse impulsionnelle du canal; et
- n est un vecteur de q réalisations de bruit gaussien complexe.
- L'égalisation est de type MMSE (pour Minimum Mean Square Error en langue anglaise).
-
-
-
- Le calcul des corrélations est ensuite effectué dans le domaine fréquentiel. Les échantillons égalisés sont ainsi transposés dans le domaine fréquentiel par l'étape 283 et le calcul des corrélations est ensuite effectué en multipliant la FFT de Z par la FFT conjuguée de la séquence PN0 modulée en BPSK. Le vecteur des valeurs de corrélation est obtenu au moyen de la IFFT. Enfin, une normalisation permet d'obtenir le vecteur des valeurs de LLR.
-
-
-
- Le vecteur de valeurs de corrélation est ensuite obtenu en appliquant à Z une IFFT (étape 285). Le vecteur des valeurs de LLR est obtenu en normalisant le vecteur des valeurs de corrélation.
- Ainsi, dans le cas d'un système à porteuse unique, l'étape d'égalisation fréquentielle et l'étape de calcul des valeurs des corrélations peuvent être fusionnées en une étape unique. Une seule étape de FFT est alors nécessaire en réception. L'utilisation de la modulation CCSK est donc particulièrement avantageuse dans les systèmes à porteuse unique.
- La
figure 7 illustre les performances de décodage de ces deux systèmes SC-FDE et OFDM. Cette figure représente des résultats de simulation sous forme de courbes. Une première courbe représente les résultats du système OFDM et une deuxième courbe représente les résultats du système SC-FDE. Le code LDPC utilisé est défini sur GF(64), de longueur 1008 bits et de rendement 1/2. L'algorithme EMS possède les mêmes paramètres que ceux employés pour les simulations de lafigure 4 . On observe que les performances en termes de taux d'erreur binaire BER sont quasi-identiques dans les deux systèmes. - Il en résulte que, compte tenu de leur faible coût d'implémentation (1 seul générateur pseudo-aléatoire en émission; une seule opération de FFT en réception), les systèmes à porteuse unique employant des codes NB-LDPC et une modulation CCSK peuvent être considérés comme une solution très intéressante pour les systèmes de communication sans fil du futur. Ces systèmes présentent par ailleurs un facteur crête, noté couramment PAPR (pour Peak-to-Average Power ratio en langue anglaise), plus faible que les systèmes OFDM. Cela permet de réduire la puissance d'émission des signaux et d'employer des amplificateurs plus petits et moins chers fonctionnant linéairement sur toute la gamme de variation du signal par rapport aux systèmes OFDM. Cela permet également de réduire la consommation électrique du système.
Claims (5)
- Procédé de transmission de symboles de mot de code correcteur d'erreur non binaire à travers un canal de transmission, chaque symbole de mot de code comprenant p bits, lequel procédé comprend- une première étape de modulation (110) associant à chaque symbole de mot de code de p bits une séquence d'au moins 2P bribes parmi 2P séquences possibles,- une deuxième étape de modulation (120) pour moduler la phase ou l'amplitude d'au moins une porteuse avec les séquences associées aux mots de code et générer des symboles modulés, et- une étape de transmission (140) de la porteuse modulée à travers ledit canal de transmission,
dans lequel la première étape de modulation est une modulation à étalement de spectre de type modulation par décalage de code cyclique utilisant une séquence pseudo-aléatoire de base d'au moins 2P bribes, les 2P séquences possibles étant obtenues par décalage circulaire de la séquence pseudo-aléatoire de base et
caractérisé en ce que les symboles modulés générés lors de la deuxième étape de modulation sont de taille égale à celle des séquences, et
en ce que le procédé comprend en outre, après ladite deuxième étape de modulation, une étape d'insertion d'un préfixe cyclique (130) dans chaque symbole à transmettre. - Dispositif d'émission de symboles de mots de code correcteur d'erreur non binaire à travers un canal de transmission selon le procédé de transmission de la revendication 1, chaque symbole de mot de code comprenant p bits, lequel dispositif comprend- un premier modulateur configuré pour associer à chaque symbole de mot de code de p bits une séquence d'au moins 2P bribes parmi 2P séquences possibles,- un deuxième modulateur configuré pour moduler la phase ou l'amplitude d'une porteuse avec les séquences associées aux mots de code et générer des symboles modulés, et- un émetteur configuré pour transmettre la porteuse modulée à travers ledit canal de transmission,
dans lequel le premier modulateur est un modulateur à étalement de spectre de type à décalage de code cyclique utilisant une séquence pseudo-aléatoire de base d'au moins 2P bribes, les 2P séquences possibles étant obtenues par décalage circulaire de la séquence pseudo-aléatoire de base, et
caractérisé en ce que le deuxième modulateur est configuré de sorte que les symboles modulés générés sont de taille égale à celle des séquences, et
en ce que le dispositif comporte en outre un circuit apte à insérer un préfixe cyclique dans chaque symbole à transmettre. - Signal de code correcteur d'erreur non binaire destiné à être transmis selon le procédé de transmission de la revendication 1.
- Procédé de réception d'un signal de code correcteur d'erreur non binaire conforme à la revendication 3 et transmis sur une porteuse unique, comprenant:- une étape de réception (150) du signal,- une étape (160) de suppression du préfixe cyclique de chaque symbole transmis;- une étape de transformée de Fourier rapide (181) du signal reçu pour générer des échantillons dans le domaine fréquentiel, et- une étape d'égalisation fréquentielle et de calcul de valeurs de logarithmes de rapport de vraisemblance (182) desdits échantillons.
- Dispositif de réception d'un signal de code correcteur d'erreur non binaire conforme à la revendication 3 et transmis sur une porteuse unique, comprenant:- un récepteur du signal transmis,- un circuit apte à supprimer le préfixe cyclique de chaque symbole transmis,- un circuit de transformée de Fourier rapide du signal reçu configuré pour générer des échantillons dans le domaine fréquentiel, et- un circuit d'égalisation fréquentielle et de calcul de valeurs de logarithmes de rapport de vraisemblance desdits échantillons.
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