DE69330768T2 - Verfahren und Vorrichtung zum Betrieb eines Multiprozessor-Rechnersystems mit Cachespeichern - Google Patents
Verfahren und Vorrichtung zum Betrieb eines Multiprozessor-Rechnersystems mit CachespeichernInfo
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- Memory System Of A Hierarchy Structure (AREA)
Applications Claiming Priority (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US87392792A | 1992-04-24 | 1992-04-24 | |
US87427292A | 1992-04-24 | 1992-04-24 | |
US87392692A | 1992-04-24 | 1992-04-24 | |
US87429092A | 1992-04-24 | 1992-04-24 | |
US87426592A | 1992-04-24 | 1992-04-24 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE69330768D1 DE69330768D1 (de) | 2001-10-25 |
DE69330768T2 true DE69330768T2 (de) | 2002-07-04 |
Family
ID=27542277
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE69330768T Expired - Lifetime DE69330768T2 (de) | 1992-04-24 | 1993-04-26 | Verfahren und Vorrichtung zum Betrieb eines Multiprozessor-Rechnersystems mit Cachespeichern |
Country Status (2)
Country | Link |
---|---|
EP (1) | EP0567355B1 (de) |
DE (1) | DE69330768T2 (de) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5544342A (en) * | 1993-06-30 | 1996-08-06 | International Business Machines Corporation | System and method for prefetching information in a processing system |
US5557769A (en) * | 1994-06-17 | 1996-09-17 | Advanced Micro Devices | Mechanism and protocol for maintaining cache coherency within an integrated processor |
US5778431A (en) * | 1995-12-19 | 1998-07-07 | Advanced Micro Devices, Inc. | System and apparatus for partially flushing cache memory |
JP3590203B2 (ja) | 1996-07-16 | 2004-11-17 | 株式会社東芝 | 記憶手段の制御方法及びその装置 |
US6230230B1 (en) * | 1998-12-03 | 2001-05-08 | Sun Microsystems, Inc. | Elimination of traps and atomics in thread synchronization |
US6289420B1 (en) | 1999-05-06 | 2001-09-11 | Sun Microsystems, Inc. | System and method for increasing the snoop bandwidth to cache tags in a multiport cache memory subsystem |
US9547594B2 (en) * | 2013-03-15 | 2017-01-17 | Intel Corporation | Instructions to mark beginning and end of non transactional code region requiring write back to persistent storage |
GB2523804B (en) | 2014-03-06 | 2021-03-31 | Advanced Risc Mach Ltd | Transactional memory support |
US9983558B2 (en) | 2015-05-22 | 2018-05-29 | Goodrich Corporation | Control systems state vector management using co-processing and multiport ram |
US11507517B2 (en) | 2020-09-25 | 2022-11-22 | Advanced Micro Devices, Inc. | Scalable region-based directory |
CN115167933B (zh) * | 2022-09-08 | 2022-12-02 | 深圳市恒运昌真空技术有限公司 | 一种双处理器设备及其控制方法和处理器 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0680499B2 (ja) * | 1989-01-13 | 1994-10-12 | インターナショナル・ビジネス・マシーンズ・コーポレーション | マルチプロセッサ・システムのキャッシュ制御システムおよび方法 |
US5155824A (en) * | 1989-05-15 | 1992-10-13 | Motorola, Inc. | System for transferring selected data words between main memory and cache with multiple data words and multiple dirty bits for each address |
JPH03189845A (ja) * | 1989-12-13 | 1991-08-19 | Internatl Business Mach Corp <Ibm> | 階層メモリ・システムおよびキヤツシユ・メモリ・サブシステム |
EP0439952A3 (en) * | 1990-01-31 | 1992-09-09 | Sgs-Thomson Microelectronics, Inc. | Dual-port cache tag memory |
US5251310A (en) * | 1990-06-29 | 1993-10-05 | Digital Equipment Corporation | Method and apparatus for exchanging blocks of information between a cache memory and a main memory |
-
1993
- 1993-04-26 DE DE69330768T patent/DE69330768T2/de not_active Expired - Lifetime
- 1993-04-26 EP EP93303256A patent/EP0567355B1/de not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
EP0567355A2 (de) | 1993-10-27 |
DE69330768D1 (de) | 2001-10-25 |
EP0567355A3 (de) | 1995-04-12 |
EP0567355B1 (de) | 2001-09-19 |
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