DE4236609A1 - Verfahren zur Erzeugung einer Struktur in der Oberfläche eines Substrats - Google Patents
Verfahren zur Erzeugung einer Struktur in der Oberfläche eines SubstratsInfo
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Description
In vielen Anwendungen, z. B. bei der Herstellung von mikroelek
tronischen Schaltungsstrukturen oder bei der Erzeugung von Git
tern insbesondere für Oberflächenwellenfilter oder Halbleiter
laser, werden zur Erzeugung von Strukturen in der Oberfläche
eines Substrats lithographische Verfahren eingesetzt. Die
Strukturfeinheit wird dabei begrenzt durch das Auflösungsvermö
gen des für die Fotolithographie verwendeten Belichtungsgerä
tes.
Zur Herstellung feinerer Muster ist es bekannt, Belichtungsge
räte zu verwenden, in denen die Belichtung mit kürzerwelligem
Licht, z. B. UV-Strahlung, oder Elektronenstrahlung erfolgt.
Bei Verwendung von kürzerwelligem Licht oder Elektronenstrah
lung verschiebt sich die Auflösungsgrenze des Belichtungsgerä
tes zu feineren Strukturen. Die Verwendung von kürzerwelligem
Licht oder Elektronenstrahlung für die Fotolithographie hat al
lerdings zur Folge, daß neue teuere Belichtungsgeräte ange
schafft und andere Fotolacke verwendet werden müssen. Insbeson
dere zur Erzeugung feinster Strukturen ist der Einsatz von
Zwei- oder Dreischichtlacksystemen erforderlich.
Der Erfindung liegt das Problem zugrunde, ein Verfahren zur Er
zeugung einer Struktur in der Oberfläche eines Substrats anzu
geben, mit dem feinere Strukturen herstellbar sind, als dies
der Auflösungsgrenze des dabei verwendeten Lithographieverfah
rens entspricht.
Dieses Problem wird erfindungsgemäß gelöst durch ein Verfahren
nach Anspruch 1.
Dazu wird an der Oberfläche des Substrats eine maskierende
Struktur erzeugt, die Strukturelemente mit im wesentlichen
senkrechten Flanken aufweist. Selbstjustiert zu den senkrechten
Flanken der Strukturelemente wird jeweils eine Hilfsstruktur
erzeugt. Die Hilfsstruktur umfaßt als seitliche Begrenzung je
weils die senkrechten Flanken des Strukturelementes. Die Ober
fläche des jeweiligen Strukturelementes liegt dabei mindestens
teilweise frei. Die freiliegenden Teile der maskierenden Struk
tur werden selektiv zur Hilfsstruktur entfernt. Die Hilfsstruk
tur wird anschließend als Maske in einem Ätzprozeß zur Erzeu
gung der Struktur in der Oberfläche des Substrats verwendet.
Die Hilfsstruktur kann auch selbst als Strukturelement dienen.
Gemäß einer Ausführungsform wird die maskierende Struktur da
durch hergestellt, daß auf die Oberfläche des Substrats ganz
flächig eine erste Schicht aufgebracht wird. Auf der Oberfläche
der ersten Schicht wird unter Verwendung eines fotolithographi
schen Verfahrens eine Fotolackmaske erzeugt. Die maskierende
Struktur entsteht aus der ersten Schicht in einer Ätzung, bei
der die Fotolackmaske als Ätzmaske verwendet wird.
In dieser Ausführungsform wird die Hilfsstruktur z. B. durch
ganzflächiges, konformes Abscheiden einer zweiten Schicht auf
die maskierende Struktur und anschließendes anisotropes Rückät
zen selektiv zu der maskierenden Struktur als Spacer an den
senkrechten Flanken gebildet.
Alternativ dazu wird die Hilfsstruktur durch eine chemische Re
aktion, die an der Oberfläche der maskierenden Struktur eine
die Strukturelemente jeweils einhüllende Deckschicht bildet,
und durch anschließendes anisotropes Rückätzen, bei dem eine
zur Substratoberfläche parallele Oberfläche der Strukturelemen
te mindestens teilweise freigelegt wird, gebildet. Es liegt im
Rahmen der Erfindung, die maskierende Struktur aus Silizium zu
bilden und die Hilfsstruktur durch thermische Oxidation des Si
liziums zu bilden.
Gemäß einer anderen Ausführungsform der Erfindung wird die mas
kierende Struktur aus drei, auf die Oberfläche des Substrats
aufgebrachten Schichten gebildet. Dabei wird die oberste
Schicht, die z. B. aus Fotolack besteht, fotolithographisch
strukturiert. Anschließend wird die Struktur der obersten
Schicht in die beiden darunterliegenden Schichten durch ani
sotropes Ätzen übertragen. Die mittlere Schicht, die selektiv
zur oberen und zur unteren Schicht ätzbar ist, wird isotrop un
ter die obere Schicht rückgeätzt, so daß die Oberfläche der un
teren Schicht im Bereich der Unterätzung freigelegt wird. Durch
Entfernung der strukturierten obersten Schicht wird die maskie
rende Struktur fertiggestellt, die die strukturierte unterste
Schicht und die strukturierte mittlere Schicht umfaßt.
Es liegt im Rahmen der Erfindung, nach der Strukturierung der
obersten Schicht zunächst nur die mittlere Schicht zu ätzen und
dabei die Unterätzung unter die oberste Schicht herzustellen.
Zur Bildung der Hilfsstruktur liegt es im Rahmen der Erfindung,
ganzflächig eine Fotolackschicht aufzubringen. Durch eine Flut
belichtung und Entwicklung wird die Fotolackschicht an Stellen
hoher Reflexion strukturiert. Dabei wird die Oberfläche der
mittleren Schicht freigelegt, die in dieser Variante stark re
flektierend sein muß. Unter Verwendung der strukturierten Foto
lackschicht als Ätzmaske wird die mittlere Schicht und der dar
unterliegende Teil der unteren Schicht durch anisotropes Ätzen
entfernt.
Bei Verwendung eines stark reflektierenden Substrates werden
diejenigen Teile der Fotolackschicht, die direkt auf der Ober
fläche des Substrats seitlich der maskierenden Struktur ange
ordnet sind, durchbelichtet, so daß auch diese Teile der Foto
lackschicht beim Entwickeln entfernt werden. In diesem Fall um
faßt die Hilfsstruktur die verbleibende untere Schicht und die
darauf angeordnete strukturierte Fotolackschicht.
Bei Verwendung eines schwach oder gar nicht reflektierenden
Substrates werden diejenigen Anteile der Fotolackschicht, die
direkt auf der Oberfläche des Substrats angeordnet sind, bei
der Flutbelichtung nicht durchbelichtet. Daher werden sie beim
Entwickeln nicht ganz entfernt. In diesem Fall ist es nach der
Ätzung zur Strukturierung der mittleren Schicht und der unteren
Schicht erforderlich, die verbleibende Fotolackschicht zu ent
fernen. Die Hilfsstruktur umfaßt in diesem Fall nur die ver
bleibende untere Schicht.
Zur Bildung der Hilfsstruktur liegt es alternativ im Rahmen der
Erfindung, durch eine chemische Reaktion selektiv an der Ober
fläche der struktierten unteren Schicht eine Deckstruktur zu
bilden. Unter Verwendung der Deckstruktur als Ätzmaske wird
durch anisotropes Ätzen die strukturierte mittlere Schicht und
der darunterliegende Teil der strukturierten unteren Schicht
entfernt. Dabei entsteht die Hilfsstruktur, die die verblei
bende untere Schicht und die Deckstruktur umfaßt.
Da die Hilfsstruktur selbstjustiert zu den Flanken der Struk
turelemente gebildet wird, werden in diesem Herstellverfahren
immer zweidimensional geschlossene Hilfsstrukturen erzeugt, die
eine im wesentlichen konstante Stegbreite aufweisen. In Anwen
dungen, in denen eine Öffnung der geschlossenen Struktur erfor
derlich ist, wird eine weitere Strukturierung durchgeführt.
Diese kann ebenfalls nach dem erfindungsgemäßen Verfahren er
folgen.
Die Öffnung der Strukturen kann während der Pro
zessierung anstelle der angewandten Flutbelichtung durch eine
strukturierende Belichtung mit gebietsweise abgesenkter Inten
sität erfolgen. Nur an den zu öffnenden Stellen und z. B. in
Peripheriebereichen wird dabei eine Struktur direkt abgebildet.
Zur Durchbelichtung der dort abzubildenden Strukturen ist eine
hohe Belichtungsdosis notwendig. Um zu vermeiden, daß damit der
gesamte Fotolack im übrigen Bereich durchbelichtet wird, wird
die Belichtungsintensität in diesem Bereich auf den Wert abge
senkt, der der Flutbelichtung im oben genannten Verfahren ent
spricht. Dieses erfolgt z. B. durch ein sich nicht abbildendes
feines Gitter auf der bei der Belichtung verwendeten Maske.
Es liegt im Rahmen der Erfindung, durch eine Umkehrtechnik, z. B.
lift-off, aus der Hilfsstruktur deren Negativ zu erzeugen.
Weitere Ausgestaltungen der Erfindung gehen aus den übrigen An
sprüchen hervor.
Im folgenden wird die Erfindung anhand der Figuren und der Aus
führungsbeispiele näher erläutert.
Fig. 1 bis Fig. 4 zeigt die Erzeugung einer Struktur in der
Oberfläche eines Substrats, wobei die
Hilfsstruktur durch eine chemische Reaktion
der Oberfläche der maskierenden Struktur
gebildet wird.
Fig. 5 bis Fig. 8 zeigt die Herstellung einer Struktur in der
Oberfläche eines Substrats, bei der die
Hilfsstruktur durch eine Spacertechnik
gebildet wird.
Fig. 9 bis Fig. 11 zeigt die Herstellung einer maskierenden
Struktur mit Hilfe einer
Dreischichttechnik.
Fig. 12 und Fig. 13 zeigt die Herstellung einer
Hilfsstruktur selbstjustiert zu einer
maskierenden Struktur, die auf einem
reflektierenden Substrat angeordnet ist und
die durch eine Dreischichttechnik
hergestellt wurde.
Fig. 14 und Fig. 15 zeigt die Herstellung einer Hilfsstruktur
zu einer maskierenden Struktur, die in
einer Dreischichttechnik hergestellt ist
und die auf einem nichtreflektierenden
Substrat angeordnet ist.
Fig. 16 und Fig. 17 zeigt die Herstellung einer Hilfsstruktur
zu einer in einer Dreischichttechnik
hergestellten maskierenden Struktur durch
chemische Reaktion der Oberfläche.
Fig. 18 und Fig. 19 zeigt die Anwendung des erfindungsgemäßen
Verfahrens zur Herstellung eines Gitters
mit Phasensprung.
Fig. 20 zeigt die Aufsicht auf ein Substrat mit
einer Hilfsstruktur und einer maskierenden
Struktur.
Fig. 21 bis Fig. 23 zeigt ein Verfahren zum Öffnen
geschlossener Strukturen.
Auf ein Substrat 1 wird eine erste Schicht 2 aufgebracht (s.
Fig. 1). Das Substrat 1 umfaßt z. B. eine Siliziumscheibe 11, an
deren Oberfläche eine Si3N4-Schicht 12 angeordnet ist. Die er
ste Schicht 2 besteht z. B. aus Polysilizium. Unter Verwendung
einer Fotolackmaske (nicht dargestellt) und optischer Lithogra
phie wird die erste Schicht strukturiert, so daß eine maskie
rende Struktur 2 entsteht.
Durch eine chemische Reaktion, die selektiv an der Oberfläche
der maskierenden Struktur 2 stattfindet, wird die maskierende
Struktur 2 mit einer Deckschicht 3 versehen (s. Fig. 2). Als
chemische Reaktion eignet sich z. B. eine thermische Oxidation.
Die Deckschicht 3 hüllt die maskierende Struktur 2 vollständig
ein. Die Dicke der Deckschicht 3 wird so bemessen, daß zwischen
benachbarten Strukturelementen die Oberfläche des Substrats 1
freibleibt. Der Abstand von benachbarte Strukturelemente 2 ein
hüllenden Deckschichten 3 parallel zur Oberfläche des Substrats
1 ist vorzugsweise gleich der Breite der einzelnen Strukturele
mente der maskierenden Struktur 2 parallel zur Oberfläche des
Substrats 1.
In einer anisotropen Ätzung, z. B. in einem fluorhaltigen Plas
ma wird die Deckschicht 3 abgeätzt, bis die Oberfläche der mas
kierenden Struktur 2 freigelegt wird (s. Fig. 3). Dabei entste
hen seitlich der einzelnen Strukturelemente der maskierenden
Struktur 2 Hilfsstrukturen 4 in Form von sogenannten Spacern.
Unter Verwendung der Hilfsstruktur 4 als Ätzmaske wird in einem
weiteren anisotropen Ätzprozeß die Struktur in die Oberfläche
des Substrats 1 erzeugt (s. Fig. 4).
Auf ein Substrat 1′, das z. B. eine Siliziumscheibe 11′ und ei
ne Si3N4-Schicht 12′ umfaßt, wird ganzflächig eine erste
Schicht aus z. B. Polysilizium aufgebracht (s. Fig. 5). Unter
Verwendung einer Fotolackmaske (nicht dargestellt) wird die er
ste Schicht strukturiert, so daß eine maskierende Struktur 2′
entsteht, die mehrere Strukturelemente umfaßt.
Es wird ganz flächig durch konformes Abscheiden eine zweite
Schicht 3′ erzeugt. Die zweite Schicht 3′ wird z. B. durch CVD-
Abscheidung aus SiOxNyCz hergestellt. Die Dicke der zweiten
Schicht 3′ wird dabei so eingestellt, daß zwischen benachbarten
Strukturelementen 2′ eine Senke in der zweiten Schicht 3′ auf
tritt. Vorzugsweise wird die Dicke der zweiten Schicht 3′ so
eingestellt, daß die Senke in der Oberfläche der zweiten
Schicht 3′ eine Breite aufweist, die im wesentlichen der Breite
der einzelnen Strukturelemente 2′ entspricht.
In einer anisotropen Ätzung, die selektiv zur Oberfläche des
Substrats 1′ und der maskierenden Struktur 2′ ist, z. B. in ei
nem fluorhaltigen Plasma, wird die zweite Schicht 3′ rückge
ätzt, bis die Oberfläche der maskierenden Struktur 2′ und die
Oberfläche des Substrats 1′ freigelegt wird. Dabei entstehen
als Spacer eine Hilfsstruktur 4′ (s. Fig. 7). Selektiv zur
Hilfsstruktur 4′ und zur Oberfläche des Substrats 1′ wird an
schließend die maskierende Struktur 2′ entfernt (s. Fig. 8).
Die Hilfsstruktur 4′ wird in einem nachfolgenden Ätzprozeß als
Ätzmaske zur Strukturierung der Oberfläche des Substrats 1′
verwendet.
Auf die Oberfläche eines Substrats 5 aus z. B. Silizium wird
eine dritte Schicht 6 aus z. B. hochausgeheiztem Lack aufge
bracht (s. Fig. 9). Auf die dritte Schicht 6 wird ganzflächig
eine vierte Schicht 7 aus z. B. Metall oder Silizium aufge
bracht. Auf die vierte Schicht 7 wird eine fünfte Schicht 8 aus
z. B. Fotolack aufgebracht. Durch fotolithographische Belich
tung und Entwicklung wird die fünfte Schicht 8 strukturiert.
Die strukturierte fünfte Schicht 8 weist eine Struktur mit meh
reren Strukturelementen auf.
Durch anisotropes Ätzen z. B. mit CCl4/O2 wird die Struktur der
strukturierten fünften Schicht 8 in die vierte Schicht 7 und
die dritte Schicht 6 übertragen. In einem isotropen Ätzprozeß,
der selektiv zur dritten Schicht 6 und zur fünften Schicht 8
erfolgt, wird eine Unterätzung der vierten Schicht 7 unter die
fünfte Schicht 8 erzeugt. Dabei wird im Bereich der Unterätzung
die Oberfläche der dritten Schicht 6 freigelegt (s. Fig. 10).
Es ist auch möglich, zunächst die isotrope Ätzung zur Struktu
rierung der vierten Schicht 7 vorzunehmen und dabei die Unter
ätzungen unter die fünfte Schicht 8 zu bilden. Anschließend
wird in einem anisotropen Ätzprozeß unter Verwendung der fünf
ten Schicht 8 als Ätzmaske die dritte Schicht 6 strukturiert.
Durch Entfernung der strukturierten fünften Schicht 8 wird die
maskierende Struktur fertiggestellt, die die strukturierte
dritte Schicht 6 und die strukturierte vierte Schicht 7 umfaßt
(s. Fig. 11).
Die in Fig. 11 gezeigte Struktur wird ganzflächig mit einer Fo
tolackschicht versehen. Durch eine Flutbelichtung und anschlie
ßende Entwicklung wird die Fotolackschicht 9 strukturiert. Un
ter der Bedingung, daß die vierte Schicht 7 und die Oberfläche
des Substrats 5 stark reflektieren, was bei einer vierten
Schicht 7 aus Metall und einem Substrat 5 aus z. B. Silizium
der Fall ist, werden die Teile der Fotolackschicht, die unmit
telbar an der Oberfläche der vierten Schicht 7 bzw. des
Substrats 5 angeordnet sind, stärker belichtet, als diejenigen
Teile, die an der Oberfläche der fünften Schicht 8 angeordnet
sind. Daher wird der Fotolack von der Oberfläche der vierten
Schicht 7 und des Substrats 5 vollständig entfernt (s. Fig.
12).
Nach Entfernung der vierten Schicht 7, z. B. durch Naßätzen mit
verdünnter Flußsäure wird in einem anisotropen Ätzprozeß die
freiliegende Oberfläche der dritten Schicht 6 geätzt. Als Ätz
prozeß wird z. B. reaktives Ionenätzen mit O2 verwendet. Der
verbleibende Teil der dritten Schicht 6 und der strukturierten
Fotolackschicht 9 (s. Fig. 13) bildet die Hilfsstruktur, die
als Ätzmaske zur Herstellung der Struktur in der Oberfläche des
Substrats 5 in nachfolgenden Ätzprozessen verwendet wird.
Weist das Substrat 5 für das anhand von Fig. 12 bis 13 be
schriebene Herstellverfahren nicht die genügende Reflektivität
auf, wird der Bereich der Fotolackschicht 9, der unmittelbar
auf der Oberfläche des Substrats 5 angeordnet ist, nicht aus
reichend belichtet. In diesem Fall ergibt sich nach der Ent
wicklung der Fotolackschicht 9 eine Struktur, in der nur die
Oberfläche der vierten Schicht 7 freigelegt ist (s. Fig. 14).
Nach Entfernung der vierten Schicht 7 z. B. durch Naßätzung mit
verdünnter Flußsäure wird der frei liegende Teil der dritten
Schicht 6 in einem anisotropen Ätzprozeß selektiv zur Oberflä
che des Substrats 5 geätzt. Als Ätzprozeß wird z. B. reaktives
Ionenätzen O2 eingesetzt. Dabei wird die Oberfläche des
Substrats 5 freigelegt. Anschließend wird die strukturierte Fo
tolackschicht 9 selektiv zur dritten Schicht 6 und zum Substrat
5 entfernt (s. Fig. 15). Dabei entsteht die Hilfsstruktur, die
aus dem verbleibenden Teil der dritten Schicht 6 gebildet wird.
Diese Hilfsstruktur wird in nachfolgenden Ätzprozessen zur
Strukturierung der Oberfläche des Substrats 5 als Ätzmaske ver
wendet.
In einem anderen Ausführungsbeispiel, in dem die maskierende
Struktur in dem anhand von Fig. 9 bis 11 erläuterten Verfahren
hergestellt wird, wird eine chemische Reaktion durchgeführt,
die selektiv an der Oberfläche der strukturierten dritten
Schicht 6 (s. Fig. 11) abläuft und dort eine Deckstruktur 10
(s. Fig. 16) bildet. Die dritte Schicht 6 besteht z. B. aus ge
eignetem Fotolack und die Deckstruktur 10 wird durch eine Sily
lierung erzeugt. Die Deckstruktur 10 ist mindestens an der par
allel zur Oberfläche des Substrats 5 verlaufenden Oberfläche
ätzresistent.
Nach Entfernung der vierten Schicht 7 z. B. durch naßchemisches
Ätzen mit verdünnter Flußsäure wird die dritte Schicht 6 in ei
nem anisotropen Ätzprozeß, der selektiv zur Oberfläche der
Deckstruktur 10 und des Substrats 5 erfolgt, geätzt. Als Ätz
prozeß eignet sich z. B. ein Sauerstoffplasma (s. Fig. 17). Der
verbleibende Teil der dritten Schicht 6 mit der Deckstruktur 10
bildet eine Hilfsstruktur, die in einem nachfolgenden Ätzprozeß
als Ätzmaske zur Strukturierung der Oberfläche des Substrats 5
verwendet wird.
Zur Herstellung eines Gitters mit Phasensprung wird auf der
Oberfläche eines Substrats 110 eine maskierende Struktur 120
erzeugt. Die maskierende Struktur 120 wird z. B. nach dem Ver
fahren, das anhand von Fig. 9 bis 11 erläutert wurde, herge
stellt (s. Fig. 18). Die maskierende Struktur 120 umfaßt eine
Vielzahl von Strukturelementen, die im wesentlichen periodisch
angeordnet sind. Für den Phasensprung ist der Abstand zweier
benachbarter, ausgewählter Strukturelemente verdoppelt.
Selbstjustiert zu der maskierenden Struktur 120 wird eine
Hilfsstruktur 130 hergestellt (s. Fig. 19). Die Hilfsstruktur
130 wird z. B. nach dem anhand von Fig. 14 erläuterten Verfah
ren hergestellt. Der vergrößerte Abstand zwischen den ausge
wählten Strukturelementen der maskierenden Struktur 120 über
trägt sich in die Hilfsstruktur 130. Die Hilfsstruktur 130 wird
als Ätzmaske verwendet zur Strukturierung der Oberfläche des
Substrats 110.
Analog ist unter Verwendung des erfindungsgemäßen Verfahrens
die Herstellung von Gittern für gechirpte Halbleiterlaser mög
lich. Bei diesen Gittern ist jeder zweite Gitterabstand gering
fügig vergrößert, wobei die Abweichung von der Gitterkonstanten
stetig zunimmt.
In Fig. 20 ist eine Aufsicht auf ein Substrat 14 mit einer mas
kierenden Struktur 15 und einer Hilfsstruktur 16 dargestellt.
Die Hilfsstruktur 16 umgibt die maskierende Struktur 15 voll
ständig. Sie bildet einen geschlossenen Kurvenzug. Nach Entfer
nen der maskierenden Struktur 15 nach einem der obengenannten
Verfahren wird die Hilfsstruktur 16 als Ätzmaske verwendet. Da
die Hilfsstruktur 16 selbstjustiert zu den senkrechten Flanken
von Strukturelementen der maskierenden Struktur 15 hergestellt
wurde, ist die minimale Stegbreite der Hilfsstruktur 16 durch
das Selbstjustierungsverfahren bestimmt. Sie ist unabhängig von
der Auflösungsgrenze der verwendeten Fotolithographie. Die Auf
lösungsgrenze der verwendeten Fotolithographie spiegelt sich
lediglich in den, minimalen Abständen der maskierenden Struktur
15 wieder.
In Anwendungen, in denen der geschlossene Kurvenzug der Struk
tur geöffnet werden soll, muß eine weitere Strukturierung
durchgeführt werden. Es liegt im Rahmen der Erfindung, diese in
das erfindungsgemäße Verfahren zu integrieren. Dazu wird eine
maskierende Struktur nach dem Verfahren, das anhand von Fig. 9
bis 11 erläutert wurde, hergestellt. Fig. 21 zeigt eine Auf
sicht auf ein Substrat 17, an dessen Oberfläche eine maskie
rende Struktur angeordnet ist. Die maskierende Struktur umfaßt
an der Oberfläche des Substrats eine strukturierte dritte
Schicht 18, die der strukturierten dritten Schicht 6 in Fig. 11
entspricht, und eine darauf angeordnete strukturierte vierte
Schicht 19, die der strukturierten vierten Schicht 7 in Fig. 11
entspricht. Durch die Unterätzung der vierten Schicht 19 bei
der Herstellung der maskierenden Struktur liegt am Rand der
maskierenden Struktur die Oberfläche der strukturierten dritten
Schicht 18 frei.
Es wird ganz flächig auf die Struktur eine Fotolackschicht auf
gebracht. Diese wird durch eine Belichtung strukturiert. Dabei
wird eine Maske verwendet, die nur an den zu öffnenden Stellen
und an beliebigen anderen gewünschten Stellen eine Struktur di
rekt abbildet. Die Maske umfaßt voll transparente Bereiche 20
und nicht transparente Bereiche 21. Die Maskenstrukturen werden
nur für Strukturgrößen abgebildet, die größer als die Auflö
sungsgrenze des Lithographieprozesses sind. Deshalb wird ein
teiltransparenter Bereich 22 nur als homogen abgesenkte Intensi
tät abgebildet (s. Fig. 22).
Zur Durchbelichtung der Strukturen ist eine hohe Belichtungsdo
sis notwendig. Damit dabei nicht der Fotolack in dem durch das
Verfahren gemäß Fig. 9 bis Fig. 11 vorstrukturierten Bereich
vollständig durchbelichtet wird, umfaßt die Maske teiltranspa
rente Bereiche 22, die in diesem Bereich die Intensität absen
ken. Die teiltransparenten Bereiche 22 werden z. B. durch ein
sich nicht abbildendes feines Gitter auf der Fotomaske reali
siert.
Nach dem Entwickeln der Fotolackschicht wird diese als Ätzmaske
zur Entfernung der vierten Schicht 19 verwendet. Dadurch wird
eine Hilfsstruktur fertiggestellt, die aus dem verbleibenden
Teil der dritten Schicht 18 an der Oberfläche des Substrats 17
besteht und der Lackschicht im nichttransparenten Bereich 21
liegt (s. Fig. 23). Diese Hilfsstruktur wird zur Strukturierung
der Oberfläche als Ätzmaske verwendet.
Claims (8)
1. Verfahren zur Erzeugung einer Struktur in der Oberfläche ei
nes Substrats,
- - bei dem an der Oberfläche des Substrats (14) eine maskierende Struktur (15) erzeugt wird, die Strukturelemente mit im wesent lichen senkrechten Flanken aufweist,
- - bei dem zu jedem Strukturelement der maskierenden Struktur (15) selbstjustiert zu den senkrechten Flanken eine Hilfsstruk tur (16) erzeugt wird, die die senkrechten Flanken des jeweili gen Strukturelementes als seitliche Begrenzung umfaßt, wobei die Oberfläche des jeweiligen Strukturelementes mindestens teilweise freiliegt,
- - bei dem freiliegende Teile der maskierenden Struktur (15) se lektiv zur Hilfsstruktur (16) entfernt werden,
- - bei dem die Hilfsstruktur (16) als Maske in einem Ätzprozeß zur Erzeugung der Struktur in der Oberfläche des Substrats (14) verwendet wird.
2. Verfahren nach Anspruch 1,
- - bei dem zur Bildung der maskierenden Struktur (2) auf die Oberfläche des Substrats (1) ganzflächig eine erste Schicht aufgebracht wird,
- - bei dem auf der Oberfläche der ersten Schicht unter Verwen dung eines fotolithographischen Verfahrens eine Fotolackmaske erzeugt wird,
- - bei dem die erste Schicht unter Verwendung der Fotolackmaske als Ätzmaske in einem Ätzprozeß strukturiert wird.
3. Verfahren nach Anspruch 2,
bei dem die Hilfsstruktur (4′) durch ganzflächiges konformes
Abscheiden einer zweiten Schicht (3′) auf die maskierende
Struktur (2′) und durch anschließendes anisotropes Rückätzen
selektiv zur maskierenden Struktur (2′) als Spacer an den senk
rechten Flanken gebildet wird.
4. Verfahren nach Anspruch 2,
bei dem die Hilfsstruktur (4) durch eine chemische Reaktion,
die an der Oberfläche der maskierenden Struktur (2) eine die
Strukturelemente jeweils einhüllende Deckschicht (3) bildet,
und durch anschließendes anisotropes Rückätzen, bei dem eine
zur Oberfläche des Substrats (1) parallele Oberfläche der
Strukturelemente mindestens teilweise freigelegt wird, gebildet
wird.
5. Verfahren nach Anspruch 4,
bei dem die maskierende Struktur (2) aus Silizium gebildet wird
und bei dem die Hilfsstruktur (4) durch thermische Oxidation
gebildet wird.
6. Verfahren nach Anspruch 1,
- - bei dem zur Bildung der maskierenden Struktur ganz flächig ei ne dritte Schicht (6), eine vierte Schicht (7) und eine fünfte Schicht (8) auf die Oberfläche des Substrats aufgebracht wird, wobei die vierte Schicht (7) isotrop selektiv zur dritten Schicht (6) und zur fünften Schicht (8) ätzbar ist,
- - bei dem die fünfte Schicht (8) fotolithographisch struktu riert wird,
- - bei dem unter Verwendung der strukturierten fünften Schicht (8) als Ätzmaske in einem anisotropen Ätzprozeß die vierte Schicht (7) und die dritte Schicht (6) strukturiert werden und bei dem in einem isotropen Ätzprozeß die vierte Schicht (7) un ter die strukturierte fünfte Schicht (8) rückgeätzt wird, so daß die Oberfläche der strukturierten dritten Schicht (6) im Bereich der Unterätzung freigelegt wird,
- - bei dem durch Entfernung der strukturierten fünften Schicht (8) die maskierende Struktur fertiggestellt wird, die die strukturierte dritte Schicht (6) und die strukturierte vierte Schicht (7) umfaßt.
7. Verfahren nach Anspruch 6,
- - bei dem zur Bildung der Hilfsstruktur ganz flächig eine Foto lackschicht (9) aufgebracht wird, die durch Flutbelichtung und Entwicklung strukturiert wird, wobei die Oberfläche der struk turierten vierten Schicht (7) freigelegt wird,
- - bei dem unter Verwendung der strukturierten Fotolackschicht (9) als Ätzmaske durch anisotropes Ätzen die strukturierte vierte Schicht (7) und der darunterliegende Teil der struktu rierten dritten Schicht (6) entfernt wird,
- - bei dem die strukturierte Fotolackschicht (9) mindestens an der Oberfläche des Substrats (5) entfernt wird, wobei die die verbleibende strukturierte dritte Schicht (6) umfassende Hilfs struktur entsteht.
8. Verfahren nach Anspruch 6,
- - bei dem zur Bildung der Hilfsstruktur durch eine chemische Reaktion selektiv an der Oberfläche der strukturierten dritten Schicht (6) eine Deckstruktur (10) gebildet wird,
- - bei dem unter Verwendung der Deckstruktur (10) als Ätzmaske durch anisotropes Atzen die strukturierte vierte Schicht (7) und der darunterliegende Teil der strukturierten dritten Schicht (6) entfernt wird, wobei die Hilfsstruktur entsteht, die die verbleibende strukturierte dritte Schicht (6) und die Deckstruktur (10) umfaßt.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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DE19924236609 DE4236609A1 (de) | 1992-10-29 | 1992-10-29 | Verfahren zur Erzeugung einer Struktur in der Oberfläche eines Substrats |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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Publications (1)
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DE4236609A1 true DE4236609A1 (de) | 1994-05-05 |
Family
ID=6471690
Family Applications (1)
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