DE19801247A1 - Verfahren und Vorrichtung zum präzisen Ausrichten von Halbleiter-Chips auf einem Substrat - Google Patents
Verfahren und Vorrichtung zum präzisen Ausrichten von Halbleiter-Chips auf einem SubstratInfo
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Description
Die vorliegende Erfindung betrifft ein Verfahren zum präzisen
Ausrichten von Halbleiter-Chips auf einem Substrat. Speziell
betrifft sie ein solches Verfahren für das Ausrichten von
Halbleiterchips mit controlled collapse chip connection
(C4)-Lötkugeln. Die Erfindung betrifft außerdem eine Vorrichtung
zur Durchführung des Verfahrens.
Beim Testen der heutigen Halbleiter-Chips tritt die
Notwendigkeit auf, teilweise weit über 1000 Signal-Pins
kontaktieren zu müssen. Dieses Problem kann auf Chip- bzw.
Waferlevel nur durch sehr aufwendige und teure Kontaktoren
durchgeführt werden.
Bei der Fehleranalyse von defekten Chips, die einem sog.
Multi-Chip-Carrier entnommen wurden, hat man zusätzlich das
Problem, ein solches Einzelchip wieder an den Tester zu
bringen, d. h., es müssen zunächst die Chip-C4-Kontakte
wiederhergestellt werden, um dann den zu testenden Chip auf
einem Chipträger positionieren und auflöten zu können. Erst
danach kann der Test auf dem Testsystem durchgeführt werden.
Bei solchen Testvorgängen werden die zu testenden Chips auf
einen zugehörigen Chip-Träger (Substrat) aufgebracht, auf dem
die Chips für den Testvorgang fixiert werden. Das Substrat
trägt entsprechende Kontaktstellen (Pads), die nach dem
Anpressen des Chips auf das Substrat mit den Kontakten des
Chips elektrisch verbunden werden.
Eine Möglichkeit, die elektrischen Kontakte des Chips
auszubilden, sind die sog. controlled collapse chip
connections (C4). Bei dieser Kontaktierungsart sind alle
elektrischen Anschlüsse des Chips (Signale und
Spannungsversorgung) auf der aktiven Chipseite an die
Chipoberfläche geführt und mit je einem C4-Pad (die aus
PbSn-Kügelchen bestehen) versehen. Nach Positionierung des Chips
auf dem Substrat wird das Chip zusammen mit dem Substrat in
einem Durchlaufofen verlötet, d. h., die Chip-C4-Pads werden
aufgeschmolzen und mit dem entsprechenden Substratpad
verlötet.
Bei der Vielzahl der heutigen Kontaktelemente auf einem
einzelnen Chip ist es sehr wichtig, die zu testenden Chips
präzise auf dem Substrat auszurichten. Dabei ist zu bemerken,
daß eine derart präzise Ausrichtung solcher C4-Chips unter
Verwendung der Chipkante nicht möglich ist, da der Sägespalt
(Zerteilung des Wafers in einzelne Chips-Waferdicing) zu
große Toleranzen aufweist.
Es ist bekannt, die einzelnen Chips bzgl. ihrer Lage zu dem
Substrat mit Hilfe einer sog. Splitfield-Optik auf einer
Chip-Alignment-Vorrichtung auszurichten (vgl. "The Fineplacer
Technical Manual", The Fineplacer System, Finetech
Electronics International, Juni 1992).
Diese optischen Alignment-Systeme beruhen auf dem Prinzip der
gleichzeitigen Darstellung von zwei Bildern unter
Zuhilfenahme eines stationären Strahlteilers. Ein Bild zeigt
dabei die Unterseite des zu testenden Bauteils und wird von
dem zweiten Bild überlagert, das das Zielgebiet auf dem
Substrat zeigt. Betrachtet man beide Bilder zusammen, so
erlauben diese einen Vergleich der entsprechenden
Kontaktpositionen von Chip und Substrat auf einen Blick.
Solche Systeme haben den Nachteil, daß sie sehr aufwendig und
teuer sind. Des weiteren können sie nicht ohne weiteres in
ein bestehendes Testsystem integriert werden, was bedeutet,
daß die Substrate zur Chippositionierung immer aus dem
Testsystem herausgenommen werden müssen.
Es ist daher die Aufgabe der vorliegenden Erfindung, ein
Verfahren zur präzisen Ausrichtung von Halbleiter-Chips auf
einem Substrat zur Verfügung zu stellen, das es erlaubt, auf
einfache und kostengünstige Art und Weise ein genaues
Ausrichten der einzelnen Chips auf den Substraten zu
gewährleisten.
Diese und weitere Aufgaben werden durch das Verfahren nach
Anspruch 1 gelöst.
Weitere vorteilhafte Ausführungsformen des erfindungsgemäßen
Verfahrens sind in den Unteransprüchen dargelegt.
Das erfindungsgemäße Verfahren wird im folgenden anhand der
Zeichnungen näher beschrieben.
Es zeigt
Fig. 1 eine Aufsicht auf das Substrat mit zwei darauf
angebrachten Folienstücken;
Fig. 2 eine Seitenansicht der Anordnung aus Fig. 1;
Fig. 3 eine zweite Ausführungsform der Erfindung; und
Fig. 4 die Seitenansicht der Anordnung aus Fig. 3.
Das vorliegende Verfahren verwendet in einer vorteilhaften
Ausführungsform dünne Polyimid-Folienstücke, deren Kanten als
Anschlag für die C4-Lötkugeln dienen. Bevorzugt wird dabei
Poly-(diphenyloxid-paramellithimid) (Kapton®) verwendet. Die
Folie weist eine Dicke im Bereich von 40 bis 60 µm, bevorzugt
50 µm auf. Allgemein erscheint es sinnvoll, eine Foliendicke
von ca. 60 bis 75% der C4-Pad-Höhe zu wählen. Falls die Folie
zu dünn ist, können die abgerundeten C4-Pads über die
Folienkante rutschen; es kommt dadurch zu keinem Anschlag.
Wird die Folie zu dick gewählt, erfaßt sie außerdem die
Chip-Kante, was unerwünscht ist, da der Sägespalt zwischen den
einzelnen aus einem Wafer geschnittenen Chips zu große
Toleranzen aufweist.
Pro Substrat werden zwei gleiche Folienstücke
zurechtgeschnitten. Die Form der Folienstücke richtet sich
dabei nach der Chipgröße des zu positionierenden Chips, und
damit nach der Anzahl der C4-Pads pro Chipseite, die die
Folienkante berühren sollen. Ein stumpfer Winkel der
Folienecken (< 90°) verhindert dabei, daß sich ein C4-Pad
beim Entlanggleiten an der Folienecke einhakt. Die Kanten der
Folienstücke, an die die C4-Kontakte angeschlagen werden
sollen, muß dabei absolut gerade sein.
Mit Hilfe eines Inspektionstools, mit dem man die einzelnen
Substrat-Pads deutlich erkennen kann (bspw. unter einem
Stereo-Mikroskop) werden die beiden Folienstücke entsprechend
der späteren Chip-Plazierung auf dem Substrat positioniert
und festgeklebt. Dazu wird bevorzugt ein 2-Komponenten-Epoxy-Kleber
verwendet. Dies hat den Vorteil, daß die Folienstücke
jederzeit durch Erwärmen des Substrats/Klebers wieder
entfernt werden können. Falls notwendig kann die Position der
Folie in erwärmtem Zustand noch korrigiert/verändert werden.
Fig. 1 zeigt eine Aufsicht auf das Substrat mit zwei
aufgeklebten Folienstücken. Das Substrat 1 trägt
entsprechende Kontaktstellen (Pads) 2, die nach dem späteren
Anpressen des Chips 3 (in Fig. 1 nur andeutungsweise gezeigt)
auf das Substrat mit den Kontakten des Chips elektrisch
verbunden werden. Die beiden aufgeklebten Folienstücke 4
liegen im rechten Winkel zueinander und sind entlang des
äußeren Randes der Kontaktstellen des Substrats angebracht.
Auf diese Weise bilden die Folienstücke auf dem Substrat eine
Anschlagkante, die in der Höhe der Dicke der gewählten Folie
entspricht.
Die C4-Anschlagkanten müssen dabei frei von überschüssigem
Kleber sein, damit eine genaue Positionierung gewährleistet
ist. Dies kann u. a. dadurch erreicht werden, daß mit Hilfe
einer Wärmeplatte ein kontrolliertes Aushärten des Klebers
durchgeführt wird.
Das auf diese Weise mit den C4-Anschlagsfolien versehene
Substrat stellt die Kontaktiervorrichtung für das zu testende
Chip dar.
In einem ersten Schritt wird zunächst das zu testende Chip
(mit der korrekten Chip-Rotation) lose auf das Substrat in
der Nähe der beiden Anschlagfolien aufgelegt. Anschließend
wird es planparallel gegen die Anschlagfolien verschoben.
Sobald die C4-Chip-Kontakte die beiden Anschlagfolien
gleichzeitig tangential berühren, ist die exakte Chipposition
erreicht.
Fig. 2 zeigt die Anordnung Substrat-Anschlagfolie-Chip. Die
Anschlagfolie 4 liegt entlang des äußeren Randes der
Kontaktstellen 2 des Substrates.
Das Chip wird nun, bspw. mit einem druckluftbetriebenen
Andruckstempel, mit einem definierten Druck gegen die
Kontaktpads des Substrats gepreßt und damit ein elektrischer
Kontakt aller C4-Chip-Kontakte mit dem Substrat hergestellt.
Anschließend kann die normale Testsequenz durchgeführt
werden.
In einer anderen bevorzugten Ausführungsform kann die
Anschlagseinrichtung beweglich ausgeführt sein, um damit
verschiedene Chip-Größen abdecken zu können. Fig. 3 zeigt
eine solche Einrichtung in der Aufsicht. Auf dem Substrat 1
ist eine Anschlagschiene 5 aus elektrisch nicht leitendem
wärmefesten Material, bspw. DELRIN® oder ein anderes
keramisches Material verschiebbar und justierbar angebracht.
Je nach Größe des Chips 6 kann diese Schiene nun bewegt
werden. Fig. 4 zeigt die Seitenansicht dieser
Ausführungsform.
Die Erfindung ist jedoch nicht auf die genannten
Ausführungsbeispiele begrenzt, sondern umfaßt auch solche
Ausführungen, die sich dem Fachmann beim Lesen ohne weiteres
erschließen.
Claims (10)
1. Verfahren zum präzisen Ausrichten eines
Halbleiterplättchens (Chip) (3) mit controlled collapse
chip connection (C4)-Lötkugeln (Pads) (2) auf einem
Substrat (1),
dadurch gekennzeichnet, daß
auf das Substrat (1) eine Anschlagseinrichtung (4)
aufgebracht wird, die als Anschlag für die C4-Lötkugeln
dient.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß
die Anschlagseinrichtung zwei dünne Polyimid-Folien
stücke umfaßt.
3. Verfahren nach Anspruch 2, dadurch gekennzeichnet, daß
die dünne Folie aus Poly-(diphenyloxid-pyromellithimid)
besteht.
4. Verfahren nach Anspruch 2 oder 3, dadurch
gekennzeichnet, daß die dünne Folie wiederentfernbar auf
dem Substrat aufgebracht wird.
5. Verfahren nach Anspruch 4, dadurch gekennzeichnet, daß
die dünne Folie mittels eines Epoxy-Klebers auf dem
Substrat fixiert wird.
6. Verfahren nach einem der vorhergehenden Ansprüche,
dadurch gekennzeichnet, daß die dünne Folie eine Dicke
im Bereich von 40 bis 60 µm, vorzugsweise 50 µm
aufweist.
7. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß
die Anschlageinrichtung verstellbar angeordnet ist.
8. Vorrichtung zum präzisen Ausrichten eines
Halbleiterplättchens (Chip) (3) mit controlled collapse
chip connection (C4)-Lötkugeln (Pads) (2), umfassend ein
Substrat (1) und eine auf diesem angeordneten
Anschlagseinrichtung (4).
9. Vorrichtung nach Anspruch 8, dadurch gekennzeichnet, daß
die Anschlagseinrichtung eine dünne Polyimid-Folie
umfaßt.
10. Vorrichtung nach Anspruch 8, dadurch gekennzeichnet, daß
die Anschlageinrichtung als verschiebbare und
justierbare Anschlagschiene ausgebildet ist.
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