DE102015209889A1 - Strukturierte Halbleiterscheibe und Verfahren zu deren Herstellung - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 62
- 238000000034 method Methods 0.000 title claims description 11
- 238000004519 manufacturing process Methods 0.000 title description 7
- 239000000463 material Substances 0.000 claims abstract description 45
- 150000004767 nitrides Chemical class 0.000 claims abstract description 22
- 230000008021 deposition Effects 0.000 claims abstract description 5
- 239000000758 substrate Substances 0.000 claims description 46
- 238000007669 thermal treatment Methods 0.000 claims description 11
- 238000000926 separation method Methods 0.000 claims description 9
- 238000000151 deposition Methods 0.000 claims description 8
- 238000010438 heat treatment Methods 0.000 claims description 2
- 238000002488 metal-organic chemical vapour deposition Methods 0.000 claims 1
- 239000010410 layer Substances 0.000 description 84
- 235000012431 wafers Nutrition 0.000 description 31
- 229910052710 silicon Inorganic materials 0.000 description 6
- 239000010703 silicon Substances 0.000 description 6
- 238000006243 chemical reaction Methods 0.000 description 5
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 4
- 238000001020 plasma etching Methods 0.000 description 4
- 229910002601 GaN Inorganic materials 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 230000007547 defect Effects 0.000 description 3
- 239000000203 mixture Substances 0.000 description 3
- QNRATNLHPGXHMA-XZHTYLCXSA-N (r)-(6-ethoxyquinolin-4-yl)-[(2s,4s,5r)-5-ethyl-1-azabicyclo[2.2.2]octan-2-yl]methanol;hydrochloride Chemical compound Cl.C([C@H]([C@H](C1)CC)C2)CN1[C@@H]2[C@H](O)C1=CC=NC2=CC=C(OCC)C=C21 QNRATNLHPGXHMA-XZHTYLCXSA-N 0.000 description 2
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000001312 dry etching Methods 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 229910052732 germanium Inorganic materials 0.000 description 2
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 238000010884 ion-beam technique Methods 0.000 description 2
- 238000010329 laser etching Methods 0.000 description 2
- 230000000873 masking effect Effects 0.000 description 2
- 230000005012 migration Effects 0.000 description 2
- 238000013508 migration Methods 0.000 description 2
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 2
- 229910010271 silicon carbide Inorganic materials 0.000 description 2
- 230000001131 transforming effect Effects 0.000 description 2
- 238000003631 wet chemical etching Methods 0.000 description 2
- BUHVIAUBTBOHAG-FOYDDCNASA-N (2r,3r,4s,5r)-2-[6-[[2-(3,5-dimethoxyphenyl)-2-(2-methylphenyl)ethyl]amino]purin-9-yl]-5-(hydroxymethyl)oxolane-3,4-diol Chemical compound COC1=CC(OC)=CC(C(CNC=2C=3N=CN(C=3N=CN=2)[C@H]2[C@@H]([C@H](O)[C@@H](CO)O2)O)C=2C(=CC=CC=2)C)=C1 BUHVIAUBTBOHAG-FOYDDCNASA-N 0.000 description 1
- 229910002704 AlGaN Inorganic materials 0.000 description 1
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 1
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 1
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 1
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 239000002800 charge carrier Substances 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 239000002019 doping agent Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 229910052733 gallium Inorganic materials 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 229910052738 indium Inorganic materials 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 230000001788 irregular Effects 0.000 description 1
- 238000001451 molecular beam epitaxy Methods 0.000 description 1
- 229910052756 noble gas Inorganic materials 0.000 description 1
- 230000006911 nucleation Effects 0.000 description 1
- 238000010899 nucleation Methods 0.000 description 1
- 230000001590 oxidative effect Effects 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229910052594 sapphire Inorganic materials 0.000 description 1
- 239000010980 sapphire Substances 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 230000000087 stabilizing effect Effects 0.000 description 1
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/764—Air gaps
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
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- H01L21/02367—Substrates
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- H01L21/02373—Group 14 semiconducting materials
- H01L21/02381—Silicon, silicon germanium, germanium
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/02428—Structure
- H01L21/0243—Surface structure
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02538—Group 13/15 materials
- H01L21/0254—Nitrides
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02656—Special treatments
- H01L21/02658—Pretreatments
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0603—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
- H01L29/0642—Isolation within the component, i.e. internal isolation
- H01L29/0649—Dielectric regions, e.g. SiO2 regions, air gaps
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0657—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/20—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
- H01L29/2003—Nitride compounds
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
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- H01L33/00—Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
- H01L33/005—Processes
- H01L33/0062—Processes for devices with an active region comprising only III-V compounds
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- H01L33/007—Processes for devices with an active region comprising only III-V compounds with a substrate not being a III-V compound comprising nitride compounds
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- H01L33/12—Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies with a stress relaxation structure, e.g. buffer layer
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Abstract
Die strukturierte Halbleiterscheibe umfasst eine Basisschicht aus Halbleitermaterial, die sich von einem Zentrum bis zu einem Rand der Halbleiterscheibe erstreckt; auf der Basisschicht eine Zwischenschicht des Halbleitermaterials, in der Hohlräume eingebettet sind; eine obere Schicht des Halbleitermaterials, die die Zwischenschicht bedeckt; Gräben in der oberen Schicht und der Zwischenschicht und Inselstrukturen zwischen den Gräben; und eine oder mehrere Schichten, die eine Abscheidefläche der jeweiligen Inselstruktur bedecken und ein Gruppe(III)nitrid enthalten.
Description
- Gegenstand der Erfindung ist eine strukturierte Halbleiterscheibe und ein Verfahren zu deren Herstellung. Die strukturierte Halbleiterscheibe ist als Ausgangsprodukt zur Herstellung elektronischer Bauelemente vorgesehen, die mit hoher elektrischer Leistung und/oder mit hohen Schaltgeschwindigkeiten betrieben werden sollen, insbesondere von elektronischen Bauelementen wie beispielsweise LEDs (light emitting diodes), LDs (laser diodes) und HEMTs (high electron mobility transistors).
- Es besteht ein Bedarf an Werkstoffen, die geeignet sind, solche Bauelemente in großen Stückzahlen herstellen zu können. Scheiben aus Galliumnitrid wären beispielsweise geeignete Werkstoffe. Deren Herstellung ist jedoch technisch aufwendig und es können, anders als beispielsweise im Fall des Werkstoffs Silizium, nur Scheiben mit vergleichsweise kleinem Durchmesser hergestellt werden.
- Man versucht daher, Gruppe(III)nitride auf Halbleiterscheiben aus Siliziumcarbid, Saphir oder Silizium abzuscheiden. Die abgeschiedenen Schichten weisen jedoch insbesondere im Fall von Silizium aufgrund von Gitterfehlanpassung (lattice mismatch) und nicht übereinstimmender Wärmeausdehnungs-Koeffizienten vergleichsweise hohe Defektdichten auf.
- Diesem Problem wird in der
WO 2011/084269 A2 - Es ist Aufgabe der vorliegenden Erfindung, eine alternative und vorteilhaftere Lösung des geschilderten Problems anzubieten.
- Gelöst wird die Aufgabe durch eine strukturierte Halbleiterscheibe, umfassend
eine Basisschicht aus Halbleitermaterial, die sich von einem Zentrum bis zu einem Rand der Halbleiterscheibe erstreckt;
auf der Basisschicht eine Zwischenschicht des Halbleitermaterials, in der Hohlräume eingebettet sind;
eine obere Schicht des Halbleitermaterials, die die Zwischenschicht bedeckt;
Gräben in der oberen Schicht und der Zwischenschicht und Inselstrukturen zwischen den Gräben; und
eine oder mehrere Schichten, die eine Abscheidefläche der jeweiligen Inselstrukturen bedecken und ein Gruppe(III)nitrid enthalten. - Die Erfinder haben herausgefunden, dass die Defektdichten zurückgehen, wenn die Schicht mit Gitterfehlanpassung auf einer Unterlage liegt, die dünn ist und wenig Kontaktfläche zum Untergrund hat. Eine solche Unterlage wird erfindungsgemäß durch Inselstrukturen bereitgestellt, in denen Hohlräume vorhanden sind, die mit einer dünnen Schicht aus Halbleitermaterial bedeckt sind.
- Als Halbleitermaterial kommt vorzugsweise Silizium, insbesondere einkristallines Silizium in Betracht. Es können aber auch andere Halbleitermaterialien verwendet werden, beispielsweise Silizium-Germanium, Germanium, Siliziumcarbid oder Galliumarsenid. Die Substratscheibe kann in poliertem oder unpoliertem Zustand vorliegen oder mit einer epitaktisch abgeschiedenen Schicht versehen sein. Die Substratscheibe kann auch eine SOI-Scheibe (silicon on insulator) oder eine gebondete Scheibe sein. Besonders bevorzugt ist eine Substratscheibe aus <111>-orientiertem einkristallinen Silizium. Die Substratscheibe hat vorzugsweise einen Durchmesser von nicht weniger als 200 mm, besonders bevorzugt einen Durchmesser von nicht weniger als 300 mm. Durchmesser bis zu 450 mm sind möglich.
- Des Weiteren wird die Aufgabe gelöst durch ein Verfahren zur Herstellung einer strukturierten Halbleiterscheibe. Gemäß einer ersten, bevorzugten Ausführungsform umfasst das Verfahren das Bereitstellen einer Substratscheibe aus Halbleitermaterial;
das Bilden von Vertiefungen in der Substratscheibe;
das Bilden von Gräben in der Substratscheibe, die breiter und tiefer sind, als die Vertiefungen, wobei benachbarte Gräben einen Abstand zueinander haben, der größer ist, als ein Abstand, den benachbarte Vertiefungen zueinander haben;
das Unterziehen der Substratscheibe einer thermischen Behandlung unter Umwandlung der Vertiefungen in Hohlräume, wobei Inselstrukturen zwischen den Gräben entstehen und die Inselstrukturen jeweils eine Zwischenschicht aus dem Halbleitermaterial und eine die Zwischenschicht bedeckende obere Schicht aus dem Halbleitermaterial umfassen und die Hohlräume in der Zwischenschicht eingebettet sind; und
das Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten. - Gemäß einer zweiten Ausführungsform umfasst das Verfahren das Bereitstellen einer Substratscheibe aus Halbleitermaterial;
das Bilden von Vertiefungen in der Substratscheibe;
das Unterziehen der Substratscheibe einer thermischen Behandlung unter Umwandlung der Vertiefungen in Hohlräume, wobei eine Zwischenschicht aus dem Halbleitermaterial und eine die Zwischenschicht bedeckende obere Schicht aus dem Halbleitermaterial entstehen und die Hohlräume in der Zwischenschicht eingebettet sind;
das Bilden von Gräben in der oberen Schicht und in der Zwischenschicht, wobei Inselstrukturen zwischen den Gräben entstehen; und
das Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten. - Die Substratscheibe bildet das Ausgangsprodukt zur Herstellung der strukturierten Halbleiterscheibe. Zunächst wird die Oberfläche der Substratscheibe mit Vertiefungen versehen. Die Vorgehensweise entspricht im Wesentlichen derjenigen, die in der
WO 03/003430 A2 - Die Dimensionen der Vertiefungen werden dabei hinsichtlich Form, Breite, Durchmesser, Tiefe und Abstand vorgegeben. Die möglichen Formen unterliegen im Prinzip keinen besonderen Beschränkungen. Gegenüber unregelmäßigen Formen sind regelmäßige Formen bevorzugt. Besonders bevorzugt sind Löcher mit rundem, quadratischem oder rechteckigem Querschnitt.
- Die Vertiefungen werden in hoher Dichte zwischen dem Zentrum und dem Rand der Substratscheibe verteilt, vorzugsweise derart, dass Muster der Vertiefungen entstehen, die sich periodisch wiederholen. Die Herstellung der strukturierten Halbleiterscheibe umfasst das Umwandeln der Vertiefungen in Hohlräume, die mit einer oberen Schicht des Halbleitermaterials bedeckt sind. Breite, Tiefe, Durchmesser und der Abstand, den benachbarte Vertiefungen zueinander haben, werden derart gewählt, dass die obere Schicht des Halbleitermaterials nach dem Umwandeln der Vertiefungen eine vorgesehene Dicke D hat. Die Dicke D der oberen Schicht beträgt vorzugsweise nicht weniger als 20 nm und nicht mehr als 10 µm. Sind die Vertiefungen Löcher mit rundem oder quadratischem Querschnitt, betragen der Durchmesser beziehungsweise die Kantenlänge des Querschnitts vorzugsweise D/5 bis 2·D, besonders bevorzugt D/3 bis D, die Tiefe der Vertiefungen vorzugsweise D bis 4·D und der Abstand benachbarter Vertiefungen vorzugsweise D/2 bis 3·D.
- Die Abstände zwischen benachbarten Vertiefungen können variieren. Wird ein Mindestabstand unterschritten, können sich die benachbarten Vertiefungen beim Umwandeln zu einem dann entsprechend größer werdenden Hohlraum vereinigen. Bevorzugt ist es jedoch, die Abstände benachbarter Vertiefungen ausreichend groß zu wählen, dass eine Vertiefung in einen Hohlraum umgewandelt wird.
- Das Umwandeln von Vertiefungen in Hohlräume umfasst eine thermische Behandlung der Substratscheibe, die eine Migration von Atomen des Halbleitermaterials auslöst. Im Verlauf der Migration schließen sich die Vertiefungen zu Hohlräumen und über den Hohlräumen bildet sich eine obere Schicht aus dem Halbleitermaterial. Aus der Region mit den Vertiefungen wird eine Zwischenschicht, in der die Hohlräume, getrennt durch Halbleitermaterial, eingebettet sind. Die thermische Behandlung der Substratscheibe umfasst das Erhitzen der Substratscheibe auf eine Temperatur von nicht weniger als 200 °C und nicht mehr als 1500 °C und das Halten der Substratscheibe im genannten Temperaturbereich über einen Zeitraum von nicht weniger als 3 Sekunden und nicht mehr als 6 Stunden. Temperaturbereich und Dauer der thermischen Behandlung richten sich nach dem Halbleitermaterial, aus dem die Substratscheibe besteht. Im Fall von einkristallinem Silizium beträgt der Temperaturbereich 700 °C bis 1370 °C, vorzugsweise 900 °C bis 1250 °C, und die Behandlungsdauer beträgt 3 Sekunden bis 6 Stunden, vorzugsweise 60 Sekunden bis 1800 Sekunden. Die thermische Behandlung wird bei einem Druck von 100 Pa bis 15000 Pa, vorzugsweise 130 Pa bis 7500 Pa, und in einer nicht oxidierenden Atmosphäre durchgeführt, vorzugsweise in einer reduzierenden Atmosphäre oder in einer Edelgas-Atmosphäre oder in einem Gemisch beider Atmosphären, besonders bevorzugt in einer Atmosphäre aus Wasserstoff oder aus Argon oder einem Gemisch beider Gase.
- Nach dem Umwandeln der Vertiefungen in Hohlräume oder vorzugsweise davor werden Gräben in der Substratscheibe gebildet. Die Gräben sind vorzugsweise breiter und tiefer als die Vertiefungen, und der Abstand zwischen benachbarten Gräben ist größer als der Abstand zwischen benachbarten Vertiefungen. Die Gräben haben vorzugsweise eine Breite von nicht weniger als 200 nm und nicht mehr als 200 µm und vorzugsweise eine Tiefe von nicht weniger als 25 nm und nicht mehr als 100 µm. Sie werden so angelegt, dass sie sich schneiden und Flächen zwischen den sich schneidenden Gräben entstehen, deren Form vorzugsweise quadratisch, rechteckig oder rautenförmig ist.
- Gemäß der bevorzugten ersten Ausführungsform des Verfahrens erfolgt das Umwandeln der Vertiefungen mittels thermischer Behandlung der Substratscheibe erst nach dem Bilden der Gräben. In diesem Fall entstehen beim Umwandeln der Vertiefungen Inselstrukturen zwischen den Gräben. Die Inselstrukturen umfassen jeweils eine Zwischenschicht aus dem Halbleitermaterial und eine obere Schicht aus dem Halbleitermaterial, die auf der Zwischenschicht liegt. Die Hohlräume sind im Halbleitermaterial der Zwischenschicht eingebettet. Die obere Schicht der jeweiligen Inselstruktur bildet die Unterlage für mindestens eine Schicht aus einem Gruppe(III)nitrid.
- Gemäß der zweiten Ausführungsform des Verfahrens erfolgt das Umwandeln der Vertiefungen mittels thermischer Behandlung der Substratscheibe vor dem Bilden der Gräben. In diesem Fall erstrecken sich die Zwischenschicht und die obere Schicht aus dem Halbleitermaterial nach dem Umwandeln der Vertiefungen zunächst vom Zentrum bis zum Rand der Substratscheibe. Die Inselstrukturen entstehen erst anschließend durch das Bilden der Gräben in der oberen Schicht und der Zwischenschicht.
- Die Gräben werden unabhängig von der gewählten Ausführungsform vorzugsweise mittels fotolithographischer Maskierung und anschließendem nasschemischen Ätzen oder Trockenätzen, beispielsweise Ionenstrahlätzen, Plasmaätzen, reaktives Ionenätzen oder Ätzen mittels Laser erzeugt.
- Unabhängig von der gewählten Ausführungsform des Herstellungsverfahrens stellt die jeweils entstehende Inselstruktur mit ihrer oben liegenden Seite der oberen Schicht eine Abscheidefläche zur Verfügung, die vorzugsweise nicht weniger als 100 µm2 und nicht mehr als 10 cm2, besonders bevorzugt nicht weniger als 10000 µm2 und nicht mehr als 5 cm2 beträgt. Die Form der Abscheidefläche ist vorzugsweise quadratisch, rechteckig oder rautenförmig.
- Die Dicke der Zwischenschicht der jeweiligen Inselstruktur beträgt vorzugsweise nicht weniger als 5 nm und nicht mehr als 5 µm, besonders bevorzugt nicht weniger als 8 nm und nicht mehr als 2 µm. Die Hohlräume, die in der Zwischenschicht der jeweiligen Inselstruktur eingebettet sind, sind vorzugsweise geschlossene Hohlräume.
- Die jeweilige Inselstruktur zeichnet sich insbesondere dadurch aus, dass die Kontaktfläche, die die obere Schicht zum Untergrund hat, deutlich kleiner ist, als die zur Verfügung gestellte Abscheidefläche. Bestünde die Zwischenschicht nur aus dem Halbleitermaterial, wäre die Kontaktfläche ebenso groß wie die Abscheidefläche. Wegen des Vorhandenseins der Hohlräume in der Zwischenschicht beträgt die Kontaktfläche, die die obere Schicht zur Zwischenschicht hat vorzugsweise nicht mehr als 10 %, besser nicht mehr als 1 % und besonders bevorzugt nicht mehr als 0,01 % der von der Inselstruktur zur Verfügung gestellten Abscheidefläche.
- Wegen dieses Aufbaus kann die jeweilige Inselstruktur Spannungen, die nach dem Bedecken mit einer Schicht aus einem Gruppe(III)nitrid aufgrund von Gitterfehlanpassung und nicht übereinstimmender Wärmeausdehnungs-Koeffizienten auftreten, eher absorbieren als Unterlagen mit massivem Untergrund. Die Dichte von durch Spannungen hervorgerufenen Defekten in einer auf einer Inselstruktur abgeschiedenen Schicht aus einem Gruppe(III)nitrid ist geringer und die Schicht ist frei von Rissen.
- Vor dem Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten, können die Abscheideflächen der Inselstrukturen geglättet werden, beispielsweise durch Abscheiden einer epitaktischen Schicht aus dem Halbleitermaterial auf den Abscheideflächen oder durch chemisch mechanisches Polieren der Abscheideflächen oder durch beide Maßnahmen.
- Vorzugsweise ist mindestens eine der Schichten, die ein Gruppe(III)nitrid enthalten, eine elektronisch oder optoelektronisch aktive Schicht und enthält ein Nitrid eines oder mehrerer der Elemente von vorzugsweise Al, Ga und In und gegebenenfalls weitere Elemente. Die weiteren Elemente sind vorzugsweise Dotierstoffe, die sich auf die Konzentration von Ladungsträgern in der Schicht auswirken, oder Elemente, die Spannungen in der Schicht hervorrufen oder abbauen wie Silizium oder Germanium, oder Elemente, deren Anwesenheit den Abstand von Leitungs- und Valenzband in der Schicht beeinflusst. Es können mehrere elektronisch oder optoelektronisch aktive Schichten vorhanden sein, beispielsweise Schichtenfolgen, die Heterostrukturen oder ein Übergitter (superlattice) bilden. Die elektronisch oder optoelektronisch aktiven Schichten können sich bezüglich ihrer Zusammensetzung und Konzentration von Elementen unterscheiden.
- Die Anwesenheit einer oder mehrerer elektronisch oder optoelektronisch aktiver Schichten aus GaN, AlGaN, InGaN oder InAlGaN ist besonders bevorzugt. Neben elektronisch oder optoelektronisch aktiven Schichten können eine oder mehrere weitere Schichten vorgesehen sein, insbesondere Nukleationsschichten und Pufferschichten. Beispiele hierfür sind Schichten aus AlN und GaN.
- Besonders bevorzugt ist es, wenn die Inselstrukturen mit Schichtenstapeln bedeckt sind, die zur Herstellung von Leistungsbauelementen, Leuchtdioden, Laserdioden oder HEMTs geeignet sind. Die Dicke der Schichtenstapel auf den Inselstrukturen beträgt vorzugsweise nicht weniger als 0,1 µm und nicht mehr als 10 µm.
- Das Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten, und gegebenenfalls weiterer Schichten erfolgt vorzugsweise durch Abscheiden der Schichten mittels CVD (chemical vapor deposition), MOCVD (metallorganic chemical vapor deposition) oder MBE (molecular beam epitaxy). Es empfiehlt sich, auf der erfindungsgemäß hergestellten Inselstruktur möglichst viele Merkmale der vorgesehenen Bauelemente zu verwirklichen, bevor die Inseln voneinander getrennt und zu fertigen Bauelementen weiterverarbeitet werden.
- Die Erfindung wird nachfolgend unter Bezugnahme auf Zeichnungen erläutert. Die Zeichnungen sind schematisch und nicht maßstabsgetreu.
-
1 zeigt eine Substratscheibe im Querschnitt mit vertikaler Schnittebene. -
2 zeigt einen vergrößerten Ausschnitt der Substratscheibe nach dem Bilden von Vertiefungen. -
3 zeigt einen vergrößerten Ausschnitt der Substratscheibe nach dem Bilden von Vertiefungen und Gräben. -
4 zeigt den Ausschnitt gemäß2 nach dem Umwandeln der Vertiefungen zu Hohlräumen. -
5 zeigt den Ausschnitt gemäß3 nach dem Umwandeln der Vertiefungen zu Hohlräumen und dem Abscheiden einer Schicht aus einem Gruppe(III)nitrid auf der entstandenen Inselstruktur. -
6 und7 zeigen exemplarisch jeweils eine mögliche Inselstruktur mit abgewandeltem Aufbau, die von einer Schicht aus einem Gruppe(III)nitrid bedeckt ist. -
8 zeigt einen kreisförmigen Ausschnitt auf eine strukturierte Halbleiterscheibe in Draufsicht. -
1 zeigt eine Substratscheibe1 , beispielsweise eine Substratscheibe aus einkristallinem Silizium. -
2 zeigt den in1 angedeuteten ovalen Ausschnitt der Substratscheibe in vergrößerter Form nach dem Bilden von Vertiefungen2 in der Substratscheibe1 . -
3 zeigt den in1 angedeuteten ovalen Ausschnitt der Substratscheibe1 nach dem Bilden von Vertiefungen2 und Gräben3 . -
4 zeigt den Ausschnitt gemäß2 nach dem Umwandeln der Vertiefungen2 zu Hohlräumen4 . Die Hohlräume4 sind im Halbleitermaterial eingebettet und Teil einer Zwischenschicht5 , die von einer oberen Schicht6 aus dem Halbleitermaterial bedeckt ist. -
5 zeigt den Ausschnitt gemäß3 nach dem Umwandeln der Vertiefungen2 zu Hohlräumen4 und dem Abscheiden einer Schicht9 aus einem Gruppe(III)nitrid auf der entstandenen Inselstruktur8 . Die Hohlräume4 sind geschlossen und im Halbleitermaterial eingebettet und Teil einer Zwischenschicht5 , die von einer oberen Schicht6 aus dem Halbleitermaterial bedeckt ist. Die Gräben3 isolieren die Inselstrukturen8 und die jeweilige Inselstruktur trägt eine oder mehrere Schichten9 eines Gruppe(III)nitrids. Zu diesem Zweck stellt die Inselstruktur8 eine Abscheidefläche10 zur Verfügung, die von der oben liegenden Seite der oberen Schicht6 gebildet wird. Das von der Substratscheibe1 stammende Material unterhalb der Gräben3 bildet eine Basisschicht7 , die sich vom Zentrum bis zum Rand der Substratscheibe erstreckt. - In
6 ist eine Inselstruktur8 gezeigt mit einem vergleichsweise großen Hohlraum4 in der Zwischenschicht5 und einer auf der oberen Schicht6 abgeschiedenen Schicht9 aus einem Gruppe(III)nitrid. Ein solcher größerer Hohlraum entsteht, wenn benachbarte Vertiefungen2 vor deren Umwandlung einen Abstand zueinander haben, der kleiner ist als ein Mindestabstand. - Die in
7 gezeigte Inselstruktur weist als Besonderheit offene Hohlräume4 in der Zwischenschicht5 auf. Eine solche Inselstruktur entsteht, wenn der Verlauf der Gräben3 derart gewählt wird, dass Hohlräume4 , die zunächst geschlossen waren, beim Anlegen der Gräben3 geöffnet werden. -
8 zeigt einen kreisförmigen Ausschnitt auf eine strukturierte Halbleiterscheibe in Draufsicht. Der Verlauf der Gräben3 folgt exemplarisch einem Schachbrettmuster, so dass die zwischen den Gräben isolierten Inselstrukturen8 einen quadratischen Querschnitt haben. - ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
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- WO 2011/084269 A2 [0004]
- WO 03/003430 A2 [0011]
Claims (10)
- Strukturierte Halbleiterscheibe, umfassend eine Basisschicht aus Halbleitermaterial, die sich von einem Zentrum bis zu einem Rand der Halbleiterscheibe erstreckt; auf der Basisschicht eine Zwischenschicht des Halbleitermaterials, in der Hohlräume eingebettet sind; eine obere Schicht des Halbleitermaterials, die die Zwischenschicht bedeckt; Gräben in der oberen Schicht und der Zwischenschicht und Inselstrukturen zwischen den Gräben; und eine oder mehrere Schichten, die eine Abscheidefläche der jeweiligen Inselstruktur bedecken und ein Gruppe(III)nitrid enthalten.
- Strukturierte Halbleiterscheibe nach Anspruch 1, dadurch gekennzeichnet, dass zwischen der oberen Schicht und der Zwischenschicht der jeweiligen Inselstruktur eine Kontaktfläche besteht, deren Fläche nicht mehr als 10 % der Fläche der Abscheidefläche beträgt.
- Strukturierte Halbleiterscheibe nach Anspruch 1 oder Anspruch 2, dadurch gekennzeichnet, dass die Fläche der Abscheidefläche nicht weniger als 100 µm2 und nicht mehr als 10 cm2 ist.
- Strukturierte Halbleiterscheibe nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, dass die Zwischenschicht der jeweiligen Inselstruktur eine Dicke hat, die nicht weniger als 5 nm und nicht mehr als 5 µm beträgt.
- Strukturierte Halbleiterscheibe nach einem der Ansprüche 1 bis 4, dadurch gekennzeichnet, dass die obere Schicht der jeweiligen Inselstruktur eine Dicke hat, die nicht weniger als 20 nm und nicht mehr als 10 µm beträgt.
- Strukturierte Halbleiterscheibe nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, dass die Gräben eine Breite von nicht weniger als 200 nm und nicht mehr als 200 µm und eine Tiefe von nicht weniger als 25 nm und nicht mehr als 100 µm haben.
- Verfahren zur Herstellung einer strukturierten Halbleiterscheibe, umfassend das Bereitstellen einer Substratscheibe aus Halbleitermaterial; das Bilden von Vertiefungen in der Substratscheibe; das Bilden von Gräben in der Substratscheibe, die breiter und tiefer sind, als die Vertiefungen, wobei benachbarte Gräben einen Abstand zueinander haben, der größer ist, als ein Abstand, den benachbarte Vertiefungen zueinander haben; das Unterziehen der Substratscheibe einer thermischen Behandlung unter Umwandlung der Vertiefungen in Hohlräume, wobei Inselstrukturen zwischen den Gräben entstehen und die Inselstrukturen jeweils eine Zwischenschicht aus dem Halbleitermaterial und eine die Zwischenschicht bedeckende obere Schicht aus dem Halbleitermaterial umfassen und die Hohlräume in der Zwischenschicht eingebettet sind; und das Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten.
- Verfahren zur Herstellung einer strukturierten Halbleiterscheibe, umfassend das Bereitstellen einer Substratscheibe aus Halbleitermaterial; das Bilden von Vertiefungen in der Substratscheibe; das Unterziehen der Substratscheibe einer thermischen Behandlung unter Umwandlung der Vertiefungen in Hohlräume, wobei eine Zwischenschicht aus dem Halbleitermaterial und eine die Zwischenschicht bedeckende obere Schicht aus dem Halbleitermaterial entsteht und die Hohlräume in der Zwischenschicht eingebettet sind; das Bilden von Gräben in der oberen Schicht und in der Zwischenschicht, wobei Inselstrukturen zwischen den Gräben entstehen; und das Bedecken der Inselstrukturen mit einer oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten.
- Verfahren nach Anspruch 7 oder Anspruch 8, dadurch gekennzeichnet, dass die thermische Behandlung das Erhitzen der Substratscheibe auf eine Temperatur von nicht weniger als 200 °C und nicht mehr als 1500 °C und das Halten der Substratscheibe im genannten Temperaturbereich über einen Zeitraum von nicht weniger als 3 Sekunden und nicht mehr als 6 Stunden umfasst.
- Verfahren nach einem der Ansprüche 6 bis 8, dadurch gekennzeichnet, dass die eine oder mehreren Schichten, die ein Gruppe(III)nitrid enthalten, auf einer Abscheidefläche der jeweiligen Inselstruktur mittels CVD, MOCVD oder MBE abgeschieden werden.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102015209889.3A DE102015209889B4 (de) | 2015-05-29 | 2015-05-29 | Strukturierte Halbleiterscheibe und Verfahren zu deren Herstellung |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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Publications (2)
Publication Number | Publication Date |
---|---|
DE102015209889A1 true DE102015209889A1 (de) | 2016-12-01 |
DE102015209889B4 DE102015209889B4 (de) | 2018-12-06 |
Family
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102015209889.3A Active DE102015209889B4 (de) | 2015-05-29 | 2015-05-29 | Strukturierte Halbleiterscheibe und Verfahren zu deren Herstellung |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE102015209889B4 (de) |
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