DE102015008110A1 - Method for monitoring at least two LED chains - Google Patents
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Abstract
Die Erfindung betrifft ein Verfahren zur Überwachung der elektrischen Energieversorgung einer ersten LED-Kette (LED1) mit n LEDs aus einer ersten geregelten Stromquelle (I1) mit einem ersten Nennstrom (I10) und einer zweiten LED-Kette (LED2) mit m LEDs aus einer zweiten Stromquelle (I2) mit einem zweiten Nennstrom (I20). Das Verfahren umfasst als einen ersten Schritt das Erzeugen eines ersten Abgriffpotenzials als ersten Fehlererkennungsparameter an einem ersten Abgriff (ERR1) und als zweiten Schritt das Erzeugen eines zweiten Abgriffpotenzials als zweiten Fehlererkennungsparameter an einem zweiten Abgriff (ERR2). Die so erzeigten Abgriffspotenziale werden in einem nächsten Schritt dann mit der Spannungsdifferenz zwischen dem ersten Abgriffpotenzial und dem zweiten Abgriffpotenzial verglichen. Die so ermittelte Spannungsdifferenz wird dann mit einem ersten Schwellwert und einem zweiten Schwellwert, der vom ersten Schwellwert verschieden ist, durch eine Auswerteschaltung (AS) verglichen. Die Auswerteschaltung (AS) signalisiert sodann, ob die Spannungsdifferenz zwischen dem ersten und dem zweiten Schwellwert liegt.The invention relates to a method for monitoring the electrical power supply of a first LED chain (LED1) with n LEDs from a first regulated current source (I1) with a first rated current (I10) and a second LED chain (LED2) with m LEDs from one second current source (I2) with a second rated current (I20). The method comprises, as a first step, generating a first tap potential as first error detection parameter at a first tap (ERR1) and as a second step generating a second tap potential as a second error detection parameter at a second tap (ERR2). The tap potentials thus displayed are then compared in a next step with the voltage difference between the first tap potential and the second tap potential. The voltage difference thus determined is then compared with a first threshold value and a second threshold value, which is different from the first threshold value, by an evaluation circuit (AS). The evaluation circuit (AS) then signals whether the voltage difference lies between the first and the second threshold value.
Description
Einleitungintroduction
Diese Erfindung betrifft ein Verfahren zur Überwachung mindestens zweier LED-Ketten. Die zugehörige Vorrichtung wird ebenfalls beschrieben. Es stehen bei einer Kette von LEDs, die in der Automobilindustrie verwendet werden sollen, aus Fertigungsgründen meist LED-Träger mit lediglich zwei elektrischen Anschlüssen zur Verfügung. Dadurch sind Teile der Kette in der Regel für eine Zustandsbewertung der LED-Kette nicht erreichbar/messbar. Für eine Sichere Ausfallserkennung ist eine solche Zustandsermittlung jedoch notwendig. Aus dem Stand der Technik ist die
Aus der
Es handelt sich also zum einen wieder um eine mögliche Lösung des technischen Problems mit den nicht gewünschten Abgriffen in der LED-Kette für eine einzelne Kette. Zum Zweiten handelt sich um den Versuch, aus transienter Änderungen des Spannungsabfalls über einen Teils der LED-Kette oder der LED-Kette selbst einen Fehlerfall, beispielsweise einen Einzelkurzschluss einer LED, zu erkennen. Die Idee der
Diese Methode hat den Nachteil, dass die Bewertung von solchen Einzelereignissen des Spannungsverlaufs des Spannungsabfalls über einen Teil der LED-Kette in automobilen Anwendungen in Anbetracht der bekannten und typischerweise vorhandenen Störpulse extrem kritisch und unzuverlässig zu bewerten ist. Dieses Verfahren der
Die Vermessung mehrerer Parallele LED-Ketten wird sowohl in der
Aufgabe der ErfindungObject of the invention
Es ist die Aufgabe der Erfindung eine Vorrichtung und ein Verfahren anzugeben, das zum einen ohne Abgriffe innerhalb einer LED-Kette und zum anderen mittels einer EMV-robusten statischen Messung eine sichere Erkennung von Kurzschlüssen einzelner LEDs innerhalb von LED-Ketten und/oder von Erniedrigungen des Leitwertes einzelner LEDs innerhalb von mehreren parallelgeschalteten LED-Ketten ermöglicht. Diese Aufgabe wird mit einem Verfahren gemäß dem Anspruch 1 gelöst.It is the object of the invention to provide a device and a method which, on the one hand without taps within an LED chain and on the other hand by means of an EMC-robust static measurement reliable detection of short circuits of individual LEDs within LED chains and / or degradations the conductance of individual LEDs within several parallel-connected LED chains allows. This object is achieved by a method according to
Beschreibung der ErfindungDescription of the invention
Die erfindungsgemäße Aufgabe wird dadurch gelöst, dass zwei LED-Stränge miteinander verglichen werden. Dabei können auch Teile dieser verschiedenen LED-Ketten als Referenzspannungsquellen genutzt werden. Die Erfindung wird zur Überwachung mindestens zweier verschiedener LED-Stränge eingesetzt. Es werden also im Gegensatz zur
Im Übrigen ist dem Fachmann klar, dass ggf. andere Teilerverhältnisse für den Spannnugsteiler verwendet werden können, wenn die Flussspannungen der LEDs in den Ketten unterschiedlich sind, was der Fachmann wegen der damit verbundenen Temperaturprobleme typischerweise jedoch vermeiden wird. Somit können je nach Anwendung die Spannungsteiler alle Teilerverhältnisse von 100% bis hinunter zu knapp größer 0% aufweisen. Ganzzahlige Teilerverhältnisse sind aufgrund des Matchings zu bevorzugen.Incidentally, it is clear to the person skilled in the art that if necessary different divider ratios can be used for the clamping part divider, if the forward voltages of the LEDs in the chains are different, which the person skilled in the art will typically avoid because of the associated temperature problems. Thus, depending on the application, the voltage dividers can have all divider ratios of 100% down to just over 0%. Integer divider ratios are preferable due to matching.
In einer Variante der Erfindung fällt an jeder LED der ersten LED-Kette (LED1), wenn diese durch den ersten Nennstrom (I10) durchströmt wird, eine erste Flussspannung (ULED1) ab, die um weniger als 20% und/oder weniger als 10% und/oder weniger als 5% und/oder weniger als 2% und/oder weniger als 1% von dem Mittelwert der Flussspannungen der anderen LEDs der ersten und zweiten LED-Kette (LED1, LED2) abweicht. Dabei fällt an jeder LED der zweiten LED-Kette (LED1), wenn diese durch den zweiten Nennstrom (I20) durchströmt wird, eine zweite Flussspannung (LED2) ab, die um weniger als 20% und/oder weniger als 10% und/oder weniger als 5% und/oder weniger als 2% und/oder weniger als 1% von dem Mittelwert der Flussspannungen der anderen LEDs der ersten und zweiten LED-Kette (LED1, LED2) abweicht. Wieder sind die erste und die zweite LED-Kette (LED1, LED2) und die erste geregelte Stromquelle (I1) und die zweite geregelte Stromquelle (I2) mit einem gemeinsamen Knoten (GND) verbunden. Nun ist jedoch nur der zweiten LED-Kette ein zweiter Spannungsteiler (RS2) mit einem zweiten Gesamtwiderstand (R2) parallelgeschaltet. Die andere LED Kette ist direkt mit der Auswerteschaltung (AS) verbunden. Der besagte zweite Spannungsteiler (RS2) weist wieder einen zweiten Abgriff (ERR2) in der Art auf, dass die Spannung (U2) zwischen diesem zweiten Abgriff (ERR2) und dem gemeinsamen Knoten (GND) ein n-faches der ersten Flussspannung (ULED1) beträgt, wenn die zweite LED-Kette (LED2) vom zweiten Nennstrom (I20) durchströmt wird. Der erste Abgriff (ERR1) und der zweite Abgriff (ERR2) sind wieder mit einem Auswerteschaltkreis (AS) verbunden. Wie zuvor erzeugt der Auswerteschaltkreis (AS) in Abhängigkeit von der Spannungsdifferenz zwischen dem ersten Abgriff (ERR1) als erstem Fehlererkennungsparameter und zweiten Abgriff (ERR2) als zweiten Fehlererkennungsparameter ein Fehlersignal (FS) und/oder setzt ein Fehler-Flag und/oder ändert einen Registerinhalt.In a variant of the invention, at each LED of the first LED chain (LED1), when it is flowed through by the first rated current (I10), a first forward voltage (U LED1 ) drops by less than 20% and / or less than 10% and / or less than 5% and / or less than 2% and / or less than 1% of the average of the forward voltages of the other LEDs of the first and second LED chain (LED1, LED2) is different. In this case, a second forward voltage (LED2) falls on each LED of the second LED chain (LED1) when the latter by the second rated current (I 20) is flowed through from which less than 20% and / or less than 10% and / or less than 5% and / or less than 2% and / or less than 1% from the average of the forward voltages of the other LEDs of the first and second LED strings (LED1, LED2). Again, the first and second LED strings (LED1, LED2) and the first regulated current source (I1) and the second regulated current source (I2) are connected to a common node (GND). Now, however, only the second LED chain, a second voltage divider (RS2) with a second total resistance (R2) connected in parallel. The other LED chain is connected directly to the evaluation circuit (AS). The said second voltage divider (RS2) again has a second tap (ERR2) in such a way that the voltage (U 2 ) between this second tap (ERR2) and the common node (GND) is n times the first forward voltage (U LED1 ) when the second LED string (LED2) is from the second Rated current (I 20 ) is flowed through. The first tap (ERR1) and the second tap (ERR2) are again connected to an evaluation circuit (AS). As before, the evaluation circuit (AS) generates an error signal (FS) as a function of the voltage difference between the first tap (ERR1) as the first error detection parameter and the second tap (ERR2) as the second error detection parameter and / or sets an error flag and / or changes one content tab.
In einer weiteren Variante der Erfindung erzeugt der Auswerteschaltkreis (AS) ein Fehlersignal (FS) und/oder ändert den logischen Inhalt eines Fehler-Flags und/oder ändert einen Registerinhalt, wenn die Spannungsdifferenz zwischen dem ersten Abgriff (ERR1) und zweiten Abgriff (ERR2) um mehr als 1% und/oder um mehr als 2% und/oder um mehr als 5% und/oder um mehr als 10% und/oder um mehr als 25% voneinander abweicht.In a further variant of the invention, the evaluation circuit (AS) generates an error signal (FS) and / or changes the logical content of an error flag and / or changes a register content if the voltage difference between the first tap (ERR1) and the second tap (ERR2 ) differs by more than 1% and / or more than 2% and / or more than 5% and / or more than 10% and / or more than 25%.
In einer weiteren Ausprägung der Erfindung weist der Auswerteschaltkreis eine erfindungsgemäße zugehörige Teilvorrichtung auf, die diese Erkennung durch Vergleich des Spannungspotenzials des ersten Abgriffs (ERR1) und des Spannungspotenzials des zweiten Abgriffs (ERR2) mit einem ersten und zweiten Schwellwert durchführt. Hierzu weist sie beispielsweise einen ersten Komparator (CMP1) mit einem ersten Eingang und einem dritten Eingang und einem ersten Komparatorausgang auf. Der erste Komparator (CMP1) ist mit dem ersten Eingang mit dem ersten Abgriff (ERR1) verbunden.In a further embodiment of the invention, the evaluation circuit has an associated sub-device according to the invention, which performs this recognition by comparing the voltage potential of the first tap (ERR1) and the voltage potential of the second tap (ERR2) with a first and second threshold value. For this purpose, it has, for example, a first comparator (CMP1) with a first input and a third input and a first comparator output. The first comparator (CMP1) is connected to the first input to the first tap (ERR1).
Des Weiteren weist sie einen zweiten Komparator (CMP2) mit einem zweiten Eingang und einem vierten Eingang und einem zweiten Komparatorausgang auf. Der zweite Komparator (CMP2) ist mit dem zweiten Eingang mit dem zweiten Abgriff (ERR2) verbunden. Um den ersten Schwellwert einzustellen ist beispielsweise eine erste Offsetspannungsquelle (VERR1), die Teil der Teilvorrichtung ist, auf der einen Seite mit dem ersten Abgriff (ERR1) und auf der anderen Seite mit dem vierten Eingang des zweiten Komparators (CMP2) verbunden. Andere Konstruktionen, die auf einen festen Spannungsversatz zwischen erstem Abgriff (ERR1) und dem vierten Eingang des zweiten Komparators (CMP2) hinauslaufen, sind denkbar und im Sinne dieser Offenbarung als erste Offsetspannungsquelle (VERR1) zu betrachten.Furthermore, it has a second comparator (CMP2) with a second input and a fourth input and a second comparator output. The second comparator (CMP2) is connected to the second input to the second tap (ERR2). To set the first threshold, for example, a first offset voltage source (V ERR1 ) that is part of the subdevice is connected on one side to the first tap (ERR1) and on the other side to the fourth input of the second comparator (CMP2). Other constructions that result in a fixed voltage offset between the first tap (ERR1) and the fourth input of the second comparator (CMP2) are conceivable and considered to be the first offset voltage source (V ERR1 ) in the sense of this disclosure.
Des Weiteren verfügt sie über eine zweite Offsetspannungsquelle (VERR2), die auf der einen Seite mit dem zweiten Abgriff (ERR2) und auf der anderen Seite mit dem dritten Eingang verbunden ist. Andere Konstruktionen, die auf einen festen Spannungsversatz zwischen zweiten Abgriff (ERR2) und dem drittem Eingang des ersten Komparators (CMP1) hinauslaufen, sind denkbar und im Sinne dieser Offenbarung als zweite Offsetspannungsquelle (VERR2) zu betrachten.Furthermore, it has a second offset voltage source (V ERR2 ) connected on one side to the second tap (ERR2) and on the other side to the third input. Tantamount other constructions to a fixed offset voltage between the second tap (ERR2) and the third input of the first comparator (CMP1), are possible and within the meaning of this disclosure as the second offset voltage source (V ERR2) to consider.
Um nun das Fehlersignal (FS) zu generieren, wird eine Logikschaltung (LG), vorzugsweise ein ODER-Gatter vorgesehen. Diese Logikschaltung (LG) verknüpft den ersten und zweiten Komparatorausgang der beiden Komparatoren (CMP1, CMP2) verknüpft, um daraus ein Fehlersignal (FS) zu erzeugen und/oder ein Fehler-Flag zusetzen und/oder einen Registerinhalt zu ändern.In order to generate the error signal (FS), a logic circuit (LG), preferably an OR gate, is provided. This logic circuit (LG) linked the first and second comparator output of the two comparators (CMP1, CMP2) linked to generate an error signal (FS) and / or set an error flag and / or change a register contents.
In einer weiteren Ausprägung der Erfindung weist die erfindungsgemäße Vorrichtung eine Teilvorrichtung mit einem ersten Komparator (CMP1) mit einem ersten Eingang und einem dritten Eingang und einem ersten Komparatorausgang auf, der mit dem ersten Eingang mit dem ersten Abgriff (ERR1) verbunden ist. Des Weiteren weist sie einen zweiten Komparator (CMP2) mit einem zweiten Eingang und einem vierten Eingang und einem zweiten Komparatorausgang auf, der mit dem zweiten Eingang mit dem zweiten Abgriff (ERR2) verbunden ist. Wie zuvor weist sie eine erste Offsetspannungsquelle (VERR1) auf, die auf der einen Seite mit dem ersten Abgriff (ERR1) und auf der anderen Seite mit dem vierten Eingang verbunden ist. Diese erste Offsetspannungsquelle (VERR1) dient wie zuvor der Darstellung eines ersten Schwellwertes mit dem das Potenzial am ersten Eingang des ersten Komparators durch den ersten Komparator (CMP1) verglichen wird. Hierdurch wird der erste Abgriff (ERR1) mit diesem ersten Schwellwert verglichen. Darüber hinaus weist sie eine zweite Offsetspannungsquelle (VERR2) auf, die auf der einen Seite mit dem zweiten Abgriff (ERR2) und auf der anderen Seite mit dem dritten Eingang verbunden ist. Diese zweite Offsetspannungsquelle (VERR2) dient wie zuvor der Darstellung eines zweiten Schwellwertes mit dem das Potenzial am zweiten Eingang des zweiten Komparators durch den zweiten Komparator (CMP2) verglichen wird. Hierdurch wird der zweite Abgriff (ERR2) mit diesem zweiten Schwellwert verglichen. Andere Realisierungen sind selbstverständlich möglich. Um das notwendige Ausgangssignal zu erzeugen verknüpft eine Logikschaltung den ersten und zweiten Komparatorausgang, um daraus ein Fehlersignal zu erzeugen und/oder ein Fehler-Flag zusetzen und/oder einen Registerinhalt zu ändern.In a further embodiment of the invention, the device according to the invention has a sub-device with a first comparator (CMP1) having a first input and a third input and a first comparator output, which is connected to the first input to the first tap (ERR1). Furthermore, it has a second comparator (CMP2) with a second input and a fourth input and a second comparator output which is connected to the second input with the second tap (ERR2). As before, it has a first offset voltage source (V ERR1 ) connected on one side to the first tap (ERR1) and on the other side to the fourth input. As before, this first offset voltage source (V ERR1 ) serves to display a first threshold value with which the potential at the first input of the first comparator is compared by the first comparator (CMP1). This compares the first tap (ERR1) with this first threshold. In addition, it has a second offset voltage source (V ERR2 ) which is connected on one side to the second tap (ERR2) and on the other side to the third input. As before, this second offset voltage source (V ERR2 ) serves to represent a second threshold value with which the potential at the second input of the second comparator is compared by the second comparator (CMP2). This compares the second tap (ERR2) with this second threshold. Other implementations are of course possible. To generate the necessary output signal, a logic circuit couples the first and second comparator outputs to produce an error signal and / or set an error flag and / or change register contents.
Neben dieser Vorrichtung umfasst daher die Erfindung auch ein Verfahren zur Überwachung der elektrischen Energieversorgung mindestens einer ersten LED-Kette (LED1) mit n LEDs aus einer ersten geregelten Stromquelle (I1) mit einem ersten Nennstrom (I10) und mindestens einer zweiten LED-Kette (LED2) mit m LEDs aus einer zweiten Stromquelle (I2) mit einem zweiten Nennstrom (I20). Das erfindungsgemäße Verfahren beginnt mit dem Erzeugen eines ersten Abgriffpotenzials als ersten Fehlererkennungsparameter an einem ersten Abgriff (ERR1). Vorzugsweise ist das Abgriffpotenzial proportional von dem Spannungsabfall über die erste LED-Kette (LED1) abhängig. Zumindest sollte diese Abhängigkeit jedoch das streng monoton sein. Hierzu dient erfindungsgemäß der bevorzugte erste Spannungsteiler (RS1), wobei der erste Abgriff (ERR1) ggf. auch am Anfang der ersten LED-Kette (LED1) erfolgen kann. Als zweites wird analog dazu ein zweites Abgriffpotenzial als zweiter Fehlererkennungsparameter an einem zweiten Abgriff (ERR2) erzeugt. Auch hier wird wieder Proportionalität bevorzugt. Mindestens jedoch sollte dieses zweite Abgriffpotenzial das streng monoton von dem Spannungsabfall über die zweite LED-Kette (LED2) abhängen. Wierder ist ein Spannungsteiler, hier der zweite Spannungsteilers (RS2) die bevorzugte Realisierung. Auch hier kann der zweite Abgriff (ERR2) ggf. auch am Anfang der zweiten LED-Kette (LED2) erfolgen. In einem dritten Schritt folgt der Vergleich der Spannungsdifferenz zwischen dem ersten Abgriffpotenzial und dem zweiten Abgriffpotenzial, insbesondere durch eine Auswerteschaltung (AS) und insbesondere unter Bildung eines Spannungsdifferenzsignals, In einem vierten Schritt folgt das Vergleichen der so ermittelten Spannungsdifferenz zwischen dem ersten Abgriffpotenzial und dem zweiten Abgriffpotenzial, insbesondere in Form des Spannungsdifferenzsignals, mit einem ersten Schwellwert und einem zweiten Schwellwert. Letzterer sollte, um ein Toleranzfenster bilden zu können, vom ersten Schwellwert verschieden sein. Dieser Vergleich erfolgt bevorzugt wieder durch die Auswerteschaltung (AS), erfolgt. In einem fünften Schritt erfolgt die Nutzbarmachung des Vergleichsergebnisses durch die Auswerteschaltung (AS). Diese signalisiert, ob die Spannungsdifferenz zwischen dem ersten und dem zweiten Schwellwert liegt, wobei die Signalisierung insbesondere durch ein Fehlersignal (FS) und/oder das Setzen eines Fehler-Flags und/oder das Ändern eines einen Registerinhalts erfolgen kann.In addition to this device, therefore, the invention also includes a method for monitoring the electrical power supply of at least a first LED chain (LED1) with n LEDs from a first regulated current source (I1) with a first rated current (I 10 ) and at least one second LED chain (LED2) with m LEDs from a second current source (I2) with a second rated current (I 20 ). The method according to the invention begins with the generation of a first tap potential as the first error detection parameter at a first tap (ERR1). Preferably, the tap potential is proportional to the voltage drop across the first LED string (LED1). At the very least, this dependency should be strictly monotone. According to the invention, the preferred first voltage divider (RS1) is used for this purpose, with the first tap (ERR1) possibly also being able to be made at the beginning of the first LED chain (LED1). Second, analogously, a second tap potential is generated as a second error detection parameter at a second tap (ERR2). Again, proportionality is preferred again. However, at least this second tap potential should depend strictly monotone on the voltage drop across the second LED string (LED2). Wierder is a voltage divider, here the second voltage divider (RS2) is the preferred realization. Here, too, the second tap (ERR2) may also take place at the beginning of the second LED chain (LED2). In a third step follows the comparison of the voltage difference between the first tap potential and the second tap potential, in particular by an evaluation circuit (AS) and in particular to form a voltage difference signal, in a fourth step follows the comparison of the thus determined voltage difference between the first tap potential and the second Tap potential, in particular in the form of the voltage difference signal, with a first threshold and a second threshold. The latter should be different from the first threshold in order to form a tolerance window. This comparison is preferably carried out again by the evaluation circuit (AS). In a fifth step, the utilization of the comparison result by the evaluation circuit (AS) takes place. This signals whether the voltage difference lies between the first and the second threshold value, wherein the signaling can be effected in particular by an error signal (FS) and / or the setting of an error flag and / or the changing of a register content.
In einer Variante des Verfahrens weichen der erste Schwellwert und der zweite Schwellwert um nicht mehr als 1% und/oder schlechter um nicht mehr als 2% und/oder schlechter um nicht mehr als 5% und/oder schlechter um nicht mehr als 10% und/oder schlechter um nicht mehr als 25% und/oder schlechter um nicht mehr als 50% voneinander ab. Hierbei hängt die Wahl der Breite des Toleranzfensters von der Fertigungsstreuung der Flussspannungen der LEDs ab.In a variant of the method, the first threshold value and the second threshold value do not differ by more than 1% and / or worse by not more than 2% and / or inferior by not more than 5% and / or worse by not more than 10% and / or worse by not more than 25% and / or worse by not more than 50%. In this case, the choice of the width of the tolerance window depends on the production spread of the forward voltages of the LEDs.
In einer weiteren Variante des Verfahrens wird mindestens ein weiterer Fehlererkennungsparameter durch eine Fehlererkennungsparametermessvorrichtung erfasst. Dies ist bevorzugt eine Temperatur (ϑ1), die durch eine Temperaturmessvorrichtung (TM1) gemessen wird und an den Auswerteschaltkreis (AS) gegeben wird. Dabei wird zumindest ein Schwellwertes in Abhängigkeit von mindestens diesem einem weiteren Fehlererkennungsparameter, insbesondere durch zumindest einen Teil der Auswerteschaltung (AS), geändert.In a further variant of the method, at least one further error detection parameter is detected by an error detection parameter measuring device. This is preferably a temperature (θ 1 ) which is measured by a temperature measuring device (TM1) and sent to the evaluation circuit (AS). In this case, at least one threshold value is changed as a function of at least one further error detection parameter, in particular by at least one part of the evaluation circuit (AS).
In einer weiteren Variante des Verfahrens erfolgt eine Bewertung der Fehlererkennungsparameter, insbesondere durch die Auswerteschaltung, in festen zeitlichem Zusammenhang mit einem Ein- oder Ausschaltsignal für die Stromquellen (I1, I2). Dies hat den Vorteil, dass Probleme mit der Versorgungsstabilität insbesondere in der Einschalt- und Ausschaltphase nicht zu fehlerhaften Fehlererkennungen führen.In a further variant of the method, an evaluation of the error detection parameters, in particular by the evaluation circuit, takes place in a fixed temporal relationship with an on or off signal for the current sources (I1, I2). This has the advantage that problems with the supply stability, especially in the switch-on and switch-off do not lead to erroneous error detection.
In einer weiteren Variante des verfahrens erfolgt ein Erfassen mindestens einer eine Temperatur (ϑ1, ϑ2), die in einem thermischen Wirkzusammenhang mit mindestens einer der LED-Ketten (LED1, LED2) steht, mittels einer Temperaturmessvorrichtung (TM1, TM2) als weiteren Fehlererkennungsparameter.In a further variant of the method of detecting is carried out at least one of a temperature (θ 1, θ 2) which is in thermal operative connection with at least one of the LED strings (LED1, LED2) is, by means of a temperature measuring means (TM1, TM2) as a further error detection parameters.
In einer weiteren Variante des Verfahrens wird mindestens ein abgeleiteter weiterer Fehlererkennungsparameter, insbesondere durch die Auswerteschaltung (AS), aus mindestens einem ersten und/oder zweiten und/oder anderen weiteren Fehlererkennungsparameter abgeleitet. Das Ergebnis dieser Ableitung kann dabei einer der folgenden abgeleiteten weiteren Fehlererkennungsparameter sein kann:
- a. eine erste und/oder höhere zeitliche Ableitung eines ersten und/oder zweiten und/oder weiteren Fehlererkennungsparameters und/oder
- b. eine erste und/oder höhere zeitliche Integration eines ersten und/oder zweiten und/oder weiteren Fehlererkennungsparameters und/oder
- c. eine Differenz und/oder mit reellen Faktoren gewichtete Summe mindestens zweier Fehlererkennungsparameter, insbesondere eine Temperaturdifferenz einer ersten Temperatur (ϑ1) und einer zweiten Temperatur (ϑ2).
- a. a first and / or higher temporal derivative of a first and / or second and / or further error detection parameter and / or
- b. a first and / or higher temporal integration of a first and / or second and / or further error detection parameter and / or
- c. a difference and / or weighted with real factors sum of at least two fault detection parameters, in particular a temperature difference of a first temperature (θ 1 ) and a second temperature (θ 2 ).
Beschreibung der FigurenDescription of the figures
Fig. 1Fig. 1
Fig. 2Fig. 2
Fig. 3Fig. 3
Fig. 4Fig. 4
Fig. 5Fig. 5
Fig. 6Fig. 6
Diese beispielhafte Teilvorrichtung verfügt beispielhaft über einem ersten Komparator (CMP1) mit einem ersten Eingang und einem dritten Eingang und einem ersten Komparatorausgang, der mit dem ersten Eingang mit dem ersten Abgriff (ERR1) verbunden ist.By way of example, this exemplary sub-device has a first comparator (CMP1) with a first input and a third input and a first comparator output which is connected to the first input with the first tap (ERR1).
Des Weiteren weist sie einen zweiten Komparator (CMP2) mit einem zweiten Eingang und einem vierten Eingang und einem zweiten Komparatorausgang auf, der mit dem zweiten Eingang mit dem zweiten Abgriff (ERR2) verbunden ist.Furthermore, it has a second comparator (CMP2) with a second input and a fourth input and a second comparator output which is connected to the second input with the second tap (ERR2).
Sie weist eine erste Offsetspannungsquelle (VERR1) auf, die auf der einen Seite mit dem ersten Abgriff (ERR1) und auf der anderen Seite mit dem vierten Eingang verbunden ist. Diese erste Offsetspannungsquelle (VERR1) dient wie zuvor der Darstellung eines ersten Schwellwertes mit dem das Potenzial am ersten Eingang des ersten Komparators durch den ersten Komparator (CMP1) verglichen wird. Hierdurch wird der erste Abgriff (ERR1) mit diesem ersten Schwellwert verglichen. Darüber hinaus weist sie eine zweite Offsetspannungsquelle (VERR2) auf, die auf der einen Seite mit dem zweiten Abgriff (ERR2) und auf der anderen Seite mit dem dritten Eingang verbunden ist. Diese zweite Offsetspannungsquelle (VERR2) dient wie zuvor der Darstellung eines zweiten Schwellwertes mit dem das Potenzial am zweiten Eingang des zweiten Komparators durch den zweiten Komparator (CMP2) verglichen wird. Hierdurch wird der zweite Abgriff (ERR2) mit diesem zweiten Schwellwert verglichen. Andere Realisierungen sind selbstverständlich möglich. Um das notwendige Ausgangssignal zu erzeugen verknüpft eine Logikschaltung den ersten und zweiten Komparatorausgang, um daraus ein Fehlersignal zu erzeugen und/oder ein Fehler-Flag zusetzen und/oder einen Registerinhalt zu ändern.It has a first offset voltage source (V ERR1 ) which is connected on one side to the first tap (ERR1) and on the other side to the fourth input. As before, this first offset voltage source (V ERR1 ) serves to display a first threshold value with which the potential at the first input of the first comparator is compared by the first comparator (CMP1). This compares the first tap (ERR1) with this first threshold. In addition, it has a second offset voltage source (V ERR2 ) which is connected on one side to the second tap (ERR2) and on the other side to the third input. As before, this second offset voltage source (V ERR2 ) serves to represent a second threshold value with which the potential at the second input of the second comparator is compared by the second comparator (CMP2). This compares the second tap (ERR2) with this second threshold. Other implementations are of course possible. To generate the necessary output signal, a logic circuit couples the first and second comparator outputs to produce an error signal and / or set an error flag and / or change register contents.
Fig. 7Fig. 7
Fig. 8Fig. 8
Vorteile der Erfindung Advantages of the invention
Die Erfindung ermöglicht die Überwachung der Funktion der LEDs in automobilen Anwendungen wie beispielsweise Bremsleuchten, Blinkern und Rückleuchten etc.The invention enables the monitoring of the function of the LEDs in automotive applications such as brake lights, turn signals and taillights etc.
BezugszeichenlisteLIST OF REFERENCE NUMBERS
-
- ASAS
- Auswerteschaltkreisevaluation circuit
-
CMP1
CMP 1 - erster Komparatorfirst comparator
- CMP2CMP2
- zweiter Komparatorsecond comparator
-
CMP3
CMP 3 - dritter Komparatorthird comparator
-
CMP4
CMP 4 - vierter Komparatorfourth comparator
- ERR1ERR1
- erste Abgrifffirst tap
- ERR2ERR2
- zweiter Abgriffsecond tap
- ERR3ERR3
- dritter Abgriffthird tap
- ERR4ERR4
- vierter Abgrifffourth tap
- FSFS
- Fehlersignalerror signal
- GNDGND
- gemeinsamer Knoten (Bezugspotenzial)common node (reference potential)
- I1I1
- erste geregelte Stromquellefirst regulated power source
- I10 I 10
- erster Nennstrom, die die erste Stromquelle (I1) für die erste LED-Kette (LED1) bereitstellt.first rated current that provides the first current source (I1) for the first LED string (LED1).
- I2I2
- zweite geregelte Stromquellesecond regulated power source
- I20 I 20
- zweiter Nennstrom, die die zweite Stromquelle (I2) für die zweite LED-Kette (LED2) bereitstellt.second rated current that provides the second current source (I2) for the second LED string (LED2).
- I3I3
- dritte geregelte Stromquellethird regulated power source
- I30 I 30
- dritter Nennstrom, die die dritte Stromquelle (I3) für die dritte LED-Kette (LED3) bereitstellt. third rated current, which provides the third current source (I3) for the third LED chain (LED3).
- LED1LED1
- erste LED-Kettefirst LED chain
- LED2LED2
- zweite LED-Kettesecond LED chain
- LED3LED3
- dritte LED-Kettethird LED chain
- LGLG
- Logikschaltunglogic circuit
- RR
- Grundwiderstandground resistance
- R1R1
- erster Gesamtwiderstand des ersten Spannungsteilers (RS1)first total resistance of the first voltage divider (RS1)
- RS1RS1
- erster Spannungsteiler mit erstem Gesamtwiderstand (R1)first voltage divider with first total resistance (R1)
- R2R2
- zweiter Gesamtwiderstand des zweiten Spannungsteilers (RS2)second total resistance of the second voltage divider (RS2)
- RS2RS2
- zweiter Spannungsteiler mit zweitem Gesamtwiderstand (R2)second voltage divider with second total resistance (R2)
- R3R3
- dritter Gesamtwiderstand des dritten Spannungsteilers (RS3)third total resistance of the third voltage divider (RS3)
- RS3RS3
- dritter Spannungsteiler mit drittem Gesamtwiderstand (R3)third voltage divider with third total resistance (R3)
- ϑ1 θ 1
- in der Nähe der ersten LED-Kette (LED1) gemessene erste Temperatur bzw. erstes Temperaturmesssignal, dass diese erste Temperatur repräsentiert.in the vicinity of the first LED chain (LED1) measured first temperature or first temperature measurement signal that represents this first temperature.
- ϑ2 θ 2
- in der Nähe der zweiten LED-Kette (LED2) gemessene zweite Temperatur bzw. zweites Temperaturmesssignal, dass diese zweite Temperatur repräsentiert.measured in the vicinity of the second LED chain (LED2) second temperature or second temperature measurement signal that represents this second temperature.
- TM1TM1
- erste Temperaurmessvorrichtung zur Messung der ersten Temperatur (ϑ1)first temperature measuring device for measuring the first temperature (θ 1 )
- TM2TM2
- zweite Temperaurmessvorrichtung zur Messung der zweiten Temperatur (ϑ2)second Temperaurmessvorrichtung for measuring the second temperature (θ 2)
- U1U1
- Spannung (U1) zwischen diesem ersten Abgriff (ERR1) und dem gemeinsamen Knoten (GND)Voltage (U1) between this first tap (ERR1) and the common node (GND)
- U2U2
- Spannung (U2) zwischen diesem zweiten Abgriff (ERR2) und dem gemeinsamen Knoten (GND) Voltage (U2) between this second tap (ERR2) and the common node (GND)
- U3U3
- Spannung (U3) zwischen diesem drittem Abgriff (ERR3) und dem gemeinsamen Knoten (GND)Voltage (U3) between this third tap (ERR3) and the common node (GND)
- ULED1 U LED1
- erste Flussspannung der LEDs der ersten LED-Kette (LED1)first forward voltage of the LEDs of the first LED chain (LED1)
- ULED2 U LED2
- zweite Flussspannung der LEDs der zweiten LED-Kette (LED2)second forward voltage of the LEDs of the second LED chain (LED2)
- ULED3 U LED3
- dritte Flussspannung der LEDs der dritten LED-Kette (LED3)third forward voltage of the LEDs of the third LED chain (LED3)
- VERR1 V ERR1
- erste Offsetspannungsquellefirst offset voltage source
- VERR2 V ERR2
- zweite Offsetspannungsquellesecond offset voltage source
- VERR3 V ERR3
- dritte Offsetspannungsquellethird offset voltage source
- VERR4 V ERR4
- vierte Offsetspannungsquellefourth offset voltage source
ZITATE ENTHALTEN IN DER BESCHREIBUNG QUOTES INCLUDE IN THE DESCRIPTION
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