DE102011078243B4 - Manufacturing method for an electronic component with a step of embedding a metal layer - Google Patents
Manufacturing method for an electronic component with a step of embedding a metal layer Download PDFInfo
- Publication number
- DE102011078243B4 DE102011078243B4 DE102011078243.5A DE102011078243A DE102011078243B4 DE 102011078243 B4 DE102011078243 B4 DE 102011078243B4 DE 102011078243 A DE102011078243 A DE 102011078243A DE 102011078243 B4 DE102011078243 B4 DE 102011078243B4
- Authority
- DE
- Germany
- Prior art keywords
- barrier layer
- layer
- trench
- single barrier
- embedding
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 229910052751 metal Inorganic materials 0.000 title claims abstract description 74
- 239000002184 metal Substances 0.000 title claims abstract description 74
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 46
- 230000004888 barrier function Effects 0.000 claims abstract description 128
- 238000000034 method Methods 0.000 claims abstract description 63
- 238000004544 sputter deposition Methods 0.000 claims abstract description 44
- 238000000151 deposition Methods 0.000 claims abstract description 27
- 150000004767 nitrides Chemical class 0.000 claims abstract description 16
- 238000011049 filling Methods 0.000 claims abstract description 5
- 230000035699 permeability Effects 0.000 claims abstract description 5
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims abstract 2
- 230000008569 process Effects 0.000 claims description 17
- 238000002844 melting Methods 0.000 claims description 7
- 230000008018 melting Effects 0.000 claims description 7
- 239000010410 layer Substances 0.000 description 190
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 102
- 239000000758 substrate Substances 0.000 description 73
- 238000012545 processing Methods 0.000 description 63
- 239000010408 film Substances 0.000 description 60
- 230000015572 biosynthetic process Effects 0.000 description 33
- 230000007246 mechanism Effects 0.000 description 27
- 239000007789 gas Substances 0.000 description 23
- 239000002245 particle Substances 0.000 description 21
- 239000004065 semiconductor Substances 0.000 description 20
- 239000000463 material Substances 0.000 description 18
- 230000008021 deposition Effects 0.000 description 16
- 238000005259 measurement Methods 0.000 description 15
- 238000009792 diffusion process Methods 0.000 description 13
- 238000010438 heat treatment Methods 0.000 description 12
- 230000006870 function Effects 0.000 description 10
- 239000010409 thin film Substances 0.000 description 9
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 8
- 238000005229 chemical vapour deposition Methods 0.000 description 8
- 238000001816 cooling Methods 0.000 description 8
- 230000005012 migration Effects 0.000 description 8
- 238000013508 migration Methods 0.000 description 8
- 239000013078 crystal Substances 0.000 description 7
- 239000011261 inert gas Substances 0.000 description 7
- 230000003746 surface roughness Effects 0.000 description 7
- 238000012546 transfer Methods 0.000 description 7
- 229910052782 aluminium Inorganic materials 0.000 description 6
- 238000011835 investigation Methods 0.000 description 6
- 230000009467 reduction Effects 0.000 description 6
- 239000012212 insulator Substances 0.000 description 5
- 229910001092 metal group alloy Inorganic materials 0.000 description 5
- 230000006866 deterioration Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 229910052757 nitrogen Inorganic materials 0.000 description 4
- 238000001179 sorption measurement Methods 0.000 description 4
- 229910004298 SiO 2 Inorganic materials 0.000 description 3
- 238000004630 atomic force microscopy Methods 0.000 description 3
- 229910052799 carbon Inorganic materials 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 3
- 238000005253 cladding Methods 0.000 description 3
- 238000012549 training Methods 0.000 description 3
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 3
- 229910001868 water Inorganic materials 0.000 description 3
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 2
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 description 2
- 230000009471 action Effects 0.000 description 2
- 238000004458 analytical method Methods 0.000 description 2
- 229910001873 dinitrogen Inorganic materials 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 239000007769 metal material Substances 0.000 description 2
- 239000006199 nebulizer Substances 0.000 description 2
- 239000011800 void material Substances 0.000 description 2
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 1
- 239000008411 PCM 4 Substances 0.000 description 1
- 238000002441 X-ray diffraction Methods 0.000 description 1
- 230000001133 acceleration Effects 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 238000005275 alloying Methods 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 238000000889 atomisation Methods 0.000 description 1
- 238000009530 blood pressure measurement Methods 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 230000000052 comparative effect Effects 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 239000000498 cooling water Substances 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 238000002425 crystallisation Methods 0.000 description 1
- 230000008025 crystallization Effects 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000006731 degradation reaction Methods 0.000 description 1
- 238000001493 electron microscopy Methods 0.000 description 1
- 238000011156 evaluation Methods 0.000 description 1
- 230000004907 flux Effects 0.000 description 1
- QOSATHPSBFQAML-UHFFFAOYSA-N hydrogen peroxide;hydrate Chemical compound O.OO QOSATHPSBFQAML-UHFFFAOYSA-N 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 238000011534 incubation Methods 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 239000000696 magnetic material Substances 0.000 description 1
- 238000001755 magnetron sputter deposition Methods 0.000 description 1
- 239000011259 mixed solution Substances 0.000 description 1
- 238000002663 nebulization Methods 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 238000012827 research and development Methods 0.000 description 1
- 238000004626 scanning electron microscopy Methods 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 229910052717 sulfur Inorganic materials 0.000 description 1
- 238000004381 surface treatment Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
Images
Classifications
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/06—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material characterised by the coating material
- C23C14/0641—Nitrides
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76877—Filling of holes, grooves or trenches, e.g. vias, with conductive material
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/53204—Conductive materials
- H01L23/53209—Conductive materials based on metals, e.g. alloys, metal silicides
- H01L23/53214—Conductive materials based on metals, e.g. alloys, metal silicides the principal metal being aluminium
- H01L23/53223—Additional layers associated with aluminium layers, e.g. adhesion, barrier, cladding layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66674—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
- H01L29/66712—Vertical DMOS transistors, i.e. VDMOS transistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7801—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
- H01L29/7802—Vertical DMOS transistors, i.e. VDMOS transistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Chemical & Material Sciences (AREA)
- Manufacturing & Machinery (AREA)
- Ceramic Engineering (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Materials Engineering (AREA)
- Mechanical Engineering (AREA)
- Metallurgy (AREA)
- Organic Chemistry (AREA)
- Electrodes Of Semiconductors (AREA)
- Physical Vapour Deposition (AREA)
Abstract
Herstellungsverfahren für ein elektronisches Bauteil nach einem „gate last“-Verfahren, mit:einem ersten Schritt zum Bilden einer isolierenden Schicht (603) mit hoher Permeabilitätskonstante in einem auf einem zu verarbeitenden Objekt ausgebildeten Graben (601), in dem eine isolierende Unterschicht (602) existiert;einem zweiten Schritt zum Bilden von Metallnitridschichten (701-703, 903) sowie einer Metallschicht (704, 904) zum Steuern einer Betriebsspannung über der isolierenden Schicht (603) mit hoher Permeabilität;einem dritten Schritt zum Ablagern einer einzelnen Barrierenschicht (705, 905), die Titannitrid enthält, bei einer Raumtemperatur über den Metallnitridschichten (701-703, 903) und der Metallschicht (704, 904) zum Steuern der Betriebsspannung durch ein Zerstäubungsverfahren, während ein Cusp-Magnetfeld auf einer Zieloberfläche ausgebildet wird; undeinem vierten Schritt zum Füllen einer Schicht (906) aus einem Metall mit niedrigem Schmelzpunkt unmittelbar auf die einzelne Barrierenschicht (705, 905) unter einer Temperaturbedingung, die ein Fließen der Schicht aus dem Metall mit niedrigem Schmelzpunkt erlaubt.A method of manufacturing an electronic component by a gate last method, comprising:a first step of forming an insulating layer (603) having a high permeability constant in a trench (601) formed on an object to be processed, in which an insulating underlayer (602 ) exists;a second step of forming metal nitride layers (701-703, 903) and a metal layer (704, 904) for controlling an operating voltage over the high permeability insulating layer (603);a third step of depositing a single barrier layer (705 , 905) containing titanium nitride at a room temperature over the metal nitride layers (701-703, 903) and the metal layer (704, 904) for controlling the operating voltage by a sputtering method while forming a cusp magnetic field on a target surface; and a fourth step of filling a low-melting-point metal layer (906) directly on said single barrier layer (705, 905) under a temperature condition allowing said low-melting-point metal layer to flow.
Description
HINTERGRUND DER ERFINDUNGBACKGROUND OF THE INVENTION
Gebiet der Erfindungfield of invention
Die Erfindung betrifft ein Herstellungsverfahren für ein elektronisches Bauteil, das einen Schritt zur Einbettung einer Metallschicht beinhaltet.The invention relates to a manufacturing method for an electronic component, which includes a step for embedding a metal layer.
Stand der TechnikState of the art
Im Stand der Technik wurden bei integrierten Halbleiterschaltungen sogenannte „gate first“-Verfahren verwendet, was ein Verfahren zur Durchführung einer Ätzverarbeitung nach der Ausbildung einer Gateisolationsschicht und einer Gateelektrode auf einer Waferoberfläche ist. In letzter Zeit wird die Gateisolationsschicht eines MOSFET mit der Elementminiaturisierung dünner, und wenn eine SiO2-Schicht für die Gateisolationsschicht verwendet wird, wird bei einer Schichtdicke von 2 nm oder weniger als dem derzeit erforderlichen Wert ein Tunnelstrom erzeugt, und der Gateleckstrom erhöht sich. Folglich wurde zuletzt untersucht, das Gateisolationsschichtmaterial durch ein Material mit hoher Dielektrizitätskonstante, dessen relative Dielektrizitätskonstante höher als die der SiO2-Schicht ist, zu ersetzten. Durch dieses Verfahren kann eine SiO2-konvertierte Schichtdicke (EOT: Equivalent Oxide Thickness - äquivalente Oxiddicke) dünner ausgebildet werden, selbst wenn die tatsächliche Dicke der Isolationsschicht größer ist. Bei einem aktuellen MOSFET mit einer Gatelänge von 22 nm oder weniger muss jedoch die EOT weiter reduziert werden. Um diesen Anforderungen gerecht zu werden, ist es nötig, die tatsächliche Dicke der isolierenden Schicht unter Verwendung des Materials mit hoher Dielektrizitätskonstante zur Reduktion des Gateleckstroms zu erhöhen. Bei dem „gate first“-Verfahren wird jedoch ein Source-/Drain-Ausbildungsschritt nach der Gate-Ausbildung durchgeführt, und dadurch werden die Gateisolationsschicht und die Gateelektrode erwärmt, wodurch eine Wärmediffusion zwischen der Isolationsschicht und der Metallschicht aufgrund der Erwärmung verursacht wird, und wodurch das Problem einer Beweglichkeitsverschlechterung und einer Verschiebung der Betriebsspannung (Vt) auftreten.In the prior art, semiconductor integrated circuits have used a so-called gate first method, which is a method of performing etching processing after forming a gate insulating film and a gate electrode on a wafer surface. Recently, the gate insulating film of a MOSFET is becoming thinner with the element miniaturization, and when a SiO 2 film is used for the gate insulating film, with a film thickness of 2 nm or less than the currently required value, a tunnel current is generated and the gate leakage current increases. Accordingly, it has recently been studied to replace the gate insulating film material with a high-dielectric-constant material whose relative dielectric constant is higher than that of the SiO 2 film. By this method, a SiO 2 -converted layer thickness (EOT: Equivalent Oxide Thickness) can be made thinner even if the actual thickness of the insulating layer is larger. However, for a current MOSFET with a gate length of 22nm or less, the EOT needs to be further reduced. In order to meet these requirements, it is necessary to increase the actual thickness of the insulating layer using the high-dielectric-constant material to reduce the gate leakage current. However, in the "gate first" method, a source/drain formation step is performed after the gate formation, and thereby the gate insulating film and the gate electrode are heated, causing heat diffusion between the insulating film and the metal film due to the heating, and thereby posing the problem of mobility degradation and operating voltage (Vt) drift.
Zur Lösung dieser Probleme erfolgte daher eine intensive Forschung und Entwicklung bezüglich eines sogenannten „gate last“-Verfahrens, bei dem zunächst Source und Drain ausgebildet werden, und zuletzt die Gateisolationsschicht und die Gateelektrode ausgebildet werden. Da bei diesem Verfahren der Gateteil zuletzt ausgebildet wird, kann die dem Gateteil zugeführte Erwärmungstemperatur niedriger sein, und es ist vielleicht möglich, die Beweglichkeitsverschlechterung und die Verschiebung der Betriebsspannung (Vt) zu unterdrücken, was die Probleme bei dem „gate first“-Verfahren waren. Aspekte des „gate last“-Verfahrens sind die Abscheidung von verschiedenen Metalldünnschichtarten in einer Form mit einer Öffnung von 22 nm oder weniger und einer Tiefe von 22 nm oder mehr (nachfolgend als Graben bezeichnet), und die Steuerung der Schichtdicken des auf der Seitenwand und dem Bodenteil des Grabens jeweils abgeschiedenen Materials auf gewünschte Werte. Da zudem die verschiedenen Metalldünnschichtarten gestapelt sind, ist es außerdem nötig, die Metalldiffusion zwischen den Metalldünnschichten zu unterdrücken.In order to solve these problems, intensive research and development has therefore been carried out on a so-called “gate last” method in which the source and drain are formed first and the gate insulating layer and the gate electrode are formed last. In this method, since the gate portion is formed last, the heating temperature applied to the gate portion can be lower, and it may be possible to suppress the mobility deterioration and the operating voltage (Vt) shift, which have been problems in the gate first method . Aspects of the "gate last" process are the deposition of different types of metal thin films in a mold with an opening of 22 nm or less and a depth of 22 nm or more (hereinafter referred to as trench), and controlling the film thicknesses of the sidewall and material deposited at the bottom portion of the trench to desired values. In addition, since the different kinds of metal thin films are stacked, it is necessary to suppress metal diffusion between the metal thin films.
Bei dem „gate last“-Verfahren beinhaltet das Verfahren zur Ausbildung der verschiedenen Arten von Metalldünnschichtmaterial ein CVD-Verfahren (chemisches Gasphasenabscheidungsverfahren), ein Atomschichtadsorptions-/Abscheideverfahren sowie ein Zerstäubungsverfahren. Das CVD-Verfahren weist Probleme bei der Steuerung der Schichtdicke, bei der Oberflächenhomogenität, sowie bei der Reproduzierbarkeit auf, da bei dem Ausbildungsvorgang eine Inkubationszeit existiert. Das Atomschichtadsorptions-/Abscheideverfahren weist eine ausgezeichnete Steuerbarkeit der Schichtdicke auf, aber wenn eine Dickschicht ausgebildet wird, wird die Wachstumszeit lang, und es treten Probleme mit den Kosten auf, weil ein teures Quellgas verwendet wird. Jedes dieser Verfahren unter Verwendung der chemischen Reaktion eines Quellgases kann eine Schicht nicht nur auf dem Bodenteil sondern auch auf der Seitenwand des Grabens homogen ausbilden, aber andererseits wird die Öffnung des Grabens schmäler, wenn die abgeschiedene Schichtdicke ansteigt. Als Verfahren zur Lösung dieser Probleme wird ein Verfahren zur Ausbildung der verschiedenen Arten von Metalldünnschichtmaterial durch ein Zerstäubungsverfahren vorgeschlagen, dass eine ausgezeichnete Steuerbarkeit der Schichtdicke, der Oberflächenhomogenität, und der Reproduzierbarkeit aufweist.In the gate last method, the method for forming the various types of metal thin film material includes a CVD (Chemical Vapor Deposition) method, an atomic layer adsorption/deposition method, and a sputtering method. The CVD method has problems in controlling layer thickness, surface homogeneity, and reproducibility because there is an incubation period in the formation process. The atomic layer adsorption/deposition method has excellent film thickness controllability, but when a thick film is formed, the growth time becomes long and there are problems of cost because an expensive source gas is used. Any of these methods using the chemical reaction of a source gas can homogeneously form a film not only on the bottom part but also on the side wall of the trench, but on the other hand, the opening of the trench narrows as the deposited film thickness increases. As a method for solving these problems, there is proposed a method of forming the various kinds of metal thin film material by a sputtering method, which is excellent in film thickness controllability, surface homogeneity, and reproducibility.
Die Veröffentlichung der japanischen Patentanmeldung
Nach vorstehender Beschreibung werden bei den neuesten Schichtausbildungsvorgängen auf einem äußerst feinen Muster verschiedene Metalldünnschichtarten gestapelt, und dadurch die Reduktion eines Grabenöffnungsdurchmessers verursacht. Folglich ist es notwendig, eine Metalldünnschichtausbildungstechnik zu verwenden, welche die Reduktion des Öffnungsdurchmessers soweit wie möglich unterdrücken kann, selbst wenn die verschiedenen Metalldünnschichtarten gestapelt werden. Es ist zudem klar, dass die AI-Einbettung die Charakteristik einer bei dem Gateelektrodenteil verwendeten Metallschicht durch die AI-Diffusion verschlechtert, weswegen eine Barrierenschichtausbildungstechnik für eine äußerst dünne Schicht zur Unterdrückung der AI-Diffusion erforderlich ist.As described above, in recent film forming processes, various kinds of metal thin films are stacked on an extremely fine pattern, thereby causing reduction of a trench opening diameter. Consequently, it is necessary to use a metal thin film forming technique which can suppress the reduction of the opening diameter as much as possible even when the different kinds of metal thin films are stacked. It is also clear that Al embedding deteriorates the characteristic of a metal film used in the gate electrode part by Al diffusion, therefore, a barrier layer formation technique for an extremely thin film for suppressing Al diffusion is required.
Jede der vorstehend beschriebenen Techniken weist jedoch das nachfolgend beschriebene Problem auf.However, each of the techniques described above has the problem described below.
Das Verfahren zur Zerstäubung bei einem hohen Druck von 133,322 Pa (1 Torr) oder höher, das in der Druckschrift
Einschlägiger Stand der Technik dazu kann beispielsweise in der Druckschrift
ERFINDUNGSZUSAMMENFASSUNGSUMMARY OF THE INVENTION
Der vorliegenden Erfindung liegt die Aufgabe zugrunde, ein Herstellungsverfahren für ein elektronisches Bauteil mit einem Schritt zur Einbettung einer Metallschicht (beispielsweise aus AI) in einem konkaven Teil (beispielsweise einem Graben) bereitzustellen, wobei das Verfahren die Reduktion der Öffnung des auf einem Substrat ausgebildeten konkaven Teils unterdrücken kann, und zudem eine zur Unterdrückung der Diffusion des einzubettenden Metalls befähigte Barrierenschicht ausbilden kann.It is an object of the present invention to provide a manufacturing method for an electronic component comprising a step of embedding a metal (e.g. Al) layer in a concave part (e.g. a trench), the method reducing the opening of the concave formed on a substrate Can partially suppress, and also capable of suppressing the diffusion of the metal to be embedded barrier layer can form.
Als Ergebnis intensiver Untersuchungen zur Lösung dieses Problems wurde erfindungsgemäß herausgefunden, dass eine äußerst dünne einzelne TiN-Barrierenschicht in einem auf einem Substrat ausgebildeten konkaven Teil (beispielsweise einem Grabenteil) unter Verwendung eines erfindungsgemäßen Abscheidegerätes ausgebildet werden kann, und ferner die AI-Einbettung auf einer einzelnen TiN-Schicht sogar ohne AI-Keimschicht durchgeführt werden kann.As a result of intensive studies to solve this problem, the present invention has found that an extremely thin TiN single barrier layer can be formed in a concave part (e.g., a trench part) formed on a substrate using a deposition apparatus of the present invention, and further Al embedding on a individual TiN layer can be performed even without an Al seed layer.
Die Erfindung stellt ein Herstellungsverfahren für ein elektronisches Bauteil auf eine „gate last“ Verfahren entsprechend den Patentansprüchen bereit.The invention provides a manufacturing method for an electronic component based on a "gate last" method according to the claims.
Ein Herstellungsverfahren für ein elektronisches Bauteil umfasst einen dritten Schritt zur Abscheidung einer einzelnen Barrierenschicht mit TiN in einem konkaven Teil, das auf einem durch ein Zerstäubungsverfahren zu verarbeitenden Objekt ausgebildet ist, während ein Cusp-Magnetfeld auf einer Zieloberfläche ausgebildet wird; und einen vierten Schritt zum Füllen einer Schicht aus einem Metall mit niedrigem Schmelzpunkt unmittelbar auf der einzelnen Barrierenschicht unter Temperaturbedingungen, welche ein Fließen der Schicht aus dem Metall mit niedrigem Schmelzpunkt erlauben.A manufacturing method for an electronic part includes a third step of depositing a single barrier layer including TiN in a concave part formed on an object to be processed by a sputtering method while forming a cusp magnetic field on a target surface; and a fourth step of filling a low-melting-point metal layer immediately on the single barrier layer under temperature conditions allowing the low-melting-point metal layer to flow.
Bei einer derartigen Konfiguration ist es möglich, AI ohne Verringerung eines Öffnungsdurchmessers oder unter Unterdrückung der Verringerung des Öffnungsdurchmessers selbst bei einem feinen Graben mit einem Öffnungsdurchmesser von 22 nm oder weniger einzubetten.With such a configuration, it is possible to embed Al without reducing an opening diameter or suppressing reduction in opening diameter even in a fine trench having an opening diameter of 22 nm or less.
Ein Herstellungsgerät umfasst für ein elektronisches Bauteil eine Zerstäubungseinrichtung mit einer Zielelektrode, die mit einer Hochfrequenzenergieversorgungsquelle verbunden ist, und zur Anbringung eines Ziels befähigt ist, sowie eine Magneteinheit, die zur Ausbildung eines Cusp-Magnetfeldes auf einer Oberfläche des Ziels eingerichtet ist, wenn das Ziel auf der Zielelektrode angebracht ist; sowie eine Steuereinheit zur Steuerung der Zerstäubungseinrichtung, wobei, wenn ein Ti oder TiN enthaltendes Ziel auf der Zielelektrode angeordnet ist, und eine Barrierenschicht in einem auf einem zu verarbeitenden Objekt ausgebildeten konkaven Teil ausgebildet ist, die Steuereinheit zum Steuern der Zerstäubungseinrichtung so eingerichtet ist, dass eine TiN enthaltende einzelne Barrierenschicht in dem konkaven Teil ausgebildet wird.An electronic component manufacturing apparatus includes a sputtering device having a target electrode connected to a high-frequency power supply source and capable of attaching a target, and a magnet unit configured to form a cusp magnetic field on a surface of the target when the target attached to the target electrode; such as a control unit for controlling the sputtering device, wherein when a target containing Ti or TiN is placed on the target electrode and a barrier layer is formed in a concave part formed on an object to be processed, the control unit for controlling the sputtering device is arranged so that a TiN-containing single barrier layer is formed in the concave part.
Ein Herstellungsgerät für ein elektronisches Bauteil umfasst ein erstes Zerstäubungsgerät, das aufweist: eine erste Zerstäubungseinrichtung mit einer ersten Zielelektrode, die mit einer ersten Hochfrequenzenergieversorgungsquelle verbunden ist, und die zur Anbringung eines Ziels befähigt ist, sowie eine ersten Magneteinheit, die zur Ausbildung eines Cusp-Magnetfeldes auf einer Oberfläche des Ziels eingerichtet ist, wenn das Ziel auf der ersten Zielelektrode angebracht ist; und eine zweiten Steuereinheit, die zum Steuern der ersten Zerstäubungseinrichtung so eingerichtet ist, dass eine TiN enthaltende einzelne Barrierenschicht in einem konkaven Teil ausgebildet ist, wenn ein Ti oder TiN enthaltendes Ziel auf der ersten Zielelektrode angeordnet ist, und eine Barrierenschicht in dem auf einem zu verarbeitenden Objekt ausgebildeten konkaven Teil ausgebildet ist; und ein zweites Zerstäubungsgerät mit: einer zweiten Zerstäubungseinrichtung mit einer zweiten Zielelektrode, die mit einer zweiten Hochfrequenzenergieversorgungsquelle verbunden ist, und die zur Anbringung eines Ziels befähigt ist, sowie einer zweiten Magneteinheit, die zur Ausbildung eines Cusp-Magnetfeldes auf einer Oberfläche des Ziels eingerichtet ist, wenn das Ziel auf der zweiten Zielelektrode angebracht ist; und eine zweiten Steuereinheit, die zur Steuerung der zweiten Zerstäubungseinrichtung eingerichtet ist, so dass eine Schicht aus einem Metall mit niedrigem Schmelzpunkt unmittelbar auf der einzelnen Barrierenschicht ausgebildet wird, und das Metall mit niedrigem Schmelzpunkt in dem konkaven Teil unter Temperaturbedingungen eingebettet wird, welche erlauben, dass die Schicht aus dem Metall mit niedrigem Schmelzpunkt fließt, wenn ein das Metall mit niedrigem Schmelzpunkt enthaltendes Ziel auf der zweiten Zielelektrode angeordnet ist, und das Metall mit niedrigem Schmelzpunkt in dem konkaven Teil eingebettet wird, wo die einzelne Barrierenschicht ausgebildet ist.An electronic component manufacturing apparatus includes a first sputtering apparatus including: a first sputtering device having a first target electrode connected to a first high-frequency power supply source and capable of attaching a target, and a first magnet unit capable of forming a cusp magnetic field is established on a surface of the target when the target is mounted on the first target electrode; and a second control unit configured to control the first sputtering device so that a TiN-containing single barrier layer is formed in a concave part when a Ti or TiN-containing target is placed on the first target electrode, and a barrier layer in the one toward processed object formed concave part; and a second sputtering apparatus comprising: a second sputtering device having a second target electrode connected to a second high-frequency power supply source and capable of attaching a target, and a second magnet unit configured to form a cusp magnetic field on a surface of the target , when the target is mounted on the second target electrode; and a second control unit configured to control the second sputtering means so that a low-melting-point metal layer is formed directly on the single barrier layer, and the low-melting-point metal is embedded in the concave part under temperature conditions that allow that the low-melting-point metal layer flows when a target containing the low-melting-point metal is placed on the second target electrode, and the low-melting-point metal is embedded in the concave part where the single barrier layer is formed.
Ein elektronisches Bauteil umfasst ein Element, das ein konkaves Teil beinhaltet; eine Elektrodenschicht, die innerhalb des konkaven Teils ausgebildet ist; eine Schicht aus einem Metall mit niedrigem Schmelzpunkt, die innerhalb des konkaven Teils eingebettet ist; und eine Barrierenschicht, die zwischen der Schicht aus dem Metall mit niedrigem Schmelzpunkt und der Elektrodenschicht ausgebildet ist, und TiN beinhaltet, wobei die Barrierenschicht eine (220)-Orientierung aufweist.An electronic component includes an element including a concave part; an electrode layer formed inside the concave part; a low melting point metal layer embedded within the concave portion; and a barrier layer formed between the low melting point metal layer and the electrode layer and including TiN, the barrier layer having a (220) orientation.
Durch Ausbildung einer extrem dünnen einzelnen TiN-Barrierenschicht innerhalb eines konkaven Teils (beispielsweise eines Grabens), der auf dem Substrat ausgebildet ist, und durch Einbetten eines Metalls mit niedrigem Schmelzpunkt (beispielsweise AI) auf der einzelnen TiN-Barrierenschicht ist es erfindungsgemäß möglich, das Metall mit niedrigem Schmelzpunkt (beispielsweise AI) ohne Verringerung des Öffnungsdurchmessers, oder unter Unterdrücken der Verringerung des Öffnungsdurchmessers selbst bei einem feinen konkaven Teil mit einem Öffnungsdurchmesser von beispielsweise 22 nm oder weniger einzubetten, während die einzelne TiN-Barrierenschicht bevorzugte Barriereneigenschaften zum Unterdrücken der Diffusion des Metalls mit niedrigem Schmelzpunkt in eine Unterschicht aufweist. Auch wenn das erfindungsgemäße Herstellungsverfahren für ein elektronisches Bauteil mit dem Schritt zur Einbettung einer Metallschicht auf ein Herstellungsverfahren mit einem Leiterbahnausbildungsschritt angewandt wird, ist es folglich möglich, AI einzubetten, ohne einen Öffnungsdurchmesser zu reduzieren, oder indem die Reduktion des Öffnungsdurchmessers ein einem feinen konkaven Teil mit einem Öffnungsdurchmesser von 22 nm oder weniger unterdrückt wird.According to the present invention, by forming an extremely thin TiN single barrier layer within a concave part (e.g., a trench) formed on the substrate and embedding a low-melting-point metal (e.g., Al) on the TiN single barrier layer Embedding low-melting-point metal (e.g., Al) without reducing the aperture diameter, or suppressing the reduction in the aperture diameter even in a fine concave part with an aperture diameter of, for example, 22 nm or less, while the single TiN barrier layer has preferred barrier properties for suppressing the diffusion of the metal with a low melting point in an underlayer. Consequently, even when the electronic component manufacturing method of the present invention including the step of embedding a metal layer is applied to a manufacturing method including a wiring formation step, it is possible to embed Al without reducing an opening diameter or by reducing the opening diameter in a fine concave part with an aperture diameter of 22 nm or less is suppressed.
Figurenlistecharacter list
-
1 zeigt eine schematische Ansicht eines Verarbeitungsgeräts zur Verwendung gemäß einem Ausführungsbeispiel der Erfindung.1 Figure 12 shows a schematic view of a processing apparatus for use in accordance with an embodiment of the invention. -
2 zeigt eine Anordnung eines innerhalb eines Verarbeitungsgerätes angebrachten Magnets zur Verwendung gemäß einem Ausführungsbeispiel der Erfindung.2 Figure 12 shows an arrangement of a magnet mounted within a processing device for use in accordance with an embodiment of the invention. -
3A zeigt eine beschreibende Ansicht eines Niederdruckzerstäubungsteilchentransfervorgangs sowie einer Form einer in einem Graben abgeschiedenen zerstäubten Schicht zur Verwendung gemäß einem Ausführungsbeispiel der Erfindung.3A 12 is a descriptive view of a low pressure sputtered particle transfer process and a form of a sputtered layer deposited in a trench for use in accordance with an embodiment of the invention. -
3B zeigt eine beschreibende Ansicht eines Hochdruckzerstäubungsteilchentransfervorgangs sowie einer Form einer in einem Graben abgeschiedenen zerstäubten Schicht.3B Fig. 12 is a descriptive view of a high-pressure sputtering particle transfer process and a shape of a sputtered layer deposited in a trench. -
4 zeigt eine schematische Ansicht von einer Grabengrößenabhängigkeit bei einem „gate last“-Verfahren, wenn ein bekanntes CVD-Verfahren für die Ausbildungstechnik verwendet wird.4 FIG. 12 is a schematic view of a trench size dependency in a gate last method when a known CVD method is used for the formation technique. -
5 zeigt eine schematische Ansicht einer Grabengrößenabhängigkeit bei einem „gate last“-Verfahren, wenn ein PCM-Zerstäubungsverfahren gemäß einem Ausführungsbeispiel der Erfindung als Ausbildungstechnik verwendet wird.5 shows a schematic view of a trench size dependency in a "gate last" method when a PCM sputtering method according to an embodiment of the invention is used as a training technique. -
6 zeigt eine Ansicht von einer Konfiguration eines Halbleiterherstellungsgeräts zur Verwendung gemäß einem Ausführungsbeispiel der Erfindung.6 12 is a view showing a configuration of a semiconductor manufacturing apparatus for use according to an embodiment of the invention. -
7A ein Flussdiagramm eines bekannten Ablaufs zur Einbettung von AI in einen Graben.7A Figure 12 is a flow chart of a known process for embedding AI in a trench. -
7B zeigt ein Flussdiagramm von einem Ablauf zur Einbettung von AI in einen Graben gemäß einem Beispiel, das zum Verstehen der Erfindung nützlich ist.7B Fig. 12 shows a flow chart of a procedure for embedding AI in a trench according to an example useful for understanding the invention. -
Die
8A und8B zeigen Ansichten einer Einzelunterschichtmaterialabhängigkeit von einer AI-Einbettungscharakteristik bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.the8A and8B 12 are views showing a single sub-layer material dependency of an Al embedding characteristic in a manufacturing method according to an embodiment of the invention. -
Die
9A bis9C zeigen Ansichten zur Darstellung des Einflusses auf die AI-Einbettungscharakteristik beim Aussetzen an der Atmosphäre bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.the9A until9C 12 are views showing the influence of exposure to the atmosphere on the Al embedding characteristic in a manufacturing method according to an embodiment of the invention. -
Die
10A bis10E zeigen Ansichten zur Darstellung der Verarbeitungsgerätabhängigkeit der AI-Einbettungscharakteristik bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.the10A until10E 12 are views showing the processing device dependency of the AI embedding characteristic in a manufacturing method according to an embodiment of the invention. -
11 zeigt eine Ansicht der Verarbeitungsgerätabhängigkeit eines AFM-Messergebnisses für eine TiN-Einzelbarrierenschicht bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.11 FIG. 12 is a processing device dependency view of an AFM measurement result for a TiN single barrier layer in a manufacturing method according to an embodiment of the invention. -
12A zeigt eine Ansicht zur Darstellung der Verarbeitungsgerätabhängigkeit eines XRD-Messergebnisses für eine TiN-Einzelbarrierenschicht bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.12A 12 is a view showing processing device dependency of an XRD measurement result for a TiN single barrier layer in a manufacturing method according to an embodiment of the invention. -
12B zeigt eine Ansicht zur Darstellung eines Spitzenwertintensitätsverhältnisses der C(220)-Orientierung, normalisiert um die Spitzenwertintensität der C(111)-Orientierung, für jede Bedingung gemäß dem Ergebnis nach12A .12B FIG. 12 is a view showing a peak intensity ratio of the C(220) orientation normalized by the peak intensity of the C(111) orientation for each condition according to the result12A . -
13 zeigt eine Ansicht zur Darstellung der Verarbeitungsgerätabhängigkeit eines spezifischen Widerstands bei einer TiN-Einzelbarrierenschicht bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.13 12 is a view showing processing tool dependency of a resistivity in a TiN single barrier layer in a manufacturing method according to an embodiment of the invention. -
14A zeigt eine Ansicht zur Darstellung der Druckabhängigkeit einer abgeschiedenen Menge einer TiN-Einzelbarrierenschicht auf dem Bodenteil eines Grabens bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.14A 12 is a view showing pressure dependency of a deposited amount of a TiN single barrier layer on the bottom part of a trench in a manufacturing method according to an embodiment of the invention. -
14B zeigt eine Ansicht zur Darstellung der Druckabhängigkeit einer abgeschiedenen Menge einer TiN-Einzelbarrierenschicht auf dem Seitenwandteil eines Grabens bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung.14B 12 is a view showing pressure dependency of a deposited amount of a TiN single barrier layer on the sidewall part of a trench in a manufacturing method according to an embodiment of the invention. -
Die
15A und15B zeigen schematische Ansichten zur Darstellung der AI-Einbettungscharakteristik eines Verarbeitungsgerätes, das bei einem Herstellungsverfahren gemäß einem Ausführungsbeispiel der Erfindung verwendet wird.the15A and15B 12 are schematic views showing the AI embedding characteristic of a processing apparatus used in a manufacturing method according to an embodiment of the invention. -
16 zeigt ein Diagramm zur Darstellung der Schritte von einem Halbleitervorrichtungsherstellungsverfahren bei dem erfindungsgemäßen Beispiel 2.16 Fig. 14 is a diagram showing the steps of a semiconductor device manufacturing process in Example 2 of the present invention. -
17 zeigt eine Ansicht zur Darstellung eines Untersuchungsergebnisses über eine effektive Austrittsarbeit bei einem durch das Herstellungsverfahren nach16 hergestellten P-MOSFET.17 FIG. 12 is a view showing a result of investigation of an effective work function in a through manufacturing method16 manufactured P-MOSFET.
AUSFÜHRLICHE BESCHREIBUNG DER ERFINDUNGDETAILED DESCRIPTION OF THE INVENTION
Nachstehend ist ein Ausführungsbeispiel der Erfindung unter Bezugnahme auf die beiliegende Zeichnung näher beschrieben.An embodiment of the invention is described in more detail with reference to the accompanying drawings.
Als Folge intensiver Untersuchungen zur Lösung der vorstehend beschriebenen Probleme wurde erfindungsgemäß ein Herstellungsverfahren für ein elektronisches Bauteil herausgefunden, mit einem Schritt zum Einbetten von AI in einen Grabenteil unter Verwendung einer Barrierenschicht, welche die Reduktion einer Grabenöffnung sowie eine AI-Diffusion unterdrücken kann, indem eine extrem dünne TiN-Einzelbarrierenschicht ausgebildet und AI auf der TiN-Einzelbarrierenschicht eingebettet wird.As a result of intensive investigations to solve the above-described problems, according to the present invention, a manufacturing method for an electronic device has been found, comprising a step of embedding Al in a trench part using a barrier layer which can suppress reduction of a trench opening and Al diffusion by using a extremely thin TiN single barrier layer is formed and Al is embedded on the TiN single barrier layer.
Ein Halbleiterherstellungsgerät 100 zur Verwendung gemäß einem Ausführungsbeispiel der Erfindung beinhaltet eine Kammer 201 mit einer oberen Elektrode 401 und einer unteren Elektrode 301, wie es in
Die Kammer 201 weist eine annähernd zylindrische Form auf, und beinhaltet eine obere Wand (Deckenwand) 202 mit einer annähernd kreisscheibenförmigen Form, einer Seitenwand 203 mit einer annähernd zylindrischen Form, sowie eine Bodenwand 204 mit einer annähernd kreisscheibenförmigen Form. Ein Druckindikator 430 (beispielsweise ein Diaphragmadruckmesser) ist um die Seitenwand 203 innerhalb der Kammer 201 zur Druckmessung bereitgestellt. Der Druckindikator 430 ist mit dem automatischen Drucksteuerungsmechanismus 431 elektrisch verbunden, der zur automatischen Steuerung des Drucks innerhalb der Kammer 201 gemäß einem durch den Druckindikator 430 gemessenen Druckwert konfiguriert ist.The
Die obere Elektrode 401 weist die obere Wand 202, einen Magnetmechanismus 405, eine Zielelektrode (erste Elektrode) 402, einen Isolator 404 und eine Abschirmung 403 auf. Der Magnetmechanismus 405 ist unter der oberen Wand 202 bereitgestellt, und die Zielelektrode 402 ist unter dem Magnetmechanismus 405 bereitgestellt. Der Isolator 404 isoliert die Zielelektrode 402 von der Seitenwand der Kammer 202, und hält außerdem die Zielelektrode 402 innerhalb der Kammer 201. Darüber hinaus ist die Abschirmung 403 unter dem Isolator 404 bereitgestellt. Dabei ist die Zielelektrode 402 mit der Hochfrequenzenergieversorgungsquelle 102 für die obere Elektrode und der Gleichstromenergieversorgungsquelle 103 über die Abgleichbox 101 verbunden. Die Hauptteile der Zielelektrode 402 sind aus nichtmagnetischem Material wie etwa AI, SUS, und Cu ausgebildet. Ein (in der Zeichnung nicht gezeigtes) Materialzielelement, das zur Ausbildung einer Schicht auf einem Substrat 305 nötig ist, kann auf der Seite der Zielelektrode 402 mit reduziertem Druck (der Substratseite) angeordnet sein. Ferner ist eine Röhrenanordnung in der oberen Elektrode 401 und der Zielelektrode 402 ausgebildet, und die obere Elektrode 401 und die Zielelektrode 402 können durch in dieser Röhrenanordnung fließendes Kühlwasser gekühlt werden.The
Der Magnetmechanismus 405 weist eine Magnetstützplatte 407, durch die Magnetstützplatte 407 gestützte mehrere Magnetstücke 406, sowie einen auf der äußersten Randbereichseite der vielen Magnetstücke 406 bereitgestellten Magnetfeldeinstellungsmagnetkörper 408 auf. Dabei ist der Magnetmechanismus 405 mit einer Zentralachse des Materialziels als Drehachse mittels eines in der Zeichnung nicht gezeigten Drehmechanismus drehbar eingerichtet. Die vielen Magnetteile 406 sind zueinander benachbart über der Zielelektrode 402 angeordnet, so dass sie parallel zu der Oberfläche der Zielelektrode 402 angeordnet sind. Die benachbarten Magnetteile 406 bilden ein geschlossenes Punkt-Cusp-Magnetfeld 411 für den Einschluss von Plasma aus. Der Magnetfeldeinstellungsmagnetkörper 408 erstreckt sich so, dass er teilweise das auf der äußeren Randbereichsseite angeordnete Magnetteil 406 auf der Seite der Zielelektrode 402 überlappt. Durch eine derartige Konfiguration ist es möglich, die Magnetfeldstärke in einer Lücke zwischen der Zielelektrode 402 und der Abschirmung 403 zu unterdrücken (zu steuern).The
Die untere Elektrode 301 umfasst einen Objekttischhalter 302, einen Kühl-/Heiz-Mechanismus 412, eine Bodenwand 204 und einen zweiten Elektrodenisolator 303. Der Objekttischhalter 302 ist eine Einheit zum Anbringen des Substrates 306, und ist mit dem Kühl-/Heiz-Mechanismus 412 darin versehen. Die Temperatur des Substrates (Substrattemperatur) kann auf eine vorbestimmte Temperatur mittels des Kühl-/Heizmechanismus 412 gesteuert werden. Der zweite Elektrodenisolator 303 ist eine Einheit zum Stützen des Objekttischhalters 302 und der Bodenwand 204 der Kammer 201, während sie voneinander isoliert werden. Ferner ist der Objekttischhalter 302 mit der Hochfrequenzenergieversorgungsquelle 305 für die untere Elektrode über die Abgleichbox 304 verbunden. Dabei ist der Objekttischhalter 302 mit einer elektrostatischen Adsorptionseinheit mit einer Einzelpolelektrode versehen, die in der Zeichnung nicht gezeigt ist, diese Einzelpolelektrode ist mit der (in der Zeichnung nicht gezeigten) Gleichstromenergieversorgungsquelle verbunden. Zudem ist der Objekttischhalter 302, was in der Zeichnung nicht gezeigt ist, mit mehreren Gasausstoßöffnungen (beispielsweise für Inertgas wie etwa Ar) für die Zufuhr von Gas an die Rückseite des Substrates 306 zum Steuern der Temperatur des Substrates 306 sowie einer Substrattemperaturmesseinheit zum Messen der Substrattemperatur versehen.The
Innerhalb der Kammer 201 sind mehrere Gaseinlassports 409 für die Zufuhr von Prozessgas wie etwa Ar in die Kammer 201 versehen.A plurality of
Unter Bezugnahme auf
Die Magnetteile 406 sind in einem Gittermuster (in der X-Richtung und der Y-Richtung) mit annähernd demselben Abstand (in einem Bereich von 5 bis 100 mm) voneinander angeordnet. Jedes der vielen Magnetteile 406 ist an einem Gitterpunkt eines polygonalen Gitters auf diese Weise angeordnet. Die benachbarten Magnetteile 406 weisen zueinander entgegengesetzte Polaritäten auf. Im Übrigen sind in einem Rechteck, das beliebige vier entlang der X-Richtung und der Y-Richtung angeordnete Magnetteile 406 beinhaltet, die Polaritäten der einander in diagonaler Richtung benachbarten Magnetteile 406 die gleichen. Genauer bilden beliebige benachbarte vier Magnetteile 406 ein Punkt-Cusp-Magnetfeld (nachstehend PCM genannt) 411 auf der Zieloberfläche aus. Das Halbleiterherstellungsgerät 100 kann das PCM auf diese Weise ausbilden, und wird daher gelegentlich PCM-Zerstäubungsgerät oder PCM-Verarbeitungsgerät genannt.The
Die Höhe des Magnetteils 406 ist typischerweise größer als 2 mm, und dessen Querschnitt ist rechteckig oder kreisförmig. Der Durchmesser, die Höhe und das Material des Magnetteils 406 können in Abhängigkeit von der Prozessanwendung optional eingestellt werden. Wenn der oberen Elektrode 401 des Halbleiterherstellungsgerätes 100 eine Hochfrequenzenergie zugeführt wird, wird mittels eines Mechanismus vom Kapazitätskopplungstyp Plasma erzeugt. Dieses Plasma unterliegt der Wirkung des geschlossenen Punkt-Cusp-Magnetfelds 411.The height of the
Der Magnetfeldeinstellungsmagnetkörper 408 erstreckt sich so, dass er das auf der äußersten Randseite auf der Seite der Zielelektrode 402 angeordnete Magnetteil 406 teilweise überlappt. Dadurch kann die Magnetfeldstärke in der Lücke zwischen der Zielelektrode 402 und der Abschirmung 403 unterdrückt (gesteuert) werden. Der Magnetfeldeinstellungsmagnetkörper 408 kann aus einem Material ausgebildet sein, das die Magnetfeldstärke zwischen der Zielelektrode 402 und der Abschirmung 403 steuern kann, und ist vorzugsweise aus einem Material mit hoher Permeabilitätskonstante wie etwa beispielsweise SUS430 ausgebildet. Der Magnetmechanismus 405 kann das Magnetfeld durch die Einstellung eines Bereichs einstellen, wo das Magnetstück 406 und der Magnetfeldeinstellungsmagnetkörper 408 einander überlappen. Dies bedeutet, dass wenn der Bereich, wo sich das Magnetstück 406 und der Magnetfeldeinstellungsmagnetkörper 408 einander überlappen, eingestellt wird, die Versorgung mit einem zum Zerstäuben der Zielelektrode 402 über den äußersten Randbereich der Zielelektrode 402 erforderlichen Magnetfeld sowie die Einstellung der Magnetfeldstärke in der Lücke zwischen der Zielelektrode 402 und der Abschirmung 403 möglich ist.The magnetic field adjustment
Unter erneuter Bezugnahme auf
Wenn jedoch die Zerstäubung unter Verwendung des Geräts gemäß dem vorliegenden Ausführungsbeispiel aus
Im Übrigen zeigt
Dabei umfasst das Halbleiterherstellungsgerät 500 eine (in der Zeichnung nicht gezeigte) Steuerung mit einer arithmetischen Verarbeitungseinheit wie etwa einer CPU, und führt eine vorbestimmte Verarbeitung für ein zu verarbeitendes Substrat durch Ausgeben eines Anweisungssignals an jedes der Verarbeitungsgeräte 501 bis 507 gemäß einem vorbestimmten Programm aus. Es versteht sich, dass jedes der Verarbeitungsgeräte 501 bis 507 eine Steuereinheit wie etwa eine (in der Zeichnung nicht gezeigte) PLC (programmierbare Logiksteuerung - Programmable Logic Controller) sowie Steuereinheiten wie etwa eine Massenflusssteuerung und eine Abgaspumpe gemäß dem von der Steuerung ausgegebenen Anweisungssignal beinhaltet (es versteht sich, dass die Steuereinheit bei jedem der Verarbeitungsgeräte 501 bis 505 die bei
Die
Das AI-Einbettungsverfahren nach dem Beispiel kann jedoch perfekte Einbettungseigenschaften selbst durch Durchführung des Einzelbarrierenschichtausbildungsschritts 815 als dem ersten Schritt der
Die Abscheidung einer TiN-Einzelbarrierenschicht bei dem ersten Schritt 815 der
Darüber hinaus wird die Abscheidung der Ti-Einzelbarrierenschicht zum Vergleich mit einem Einzelbarrierenschichtmaterial durchgeführt. Bei der Abscheidung der Ti-Einzelbarrierenschicht wird die Substrattemperatur auf 30°C eingestellt, die Hochfrequenzleistung und die Gleichspannung des Ti-Ziels werden auf 1500 W bzw. 430 V eingestellt, Ar wird für das Inertgas verwendet, die Zuführmenge von Ar wird auf 100 sccm eingestellt, der Druck innerhalb der Kammer wird auf 10 Pa durch den automatischen Drucksteuerungsmechanismus eingestellt, und die Schichtausbildung wird sodann durchgeführt. Ferner wird zur Steuerung der Schichtausbildungsform die Schichtausbildung durch Einstellen der Hochfrequenzleistung der Substratelektrode auf 50 W durchgeführt.In addition, the deposition of the Ti single barrier layer is compared to a one cell barrier layer material performed. In the deposition of the Ti single barrier layer, the substrate temperature is set to 30°C, the high-frequency power and the DC voltage of the Ti target are set to 1500 W and 430 V, respectively, Ar is used for the inert gas, the supply amount of Ar is set to 100 sccm is adjusted, the pressure inside the chamber is adjusted to 10 Pa by the automatic pressure control mechanism, and the film formation is then performed. Further, in order to control the film formation form, the film formation is performed by setting the high frequency power of the substrate electrode to 50W.
Es versteht sich, dass während ein Ti enthaltendes Ziel bei dem vorliegenden Ausführungsbeispiel verwendet wird, ein TiN enthaltendes Ziel verwendet werden kann. Dabei kann Inertgas als das von dem Gaseinlassport 409 eingeführte Gas verwendet werden.It should be understood that while a target containing Ti is used in the present embodiment, a target containing TiN can be used. At this time, inert gas can be used as the gas introduced from the
Auf diese Weise erzeugt die Steuereinheit 420 der Kammer 501 bei dem ersten Schritt der
Danach wird bei dem zweiten Schritt 816 der
Auf diese Weise erzeugt die Steuereinheit 420 der Kammer 502 bei dem zweiten Schritt der
Die
Bei
Weiterhin zeigen die
Nachstehend ist das Ergebnis einer Untersuchung über die TiN-Einzelbarrierenschicht bei dem ersten Schritt der
Nachstehend ist das Ergebnis einer Untersuchung über die Kristallorientierung der TiN-Einzelbarrierenschicht bei dem ersten Schritt der
Gemäß
Ferner ergibt sich, dass das C(220)/C(111)-Verhältnis maximiert ist, wenn die Abscheidung unter Verwendung des PCM-Verarbeitungsgerätes nach dem vorliegenden Ausführungsbeispiel mit einer Substrattemperatur bei Raumtemperatur und einem Druck von 100 Pa durchgeführt wurde. Aus diesem Ergebnis und dem Ergebnis aus
Wenn ferner die Kristallorientierung der TiN-Einzelbarrierenschicht schwach ist, sind manchmal die Barriereneigenschaften verschlechtert, und AI diffundiert zu einer Schicht unter der TiN-Schicht der Barrierenschicht bei der AI-Einbettung des zweiten Schritts der
Durch Ausbildung der TiN-Einzelbarrierenschicht unter Verwendung des PCM-Verarbeitungsgerätes bei einem Druck innerhalb der Kammer von nicht weniger als 1 Pa und nicht mehr als 200 Pa, und vorzugsweise nicht weniger als 10 Pa und nicht mehr als 100 Pa kann das vorliegende Ausführungsbeispiel die C(220)-Kristallorientierung der innerhalb des Grabens ausgebildeten TiN-Einzelbarrierenschicht verbessern. Folglich ist es möglich, AI bevorzugt in den Graben einzubetten, in dem die TiN-Einzelbarrierenschicht ausgebildet ist, während die Ausbildung der Lücke reduziert und außerdem die Diffusion des eingebetteten AI in eine Unterschicht der TiN-Einzelbarrierenschicht unterdrückt wird.By forming the TiN single barrier layer using the PCM processing apparatus at a pressure within the chamber of not less than 1 Pa and not more than 200 Pa, and preferably not less than 10 Pa and not more than 100 Pa, the present embodiment can achieve the C Improve (220) crystal orientation of the TiN single barrier layer formed within the trench. Consequently, it is possible to preferentially embed Al in the trench in which the TiN single barrier layer is formed while reducing the formation of the gap and also suppressing the diffusion of the embedded Al into an underlayer of the TiN single barrier layer.
Nach vorstehender Beschreibung ist es bei dem vorliegenden Ausführungsbeispiel wichtig, das beispielsweise in
Ferner weist gemäß
Die
<Beispiel 1><Example 1>
Nachstehend ist ein erstes Beispiel unter Bezugnahme auf die beiliegende Zeichnung näher beschrieben.A first example is described below with reference to the accompanying drawings.
Die Substrattemperatur, die Zielleistung, der Zerstäubungsgasdruck, die Ar-Gasflussmenge und die Stickstoffgasflussmenge können optional in Bereichen von 25°C bis 500°C, 100 W bis 5.000 W, 1 Pa bis 200 Pa, 10 sccm bis 500 sccm bzw. 1 sccm bis 100 sccm bestimmt werden.The substrate temperature, target power, sputtering gas pressure, Ar gas flow rate, and nitrogen gas flow rate can be optionally set in ranges of 25°C to 500°C, 100W to 5,000W, 1Pa to 200Pa, 10sccm to 500sccm, and 1sccm, respectively can be determined up to 100 sccm.
Die Abscheidung der TiN-Einzelbarrierenschicht 802 bei dem ersten Schritt der
<Beispiel 2 (Beispiel gemäß dem „gate Iast“-Verfahren)><Example 2 (Example according to the "gate Ilast" method)>
Nachstehend ist ein zweites erfindungsgemäßes Beispiel unter Bezugnahme auf die beiliegende Zeichnung beschrieben. Jede der Darstellungen von Schritt 161 bis Schritt 166 in
Bei Schritt 161 nach
Danach wurde bei Schritt 164 aus
Danach wurde bei Schritt 165 aus
Es versteht sich, dass bei dem Schritt zur Ausbildung der aus AI ausgebildeten Metallschicht, durch Einstellen der Substrattemperatur zwischen 300°C bis 400°C, die Metalllegierungsschicht 904 zumindest in die Metallnitridschicht A 900 in dem Bereich diffundiert, wo der N-MOSFET auszubilden ist, und die für den N-MOSFET geeignete effektive Austrittsarbeit kann verwirklicht werden. In dem Bereich, wo der P-MOSFET auszubilden ist, unterdrücken andererseits die Metallnitridschicht B 903 und die Metalllegierungsschicht 904 die AI-Diffusion, und dadurch ist es möglich, eine für den P-MOSFET geeignete effektive Austrittsarbeit beizubehalten. Ein Untersuchungsergebnis für diese effektive Austrittsarbeit für den P-MOSFET ist in
So wird erfindungsgemäß ein Herstellungsverfahren für ein elektronisches Bauteil mit einem Schritt zur Einbettung einer Metallschicht bereitgestellt. Ein Ausführungsbeispiel der Erfindung beinhaltet einen dritten Schritt zur Abscheidung einer einzelnen Barrierenschicht mit TiN auf einem zu verarbeitenden Objekt, auf dem ein konkaves Teil ausgebildet ist, sowie einen vierten Schritt zum Füllen eines Metalls mit niedrigem Schmelzpunkt unmittelbar auf der Barrierenschicht unter einer Temperaturbedingung, welche ein Fließen des Metalls mit niedrigem Schmelzpunkt erlaubt, durch ein PCM-Zerstäubungsverfahren, während ein Magnetfeld durch eine Magneteinheit mit mehreren Magneten ausgebildet wird, die an Gitterpunkten eines polygonalen Gitters so angeordnet sind, dass sie verschiedene Polaritäten zwischen den benachbarten Magneten aufweisen.Thus, according to the invention, a production method for an electronic component is provided with a step for embedding a metal layer. An embodiment of the invention includes a third step of depositing a single barrier layer with TiN on an object to be processed on which a concave part is formed, and a fourth step of filling a low-melting-point metal directly on the barrier layer under a temperature condition which a The low-melting-point metal is allowed to flow by a PCM sputtering method while a magnetic field is formed by a magnet unit having a plurality of magnets arranged at lattice points of a polygonal lattice so as to have different polarities between the adjacent magnets.
Claims (7)
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2010-294009 | 2010-12-28 | ||
JP2010294009A JP5649441B2 (en) | 2009-12-29 | 2010-12-28 | Method of manufacturing electronic component having step of embedding metal film |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102011078243A1 DE102011078243A1 (en) | 2012-06-28 |
DE102011078243B4 true DE102011078243B4 (en) | 2022-07-21 |
Family
ID=46512875
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102011078243.5A Active DE102011078243B4 (en) | 2010-12-28 | 2011-06-28 | Manufacturing method for an electronic component with a step of embedding a metal layer |
Country Status (4)
Country | Link |
---|---|
JP (1) | JP5649441B2 (en) |
KR (1) | KR101252126B1 (en) |
DE (1) | DE102011078243B4 (en) |
TW (1) | TWI509094B (en) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5834944B2 (en) * | 2012-01-19 | 2015-12-24 | 東京エレクトロン株式会社 | Magnetron sputtering apparatus and film forming method |
KR101638464B1 (en) * | 2012-01-24 | 2016-07-11 | 캐논 아네르바 가부시키가이샤 | Electronic component manufacturing method and electrode structure |
KR102127778B1 (en) | 2013-10-15 | 2020-06-29 | 삼성전자주식회사 | Method of fabricating a semiconductor device and the device |
US11257677B2 (en) * | 2020-01-24 | 2022-02-22 | Applied Materials, Inc. | Methods and devices for subtractive self-alignment |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06168891A (en) | 1992-11-30 | 1994-06-14 | Mitsubishi Electric Corp | Semiconductor fabricating system |
US5371042A (en) | 1992-06-16 | 1994-12-06 | Applied Materials, Inc. | Method of filling contacts in semiconductor devices |
US5962923A (en) | 1995-08-07 | 1999-10-05 | Applied Materials, Inc. | Semiconductor device having a low thermal budget metal filling and planarization of contacts, vias and trenches |
US20010030123A1 (en) | 2000-01-21 | 2001-10-18 | Jianming Fu | Sputtering method utilizing an extended plasma region |
US20030024478A1 (en) | 2001-08-06 | 2003-02-06 | Anelva Corporation | Surface processing apparatus |
JP2004506090A (en) | 2000-03-10 | 2004-02-26 | アプライド マテリアルズ インコーポレイテッド | Method and apparatus for performing high pressure physical vapor deposition |
US20090179285A1 (en) | 2008-01-10 | 2009-07-16 | Bingxi Sun Wood | Metal gate electrodes for replacement gate integration scheme |
Family Cites Families (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0666287B2 (en) * | 1988-07-25 | 1994-08-24 | 富士通株式会社 | Method for manufacturing semiconductor device |
CA2041730C (en) * | 1991-05-02 | 2001-08-21 | Luc Ouellet | Stabilization of the interface between aluminum and titanium nitride |
JPH05267475A (en) * | 1992-03-18 | 1993-10-15 | Yamaha Corp | Wiring formation |
IL113882A0 (en) * | 1994-06-03 | 1995-08-31 | Varian Associates | Tin deposition method |
JPH08222564A (en) * | 1995-02-15 | 1996-08-30 | Yamaha Corp | Manufacture of semiconductor device and semiconductor manufacturing device |
JPH0941133A (en) * | 1995-08-01 | 1997-02-10 | Sony Corp | Film forming method of metal compound film and film forming device to be used therefor |
JPH09120991A (en) * | 1995-08-07 | 1997-05-06 | Applied Materials Inc | Metal filling to narrow aperture using crystallographically alignedliner layer and formation of inter conection |
JP3408527B2 (en) * | 2000-10-26 | 2003-05-19 | 松下電器産業株式会社 | Method for manufacturing semiconductor device |
JP4614578B2 (en) * | 2001-06-01 | 2011-01-19 | キヤノンアネルバ株式会社 | Plasma processing equipment for sputter deposition applications |
JP2004162138A (en) * | 2002-11-14 | 2004-06-10 | Anelva Corp | Plasma assisted sputtering film-forming apparatus |
US7211502B2 (en) * | 2003-03-26 | 2007-05-01 | Semiconductor Energy Laboratory Co., Ltd. | Method for manufacturing semiconductor device |
JP2007027392A (en) * | 2005-07-15 | 2007-02-01 | Denso Corp | Semiconductor device and its manufacturing method |
WO2009157186A1 (en) * | 2008-06-24 | 2009-12-30 | キヤノンアネルバ株式会社 | Magnetic field generating apparatus and plasma processing apparatus |
-
2010
- 2010-12-28 JP JP2010294009A patent/JP5649441B2/en active Active
-
2011
- 2011-06-24 TW TW100122221A patent/TWI509094B/en active
- 2011-06-28 DE DE102011078243.5A patent/DE102011078243B4/en active Active
- 2011-06-28 KR KR1020110062823A patent/KR101252126B1/en active IP Right Grant
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5371042A (en) | 1992-06-16 | 1994-12-06 | Applied Materials, Inc. | Method of filling contacts in semiconductor devices |
JPH06168891A (en) | 1992-11-30 | 1994-06-14 | Mitsubishi Electric Corp | Semiconductor fabricating system |
US5962923A (en) | 1995-08-07 | 1999-10-05 | Applied Materials, Inc. | Semiconductor device having a low thermal budget metal filling and planarization of contacts, vias and trenches |
JP3193875B2 (en) | 1995-08-07 | 2001-07-30 | アプライド マテリアルズ インコーポレイテッド | Method and apparatus for low cost metal filling and planarization of contacts, vias and trenches in semiconductor wafers |
US20010030123A1 (en) | 2000-01-21 | 2001-10-18 | Jianming Fu | Sputtering method utilizing an extended plasma region |
JP2004506090A (en) | 2000-03-10 | 2004-02-26 | アプライド マテリアルズ インコーポレイテッド | Method and apparatus for performing high pressure physical vapor deposition |
US20030024478A1 (en) | 2001-08-06 | 2003-02-06 | Anelva Corporation | Surface processing apparatus |
US20090179285A1 (en) | 2008-01-10 | 2009-07-16 | Bingxi Sun Wood | Metal gate electrodes for replacement gate integration scheme |
Also Published As
Publication number | Publication date |
---|---|
KR101252126B1 (en) | 2013-04-08 |
TW201250019A (en) | 2012-12-16 |
JP2011153374A (en) | 2011-08-11 |
KR20120089989A (en) | 2012-08-16 |
DE102011078243A1 (en) | 2012-06-28 |
JP5649441B2 (en) | 2015-01-07 |
TWI509094B (en) | 2015-11-21 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE3854276T2 (en) | Cathode sputtering method and device for carrying out the same. | |
DE3587964T2 (en) | Method and device for chemical vapor deposition using a magnetron-enhanced plasma. | |
DE3727264C2 (en) | ||
DE10060002B4 (en) | Device for surface treatment | |
DE3783405T2 (en) | SEMICONDUCTOR ARRANGEMENT WITH A THICK LAYER WIRING AND METHOD FOR PRODUCING THE SAME. | |
DE102006004430B4 (en) | Method and system for advanced process control in an etching system by gas flow control based on CD measurements | |
DE4201661A1 (en) | Semiconductor integrated circuit mfr. - uses a deposited carbon@ film as intermediate layer to improve the accuracy of reproducing sub-micron dimensions | |
DE69327778T2 (en) | Device for contact hole filling in a semiconductor element by irradiation with a plasma from inert gas ions | |
DE102011078243B4 (en) | Manufacturing method for an electronic component with a step of embedding a metal layer | |
DE69502750T2 (en) | Plasma generating device and plasma processing device | |
EP0579018A1 (en) | Process for production of a metal oxide layer, vacuum treatment apparatus for the process and article coated with at least one metal oxide layer | |
DE112009001954T5 (en) | Plasma doping method and method for producing a semiconductor device | |
DE112009003766T5 (en) | Sputtering device and sputtering method | |
DE112010002029T5 (en) | Film forming method and film forming apparatus | |
DE102008015078B4 (en) | vacuum evaporator | |
DE1515300A1 (en) | Device for the production of high quality thin layers by cathode sputtering | |
DE69232575T2 (en) | Copper film coated substrates and method of making a copper film on a substrate | |
DE1640486C3 (en) | Process for reactive sputtering of elemental silicon | |
DE112012005736T5 (en) | Production process for electrical component and electrode assembly | |
DE1690276B1 (en) | CATHODE DUST PROCESS FOR PRODUCING OHMSHE CONTACTS ON A SEMICONDUCTOR SUBSTRATE AND DEVICE FOR PERFORMING THE PROCESS | |
DE19613669B4 (en) | Method for producing a semiconductor element with a platinum layer | |
DE102007025341B4 (en) | Process and separation system with multi-step separation control | |
DE69131391T2 (en) | Plasma processing device | |
DE10048420A1 (en) | Method for producing integrated circuit arrangements and associated circuit arrangements, in particular tunnel contact elements | |
DE102015117176B4 (en) | Process for processing a beam |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R083 | Amendment of/additions to inventor(s) | ||
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0021283000 Ipc: H01L0029450000 Effective date: 20130606 |
|
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0029450000 Ipc: H01L0021285000 |
|
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |