DE102010063159A1 - Semiconductor device and its manufacturing method - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 81
- 238000004519 manufacturing process Methods 0.000 title claims description 18
- 239000001301 oxygen Substances 0.000 claims abstract description 95
- 229910052760 oxygen Inorganic materials 0.000 claims abstract description 95
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims abstract description 94
- 230000007547 defect Effects 0.000 claims abstract description 79
- 239000000758 substrate Substances 0.000 claims abstract description 65
- 230000003647 oxidation Effects 0.000 claims description 57
- 238000007254 oxidation reaction Methods 0.000 claims description 57
- 238000000034 method Methods 0.000 claims description 23
- 239000002245 particle Substances 0.000 claims description 10
- 238000000137 annealing Methods 0.000 claims description 7
- 230000001678 irradiating effect Effects 0.000 claims description 2
- 230000015572 biosynthetic process Effects 0.000 claims 1
- 239000013078 crystal Substances 0.000 description 41
- 239000002019 doping agent Substances 0.000 description 22
- 238000010438 heat treatment Methods 0.000 description 18
- 230000006798 recombination Effects 0.000 description 18
- 229910001385 heavy metal Inorganic materials 0.000 description 17
- 238000011084 recovery Methods 0.000 description 16
- 238000012423 maintenance Methods 0.000 description 14
- 238000005215 recombination Methods 0.000 description 13
- 238000009792 diffusion process Methods 0.000 description 12
- 230000005684 electric field Effects 0.000 description 10
- 239000001307 helium Substances 0.000 description 10
- 229910052734 helium Inorganic materials 0.000 description 10
- SWQJXJOGLNCZEY-UHFFFAOYSA-N helium atom Chemical compound [He] SWQJXJOGLNCZEY-UHFFFAOYSA-N 0.000 description 10
- 238000009826 distribution Methods 0.000 description 6
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 5
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 5
- 238000004321 preservation Methods 0.000 description 5
- 229910052814 silicon oxide Inorganic materials 0.000 description 5
- 230000000903 blocking effect Effects 0.000 description 4
- 238000005468 ion implantation Methods 0.000 description 4
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 3
- 229910052782 aluminium Inorganic materials 0.000 description 3
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 3
- 229910052796 boron Inorganic materials 0.000 description 3
- 239000007789 gas Substances 0.000 description 3
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 2
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 230000015556 catabolic process Effects 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000010893 electron trap Methods 0.000 description 2
- 238000002513 implantation Methods 0.000 description 2
- 239000011261 inert gas Substances 0.000 description 2
- 238000005224 laser annealing Methods 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 229910052757 nitrogen Inorganic materials 0.000 description 2
- -1 oxygen ions Chemical class 0.000 description 2
- 229910052698 phosphorus Inorganic materials 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 2
- 230000005855 radiation Effects 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- BUHVIAUBTBOHAG-FOYDDCNASA-N (2r,3r,4s,5r)-2-[6-[[2-(3,5-dimethoxyphenyl)-2-(2-methylphenyl)ethyl]amino]purin-9-yl]-5-(hydroxymethyl)oxolane-3,4-diol Chemical compound COC1=CC(OC)=CC(C(CNC=2C=3N=CN(C=3N=CN=2)[C@H]2[C@@H]([C@H](O)[C@@H](CO)O2)O)C=2C(=CC=CC=2)C)=C1 BUHVIAUBTBOHAG-FOYDDCNASA-N 0.000 description 1
- 238000010521 absorption reaction Methods 0.000 description 1
- 238000009825 accumulation Methods 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 229910001873 dinitrogen Inorganic materials 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000000407 epitaxy Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 239000011888 foil Substances 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 1
- 229920002120 photoresistant polymer Polymers 0.000 description 1
- 229910052697 platinum Inorganic materials 0.000 description 1
- 230000001698 pyrogenic effect Effects 0.000 description 1
- 238000010008 shearing Methods 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02107—Forming insulating materials on a substrate
- H01L21/02225—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
- H01L21/02227—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
- H01L21/0223—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate
- H01L21/02233—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer
- H01L21/02236—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer group IV semiconductor
- H01L21/02238—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer group IV semiconductor silicon in uncombined form, i.e. pure silicon
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/265—Bombardment with radiation with high-energy radiation producing ion implantation
- H01L21/26506—Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/30—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by physical imperfections; having polished or roughened surface
- H01L29/32—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by physical imperfections; having polished or roughened surface the imperfections being within the semiconductor body
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66083—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by variation of the electric current supplied or the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. two-terminal devices
- H01L29/6609—Diodes
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/86—Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
- H01L29/861—Diodes
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- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/86—Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
- H01L29/861—Diodes
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- Y10S438/00—Semiconductor device manufacturing: process
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- Y10S438/92—Controlling diffusion profile by oxidation
Abstract
Eine Halbleitervorrichtung umfasst ein Halbleitersubstrat, eine erste Elektrode, die auf einer ersten Hauptoberfläche des Halbleitersubstrates ausgebildet ist, sowie eine zweite Elektrode, die auf einer zweiten Hauptoberfläche des Halbleitersubstrates ausgebildet ist. Das Halbleitersubstrat beinhaltet einen ersten Bereich, in dem eine Dichte von Sauerstoffleerstellenfehlern größer als eine Dichte von Leerstellenclusterfehlern ist, sowie einen zweiten Bereich, in dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist.A semiconductor device includes a semiconductor substrate, a first electrode formed on a first main surface of the semiconductor substrate, and a second electrode formed on a second main surface of the semiconductor substrate. The semiconductor substrate includes a first region in which a density of oxygen vacancy defects is greater than a density of vacancy cluster defects and a second region in which the density of vacancy cluster defects is greater than the density of oxygen vacancy defects.
Description
Die Erfindung betrifft eine Halbleitervorrichtung. Die Erfindung betrifft insbesondere eine Freilaufdiode, die mit einer Leistungshalbleitervorrichtung in Gegenparallelschaltung verbunden ist.The invention relates to a semiconductor device. In particular, the invention relates to a freewheeling diode connected to a power semiconductor device in a counter-parallel circuit.
Eine Diode wird bei vielen Bauarten von elektrischen Schaltungen verwendet, und ihre Funktion deckt weitgefächerte Gebiete ab. Die Diode wird beispielsweise bei einer Inverterschaltung verwendet, welche die Zufuhr von elektrischer Energie zu einer Last steuert. Die Inverterschaltung umfasst eine Vielzahl von Leistungshalbleitervorrichtungen in Brückenschaltung, und Dioden werden mit diesen Leistungshalbleitervorrichtungen jeweils in Gegenparallelschaltung verbunden. Diese Diodenbauart wird als Freilaufdiode (nachstehend als „FWD” in Bezug genommen) bezeichnet. Die FWD kommuniziert einen Laststrom, wenn die Leistungshalbleitervorrichtung eine An/Aus-Steuerung des Laststroms durchführt.A diode is used in many types of electrical circuits, and their function covers wide areas. The diode is used, for example, in an inverter circuit which controls the supply of electrical energy to a load. The inverter circuit comprises a plurality of bridge-connected power semiconductor devices, and diodes are connected to these power semiconductor devices in a counter-parallel circuit, respectively. This type of diode is called a freewheeling diode (hereinafter referred to as "FWD"). The FWD communicates a load current when the power semiconductor device performs on / off control of the load current.
In letzter Zeit erforderte eine Inverterschaltung zur Steuerung eines in einem Hybridfahrzeug oder einem Elektrofahrzeug angeordneten Motors einen geringen Schaltverlust und eine hohe Stoßdurchschlagsspannung. Zur Erfüllung dieser Anforderungen muss die Sperrverzögerungseigenschaft der FWD verbessert werden. Es erfolgten insbesondere Bemühungen zur Verringerung einer Sperrverzögerungsladung (Qrr) für einen niedrigen Schaltverlust und zur Aufweichung eines Erholungsstroms, der zu der hohen Stoßdurchschlagsspannung beiträgt, indem Kristallfehler innerhalb des Halbleitersubstrates ausgebildet wurden.Recently, an inverter circuit for controlling a motor arranged in a hybrid vehicle or an electric vehicle has required a low switching loss and a high breakdown voltage. To meet these requirements, the FWD lock-in delay characteristic must be improved. In particular, efforts have been made to reduce a reverse recovery charge (Qrr) for a low switching loss and to soften a recovery current that contributes to the high breakdown voltage by forming crystal defects within the semiconductor substrate.
Die Druckschriften
Allgemein bildet das Energieniveau der Kristallfehler ein Rekombinationszentrum für Elektronen und Löcher sowie ein Generationszentrum für Elektronen und Löcher, wenn ein hohes elektrisches Feld angelegt wird (ein Sperrzustand). Falls viele Kristallfehler innerhalb des Halbleitersubstrates ausgebildet werden, kann daher ein Anstieg des Leckstroms im Sperrzustand auftreten. Es ist bekannt, dass unter Verwendung der Schwermetalldiffusion ausgebildete Kristallfehler ein geringes Erzeugungsausmaß für Elektronen und Löcher aufweisen (das Erzeugungsausmaß für Elektronen und Löcher ist nachstehend als „Erzeugungswahrscheinlichkeit” in Bezug genommen). Daher wird der Leckstrom gehemmt, wenn die innerhalb des Halbleitersubstrates ausgebildete Kristallfehlerart von der Diffusion des Schwermetalls herrührt. Die unter Verwendung einer Schwermetalldiffusion ausgebildeten Kristallfehler weisen jedoch das Problem auf, dass das Rekombinationsausmaß der Elektronen und Löcher (was nachstehend als „Rekombinationswahrscheinlichkeit” in Bezug genommen ist) in Abhängigkeit von der Temperatur leicht variiert. Andererseits sind die unter Verwendung der Bestrahlung mit geladenen Teilchen ausgebildeten Kristallfehler dadurch gekennzeichnet, dass die Rekombinationswahrscheinlichkeit für Elektronen und Löcher nicht in Abhängigkeit von der Temperatur variiert. Bei dem vorstehend beschriebenen Stand der Technik werden beide Arten von ausgebildeten Kristallfehlern unter Verwendung der Schwermetalldiffusion und der Bestrahlung mit geladenen Teilchen innerhalb des Halbleitersubstrates kombiniert, weswegen dies zu der Verringerung der Sperrverzögerungsladung (Qrr) und der Aufweichung des Erholungsstroms führt, während es den Anstieg im Leckstrom hemmt.Generally, the energy level of the crystal defects forms a recombination center for electrons and holes as well as an electron and hole generation center when a high electric field is applied (a blocking state). Therefore, if many crystal defects are formed inside the semiconductor substrate, an increase in off-state leakage current may occur. It is known that crystal defects formed using heavy metal diffusion have a small generation amount of electrons and holes (the generation amount of electrons and holes is referred to as "generation probability" below). Therefore, the leakage current is inhibited when the crystal defect type formed inside the semiconductor substrate is due to the diffusion of the heavy metal. However, the crystal defects formed using heavy metal diffusion have the problem that the recombination amount of the electrons and holes (which is referred to as "recombination probability" hereinafter) slightly varies depending on the temperature. On the other hand, the crystal defects formed using the charged particle beam irradiation are characterized in that the recombination probability for electrons and holes does not vary depending on the temperature. In the above-described prior art, both types of crystal defects formed are combined using heavy metal diffusion and charged particle irradiation within the semiconductor substrate, thus resulting in reduction of the reverse recovery charge (Qrr) and relaxation of the recovery current while suppressing the increase in Leakage current inhibits.
Bei dem vorstehend beschriebenen Stand der Technik werden jedoch die Kristallfehler unter Verwendung von Schwermetallen (beispielsweise Platin) ausgebildet. Für den Vorgang zum Dotieren des Schwermetalls benötigt das Halbleitersubstrat eine Sonderausstattung, um eine Kontamination mit dem Schwermetall zu vermeiden. Derartige Sonderausstattungen unterscheiden sich von den allgemeinen Halbleiterherstellungsausstattungen. Daher führt die Verwendung von Schwermetallen zu einem massiven Kostenanstieg bei der Herstellung der Halbleitervorrichtung.In the prior art described above, however, the crystal defects are formed using heavy metals (for example, platinum). For the process of doping the heavy metal, the semiconductor substrate requires special equipment to avoid contamination with the heavy metal. Such optional equipment is different from general semiconductor manufacturing equipment. Therefore, the use of heavy metals leads to a massive increase in the cost of manufacturing the semiconductor device.
Die erfindungsgemäß bereitgestellte Technik kann eine Halbleitervorrichtung bereitstellen, bei der verschiedene Arten von Kristallfehlern kombiniert werden, ohne dass Schwermetalle verwendet werden.The technique provided by the present invention may provide a semiconductor device in which various types of crystal defects are combined without using heavy metals.
Hierbei spielen die Energieniveaus der Kristallfehler eine Rolle. Die unter Verwendung der Schwermetalldiffusion ausgebildeten Kristallfehler weisen für das Rekombinationszentrum ein Energieniveau von 0,23 eV unterhalb der Leitungsbandkante (Ec) auf. Andererseits sind die unter Verwendung der Bestrahlung mit geladenen Teilchen ausgebildeten Kristallfehler eine Ansammlung von Gitterlücken, bei denen eine Vielzahl von Atomgitterlücken kombiniert ist, und weisen ein Energieniveau des Rekombinationszentrums bei 0,40 eV unterhalb der Leitungsbandkante (Ec) auf. Im Vergleich weisen also die unter Verwendung der Schwermetalldiffusion ausgebildeten Kristallfehler ein flaches Energieniveau und die unter Verwendung der Bestrahlung mit geladenen Teilchen ausgebildeten Kristallfehler ein tiefes Energieniveau auf.Here, the energy levels of crystal defects play a role. The crystal defects formed using heavy metal diffusion have an energy level of 0.23 eV below the conduction band edge (Ec) for the recombination center. On the other hand, the crystal defects formed using charged particle beam irradiation are an accumulation of vacancies combining a plurality of atomic vacancies and have an energy level of the recombination center at 0.40 eV below the conduction band edge (Ec). In comparison, therefore, the crystal defects formed using heavy metal diffusion have a flat energy level and those using charged radiation Particles formed crystal defects to a low energy level.
Erfindungsgemäß wurde herausgefunden, dass die Rekombinationswahrscheinlichkeit und die Erzeugungswahrscheinlichkeit für Elektronen und Löcher von dem Energieniveau für Kristallfehler abhängen.
Eine erfindungsgemäße Halbleitervorrichtung umfasst ein Halbleitersubstrat, eine erste Elektrode, die auf einer ersten Hauptoberfläche des Halbleitersubstrates ausgebildet ist, und eine zweite Elektrode, die auf einer zweiten Hauptoberfläche des Halbleitersubstrates ausgebildet ist. Das Halbleitersubstrat kann einen ersten Bereich, bei dem die Dichte von Sauerstoffleerstellen größer als die Dichte von Leerstellenclustern ist, sowie einen zweiten Bereich beinhalten, bei dem die Dichte der Leerstellencluster. größer als die Dichte der Sauerstoffleerstellen ist. Die erfindungsgemäße Halbleitervorrichtung umfasst, dass bei ihr Sauerstoffleerstellen ausgebildet sind. Die Sauerstoffleerstellen weisen ein Energieniveau von etwa 0,17 eV unterhalb der Leitungsbandkante (Ec) auf, und ihr Energieniveau ist nahezu identisch zu dem Energieniveau von durch die Verwendung von Schwermetalldiffusion ausgebildeten Kristallfehlern. Daher können die Sauerstoffleerstellen die unter Verwendung der Schwermetalldiffusion ausgebildeten Kristallfehler modifizieren. Falls Sauerstoffleerstellen ausgebildet werden, wird eine Halbleitervorrichtung ohne die Verwendung von Schwermetallen verwirklicht, bei der verschiedene Arten von Kristallfehlern kombiniert sind.A semiconductor device according to the invention comprises a semiconductor substrate, a first electrode formed on a first main surface of the semiconductor substrate, and a second electrode formed on a second main surface of the semiconductor substrate. The semiconductor substrate may include a first region where the density of oxygen vacancies is greater than the density of vacancy clusters, and a second region where the density of the vacancy clusters. greater than the density of oxygen vacancies. The semiconductor device according to the invention comprises that oxygen vacancies are formed in it. The oxygen vacancies have an energy level of about 0.17 eV below the conduction band edge (Ec), and their energy level is nearly identical to the energy level of crystal defects formed by the use of heavy metal diffusion. Therefore, the oxygen vacancies may modify the crystal defects formed using heavy metal diffusion. If oxygen vacancies are formed, a semiconductor device without the use of heavy metals, in which various types of crystal defects are combined, is realized.
Die Erfindung ist nachstehend anhand von Ausführungsbeispielen unter Bezugnahme auf die beiliegende Zeichnung näher beschreiben. Es zeigen:The invention is described below with reference to embodiments with reference to the accompanying drawings. Show it:
Gemäß
Nachstehend ist ein Herstellungsverfahren für die Diode
Danach wird gemäß
In
Gemäß
Als nächstes werden die berechneten Werte nach
Bei dem thermischen Oxidationsschritt der Messwerte
Gemäß
Obwohl die Bedingungen bei dem vorstehend beschriebenen thermischen Oxidationsschritt sowie Wärmebehandlungsschritt nicht auf die vorstehend beschriebenen Bedingungen beschränkt sind, wird bevorzugt, dass die Sauerstoffdichte der gesamten Flächen in der Epitaxieschicht
Sodann wird unter Bezugnahe auf
Danach wird gemäß
Danach wird gemäß
Sodann wird gemäß
Dann wird gemäß
Die Sauerstoffleerstellenfehler
Zudem tritt die Rekombination von Elektronen und Löchern in einem stärker lokalisierten Bereich auf, und die Aufweichung des Erholungsstroms wird weiter verbessert.In addition, the recombination of electrons and holes occurs in a more localized region, and the softening of the recovery current is further improved.
Repräsentative, nicht beschränkende Beispiele der Erfindung sind vorstehend unter Bezugnahme auf die beiliegende Zeichnung näher beschrieben. Diese ausführliche Beschreibung ist lediglich dazu gedacht, dem Fachmann weitere Einzelheiten zur Umsetzung bevorzugter Ausgestaltungen der vorliegenden Lehre mitzuteilen, und nicht dazu gedacht, den Erfindungsbereich zu beschränken. Darüber hinaus kann jedes der nachstehend beschriebenen zusätzlichen Merkmale und Lehren separat oder in Verbindung mit anderen Merkmalen und Lehren zur Bereitstellung verbesserter Halbleitervorrichtungen sowie Verfahren zu deren Herstellung verwendet werden.Representative, non-limiting examples of the invention are described in detail above with reference to the accompanying drawings. This detailed description is merely intended to provide those skilled in the art with further details for practicing preferred embodiments of the present teachings and is not intended to limit the scope of the invention. In addition, any of the additional features and teachings described below may be used separately or in conjunction with other features and teachings to provide improved semiconductor devices and methods of making the same.
Darüber hinaus sind die nachstehend offenbarten Kombinationen aus Merkmalen und Schritten nicht wesentlich, um die Erfindung in ihrer weitesten Ausgestaltung umzusetzen, und sind lediglich zur Beschreibung von repräsentativen Beispielen der Erfindung angegeben. Zudem können verschiedene Merkmale der vorstehenden und nachstehenden repräsentativen Beispiele sowie der verschiedenen unabhängigen und abhängigen Patentansprüche derart kombiniert werden, die nicht ausdrücklich und im Einzelnen aufgelistet sind, und dennoch zusätzliche nützliche Ausführungsbeispiele der vorliegenden Lehren darstellen.Moreover, the combinations of features and steps disclosed below are not essential to the practice of the invention in its broadest form, and are provided merely to describe representative examples of the invention. In addition, different Features of the foregoing and following representative examples as well as the various independent and dependent claims are combined in such a way that are not expressly and specifically listed, and yet constitute additional useful embodiments of the present teachings.
Alle vorliegenden offenbarten Merkmale sind separat und unabhängig offenbart, zur ausreichenden Offenbarung, sowie zur Definition des beanspruchten Gegenstands, unabhängig von den Zusammensetzungen der Merkmale bei den Ausführungsbeispielen und/oder den Patentansprüchen gedacht. Zudem sind alle Wertbereiche oder Angaben von Elementgruppen dazu gedacht, jeden möglichen Zwischenwert oder Zwischenelement ausführbar zu offenbaren, sowie diesbezüglich den beanspruchten Gegenstand zu definieren.All presently disclosed features are disclosed separately and independently, for sufficient disclosure, as well as to define the claimed subject matter, regardless of the compositions of the features in the embodiments and / or the claims. In addition, all value ranges or statements of element groups are intended to explain every possible intermediate value or intermediate element executable, and in this regard to define the claimed subject matter.
Bei einer Ausgestaltung der vorliegenden Lehre kann eine Halbleitervorrichtung ein Halbleitersubstrat, eine auf einer ersten Hauptoberfläche des Halbleitersubstrats ausgebildete erste Elektrode, sowie eine auf einer zweiten Hauptoberfläche des Halbleitersubstrats ausgebildete zweite Elektrode umfassen. Das Halbleitersubstrat kann einen ersten Bereich, bei dem die Dichte von Sauerstoffleerstellenfehlern größer als die Dichte von Leerstellenclusterfehlern ist, sowie einen zweiten Bereich beinhalten, bei dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist.In one embodiment of the present teachings, a semiconductor device may include a semiconductor substrate, a first electrode formed on a first main surface of the semiconductor substrate, and a second electrode formed on a second main surface of the semiconductor substrate. The semiconductor substrate may include a first region where the density of oxygen vacancy defects is greater than the density of vacancy cluster defects, and a second region where the density of the vacancy cluster defects is greater than the density of the oxygen vacancy defects.
Bei einer Ausgestaltung der vorliegenden Lehre kann die Dichte der Sauerstoffleerstellenfehler kein Maximum im Halbleitersubstrat aufweisen. Der Begriff „Maximum” bedeutet dabei, dass es keinen lokalen Maximalwert innerhalb des Halbleitersubstrats entlang der Dickenrichtung gibt. Für den Fall, dass die Dichte des Sauerstoffleerstellenfehlers entlang der Dickenrichtung monoton steigt oder fällt bedeutet dies daher, dass es keinen lokalen Maximalwert gibt. Noch bevorzugter kann die Dichte der Sauerstoffleerstellenfehler innerhalb des Halbleitersubstrates zwischen der ersten Hauptoberfläche und der zweiten Hauptoberfläche konstant sein. Bei diesen Konfigurationen wird der Anstieg des Leckstroms unterdrückt, und die Sperrverzögerungsladung (Qrr) wird drastisch verringert.In one embodiment of the present teaching, the density of oxygen vacancy defects can not have a maximum in the semiconductor substrate. The term "maximum" here means that there is no local maximum value within the semiconductor substrate along the thickness direction. Therefore, in the case where the density of the oxygen vacancy error increases or decreases monotonously along the thickness direction, it means that there is no local maximum value. More preferably, the density of oxygen vacancy defects within the semiconductor substrate between the first major surface and the second major surface may be constant. In these configurations, the leakage current increase is suppressed and the reverse recovery charge (Qrr) is drastically reduced.
Bei einer Ausgestaltung der vorliegenden Lehre ist die Dichte der Sauerstoffleerstellenfehler im ersten Bereich größer als 1 × 1013 cm–3. Die Sauerstoffleerstellenfehler mit einem derart hohen Dichtebereich können als absichtlich ausgebildet bewertet werden.In one embodiment of the present teachings, the density of oxygen vacancy defects in the first region is greater than 1 × 10 13 cm -3 . The oxygen vacancy errors with such a high density range may be evaluated as intentional.
Bei einer Ausgestaltung der vorliegenden Lehre kann die Halbleitervorrichtung eine Diode sein, wie es in den vorstehend beschriebenen Ausführungsbeispielen dargestellt ist. Dabei kann die erste Elektrode eine Kathodenelektrode und die zweite Elektrode eine Anodenelektrode sein. Es versteht sich, dass alternativ die vorliegende Lehre nicht auf das Ausführungsbeispiel einer Diode beschränkt ist. Beispielsweise können durch die vorliegende Lehre ein IGBT oder ein MOSFET verwirklicht werden.In one embodiment of the present teachings, the semiconductor device may be a diode as illustrated in the embodiments described above. In this case, the first electrode may be a cathode electrode and the second electrode may be an anode electrode. It is understood that alternatively, the present teaching is not limited to the embodiment of a diode. For example, an IGBT or a MOSFET can be realized by the present teaching.
Bei einer Ausgestaltung der Erfindung kann die Diode eine vertikale PIN-Diode sein, die einen n+-Kathodenbereich, einen n-Sperrbereich für das elektrische Feld, einen n–-Spannungserhaltungsbereich sowie einen p+-Anodenbereich aufweist.In one embodiment of the invention, the diode may be a vertical PIN diode having an n + cathode region, an n-blocking region for the electric field, an n - voltage maintenance region and a p + anode region.
Bei einer Ausgestaltung der vorliegenden Lehre kann der erste Bereich, in dem die Dichte der Sauerstoffleerstellenfehler größer als die Dichte der Leerstellenclusterfehler ist, innerhalb des Spannungserhaltungsbereichs angeordnet sein.In one embodiment of the present teachings, the first region where the density of oxygen vacancy defects is greater than the density of the vacancy cluster defects may be located within the voltage preservation region.
Bei einer Ausgestaltung der vorliegenden Lehre kann die Dichte der Sauerstoffleerstellenfehler zumindest größer als 1 × 1013 cm–3 sein. Die Sauerstoffleerstellenfehler mit einer derartigen Dichte sind als durch Einführung von Sauerstoff absichtlich ausgebildet bewertet.In one embodiment of the present teachings, the density of oxygen vacancy defects may be at least greater than 1 × 10 13 cm -3 . The oxygen vacancy defects of such density are judged to be intentionally formed by the introduction of oxygen.
Bei einer Ausgestaltung der vorliegenden Lehre kann der zweite Bereich, in dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist, an einer pn-Übergangsgrenzfläche zwischen dem Spannungserhaltungsbereich und dem Anodenbereich angeordnet sein. Es ist zudem bevorzugt, dass der Spitzenwert des zweiten Bereichs auf der Seite des Spannungserhaltungsbereichs angrenzend zu der pn-Übergangsgrenzfläche zwischen dem Spannungserhaltungsbereich und dem Anodenbereich angeordnet ist. Es ist noch bevorzugter, dass der zweite Bereich nicht innerhalb des Anodenbereichs angeordnet ist. Bei dieser Konfiguration kann ein zusätzlicher zweiter Bereich, in dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist, an einer Verbindungsgrenzfläche zwischen einem Sperrbereich für das elektrische Feld und dem Spannungserhaltungsbereich angeordnet sein.In one embodiment of the present teachings, the second region in which the density of the vacancy cluster defects is greater than the density of the oxygen vacancy defects may be disposed at a pn junction interface between the voltage preservation region and the anode region. It is also preferable that the peak value of the second area is disposed on the side of the voltage sustaining area adjacent to the pn junction interface between the voltage sustaining area and the anode area. It is more preferable that the second region is not disposed within the anode region. In this configuration, an additional second region in which the density of the vacancy cluster defects is greater than the density of the oxygen vacancy defects may be disposed at a junction interface between an electric field stop region and the voltage conservation region.
Bei einer Ausgestaltung der vorliegenden Lehre kann das Energieniveau für das Rekombinationszentrum der Sauerstoffleerstellenfehler ein Elektronenfallenniveau zwischen 0,15 eV bis 0,25 eV unterhalb der Leitungsbandkante (Ec) sein.In one embodiment of the present teachings, the energy level for the recombination center may be the oxygen vacancy error, an electron trap level between 0.15 eV to 0.25 eV below the conduction band edge (Ec).
Bei einer Ausgestaltung der vorliegenden Lehre kann das Energieniveau für das Rekombinationszentrum der Leerstellenclusterfehler ein Elektronenfallenniveau zwischen 0,35 eV bis 0,55 eV unterhalb der Leitungsbandkante (Ec) sein. In one embodiment of the present teachings, the energy level for the recombination center of the vacancy cluster errors may be an electron trap level between 0.35 eV to 0.55 eV below the conduction band edge (Ec).
Bei einer Ausgestaltung der vorliegenden Lehre kann ein Herstellungsverfahren für eine Halbleitervorrichtung bereitgestellt werden. Die Halbleitervorrichtung umfasst ein Halbleitersubstrat mit einem ersten Bereich und einem zweiten Bereich, wobei die Dichte der Sauerstoffleerstellenfehler größer als die Dichte der Leerstellenclusterfehler in dem ersten Bereich ist, und die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler im zweiten Bereich ist. Das Herstellungsverfahren kann das Einführen von Sauerstoff in das Halbleitersubstrat und das Bestrahlen von geladenen Teilchen bis zu einer vorbestimmten Tiefe in dem Halbleitersubstrat aufweisen. Der Hochdichtebereich der Sauerstoffleerstellenfehler ist innerhalb des Halbleitersubstrates durch Durchführung des Schritts zum Einführen von Sauerstoff ausgebildet. Zudem werden geladene Teilchen bei vorbestimmter Tiefe bei dem Schritt zum Bestrahlen von geladenen Teilchen eingestrahlt. Folglich werden der erste Bereich, in dem die Dichte der Sauerstoffleerstellenfehler größer als die Dichte der Leerstellenclusterfehler ist, und der zweite Bereich, in dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist, innerhalb des Halbleitersubstrats ausgebildet.In an embodiment of the present teachings, a manufacturing method for a semiconductor device can be provided. The semiconductor device comprises a semiconductor substrate having a first region and a second region, wherein the density of the oxygen vacancy defects is greater than the density of the vacancy cluster defects in the first region, and the density of the vacancy cluster defects is greater than the density of the oxygen vacancy defects in the second region. The manufacturing method may include introducing oxygen into the semiconductor substrate and irradiating charged particles to a predetermined depth in the semiconductor substrate. The high density region of the oxygen vacancy defects is formed inside the semiconductor substrate by performing the oxygen introducing step. In addition, charged particles are irradiated at a predetermined depth in the charged particle irradiation step. Thus, the first region in which the density of oxygen vacancy defects is greater than the density of the vacancy cluster defects and the second region in which the density of the vacancy cluster defects is greater than the density of oxygen vacancy defects are formed inside the semiconductor substrate.
Der Schritt zum Einführen von Sauerstoff kann das Ausbilden einer Oxidschicht auf einer Hauptoberfläche des Halbleitersubstrates und Ausheilen des Halbleitersubstrates in einem Zustand umfassen, bei dem die Oxidschicht vorhanden ist. Der Sauerstoff kann innerhalb des Halbleitersubstrates unter Verwendung eines einfachen Vorgangs eingeführt werden.The step of introducing oxygen may include forming an oxide layer on a main surface of the semiconductor substrate and annealing the semiconductor substrate in a state where the oxide layer is present. The oxygen can be introduced within the semiconductor substrate using a simple process.
Bei dem Schritt zur Ausbildung der Oxidschicht kann die Oxidationstemperatur zwischen 1100 und 1200°C eingestellt werden, und die Oxidationszeit kann innerhalb 10 bis 500 Minuten eingestellt werden. Bei dem Schritt zum Ausheilen des Halbleitersubstrates kann die Ausheiltemperatur oberhalb von 1150°C eingestellt werden. Folglich kann eine hohe Sauerstoffdichte innerhalb des Halbleitersubstrates eingeführt werden.In the step of forming the oxide layer, the oxidation temperature may be set between 1100 and 1200 ° C, and the oxidation time may be set within 10 to 500 minutes. In the step of annealing the semiconductor substrate, the annealing temperature may be set above 1150 ° C. Consequently, a high oxygen density can be introduced within the semiconductor substrate.
Bei dem Schritt zum Einführen von Sauerstoff kann die Sauerstoffdichte innerhalb des Halbleitersubstrates auf einem gesamten Bereich entlang der Dickenrichtung ansteigen. Folglich wird der Hochdichtebereich der Sauerstoffleerstellenfehler sicher innerhalb des Halbleitersubstrates ausgebildet.In the oxygen introducing step, the oxygen density within the semiconductor substrate may increase over an entire region along the thickness direction. As a result, the high density region of the oxygen vacancy defects is surely formed within the semiconductor substrate.
Somit umfasst nach vorstehender Beschreibung eine Halbleitervorrichtung ein Halbleitersubstrat, eine erste Elektrode, die auf einer ersten Hauptoberfläche des Halbleitersubstrates ausgebildet ist, sowie eine zweite Elektrode, die auf einer zweiten Hauptoberfläche des Halbleitersubstrates ausgebildet ist. Das Halbleitersubstrat beinhaltet einen ersten Bereich, in dem eine Dichte von Sauerstoffleerstellenfehlern größer als eine Dichte von Leerstellenclusterfehlern ist, sowie einen zweiten Bereich, in dem die Dichte der Leerstellenclusterfehler größer als die Dichte der Sauerstoffleerstellenfehler ist.Thus, as described above, a semiconductor device includes a semiconductor substrate, a first electrode formed on a first main surface of the semiconductor substrate, and a second electrode formed on a second main surface of the semiconductor substrate. The semiconductor substrate includes a first region in which a density of oxygen vacancy errors is greater than a density of vacancy cluster errors, and a second region in which the density of the vacancy cluster defects is greater than the density of the oxygen vacancy defects.
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Zitierte PatentliteraturCited patent literature
- WO 99/09600 A [0004] WO 99/09600 A [0004]
- JP 06-35010 A [0004] JP 06-35010 A [0004]
- JP 2004-88012 A [0004] JP 2004-88012 A [0004]
Claims (9)
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009-285078 | 2009-12-16 | ||
JP2009285078 | 2009-12-16 | ||
JP2010-169360 | 2010-07-28 | ||
JP2010169360A JP5156059B2 (en) | 2009-12-16 | 2010-07-28 | Diode and manufacturing method thereof |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102010063159A1 true DE102010063159A1 (en) | 2011-06-22 |
DE102010063159B4 DE102010063159B4 (en) | 2013-10-10 |
Family
ID=44141981
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102010063159A Expired - Fee Related DE102010063159B4 (en) | 2009-12-16 | 2010-12-15 | Semiconductor device and its manufacturing method |
Country Status (4)
Country | Link |
---|---|
US (2) | US8698285B2 (en) |
JP (1) | JP5156059B2 (en) |
CN (1) | CN102104074B (en) |
DE (1) | DE102010063159B4 (en) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN103107203B (en) * | 2011-11-10 | 2015-12-02 | 比亚迪股份有限公司 | A kind of diode and manufacture method thereof |
US8772144B2 (en) * | 2011-11-11 | 2014-07-08 | Alpha And Omega Semiconductor Incorporated | Vertical gallium nitride Schottky diode |
EP2800143B1 (en) * | 2011-12-28 | 2020-04-08 | Fuji Electric Co., Ltd. | Semiconductor device and method for producing semiconductor device |
CN109065441B (en) | 2013-06-26 | 2023-06-30 | 富士电机株式会社 | Semiconductor device and method for manufacturing semiconductor device |
TWI657480B (en) * | 2014-06-25 | 2019-04-21 | 環球晶圓股份有限公司 | Silicon substrates with compressive stress and methods for production of the same |
JP6305294B2 (en) * | 2014-09-19 | 2018-04-04 | 株式会社東芝 | Semiconductor device and manufacturing method thereof |
JP6406452B2 (en) | 2015-06-30 | 2018-10-17 | 富士電機株式会社 | Semiconductor device and manufacturing method thereof |
CN116547788A (en) * | 2020-12-15 | 2023-08-04 | 三菱电机株式会社 | Method for manufacturing semiconductor device and semiconductor device |
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JP2004088012A (en) | 2002-08-29 | 2004-03-18 | Shindengen Electric Mfg Co Ltd | Diode |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2851026B2 (en) | 1993-10-05 | 1999-01-27 | 東洋電機製造株式会社 | High speed diode |
JPH1197376A (en) | 1997-09-22 | 1999-04-09 | Hitachi Ltd | High breakdown strength semiconductor device and fabrication thereof |
JP4919700B2 (en) * | 2005-05-20 | 2012-04-18 | トヨタ自動車株式会社 | Semiconductor device and manufacturing method thereof |
JP5080744B2 (en) | 2006-03-17 | 2012-11-21 | 株式会社豊田中央研究所 | Semiconductor device and manufacturing method thereof |
JP5124964B2 (en) * | 2006-03-27 | 2013-01-23 | サンケン電気株式会社 | Manufacturing method of semiconductor devices |
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JP2010161237A (en) | 2009-01-08 | 2010-07-22 | Toyota Motor Corp | Method of manufacturing semiconductor device |
-
2010
- 2010-07-28 JP JP2010169360A patent/JP5156059B2/en not_active Expired - Fee Related
- 2010-12-09 CN CN201010589260.9A patent/CN102104074B/en not_active Expired - Fee Related
- 2010-12-14 US US12/967,373 patent/US8698285B2/en not_active Expired - Fee Related
- 2010-12-15 DE DE102010063159A patent/DE102010063159B4/en not_active Expired - Fee Related
-
2014
- 2014-02-28 US US14/193,434 patent/US8846544B2/en not_active Expired - Fee Related
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JP2004088012A (en) | 2002-08-29 | 2004-03-18 | Shindengen Electric Mfg Co Ltd | Diode |
Also Published As
Publication number | Publication date |
---|---|
JP2011146673A (en) | 2011-07-28 |
CN102104074B (en) | 2014-06-04 |
JP5156059B2 (en) | 2013-03-06 |
US20110140243A1 (en) | 2011-06-16 |
US20140179116A1 (en) | 2014-06-26 |
US8698285B2 (en) | 2014-04-15 |
DE102010063159B4 (en) | 2013-10-10 |
CN102104074A (en) | 2011-06-22 |
US8846544B2 (en) | 2014-09-30 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R084 | Declaration of willingness to licence | ||
R020 | Patent grant now final |
Effective date: 20140111 |
|
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |