DE102006023088A1 - Power semiconductor component has power semiconductor chip arranged on region of flat conductor frame planned as chip pads, power semiconductor chip is connected with chip pad by plumb bob layer - Google Patents
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Abstract
Description
Die Erfindung betrifft ein Leistungshalbleiterbauteil mit mindestens einem auf einem Flachleiterrahmen angeordneten Leistungshalbleiterchip, der mit seiner Rückseite auf einen als Chippad vorgesehenen Bereich des Flachleiterrahmens gelötet ist.The The invention relates to a power semiconductor device having at least a power semiconductor chip arranged on a leadframe, the one with his back on a designated as Chippad area of the leadframe soldered is.
Solche Leistungshalbleiterbauteile weisen extrem niedrige elektrische Widerstände von beispielsweise weniger als 2 mΩ und hohe Verlustleistungen auf. Problematisch ist bei diesem Bauteilen, die flächige Lotverbindung in der gewünschten, gleichmäßigen Dicke einzustellen. Kleine Abweichungen von der angestrebten Dicke oder auch Verkippungen des Halbleiterchips, die zu lokalen Variationen in der Dicke führen, bedingen verhältnismäßig starke Schwankungen im Widerstand des Bauteils. Lokale Schwankungen in der Schichtdicke führen darüber hinaus zu unerwünschten lokalen Schwankungen im elektrischen und thermischen Widerstand. Durch Verkippungen des Leistungshalbleiterchips und durch zu dünne Lotschichten kommt es zu Rissen in der Lotschicht, die besonders während des Temperaturzykelns auftreten und die zu Zuverlässigkeitsproblemen des Bauteils führen.Such Power semiconductor devices have extremely low electrical resistances of for example, less than 2 mΩ and high power losses. The problem with these components, the area Solder joint in the desired, uniform thickness adjust. Small deviations from the desired thickness or Also, tilts of the semiconductor chip leading to local variations lead in the thickness, condition relatively strong Fluctuations in the resistance of the component. Local fluctuations in the layer thickness lead beyond too unwanted local fluctuations in electrical and thermal resistance. By Tipping of the power semiconductor chip and too thin solder layers There are cracks in the solder layer, especially during Temperaturzykelns occur and the reliability problems lead the component.
Aufgabe der Erfindung ist es daher, ein Leistungshalbleiterbauteil anzugeben, das besonders zuverlässig ist und das einen geringen und über die gesamte Rückseite des Leistungshalbleiterchips konstanten elektrischen und thermischen Widerstand aufweist.task The invention is therefore to specify a power semiconductor device, the most reliable is and that is a small and over the entire back of power semiconductor chip constant electric and thermal Has resistance.
Darüber hinaus ist es eine weitere Aufgabe der vorliegenden Erfindung, ein Verfahren zur Herstellung eines solchen Leistungshalbleiterbauteils anzugeben.Furthermore It is another object of the present invention to provide a method to specify for the production of such a power semiconductor device.
Erfindungsgemäß wird diese Aufgabe mit dem Gegenstand der unabhängigen Patentansprüche gelöst. Vorteilhafte Weiterbildungen der Erfindung sind Gegenstand der abhängigen Patentansprüche.According to the invention this Problem solved with the subject of the independent claims. advantageous Further developments of the invention are the subject of the dependent claims.
Ein erfindungsgemäßes Leistungshalbleiterbauteil weist mindestens einen auf einem als Chippad vorgesehenen Bereich eines Flachleiterrahmens angeordneten Leistungshalbleiterchip auf. Der Leistungshalbleiterchip ist über eine Lotverbindung beziehungsweise eine Lotschicht mit dem Chippad verbunden. Die Lotschicht weist kugelförmige Abstandshalter mit einer elektrisch leitenden Oberfläche und einem Durchmesser d mit d ≤ 45 μm auf.One Inventive power semiconductor device has at least one on a designated as Chippad area a leadframe arranged on power semiconductor chip. The power semiconductor chip is over a solder joint or a solder layer with the Chippad connected. The solder layer has spherical spacers with a electrically conductive surface and a diameter d with d ≤ 45 μm.
Gemäß einem der Erfindung zugrunde liegenden Gedanken ist ein über die gesamte Rückseite des Leistungshalbleiterchips konstanter elektrischer und thermischer Widerstand gleichzeitig mit einer besonders zuverlässigen Lotschicht dadurch zu erreichen, dass eine definierte Dicke der Lotschicht sichergestellt wird. Die Lotschicht sollte also weder zu dick noch zu dünn und auch nicht ungleichmäßig dick sein, also möglichst keine lokalen Dickevariationen aufweisen. Durch die in dem Lotgut verteilten kugelförmigen Abstandshalter wird eine gleichmäßige Mindestdicke der Schicht gewährleistet. Das Eigengewicht des Leistungshalbleiterchips und gegebenenfalls ein leichter Druck, der den Leistungshalbleiterchip während des Lötprozesses gegen das Chippad drückt, stellen eine Maximaldicke der Schicht sicher.According to one The idea underlying the invention is a on the entire back of the power semiconductor chip constant electric and thermal Resistance at the same time with a particularly reliable solder layer to achieve that ensures a defined thickness of the solder layer becomes. The solder layer should therefore neither too thick nor too thin and also not unevenly thick be, if possible have no local thickness variations. By in the lottery distributed spherical Spacer becomes a uniform minimum thickness the layer ensures. The dead weight of the power semiconductor chip and, where appropriate a slight pressure that the power semiconductor chip during the soldering process against the Chippad expresses, ensure a maximum thickness of the layer.
Bei ausreichendem Eigengewicht der Leistungshalbleiterchips bzw. ausreichendem Druck entspricht die Maximaldicke dann im Prinzip der gleichmäßigen Minimaldicke, so dass die Lotschicht über die gesamte Rückseite des Leistungshalbleiterchips eine gleichmäßige Dicke, nämlich die Dicke, die dem Durchmesser der Abstandshalter entspricht, aufweist.at sufficient own weight of the power semiconductor chips or sufficient Pressure corresponds to the maximum thickness then in principle the uniform minimum thickness, so that the solder layer over the entire back the power semiconductor chip a uniform thickness, namely the Thickness corresponding to the diameter of the spacers has.
Bei einer Ausführungsform der Erfindung sind als kugelförmige Abstandshalter metallische Kugeln vorgesehen, die Kupfer, Nickel, Silber, Zinn, Gold und/oder Palladium und/oder Legierungen aus diesen Metallen aufweisen. Bei einer alternativen Ausführungsform sind als kugelförmige Abstandshalter keramische Kugeln vorgesehen, die eine metallische Oberfläche aufweisen. Bei einer weiteren alternativen Ausführungsform sind als kugelförmige Abstandshalter Polymerkugeln vorgesehen, die eine metallische Oberfläche aufweisen.at an embodiment of the invention are spherical Spacer metallic balls provided the copper, nickel, Silver, tin, gold and / or palladium and / or alloys of these Have metals. In an alternative embodiment are as spherical spacers provided ceramic balls having a metallic surface. In a further alternative embodiment are as spherical spacers Polymer balls provided which have a metallic surface.
Durch die metallischen Oberflächen der Abstandshalter ist eine gute elektrische Leitfähigkeit der Lotschicht sichergestellt. Die Verwendung von Polymerkugeln hat den Vorteil, dass diese verhältnismäßig elastisch sind und daher eine Pufferfunktion übernehmen und mechanische Spannungen in der Lotschicht bis zu einem gewissen Grad ausgleichen können, was die Zuverlässigkeit des Bauteils erhöht und Rissen in der Lotschicht vorbeugt. Die Verwendung von Keramikkugeln dagegen hat den Vorteil, dass diese eine sehr gute Wärmeleitfähigkeit aufweisen, was insbesondere bei Leistungshalbleiterbauteilen vorteilhaft ist.By the metallic surfaces the spacer is a good electrical conductivity the solder layer ensured. The use of polymer balls has the advantage that these are relatively elastic are and therefore assume a buffer function and mechanical stresses in the solder layer can compensate to some extent what the reliability of the component increases and Cracks in the solder layer prevent. The use of ceramic balls on the other hand has the advantage that these have a very good thermal conductivity have, which is particularly advantageous in power semiconductor devices is.
Die keramischen Kugeln weisen vorteilhafterweise einen Kern aus mindestens einem der Materialien SiO2, Al2O3, TiO2, ZrO2, MgO, BeO, Y2O3, AlN, BN, Si3N4 auf. Besonders vorteilhaft sind Keramiken wie MgO, deren thermische Ausdehnungskoeffizient nahe dem des Flachleiterrahmens liegt.The ceramic spheres advantageously have a core of at least one of the materials SiO 2 , Al 2 O 3 , TiO 2 , ZrO 2 , MgO, BeO, Y 2 O 3 , AlN, BN, Si 3 N 4 . Particularly advantageous are ceramics such as MgO, whose thermal expansion coefficient is close to that of the lead frame.
Die Polymerkugeln weisen vorteilhafterweise einen Kern aus mindestens einem der Materialien PI, PEEK, PAEK, PTFE, SI auf. Diese Polymere sind ausreichend temperaturbeständig, um auch verhältnismäßig hohe Löttemperaturen von mehr als 300°C kurzzeitig überstehen können ohne aufzuschmelzen. Es sind auch andere hochtemperaturbeständige Thermoplaste denkbar.The polymer spheres advantageously have a core of at least one of the materials PI, PEEK, PAEK, PTFE, SI. These polymers are sufficiently temperature-resistant to even relatively high soldering temperatures of more than 300 ° C. can survive briefly without melting. There are also other high temperature resistant thermoplastics conceivable.
Die metallische Oberfläche der Keramik- oder Polymerkugeln weist vorteilhafterweise Kupfer, Nickel, Silber, Zinn, Gold und/oder Palladium und/oder Legierungen aus diesen Metallen auf, die mit dem Zinn des Lotguts beim Verlöten reagieren und intermetallische Phasen ausbilden können.The metallic surface the ceramic or polymer balls advantageously has copper, nickel, Silver, tin, gold and / or palladium and / or alloys of these Metals that react with the tin of the solder during soldering and form intermetallic phases.
Die erfindungsgemäße Vorrichtung hat den Vorteil, dass eine verhältnismäßig geringe Dicke d der Lotschicht sozusagen automatisch eingestellt wird. Dabei kann die Dicke in einem engen Bereich so gewählt werden, dass ihr elektrischer und thermischer Widerstand möglichst klein ist, weil Schichtdicke nicht unnötig groß ist. Ein kleiner thermischer und elektrischer Widerstand sind besonders bei Leistungshalbleiterbauteilen sehr wichtig. Gleichzeitig kann aber durch die Verwendung der Abstandshalter auch gewährleistet werden, dass die Schichtdicke ausreichend groß ist für eine gute Zuverlässigkeit des Leistungshalbleiterbauteils.The inventive device has the advantage that a relatively small Thickness d of the solder layer is set automatically, so to speak. there the thickness can be chosen in a narrow range so that its electrical and thermal resistance as possible is small, because layer thickness is not unnecessarily large. A little thermal and electrical resistance are especially in power semiconductor devices very important. At the same time, however, by using the spacers as well guaranteed be that the layer thickness is sufficiently large for a good reliability of the power semiconductor device.
Nach der vorliegenden Erfindung umfasst ein Verfahren zur Herstellung eines Leistungshalbleiterbauteils folgende Schritte: Zunächst wird ein Halbleiterchip mit einer aktiven Oberseite und einer metallisierten Rückseite bereitgestellt. Ferner wird ein Flachleiterrahmen mit einem als Chippad oder Chipinsel vorgesehenen Bereich bereitgestellt. Auf das Chippad wird ein Lotgut aufgebracht, wobei in dem Lotgut im Wesentlichen kugelförmige Abstandshalter mit einer elektrisch leitenden Oberfläche und einem Durchmesser d mit d ≤ 45 μm verteilt sind. Der Leistungshalbleiterchip wird auf das Chippad unter Verlöten mit dem Chippad aufgebracht, wobei sich eine Lotschicht der Dicke d ausbildet.To The present invention comprises a process for the preparation a power semiconductor device, the following steps: First a semiconductor chip having an active top and a metallized one back provided. Further, a lead frame with a as Chippad or chip island provided area. On the Chippad is applied a Lotgut, wherein in the Lotgut in Essentially spherical Spacer with an electrically conductive surface and a diameter d with d ≤ 45 microns distributed are. The power semiconductor chip is soldered to the chippad with applied to the chip pad, wherein a solder layer of thickness d formed.
Während des Verlötens des Leistungshalbleiterchips mit dem Chippad wird auf die Oberseite des Leistungshalbleiterchips vorteilhafterweise ein Druck ausgeübt, der ausreichend ist, um ein Aufschwimmen des Halbleiterchips auf dem verflüssigten Lot und ein Verkippen zu verhindern und gleichzeitig sicherzustellen, dass sich eine Lotschicht mit der definierten Dicke d ausbildet, die dem Durchmesser der kugelförmigen Abstandshalter entspricht. Das Lotgut weist vorteilhafterweise Zinn auf.During the soldering of the power semiconductor chip with the Chippad is placed on top of the Power semiconductor chips advantageously applied a pressure, the is sufficient to float the semiconductor chip on the liquefied Prevent soldering and tilting while ensuring that forms a solder layer with the defined thickness d, the diameter of the spherical one Spacer corresponds. The solder advantageously has tin on.
Das Lotgut kann in Form einer Lotpaste, einer Lotfolie oder eines Lotpulvers vorliegen und aufgebracht werden.The Lotgut can be in the form of a solder paste, a solder foil or a solder powder be present and applied.
In einer Ausführungsform werden als kugelförmige Abstandshalter metallische Kugeln verwendet, die Kupfer, Nickel, Silber, Zinn, Gold und/oder Palladium und/oder Legierungen daraus aufweisen. In einer alternativen Ausführungsform ist es auch möglich, keramische Kugeln mit einer metallischen Oberfläche zu verwenden, die einen Kern aus mindestens einem der Materialien SiO2, Al2O3, TiO2, ZrO2, MgO, BeO, Y2O3, AlN, BN, Si3N4 aufweisen. Ferner können als kugelförmige Abstandshalter Polymerkugeln verwendet werden, die eine metallische Oberfläche und einen Kern aus mindestens einem der Materialien PI, PEEK, PAEK, PTFE, SI oder einem anderen hochtemperaturbeständigen Thermoplast aufweisen.In one embodiment, metallic spheres comprising copper, nickel, silver, tin, gold and / or palladium and / or alloys thereof are used as spherical spacers. In an alternative embodiment, it is also possible to use ceramic spheres with a metallic surface comprising a core of at least one of SiO 2 , Al 2 O 3 , TiO 2 , ZrO 2 , MgO, BeO, Y 2 O 3 , AlN , BN, Si 3 N 4 . Further, as spherical spacers polymer balls can be used which have a metallic surface and a core of at least one of the materials PI, PEEK, PAEK, PTFE, SI or another high temperature resistant thermoplastic.
Die metallische Oberfläche der kugelförmigen Abstandshalter weist vorteilhafterweise Kupfer, Nickel, Silber, Zinn, Gold und/oder Palladium und/oder Legierungen daraus auf. Beim Verlöten bildet dann das Metall der Oberfläche mit dem Zinn in dem Lotgut intermetallische Phasen aus.The metallic surface the spherical one Spacer advantageously has copper, nickel, silver, Tin, gold and / or palladium and / or alloys thereof. At the Solder then forms the metal of the surface with the tin in the solder intermetallic phases.
Das erfindungsgemäße Verfahren erlaubt es, auf einfache und schnelle Weise besonders zuverlässige Leistungshalbleiterbauteile herzustellen. Verkippungen der Halbleiterchips und/oder ungleichmäßig dicke oder zu dicke oder zu dünne Lotschichten, die zu Zuverlässigkeitsproblemen des Bauteils und zu einem erhöhten Ausschuss bei der Produktion führen, werden vermieden, ohne dass dazu aufwendige Verfahrensschritt notwendig wären.The inventive method allows particularly reliable power semiconductor components in a simple and fast way manufacture. Tilting of the semiconductor chips and / or uneven thickness or too thick or too thin Solder layers leading to reliability problems of the component and to an increased Lead committee in the production, are avoided without the need for elaborate process step would.
Dadurch ist das erfindungsgemäße Verfahren besonders zur Herstellung zuverlässiger Leistungshalbleiterbauteile geeignet. Bei Leistungshalbleiterbaiteilen ist ein geringer thermischer und elektrischer Widerstand der Lotverbindung zwischen Leistungshalbleiterchip und Chippad nämlich besonders entscheidend. Diese geringen Widerstände werden durch dünne Lotschichten erzielt. Jedoch besteht gerade bei dünnen Lotschichten die Gefahr, dass es durch winzige Risse oder durch Unregelmäßigkeiten in der Lotschicht zu Zuverlässigkeitsproblemen kommt. Das erfindungsgemäße Verfahren erlaubt die zuverlässige Ausbildung besonders dünner und gleichmäßiger Lotschichten.Thereby is the inventive method especially for making reliable Power semiconductor components suitable. For power semiconductor parts is a low thermal and electrical resistance of the solder joint between power semiconductor chip and Chippad namely particularly crucial. These low resistances be through thin Achieved solder layers. However, it exists especially with thin layers of solder the danger of it being caused by tiny cracks or by irregularities in the solder layer comes to reliability problems. The inventive method allows the reliable Training particularly thin and even solder layers.
Ausführungsbeispiele der Erfindung werden im folgenden anhand der beigefügten Figuren näher erläutert. Darin zeigenembodiments The invention will be described below with reference to the accompanying drawings explained in more detail. In this demonstrate
Gleiche Teile sind in allen Figuren mit den gleichen Bezugszeichen versehen.Same Parts are provided in all figures with the same reference numerals.
In
einem ersten Schritt der Herstellung des Leistungshalbleiterbauteils
Zur
Herstellung der Lotverbindung wird Lotgut, beispielsweise eine Lotpaste
In
einem zweiten Schritt des Verfahrens, der in
Die
Kraft, die in Richtung des Pfeils
In
Ein
Verfahren zur Herstellung eines Leistungshalbleiterbauteils
Die
Verwendung von verhältnismäßig elastischen
Polymerkugeln hat den Vorteil, dass diese eine Pufferfunktion übernehmen
und mechanische Spannungen in der Lotschicht bis zu einem ge wissen
Grad ausgleichen können,
was die Zuverlässigkeit
des Bauteils erhöht
und Rissen in der Lotschicht
- 11
- LeistungshalbleiterbauteilPower semiconductor device
- 22
- LeistungshalbleiterchipPower semiconductor chip
- 33
- aktive Oberseiteactive top
- 44
- Rückseiteback
- 55
- Metallisierungmetallization
- 66
- Umverdrahtungsstrukturrewiring
- 77
- KontaktanschlussflächeContact pad
- 88th
- FlachleiterrahmenLeadframe
- 99
- Lotpastesolder paste
- 1010
- kugelförmige Abstandshalterspherical spacers
- 1111
- BereichArea
- 1212
- Oberseitetop
- 1313
- Lotschichtsolder layer
- 1414
- Pfeilarrow
- 1515
- Kerncore
- 1616
- Oberflächesurface
- dd
- Dickethickness
Claims (20)
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