CN208622084U - 全闪存服务器 - Google Patents

Abstract

本实用新型揭示了一种全闪存服务器，包括多核CPU、内存控制器、内存模组、PCIe总线、插接到PCIe总线的闪存控制器模组和可以插接到闪存控制模组的闪存模组，多核CPU通过内存控制器连接内存模组，多核CPU包括多个CPU内核，PCIe总线所述内存控制器连接多核CPU和内存模组，闪存控制器模组包括闪存控制器、连接PCIe总线的第一接口和连接闪存模组的第二接口，闪存模组包括若干闪存颗粒和连接到闪存控制器的第三接口。本实用新型增加了相同电路板面积下的闪存颗粒数量，而且降低了功耗，当闪存颗粒出现故障或者达到使用寿命后，只需要更换有问题的闪存颗粒，节约了成本，同时，能提高服务器CPU的利用率，减少时延，提高性能。

Description

全闪存服务器

技术领域

本实用新型涉及到计算机技术领域，特别是涉及到一种全闪存服务器。

背景技术

对IOPS要求很高、时延要求很低的应用场景，需要高性能企业级存储系统。这类高性能企业级存储系统原先是采用大量2.5吋SAS接口、高转速(10,000或15,000转/分)的HDD和控制器组成的磁盘阵列所构建的SAN存储系统来实现的。在SSD特别是采用NVMe接口的SSD出现后，全部存储介质均采用SSD的全闪存阵列或全闪存服务器正在取代传统的SAN存储系统作为企业级高性能存储系统。

一块SSD由SSD控制器(主控)芯片、作为缓存的DRAM芯片以及NAND闪存颗粒(芯片)等三个部分组成，NAND闪存颗粒是一种非易失性(在断电情况下仍能保持所存储数据信息)半导体存储器，SSD用户的数据全部存储于闪存颗粒里，它是SSD的存储媒介，也是SSD中最容易损坏的部件，特别是TLC闪存颗粒的寿命远远低于SSD控制器芯片和缓存芯片的寿命。

如图1所示，SSD连接到服务器，一方面服务器主机本身就有CPU和作为内存的DRAM，连接到服务器主机上的每一块SSD也有CPU和作为缓存的DRAM。在服务器CPU的路数和内核数越来越多、每台服务器连接的SSD也越来越多的情况下，SSD内部的CPU和DRAM不仅会使得有大量SSD的全闪存服务器的功耗与成本急剧增加，而且由于SSD内部的控制器芯片和DRAM芯片占据了电路板上的空间，使得在相同电路板面积下可以布置的闪存颗粒减少，降低了SSD的存储密度。同时闪存颗粒特别是目前大量使用的TLC闪存颗粒的寿命远低于控制器芯片和DRAM芯片的寿命，在高性能重载全闪存服务器中SSD的闪存颗粒会很快达到其使用寿命，需要频繁更换包括控制器和缓存芯片在内的整块SSD，使得维护成本大大增加。这些问题不仅增加了用户的TCO(总体拥有成本)，也不符合绿色环保的要求。

另一方面，服务器CPU的内核数不断增加，如Intel的铂金8180 CPU为28核，AMD的霄龙7601为32核，高通的Centriq 2460为48核，即便是最低端的服务器CPU如Intel的E3-1230也有4核。在绝大多数情况下，由于负载不均匀、软件和应用无法实现分布式处理以及硬件瓶颈产生的阻塞等原因，不可避免地造成多核服务器CPU中的不少核处于闲置状态，无法有效利用。

实用新型内容

本实用新型的主要目的为提供一种全闪存服务器，增加了相同电路板面积下的闪存颗粒数量，而且降低了功耗，当闪存颗粒出现故障或者达到使用寿命后，只需要更换有问题的闪存颗粒，节约了成本，同时，能提高服务器CPU的利用率，减少时延，提高性能。

本实用新型提出一种全闪存服务器，包括多核CPU、内存控制器、内存模组、PCIe总线、插接到PCIe总线的闪存控制器模组和可以插接到闪存控制模组的闪存模组，多核CPU通过内存控制器连接内存模组，多核CPU包括多个CPU内核，PCIe总线通过内存控制器连接多核CPU和内存模组，闪存控制器模组包括闪存控制器、连接PCIe总线的第一接口和连接闪存模组的第二接口，闪存模组包括若干闪存颗粒和连接到闪存控制器的第三接口。

进一步地，第一接口为PCIe接口。

进一步地，第二接口为闪存接口，闪存接口支持ToggleDDR和ONFI两种闪存接口标准。

进一步地，第三接口支持ToggleDDR或ONFI接口标准。

进一步地，内存模组采用SCM和/或DRAM。

进一步地，SCM是PCM、ReRAM、MRAM或NRAM。

本实用新型全闪存服务器的有益效果为：利用服务器多核CPU的部分CPU内核、内存和软件来取代SSD控制器芯片、缓存芯片和固件，直接对SSD的颗粒进行读写和删除操作，由于SSD中只有闪存颗粒，不仅增加了相同电路板面积下的闪存颗粒数量，而且没有控制器芯片和缓存芯片，可以降低功耗，节约成本，特别是当闪存颗粒出现故障或者达到使用寿命后，只需要更换有问题的闪存颗粒，不需要像传统的SSD那样连带更换没有问题的主控芯片和缓存芯片，可大大减低更换SSD的成本，同时能提高服务器CPU的利用率，减少时延，提高性能。

附图说明

图1为背景技术中SSD连接到服务器的示意图；

图2为本实用新型全闪存服务器的结构示意图；

图3为本实用新型全闪存服务器一实施例的结构示意图。

本实用新型目的的实现、功能特点及优点将结合实施例，参照附图做进一步说明。

具体实施方式

应当理解，此处所描述的具体实施例仅仅用以解释本实用新型，并不用于限定本实用新型。

下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本实用新型的一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。

需要说明，本实用新型实施例中所有方向性指示(诸如上、下、左、右、前、后……)仅用于解释在某一特定姿态(如附图所示)下各部件之间的相对位置关系、运动情况等，如果该特定姿态发生改变时，则该方向性指示也相应地随之改变，所述的连接可以是直接连接，也可以是间接连接。

另外，在本实用新型中如涉及“第一”、“第二”等的描述仅用于描述目的，而不能理解为指示或暗示其相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。另外，各个实施例之间的技术方案可以相互结合，但是必须是以本领域普通技术人员能够实现为基础，当技术方案的结合出现相互矛盾或无法实现时应当认为这种技术方案的结合不存在，也不在本实用新型要求的保护范围之内。

参照图2和图3，一种全闪存服务器，包括多核CPU 1(Central Processing Unit，中央处理器)、内存控制器2、内存模组3、PCIe总线4(PCI Expres，计算机总线的一种通用规格，)、插接到PCIe总线4的闪存控制器模组5和可以插接到闪存控制模组的闪存模组6，多核CPU 1通过内存控制器2连接内存模组3，多核CPU 1包括多个CPU内核11，PCIe总线4通过内存控制器2连接多核CPU1和内存模组3，闪存控制器模组5中包括闪存控制器51、连接PCIe总线4的第一接口和连接闪存模组6的第二接口，闪存模组6包括若干闪存颗粒61和连接到闪存控制器51的第三接口。

本实用新型将传统SSD(Solid State Drives，固态硬盘)控制器芯片的闪存控制器51独立出来，做成单独的闪存控制器模组5，闪存控制器模组5中包括闪存控制器51、连接PCIe总线4的第一接口和连接闪存模组6的第二接口，第一接口为PCIe接口，闪存控制器模组5中的第二接口为闪存接口，闪存接口支持ToggleDDR(三星与东芝联合推出的闪存接口标准)和ONFI(Open NAND Flash Interface，开放NAND闪存接口，NAND即与非门)两种闪存接口标准，闪存控制器模组5通过PCIe接口连接到PCIe总线4的RC(Root Complex，根组件，是PCIe总线4的最顶层与CPU、内存连接并且是所有下行端口的PCIe设备连接的接口)上，闪存模组6插接到闪存控制器模组5的闪存接口上，闪存模组6包括若干闪存颗粒61和连接到闪存控制器51的第三接口，闪存模组6中连接到闪存控制器51的第三接口支持ToggleDDR或ONFI接口标准，原来在SSD控制器芯片中的CPU可以通过系统软件来指定服务器主机上的多核CPU 1中的一部分CPU内核11来承担，一般NUMA(Non Uniform Memory AccessArchitecture，非统一内存访问架构)架构的服务器就可实现此功能，控制器芯片中的主机接口控制器、缓存控制器以及ECC(Error Checking and Correcting，错误检查和纠正)等均通过软件来实现，采用服务器的内存模组3作为闪存模组6的缓存，这样在服务器上构成虚拟SSD，在一些实施例中，多核CPU 1与内存控制器2之间还可以设置有Cache(CacheMemory，高速缓冲存储器)，加快CPU读取速度，CPU内核11分别通过内存控制器2连接内存模组3，CPU内核11和内存控制器2之间也可以设置有Cache，在一些实施例中，全闪存服务器还包括内部互联模块7，内存控制器2通过内部互联模块7连接和信息交互，使得每个CPU内核11通过与其连接的内存控制器2访问本地内存模组3，也可以通过内部互联模块7和其它内核的内存控制器2访问远端的内存模组3，内存模组3可采用SCM(Storage Class Memory，存储级内存)和/或DRAM(Dynamic Random Access Memory，动态随机存取存储器)，即内存可以部分采用DRAM，部分采用SCM，也可以全部均采用DRAM或SCM，优选采用SCM，由于SCM内存具有非易失性(断电后数据不会丢失)，不需要像RAM(Random Access Memory，随机存储器)作为SSD的缓存那样在掉电时需要用UPS(Uninterruptible Power Supply，不间断电源)或大容量电容供电将存储在缓存中的数据和映射表刷到闪存颗粒61中，这不仅简化了系统的结构，而且降低了功耗，提高了性能，SCM可以是PCM(Phase-change Memory，相变存储器)、ReRAM(Resistive Random-access Memory，阻抗随机存储器)、MRAM(Magnetic RandomAccess Memory，磁性随机存储器)或NRAM(Nantero’s CNT Random Access Memory，碳纳米管随机存储器)等，如果内存全部由DRAM构成，需要配置足够大的UPS或者大容量电容以保证在断电时可将缓存在DRAM中数据和逻辑地址到物理地址的映射表、状态表等全部写入到闪存模组6中，由于闪存模组6中没有控制器芯片和缓存芯片，可以降低能耗，减少尺寸并降低用户的采购成本。如果闪存颗粒61损坏，只需要更换闪存模组6，不需要如传统SSD那样会连带更换控制器芯片和缓存芯片，大大降低了用户的总体拥有成本，由运行在服务器主机CPU内核11上的软件来实现原先由SSD内部的控制器芯片和固件来实现的ECC、RAID(Redundant Arrays of Independent Disks，磁盘阵列)、垃圾回收、错误处理、坏块管理以及FTL(Flash Translation Layer，闪存转换层)等功能；可以根据系统配置的闪存控制器模组5以及闪存模组6的数量和容量以及应用的要求进行全局配置和处理，达到提高性能、减少时延、优化垃圾回收以及磨损平衡，增加闪存模组6的有效存储空间和寿命。更重要的是可以根据应用的要求来实现RAID和FTL，将全部闪存模组6组成一个大的虚拟SSD或阵列。由于FTL可以不断修改，可以与上层软件深度融合，减少重复处理和写放大，既能提升性能、降低功耗，还可以增加闪存模组6的寿命。

参照图3，在一实施例中，采用了4核CPU，即CPU包括4个CPU内核11，NUMA架构的服务器，每个CPU内核11对应一个内存控制器2和一个内存模组3，CPU内核11分别通过内存控制器2连接内存模块3，CPU内核11和内存控制器2之间也可以设置有Cache，内存控制器通过内部互联模块7连接和信息交互，其中两颗CPU内核11被指定作为虚拟SSD控制器的CPU，通过内存控制器2与这两颗CPU内核11连接的内存模组3作为虚拟SSD的缓存，内存模组3采用SCM，闪存控制器模组5的PCIe接口插接到服务器的PCIe接口上，闪存模组6插接到闪存控制器模组5的闪存接口上，运行在指定作为虚拟SSD控制器CPU内核11上的软件接受服务器主机发送的读写和删除请求，并根据这些请求执行请求所要求的操作，从实际读取和写入数据到ECC、执行垃圾回收、耗损均衡算法等，在操作过程中，一是合理调配数据在各个闪存颗粒61的负荷，二是承担全部数据的中转，在CPU内核11上运行的软件实现所需要的功能，调度SCM内存模组3和闪存控制器模组5等硬件完成数据从主机到闪存模组6的写入、读取和删除。

本实用新型适用于具备2核以上的CPU并且有PCIe总线4的通用服务器，服务器系统架构除了NUMA结构外，本实用新型也适用于SMP(Symmetrical Multi-ProcessingArchitecture，对称多处理架构)结构和MPP(Massively Parallel ProcessingArchitecture，大规模并行处理架构)结构。

本实用新型全闪存服务器的有益效果为：利用服务器多核CPU的部分CPU内核、内存和软件来取代SSD控制器芯片、缓存芯片和固件，直接对SSD的颗粒进行读写和删除操作，由于SSD中只有闪存颗粒，不仅增加了相同电路板面积下的闪存颗粒数量，而且没有控制器芯片和缓存芯片，可以降低功耗，节约成本，特别是当闪存颗粒出现故障或者达到使用寿命后，只需要更换有问题的闪存颗粒，不需要像传统的SSD那样连带更换没有问题的主控芯片和缓存芯片，可大大减低更换SSD的成本，同时能提高服务器CPU的利用率，减少时延，提高性能。

以上所述仅为本实用新型的优选实施例，并非因此限制本实用新型的专利范围，凡是利用本实用新型说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本实用新型的专利保护范围内。

Claims (6)

1.一种全闪存服务器，其特征在于，包括多核CPU、内存控制器、内存模组、PCIe总线、插接到PCIe总线的闪存控制器模组和可以插接到闪存控制模组的闪存模组，所述多核CPU通过所述内存控制器连接所述内存模组，所述多核CPU包括多个CPU内核，所述PCIe总线通过所述内存控制器连接所述多核CPU和所述内存模组，所述闪存控制器模组包括闪存控制器、连接所述PCIe总线的第一接口和连接所述闪存模组的第二接口，所述闪存模组包括若干闪存颗粒和连接到所述闪存控制器的第三接口。

2.根据权利要求1所述的全闪存服务器，其特征在于，所述第一接口为PCIe接口。

3.根据权利要求1所述的全闪存服务器，其特征在于，所述第二接口为闪存接口，所述闪存接口支持ToggleDDR和ONFI两种闪存接口标准。

4.根据权利要求1所述的全闪存服务器，其特征在于，所述第三接口支持ToggleDDR或ONFI接口标准。

5.根据权利要求1所述的全闪存服务器，其特征在于，所述内存模组采用SCM和/或DRAM。

6.根据权利要求5所述的全闪存服务器，其特征在于，所述SCM是PCM、ReRAM、MRAM或NRAM。