CN207182144U - 一种待机功耗低的熨斗电源电路 - Google Patents
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Abstract
本实用新型涉及电路领域,特别地涉及一种待机功耗低的熨斗电源电路。本实用新型公开了一种待机功耗低的熨斗电源电路,包括阻容降压电路、整流电路、24V稳压电路、5V稳压电路和开关电路,所述阻容降压电路的输入端接交流电源,所述阻容降压电路的输出端接整流电路的输入端,所述整流电路的输出端接24V稳压电路的输入端,所述5V稳压电路的输入端接24V稳压电路的输出端,所述24V稳压电路为继电器驱动电路供电,所述5V稳压电路为微处理器供电,所述24V稳压电路输出端通过开关电路接5V稳压电路的输出端,所述开关电路的控制输入端接微处理器的第一控制输出端。本实用新型体积小,成本低,待机功耗低。
Description
技术领域
本实用新型属于电路领域,具体地涉及一种待机功耗低的熨斗电源电路。
背景技术
随着技术的发展和用户要求的提高,熨斗也需要越来越智能化,以提高安全性和用户体验感,而要对熨斗进行智能控制,就需要电路板来实现,而电路板需要电源电路来给其提供电源,现有的电源电路主要有两种方式,如下:
1.开关电源:采用开关电源,功耗低,符合ERP(待机功耗低于0.5W)要求。但开关电源电路结构复杂,体积大,占用空间大,而熨斗控制电路板是放在熨斗手柄中,手柄空间小,无法适用,且开关电源成本高,市场的竞争让产品不允许使用开关电源电路。
2.阻容降压:虽然现有的阻容降压电路体积小,占用空间小,可以放置在熨斗手柄中,且成本低,但待机功耗高,过不了ERP的要求。
发明内容
本实用新型的目的在于为解决上述问题而提供一种体积小、成本低。待机功耗低的熨斗电源电路。
为此,本实用新型公开了一种待机功耗低的熨斗电源电路,包括阻容降压电路、整流电路、24V稳压电路、5V稳压电路和开关电路,所述阻容降压电路的输入端接交流电源,所述阻容降压电路的输出端接整流电路的输入端,所述整流电路的输出端接24V稳压电路的输入端,所述5V稳压电路的输入端接24V稳压电路的输出端,所述24V稳压电路为继电器驱动电路供电,所述5V稳压电路为微处理器供电,所述24V稳压电路的输出端通过开关电路接5V稳压电路的输出端,所述开关电路的控制输入端接微处理器的第一控制输出端。
进一步的,所述阻容降压电路包括电阻R1、电阻R2、电阻R2a和电容C1,所述电容C1与串联的电阻R2和电阻R2a并联后一端串联电阻R1接交流电源,另一端接整流电路的输入端。
进一步的,所述整流电路为半波整流电路。
进一步的,所述开关电路包括电阻R18、电阻R19、PNP三极管P1和NPN三极管N1,所述PNP三极管P1的发射极串联电阻R18接24V稳压电路的输出端,所述PNP三极管P1的集电极接5V稳压电路的输出端,所述PNP三极管P1的发射极通过电阻R18A接PNP三极管P1的基极,PNP三极管P1的基极串联电阻R19接NPN三极管N1的集电极,NPN三极管N1的基极串联电阻R20接微处理器的第一控制输出端IO_euq,NPN三极管N1的发射极接地。
进一步的,所述继电器驱动电路包括NPN三极管N2,所述NPN三极管N2与继电器的线圈REL1串联后接在24V稳压电路的输出端与地之间,所述NPN三极管N2的基极串联电阻R5接微处理器的第二控制输出端IO_relay,所述NPN三极管N2的基极与发射极之间接有电阻R6。
进一步的,所述24V稳压电路由稳定电压为24V的稳压管来实现。
进一步的,所述5V稳压电路由稳定电压为5V的稳压管来实现。
本实用新型的有益技术效果:
本实用新型通过设置开关电路,在待机时,将24V稳压电路的24V电压直接拉到5V,使得稳定电压为24V的稳压管基本不损耗电流,降低了待机功耗,且结构简单,体积小,易于实现,成本低。
附图说明
图1为本实用新型具体实施例的电路原理图。
具体实施方式
现结合附图和具体实施方式对本实用新型进一步说明。
如图1所示,一种待机功耗低的熨斗电源电路,包括阻容降压电路、整流电路、24V稳压电路、5V稳压电路和开关电路,所述阻容降压电路的输入端接交流电源,所述阻容降压电路的输出端接整流电路的输入端,所述整流电路的输出端接24V稳压电路的输入端,所述5V稳压电路的输入端接24V稳压电路的输出端,所述24V稳压电路为继电器驱动电路供电,所述5V稳压电路为微处理器(图中未示出)供电,所述24V稳压电路的输出端通过开关电路接5V稳压电路的输出端,所述开关电路的控制输入端接微处理器的第一控制输出端。
本具体实施例中,所述阻容降压电路包括电阻R1、电阻R2、电阻R2a和电容C1,所述整流电路为半波整流电路,包括二极管D1和D2,所述24V稳压电路包括稳定电压为24V的稳压管ZD1,型号为2EZ24D5,所述5V稳压电路包括电阻R3、电阻R10和稳定电压为5V的稳压管ZD2,所述开关电路包括电阻R18、电阻R19、PNP三极管P1和NPN三极管N1,所述继电器驱动电路包括NPN三极管N2。
所述电容C1与串联的电阻R2和电阻R2a并联后一端串联电阻R1接交流电源的火线ACL1,本具体实施例中,交流电源为230V的交流电源,交流电源的零线ACN接地,另一端接分别接二极管D1的正端和二极管D2的负端,二极管D2的正端接地,二极管D1的负端接稳压管ZD1的负端,稳压管ZD1的正端接地。
稳压管ZD1的负端作为24V稳压电路的输出端输出24V电压为继电器驱动电路供电,稳压管ZD1的负端接并联的电阻R3和R10的第一端,并联的电阻R3和R10的第二端接稳压管ZD2的负端,稳压管ZD2的正端接地,稳压管ZD2的负端作为5V稳压电路的输出端输出5V电压为微处理器供电。
所述PNP三极管P1的发射极串联电阻R18接稳压管ZD1的负端,所述PNP三极管P1的集电极接稳压管ZD2的负端,所述PNP三极管P1的发射极通过电阻R18A接PNP三极管P1的基极,PNP三极管P1的基极串联电阻R19接NPN三极管N1的集电极,NPN三极管N1的基极串联电阻R20接微处理器的第一控制输出端IO_euq,NPN三极管N1的发射极接地。
所述NPN三极管N2与继电器的线圈REL1串联后接在稳压管ZD1的负端与地之间,所述NPN三极管N2的基极串联电阻R5接微处理器的第二控制输出端IO_relay,所述NPN三极管N2的基极与发射极之间接有电阻R6,继电器的开关串接在交流电源与负载之间,本实施例中,负载的输入端接OUT端。
本具体实施例中,电容C1的规格为564J/400V。
本具体实施例中,还包括电容C2,所述电容C2接在并联的电阻R3和R10的第一端与地之间。
本具体实施例中,还包括电容C3和C4,所述电容C3和C4并联后再与稳压管ZD2并联。
本具体实施例中,微处理器为单片机,但不限于此。
在其它实施例中,开关电路也可以采用现有的其它开关电路,如采用一个三极管,或采用MOS等来实现,此是本领域技术人员可以轻易实现的,不再详细说明。
工作过程:当产品进入工作状态时,单片机的的第一控制输出端IO_euq清0,PNP三极管P1和NPN三极管N1断开,稳压管ZD1正常工作,让电压稳住24V给继电器驱动电路供电,使继电器驱动电路驱动继电器,从而控制负载,稳压管ZD2正常工作,让电压稳住5V给单片机供电;当产品进行待机状态时,单片机的的第一控制输出端IO_euq置1,PNP三极管P1和NPN三极管N1导通,把稳压管ZD1负端的24V电压拉到5V,稳压管ZD1就基本不损耗电流了,从而降低功耗,使其可以低于0.5W,稳压管ZD2正常工作,让电压稳住5V给单片机供电,单片机始终保持工作状态。
本实用新型通过设置开关电路,在待机时,将24V稳压电路的电压直接拉到5V,使得稳定电压为24V的稳压管基本不损耗电流,降低了待机功耗,且结构简单,体积小,易于实现,成本低。
尽管结合优选实施方案具体展示和介绍了本实用新型,但所属领域的技术人员应该明白,在不脱离所附权利要求书所限定的本实用新型的精神和范围内,在形式上和细节上可以对本实用新型做出各种变化,均为本实用新型的保护范围。
Claims (7)
1.一种待机功耗低的熨斗电源电路,其特征在于:包括阻容降压电路、整流电路、24V稳压电路、5V稳压电路和开关电路,所述阻容降压电路的输入端接交流电源,所述阻容降压电路的输出端接整流电路的输入端,所述整流电路的输出端接24V稳压电路的输入端,所述5V稳压电路的输入端接24V稳压电路的输出端,所述24V稳压电路为继电器驱动电路供电,所述5V稳压电路为微处理器供电,所述24V稳压电路的输出端通过开关电路接5V稳压电路的输出端,所述开关电路的控制输入端接微处理器的第一控制输出端。
2.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述阻容降压电路包括电阻R1、电阻R2、电阻R2a和电容C1,所述电容C1与串联的电阻R2和电阻R2a并联后一端串联电阻R1接交流电源,另一端接整流电路的输入端。
3.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述整流电路为半波整流电路。
4.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述开关电路包括电阻R18、电阻R19、PNP三极管P1和NPN三极管N1,所述PNP三极管P1的发射极串联电阻R18接24V稳压电路的输出端,所述PNP三极管P1的集电极接5V稳压电路的输出端,所述PNP三极管P1的发射极通过电阻R18A接PNP三极管P1的基极,PNP三极管P1的基极串联电阻R19接NPN三极管N1的集电极,NPN三极管N1的基极串联电阻R20接微处理器的第一控制输出端IO_euq,NPN三极管N1的发射极接地。
5.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述继电器驱动电路包括NPN三极管N2,所述NPN三极管N2与继电器的线圈REL1串联后接在24V稳压电路的输出端与地之间,所述NPN三极管N2的基极串联电阻R5接微处理器的第二控制输出端IO_relay,所述NPN三极管N2的基极与发射极之间接有电阻R6。
6.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述24V稳压电路由稳定电压为24V的稳压管来实现。
7.根据权利要求1所述的待机功耗低的熨斗电源电路,其特征在于:所述5V稳压电路由稳定电压为5V的稳压管来实现。
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