CN204498086U - 双边沿检测电路 - Google Patents
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Abstract
本实用新型公开一种双边沿检测电路，电路包括反相器U1、电容C1、带施密特触发的反相器U2和异或门U4，被检测信号输入端同时连接在反相器U1的输入端和异或门U4的一个输入端上，反相器U1的输出端连接在带施密特触发的反相器U2输入端上，反相器U1的输出端和带施密特触发的反相器U2输入端之间通过电容C1接地，带施密特触发的反相器U2的输出端连接在异或门U4的另一个输入端上，异或门U4的输出端为双边沿检测电路的输出端。本实用新型较之现有边沿检测芯片相比，电路结构简单，实现成本较低，且能够方便的进行边沿检测等，可靠性和稳定性好，电路能够很好的解决边沿检测等问题。
Description
技术领域
本实用新型公开一种检测电路，特别是一种双边沿检测电路，本实用新型可以应用于检测电路中信号的逻辑边沿。
背景技术
一般的电路都需要基于信号的变化来进行相应的动作，以实现预定的功能；电路的信号逻辑边沿表征了信号变化的时间点，信号的上升沿（即逻辑0-->1）和信号的下降沿（即逻辑1-->0）均进行检测称为信号的双边沿检测，常规的大型电路中，通常都是采用MCU或者专用的检测电路信号变化的器件来实现的，成本较高，小型电路中，没有用到MCU等可控制和检测电路信号变化的器件，需要使用简单器件搭建的逻辑变化检测电路，目前的检测电路结构较为复杂，寻找一种简单可行的双边沿检测电路成为一种急切的需求。
发明内容
针对上述提到的现有技术中的双边沿检测电路结构复杂，成本高的缺点，本实用新型提供一种采用简单期间搭接而成的双边沿检测电路，电路简单，成本低。
本实用新型解决其技术问题采用的技术方案是：一种双边沿检测电路，电路包括反相器U1、电容C1、带施密特触发的反相器U2和异或门U4，被检测信号输入端同时连接在反相器U1的输入端和异或门U4的一个输入端上，反相器U1的输出端连接在带施密特触发的反相器U2输入端上，反相器U1的输出端和带施密特触发的反相器U2输入端之间通过电容C1接地，带施密特触发的反相器U2的输出端连接在异或门U4的另一个输入端上，异或门U4的输出端为双边沿检测电路的输出端。
本实用新型解决其技术问题采用的技术方案进一步还包括：
所述的反相器U1的输出端和电容C1之间串接有电阻R1。
本实用新型的有益效果是：本实用新型较之现有边沿检测芯片相比，电路结构简单，实现成本较低，且能够方便的进行边沿检测等，可靠性和稳定性好，电路能够很好的解决边沿检测等问题。
下面将结合附图和具体实施方式对本实用新型做进一步说明。
附图说明
图1为本实用新型电路原理图。
图2为本实用新型在激励源VG1输入为5V逻辑高电平的脉冲激励下，电路各个节点对应的波形图。
具体实施方式
本实施例为本实用新型优选实施方式，其他凡其原理和基本结构与本实施例相同或近似的，均在本实用新型保护范围之内。
本实用新型电路中为信号双边沿检测电路，其主要包括反相器U1、电容C1、带施密特触发的反相器U2和二输入异或门U4，被检测信号输入端（即节点VF1，本实施例中，其通过激励源VG1产生检测信号）同时连接在反相器U1的输入端和异或门U4的一个输入端上，反相器U1的输出端连接在带施密特触发的反相器U2输入端上，反相器U1的输出端和带施密特触发的反相器U2输入端之间通过电容C1接地，带施密特触发的反相器U2的输出端连接在异或门U4的另一个输入端上，异或门U4的输出端为双边沿检测电路的输出端。本实施例中，在反相器U1的输出端和电容C1之间还串接有电阻R1。
本实用新型在使用时，当输入检测信号VG1由逻辑1变为逻辑0的过程中，节点VF2电平上升，同时电容C1被充电；U2为带施密特触发的反相器，在电容C1充电到反相器U2的输入阀值Vth电平以上时，反相器U2的输出变为逻辑0；电容C1（即节点VF2）的电位由0V充电到Vth的时间内，反相器U2的输出为逻辑高电平；则节点VF3输出为逻辑1；当电容C1（即节点VF2）的电位充电到大于Vth时，反相器U2的输出为逻辑低电平；则节点VF3的输出为逻辑0，由此检测到输入信号的下降沿。
当输入检测信号VG1由逻辑0（逻辑低电平0V）变为逻辑1（逻辑高电平5V）的过程中，节点VF2电平下降，电容C1通过电阻R1放电；U2为带施密特触发的反相器，在电容C1放电到反相器U2的输入阀值Vtl电平以下时，反相器U2的输出变为逻辑1；电容C1（即节点VF2）的电位由逻辑高电平放电到Vtl的时间内，反相器U2的输出为逻辑低电平；则节点VF3输出为逻辑1；当电容C1（即节点VF2）的电位放电到小于Vtl，反相器U2的输出为逻辑高电平， 则节点VF3的输出为逻辑0，由此检测到输入信号的上升沿。
当被检测信号保持逻辑电平不变，则异或门U4电路的两个输入端逻辑电平一致，输出VF3输出一直保持逻辑0不变。
请参看附图2，电路在激励源VG1输入为5V逻辑高电平的脉冲激励下，电路各个节点对应的波形图；对于5V逻辑的电路，通常条件下电路的输入阀值Vtl=0.9V(0.3*VCC)、 Vth = 3.5V（0.7*VCC）；范围在0~0.9V的电平为逻辑0， 范围在3.5V~5V的电平为逻辑1。节点VF2对应电容C1和电阻R1充放电过程中的实际波形，属于模拟信号，为整个检测电路的中间信号过程。
本实用新型较之现有边沿检测芯片相比，电路结构简单，实现成本较低，且能够方便的进行边沿检测等，可靠性和稳定性好，电路能够很好的解决边沿检测等问题。
Claims (2)
1.一种双边沿检测电路，其特征是：所述的电路包括反相器U1、电容C1、带施密特触发的反相器U2和异或门U4，被检测信号输入端同时连接在反相器U1的输入端和异或门U4的一个输入端上，反相器U1的输出端连接在带施密特触发的反相器U2输入端上，反相器U1的输出端和带施密特触发的反相器U2输入端之间通过电容C1接地，带施密特触发的反相器U2的输出端连接在异或门U4的另一个输入端上，异或门U4的输出端为双边沿检测电路的输出端。
2.根据权利要求1所述的双边沿检测电路，其特征是：所述的反相器U1的输出端和电容C1之间串接有电阻R1。
Priority Applications (1)
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2015
- 2015-04-29 CN CN201520268610.XU patent/CN204498086U/zh not_active Expired - Fee Related
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