CN204334563U - 一种自动检测lvds信号通道数的装置 - Google Patents
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Abstract
本实用新型公开一种自动检测LVDS信号通道数的装置,包括:依次电连接的多通道LVDS信号输入端子、Buffer电路、FPGA模块、电阻网络、多通道LVDS信号输出端子、待测显示屏,FPGA模块上还连接一结果显示屏;FPGA模块产生一组扫描检测时序信号,通过数据线传输至电阻网络,再传输给多通道LVDS信号输出端子,多通道LVDS信号输出端子通过数据线将扫描检测时序信号传输给待测显示屏,待测显示屏会返回一组时序信号,依次通过多通道LVDS信号输出端子、电阻网络,再通过FPGA模块进行接收,FPGA模块会根据返回的时序信号进行逻辑分析和判断,然后再通过数据线将分析的结果分别发送给结果显示屏。
Description
技术领域
本实用新型涉及电子测试领域,特别是一种自动检测LVDS信号通道数的装置。
背景技术
目前市面上驱动LCM显示屏的信号一般都是LVDS信号格式,且有2通道、4通道、6通道等多种数据通道数。现有的用来检测LVDS信号数据的通道数的设备,无法及时准确判断出LVDS差分对信号(N和P)是否对电源短路、是否对地短路、以及相邻两个差分对之间是否短路;而且现有的设备一般无法自动检测差分对之间是否开路,也无法及时将检测结果进行显示,当相邻差分对之间短路时,无法及时关断信号,容易造成对液晶屏的损坏。
实用新型内容
针对上述技术问题,本实用新型公开一种自动检测LVDS信号通道数的装置,包括:依次电连接的多通道LVDS信号输入端子、Buffer电路、FPGA模块、电阻网络、多通道LVDS信号输出端子、待测显示屏,所述FPGA模块上还连接一结果显示屏;所述FPGA模块产生一组扫描检测时序信号,通过数据线传输至电阻网络,再传输给多通道LVDS信号输出端子,所述多通道LVDS信号输出端子通过数据线将所述扫描检测时序信号传输给待测显示屏,所述待测显示屏会返回一组时序信号,依次通过多通道LVDS信号输出端子、电阻网络,再通过FPGA模块进行接收,所述FPGA模块会根据返回的时序信号进行逻辑分析和判断,然后再通过数据线将分析的结果分别发送给结果显示屏,所述显示屏用于对分析结果和故障情况进行显示。
本实用新型的有益效果是通过从输入端输入若干通道的正确的LVDS信号,经过所述自动检测LVDS信号通道数的装置,输入到待测显示屏,待测显示屏的接收电路如果没问题,返回的时序信号是正确的,如果待测显示屏的LVDS接收电路有问题,返回的时序信号就是错误的时序信号,从而可以自动检测LVDS信号数据的通道数,且能判断出LVDS差分对信号(N和P)是否对电源短路、是否对地短路、及相邻两个差分对之间是否短路,由于驱动LCM的LVDS差分对之间使用100欧的电阻短接,因此所述装置还能够自动检测差分对之间是否开路;此外,所述装置对判断出的通道数以及开短路结果能及时准确的通过结果显示屏进行显示;当检测出LVDS信号对电源以及相邻差分对之间短路时,能及时关断信号,以免对液晶屏造成损坏。
附图说明
图1是本实用新型所述自动检测LVDS信号通道数的装置的结构示意图。
具体实施方式
下面结合附图对本实用新型做进一步的详细说明,以令本领域技术人员参照说明书文字能够据以实施。
如图所示,本实用新型公开一种自动检测LVDS信号通道数的装置,包括:依次电连接的多通道LVDS信号输入端子、Buffer电路、FPGA模块、电阻网络、多通道LVDS信号输出端子、待测显示屏,所述FPGA模块上还连接一结果显示屏;所述FPGA模块产生一组扫描检测时序信号,通过数据线传输至电阻网络,再传输给多通道LVDS信号输出端子,所述多通道LVDS信号输出端子通过数据线将所述扫描检测时序信号传输给待测显示屏,所述待测显示屏会返回一组时序信号,依次通过多通道LVDS信号输出端子、电阻网络,再通过FPGA模块进行接收,所述FPGA模块会根据返回的时序信号进行逻辑分析和判断,然后再通过数据线将分析的结果分别发送给结果显示屏,所述显示屏用于对分析结果和故障情况进行显示。所述自动检测LVDS信号通道数的装置可以自动检测LVDS信号数据的通道数,且能判断出LVDS差分对信号(N和P)是否对电源短路、是否对地短路、及相邻两个差分对之间是否短路,由于驱动LCM的LVDS差分对之间使用100欧的电阻短接,因此所述装置还能够自动检测差分对之间是否开路;此外,所述装置对判断出的通道数以及开短路结果能及时准确的通过结果显示屏进行显示;当检测出LVDS信号对电源以及相邻差分对之间短路时,能及时关断信号,以免对液晶屏造成损坏。
尽管本实用新型的实施方案已公开如上,但其并不仅仅限于说明书和实施方式中所列运用,它完全可以被适用于各种适合本实用新型的领域,对于熟悉本领域的人员而言,可容易地实现另外的修改,因此在不背离权利要求及等同范围所限定的一般概念下,本实用新型并不限于特定的细节和这里示出与描述的图例。
Claims (1)
1.一种自动检测LVDS信号通道数的装置,其特征在于,包括:依次电连接的多通道LVDS信号输入端子、Buffer电路、FPGA模块、电阻网络、多通道LVDS信号输出端子、待测显示屏,所述FPGA模块上还连接一结果显示屏;
所述FPGA模块产生一组扫描检测时序信号,通过数据线传输至电阻网络,再传输给多通道LVDS信号输出端子,所述多通道LVDS信号输出端子通过数据线将所述扫描检测时序信号传输给待测显示屏,所述待测显示屏会返回一组时序信号,依次通过多通道LVDS信号输出端子、电阻网络,再通过FPGA模块进行接收,所述FPGA模块会根据返回的时序信号进行逻辑分析和判断,然后再通过数据线将分析的结果分别发送给结果显示屏,所述显示屏用于对分析结果和故障情况进行显示。
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Publications (1)
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