CN202433519U - 一种二次雷达接收机 - Google Patents
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Abstract
本实用新型涉及二次雷达信号通讯领域,尤其是涉及一种针对多种调制信号接收解调的二次雷达接收机。提供一种利用中频数字化处理技术,将射频输入信号通过信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路后,将多种调制射频信号进行解调。本实用新型包括信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路,所述射频输入信号经过信号预处理电路后分别与IFF信号处理电路输入端、ATC信号处理电路输入端连接,所述IFF信号处理电路输出端、ATC信号处理电路输出端分别与FPGA芯片连接。本实用新型主要应用于二次雷达信号通讯领域。
Description
技术领域
本实用新型涉及二次雷达信号通讯领域,尤其是涉及一种针对多种调制信号接收解调的二次雷达接收机。
背景技术
随着无线电通信和雷达技术的发展,对系统性能提出了更高更严格的要求。系统相应地也对接收机提出了更高更严格的要求,除具有高的解码灵敏度、更强的抗干扰能力外,还要求接收机体积小、重量轻,实现模块化、通用化,以适应更多的系统平台。系统还要求接收机完成多种调制信号的接收解调。由于受器件、材料、技术开发手段等多因素的制约,常规设计的雷达接收机体积偏大、偏重,不满足一些系统平台的需要。
实用新型内容
本实用新型采用的技术方案是针对现有技术中的问题,提供一种利用中频数字化处理技术,将射频输入信号通过信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路后,将多种射频信号进行解调。
为达到上述目的,本实用新型采用的技术方案是:
一种二次雷达接收机,包括信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路,所述射频输入信号经过信号预处理电路后分别与IFF信号处理电路输入端、ATC信号处理电路输入端连接,所述IFF信号处理电路输出端、ATC信号处理电路输出端分别与FPGA数字处理电路连接。
所述信号预处理电路包括限幅电路、射频放大电路、功分器,所述限幅电路、射频放大电路、功分器输入端依次顺序连接,功分器输出端分别与IFF信号处理电路、ATC信号处理电路连接。
所述限幅电路包括6个限幅二极管。
所述射频放大电路包括一个低噪声放大器。
所述IFF信号处理电路包括开关选频电路、混频器、中频放大滤波电路、第一模数转换电路,所述功分器输出端、开关选频电路、混频器、中频放大滤波电路、模数转换电路、FPGA电路第一端口依次顺序连接,所述FPGA数字处理电路第三端口与开关选频电路第三端口连接。
所述开关选频电路包括开关、滤波器,所述开关控制端与FPGA芯片连接,开关输入端与功分器输出端连接,开关输出端与混频器输入端连接。
所述混频器为LTC混频器。
所述中频放大滤波电路包括宽带放大器、LC滤波电路,宽带放大器输出端与LC滤波器输入端连接。
所述ATC信号处理电路包括预选器、射频检测电路、第二模数转换电路,所述功分器输出端、预选器、射频检测电路、第二数模转换电路、FPGA电路第二端口连接。
所述第一模数转换电路、第二模数转换电路为80.0MHz采样速率的模数转换电路。
为达到上述目的,本实用新型采用的技术方案及优点是:
1)通过信号预处理电路对射频输入信号进行限幅、放大后,通过功分器分为两路,分别送入ATC信号处理电路、IFF信号处理电路,同时完成ASK、DPSK等多种调制信号的接收解调,功能多。
2)采用中频数字化处理技术:电路采用优化设计,将数字处理中频信号电平大大降低,可以处理-60dBmw的小信号,大幅度减少了模拟器件数量,减少了体积,降低了成本。同时采用中频数字化处理技术,实现相关解调处理和键控幅度解调处理,比采用模拟实现方式更灵活,更容易调试,性能更稳定。
3)采用小型腔体设计:采用铝合金材料作腔体,将腔体分为上、下两面,一面作数字板和限幅放大板,中间采用隔板分开,另一面作模拟板用,腔体上、下面之间采用2mm的隔板分腔,既考虑了接收机的屏蔽设计,又大大降低了腔体的重量。
4)采用微带复合多层板材料:接收机设计中,涉及的射频信号,控制信号,电源信号等比较多,采用常规微带板材料,不可避免会出现信号的交叉,给设计带来困难,解决这个问题就是采用新型微带复合多层板材料,将不同信号定义在不同层上走线布局,既避免了信号的交叉重叠,又兼顾了电磁兼容设计。
5)采用多温度梯度焊接技术:由于采用了小型腔体设计,为降低接收机的体积,模拟电路板采用多温度梯度焊接技术,将腔体与印制板焊接在一起,不使用螺钉,从而节约了体积和空间。
附图说明
本实用新型将通过例子并参照附图的方式说明,其中:
图1 是本实用新型原理框图。
具体实施方式
为了使本实用新型的目的、技术方案及优点更加清楚明白,以下结合附图及实施例,对本实用新型进行进一步详细说明。应当理解,此处所描述的具体实施例仅用以解释本实用新型,并不用于限定本实用新型。
优选实施例
如图1所述,一种二次雷达接收机,包括信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路,所述接收射频输入信号经过信号预处理电路后分别与IFF信号处理电路输入端、ATC信号处理电路输入端连接,所述IFF信号处理电路输出端、ATC信号处理电路输出端分别与FPGA芯片连接。信号预处理电路包括限幅电路、射频放大电路、功分器,所述限幅电路(包括6个限幅二极管,所述限幅二极管依次串联)、射频放大电路、功分器输入端依次顺序连接,功分器输出端分别与IFF信号处理电路、ATC信号处理电路连接。
工作过程:将射频输入信号通过信号预处理电路处理后,分别将处理后的射频信号发送给IFF信号处理电路、ATC信号处理电路,经过IFF信号处理电路、ATC信号处理电路处理后的数据通过FPGA数字处理电路后输出。具体过程为:将射频输入信号经过限幅电路、射频放大电路后,再经功分器将信号分为两路,一路送给ATC信号处理电路,一路送给IFF信号处理电路。进入IFF信号处理电路的射频信号,经过开关选频电路(FPGA电路发送控制信号使得开关选频电路工作)、混频器、中频放大滤波处理后变成满足一定指标要求的中频信号输出,输出的信号经过采样速率为80MHz的模数转换电路后,产生14bit的中频数字信号,在FPGA中将数字信号进行DDC下变频,再经过数字低通滤波和抽取,得到正交基带信号,最后将得到的正交基带信号经过基带相关解调,输出相关峰信息。
进入ATC信号处理电路的射频信号,经过预选器选出询问信号,并且抑制带外及镜像频率信号,经射频检波输出视频信号,将该视频信号放大到一定的幅度以满足数字处理的需要,视频信号经过80MHz采样速率的模数转换电路变换产生14bit的幅度信息,送入FPGA芯片中作判决,旁瓣分离,输出译码脉冲和旁瓣抑制脉冲。
本说明书中公开的所有特征,除了互相排斥的特征以外,均可以以任何方式组合。
本说明书(包括任何附加权利要求、摘要和附图)中公开的任一特征,除非特别叙述,均可被其他等效或具有类似目的的替代特征加以替换。即,除非特别叙述,每个特征只是一系列等效或类似特征中的一个例子而已。
Claims (10)
1.一种二次雷达接收机,其特征在于包括信号预处理电路、IFF信号处理电路、ATC信号处理电路、FPGA数字处理电路,所述射频输入信号经过信号预处理电路后分别与IFF信号处理电路输入端、ATC信号处理电路输入端连接,所述IFF信号处理电路输出端、ATC信号处理电路输出端分别与FPGA数字处理电路连接。
2.根据权利要求1所述的一种二次雷达接收机,其特征在于所述信号预处理电路包括限幅电路、射频放大电路、功分器,所述限幅电路、射频放大电路、功分器输入端依次顺序连接,功分器输出端分别与IFF信号处理电路、ATC信号处理电路连接。
3.根据权利要求2所述的一种二次雷达接收机,其特征在于所述限幅电路包括6个限幅二极管。
4.根据权利要求2所述的一种二次雷达接收机,其特征在于所述射频放大电路包括一个低噪声放大器。
5.根据权利要求4所述的一种二次雷达接收机,其特征在于所述IFF信号处理电路包括开关选频电路、混频器、中频放大滤波电路、第一模数转换电路,所述功分器输出端、开关选频电路、混频器、中频放大滤波电路、模数转换电路、FPGA电路第一端口依次顺序连接。
6.根据权利要求5所述的一种二次雷达接收机,其特征在于所述开关选频电路包括开关、滤波器,所述开关控制端与FPGA芯片连接,开关输入端与功分器输出端连接,开关输出端与混频器输入端连接。
7.根据权利要求5所述的一种二次雷达接收机,其特征在于所述混频器为LTC混频器。
8.根据权利要求5所述的一种二次雷达接收机,其特征在于所述中频放大滤波电路包括宽带放大器、LC滤波电路,宽带放大器输出端与LC滤波器输入端连接。
9.根据权利要求1所述的一种二次雷达接收机,其特征在于所述ATC信号处理电路包括预选器、射频检测电路、第二模数转换电路,所述功分器输出端、预选器、射频检测电路、第二数模转换电路、FPGA电路第二端口连接。
10.根据权利要求9所述的一种二次雷达接收机,其特征在于所述第一模数转换电路、第二模数转换电路为80.0MHz采样速率的模数转换电路。
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2011
- 2011-12-14 CN CN2011205212802U patent/CN202433519U/zh not_active Expired - Lifetime
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