CN1901339A - 一种数字式固定频率抗干扰电路 - Google Patents

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Abstract

本发明涉及数字式固定频率抗干扰电路。本发明所要解决的技术问题是提供一种能将来自主开关器件在开通或关断瞬间的干扰信号滤除的数字式固定频率抗干扰电路，以此保证功率开关的正常使用，提高电路的稳定性。解决该问题的技术方案是：一种数字式固定频率抗干扰电路，其特征在于该电路包括：一反相器，用于波形反相，其输入端接产生三角载波信号的基准方波V1，输出信号V3送至双输入异或门的一输入脚，所述基准方波V1还同时接至双D触发器的输入端D；一异或门，用于比较输入端经过反相的基准方波V3和带有毛刺的PWM控制信号Vin，其输出信号V2送至双D触发器的时钟脚CLK；一双D触发器，用于对带有毛刺的PWM控制信号进行整形，从而输出光滑的波形Vo。本发明可用于电力电子变换电路中。

Description

一种数字式固定频率抗干扰电路
技术领域
本发明涉及抗干扰电路，具体地说，本发明涉及一种数字式固定频率抗干扰电路。适用于电力电子变换电路中。
背景技术
在电力电子装置中，由于功率器件的开关，会引起强烈的射频和传导干扰，严重时会影响控制电路的工作，使其无法正常工作。特别是在高频功率转换装置中，一种较容易出现的情况是：调节信号易受到来自主开关器件在开通或关断瞬间的干扰，此干扰信号与高频载波信号相比较，易产生对功率器件在一个周期内的多次开关(如图1所示)，从而使开关频率提高，损耗增大，轻者引起控制性能的恶化，严重的会引起主功率管的损坏。
发明内容
本发明正是针对以上情况，提供一种能将来自主开关器件在开通或关断瞬间的干扰信号滤除的数字式固定频率抗干扰电路，以此保证功率开关的正常使用，提高电路的稳定性。
本发明所采用的技术方案是：一种数字式固定频率抗干扰电路，其特征在于该电路包括：
一反相器，用于波形反相，其输入端接产生三角载波信号的基准方波V1，输出信号V3送至双输入异或门的一输入脚，所述基准方波V1还同时接至双D触发器的输入端D；
一异或门，用于比较输入端经过反相的基准方波V3和带有毛刺的PWM控制信号Vin，其输出信号V2送至双D触发器的时钟脚CLK；
一双D触发器，用于对带有毛刺的PWM控制信号进行整形，从而输出光滑的波形Vo。
所述异或门的输出端和双D触发器的时钟输入端之间设有由R1、C1组成的延时电路。
本发明的有益效果是：该数字式固定频率抗干扰电路能消除高频干扰，免除主功率开关管在一个周期内出现多次开关的可能，从而避免功率开关管因此损坏，延长器件仍至整机的使用寿命。此外，该电路由于采用数字电路构成，具有调试方便、工作稳定的特点。
附图说明
图1是本发明背景技术开关误动作波形的示意图。
图2是本发明的电路原理图。
图3是本发明电路的工作波形示意图。
图4是本发明电路工作实测的波形图。
具体实施方式
本实施例电路结构如图2所示，它包括：
一反相器IC1B(型号：CD40106)，用于将波形反相，其输入端输入产生三角波载波信号的基准方波V1，反相后的输出信号V3(也是方波)送至异或门的一输入端，同时，基准方波V1的另一路直接输至双D触发器的输入端D，参见图3所示的波形图。
一异或门IC2B(型号：CD4030)，用于比较输入端的V3和带有毛刺的PWM控制信号Vin，见图3，如果输入信号V3和Vin电平不一致(一个高电平，一个低电平)，则输出信号V2为高电平，送至双D触发器的时钟脚CLK；如果输入V1和Vin一致(全是高电平或全是低电平)，则输出信号V2为低电平，送至双D触发器的时钟脚CLK。
一双D触发器IC3A(型号：CD4013)，产生三角波载波信号的基准方波V1接至双D触发器的输入端D，在双D触发器的时钟脚CLK的作用下，对带有毛刺的PWM控制信号进行整形，从而输出固定周期的光滑的波形Vo。详见图3，波形Vo，即Q脚的波形遵循这样一个规则：某个时钟脉冲V2到来之后Vo的状态和该脉冲到来之前V1的状态相同。
为了配合CLK信号和D输入端信号的时序要求，在异或门的输出端和双D触发器的时钟输入端之间设有由R1、C1组成的延时电路。

Claims (2)

1、一种数字式固定频率抗干扰电路，其特征在于该电路包括：
一反相器，用于波形反相，其输入端接产生三角载波信号的基准方波V1，输出信号V3送至双输入异或门的一输入脚，所述基准方波V1还同时接至双D触发器的输入端D；
一异或门，用于比较输入端经过反相的基准方波V3和带有毛刺的PWM控制信号Vin，其输出信号V2送至双D触发器的时钟脚CLK；
一双D触发器，用于对带有毛刺的PWM控制信号进行整形，从而输出光滑的波形Vo。
2、根据权利要求1所述的数字式固定频率抗干扰电路，其特征在于：所述异或门的输出端和双D触发器的时钟输入端之间设有由R1、C1组成的延时电路。
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