CN1303775C - 无线电传输系统 - Google Patents

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Abstract

在无线电传输系统里，接收装置具备：根据发送装置每隔一定时间间隔发送的数据包的接收间隔，通过使用PLL，而使接收装置侧时刻与发送装置侧时刻同步的机构；将接收到的数据包保持在接收缓冲器内的结构；以及在接收装置侧时刻与由附加于保持在接收缓冲器中的数据包上的发送装置侧时刻信息表示的发送装置侧时刻一致时，将该数据包输出到译码装置的机构。

Description

无线电传输系统
技术领域
本发明涉及无线电传输系统。
背景技术
在数字图像信号的无线电传输系统中，发送装置将编码装置生成的数据包保存在缓冲器内，每隔一定时间输出存入缓冲器的数据包数据，接收装置接收到数据包以后，立即向译码装置输出。公知：在这种无线电传输系统中，编码装置中的数据包输出间隔与接收装置中的数据包输入间隔不同。这种现象称作抖动(jitter)。
另外，在无线电通信传输线路上，有发生传输错误的可能性。在收到的数据包中发生错误的情况下，接收装置向发送装置进行重发请求，接收到重发请求的发送装置重发同一数据包。如发生这种重发，则抖动更加增大。
就数字图像声音信号传输中大多利用的MPEG2系统来说，若传输引起的抖动增大，则在译码装置的缓冲器内发生上溢或下溢，无法正常地再生图像声音。
发明内容
本发明的目的在于，提供一种无线电传输系统，其可以在与发送装置内的译码装置生成数据包的时间间隔大体相同的时间内将数据包输入到接收装置内的译码装置中，且在接收装置内的译码装置中不会引起上溢或下溢，可以进行良好的再生。
本发明的第1无线电传输系统，其具备包括编码装置的发送装置和包括译码装置的接收装置，发送装置通过发送缓冲器，无线电传输从编码装置输出的数据包，在接收装置正常接收数据包时将该情况通知发送装置，在发送装置中只从发送缓冲器内除去通知了接收装置正常接收的数据包，其特征在于，发送装置具备：发送缓冲器，其保存附加了发送装置侧时刻信息的数据包，并且在受到数据包发送命令时，就输出保存于其中的数据包，在接收到数据包删除命令时，就从其中删除发送完的数据包；发送时刻计数器，其以一定时间间隔向发送缓冲器输出发送命令，并根据时钟产生电路产生的时钟，生成发送装置侧时刻信息；时钟产生电路，其产生送至发送时刻计数器的时钟；以及时刻信息附加电路，其在从编码装置输出的数据包上，附加表示从编码装置输出时的发送装置侧时刻的发送装置侧时刻信息，接收装置具备：根据发送装置每隔一定时间间隔发送的数据包的接收间隔，通过使用PLL，而使接收装置侧时刻与发送装置侧时刻同步的机构；将接收到的数据包保持在接收缓冲器内的机构；以及在接收装置侧时刻与由附加于保持在接收缓冲器中的数据包上的发送装置侧时刻信息表示的发送装置侧时刻一致时，将该数据包输出到译码装置的机构。
本发明的第2无线电传输系统，其具备包括编码装置的发送装置和包括译码装置的接收装置，发送装置通过发送缓冲器，无线电传输从编码装置输出的数据包，在接收装置正常接收了数据包时将该情况通知发送装置，发送装置仅从发送缓冲器内除去通知了接收装置正常接收的数据包，其特征在于，发送装置具备：在从编码装置输出的数据包上，附加表示从编码装置输出时的发送装置侧时刻的发送装置侧时刻信息的电路；将附加了发送装置侧时刻信息的数据包保存在发送缓冲器的电路；以及以一定时间间隔发送存入发送缓冲器内的数据包的电路，接收装置具备：根据每隔一定时间间隔从发送装置发送的数据包的接收间隔，通过使用PLL，而使接收装置侧时刻与发送装置侧时刻同步的电路；将接收到的数据包保持在接收缓冲器内的电路；以及在接收装置侧时刻与由附加于保持在接收缓冲器的数据包上的发送装置侧时刻信息表示的发送装置侧时刻一致时，将该数据包输出到译码装置的电路。
附图说明
图1是表示无线电传输系统中的发送装置的构成的框图。
图2是表示无线电传输系统中的接收装置的构成的框图。
图3是表示发送装置和接收装置的各部分的信号的时间图。
具体实施方式
下面，参照附图说明本发明的实施方式。
图1表示无线电传输系统中的发送装置的构成。图2表示无线电传输系统中的接收装置的构成。图3表示发送装置和接收装置的各部分的信号。
在本实施方式中，假定使用MPEG2系统作为编码译码算法。另外，在本实施方式中，假设只传输图像信号。
首先，对发送装置进行说明。图像信号由编码装置1进行编码。从编码装置1输出的TS数据包(TS packet)传送至时刻信息附加电路2。另一方面，时钟产生电路3产生的时钟(clock)送至发送时刻计数器4。发送时刻计数器4根据时钟产生电路3产生的时钟，生成发送装置侧时刻信息。发送时刻计数器4生成的发送装置侧时刻信息向时刻信息附加电路2提供。
时刻信息附加电路2在从编码装置1送来的各TS数据包上，附加发送装置侧时刻信息，该发送装置侧时刻信息表示该TS数据包的开头从编码装置1输出的发送装置侧时刻。附加过发送装置侧时刻信息的TS数据包保存在发送缓冲器5内。
发送时刻计数器4，以一定时间间隔(本例中，1.0msec)，向发送缓冲器5输出发送命令。发送缓冲器5每次从发送时刻计数器4收到发送命令，就输出保存于发送缓冲器5内的数据包。
由纠错码附加电路6在从发送缓冲器5输出的数据包上附加纠错码。附加过纠错码的数据包，由调制器7进行过调制后，从发送天线8送出。
而且，调制器7在根据发送命令调制从发送缓冲器5输出的数据包信息(由1个或多个数据包组成的信息)之前，调制同步控制用标志(flag)，并从发送天线8发送。即，以和输出发送命令的时间间隔同样的时间间隔，调制并发送同步控制用标志。
通过数据包发送结果传输电波，从接收装置向发送装置通知：从发送装置送出的数据包是否已由接收装置正常接收。数据包发送结果传输电波由接收天线11接收。接收天线11接收到的数据包发送结果传输电波由解调器12解调以后，送至通信结果判断部13。通信结果判断部13根据从解调器12送来的信号，判断从发送装置送出的数据包是否由接收装置正常接收，在判断为正常接收到的情况下，向发送缓冲器5输出数据包删除命令。
发送缓冲器5，在接收到数据包删除命令时，从发送缓冲器5中删除发送完的数据包。
图3的“编码装置数据包输出”表示从编码装置1输出TS数据包的时间。在图3的示例中，在发送装置侧时刻为1.0msec时，从编码装置1输出数据包a1，在发送装置侧时刻为1.2msec时，从编码装置1输出数据包a2。
并且，在发送装置侧时刻为2.0msec时，送出数据包a1、a2，在发送装置侧时刻为3.0msec时，送出数据包b1、b2、b3。在图3的示例中，因为发送装置侧时刻为3.0msec时送出的数据包b1、b2、b3中产生传输错误，所以在发送装置侧时刻为4.0msec时，重发数据包b1、b2、b3。
其次，对接收装置进行说明。从发送装置输出的数据包信息传输电波由接收天线21接收。由接收天线21接收到的数据包信息传输电波被送至解调器22进行解调。由解调器22得到的信号送至纠错电路23进行纠错。
纠错电路23将表示是否进行过正常纠错的接收结果送至调制器24。调制器24调制接收结果，并作为数据包发送结果传输电波，从发送天线25从出。
纠错电路23在正常进行过纠错的情况下，将带有发送装置侧时刻信息的TS数据包保存在接收缓冲器26内。保存于接收缓冲器26的TS数据包，在附加于其上的发送装置侧时刻信息与从后述的接收装置侧时刻生成电路30产生的接收装置侧时刻一致时，送到译码装置27并进行译码。
对接收装置侧时刻生成电路30进行说明。在解调器22中，每当由译码而得到同步控制用标志，就将数据包到达信号送往到达次数计数器31和相位比较器34。在到达次数计数器31中计数数据包到达信号。将到达次数计数器31的计数值送到乘法器32，并将发送时间间隔(在该例中为1.0msec)乘以计数值。并且，将乘法器32的乘法运算结果送到加法器33，通过将补偿值加到乘法运算结果上，生成虚拟发送侧时刻。
之所以加上补偿值，是因为若将发送装置侧时刻直接作为接收装置侧时刻，则由于数据包传输过程中有延迟，无法按其附加的发送装置侧时刻从接收缓冲器26输出数据包的缘故。
根据虚拟发送侧时刻，通过由相位比较器34、时钟产生电路35和接收时刻计数器36构成的PLL电路(相位同步电路)，利用PLL，生成接收装置侧时刻。
即，由相位比较器34比较：表示虚拟发送侧时刻的时钟信号与表示从接收时刻计数器36输出的接收装置侧时刻的时钟信号的相位。然后，根据由相位比较器34检测出的相位差，通过控制从时钟产生电路35输出的时钟频率，从而使表示接收装置侧时刻的时钟频率与表示虚拟发送侧时刻的时钟频率取得同步。
在图3的示例中，表示向乘法器32提供的补偿值为-3的情形。在检测到对应于发送装置侧时刻1.0msec的同步控制用标志时，虚拟发送侧时刻变为-2.0msec，然后每检测到同步控制用标志，就增加+1.0。
表示虚拟发送侧时刻的时钟相位与表示接收装置侧时刻的时钟相位，虽然最初有偏差，但利用PLL电路控制，可以使两相位差变为0。在图3的示例中，在接收装置侧时刻为1.0msec时，从接收缓冲器26输出数据包a1、a2，在接收装置侧时刻为2.0msec时，从接收缓冲器26输出数据包b1、b2、b3。
根据上述实施例，可以在与发送装置内的编码装置生成的数据包的时间间隔大体相同的时间内，将数据包输入接收装置内的译码装置中。

Claims (1)

1.一种无线电传输系统，其具备包括编码装置的发送装置和包括译码装置的接收装置，发送装置通过发送缓冲器，无线电传输从编码装置输出的数据包，在接收装置正常接收数据包时将该情况通知发送装置，在发送装置中只从发送缓冲器内除去通知了接收装置正常接收的数据包，其特征在于，
发送装置具备：
发送缓冲器，其保存附加了发送装置侧时刻信息的数据包，并且在收到数据包发送命令时，就输出保存于其中的数据包，在接收到数据包删除命令时，就从其中删除发送完的数据包；
发送时刻计数器，其以一定时间间隔向发送缓冲器输出发送命令，并根据时钟产生电路产生的时钟，生成发送装置侧时刻信息；
时钟产生电路，其产生送至发送时刻计数器的时钟；以及
时刻信息附加电路，其在从编码装置输出的数据包上，附加表示从编码装置输出时的发送装置侧时刻的发送装置侧时刻信息，
接收装置具备：
根据发送装置每隔一定时间间隔发送的数据包的接收间隔，通过使用PLL，而使接收装置侧时刻与发送装置侧时刻同步的机构；
将接收到的数据包保持在接收缓冲器内的机构；以及
在接收装置侧时刻与由附加于保持在接收缓冲器中的数据包上的发送装置侧时刻信息表示的发送装置侧时刻一致时，将该数据包输出到译码装置的机构。
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