CN1233020A - 多路超高速缓冲存储器装置和方法 - Google Patents

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Abstract

具有多路超高速缓冲存储器的装置,该装置包括一个第一用户可控制项,该控制项具有相应于多路超高速缓冲存储器的第一路的预定第一属性;一个第二用户可控制项,该控制项具有相应于多路超高速缓冲存储器的第二路的预定第二属性;第一比较电路和第二比较电路,用于把访问属性与预定第一或第二属性相比较,以提供第一或第二比较结果;第一路控制电路和第二路控制电路,用于根据第一或第二比较结果选择性地激活多路超高速缓冲存储器的第一或第二路。

Description

多路超高速缓冲存储器装置和方法
本发明一般涉及处理器和存储器，尤其涉及多路超高速缓冲存储器。
由于便携和手提工具的普遍应用，在微处理器和微控制器的设计中低电耗已变得十分重要。一个典型的嵌入式控制系统一般包括一个中央处理器(CPU)和多个不同类型的存储器和外围设备。不同类型的存储器对于具有微处理器的集成电路来讲可能是外置的，并且/或者在同一个集成电路中，并且不同类型的存储器可能包括超高速缓冲存储器，ROM(只读存储器)，和多个SRAM(静态随机访问存储器)设备。
要访问一个大的外部主存储器需要花费大量的能量和时间。因此，可在集成电路中使用一种更小，更快，更有效的存储器，有时指超高速缓冲存储器，以减少对主存储器的访问次数。为了使集成电路尽量的小，集成电路板上只包括所需要的存储器。
超高速缓冲存储标记(Cache TAG)普遍被用于提高超高速缓冲存储器的性能。超高速缓冲存储器TAG接收一个由微处理器提供的TAG地址，并判定所需要的指令和/或数据是否在超高速缓冲存储器中。如果所需要的指令不在超高速缓冲存储器中，则微处理器必须从主存储器中检索所需指令。当指令被写进超高速缓冲存储器中时，则把指令地址的高位存储在一个TAG矩阵中。超高速缓冲存储器TAG有一个比较器，用于把处理器生成地址与TAG地址相比较。如果TAG地址与处理器生成地址相同，则超高速缓冲存储器“命中”，并且超高速缓冲存储器TAG提供一匹配信号，表明所需要的数据在超高速缓冲存储器中。如果处理器生成地址与TAG地址不相同，则超高速缓冲存储器“未命中”，相应的匹配信号表明所需要的数据不在超高速缓冲存储器中。另外，可设置一个有效位作为TAG地址的一部分，用于在超高速缓冲存储器的比较循环中判定存储TAG地址的有效命中。
根据现有的超高速缓冲存储器技术，在许多应用中，访问请求的冲突降低了超高速缓冲存储器的效率，其中访问请求的冲突造成多次对于超高速缓冲存储器的访问失败，且需要访问外部存储器。另外，在低电耗应用中，费用被附加到用于处理资源的有效电力管理上。因此，需要超高速缓冲存储器在提供低电耗的同时提供更高的处理效率，例如更高的超高速缓冲存储器命中率。
相应地，需要一种改进的超高速缓冲存储器装置和方法。
由于附加的权利要求书中特别提及了本发明，因此下面将参照附图来详细描述本发明的其他一些特性。
图1示出了一个数据处理系统的实施例的方框图。
图2示出了一个图1中的超高速缓冲存储器的一部分的实施例的方框图。
图3示出了一个详细说明图2中超高速缓冲存储器的具体实施例的方框图。
图4示出了表示一个用于图2的超高速缓冲存储器的寄存器的特定实施例的图表。
图5示出了一个使用图4中寄存器的图2中的超高速缓冲存储器的访问操作的流程图。
最佳实施例的详细说明：
一般地，本发明涉及使用多路超高速缓存的多路超高速缓冲存储器装置和方法。根据本发明的第一个方面，装置为具有多路超高速缓冲存储器的装置。装置包括一个第一用户可控制单元，其中的第一可控制单元具有一个相应于多路超高速缓冲存储器中第一路的预定第一属性；一个第二用户可控制单元，其中的第二可控制单元具有一个相应于多路超高速缓冲存储器中第二路的预定第二属性；一个用于把访问属性传送给多路超高速缓冲存储器的导线；第一比较电路，用于把访问属性与预定第一属性相比较，以提供第一比较结果；第二比较电路，用于把访问属性与预定第二属性相比较，以提供第二比较结果；第一路控制电路，用于根据第一比较结果选择性地激活多路超高速缓冲存储器的第一路；和第二路控制电路，用于根据第二比较结果选择性地激活多路超高速缓冲存储器的第二路。
根据本发明的另一方面，装置为一个集成电路。该集成电路包括一个具有第一路和第二路的超高速缓冲存储器；一个第一存储单元，用于存储一个用于超高速缓冲存储器中第一路的第一存储属性；一个第二存储单元，用于存储一个用于超高速缓冲存储器中第二路的第二存储属性；一个用于传送访问属性的导线；和控制电路。控制电路把访问属性与第一存储属性相比较，以提供一个第一比较结果，并根据第一比较结果选择性地激活超高速缓冲存储器的第一路。控制电路还把访问属性与第二存储属性相比较，以提供一个第二比较结果，并根据第二比较结果选择性地激活超高速缓冲存储器的第二路。
根据本发明的另一方面，描述了一种用于操作具有多路超高速缓冲存储器的数据处理系统的方法。该方法包括如下步骤：初始化一个访问操作；访问多路超高速缓冲存储器以响应访问操作；把提供的访问属性提供给多路超高速缓冲存储器，作为访问操作的一部分；把提供的访问属性与相应于多路超高速缓冲存储器中第一路的第一存储访问属性相比较；把提供的访问属性与相应于多路超高速缓冲存储器中第二路的第二存储访问属性相比较；根据提供的访问属性是否与第一存储属性相匹配，进而选择性地激活多路超高速缓冲存储器的第一路；并根据提供的访问属性是否与第二存储属性相匹配，进而选择性地激活多路超高速缓冲存储器的第二路。
应当指出的是，这里所用到的具体术语和表达，在详细描述中所描述的具体的结构细节和操作细节，以及附图均只是为了说明之便，并不会限制附加的权利要求书中所描述的发明的范围。
参看图1，图示了处理系统10的一个实施例。处理系统10包括一个处理器12，和一个外部存储器14。处理器12包括一个中央处理器16，一个超高速缓冲存储器18，一个总线接口22，和其他模块20。处理器12还包括总线24和总线26。总线24把CPU16，超高速缓冲存储器18，总线接口22，和其他模块20互连在一起。总线26把总线接口22与存储器14耦合在一起。虽然描述了一个数据处理系统的特定实施例，但是可实现用于这种处理系统的不同的配置和其他实施例。例如，虽然图示中超高速缓冲存储器18作为微处理器12的一部分，但是超高速缓冲存储器18可位于处理器12的外部，例如位于外部存储器14中。
参看图2，图示了超高速缓冲存储器18的一部分的一个特殊的实施例。超高速缓冲存储器18的这一部分包括一个寄存器40，用于多路42-48的标记存储器矩阵，用于多路50-56的数据存储器矩阵，和超高速缓冲存储器控制电路58。超高速缓冲存储器控制电路58包括寄存器80，比较器60，和访问控制逻辑82。寄存器40接收总线24的地址部分，并且寄存器40具有一个标记值部分64，索引部分66，和一个字选择部分68。标记值部分64包括提供给多路标记矩阵42-48的标记值数据。来自索引部分66的数据被提供给多路标记矩阵42-48和多路数据矩阵50-56。来自字处理部分68的数据被提供给多路数据矩阵50-56。多路数据矩阵被耦合到总线24的双向数据部分。
每个标记矩阵，例如标记矩阵(路0)42，根据标记值64和位于索引值66所指向位置处的数据之间的比较结果，给相应的数据矩阵提供一命中信号，例如给数据矩阵(路0)50。超高速缓冲存储器控制电路系统58从总线24处接收访问属性87，地址和控制数据。在另一个实施例中，可在本地生成访问属性87，例如在多路超高速缓冲存储器内部生成。比较器60用于把访问属性87与来自寄存器80的存储属性值相比较，以生成一比较结果61，所生成的比较结果又由访问控制逻辑82处理，以为多路超高速缓冲存储器中的各路生成读允许信号86和写允许信号84。虽然只图示了一个比较器60，但是比较器60为多路超高速缓冲存储器的各路都提供了多个专门的比较器。在一个特定的实施例中，访问属性包括用于访问信息的数据类类型，例如存储在存储器中的信息的指令类型或数据类型。该实施例中的寄存器80包括控制位，用于相应地激活或禁止每个数据类类型。另外，寄存器80还可能包括其他的控制位，用于为多路超高速缓冲存储器的各路选择不同的激活或禁止功能。一个上述其他控制位的例子是用于根据每路的情况选择性地激活超高速缓冲存储器的刷新的控制位。另外，超高速缓冲存储器控制电路通过相应的通信通道62和70同标记矩阵42和数据矩阵50-56进行通信。
高速缓冲存储器控制电路58响应接收自数据总线24的数据。例如，可能从总线24处接收一用户可编程控制字并把它存储在寄存器80中，其中用户可编程控制字包括对于多个高速缓冲存储器路的用户选择属性控制位。通过这种方式，寄存器80可根据特殊应用或用户需求来灵活且动态地分配多路超高速缓冲存储器资源。
参看图3，图示了第一标记矩阵路的一部分和相应的第一数据矩阵路的一部分的一个特定实施例，其中第一标记矩阵路例如为标记矩阵(路0)42，其中第一标记矩阵路例如为数据矩阵(路0)50。上述部分包括具有标记部分64，索引部分66，和字选择部分68的寄存器40。比较器65把标记部分64和通过索引部分66接收自标记矩阵(路0)42的数据进行比较，以提供一个命中信号72。数据矩阵(路0)50包括多个数据块，并且数据矩阵由索引值66和字选择值68进行编址。编址数据项通过数据总线从数据矩阵(路0)50输出，其中数据总线为总线24的一部分。
另外要描述的是路控制电路92，其中路控制电路从它的输入处接收读允许信号86和写允许信号84，并在它的输出处输出控制信号94。控制信号94包括用于标记矩阵(路0)42和数据矩阵(路0)50的读和写控制信号，还包括用于多个功能的其它相关控制信号，其中各功能根据每一路的情况执行或不执行。
参看图4，图示了超高速缓冲存储器控制电路58内部的寄存器80的一个特殊实施例。在该实施例中，寄存器80包括多个数据域，每个数据域包括多个数据位。寄存器80包括一个超高速缓冲存储器刷新域102，一个数据超高速缓冲存储器允许域104，和一个指令超高速缓冲存储器允许域106。每个域102-106可包括一个或多个控制位。域102中的每个超高速缓冲存储器控制位都与一个不同的超高速缓冲存储器路相关。对于每个超高速缓冲存储器路，域102中的一个特定的超高速缓冲存储器控制位将判定是否刷新或清除特定的超高速缓冲存储器路。当刷新特定超高速缓冲存储器路时，则这一路的数据矩阵内的所有数据都将无效。
对于每个超高速缓冲存储器路，域104中的一个特定的超高速缓冲存储器控制位将判定特定超高速缓冲存储器路是否可被用于访问具有数据类类型的数据。同样地，域106中的一个特定的超高速缓冲存储器控制位将判定特定超高速缓冲存储器路是否可被用于访问具有指令类类型的数据。虽然只描述了一些数据和指令类型的类类型，但是上述各路的方法和结构也适用于多种数据类。例如，其他控制域也可能用于其他数据类类型定义，例如用户类类型，超级用户类类型，栈数据类类型，和非栈数据类类型。
参看图5，图示了用于操作数据处理系统10的一种特定的方法，其中数据处理系统具有多路超高速缓冲存储器。该方法包括第一步骤，即步骤202，用于初始化一个访问例如存储器访问等，在该步骤中把地址和属性信息提供给多路超高速缓冲存储器。在步骤204中，提供的属性信息与多路超高速缓冲存储器的各路的存储属性控制位相比较。这些存储属性控制位可能是存储在上述寄存器80中的控制位。在步骤206中，根据上述比较结果，给多路超高速缓冲存储器的各路提供允许信号，例如读允许信号和写允许信号。在步骤208中，根据允许信号，激活所选中的超高速缓冲存储器路，而未被选中的路仍保持禁止。
当访问超高速缓冲存储器时，在步骤210中如果有超高速缓冲存储命中，则在步骤212中继续执行只有被选中的超高速缓冲存储器路参加的超高速缓冲存储器访问。另外，一个置换功能用于判定在下面的置换操作中将被置换的超高速缓冲存储器入口。该置换只受所选择的超高速缓冲存储器路的影响。在超高速缓冲存储器未被命中的情况下，在步骤214中，只有被选中的超高速缓冲存储器路参加置换操作。作为一个特例，只有被选中的超高速缓冲存储器路参加了置换操作，其中置换操作根据相应的访问操作用来自外部存储器的数据块来置换现存的数据块。然后在步骤216中访问操作完成。
上述多路超高速缓冲存储器装置和方法具有许多优点。例如，在某一处理应用中，通过给该应用中常用到的数据类类型提供以更高的分配来提高超高速缓冲存储器的效率。例如，在某一应用中，如果由于处理而要访问大量的指令类型数据，则可从更高的超高速缓冲存储器使用频率上受益。通过根据多路的情况来选择性地分配超高速缓冲存储器资源，可取得最佳超高速缓冲存储器分配。另外，由于对于特定的数据类类型单独的超高速缓冲存储器路可被取消选择，因此可省电，这是由于未被选择的超高速缓冲存储器路没有使用相关的耗电电路。这种节约电耗的方法在许多低电耗应用中尤其有用，例如在低功率手提设备中。
因此，至此描述了一种实施例，其中该实施例至少包括一个用于操作数据处理系统的改进后的多路超高速缓冲存储器装置和方法的最佳实施例。对于熟练的技术人员来讲，所述方面可在多个方面予以改进，并且可假设除了上述最佳实施例外还有其他实施例。相应地，上述实施例是示例性的且不仅限于此，且在最大范围内合法，附加的权利要求书的目的在于涵盖本发明领域和精神内的所有的改进和其他的实施例。本发明的保护范围由下述权利要求书或其他相应文件的最广允许解释决定，而不是由上述详细描述决定。

Claims (10)

1．一种用于操作具有多路超高速缓冲存储器的数据处理系统的方法，该方法具有以下步骤：
初始化一访问操作；
响应访问操作访问多路超高速缓冲存储器；
提供给多路超高速缓冲存储器一个提供的访问属性作为访问操作的一部分；
把提供的访问属性与相应于多路超高速缓冲存储器的第一路的第一存储访问属性相比较；
把提供的访问属性与相应于多路超高速缓冲存储器的第二路的第二存储访问属性相比较；
根据提供的访问属性是否与第一存储访问属性匹配，选择性地激活多路超高速缓冲存储器的第一路；
根据提供的访问属性是否与第二存储访问属性匹配，选择性地激活多路超高速缓冲存储器的第二路；
2．如权利要求1所述的方法，其中提供的访问属性，第一存储访问属性，和第二存储访问属性均为超级用户/用户属性。
3．如权利要求1所述的方法，其特征在于还包括如下步骤：
在访问操作中判定是否发生了超高速缓冲存储器访问未命中的情况；和
如果发生了超高速缓冲存储器访问未命中的情况，则执行置换操作，其中在置换操作中只使用已在访问操作中选择性地激活了的多路超高速缓冲存储器中的路。
4．如权利要求1所述的方法，其中选择性地激活多路超高速缓冲存储器中的第一路的所述步骤包括：
选择性地把第一读允许信号提供给多路超高速缓冲存储器的第一路；和
选择性地把第一写允许信号提供给多路超高速缓冲存储器的第一路。
5．如权利要求1所述的方法，其特征在于还包括如下步骤：
把第二个提供的访问属性提供给多路超高速缓冲存储器，作为访问操作的一部分；
把第二个提供的访问属性与相应于多路超高速缓冲存储器的第一路的第三存储访问属性相比较；
把第二个提供的访问属性与相应于多路超高速缓冲存储器的第二路的第四存储访问属性相比较；
根据提供的访问属性是否与第一存储访问属性匹配及第二个提供的访问属性是否与第三存储访问属性匹配，选择性地激活多路超高速缓冲存储器的第一路；
根据提供的访问属性是否与第二存储访问属性匹配及第二个提供的访问属性是否与第四存储访问属性匹配，选择性地激活多路超高速缓冲存储器的第二路。
6．一个集成电路，其特征在于：
一个具有第一路和第二路的超高速缓冲存储器；
一个第一存储项，用于存储有关超高速缓冲存储器的第一路的第一存储属性；
一个第二存储项，用于存储有关超高速缓冲存储器的第二路的第二存储属性；
一个用于传送访问属性的导线；和
控制电路，其中控制电路把访问属性与第一存储属性相比较以提供一个第一比较结果，并根据第一比较结果选择性地激活超高速缓冲存储器的第一路，并且控制电路把访问属性与第二存储属性相比较以提供一个第二比较结果，并根据第二比较结果选择性地激活超高速缓冲存储器的第二路。
7．如权利要求6所述的集成电路，其中所述第一存储项包括第一用户可编程寄存器位，且所述第二存储项包括第二用户可编程寄存器位。
8．如权利要求6所述的集成电路，其中超高速缓冲存储器的第一路包括：
一个第一标记部分；和
一个第一数据部分；
并且其中超高速缓冲存储器的第二路包括：
一个第二标记部分；和
一个第二数据部分。
9．如权利要求6所述的集成电路，其中访问属性，第一存储属性和第二存储属性均为指令/数据属性。
10．一个具有多路超高速缓冲存储器的装置，其特征在于：
一个第一用户可控制项，其中第一用户可控制项具有相应于多路超高速缓冲存储器的第一路的预定第一属性；
一个第二用户可控制项，其中第二用户可控制项具有相应于多路超高速缓冲存储器的第二路的预定第二属性；
一个用于把访问属性传送给多路超高速缓冲存储器的导线；
第一比较电路，用于把访问属性与预定第一属性相比较，以提供第一比较结果；
第二比较电路，用于把访问属性与预定第二属性相比较，以提供第二比较结果；
第一路控制电路，用于根据第一比较结果选择性地激活多路超高速缓冲存储器的第一路；
第二路控制电路，用于根据第二比较结果选择性地激活多路超高速缓冲存储器的第二路。
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