CN117113443A - 基于cpld的毁钥方法、毁钥启动申请电路、设备及介质 - Google Patents
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Abstract
本申请公开了一种基于CPLD的毁钥方法、毁钥启动申请电路、设备及介质，属于信息安全技术领域。其中，具体毁钥方法包括：判断CPLD接受到的触发信息与多级校准信息均一致时，CPLD的第一管脚和第二管脚输出高电平，并向毁钥设备发出第一控制信号；触发信息为CPU接收毁钥信号，进入毁钥启动申请系统时采集得到的；多级校准信息为CPU向CPLD的多个地址写入的与每个地址一一对应的标准触发信息；第一控制信号用于控制毁钥设备向目标数据信息输出毁钥电流，以毁掉目标数据信息。本申请通过设置多级的校准信息保证，只有当CPLD接受到的触发信息与多级标准信息均一致时，才能控制毁钥设备释放出用于毁掉目标文件的毁钥电流，保证了整个毁钥过程的可靠性。
Description
技术领域
本公开一般涉及航空计算机技术领域，具体涉及一种基于CPLD的毁钥方法、毁钥启动申请电路、设备及介质。
背景技术
随着信息化技术在航空机载领域广泛应用，信息安全越发引起重视。面对纷繁复杂的态势，关键数据的重要性不言而喻。目前保护数据信息的方法一般有设置密码和数据加密，但即使安最强的加密系统，也存在被破解可能。为保证关键信息在任何情况下不被泄露，作为数据保护的手段，需要运用数据毁钥技术。
现有毁钥控制系统通过双余度二极管保护电路模块和双余度继电器控制模块，能对现有毁钥控制系统进行优化改进，有效防止出现断电反流冲击元器件，延长有效使用寿命，确保毁钥信号输出可靠稳定，杜绝误毁钥及毁钥失败情况发生，但却没有严格的软件协议实现毁钥流程，导致系统容易出现误判以及毁钥速度过慢等问题。
发明内容
鉴于现有技术中的上述缺陷或不足，期望提供一种可靠性高基于CPLD的毁钥方法、毁钥启动申请电路、设备及介质。
本申请提供一种基于CPLD的毁钥方法，包括：
判断所述CPLD接受到的触发信息与多级校准信息均一致时，所述CPLD的第一管脚和第二管脚输出高电平，并向毁钥设备发出第一控制信号；
所述触发信息为CPU接收毁钥信号，进入毁钥启动申请系统时采集得到的；所述多级校准信息为所述CPU向所述CPLD的多个地址写入的与每个地址一一对应的标准触发信息；
所述第一控制信号用于控制所述毁钥设备向目标数据信息输出毁钥电流，以毁掉所述目标数据信息。
根据本申请实施例提供的技术方案，所述多级校准信息包括：第一校准信息、第二校准信息和第三校准信息；
当所述CPLD接收到第一校准信息时，所述CPLD控制第一固态继电器端口的寄存器R1呈现为第一电平信号；
当所述CPLD接收到第二校准信息时，所述CPLD控制第二固态继电器端口的寄存器R2呈现为第二电平信号；
当所述CPLD接收到第三校准信息时，所述CPLD将所述第三校准信息写入毁钥使能寄存器R0，且当所述寄存器R1呈现为第一电平信号、所述寄存器R2呈现为第二电平信号以及所述第三校准信息写入毁钥使能寄存器R0时，向所述毁钥设备发出所述第一控制信号。
根据本申请实施例提供的技术方案，当所述寄存器R1、所述寄存器R2和所述毁钥使能寄存器R0均收到相应的校准信息时，所述CPLD控制所述第一管脚和所述第二管脚输出电高电平，所述第一固态继电器和所述第二固态继电器均处于闭合状态。
根据本申请实施例提供的技术方案，所述向毁钥设备发出第一控制信号之后，还包括：
所述CPLD通过离散量输入接口检测是否有毁钥电流输出；
当检测到存在所述毁钥电流的输出时，启动计时器；
判断所述计时器所记录的毁钥电流输出时间大于或者等于预设时长时，则确认所述第一控制信号有效，并中断所述毁钥电流的输出。
根据本申请实施例提供的技术方案，所述中断所述毁钥电流的输出之后，还包括：
启动软件毁钥申请系统；
将存储颗粒中最重要的数据信息毁掉，并将核心重要区域全部格式化；
计算所述软件毁钥时间，当所述软件毁钥时间到达预设时间时，启动硬件毁钥申请系统。
根据本申请实施例提供的技术方案，所述当检测到存在所述毁钥电流的输出时，启动计时器之后，还包括：
判断所述计时器所记录的毁钥电流输出时间小于预设时长时，重新启动所述计时器，直至判断所述毁钥电流输出时间大于或者等于预设时长。
根据本申请实施例提供的技术方案，所述CPLD接受到所述第一校准信息、所述第二校准信息和所述第三校准信息均会通过CRC16算法进行校验，校验通过后分别执行控制第一固态继电器端口的寄存器R1呈现为第一电平信号、控制第二固态继电器端口的寄存器R2呈现为第二电平信号以及将所述第三校准信息写入毁钥使能寄存器R0的步骤。
第二方面，本申请提供一种毁钥启动申请电路，其特征在于，包括：第一固态继电器、第二固态继电器、以及分别控制两个固态继电器的控制电路；
所述控制电路至少包括有CPLD；当所述第一固态继电器和所述第二固态继电器均处于闭合状态时，发出毁钥启动申请信号。
第三方面，本申请提供一种终端设备，包括存储器、处理器以及存储在所述存储器中并可在所述处理器上运行的计算机程序，其特征在于，所述处理器执行所述计算机程序时实现如上述的一种基于CPLD的毁钥方法的步骤。
第四方面，本申请提供一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，其特征在于，所述计算机程序被处理器执行时实现如上述的一种基于CPLD的毁钥方法的步骤。
综上所述，本技术方案具体地公开了基于CPLD的毁钥方法、毁钥启动申请电路、设备及介质。其中，基于CPLD的毁钥方法包括：判断所述CPLD接受到的触发信息与多级校准信息均一致时，所述CPLD的第一管脚和第二管脚输出高电平，并向毁钥设备发出第一控制信号；所述触发信息为CPU接收毁钥信号，进入毁钥启动申请系统时采集得到的；所述多级校准信息为所述CPU向所述CPLD的多个地址写入的与每个地址一一对应的标准触发信息；所述第一控制信号用于控制所述毁钥设备向目标数据信息输出毁钥电流，以毁掉所述目标数据信息。
为保证关键信息在任何情况下不被泄露，作为数据保护的手段，需要运用数据毁钥技术，现有毁钥技术大多集中在毁钥控制系统的升级与优化，而很少提出严格的软件协议实现毁钥流程保证毁钥流程的精确启动，本申请通过向CPLD地址写入多级校准信息，确保所述CPLD接受到的触发信息与多级标准信息全部一致，CPLD的管脚才会输出高电平，进而控制毁钥设备发出第一控制信号，毁掉目标数据信息。
附图说明
通过阅读参照以下附图所作的对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显：
图1为一种基于CPLD的毁钥方法的流程示意图。
图2为一种基于CPLD的毁钥方法的原理示意图。
图3为一种终端设备的原理框图。
图中标号：500、终端设备；501、CPU；502、ROM；503、RAM；504、总线；505、I/O接口；506、输入部分；507、输出部分；508、存储部分；509、通信部分；510、驱动器；511、可拆卸介质。
具体实施方式
下面结合附图和实施例对本申请作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释相关发明，而非对该发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与发明相关的部分。
需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。下面将参考附图并结合实施例来详细说明本申请。
实施例1
请参考图1所示的本实施例提供的一种基于CPLD的毁钥方法的流程示意图以及图2所示的原理示意图，该毁钥方法是基于CPLD(Complex Programming logic device，复杂可编程逻辑器件)的，与只有简单硬件器件搭建电路相比，通过CPU(Central ProcessingUnit，中央处理器)和CPLD增加智能判断，通过多重机制保障可靠毁钥，并有效防止误毁钥，所以执行主体可以是CPU。
具体地，毁钥方法包括：
S100：判断所述CPLD接受到的触发信息与多级校准信息均一致时，所述CPLD的第一管脚和第二管脚输出高电平，并向毁钥设备发出第一控制信号；
所述触发信息为CPU接收毁钥信号，进入毁钥启动申请系统时采集得到的；所述多级校准信息为所述CPU向所述CPLD的多个地址写入的与每个地址一一对应的标准触发信息；
具体地，所述多级校准信息包括：第一校准信息、第二校准信息和第三校准信息；其中，第一校准信息例如为0x0001、第二校准信息同样可选为0x0001、第三校准信息例如为0xBD73；
“毁钥信号”是指CPU通过周期循环检测来自飞控设备的毁钥申请命令，一旦检测到需要发出毁钥指令，则进入毁钥申请流程。
进一步地，针对第一校准信息，当CPLD接收到第一校准信息时，CPLD控制第一固态继电器端口的寄存器R1呈现为第一电平信号，即为1；
具体地，CPU首先通过SPI总线向CPLD地址Addr1写入0x0001用于控制第一级固态继电器闭合。CPLD在收到上述数据后且通过CRC16校验后，将第一级固态继电器的端口寄存器R1设置为1，此时CPLD的GPIO_1PIN(第一管脚)输出电平仍然为低电平，第一级固态继电器处于开路状态；
针对第二校准信息，当CPLD接收到第二校准信息时，CPLD控制第二固态继电器端口的寄存器R2呈现为第二电平信号，即为1；
具体地，CPU通过SPI总线向CPLD地址Addr2写入0x0001用于控制第二级固态继电器闭合，CPLD在收到上述数据且校验通过后将第二级固态继电器的端口寄存器R2设置为1，此时CPLD的GPIO_2PIN(第二管脚)输出电平仍然为低电平，第二级固态继电器处于开路状态；
针对第三校准信息，当CPLD接收到第三校准信息时，CPLD将所述第三校准信息写入毁钥使能寄存器R0，并向所述毁钥设备发出所述第一控制信号；
具体地，CPU通过SPI总线向CPLD地址Addr0写入数据0xBD73，CPLD校验数据正常，将该数据写入毁钥使能寄存器R0。
需要注意的是，第三校准信息会选取比较复杂一点的字符串，提高触发信息的可靠性，此外，具体第一校准信息、第二校准信息和第三校准信息的设置可由技术人员根据实际的情况进行设定。
此外所述第一控制信号用于控制所述毁钥设备向目标数据信息输出毁钥电流，以毁掉所述目标数据信息。
由于设置有多级的校准信息，所以只有在校准信息全部一致时，才会触发相应的用于控制毁钥设备的第一控制信号，不会导致误触发毁钥申请信号，从而增强了系统可靠性。
具体地，CPLD设计组合逻辑电路，只有同时满足R1为1、R2为1且R0＝0xBD73时，CPLD才控制GPIO_1PIN和GPIO_2PIN输出电高电平，从而控制毁钥申请输出28V直流信号，并通知毁钥设备输出毁钥电流，有一个环节不满足，则不会误触发毁钥信号。
进一步地，所述向毁钥设备发出第一控制信号之后，还包括：
所述CPLD通过离散量输入接口检测是否有毁钥电流输出；
当检测到存在所述毁钥电流的输出时，启动计时器；
判断所述计时器所记录的毁钥电流输出时间大于或者等于预设时长时，则确认所述第一控制信号有效，并中断所述毁钥电流的输出；此处，预设时长例如为32ms。
而判断所述计时器所记录的毁钥电流输出时间小于预设时长时，重新启动所述计时器，直至判断所述毁钥电流输出时间大于或者等于预设时长，形成对毁钥电流的持续监测。
具体地，进入完毁钥申请流程后，CPLD通过离散量输入接口检测是否有毁钥电流。按照业内规范毁钥电流是一个电压是28V，电流为1A，持续时间为2S的信号。
其中，此处的毁钥检测电路由光电隔离的离散量输入电路和CPLD检测逻辑组成。CPLD设计一个32ms的定时器，只有在CPLD检测到毁钥电流后才启动定时器。只有32ms内毁钥电路持续为高电平，才判断毁钥信号有效并发送中断信号给CPU。一旦中间检测到毁钥电流为低电平，则判断可能有干扰信号，重新启动定时器，重新检测，直到32ms内都为高电平，则判定毁钥电流有效。
具体地，所述中断所述毁钥电流的输出之后，还包括：
启动软件毁钥申请系统；
将存储颗粒中最重要的数据信息毁掉，并将核心重要区域全部格式化；
计算所述软件毁钥时间，当所述软件毁钥时间到达预设时间时，启动硬件毁钥申请系统；此处，预设时间为1s。
所述软毁和硬毁钥控制电路有2个电磁继电器及控制电路组成；所述CPLD完成地址译码、毁钥电流检测、中断告警、毁钥申请控制等功能组成；所述中断告警是CPLD检测到毁钥电流后，通过通用输入输出接口上报道CPU中断管脚，提示CPU启动软件毁钥流程。
CPU软件上将毁钥功能设置最高优先级，从而保证优先执行毁钥功能。CPU接收到毁钥中断后启动软件毁钥流程，通过PCIe总线优先毁掉存储颗粒中最重要的数据信息，将核心重要区域属于全部格式化为0xffff。软毁钥时间为1s，该时间由CPLD硬件定时器控制，在1s时间到后，不管软毁钥进展CPLD强制启动硬件毁钥电路。
CPLD通过控制2个电磁继电器闭合，将毁钥大电流直接加载到毁钥颗粒的3.3V接口电压和1.8V核电压，充分保证存储颗粒存储数据被烧毁，从而通过软毁和硬毁两个过程，两重机制充分保障可靠毁钥存储颗粒。
综上所述，为保证关键信息在任何情况下不被泄露，作为数据保护的手段，需要运用数据毁钥技术。本申请为保证关键信息在任何情况下不被泄露，作为数据保护的手段，需要运用数据毁钥技术，现有毁钥技术大多集中在毁钥控制系统的升级与优化，而很少提出严格的软件协议实现毁钥流程保证毁钥流程的精确启动，本申请通过向CPLD地址写入多级校准信息，确保所述CPLD接受到的触发信息与多级校准信息全部一致，CPLD的管脚才会输出高电平，进而控制毁钥设备发出第一控制信号，毁掉目标数据信息以及通过后续的触发条件，进一步地毁掉目标设备的软件和硬件。
实施例2
本实施例提供一种毁钥启动申请电路，应用有实施例1所述的一种基于CPLD的毁钥方法，毁钥启动申请电路包括：第一固态继电器、第二固态继电器、以及分别控制两个固态继电器的控制电路；
所述控制电路至少包括有CPLD；当所述第一固态继电器和所述第二固态继电器均处于闭合状态时，发出毁钥启动申请信号。
所述毁钥申请电路由2个固态继电器及控制电路组成，2个固态继电器采用串联的形式，对外输出高电压信号。毁钥申请电路之所以采用固态继电器而不是电磁继电器，是因为电磁继电器输出时机械触点有抖动现象，串联后这种情况更加严重，不利于毁钥设备采集毁钥申请信号。而采用的固态继电器是电子触点，电子开关只有通和断2种状态，不存在抖动情况。此外，采用两级固态继电器串联，则需要2个固态继电器的2个独立的控制电路同时闭合才能发出毁钥申请信号。如果只有其中一个固态继电器被误触发，不会导致误触发毁钥申请信号，从而增强了系统可靠性。
所述系统还包括CPU、CPLD、毁钥申请电路、毁钥检测电路、毁钥控制电路、数据存储颗粒等组成；所述CPU与CPLD通过SPI总线通信，CPU与存储颗粒通过PCIe总线实现数据交互；所述毁钥申请电路由2个固态继电器及控制电路组成，2个固态继电器采用串联的形式，对外输出高电压离散信号；所述毁钥申请电路是为防止误触发毁钥申请，CPU和CPLD之间制定一个毁钥流程，只有严格符合这个流程才允许发出毁钥申请。
具体地，所述毁钥检测电路由光电隔离电路组成；所述毁钥控制电路有2个电磁继电器及控制电路组成；所述CPLD完成地址译码、毁钥电流检测、中断告警、毁钥申请控制等功能组成；所述中断告警是CPLD检测到毁钥电流后，通过通用输入输出接口上报道CPU中断管脚，提示CPU启动软件毁钥流程；所述毁钥包含软毁和硬毁两个过程，两重机制充分保障可靠毁钥。所述基CPLD的高可靠性毁钥的方法，与只有简单硬件器件搭建电路相比，通过CPU和CPLD增加智能判断，通过多重机制保障可靠毁钥，并有效防止误毁钥。
实施例3
一种终端设备，包括存储器、处理器以及存储在所述存储器中并可在所述处理器上运行的计算机程序，所述处理器执行所述计算机程序时实现如实施例1所述的一种基于CPLD的毁钥方法的步骤。
在本实施例中，如图3所示，终端设备500包括CPU(中央处理单元)501，其可以根据存储在ROM(只读存储器)502中的程序或者从存储部分加载到RAM(随机访问存储器)503中的程序而执行各种适当的动作和处理。在RAM503中，还存储有系统操作所需的各种程序和数据。CPU501、ROM502以及RAM503通过总线504彼此相连。I/O(输入/输出)接口505也连接至总线504。
以下部件连接至I/O接口505：包括键盘、鼠标等的输入部分506；包括诸如阴极射线管(CRT)、液晶显示器(LCD)等以及扬声器等的输出部分507；包括硬盘等的存储部分508；以及包括诸如LAN卡、调制解调器等的网络接口卡的通信部分509。通信部分509经由诸如因特网的网络执行通信处理。驱动器也根据需要连接至I/O接口505。可拆卸介质511，诸如磁盘、光盘、磁光盘、半导体存储器等等，根据需要安装在驱动器510上，以便于从其上读出的计算机程序根据需要被安装入存储部分508。
特别地，根据本发明的实施例，上文参考流程示意图1描述的过程可以被实现为计算机软件程序。例如，本发明的实施例1包括一种计算机程序产品，其包括承载在计算机可读介质上的计算机程序，该计算机程序包含用于执行流程图所示的方法的程序代码。在这样的实施例中，该计算机程序可以通过通信部分从网络上被下载和安装，和/或从可拆卸介质被安装。在该计算机程序被中央处理单元(CPU)501执行时，执行本发明的系统中限定的上述功能。
需要说明的是，本发明所示的计算机可读介质可以是计算机可读信号介质或者计算机可读存储介质或者是上述两者的任意组合。计算机可读存储介质例如可以是——但不限于——电、磁、光、电磁、红外线、或半导体的系统、装置或器件，或者任意以上的组合。计算机可读存储介质的更具体的例子可以包括但不限于：具有一个或多个导线的电连接、便携式计算机磁盘、硬盘、随机访问存储器(RAM)503、只读存储器(ROM)502、可擦式可编程只读存储器(EPROM或闪存)、光纤、便携式紧凑磁盘只读存储器(CD-ROM)、光存储器件、磁存储器件、或者上述的任意合适的组合。在本发明中，计算机可读存储介质可以是任何包含或存储程序的有形介质，该程序可以被指令执行系统、装置或者器件使用或者与其结合使用。而在本发明中，计算机可读的信号介质可以包括在基带中或者作为载波一部分传播的数据信号，其中承载了计算机可读的程序代码。这种传播的数据信号可以采用多种形式，包括但不限于电磁信号、光信号或上述的任意合适的组合。计算机可读的信号介质还可以是计算机可读存储介质以外的任何计算机可读介质，该计算机可读介质可以发送、传播或者传输用于由指令执行系统、装置或者器件使用或者与其结合使用的程序。计算机可读介质上包含的程序代码可以用任何适当的介质传输，包括但不限于：无线、电线、光缆、RF等等，或者上述的任意合适的组合。
附图中的流程图和框图，图示了按照本发明各种实施例的系统、方法和计算机程序产品的可能实现的体系架构、功能和操作。在这点上，流程图或框图中的每个方框可以代表一个模块、程序段、或代码的一部分，上述模块、程序段、或代码的一部分包含一个或多个用于实现规定的逻辑功能的可执行指令。也应当注意，在有些作为替换的实现中，方框中所标注的功能也可以以不同于附图中所标注的顺序发生。例如，两个接连地表示的方框实际上可以基本并行地执行，它们有时也可以按相反的顺序执行，这依所涉及的功能而定。也要注意的是，框图或流程图中的每个方框、以及框图或流程图中的方框的组合，可以用执行规定的功能或操作的专用的基于硬件的系统来实现，或者可以用专用硬件与计算机指令的组合来实现。
描述于本发明实施例中所涉及到的单元可以通过软件的方式实现，也可以通过硬件的方式来实现，所描述的单元也可以设置在处理器中。其中，这些单元的名称在某种情况下并不构成对该单元本身的限定。所描述的单元或模块也可以设置在处理器中，例如，可以描述为：一种处理器包括第一生成模块、获取模块、查找模块、第二生成模块及合并模块。其中，这些单元或模块的名称在某种情况下并不构成对该单元或模块本身的限定，例如，获取模块还可以被描述为“用于在该基础表中获取多个待探测实例的获取模块”。
实施例4
本发明还提供了一种计算机可读介质，该计算机可读介质可以是上述实施例中描述的电子设备中所包含的；也可以是单独存在，而未装配入该电子设备中。上述计算机可读介质承载有一个或者多个程序，当上述一个或者多个程序被一个该电子设备执行时，使得该电子设备实现如上述实施例中所述的一种基于CPLD的毁钥方法。
以上描述仅为本申请的较佳实施例以及对所运用技术原理的说明。本领域技术人员应当理解，本申请中所涉及的发明范围，并不限于上述技术特征的特定组合而成的技术方案，同时也应涵盖在不脱离所述发明构思的情况下，由上述技术特征或其等同特征进行任意组合而形成的其它技术方案。例如上述特征与本申请中公开的(但不限于)具有类似功能的技术特征进行互相替换而形成的技术方案。
Claims (10)
1.一种基于CPLD的毁钥方法，其特征在于，包括：
判断所述CPLD接受到的触发信息与多级校准信息均一致时，所述CPLD的第一管脚和第二管脚输出高电平，并向毁钥设备发出第一控制信号；
所述触发信息为CPU接收毁钥信号，进入毁钥启动申请系统时采集得到的；所述多级校准信息为所述CPU向所述CPLD的多个地址写入的与每个地址一一对应的标准触发信息；
所述第一控制信号用于控制所述毁钥设备向目标数据信息输出毁钥电流，以毁掉所述目标数据信息。
2.根据权利要求1所述的一种基于CPLD的毁钥方法，其特征在于，
所述多级校准信息包括：第一校准信息、第二校准信息和第三校准信息；
当所述CPLD接收到第一校准信息时，所述CPLD控制第一固态继电器端口的寄存器R1呈现为第一电平信号；
当所述CPLD接收到第二校准信息时，所述CPLD控制第二固态继电器端口的寄存器R2呈现为第二电平信号；
当所述CPLD接收到第三校准信息时，所述CPLD将所述第三校准信息写入毁钥使能寄存器R0，且当所述寄存器R1呈现为第一电平信号、所述寄存器R2呈现为第二电平信号以及所述第三校准信息写入毁钥使能寄存器R0时，向所述毁钥设备发出所述第一控制信号。
3.根据权利要求2所述的一种基于CPLD的毁钥方法，其特征在于，
当所述寄存器R1、所述寄存器R2和所述毁钥使能寄存器R0均收到相应的校准信息时，所述CPLD控制所述第一管脚和所述第二管脚输出电高电平，所述第一固态继电器和所述第二固态继电器均处于闭合状态。
4.根据权利要求1所述的一种基于CPLD的毁钥方法，其特征在于，
所述向毁钥设备发出第一控制信号之后，还包括：
所述CPLD通过离散量输入接口检测是否有毁钥电流输出；
当检测到存在所述毁钥电流的输出时，启动计时器；
判断所述计时器所记录的毁钥电流输出时间大于或者等于预设时长时，则确认所述第一控制信号有效，并中断所述毁钥电流的输出。
5.根据权利要求4所述的一种基于CPLD的毁钥方法，其特征在于，
所述中断所述毁钥电流的输出之后，还包括：
启动软件毁钥申请系统；
将存储颗粒中最重要的数据信息毁掉，并将核心重要区域全部格式化；
计算所述软件毁钥时间，当所述软件毁钥时间到达预设时间时，启动硬件毁钥申请系统。
6.根据权利要求5所述的一种基于CPLD的毁钥方法，其特征在于，所述当检测到存在所述毁钥电流的输出时，启动计时器之后，还包括：
判断所述计时器所记录的毁钥电流输出时间小于预设时长时，重新启动所述计时器，直至判断所述毁钥电流输出时间大于或者等于预设时长。
7.根据权利要求2所述的一种基于CPLD的毁钥方法，其特征在于，
所述CPLD接受到所述第一校准信息、所述第二校准信息和所述第三校准信息均会通过CRC16算法进行校验，校验通过后分别执行控制第一固态继电器端口的寄存器R1呈现为第一电平信号、控制第二固态继电器端口的寄存器R2呈现为第二电平信号以及将所述第三校准信息写入毁钥使能寄存器R0的步骤。
8.一种毁钥启动申请电路，其特征在于，包括：第一固态继电器、第二固态继电器、以及分别控制两个固态继电器的控制电路；
所述控制电路至少包括有CPLD；当所述第一固态继电器和所述第二固态继电器均处于闭合状态时，发出毁钥启动申请信号。
9.一种终端设备，包括存储器、处理器以及存储在所述存储器中并可在所述处理器上运行的计算机程序，其特征在于，所述处理器执行所述计算机程序时实现如权利要求1至7任一项所述的一种基于CPLD的毁钥方法的步骤。
10.一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，其特征在于，所述计算机程序被处理器执行时实现如权利要求1-7任一项所述的一种基于CPLD的毁钥方法的步骤。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN202311140744.9A CN117113443A (zh) | 2023-09-05 | 2023-09-05 | 基于cpld的毁钥方法、毁钥启动申请电路、设备及介质 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN202311140744.9A CN117113443A (zh) | 2023-09-05 | 2023-09-05 | 基于cpld的毁钥方法、毁钥启动申请电路、设备及介质 |
Publications (1)
| Publication Number | Publication Date |
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| CN117113443A true CN117113443A (zh) | 2023-11-24 |
Family
ID=88805483
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
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Country Status (1)
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2023
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