CN116961761B - 应用于光纤收发器的硬件仲裁电路及方法 - Google Patents
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Abstract
本发明公开一种应用于光纤收发器的硬件仲裁电路及方法,包括有第一芯片、第二芯片以及EEPROM芯片;第一芯片和第二芯片两者中,其一为激光驱动器,另一为光电二极管接收器;第一芯片内置有总控制机、控制电路、SRAM芯片以及具有仲裁机制和智能地址识别功能的仲裁器;仲裁器连接总控制机,控制电路通过IIC总线分别连接第二芯片和EEPROM芯片,所述控制电路还连接仲裁器;其替代使用传统MCU,具有降低电路成本、响应速度较快的优点。
Description
技术领域
本发明涉及光纤收发器技术领域,尤其是指一种应用于光纤收发器的硬件仲裁电路及方法。
背景技术
小封装可插拔收发器(small form-factor pluggable,SFP)、四通道小封装可插拔收发器(Quad Small Form-actor Pluggable,QSFP)、双密度四通道小封装可插拔收发器(Quad Small Form Factor Pluggable-Double Density,QSFP-DD)或八通道小封装可插拔收发器(Octal Small Form-factor Pluggable,OSFP)等皆是可热插入的光纤收发器,用于电信和数据通信中光学通讯应用。
在现有的光纤收发器中,通常使用微处理器(MCU)+激光驱动器+光电二极管接收器的组合方案。在该方案中,如图1所示,与激光驱动器和光电二极管接收器之间的通讯由MCU软件配合IIC总线实现,成本较高。当出现通讯冲突时需要经过MCU内核的仲裁,响应速度较慢。
发明内容
有鉴于此,本发明针对现有技术存在之缺失,其主要目的是提供一种应用于光纤收发器的硬件仲裁电路及方法,其替代使用传统MCU,具有降低电路成本、响应速度较快的优点。
为实现上述目的,本发明采用如下之技术方案:
一种应用于光纤收发器的硬件仲裁电路,包括有第一芯片、第二芯片以及EEPROM芯片;
所述第一芯片和第二芯片两者中,其一为激光驱动器,另一为光电二极管接收器;
所述第一芯片内置有总控制机、控制电路、SRAM芯片以及具有仲裁机制和智能地址识别功能的仲裁器;
所述仲裁器连接总控制机,用于接收来自总控制机的三个串口通讯请求,经过仲裁机制与地址识别功能的逻辑判断后,通过控制电路发起指定通讯;
控制电路通过IIC总线分别连接第二芯片和EEPROM芯片,所述控制电路还连接仲裁器,用于接收来自仲裁器的指定通讯请求后,读取EEPROM芯片或第二芯片的预定位置的数据,并存储到SRAM芯片的预定位置或者将数据下发到EEPROM芯片或第二芯片的预定位置。
一种应用于光纤收发器的硬件仲裁方法,其基于应用于光纤收发器的硬件仲裁电路,包括有:
步骤S1、仲裁器同时接收来自总控制机的三个请求,其中,三个请求分别为上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求;
步骤S2、仲裁器依次处理上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求。
作为一种优选方案,在步骤S2中,仲裁器处理上电后的初始化请求的步骤如下:
步骤S211、仲裁器缓存该请求;
步骤S212、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S213、控制电路读取EEPROM芯片预定位置的数据,将数据存储到SRAM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S214、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S215、清除该请求缓存,通知总控制机已完成。
作为一种优选方案,在步骤S2中,仲裁器处理正常工作时的写配置请求的步骤如下:
步骤S221、仲裁器缓存该请求;
步骤S222、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S223、控制电路将数据存储到EEPROM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S224、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S225、清除该请求缓存,通知总控制机已完成。
作为一种优选方案,在步骤S2中,仲裁器处理正常工作时读第二芯片数据请求的步骤如下:
步骤S231、仲裁器缓存该请求;
步骤S232、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S233、控制电路从第二芯片读取预定位置的数据,将数据存储到SRAM芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S234、清除该请求缓存,通知总控制机已完成。
本发明与现有技术相比具有明显的优点和有益效果,具体而言,其主要是通过总控制机、控制电路、SRAM芯片以及仲裁器内置于第一芯片,配合EEPROM,将通讯功能由控制电路实现、仲裁功能由仲裁器实现,替代使用传统MCU,具有降低电路成本、响应速度较快的优点。
为更清楚地阐述本发明的结构特征和功效,下面结合附图与具体实施例来对本发明进行详细说明:
附图说明
图1是现有技术的电路原理框图;
图2是本发明之较佳实施例的电路原理框图;
图3是本发明之较佳实施例的第一流程框图(显示主要流程图);
图4是本发明之较佳实施例的第二流程框图(主要显示对上电后的初始化请求的处理流程);
图5是本发明之较佳实施例的第三流程框图(主要显示对正常工作时的写配置请求的处理流程);
图6是本发明之较佳实施例的第四流程框图(主要显示对正常工作时读第二芯片数据请求的处理流程)。
具体实施方式
请参照图2至图6所示,其显示出了本发明之实施例的具体结构,一种应用于光纤收发器的硬件仲裁电路,包括有第一芯片、第二芯片以及EEPROM芯片;
所述第一芯片和第二芯片两者中,其一为激光驱动器,另一为光电二极管接收器;
所述第一芯片内置有总控制机、控制电路、SRAM芯片以及具有仲裁机制和智能地址识别功能的仲裁器;
所述仲裁器连接总控制机,用于接收来自总控制机的三个串口通讯请求,经过仲裁机制与地址识别功能的逻辑判断后,通过控制电路发起指定通讯;
控制电路通过IIC总线分别连接第二芯片和EEPROM芯片,所述控制电路还连接仲裁器,用于接收来自仲裁器的指定通讯请求后,读取EEPROM芯片或第二芯片的预定位置的数据,并存储到SRAM芯片的预定位置或者将数据下发到EEPROM芯片或第二芯片的预定位置。
一种应用于光纤收发器的硬件仲裁方法,其基于应用于光纤收发器的硬件仲裁电路,包括有:
步骤S1、仲裁器同时接收来自总控制机的三个请求,其中,三个请求分别为上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求;
步骤S2、仲裁器依次处理上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求。
在本实施例中,在步骤S2中,仲裁器处理上电后的初始化请求的步骤如下:
步骤S211、仲裁器缓存该请求;
步骤S212、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S213、控制电路读取EEPROM芯片预定位置的数据,将数据存储到SRAM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S214、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S215、清除该请求缓存,通知总控制机已完成。
在本实施例中,在步骤S2中,仲裁器处理正常工作时的写配置请求的步骤如下:
步骤S221、仲裁器缓存该请求;
步骤S222、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S223、控制电路将数据存储到EEPROM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S224、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S225、清除该请求缓存,通知总控制机已完成。
在本实施例中,步骤S2中,仲裁器处理正常工作时读第二芯片数据请求的步骤如下:
步骤S231、仲裁器缓存该请求;
步骤S232、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S233、控制电路从第二芯片读取预定位置的数据,将数据存储到SRAM芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S234、清除该请求缓存,通知总控制机已完成。
本发明的设计重点在于,其主要是通过总控制机、控制电路、SRAM芯片以及仲裁器内置于第一芯片,配合EEPROM,将通讯功能由控制电路实现、仲裁功能由仲裁器实现,替代使用传统MCU,具有降低电路成本、响应速度较快的优点。
以上所述,仅是本发明的较佳实施例而已,并非对本发明的技术范围作任何限制,故凡是依据本发明的技术实质对以上实施例所作的任何细微修改、等同变化与修饰,均仍属于本发明技术方案的范围内。
Claims (5)
1.一种应用于光纤收发器的硬件仲裁电路,其特征在于:包括有第一芯片、第二芯片以及EEPROM芯片;
所述第一芯片和第二芯片两者中,其一为激光驱动器,另一为光电二极管接收器;
所述第一芯片内置有总控制机、控制电路、SRAM芯片以及具有仲裁机制和智能地址识别功能的仲裁器;
所述仲裁器连接总控制机,用于接收来自总控制机的三个串口通讯请求,经过仲裁机制与地址识别功能的逻辑判断后,通过控制电路发起指定通讯;
控制电路通过IIC总线分别连接第二芯片和EEPROM芯片,所述控制电路还连接仲裁器,用于接收来自仲裁器的指定通讯请求后,读取EEPROM芯片或第二芯片的预定位置的数据,并存储到SRAM芯片的预定位置或者将数据下发到EEPROM芯片或第二芯片的预定位置。
2.一种应用于光纤收发器的硬件仲裁方法,其特征在于:其基于权利要求1所述的应用于光纤收发器的硬件仲裁电路,包括有:
步骤S1、仲裁器同时接收来自总控制机的三个请求,其中,三个请求分别为上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求;
步骤S2、仲裁器依次处理上电后的初始化请求、正常工作时的写配置请求和正常工作时读第二芯片数据请求。
3.根据权利要求2所述的应用于光纤收发器的硬件仲裁方法,其特征在于:在步骤S2中,仲裁器处理上电后的初始化请求的步骤如下:
步骤S211、仲裁器缓存该请求;
步骤S212、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S213、控制电路读取EEPROM芯片预定位置的数据,将数据存储到SRAM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S214、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S215、清除该请求缓存,通知总控制机已完成。
4.根据权利要求2所述的应用于光纤收发器的硬件仲裁方法,其特征在于:在步骤S2中,仲裁器处理正常工作时的写配置请求的步骤如下:
步骤S221、仲裁器缓存该请求;
步骤S222、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
步骤S223、控制电路将数据存储到EEPROM芯片的预定位置,所有数据传输完成后通知仲裁器;
步骤S224、仲裁器通过地址识别功能判断当前是配置第一芯片还是第二芯片:若是第一芯片则结束通讯并释放总线;若是第二芯片则再次通知控制电路发起通讯,将数据下发到第二芯片的预定位置,所有数据传输完成后结束通讯并释放总线;
步骤S225、清除该请求缓存,通知总控制机已完成。
5.根据权利要求2所述的应用于光纤收发器的硬件仲裁方法,其特征在于:在步骤S2中,仲裁器处理正常工作时读第二芯片数据请求的步骤如下:
步骤S231、仲裁器缓存该请求;
步骤S232、仲裁器判断总线是否被占用,若未被占用,则立即通知控制电路发起通讯、占用总线,否则,等待当前通讯结束后通知控制电路发起新通讯、占用总线;
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