CN1166058C - 一种实现n阶插值滤波的方法与装置 - Google Patents
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Abstract
本发明公开了一种实现N阶插值滤波的方法和装置,其特点是,采用N-1阶梳状滤波器、零阶保持器和N-1阶的积分器来完成,其信号处理流程是:速率为Fs/R的数字信号先经过N-1阶的梳状滤波器,然后经过零阶保持器把数据速率变为Fs,最后经过N-1阶的积分器输出。本发明在梳状滤波器和积分器之间,用零阶保持器代替补零电路,可使电路结构简单;同时为实现同样的插值滤波功能可以少用一阶梳状滤波器和一阶积分器,达到节省资源的目的。
Description
本发明涉及一种N阶CIC(Cascaded Integrator-Comb)插值滤波器,尤其涉及一种少用一阶梳状滤波器和一阶积分器即能实现同样插值滤波功能的方法与装置,
由大规模集成电路(VLSI)的飞速发展带来的数字化是当今愈演愈烈的信息技术的一个主要特征,它反映在无线电通信设备上是数字器件越来越接近天线,这种趋势所带来的好处是生产容易、成本低廉、功能更多、性能更好。
在无线电数字发射机中必须包含把数字信号从低速率转化为较高速率的数字上变频器,其中数字插值滤波器必不可少,它用于消除不需要的带外杂波,因此设计速度快而占用资源少的数字插值滤波器非常重要。
有许多实现数字插值滤波器的方法,其中影响最广的是Eugene B.Hogenhauer在《超声、语音和信号处理会刊》1981年4月刊的“实现抽样和插值的一类经济的数字滤波器”(″An Economical Class of Digital Filters forDecimation and Interpolation″IEEE Transactions on Acoustics,Speech and SignalProcessing,Vol.ASSP 29,No.2,April 1981)一文中所提出的方法,该方法被称为CIC(Cascaded Integrator-Comb)插值滤波器(以下简称CIC插值滤波器),CIC插值滤波器是高速插值滤波器在实现技术上的一个里程碑,自从该文发表后已获得广泛应用。
通常实现N阶插值滤波的CIC插值滤波器的结构是(具体结构见图1):从信号流向看,开始为N个梳状滤波器1(减法器),接着是补零电路4,最后是N个积分器3(加法器),补零电路4由一个零值存储器、一个数据存储器和一个开关电路构成,其中梳状滤波器部分工作在较低的取样速率,积分器部分工作在较高的取样速率,开关电路的a端每隔R-1个时钟脉冲周期倒向c端一次。插值因子R通常设置为2到10000。阶次N通常是依据应用要求精度选取,目前在实际应用中N通常界于2到5。该N阶CIC滤波器的信号处理流程是:速率为Fs/R的数字信号先经过N阶的梳状滤波器,然后经过补零电路把数据速率变为Fs,最后经过N阶的积分器输出。
采用CIC插值滤波器有许多优点:不需要乘法器,不需要存储输入数据和滤波系数的存储器,滤波器的实现结构非常规范,不需要外部控制线和复杂的内部时序。
CIC插值滤波器解决了数字插值滤波器的高速实现问题,在占用资源(加法器和存储器)方面也不算太多,因此在单通道和交流供电的应用场合,人们不会对CIC所占用的资源作过多的要求,然而在数字无线电发射机的多路并行应用中,CIC插值滤波器资源的节省将导致相应ASIC实现的更高集成度,同时减少所消耗的电流。尤其对于手机和卫星应用来说,因采用的是电池或太阳能供电,低能耗地实现数字插值滤波意味着延长使用时间,因而具有更重要的意义。
本发明的目的是为了提供一种节省资源的N阶插值滤波的方法与装置,该方法和装置在为实现同样的插值滤波效果时可少用一阶梳状滤波器和一阶积分器。
实现本发明目的的技术方案是:
一种实现N阶插值滤波的方法,其特点是,采用N-1阶梳状滤波器、零阶保持器和N-1阶的积分器来完成,其信号处理流程是:速率为Fs/R的数字信号先经过N-1阶的梳状滤波器,然后经过零阶保持器把数据速率变为Fs,最后经过N-1阶的积分器输出;
所述的经过零阶保持器把数据速率变为Fs的方法是:把数据以Fs/R的速率写入存储器,然后以Fs的速率从该存储器中读出;
所述的梳状滤波器、积分器的阶数N>2。
上述方法,其中,所述的零阶保持器是一个数据存储器。
一种专用于实现上述N阶插值滤波方法的装置,其特点是,它依次由N-1阶梳状滤波器、零阶保持器和N-1阶的积分器串接构成;
所述的梳状滤波器、积分器的阶数N>2。
所述的零阶保持器是一个数据存储器,其串接在梳状滤波器之后与积分器之前。
由于本发明采用了以上的技术方案,在梳状滤波器和积分器之间,用零阶保持器代替补零电路,可使电路结构简单;另一方面可以少用一阶梳状滤波器和一阶积分器即能实现同样的插值滤波功能,达到节省资源的目的。
对于N阶补零内插CIC滤波器,设插值率为R,输入数据位宽为Bin,如改用N-1阶的零阶保持内插CIC滤波器(除有非常小的时延外,其它性能完全一样),则能够节省2个(Bin+N)比特宽度的存储器和2个(Bin+N)比特宽度的加法器。在前面我们已经提到在实用中CIC的最高阶次为5,而CIC每增加一阶(级),存储器和加法器至少要增加1比特宽度,因此降低一阶CIC所节省的资源约为20%,即采用本发明实现数字插值滤波器比常规方法约节省20%的芯片资源。
本发明的具体性能、特点将由以下的实施例及其附图进一步加以说明。
图1是采用常规方法实现的N阶CIC插值滤波器的结构示意图。
图2是采用本发明实现的N阶CIC插值滤波器的结构示意图。
图3是经典5阶CIC与采用本发明后的4阶CIC对脉冲的响应波形比较示意图。
图4是本发明的一种应用数字上变频器电路的功能框图。
本发明是一种采用零阶保持器来实现N阶CIC插值滤波的方法与装置,请参阅图2,本发明的装置是依次由N-1阶梳状滤波器1、零阶保持器2和N-1阶的积分器3构成,零阶保持器2是一个数据存储器。在变速率信号处理中,利用零阶保持器通过在梳状滤波器之后和积分滤波器之前存贮当前的和以前的数据来实现一阶梳状滤波器和一阶积分器,与传统方法相比,可以少用一阶梳状滤波器和一阶积分器,从而达到节省资源(加法器、存储器和乘法器等)的目的。
本发明实现N阶CIC滤波的信号处理流程是:速率为Fs/R的数字信号先经过N-1阶的梳状滤波器,然后经过零阶保持器把数据速率变为Fs,最后经过N-1阶的积分器输出。
上述经过零阶保持器把数据速率变为Fs的方法是:把数据以Fs/R的速率低速写入存储器,然后以Fs的速率高速从该存储器中读出。
输入数据速率为Fs/R一阶梳状滤波器的传递函数为Hc(z)=(1-z-R),式中R是插值率或抽取率;输入数据速率为Fs的一阶积分器的传递函数为H1(z)=1/(1-z-1),由一阶梳状滤波器和一阶积分器组成的一阶CIC插值滤波器(中间每2点之间补R-1个零进行速率匹配)的传递函数是
HC1(z)=Hc(z)H1(z)=(1+z-1+……+z-(R-1))
对于N-1(N>2)阶的CIC插值滤波器,如在梳状滤波器和积分器中间采用零阶保持(而不是补零)的速率匹配方法,从采样率为Fs的角度看,原来是每R个数据中只有第一个数据不是零,现在R个数据全不是零且相等,以数字信号处理的观点看,后面的R-1个非零数据可以由第1个数据延迟1个时钟周期(1/Fs)、2个时钟周期、……、(R-1)个时钟周期徕,这R个数据叠加起来送入后续积分器,因此该零阶保持器的传递函数的形式表达式是:
Hz(z)=(1+z-1+……+z-(R-1))
可见Hz(z)=HC1(z),两者完全一样。数字仿真和FPGA实现进一箕证实了这一论断,图3是经典的5阶CIC脉冲冲击响应波形A和本发明采用零阶保持后的4阶CIC的脉冲冲击响应波形B的比较示意图,从图中可以看出,当不考虑处理时延时,两者完全一样。
CIC插值滤波的主要应用领域是需要较大的数据率变换且在高数据速率侧采用乘法器不经济的场合,凡是需要应用CIC进行插值的场合都可以实施本发明,如采用高度数字化的基站和移动终端,又如数字高频任意波发生器,等等,本发明的应用范围非常广泛。
图4是本发明应用在数字上变频器电路的功能框图。图中单元31是工作在较低时钟频率的系数存储FIR(Finite impulse response)滤波器;单元32是本发明所关注的CIC插值滤波器,它能以较少的资源和可接受的性能将较低速率的数字信号变为较高速率的数字信号,单元32可以是多个CIC的级联,这样可以增加应用的灵活性;单元33是数控振荡器,它产生复数(两路正交)的数字中频振荡信号;单元34实现数字乘法功能,单元35实现数据缓冲输出。
假定单元32采用补零内插时需要5阶梳状滤波器和5阶积分器,则采用零阶保持内插后,完成同样的功能,只需要4阶梳状滤波器和4阶积分器了。
Claims (3)
1、一种实现N阶插值滤波的方法,其特征在于,采用N-1阶梳状滤波器、零阶保持器和N-1阶的积分器来完成,其信号处理流程是:速率为Fs/R的数字信号先经过N-1阶的梳状滤波器,然后经过零阶保持器把数据速率变为Fs,最后经过N-1阶的积分器输出;
所述的经过零阶保持器把数据速率变为Fs的方法是:把数据以Fs/R的速率写入存储器,然后以Fs的速率从该存储器中读出;
所述的梳状滤波器、积分器的阶数N>2。
2、根据权利要求1所述的方法,其特征在于,所述的零阶保持器是一个数据存储器。
3、一种专用于实现权利要求1所述的N阶插值滤波方法的装置,其特征在于,它依次由N-1阶梳状滤波器、零阶保持器和N-1阶的积分器串接构成;所述的梳状滤波器、积分器的阶数N>2;所述的零保持器是一个数据存储器,其串接在梳状滤波器之后与积分器之前。
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