CN116229903A - 显示装置 - Google Patents

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CN116229903A
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CN
China
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control
driving
gate
transistor
period
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崔荣埈
吴惠美
李昭廷
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LG Display Co Ltd
Original Assignee
LG Display Co Ltd
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Abstract

本发明的实施方式涉及一种显示装置，包括：显示面板，所述显示面板包括多条栅极线、多条数据线和多个子像素；多个发光元件，设置在所述多个子像素上；以及多个驱动晶体管，所述驱动晶体管被配置为驱动所述多个发光元件，并且每个驱动晶体管包括驱动栅极和与所述驱动栅极相对设置且电连接至控制电压线的控制栅极，其中在作为帧周期的一部分的控制时段中，第一电平的控制电压被施加给所述多个驱动晶体管中的至少一个驱动晶体管的控制栅极，所述至少一个驱动晶体管在所述控制时段中截止。通过施加给与驱动晶体管的驱动栅极相对设置的控制栅极的控制电压的控制，可容易地控制驱动晶体管的导通状态和截止状态并且可在显示驱动中执行非发光驱动。

Description

显示装置
相关申请的交叉引用
本申请要求享有于2021年12月2日提交的韩国专利申请No.10-2021-0171145的优先权，通过引用将该韩国专利申请整体并入本文。
技术领域
本发明的实施方式涉及一种显示装置。
背景技术
信息社会的发展促使对于显示图像的显示装置的需求日益增加，并且诸如液晶显示装置、有机发光显示装置等之类的各种显示装置得到使用。
由于有机发光显示装置使用自身发光的有机发光二极管来显示图像，所以其能够提供快速响应速度、高发光效率、高亮度和宽视角等优点。
此外，研究和开发了能够减少有机发光显示装置的视频图像响应时间的方法。
发明内容
本发明的实施方式可提供一种显示装置，其能够在减小显示装置中设置的子像素的结构和驱动方法的变化的同时改善视频响应时间。
本发明的实施方式可提供一种显示装置，包括：显示面板，所述显示面板包括多条栅极线、多条数据线和多个子像素；多个发光元件，所述发光元件设置在所述多个子像素上；以及多个驱动晶体管，所述驱动晶体管被配置为驱动所述多个发光元件，并且所述多个驱动晶体管的每一个包括驱动栅极和与所述驱动栅极相对设置且电连接至控制电压线的控制栅极，其中在作为帧周期的一部分的控制时段中，第一电平的控制电压被施加给所述多个驱动晶体管中的至少一个驱动晶体管的控制栅极，所述至少一个驱动晶体管在所述控制时段中截止。
本发明的实施方式可提供一种显示装置，包括：显示面板，所述显示面板包括多条栅极线、多条数据线和多个子像素；以及多个驱动晶体管，所述驱动晶体管在所述多个子像素上，并且所述多个驱动晶体管的每一个包括驱动栅极和与所述驱动栅极相对设置且电连接至控制电压线的控制栅极，其中在将扫描信号施加给所述多条栅极线中的第一栅极线的时段中施加给所述多个驱动晶体管中的至少一个驱动晶体管的控制栅极的控制电压的电平不同于在将扫描信号施加给所述多条栅极线中的第二栅极线的时段中施加给所述至少一个驱动晶体管的控制栅极的控制电压的电平。
根据本发明的各实施方式，由于设置在子像素上的驱动晶体管通过在帧周期中施加给驱动晶体管的控制栅极的控制电压的控制而截止，所以可容易地实现能够改善显示装置的视频响应时间的子像素的结构和驱动方法。
根据本发明的各实施方式，通过施加给与驱动晶体管的驱动栅极相对设置的控制栅极的控制电压的控制，可容易地控制驱动晶体管的导通状态和截止状态，可在显示驱动中执行非发光驱动。此外，由于通过施加给驱动晶体管的控制栅极的控制电压来执行非发光驱动，所以可独立于施加扫描信号的时段来执行非发光驱动，并且可在不影响显示驱动的条件下执行非发光驱动，可改善显示装置的视频响应时间。
附图说明
通过结合附图给出的下文详细描述，本发明的上述和其他目的、特征和优点将更清楚地理解。在附图中：
图1是示意性图解根据本发明实施方式的显示装置的构造的视图；
图2是图解根据本发明实施方式的显示装置中包括的子像素的电路结构示例的视图；
图3是图解根据施加给图2所示的子像素上设置的驱动晶体管的控制栅极的控制电压，驱动晶体管的阈值电压的变化示例的视图；
图4A至4C是图解图2所示的子像素的驱动方法示例的视图；
图5是图解在根据本发明实施方式的显示装置中包括的子像素的另一电路结构示例的视图；
图6是图解根据图5所示的子像素上设置的第一控制晶体管的驱动，驱动晶体管的输出曲线示例的视图；
图7是图解图5所示的子像素的驱动方法示例的视图；
图8是图解在根据本发明实施方式的显示装置中包括的子像素的又一电路结构示例及其驱动方法示例的视图；
图9A和9B是图解控制电压线设置在根据本发明实施方式的显示装置中的结构示例的视图；
图10是图解在根据本发明实施方式的显示装置中设置的栅极线和控制电压线的驱动时序示例的视图；
图11A是图解根据由图10所示的1001表示的栅极线所驱动的子像素的驱动得到的电压波形示例的视图；
图11B是图解根据由图10所示的1002表示的栅极线所驱动的子像素的驱动得到的电压波形示例的视图；
图12A和12B是图解在根据本发明实施方式的显示装置中设置的栅极线和控制电压线的其他驱动时序示例的视图。
具体实施方式
在本发明的示例或实施方式的下文描述中，将参照附图，其中通过举例的方式示出了可实施的具体示例或实施方式，并且其中可使用相同的参考标记和符号来指代相同或相似的组件，即使在彼此不同的附图中示出。此外，在本发明的示例或实施方式的下文描述中，当确定对本文涉及的公知功能和组件的详细描述反而会使本发明的一些实施方式中的主题不清楚时，将省略该详细描述。在本文中使用的术语比如“包括”、“具有”、“包含”、“构成”通常旨在允许添加其他组件，除非这些术语与术语“仅”一起使用。
在此可使用诸如“第一”、“第二”、“A”、“B”、“(A)”或“(B)”之类的术语来描述本发明的元件。这些术语的每一个并非用来限定元件的本质、顺序、次序或数量等，而是仅用于将相应元件与其他元件区分开。
当提到第一元件与第二元件“连接或耦接”、“交叠”等时，应当解释为，第一元件不仅可与第二元件“直接连接或耦接”或“直接接触或交叠”，也可在第一元件和第二元件之间插置第三元件，或者第一元件和第二元件可经由第四元件彼此“连接或耦接”、“交叠”等。在此，第二元件可包括在彼此“连接或耦接”、“接触或交叠”等的两个或更多个元件中的至少之一中。
当使用时间相对术语比如“之后”、“随后”、“接下来”、“之前”等来描述元件或构造的工艺或操作，或者操作、处理、制造方法中的流程或步骤时，这些术语可用于描述非连续性或非依次性的工艺或操作，除非这些术语与术语“直接”或“紧接”一起使用。
此外，当提到任何维度、相对尺寸等时，应当考虑到，元件或特征的数值或相应信息(例如电平、范围等)包括可由各种因素(例如，工艺因素、内部或外部冲击、噪声等)导致的公差或误差范围，即使未指明相关说明。此外，术语“可”完全涵盖术语“能够”的全部含义。
下文，将参照附图详细描述本发明的各实施方式。
图1是示意性图解根据本发明实施方式的显示装置100的构造的视图。
参照图1，显示装置100可包括显示面板110以及用于驱动显示面板110的栅极驱动电路120、数据驱动电路130和控制器140。
显示面板110可包括其中设置有多个子像素SP的有源区AA以及位于有源区AA的外部的非有源区NA。
多条栅极线GL和多条数据线DL可布置在显示面板110上。多个子像素SP可位于栅极线GL和数据线DL彼此交叉的区域中。
栅极驱动电路120由控制器140控制，并且将扫描信号依次输出到布置在显示面板110上的多条栅极线GL，由此控制多个子像素SP的驱动时序。
栅极驱动电路120可包括一个或多个栅极驱动器集成电路GDIC，并且可仅位于显示面板110的一侧处，或者可根据驱动方法位于其两侧处。
每个栅极驱动器集成电路GDIC可通过带式自动焊接TAB方法或者玻上芯片COG方法连接至显示面板110的接合焊盘。可选地，每个栅极驱动器集成电路GDIC可由面板内栅极GIP方法实现，然后直接布置在显示面板110上。可选地，栅极驱动器集成电路GDIC可集成并且布置在显示面板110上。可选地，每个栅极驱动器集成电路GDIC可由膜上芯片COF方法实现，其中元件安装在连接至显示面板110的膜上。
数据驱动电路130从控制器140接收图像数据DATA，并且将图像数据DATA转换成模拟数据电压Vdata。然后，数据驱动电路130根据经由栅极线GL施加扫描信号的时序向每条数据线DL输出数据电压Vdata，从而多个子像素SP的每一个发射具有对应于图像数据DATA的亮度的光。
数据驱动电路1 30可包括一个或多个源极驱动器集成电路SDIC。
每个源极驱动器集成电路SDIC可包括移位寄存器、锁存电路、数模转换器、输出缓存器等。
每个源极驱动器集成电路SDIC可通过带式自动焊接TAB方法或玻上芯片COG方法连接至显示面板110的接合焊盘。可选地，每个源极驱动器集成电路SDIC可直接设置在显示面板110上。可选地，栅源极驱动器集成电路SDIC可集成并且布置在显示面板110上。可选地，每个源极驱动器集成电路SDIC可由膜上芯片COF方法实现。在这种情形下，每个源极驱动器集成电路SDIC可安装在连接至显示面板110的膜上，并且可经由膜上的线电连接至显示面板110。
控制器140可向栅极驱动电路120和数据驱动电路130提供各种控制信号，并且控制栅极驱动电路120和数据驱动电路130的操作。
控制器140可安装在印刷电路板、柔性印刷电路等上，并且可经由印刷电路板、柔性印刷电路等电连接至栅极驱动电路120和数据驱动电路130。
控制器140可允许栅极驱动电路120根据在每帧中实现的时序输出扫描信号。控制器140可将从外部接收到的数据信号转换成符合在数据驱动电路130中使用的数据信号格式，然后将转换后的图像数据输出到数据驱动电路130。
控制器140可从显示装置100的外部(例如主机系统)接收图像数据以及各种时序信号，包括垂直同步信号VSYNC、水平同步信号HSYNC、输入数据使能DE信号、时钟信号CLK等。
控制器140可使用从外部接收到的各种时序信号产生各种控制信号，并且可向栅极驱动电路120和数据驱动电路130输出控制信号。
例如，为了控制栅极驱动电路120，控制器140可输出包括栅极起始脉冲GSP、栅极移位时钟GSC、栅极输出使能信号GOE等的栅极控制信号GCS。
栅极起始脉冲GSP控制构成栅极驱动电路120的一个或多个栅极驱动器集成电路GDIC的操作起始时序。栅极移位时钟GSC是共同输入给一个或多个栅极驱动器集成电路GDIC的时钟信号，其控制扫描信号的移位时序。栅极输出使能信号GOE指定关于一个或多个栅极驱动器集成电路GDIC的时序信息。
此外，为了控制数据驱动电路130，控制器140可输出包括源极起始脉冲SSP、源极采样时钟SSC、源极输出使能信号SOE等的各种数据控制信号DCS。
源极起始脉冲SSP控制构成数据驱动电路130的一个或多个源极驱动器集成电路SDIC的数据采样起始时序。源极采样时钟SSC是用于控制在相应源极驱动器集成电路SDIC中的采样数据的时序的时钟信号。源极输出使能信号SOE控制数据驱动电路130的输出时序。
显示装置100可进一步包括电源管理集成电路，用于向显示面板110、栅极驱动电路120、数据驱动电路130等提供各种电压或电流，或者用于控制待提供的各种电压或电流。
每个子像素SP是通过栅极线GL和数据线DL的交叉限定的区域，并且包括发光的元件的至少一个电路元件可设置在子像素SP中。
例如，在显示装置100是有机发光显示装置的情形下，有机发光二极管OLED和各种电路元件可设置在多个子像素SP上。由于通过各种电路元件控制提供给有机发光二极管OLED的电流，每个子像素SP可呈现对应于图像数据的亮度。
可选地，在一些情形下，发光二极管LED或微发光二极管μLED可设置在子像素SP上。
图2是图解根据本发明实施方式的显示装置100中包括的子像素SP的电路结构示例的视图。
参照图2，多个子像素SP的每一个可包括发光元件ED。子像素SP可包括驱动晶体管DRT，其被配置为向发光元件ED提供驱动电流。
除了用于驱动子像素SP的驱动晶体管DRT和发光元件ED之外，子像素SP还可包括至少一个电路元件。
例如，子像素SP可包括第一开关晶体管SWT1、第二开关晶体管SWT2以及存储电容器Cstg。
图2所示的子像素SP的电路结构示例示出了在子像素SP中包括三个薄膜晶体管和一个电容器的3T1C结构，但是本发明的实施方式不限于此，子像素SP上可设置至少一个驱动晶体管。此外，示出了图2所示的子像素SP上设置的全部薄膜晶体管为N型的示例，但是子像素SP中包括的至少一些薄膜晶体管可以是P型。
第一开关晶体管SWT1可电连接在数据线DL和第一节点N1之间。
第一开关晶体管SWT1可由被施加第一扫描信号SCAN1的栅极线GL控制。
第一开关晶体管SWT1可进行控制，以将经由数据线DL提供的数据电压Vdata施加给第一节点N1。第一节点N1可以是驱动晶体管DRT的栅极节点。
第二开关晶体管SWT2可电连接在基准电压线RVL和第二节点N2之间。
第二开关晶体管SWT2可由被施加第一扫描信号SCAN1的栅极线GL控制。
第二开关晶体管SWT2可由与用于控制第一开关晶体管SWT1的栅极线GL不同的栅极线GL控制，但是也可如图2所示的示例那样，由与用于控制第一开关晶体管SWT1的栅极线GL相同的栅极线GL控制。设置在有源区AA上的栅极线GL可减少。
第二开关晶体管SWT2可进行控制，以将基准电压Vref施加给第二节点N2。第二节点N2可以是驱动晶体管DRT的源极节点或漏极节点。
第二开关晶体管SWT2可在经由基准电压线RVL感测第二节点N2的电压或电流的处理中被驱动。
可通过经由基准电压线RVL进行感测来检测子像素SP上设置的驱动晶体管DRT或发光元件ED的劣化。在基于经由感测检测的劣化来执行补偿时，可防止由于子像素SP的劣化偏差导致的图像质量下降。
存储电容器Cstg可电连接在第一节点N1和第二节点N2之间。存储电容器Cstg可在一帧期间保持第一节点N1和第二节点N2之间的电压差。
驱动晶体管DRT可电连接至提供第一驱动电压EVDD的驱动电压线DVL。第一驱动电压EVDD例如可以是高电位驱动电压。
驱动晶体管DRT可由施加给第一节点N1的数据电压Vdata控制。驱动晶体管DRT可根据第一节点N1和第二节点N2的电压差来输出驱动电流，并且控制发光元件ED的驱动。
发光元件ED可电连接至第二节点N2。发光元件ED可电连接至施加第二驱动电压EVSS的电压线。第二驱动电压EVSS例如可以是低电位驱动电压。
发光元件ED可根据由驱动晶体管DRT提供的驱动电流而发光，并且呈现基于灰度级的图像。
发光元件ED在发光元件ED本应发光的时段中的部分时段中不会发光，以改善视频响应时间。
例如，当经由数据线DL提供对应于黑图像的数据电压Vdata时，驱动晶体管DRT可截止，并且发光元件ED不会发光。在这种情形下，可需要驱动栅极线GL和数据线DL以便向子像素SP提供数据电压Vdata。
本发明的实施方式可提供能够使发光元件ED不发光而不影响经由驱动晶体管DRT的栅极之中的、与被施加数据电压Vdata的栅极不同的栅极的驱动来驱动栅极线GL和数据线DL的方法。
下文中，在驱动子像素SP时控制发光元件ED不发光以便改善视频响应时间的驱动方法可被称为“非发光驱动”。此外，非发光驱动可指驱动晶体管DRT和发光元件ED处于截止状态的驱动，但是在一些情形下，可包括发光元件ED以非常低的灰度级发光的状态。
例如，子像素SP上设置的驱动晶体管DRT可包括驱动栅极GEd和控制栅极GEc。设置在多个子像素SP中的第一子像素上的第一驱动晶体管的第一控制栅极可电连接至设置在多个子像素SP中的第二子像素上的第二驱动晶体管的第二控制栅极。
驱动晶体管DRT的驱动栅极GEd可指第一节点N1或者电连接至第一节点N1的电极。驱动晶体管DRT的驱动栅极GEd可根据施加给第一节点N1的数据电压Vdata控制驱动晶体管DRT的驱动。
驱动晶体管DRT的控制栅极GEc可与驱动栅极GEd相对设置。
例如，驱动晶体管DRT的控制栅极GEc和驱动栅极GEd可位于沟道的两侧上。
驱动晶体管DRT的控制栅极GEc可使用为了防止外部光进入到驱动晶体管DRT的沟道而设置的遮光层来实现。可选地，驱动晶体管DRT的控制栅极GEc可使用分开设置的电极层来实现。
驱动晶体管DRT的控制栅极GEc可使用与被施加数据电压Vdata的驱动栅极GEd相对设置的任一个电极层来实现。
驱动晶体管DRT的控制栅极GEc可电连接至提供控制电压Vb的控制电压线CVL。
驱动晶体管DRT的阈值电压可根据施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb而改变。
图3是图解根据施加给图2所示的子像素SP上设置的驱动晶体管DRT的控制栅极GEc的控制电压Vb，驱动晶体管DRT的阈值电压的变化示例的视图。
参照图3，示出了根据施加给驱动晶体管DRT的电压输出的电流示例。
例如，如果施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb从10V降低到0V，则驱动晶体管DRT的阈值电压可增加ΔVth。
由于驱动晶体管DRT的阈值电压Vth增加，所以在将相同电压施加给驱动晶体管DRT的状态下输出的电流可减小。
可通过由驱动晶体管DRT输出的电流的减小来改变发光元件ED的驱动状态。
此外，根据驱动晶体管DRT的阈值电压的改变，驱动晶体管DRT的导通状态和截止状态可改变。
根据驱动晶体管DRT的导通状态和截止状态的改变，驱动晶体管DRT可截止，发光元件ED可以是非发光状态。由于发光元件ED在发光时段中具有非发光状态，所以可执行子像素SP的非发光驱动，并且可改善视频响应时间。
因为通过对施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb的控制来执行上述非发光驱动，所以上述非发光驱动可在不影响施加给驱动晶体管DRT的第一节点N1和第二节点N2的电压的条件下执行。
可在减小对子像素SP的显示驱动的影响的同时执行用于改善视频响应时间的非发光驱动。
图4A至4C是图解图2所示的子像素SP的驱动方法示例的视图。
参照图4A，高电平的第一扫描信号SCAN1可在帧周期FP的第一时段P1中被施加给栅极线GL。
第一开关晶体管SWT1和第二开关晶体管SWT2可由第一扫描信号SCAN1导通。
在第一开关晶体管SWT1导通时，经由数据线DL提供的数据电压Vdata可被施加给第一节点N1。在第二开关晶体管SWT2导通时，经由基准电压线RVL提供的基准电压Vref可被施加给第二节点N2。
用于子像素SP的显示驱动的电压可在第一时段P1中被施加给驱动晶体管DRT的第一节点N1和第二节点N2。第一时段P1可被称为数据写入时段WP。
参照图4B，低电平的第一扫描信号SCAN1可在帧周期FP的第二时段P2中被施加给栅极线GL。
第一开关晶体管SWT1和第二开关晶体管SWT2可由第一扫描信号SCAN1截止。
由于第一节点N1和第二节点N2浮置，第一节点N1的电压电平和第二节点N2的电压电平可增加。可由驱动晶体管DRT提供驱动电流，并且发光元件ED可发射呈现对应于数据电压Vdata的亮度的光。
第二时段P2可被称为发光时段EP。
可在发光时段EP期间执行非发光驱动。
例如，参照图4C，在帧周期FP中可包括控制时段CP。控制时段CP的至少一部分可与帧周期FP的发光时段EP交叠。控制时段CP可以是帧周期FP的一部分。图4C示出了控制时段CP是发光时段EP的一部分的示例，但是在一些情形下，控制时段CP可与数据写入时段WP交叠。
第一电平L1的控制电压Vb可在控制时段CP中被施加给驱动晶体管DRT的控制栅极GEc。
第一电平L1的控制电压Vb例如可以是能够将驱动晶体管DRT的阈值电压偏移到正方向的电平的电压。在一些情形下，在驱动晶体管DRT是P型时，第一电平L1的控制电压Vb可以是能够将驱动晶体管DRT的阈值电压偏移到负方向的电平的电压。
第一电平L1的控制电压Vb可以是能够通过改变驱动晶体管DRT的阈值电压来使驱动晶体管DRT截止的电平的电压。
驱动晶体管DRT可通过第一电平L1的控制电压Vb截止。由于驱动晶体管DRT截止，所以发光元件ED可处于非发光状态。
通过施加给驱动晶体管DRT的控制栅极GEc的第一电平L1的控制电压Vb，可在帧周期FP中容易地执行非发光驱动。
在除了帧周期FP的控制时段CP之外的时段中施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb的电平可以是不同于第一电平L1的第二电平L2。
第二电平L2的控制电压Vb可以是用以正常驱动驱动晶体管DRT而不将驱动晶体管DRT的阈值电压偏移到正方向的电平的电压。
由于控制电压Vb的电平在控制时段CP的起始时间从第二电平L2降低到第一电平L1，所以第一节点N1和第二节点N2的电压可与控制栅极GEc耦合，并略微降低。由于控制电压Vb的电平在控制时段CP的结束时间从第一电平L1上升到第二电平L2，所以第一节点N1和第二节点N2的电压可略微升高。也就是说，驱动栅极的电压电平可在施加第一电平L1的控制电压Vb的时间改变。
在控制时段CP中第一节点N1(驱动栅极)的电压电平和第二节点N2(源极或漏极)的电压电平之差可保持为与控制时段CP之前相同或相似。
第二电平L2的控制电压Vb可在除了控制时段CP之外的时段中施加给驱动晶体管DRT的控制栅极GEc。通过第二电平L2的控制电压Vb可稳定地保持驱动晶体管DRT的电流输出特性。
此外，由于施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb的电平在控制时段CP中从第二电平L2改变为第一电平L1，所以可容易地执行子像素SP的非发光驱动。
如上所述，根据本发明的实施方式，通过施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb的控制，可在不影响为了子像素SP的显示驱动而提供的电压的条件下容易地执行子像素SP的非发光驱动。
此外，由于具体电平(certain level)的控制电压Vb在不执行非发光驱动的时段中被施加给驱动晶体管DRT的控制栅极GEc，所以可改善驱动晶体管DRT的电流输出特性的稳定性。
此外，可在进一步改善驱动晶体管DRT的电流输出特性的稳定性的结构中执行子像素SP的非发光驱动。
图5是图解在根据本发明实施方式的显示装置100中包括的子像素SP的另一电路结构示例的视图。图6是图解根据图5所示的子像素SP上设置的第一控制晶体管COT1的驱动，驱动晶体管DRT的输出曲线示例的视图。图7是图解图5所示的子像素的驱动方法示例的视图。
参照图5，子像素SP可包括驱动晶体管DRT和发光元件ED。子像素SP可包括第一开关晶体管SWT1、第二开关晶体管SWT2和存储电容器Cstg。上述构造与参照图2描述的组件相同，因此将省略重复描述。
子像素SP可包括电连接在第二节点N2和第三节点N3之间的第一控制晶体管COT1。第一控制晶体管COT1可设置在多个子像素SP的每一个上。
第二节点N2可以是驱动晶体管DRT的源极节点(或漏极节点)。第三节点N3可以是连接至驱动晶体管DRT的控制栅极GEc的节点。
第一控制晶体管COT1可由被施加第二扫描信号SCAN2的栅极线GLb控制。被施加第二扫描信号SCAN2的栅极线GLb可不同于被施加第一扫描信号SCAN1的栅极线GLa。
子像素SP可包括电连接至第三节点N3的第二控制晶体管COT2。在一些情形下，第二控制晶体管COT2可位于设置有子像素SP的区域的外部。
第二控制晶体管COT2可由被施加第三扫描信号SCAN3的栅极线GLc控制。被施加第三扫描信号SCAN3的栅极线GLc可不同于被施加第一扫描信号SCAN1的栅极线GLa或被施加第二扫描信号SCAN1的栅极线GLb。
第二控制晶体管COT2可电连接至控制电压线CVL。第二控制晶体管COT2可进行控制，以将控制电压Vb施加给驱动晶体管DRT的控制栅极GEc。
在第二控制晶体管COT2位于设置有子像素SP的区域的外部的情形下，第二控制晶体管COT2可电连接至一条或多条控制电压线CVL，并且控制控制电压Vb向驱动晶体管DRT的控制栅极GEc的提供。
当第一控制晶体管COT1电连接在第二节点N2和第三节点N3之间时，第二节点N2和第三节点N3可根据第一控制晶体管COT1的驱动而电连接。驱动晶体管DTR的源极和驱动晶体管DRT的控制栅极GEc可彼此电连接。
图6示出了根据施加给驱动晶体管DRT的电压(V)而输出的电流(A)曲线示例。
参照图5和6，由于驱动晶体管DRT的源极节点和驱动晶体管DRT的控制栅极GEc根据第一控制晶体管COT1的驱动彼此电连接，所以驱动晶体管DRT的输出曲线可从①改变为②。驱动晶体管DRT的电流输出特性可稳定。
驱动晶体管DRT的电流输出特性可通过第一控制晶体管COT1和第二控制晶体管COT2稳定化，在帧周期FP中可执行非发光驱动。
参照图7，高电平的第一扫描信号SCAN1可在帧周期FP的第一时段P1中被施加给栅极线GLa。数据电压Vdata和基准电压Vref的每一个可被分别施加给第一节点N1和第二节点N2。
高电平的第二扫描信号SCAN2可在第一时段P1中被施加给栅极线GLb。在第一时段P1中施加给栅极线GLc的第三扫描信号SCAN3可以是低电平。
低电平的第一扫描信号SCAN1可在第二时段P2中被施加给栅极线GLa，发光元件ED可处于发光状态。
第二扫描信号SCAN2可在第一时段P1和一部分第二时段P2中保持高电平。当施加高电平的第二扫描信号SCAN2时，第一控制晶体管COT1可保持导通状态。
当第三扫描信号SCAN3在相应时段中保持低电平时，第二控制晶体管COT2可保持截止状态。控制电压Vb可在相应时段中保持第二电平L2。可选地，可以是在相应时段中未提供控制电压Vb的状态。
由于驱动晶体管DRT的源极和控制栅极GEc在执行显示驱动的时段中电连接，所以可稳定地保持驱动晶体管DRT的电流输出特性。
低电平的第二扫描信号SCAN2可在帧周期FP的控制时段CP中被施加给栅极线GLb。高电平的第三扫描信号SCAN3可在控制时段CP中被施加给栅极线GLc。
第一控制晶体管COT1可通过低电平的第二扫描信号SCAN2截止。第二节点N2和第三节点N3不会在控制时段CP中彼此电连接。
第二控制晶体管COT2可通过高电平的第三扫描信号SCAN3导通。第一电平L1的控制电压Vb可在控制时段CP中被施加给驱动晶体管DRT的控制栅极GEc。驱动晶体管DRT的阈值电压可改变，驱动晶体管DRT可截止。发光元件ED的非发光驱动可在控制时段CP中执行。
如上所述，通过第一控制晶体管COT1和第二控制晶体管COT2连接至第三节点N3的结构，可在稳定地保持驱动晶体管DRT的电流输出特性的同时容易地经由驱动晶体管DRT的截止来执行非发光驱动。
此外，根据本发明的实施方式，在上述结构使用其他类型的第一控制晶体管COT1和第二控制晶体管COT2来实现时，可在减少子像素SP上设置的栅极线GL的数量的同时提供能够执行非发光驱动的结构。
图8是图解根据本发明实施方式的显示装置100中包括的子像素SP的又一电路结构示例及其驱动方法示例的视图。
参照图8，子像素SP可包括电连接在第二节点N2和第三节点N3之间的第一控制晶体管COT1。子像素SP可包括电连接至第三节点N3的第二控制晶体管COT2。第二控制晶体管COT2在一些情形下可设置在设置有子像素SP的区域的外部。
例如，在如图8所示的示例中，第一控制晶体管COT1可以是P型。第二控制晶体管COT2可以是N型。
可选地，第一控制晶体管COT1可以是N型，第二控制晶体管COT2可以是P型。
第一控制晶体管COT1和第二控制晶体管COT2可由相同的栅极线GLb控制。第一控制晶体管COT1和第二控制晶体管COT2可由施加给栅极线GLb的第二扫描信号SCAN2控制。
当第一控制晶体管COT1和第二控制晶体管COT2被实现为CMOS型时，第一控制晶体管COT1和第二控制晶体管COT2可由一个扫描信号控制。
例如，低电平的第二扫描信号SCAN2可在帧周期FP的数据写入时段WP和一部分发光时段EP中被施加给栅极线GLb。
在施加低电平的第二扫描信号SCAN2的时段中，第一控制晶体管COT1可导通，第二控制晶体管COT2可截止。第二节点N2和第三节点N3可电连接。控制电压Vb不会被提供给驱动晶体管DRT的控制栅极GEc。
高电平的第二扫描信号SCAN2可在帧周期FP的控制时段CP中被施加给栅极线GLb。
在施加高电平的第二扫描信号SCAN2的时段中，第一控制晶体管COT1可截止，第二控制晶体管COT2可导通。第二节点N2和第三节点N3不会彼此电连接。第一电平L1的控制电压Vb可被提供给驱动晶体管DRT的控制栅极GEc。
在显示驱动中稳定地保持驱动晶体管DRT的电流输出特性的同时，可通过控制电压Vb执行非发光驱动。由于第一控制晶体管COT1和第二控制晶体管COT2被一条栅极线GLb驱动，所以在子像素SP上设置的信号线的数量可减少。
如上所述，本发明的实施方式通过施加给驱动晶体管DRT的控制栅极GEc的控制电压Vb的控制可容易地执行子像素SP的非发光驱动。提供控制电压Vb的控制电压线CVL可以各种形状设置在显示面板110中。非发光驱动的执行方法可根据控制电压线CVL的布置结构而不同。
图9A和9B是图解控制电压线CVL设置在根据本发明实施方式的显示装置100中的结构示例的视图。
参照图9A和9B，控制电压线CVL可被设置为连接至有源区AA上设置的两个或更多个子像素SP。
控制电压线CVL可电连接至在两个或更多个子像素SP的每一个上设置的驱动晶体管DRT的控制栅极GEc。在不同子像素SP上设置的驱动晶体管DRT的控制栅极GEc可通过控制电压线CVL彼此电连接。
控制电压线CVL可设置在一个方向上。例如，在图9A所示的示例中，控制电压线CVL可设置在与设置栅极线GL的方向(或者栅极线GL的设置方向)交叉的方向上。控制电压线CVL可设置在设置数据线DL或驱动电压线DVL的方向上，并且可电连接至子像素SP。在这种情形下，数据线DL、驱动电压线DVL、基准电压线RVL和控制电压线CVL可设置在相同方向上。
控制电压线CVL可电连接至在有源区AA的外部的提供控制电压Vb的控制电压提供线CVSL。
在如图9A所示的示例来设置控制电压线CVL的情形下，控制电压Vb可被同时提供给有源区AA上设置的所有子像素SP。可在帧周期FP中同时在所有子像素SP中执行非发光驱动。
在另一示例中，在如图9B所示的示例中，控制电压线CVL可设置在设置栅极线GL的方向上。
控制电压线CVL可电连接至位于有源区AA的外部的控制电压提供线CVSL。
在图9B所示的结构中，控制电压Vb可被同时提供给多条控制电压线CVL，并且可执行非发光驱动。
可选地，控制电压Vb可被依次提供给多条控制电压线CVL，并且可执行非发光驱动。此外，可通过以包括两条或更多条控制电压线CVL的组为单位来依次执行非发光驱动。
通过控制电压线CVL进行的依次非发光驱动可由栅极驱动电路120或者分开设置的电路来执行。当控制电压线CVL设置在设置栅极线GL的方向上并且执行非发光驱动时，即使依次执行非发光驱动，也可在不会识别到图像质量异常的条件下执行非发光驱动。
此外，根据本发明的实施方式，由于通过与驱动晶体管DRT的控制栅极GEc电连接的控制电压线CVL的控制来执行非发光驱动，所以可在不影响通过栅极线GL和数据线DL实现的显示驱动时序的条件下执行非发光驱动。
图10是图解在根据本发明实施方式的显示装置100中设置的栅极线GL和控制电压线CVL的驱动时序示例的视图。
图11A是图解根据由图10所示的1001表示的栅极线GL所驱动的子像素SP的驱动得到的电压波形示例的视图。图11B是图解根据由图10所示的1002表示的栅极线GL所驱动的子像素SP的驱动得到的电压波形示例的视图。
参照图10，可从第一栅极线GL(1)至第n栅极线GL(n)依次施加扫描信号，可执行显示驱动。
控制电压Vb可在发光时段EP中保持具体电平。控制电压Vb的电平可以是不改变驱动晶体管DRT的阈值电压的电平，或者不使驱动晶体管DRT截止的电平。可选地，在一些情形下，在发光时段EP中可不提供控制电压Vb。
控制电压Vb可被改变为使得驱动晶体管DRT的阈值电压偏移的电平。图10所示的示例示出了控制电压Vb的电平在控制时段CP中降低的示例，但是根据驱动晶体管DRT的类型，控制电压Vb的电平可在控制时段CP中升高。
驱动晶体管DRT可通过驱动晶体管DRT的阈值电压的偏移而截止。
当驱动晶体管DRT截止时，在控制时段CP中由驱动晶体管DRT驱动的发光元件ED可处于非发光状态。通过控制电压Vb的控制可在原本的发光时段中容易地执行非发光驱动，并且可改善基于子像素SP的驱动的视频响应时间。
此外，由于用于非发光驱动的控制电压Vb被施加给驱动晶体管DRT的控制栅极GEc，所以其不会影响施加给驱动晶体管DRT的第一节点N1和第二节点N2的电压，由此可独立于非发光驱动来执行子像素SP的驱动。
参照图11A，其示出了由第一栅极线GL(1)驱动的子像素SP的电压波形示例。
高电平的第一扫描信号SCAN1可在数据写入时段WP中被施加给子像素SP。数据电压Vdata被施加给第一节点N1，并且基准电压Vref可被施加给第二节点N2。
当第一扫描信号SCAN1改变为低电平时，第一节点N1和第二节点N2的电压可升高，驱动晶体管DRT可输出驱动电流。在数据写入时段WP之后，可以是发光元件ED发光的发光时段EP。
可在控制时段CP中施加低电平的控制电压Vb。当施加控制电压Vb时，第一节点N1和第二节点N2的电压电平可略微降低。第一节点N1的电压电平和第二节点N2的电压电平之差可在控制时段CP中保持不变。
当驱动晶体管DRT的阈值电压在控制时段CP中通过控制电压Vb偏移时，驱动晶体管DRT和发光元件ED可截止，可执行非发光驱动。
在控制时段CP之后，控制电压Vb可变为高电平。当控制电压Vb的电平改变时，第一节点N1和第二节点N2的电压电平可略微升高。
驱动晶体管DRT的阈值电压可通过控制电压Vb的电平变化而改变，驱动晶体管DRT可导通。当第一节点N1和第二节点N2之间的电压电平差保持不变时，驱动电流可通过驱动晶体管DRT被提供给发光元件ED，发光元件ED可导通。
可在施加低电平的控制电压Vb的控制时段CP中执行向第一节点N1和第二节点N2的电压施加。
参照图11B，其示出了由第(n-2)栅极线GL(n-2)驱动的子像素SP的电压波形示例。
数据写入时段WP的至少一部分可与控制时段CP交叠。高电平的第一扫描信号SCAN1可在数据写入时段WP中被提供给子像素SP。同时，低电平的控制电压Vb可被提供给子像素SP。
当控制电压Vb被施加给驱动晶体管DRT的控制栅极GEc时，数据电压Vdata和基准电压Vref的每一个可被分别施加给第一节点N1和第二节点N2。可在执行非发光驱动的时段中对子像素SP执行数据写入。
第一节点N1和第二节点N2的电压可在控制电压Vb改变为低电平的时间略微降低。第一节点N1的电压电平和第二节点N2的电压电平之差可保持为与根据在数据写入时段WP中提供的数据电压Vdata和基准电压Vref而得到的差相同或相似。
由于通过低电平的控制电压Vb使驱动晶体管DRT的阈值电压发生偏移，所以驱动晶体管DRT不会导通，可执行非发光驱动。
在控制时段CP之后，高电平的控制电压Vb可被提供给子像素SP。
第一节点N1和第二节点N2的电压电平可升高，驱动晶体管DRT可导通。发光元件ED可根据经由驱动晶体管DRT提供的驱动电流而导通，并且可被驱动。
如上所述，由于可独立于显示驱动来执行非发光驱动，所以可在不会基于非发光驱动而减少或改变显示驱动时段的条件下执行显示驱动和非发光驱动。
此外，执行非发光驱动的时间可根据控制电压线CVL的布置结构和驱动方法而不同。
图12A和12B是图解在根据本发明实施方式的显示装置100中设置的栅极线GL和控制电压线CVL的其他驱动时序示例的视图。
参照图12A，在控制电压线CVL设置在设置栅极线GL的方向上的情形下，可通过控制电压线CVL依次执行非发光驱动。
例如，由第一控制电压线CVL(1)进行的非发光驱动可在由第一栅极线GL(1)驱动子像素SP时在控制时段CP中执行。在将扫描信号施加给多条栅极线中的第一栅极线的时段中施加给多个驱动晶体管中的至少一个驱动晶体管的控制栅极的控制电压的电平可不同于在将扫描信号施加给多条栅极线中的第二栅极线的时段中施加给至少一个驱动晶体管的控制栅极的控制电压的电平。
控制电压线CVL可设置在设置栅极线GL的方向上，并且可依次执行显示驱动和非发光驱动。
可选地，即使在控制电压线CVL设置在设置栅极线GL的方向上的情形下，两条或更多条控制电压线CVL也可同时驱动，即，第一电平L1的控制电压Vb可被同时施加给多个驱动晶体管中的至少两个驱动晶体管的每一个的控制栅极，并且可执行非发光驱动。
例如，参照图12B，可从第一栅极线GL(1)至第四栅极线GL(4)依次驱动栅极线GL。低电平的控制电压Vb可在向第四栅极线GL(4)提供扫描信号的时间同时提供给第一控制电压线至第四控制电压线CVL(1-4)。
由于施加低电平的控制电压Vb的时段可独立于施加扫描信号的时段，所以可在向第一栅极线GL(1)至第四栅极线GL(4)的任意一条施加扫描信号的时段中施加低电平的控制电压Vb。
可通过以由四条控制电压线CVL驱动的组为单位来执行非发光驱动。
此外，除了上述方法之外，可在独立于提供扫描信号的时段的各种时段中提供控制电压Vb，可同时或依次执行非发光驱动。
上述本发明的实施方式将简要描述如下。
根据本发明实施方式的显示装置100可包括：显示面板110，在所述显示面板中设置多条栅极线GL、多条数据线DL和多个子像素SP；多个发光元件ED，所述发光元件设置在所述多个子像素SP的每一个上；以及多个驱动晶体管DRT，所述驱动晶体管被配置为驱动所述多个发光元件ED的每一个并且包括驱动栅极GEd和与所述驱动栅极GEd相对设置且电连接至控制电压线CVL的控制栅极GEc。
在作为帧周期FP的一部分的控制时段CP中，第一电平L1的控制电压Vb可被施加给所述多个驱动晶体管DRT中的至少一个驱动晶体管DRT的控制栅极GEc，所述至少一个驱动晶体管DRT可在所述控制时段CP中截止。
在所述控制时段CP中，扫描信号可被施加给用于驱动其上设置有所述至少一个驱动晶体管DRT的子像素SP的栅极线GL。
在所述帧周期FP的除了所述控制时段CP之外的时段中，不同于所述第一电平L1的第二电平L2的控制电压Vb可被施加给所述至少一个驱动晶体管DRT的控制栅极GEc。
施加所述第二电平L2的控制电压Vb的时段的至少一部分可与所述帧周期FP的发光时段EP交叠。
所述控制电压线CVL可设置在设置所述多条数据线DL的方向上，并且所述第一电平L1的控制电压Vb可被同时施加给所述多个驱动晶体管DRT的每一个的控制栅极GEc。
可选地，所述控制电压线CVL可设置在设置所述多条栅极线GL的方向上，并且所述第一电平L1的控制电压Vb可被依次施加给所述多个驱动晶体管DRT的每一个的控制栅极GEc。
可选地，所述控制电压线CVL可设置在设置所述多条栅极线GL的方向上，并且所述第一电平L1的控制电压Vb可被同时施加给所述多个驱动晶体管DRT中的至少两个驱动晶体管DRT的每一个的控制栅极GEc。
所述控制电压线CVL可电连接至控制电压提供线CVSL，所述控制电压提供线设置在设置有所述多个子像素SP的区域的外部。
设置在所述多个子像素SP中的第一子像素上的第一驱动晶体管的第一控制栅极可电连接至设置在所述多个子像素SP中的第二子像素上的第二驱动晶体管的第二控制栅极。
所述显示装置100还可包括：第一控制晶体管COT1，所述第一控制晶体管被配置为电连接在所述多个驱动晶体管DRT的每一个的控制栅极GEc和源极之间；以及第二控制晶体管COT2，所述第二控制晶体管被配置为电连接至在所述控制栅极GEc和所述第一控制晶体管COT1之间的节点，并且控制所述控制电压Vb向所述控制栅极GEc的提供。
所述第一控制晶体管COT1可在所述第二控制晶体管COT2处于导通状态的时段中处于截止状态。
所述第二控制晶体管COT2可在所述第一控制晶体管COT1处于导通状态的时段中处于截止状态。
所述第一控制晶体管COT1可以是N型并且所述第二控制晶体管COT2可以是P型。可选地，所述第一控制晶体管COT1可以是P型并且所述第二控制晶体管COT2可以是N型。
所述第一控制晶体管COT1和所述第二控制晶体管COT2可由相同的栅极线GL控制。
所述第一控制晶体管COT1可设置在所述多个子像素SP的每一个上，所述第二控制晶体管COT2可设置在设置有所述多个子像素SP的区域的外部。
所述驱动栅极GEd的电压电平可在施加所述第一电平L1的控制电压Vb的时间改变。
所述至少一个驱动晶体管DRT的驱动栅极GEd的电压电平和所述至少一个驱动晶体管DRT的源极的电压电平之差在所述控制时段CP期间保持不变。
根据本发明实施方式的显示装置100可包括：显示面板110，在所述显示面板中设置多条栅极线GL、多条数据线DL和多个子像素SP；以及多个驱动晶体管DRT，所述驱动晶体管设置在所述多个子像素SP的每一个上并且包括驱动栅极GEd和与所述驱动栅极GEd相对设置且电连接至控制电压线CVL的控制栅极GEc，其中在将扫描信号施加给所述多条栅极线GL中的第一栅极线的时段中施加给所述多个驱动晶体管DRT中的至少一个驱动晶体管DRT的控制栅极GEc的控制电压Vb的电平不同于在将扫描信号施加给所述多条栅极线GL中的第二栅极线的时段中施加给所述至少一个驱动晶体管DRT的控制栅极GEc的控制电压Vb的电平。
根据上述本发明的实施方式，通过施加给与驱动晶体管DRT的驱动栅极GEd相对设置的控制栅极GEc的控制电压Vb的控制，可使驱动晶体管DRT的阈值电压偏移。
由此，可容易地控制驱动晶体管DRT的导通状态和截止状态，可在显示驱动中执行非发光驱动，可改善子像素SP的视频响应时间。
此外，由于通过施加给驱动晶体管DRT的与栅极节点或源极节点分离设置的控制栅极GEc的控制电压Vb的控制来执行非发光驱动，所以可独立于施加扫描信号的时段来执行非发光驱动。
因此，根据本发明的实施方式，可提供在不影响显示驱动时序的条件下可容易地执行非发光驱动的显示装置100。
给出了上述描述以使得所属领域的任何普通技术人员能够获取并且使用本发明的技术构思，并且上述描述是在具体应用及其需求的环境下提供的。对于所属领域的技术人员来说，对于所描述的实施方式的各种修改、添加和替代是很清楚的，并且在不脱离本发明的精神和范围的条件下，本文限定的大致原理可应用于其他实施方式和应用。上述描述和附图仅为了例示的目的提供了本发明的技术构思的示例。也就是说，所公开的实施方式旨在例示本发明的技术构思的范围。因此，本发明的范围不限于示出的实施方式，而是与权利要求书一致的最宽范围。应当基于所附权利要求书解释本发明的保护范围，其等同范围内的所有技术构思都应当解释为包含在本发明的范围内。

Claims (18)

1.一种显示装置，包括：
显示面板，所述显示面板包括多条栅极线、多条数据线和多个子像素；
多个发光元件，所述发光元件设置在所述多个子像素上；以及
多个驱动晶体管，所述驱动晶体管被配置为驱动所述多个发光元件，所述多个驱动晶体管的每一个包括驱动栅极和与所述驱动栅极相对设置且电连接至控制电压线的控制栅极，
其中在作为帧周期的一部分的控制时段中，第一电平的控制电压被施加给所述多个驱动晶体管中的至少一个驱动晶体管的控制栅极，所述至少一个驱动晶体管在所述控制时段中截止。
2.根据权利要求1所述的显示装置，其中在所述控制时段中，扫描信号被施加给用于驱动所述多个子像素中的、其上设置有所述至少一个驱动晶体管的子像素的栅极线。
3.根据权利要求1所述的显示装置，其中在所述帧周期的除了所述控制时段之外的时段中，不同于所述第一电平的第二电平的控制电压被施加给所述至少一个驱动晶体管的控制栅极。
4.根据权利要求3所述的显示装置，其中施加所述第二电平的控制电压的时段的至少一部分与所述帧周期的发光时段交叠。
5.根据权利要求1所述的显示装置，其中所述控制电压线设置在设置所述多条数据线的方向上，并且所述第一电平的控制电压被同时施加给所述多个驱动晶体管的每一个的控制栅极。
6.根据权利要求1所述的显示装置，其中所述控制电压线设置在设置所述多条栅极线的方向上，并且所述第一电平的控制电压被依次施加给所述多个驱动晶体管的每一个的控制栅极。
7.根据权利要求1所述的显示装置，其中所述控制电压线设置在设置所述多条栅极线的方向上，并且所述第一电平的控制电压被同时施加给所述多个驱动晶体管中的至少两个驱动晶体管的每一个的控制栅极。
8.根据权利要求1所述的显示装置，其中所述控制电压线电连接至控制电压提供线，所述控制电压提供线设置在设置有所述多个子像素的区域的外部。
9.根据权利要求1所述的显示装置，其中所述多个驱动晶体管中的、设置在所述多个子像素中的第一子像素上的第一驱动晶体管的第一控制栅极电连接至所述多个驱动晶体管中的、设置在所述多个子像素中的第二子像素上的第二驱动晶体管的第二控制栅极。
10.根据权利要求1所述的显示装置，还包括：
第一控制晶体管，所述第一控制晶体管被配置为电连接在所述多个驱动晶体管的每一个的控制栅极和源极之间；以及
第二控制晶体管，所述第二控制晶体管被配置为电连接至在所述控制栅极和所述第一控制晶体管之间的节点，并且控制所述控制电压向所述控制栅极的提供。
11.根据权利要求10所述的显示装置，其中所述第一控制晶体管在所述第二控制晶体管处于导通状态的时段中处于截止状态。
12.根据权利要求10所述的显示装置，其中所述第二控制晶体管在所述第一控制晶体管处于导通状态的时段中处于截止状态。
13.根据权利要求10所述的显示装置，其中所述第一控制晶体管是N型晶体管并且所述第二控制晶体管是P型晶体管，或者所述第一控制晶体管是P型晶体管并且所述第二控制晶体管是N型晶体管。
14.根据权利要求13所述的显示装置，其中所述第一控制晶体管和所述第二控制晶体管由相同的栅极线控制。
15.根据权利要求10所述的显示装置，其中所述第一控制晶体管设置在所述多个子像素的每一个上，所述第二控制晶体管设置在设置有所述多个子像素的区域的外部。
16.根据权利要求1所述的显示装置，其中所述驱动栅极的电压电平在施加所述第一电平的控制电压的时间改变。
17.根据权利要求1所述的显示装置，其中所述至少一个驱动晶体管的驱动栅极的电压电平和所述至少一个驱动晶体管的源极的电压电平之差在所述控制时段期间保持不变。
18.一种显示装置，包括：
显示面板，所述显示面板包括多条栅极线、多条数据线和多个子像素；以及
多个驱动晶体管，所述驱动晶体管设置在所述多个子像素上，并且所述多个驱动晶体管的每一个包括驱动栅极和与所述驱动栅极相对设置且电连接至控制电压线的控制栅极，
其中在将扫描信号施加给所述多条栅极线中的第一栅极线的时段中施加给所述多个驱动晶体管中的至少一个驱动晶体管的控制栅极的控制电压的电平不同于在将扫描信号施加给所述多条栅极线中的第二栅极线的时段中施加给所述至少一个驱动晶体管的控制栅极的控制电压的电平。
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