CN115424571A - 电源电路、显示面板和显示装置 - Google Patents
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Abstract
本申请提供了一种电源电路、显示面板和显示装置。所述电源电路包括负压子电路，用于产生第一输出电压，并通过第一电压输出端输出第一输出电压；升压子电路，用于输出第二输出电压；分压电路，用于对负压子电路输出的第一输出电压进行分压；放大子电路，用于将分压电路产生的电压与参考电压端输出的参考电压进行比较得到第三输出电压，并将第三输出电压进行放大后传输给滤波子电路；滤波子电路，用于将放大后的第三输出电压进行滤波稳压传输给延迟子电路；延迟子电路，用于延迟将滤波子电路传输的第三输出电压传输给第一开关子电路；第一开关子电路，用于根据滤波子电路传输的第三输出电压导通，并将电流源的电压传输给第二开关子电路。
Description
技术领域
本申请涉及显示技术领域，尤其涉及一种电源电路、一种具有该电源电路的显示面板和一种具有该显示面板的显示装置。
背景技术
目前，在显示屏幕常用的驱动框架中，通常都是采用时序控制芯片提供控制信号和画面数据，电源芯片提供工作电源，数据驱动芯片接收数据并驱动显示屏幕进行显示。
然而，现在的显示屏幕在刚开机时容易出现闪白线，即显示屏幕上出现白线，造成显示异常，从而影响用户的观看感受和使用体验。
发明内容
鉴于上述现有技术的不足，本申请的目的在于提供一种电源电路，解决的屏幕容易在刚开机时出现闪白线的问题，以提高用户的观看感受和使用体验。
为解决上述技术问题，本申请提供一种电源电路，其包括：负压子电路，与第一电压输出端以及分压电路电性连接，用于产生第一输出电压，并通过所述第一电压输出端输出所述第一输出电压；升压子电路，用于输出第二输出电压；所述分压电路，与放大子电路以及所述第一电压输出端电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压；所述放大子电路，与参考电压端、滤波子电路以及延迟子电路电性连接，用于将所述分压电路产生的电压与所述参考电压端输出的参考电压进行比较得到第三输出电压，并将所述第三输出电压进行放大后传输给所述滤波子电路；所述滤波子电路，与所述延迟子电路电性连接，用于将放大后的所述第三输出电压进行滤波稳压传输给所述延迟子电路；所述延迟子电路，与第一开关子电路电性连接，用于延迟将所述滤波子电路传输的所述第三输出电压传输给所述第一开关子电路；所述第一开关子电路，与电流源以及第二开关子电路电性连接，用于根据所述滤波子电路传输的所述第三输出电压导通，并将所述电流源的电压传输给所述第二开关子电路。
在示例性实施方式中，所述第二开关子电路与升压晶体管以及第二电压输出端电性连接，用于根据所述电流源的电压导通，并通过所述第二电压输出端输出第二输出电压。
在示例性实施方式中，所述分压电路包括第一分压子电路和第二分压子电路，其中，所述第一分压子电路与所述第二分压子电路以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压；所述第二分压子电路与所述负压子电路、所述第一电压输出端以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压。
在示例性实施方式中，所述第一分压子电路包括第一电阻，所述第一电阻的一端与所述第二分压子电路以及所述放大子电路电性连接，所述第一电阻的另一端接地，用于对所述负压子电路输出的所述第一输出电压进行分压；所述第二分压子电路包括第二电阻，所述第二电阻与所述负压子电路、所述第一电压输出端、所述第一电阻以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压。
在示例性实施方式中，所述放大子电路包括放大器，所述放大器的同相输入端用于输入所述参考电压端输出的所述参考电压，所述放大器的反相输入端电性连接于所述第一电阻和所述第二电阻之间，用于接收所述分压电路产生的电压，所述放大器的输出端与所述滤波子电路以及所述延迟子电路电性连接。
在示例性实施方式中，所述滤波子电路包括第三电阻和电容，其中，所述第三电阻的一端与所述放大器的输出端以及所述延迟子电路电性连接，所述第三电阻的另一端与所述电容的一端电性连接，所述电容的另一端接地，所述第三电阻与所述电容均用于将放大后的所述第三输出电压进行滤波稳压得到稳定的放大后的所述第三输出电压，并将稳定的放大后的所述第三输出电压传输给所述延迟子电路。
在示例性实施方式中，所述第一开关子电路包括第一开关晶体管，所述第一开关晶体管的栅极与所述延迟子电路电性连接，所述第一开关晶体管的源极与所述电流源电性连接，所述第一开关晶体管的漏极与所述第二开关子电路电性连接，用于将所述电流源的电压传输给所述第二开关子电路。
在示例性实施方式中，所述第二开关子电路包括第二开关晶体管，所述第二开关晶体管的栅极与所述第一开关晶体管的漏极电性连接，所述第二开关晶体管的漏极与所述第二电压输出端电性连接，所述第二开关晶体管的源极通过所述升压晶体管和电感与电压输入端电性连接，用于根据所述电流源的电压导通输出所述第二输出电压。
综上所述，所述电源电路中，所述延迟子电路到达预设的延迟时间后，所述第一开关晶体管的栅极接收到所述延迟子电路传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管的栅极电压下降到所述第一开关晶体管的第一开启电压时，所述第一开关晶体管导通，所述第二开关晶体管通过所述第一开关晶体管与所述电流源电性导通，将所述电流源的电压传输给所述第二开关晶体管，所述第二开关晶体管的栅极接收所述电流源的电压，当所述第二开关晶体管的下降到所述第二开关晶体管的第二开启电压时，所述第二开关晶体管导通，此时所述第二输出电压才可以通过第二电压输出端输出，从而保证所述第一输出电压到达预设电压时，所述第二输出电压才开始输出，从而实现了所述第一输出电压控制所述第二输出电压输出的目标，进而避免了所述第一输出电压和所述第二输出电压产生重叠区，防止屏幕出现闪白线。
基于同样的发明构思，本申请还提供一种显示面板，其包括时序控制电路和上述的电源电路，其中，所述时序控制电路用于提供控制信号和画面数据，所述电源电路用于为所述显示面板提供工作电源。
综上所述，所述显示面板中，所述延迟子电路到达预设的延迟时间后，所述第一开关晶体管的栅极接收到所述延迟子电路传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管的栅极电压下降到所述第一开关晶体管的第一开启电压时，所述第一开关晶体管导通，所述第二开关晶体管通过所述第一开关晶体管与所述电流源电性导通，将所述电流源的电压传输给所述第二开关晶体管，所述第二开关晶体管的栅极接收所述电流源的电压，当所述第二开关晶体管的下降到所述第二开关晶体管的第二开启电压时，所述第二开关晶体管导通，此时所述第二输出电压才可以通过第二电压输出端输出，从而保证所述第一输出电压到达预设电压时，所述第二输出电压才开始输出，从而实现了所述第一输出电压控制所述第二输出电压输出的目标，进而避免了所述第一输出电压和所述第二输出电压产生重叠区，防止屏幕出现闪白线。
基于同样的发明构思，本申请还提供一种显示装置，其包括上述的显示面板。
综上所述，所述显示装置中，所述延迟子电路到达预设的延迟时间后，所述第一开关晶体管的栅极接收到所述延迟子电路传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管的栅极电压下降到所述第一开关晶体管的第一开启电压时，所述第一开关晶体管导通，所述第二开关晶体管通过所述第一开关晶体管与所述电流源电性导通，将所述电流源的电压传输给所述第二开关晶体管，所述第二开关晶体管的栅极接收所述电流源的电压，当所述第二开关晶体管的下降到所述第二开关晶体管的第二开启电压时，所述第二开关晶体管导通，此时所述第二输出电压才可以通过第二电压输出端输出，从而保证所述第一输出电压到达预设电压时，所述第二输出电压才开始输出，从而实现了所述第一输出电压控制所述第二输出电压输出的目标，进而避免了所述第一输出电压和所述第二输出电压产生重叠区，防止屏幕出现闪白线。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图是本申请的一些实施例，对于本领普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例公开的一种显示面板的结构示意图；
图2为本申请实施例一提供的一种电源电路的时序图；
图3为本申请实施例二提供的一种电源电路的电路示意图；
图4为图3所示电源电路的电路结构示意图；
图5为图4所示的电源电路的时序图。
附图标记说明：
100-显示面板；110-控制模块；130-数据驱动模块；150-显示屏幕；111-时序控制电路；113-电源电路；151-白线；210-升压子电路；220-逻辑电压子电路；240-负压子电路；250-第一分压子电路；260-第二分压子电路；270-放大子电路；280-滤波子电路；290-延迟子电路；310-第一开关子电路；330-电流源；410-第二开关子电路；430-电压输入端；450-第一电压输出端；460-参考电压端；470-第二电压输出端；271-放大器；L1-电感；D1-升压晶体管；R1-第一电阻；R2-第二电阻；R3-第三电阻；C1-电容；T1-第一开关晶体管；T2-第二开关晶体管；Vin-输入电压；VDD-逻辑电压；VGL-第一输出电压；VAA-第二输出电压；Vref-参考电压；Vth1-第一开启电压；Vth2-第二开启电压。
具体实施方式
为了便于理解本申请，下面将参照相关附图对本申请进行更全面的描述。附图中给出了本申请的较佳实施方式。但是，本申请可以以许多不同的形式来实现，并不限于本文所描述的实施方式。相反地，提供这些实施方式的目的是使对本申请的公开内容理解的更加透彻全面。
以下各实施例的说明是参考附加的图示，用以例示本申请可用以实施的特定实施例。本文中为部件所编序号本身，例如“第一”、“第二”等，仅用于区分所描述的对象，不具有任何顺序或技术含义。而本申请所说“连接”、“联接”，如无特别说明，均包括直接和间接连接(联接)。本申请中所提到的方向用语，例如，“上”、“下”、“前”、“后”、“左”、“右”、“内”、“外”、“侧面”等，仅是参考附加图式的方向，因此，使用的方向用语是为了更好、更清楚地说明及理解本申请，而不是指示或暗指所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。
在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸地连接，或者一体地连接；可以是机械连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通。对于本领域的普通技术人员而言，可以具体情况理解上述术语在本申请中的具体含义。需要说明的是，本申请的说明书和权利要求书及附图中的术语“第一”、“第二”等是用于区别不同对象，而不是用于描述特定顺序。
此外，本申请中使用的术语“包括”、“可以包括”、“包含”、或“可以包含”表示公开的相应功能、操作、元件等的存在，并不限制其他的一个或多个更多功能、操作、元件等。此外，术语“包括”或“包含”表示存在说明书中公开的相应特征、数目、步骤、操作、元素、部件或其组合，而并不排除存在或添加一个或多个其他特征、数目、步骤、操作、元素、部件或其组合，意图在于覆盖不排他的包含。此外，当描述本申请的实施方式时，使用“可”表示“本申请的一个或多个实施方式”。并且，用语“示例性的”旨在指代示例或举例说明。
除非另有定义，本文所使用的所有的技术和科学术语与属于本申请的技术领域的技术人员通常理解的含义相同。本文中在本申请的说明书中所使用的术语只是为了描述具体的实施方式的目的，不是旨在于限制本申请。
本申请实施例希望提供一种能够解决上述技术问题的电源电路、显示面板和显示装置的技术方案，从而能够解决屏幕容易在刚开机时出现闪白线的问题，以提高用户的观看感受和使用体验。其详细内容将在后续实施例中得以阐述。
请参阅图1，其为本申请实施例公开的一种显示面板的结构示意图。如图1所示，本申请提供一种显示面板100，其至少可以包括控制模块110、数据驱动模块130以及显示屏幕150，其中，所述控制模块110与所述数据驱动模块130电性连接，所述数据驱动模块130与所述显示屏幕150电性连接。
在本申请实施方式中，所述控制模块110包括时序控制电路111和电源电路113，其中，所述时序控制电路111和所述电源电路113均与所述数据驱动模块130电性连接。所述时序控制电路111用于提供控制信号和画面数据，并将所述控制信号和所述画面数据传输给所述数据驱动模块130。
在本申请实施方式中，所述时序控制电路111可为时序控制器(TimingController，TCON)。
所述电源电路113用于为所述显示面板100提供工作电源。
在本申请实施方式中，所述电源电路113可为脉冲宽度调制(Pulse widthmodulation，PWM)电源。
所述数据驱动模块130用于接收所述时序控制电路111传输的所述控制信号和所述画面数据，并通过所述控制信号产生驱动信号驱动所述显示屏幕150根据所述画面数据进行显示。
在本申请实施方式中，所述数据驱动模块130可为数据驱动芯片(SourceDriver)。
所述显示屏幕150用于根据所述画面数据进行显示。在所述显示面板100刚开机时，所述显示屏幕150出现白线151，从而影响用户的观感。
在本申请实施方式中，所述显示屏幕150可为液晶显示屏。
请一并参阅图2，其为本申请实施例一提供的一种电源电路的时序图。如图2所示，当输入电压Vin到来时，逻辑电压VDD先产生，随后同时产生第一输出电压VGL和第二输出电压VAA，则第一输出电压VGL和第二输出电压VAA在t时间段内产生一段重叠区，在t时间段内，所述数据驱动模块130开始输出电压，但由于第一输出电压VGL还未稳定，所述显示屏幕150内的薄膜晶体管(Thin Film Transistor，TFT)没有完全关闭，造成所述驱动信号会被充电至所述显示屏幕150，导致所述显示屏幕150显示异常出现白线151。
请参阅图3，其为本申请实施例二提供的一种电源电路的电路示意图。如图3所示，本申请提供的电源电路113至少可以包括升压子电路210、逻辑电压子电路220、负压子电路240、第一分压子电路250、第二分压子电路260、放大子电路270、滤波子电路280、延迟子电路290、第一开关子电路310以及电流源330。
其中，所述升压子电路210与电感L1以及升压晶体管D1电性连接，用于升压。在本申请实施例中，所述升压晶体管D1可为二极管。
在本申请实施方式中，所述升压子电路210、电感L1以及升压晶体管D1构成升压回路输出第二输出电压VAA。
所述逻辑电压子电路220与电压输入端430电性连接，用于提供逻辑电压。
所述负压子电路240与所述电压输入端430、第一电压输出端450以及所述第二分压子电路260电性连接，所述负压子电路240用于产生第一输出电压VGL，并通过所述第一电压输出端450输出所述第一输出电压VGL。
所述第一分压子电路250与所述第二分压子电路260以及所述放大子电路270电性连接，所述第一分压子电路250用于对所述负压子电路240输出的第一输出电压VGL进行分压。其中，在所述第一分压子电路250对所述负压子电路240输出的第一输出电压VGL进行分压后，位于所述第一分压子电路250与所述第二分压子电路260之间(例如中点位置)，并与所述放大子电路270电性连接的点FB得到FB点电压，也即为，所述第一分压子电路250与所述第二分压子电路260构成的分压电路产生的电压。
所述第二分压子电路260与所述负压子电路240、所述第一电压输出端450、所述第一分压子电路250以及所述放大子电路270电性连接，所述第二分压子电路260用于对所述负压子电路240输出的第一输出电压VGL进行分压。
在本申请实施方式中，所述第一分压子电路250与所述第二分压子电路260构成分压电路，用于对所述负压子电路240输出的第一输出电压VGL进行分压。
所述放大子电路270与所述第一分压子电路250、所述第二分压子电路260、参考电压端460、所述滤波子电路280以及所述延迟子电路290电性连接，所述放大子电路270用于将所述FB点电压与所述参考电压端460输出的参考电压Vref进行比较得到第三输出电压，并将所述第三输出电压进行放大，并将放大后的所述第三输出电压传输给所述滤波子电路280。
所述滤波子电路280与所述放大子电路270以及所述延迟子电路290电性连接，所述滤波子电路280用于将放大后的所述第三输出电压进行滤波稳压得到稳定的放大后的所述第三输出电压，并将稳定的放大后的所述第三输出电压传输给所述延迟子电路290。在本申请实施例中，所述滤波子电路280可为低通滤波器电路。
所述延迟子电路290与所述放大子电路270、所述滤波子电路280以及所述第一开关子电路310电性连接，所述延迟子电路290用于延迟将所述滤波子电路280传输的稳定的放大后的所述第三输出电压传输给所述第一开关子电路310。
所述第一开关子电路310与所述延迟子电路290、所述电流源330以及第二开关子电路410电性连接，所述第一开关子电路310用于根据所述滤波子电路280传输的稳定的放大后的所述第三输出电压导通或关断，并将所述电流源330的电压传输给所述第二开关子电路410。
所述第二开关子电路410与所述第一开关子电路310、所述升压晶体管D1以及第二电压输出端470电性连接，所述第二开关子电路410用于根据所述电流源330的电压导通，并通过所述第二电压输出端470输出第二输出电压VAA。
请参见图4，图4为图3所示电源电路的电路结构示意图。如图4所示，本申请提供的电源电路113中的所述第一分压子电路250包括第一电阻R1，所述第一电阻R1的一端与所述第二分压子电路260以及所述放大子电路270电性连接，所述第一电阻R1的另一端接地，所述第一电阻R1用于对所述负压子电路240输出的第一输出电压VGL进行分压。
所述第二分压子电路260包括第二电阻R2，所述第二电阻R2与所述负压子电路240、所述第一电压输出端450、所述第一电阻R1以及所述放大子电路270电性连接，所述第二电阻R2用于对所述负压子电路240输出的第一输出电压VGL进行分压。
所述放大子电路270包括放大器271，所述放大器271的同相输入端用于输入所述参考电压端460输出的参考电压Vref，所述放大器271的反相输入端电性连接于所述第一电阻R1和所述第二电阻R2之间，用于接收所述FB点电压，所述放大器271的输出端与所述滤波子电路280以及所述延迟子电路290电性连接。所述放大器271用于将FB点电压与所述参考电压端460输出的参考电压Vref进行比较得到第三输出电压，并将所述第三输出电压进行放大，将放大后的所述第三输出电压传输给所述滤波子电路280。其中，所述FB点电压＝-VGL*R1/(R1+R2)。
在本申请实施方式中，所述放大器271可为运算放大器(Operational Amplifier，OP)。
所述滤波子电路280包括第三电阻R3和电容C1，其中，所述第三电阻R3的一端与所述放大器271的输出端以及所述延迟子电路290电性连接，所述第三电阻R3的另一端与所述电容C1的一端电性连接，所述电容C1的另一端接地。所述第三电阻R3与所述电容C1均用于将放大后的所述第三输出电压进行滤波稳压得到稳定的放大后的所述第三输出电压，并将稳定的放大后的所述第三输出电压传输给所述延迟子电路290。
所述第一开关子电路310包括第一开关晶体管T1，所述第一开关晶体管T1的栅极与所述延迟子电路290电性连接，所述第一开关晶体管T1的源极与所述电流源330电性连接，所述第一开关晶体管T1的漏极与所述第二开关子电路410电性连接，用于将所述电流源330的电压传输给所述第二开关子电路410。所述第一开关晶体管T1的栅极接收所述延迟子电路290传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管T1的栅极电压下降到所述第一开关晶体管T1的第一开启电压Vth1时，所述第一开关晶体管T1导通，所述第二开关子电路410通过所述第一开关晶体管T1与所述电流源330电性连接，将所述电流源330的电压传输给所述第二开关子电路410。
所述第二开关子电路410包括第二开关晶体管T2，所述第二开关晶体管T2的栅极与所述第一开关晶体管T1的漏极电性连接，所述第二开关晶体管T2的漏极与所述第二电压输出端470电性连接，所述第二开关晶体管T2的源极与所述升压晶体管D1电性连接，用于根据所述电流源330的电压导通输出第二输出电压VAA。所述第二开关晶体管T2的栅极接收所述电流源330的电压，当所述第二开关晶体管T2的下降到所述第二开关晶体管T2的第二开启电压Vth2时，所述第二开关晶体管T2导通，所述第二输出电压VAA通过所述第二电压输出端470输出。
在本申请实施方式中，所述升压子电路210、电感L1以及升压晶体管D1构成升压回路输出第二输出电压VAA。
对应图4所示的电源电路的时序图如图5所示，具体地，选取如图5所示的时序图中的t1、t2和t3的三个阶段。图5所示的电源电路的时序图的详细内容将在后续实施例中得以说明。
在t1阶段，当开机后，即当输入电压Vin到来时，逻辑电压VDD先产生，所述第一输出电压VGL和所述第二输出电压VAA未产生。
在t2阶段，所述第一输出电压VGL开始产生，并从0V逐渐下降，所述FB点电压也逐渐下降，所述第一电阻R1和所述第二电阻R2对所述负压子电路240输出的第一输出电压VGL进行分压，得到FB点的FB点电压＝-VGL*R1/(R1+R2)，所述放大器271将FB点电压与所述参考电压端460输出的参考电压Vref进行比较，当所述第一输出电压VGL大于预设电压时，所述参考电压Vref大于所述FB点电压，则所述放大器271输出高电平；当所述第一输出电压VGL小于或等于预设电压时，所述参考电压Vref小于或等于所述FB点电压，则所述放大器271输出低电平，并输出放大后的所述第三输出电压，所述第三电阻R3与所述电容C1构成的滤波子电路将放大后的所述第三输出电压进行滤波稳压得到稳定的放大后的所述第三输出电压，当所述延迟子电路290判断输入为高电平时，所述延迟子电路290不工作。其中，所述FB点指的是所述第一分压子电路250与所述第二分压子电路260之间任意位置(例如中点位置)且与所述放大子电路270电性连接的点。
在t3阶段，当所述延迟子电路290判断输入为低电平时，所述延迟子电路290开启工作，到达预设的延迟时间后，所述第一开关晶体管T1的栅极接收所述延迟子电路290传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管T1的栅极电压下降到所述第一开关晶体管T1的第一开启电压Vth1时，所述第一开关晶体管T1导通，所述第二开关晶体管T2通过所述第一开关晶体管T1与所述电流源330电性导通，将所述电流源330的电压传输给所述第二开关晶体管T2，所述第二开关晶体管T2的栅极接收所述电流源330的电压，所述电流源330可以把所述第二开关晶体管T2的栅极电压逐渐往下拉，当所述第二开关晶体管T2的下降到所述第二开关晶体管T2的第二开启电压Vth2时，所述第二开关晶体管T2导通，此时所述第二输出电压VAA才可以通过第二电压输出端470输出，由此便实现了所述第一输出电压VGL控制所述第二输出电压VAA输出的目标。
综上所述，所述电源电路中，所述延迟子电路290到达预设的延迟时间后，所述第一开关晶体管T1的栅极接收到所述延迟子电路290传输的稳定的放大后的所述第三输出电压，当所述第一开关晶体管T1的栅极电压下降到所述第一开关晶体管T1的第一开启电压Vth1时，所述第一开关晶体管T1导通，所述第二开关晶体管T2通过所述第一开关晶体管T1与所述电流源330电性导通，将所述电流源330的电压传输给所述第二开关晶体管T2，所述第二开关晶体管T2的栅极接收所述电流源330的电压，当所述第二开关晶体管T2的下降到所述第二开关晶体管T2的第二开启电压Vth2时，所述第二开关晶体管T2导通，此时所述第二输出电压VAA才可以通过第二电压输出端470输出，从而保证所述第一输出电压VGL到达预设电压时，所述第二输出电压VAA才开始输出，从而实现了所述第一输出电压VGL控制所述第二输出电压VAA输出的目标，进而避免了所述第一输出电压VGL和所述第二输出电压VAA产生重叠区，防止屏幕出现闪白线。
基于相同的发明构思，本申请还提供一种显示装置，其包括上述的显示面板。其中，所述显示装置包括但不局限于：Mini LED面板、Micro LED面板、手机、平板电脑、导航仪、显示器等任何具有显示功能的电子设备或者部件，本申请对此不作具体限制。根据本申请的实施例，该显示装置的具体种类不受特别的限制，本领域技术人员可根据应用该显示装置的具体使用要求进行相应地设计，在此不再赘述。
在其中一个实施例中，所述显示装置还包括电源板、高压板、按键控制板等其他必要的部件和组成，本领域技术人员可根据该显示装置的具体类型和实际功能进行相应地补充，在此不再赘述。
本申请中所描述的流程图仅仅为一个实施例，在不偏离本申请的精神的情况下对此图示或者本申请中的步骤可以有多种修改变化。比如，可以不同次序的执行这些步骤，或者可以增加、删除或者修改某些步骤。本领域的一般技术人员可以理解实现上述实施例的全部或部分流程，并依本申请权利要求所作的等同变化，仍属于发明所涵盖的范围。
在本说明书的描述中，参考术语“一个实施方式”、“一些实施方式”、“示意性实施方式”、“示例”、“具体示例”或“一些示例”等的描述意指结合所述实施方式或示例描述的具体特征、结构、材料或者特点包含于本申请的至少一个实施方式或示例中。在本说明书中，对上述术语的示意性表述不一定指的是相同的实施方式或示例。而且，描述的具体特征、结构、材料或者特点可以在任何的一个或多个实施方式或示例中以合适的方式结合。
应当理解的是，本申请的应用不限于上述的举例，对本领域普通技术人员来说，可以根据上述说明加以改进或变换，所有这些改进和变换都应属于本申请所附权利要求的保护范围。本领域的一般技术人员可以理解实现上述实施例的全部或部分方法，并依本申请权利要求所作的等同变化，仍属于申请所涵盖的范围。
Claims (10)
1.一种电源电路，其特征在于，包括：
负压子电路，与第一电压输出端以及分压电路电性连接，用于产生第一输出电压，并通过所述第一电压输出端输出所述第一输出电压；
升压子电路，用于输出第二输出电压；
所述分压电路，与放大子电路以及所述第一电压输出端电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压；
所述放大子电路，与参考电压端、滤波子电路以及延迟子电路电性连接，用于将所述分压电路产生的电压与所述参考电压端输出的参考电压进行比较得到第三输出电压，并将所述第三输出电压进行放大后传输给所述滤波子电路；
所述滤波子电路，与所述延迟子电路电性连接，用于将放大后的所述第三输出电压进行滤波稳压传输给所述延迟子电路；
所述延迟子电路，与第一开关子电路电性连接，用于延迟将所述滤波子电路传输的所述第三输出电压传输给所述第一开关子电路；
所述第一开关子电路，与电流源以及第二开关子电路电性连接，用于根据所述滤波子电路传输的所述第三输出电压导通，并将所述电流源的电压传输给所述第二开关子电路。
2.根据权利要求1所述的电源电路，其特征在于，所述第二开关子电路与升压晶体管以及第二电压输出端电性连接，用于根据所述电流源的电压导通，并通过所述第二电压输出端输出第二输出电压。
3.根据权利要求1所述的电源电路，其特征在于，所述分压电路包括第一分压子电路和第二分压子电路，其中，所述第一分压子电路与所述第二分压子电路以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压；所述第二分压子电路与所述负压子电路、所述第一电压输出端以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压。
4.根据权利要求3所述的电源电路，其特征在于，所述第一分压子电路包括第一电阻，所述第一电阻的一端与所述第二分压子电路以及所述放大子电路电性连接，所述第一电阻的另一端接地，用于对所述负压子电路输出的所述第一输出电压进行分压；
所述第二分压子电路包括第二电阻，所述第二电阻与所述负压子电路、所述第一电压输出端、所述第一电阻以及所述放大子电路电性连接，用于对所述负压子电路输出的所述第一输出电压进行分压。
5.根据权利要求4所述的电源电路，其特征在于，所述放大子电路包括放大器，所述放大器的同相输入端用于输入所述参考电压端输出的所述参考电压，所述放大器的反相输入端电性连接于所述第一电阻和所述第二电阻之间，用于接收所述分压电路产生的电压，所述放大器的输出端与所述滤波子电路以及所述延迟子电路电性连接。
6.根据权利要求5所述的电源电路，其特征在于，所述滤波子电路包括第三电阻和电容，其中，所述第三电阻的一端与所述放大器的输出端以及所述延迟子电路电性连接，所述第三电阻的另一端与所述电容的一端电性连接，所述电容的另一端接地，所述第三电阻与所述电容均用于将放大后的所述第三输出电压进行滤波稳压得到稳定的放大后的所述第三输出电压，并将稳定的放大后的所述第三输出电压传输给所述延迟子电路。
7.根据权利要求2-6任意一项所述的电源电路，其特征在于，所述第一开关子电路包括第一开关晶体管，所述第一开关晶体管的栅极与所述延迟子电路电性连接，所述第一开关晶体管的源极与所述电流源电性连接，所述第一开关晶体管的漏极与所述第二开关子电路电性连接，用于将所述电流源的电压传输给所述第二开关子电路。
8.根据权利要求7所述的电源电路，其特征在于，所述第二开关子电路包括第二开关晶体管，所述第二开关晶体管的栅极与所述第一开关晶体管的漏极电性连接，所述第二开关晶体管的漏极与所述第二电压输出端电性连接，所述第二开关晶体管的源极通过所述升压晶体管和电感与电压输入端电性连接，用于根据所述电流源的电压导通输出所述第二输出电压。
9.一种显示面板，其特征在于，包括时序控制电路和如权利要求1-8任意一项所述的电源电路，其中，所述时序控制电路用于提供控制信号和画面数据，所述电源电路用于为所述显示面板提供工作电源。
10.一种显示装置，其特征在于，包括如权利要求9所述的显示面板。
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