CN115080362A - 一种pcie设备降速上报方法、系统、设备以及存储介质 - Google Patents

一种pcie设备降速上报方法、系统、设备以及存储介质 Download PDF

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Abstract

本发明公开了一种PCIE设备降速上报方法，包括以下步骤：设置监控PCIE设备速率状态的寄存器；响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。本发明还公开了一种系统、计算机设备以及可读存储介质。本发明提出的方案通过增加一组寄存器来监控PCIE设备的速率，当监控到PCIE设备降速的时候，BIOS会传送相关信息给BMC同时触发CSMI上报给OS。

Description

一种PCIE设备降速上报方法、系统、设备以及存储介质
技术领域
本发明涉及PCIE领域，具体涉及一种PCIE设备降速上报方法、系统、设备以及存储介质。
背景技术
随着服务器的运用越来越广泛，同时对PCIE设备的传输速率要求越来越高；稳定的传输速率对服务器的性能稳定起很重要的作用。当PCIE设备在发生故障，造成速率降低后，是否会有相关的提示信息，对服务器的维护起了很重要的作用。
当前在OS下当发生PCIE降速的时候，不会上报相关日志；只有在服务器重启post的过程中，bios检测到降速现象才会上报给BMC，BMC才会报出相关信息。
当前现有技术只针对POST过程中的PCIE设备降速上报，不针对OS下PCIE设备降速上报；当OS下PCIE设备发生故障降速的时候，不能及时上报相关信息，会影响服务器的传输速率，从而影响服务器的性能，影响客户的使用。
发明内容
有鉴于此，为了克服上述问题的至少一个方面，本发明实施例提出一种PCIE设备降速上报方法，包括以下步骤：
设置监控PCIE设备速率状态的寄存器；
响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
基于同一发明构思，根据本发明的另一个方面，本发明的实施例还提供了一种PCIE设备降速上报系统，包括：
设置模块，配置为设置监控PCIE设备速率状态的寄存器；
修改模块，配置为响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
发送模块，配置为响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
上报模块，配置为响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
在一些实施例中，还包括修复模块，配置为：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，修复模块还配置为：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，上报模块，配置为：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
基于同一发明构思，根据本发明的另一个方面，本发明的实施例还提供了一种计算机设备，包括：
至少一个处理器；以及
存储器，所述存储器存储有可在所述处理器上运行的计算机程序，其特征在于，所述处理器执行所述程序时执行以下步骤：
设置监控PCIE设备速率状态的寄存器；
响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
基于同一发明构思，根据本发明的另一个方面，本发明的实施例还提供了一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，所述计算机程序被处理器执行时执行以下骤：
设置监控PCIE设备速率状态的寄存器；
响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
本发明具有以下有益技术效果之一：本发明提出的方案通过增加一组寄存器来监控PCIE设备的速率，当监控到PCIE设备降速的时候，BIOS会传送相关信息给BMC同时触发CSMI上报给OS。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的实施例。
图1为本发明的实施例提供的PCIE设备降速上报方法的流程示意图；
图2为本发明的实施例提供的PCIE设备降速上报系统的结构示意图；
图3为本发明的实施例提供的计算机设备的结构示意图；
图4为本发明的实施例提供的计算机可读存储介质的结构示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白，以下结合具体实施例，并参照附图，对本发明实施例进一步详细说明。
需要说明的是，本发明实施例中所有使用“第一”和“第二”的表述均是为了区分两个相同名称非相同的实体或者非相同的参量，可见“第一”“第二”仅为了表述的方便，不应理解为对本发明实施例的限定，后续实施例对此不再一一说明。
根据本发明的一个方面，本发明的实施例提出一种PCIE设备降速上报方法，如图1所示，其可以包括步骤：
S1，设置监控PCIE设备速率状态的寄存器；
S2，响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
S3，响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
S4，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
本发明提出的方案通过增加一组寄存器来监控PCIE设备的速率，当监控到PCIE设备降速的时候，BIOS会传送相关信息给BMC同时触发CSMI上报给OS。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
具体的，可以新增一组监控PCIE速率状态的寄存器link.state，其中，设置正常状态为0，异常状态为1。然后可以通过如下命令可以查看PCIE的速率状态：
sv.socket0.uncore.pi5.pxp3.pcieg5.port0.cfg.link.state
注：pi5.pxp3.pcieg5是所插设备的位置
pcie.topology()可以查看设备的拓扑信息
这样当某个设备发生故障造成PCIE设备降速，CPU监测到有异常会触发当前PCIE设备的寄存器发生变化link.state由0变为1。
CPU首先会发出一个修复动作,pci.link.retry,查看是否真正故障造成的降速，还是由其他原因造成的降速；假如可以修复状态会变为0，假如不可修复状态会保持为1
BIOS会传递此异常信息给BMC，BMC会根据相关的寄存器解析出相关的警告日志，并在sel跟idl中显示出来，相关的显示信息如下：
SEL:
OCPNIC_interrupt bus_degrade_assert
IDL:
OCPNIC_Status Bus Degraded Rate Reduction PCIE Location:#CPU0_PE0(BUS22-DEV0-FUNC0)
通过此信息，可以准确的定位到降速的PCIE设备
同时BIOS会触发CSMI上报OS，OS会根据CSMI解析相关信息，产生异常日志
当用户当看到BMC或OS下的警告信息，会及时查看相关设备，并更换相关设备，保证服务器PCIE设备速率稳定的运行，保证产品的质量。
本发明提出的方案可以在当PCIE设备在OS环境下运行触发降速，能很好的监控到，并上报相关信息到BMC跟OS，以便及时更换相关设备，保证服务器PCIE设备传输速率的稳定性，从而提高产品的质量
基于同一发明构思，根据本发明的另一个方面，本发明的实施例还提供了一种PCIE设备降速上报系统400，如图2所示，包括：
设置模块401，配置为设置监控PCIE设备速率状态的寄存器；
修改模块402，配置为响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
发送模块403，配置为响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
上报模块404，配置为响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
在一些实施例中，还包括修复模块，配置为：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，修复模块还配置为：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，上报模块404，配置为：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
基于同一发明构思，根据本发明的另一个方面，如图3所示，本发明的实施例还提供了一种计算机设备501，包括：
至少一个处理器520；以及
存储器510，存储器510存储有可在处理器上运行的计算机程序511，处理器520执行程序时执行以下步骤：
S1，设置监控PCIE设备速率状态的寄存器；
S2，响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
S3，响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
S4，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
本发明提出的方案通过增加一组寄存器来监控PCIE设备的速率，当监控到PCIE设备降速的时候，BIOS会传送相关信息给BMC同时触发CSMI上报给OS。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
基于同一发明构思，根据本发明的另一个方面，如图4所示，本发明的实施例还提供了一种计算机可读存储介质601，计算机可读存储介质601存储有计算机程序610，计算机程序610被处理器执行时执行以下步骤：
S1，设置监控PCIE设备速率状态的寄存器；
S2，响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
S3，响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
S4，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
本发明提出的方案通过增加一组寄存器来监控PCIE设备的速率，当监控到PCIE设备降速的时候，BIOS会传送相关信息给BMC同时触发CSMI上报给OS。
在一些实施例中，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
在一些实施例中，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
在一些实施例中，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
最后需要说明的是，本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，可以通过计算机程序来指令相关硬件来完成，程序可存储于一计算机可读取存储介质中，该程序在执行时，可包括如上述各方法的实施例的流程。
此外，应该明白的是，本文的计算机可读存储介质(例如，存储器)可以是易失性存储器或非易失性存储器，或者可以包括易失性存储器和非易失性存储器两者。
本领域技术人员还将明白的是，结合这里的公开所描述的各种示例性逻辑块、模块、电路和算法步骤可以被实现为电子硬件、计算机软件或两者的组合。为了清楚地说明硬件和软件的这种可互换性，已经就各种示意性组件、方块、模块、电路和步骤的功能对其进行了一般性的描述。这种功能是被实现为软件还是被实现为硬件取决于具体应用以及施加给整个系统的设计约束。本领域技术人员可以针对每种具体应用以各种方式来实现的功能，但是这种实现决定不应被解释为导致脱离本发明实施例公开的范围。
以上是本发明公开的示例性实施例，但是应当注意，在不背离权利要求限定的本发明实施例公开的范围的前提下，可以进行多种改变和修改。根据这里描述的公开实施例的方法权利要求的功能、步骤和/或动作不需以任何特定顺序执行。此外，尽管本发明实施例公开的元素可以以个体形式描述或要求，但除非明确限制为单数，也可以理解为多个。
应当理解的是，在本文中使用的，除非上下文清楚地支持例外情况，单数形式“一个”旨在也包括复数形式。还应当理解的是，在本文中使用的“和/或”是指包括一个或者一个以上相关联地列出的项目的任意和所有可能组合。
上述本发明实施例公开实施例序号仅仅为了描述，不代表实施例的优劣。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成，也可以通过程序来指令相关的硬件完成，程序可以存储于一种计算机可读存储介质中，上述提到的存储介质可以是只读存储器，磁盘或光盘等。
所属领域的普通技术人员应当理解：以上任何实施例的讨论仅为示例性的，并非旨在暗示本发明实施例公开的范围(包括权利要求)被限于这些例子；在本发明实施例的思路下，以上实施例或者不同实施例中的技术特征之间也可以进行组合，并存在如上的本发明实施例的不同方面的许多其它变化，为了简明它们没有在细节中提供。因此，凡在本发明实施例的精神和原则之内，所做的任何省略、修改、等同替换、改进等，均应包含在本发明实施例的保护范围之内。

Claims (10)

1.一种PCIE设备降速上报方法，其特征在于，包括以下步骤：
设置监控PCIE设备速率状态的寄存器；
响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
2.如权利要求1所述的方法，其特征在于，还包括：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
3.如权利要求2所述的方法，其特征在于，还包括：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
4.如权利要求1所述的方法，其特征在于，响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报，进一步包括：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
5.一种PCIE设备降速上报系统，其特征在于，包括：
设置模块，配置为设置监控PCIE设备速率状态的寄存器；
修改模块，配置为响应于检测到PCIE设备降速，将所述寄存器的值修改为第一预设值；
发送模块，配置为响应于BIOS检测到所述寄存器为第一预设值，向BMC发送预设信息；
上报模块，配置为响应于所述BMC收到所述预设信息，获取警告日志并将所述警告日志进行上报。
6.如权利要求5所述的系统，其特征在于，还包括修复模块，配置为：
响应于CPU检测到所述寄存器为第一预设值，生成修复信号；
响应于基于所述修复信号，所述PCIE设备降速状态解除，将所述寄存器的值修改为第二预设值。
7.如权利要求6所述的系统，其特征在于，修复模块还配置为：
响应于基于所述修复信号，所述PCIE设备降速状态无法解除，将所述寄存器的值保持为第一预设值。
8.如权利要求5所述的系统，其特征在于，上报模块，配置为：
响应于所述BMC接收到所述预设信息，从第二寄存器中解析出告警日志并将所述告警日志通过预设接口上传到系统。
9.一种计算机设备，包括：
至少一个处理器；以及
存储器，所述存储器存储有可在所述处理器上运行的计算机程序，其特征在于，所述处理器执行所述程序时执行如权利要求1-4任意一项所述的方法的步骤。
10.一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，其特征在于，所述计算机程序被处理器执行时执行如权利要求1-4任意一项所述的方法的步骤。
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