CN114863856A - 显示面板的驱动方法、显示装置 - Google Patents

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CN114863856A CN202210442759.XA CN202210442759A CN114863856A CN 114863856 A CN114863856 A CN 114863856A CN 202210442759 A CN202210442759 A CN 202210442759A CN 114863856 A CN114863856 A CN 114863856A
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田雪琦
李玥
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Abstract

本发明实施例提供了一种显示面板的驱动方法、显示装置，涉及显示技术领域，有效改善上电或下电时的闪屏问题。显示面板包括数据线；显示面板的驱动过程包括第一阶段和显示阶段，第一阶段位于显示阶段之前或者之后，第一阶段包括第一子时段和第二子时段，第二子时段位于第一子时段与显示阶段之间；驱动方法包括：在第一子时段，向数据线提供第一电压VAVDD，第一电压VAVDD大于或等于显示面板在显示阶段所需的最大正性电压VGH；在第二子时段，向数据线提供第二电压VREG_OUT，第二电压VREG_OUT小于第一电压VAVDD且大于或等于显示面板在显示阶段对应的最大灰阶电压VGMP。

Description

显示面板的驱动方法、显示装置
【技术领域】
本发明涉及显示技术领域，尤其涉及一种显示面板的驱动方法、显示装置。
【背景技术】
随着显示技术的不断发展，用户对显示装置各方面性能的要求也越来越高。而现有显示装置在上电或下电时存在闪屏问题，例如，显示装置在开机或关机时会进行屏幕闪烁，该闪烁虽然时间短暂但仍会被用户可见，因而会影响到用户的使用体验。
【发明内容】
有鉴于此，本发明实施例提供了一种显示面板的驱动方法、显示装置，用以有效改善上电或下电时的闪屏问题。
一方面，本发明实施例提供了一种显示面板的驱动方法，
所述显示面板包括数据线；
所述显示面板的驱动过程包括第一阶段和显示阶段，其中，所述第一阶段位于所述显示阶段之前或者之后，所述第一阶段包括第一子时段和第二子时段，所述第二子时段位于第一子时段与所述显示阶段之间；
所述驱动方法包括：
在所述第一子时段，向所述数据线提供第一电压VAVDD，所述第一电压VAVDD大于或等于所述显示面板在所述显示阶段所需的最大正性电压VGH；
在所述第二子时段，向所述数据线提供第二电压VREG_OUT，所述第二电压VREG_OUT小于所述第一电压VAVDD且大于或等于所述显示面板在所述显示阶段对应的最大灰阶电压VGMP。
另一方面，本发明实施例提供了一种显示装置，包括：
显示面板，包括数据线；
第一驱动芯片，与所述数据线电连接；
所述显示面板的驱动过程包括第一阶段和显示阶段，所述第一阶段位于所述显示阶段之前或之后，所述第一阶段包括第一子时段和第二子时段，所述第二子时段位于第一子时段与所述显示阶段之间；
所述第一驱动芯片用于：在所述第一子时段向所述数据线提供第一电压VAVDD，所述第一电压VAVDD大于或等于所述显示面板在所述显示阶段所需的最大正性电压VGH；在所述第二子时段向所述数据线提供第二电压VREG_OUT，所述第二电压VREG_OUT小于所述第一电压VAVDD且大于或等于所述显示面板在所述显示阶段对应的最大灰阶电压VGMP。
上述技术方案中的一个技术方案具有如下有益效果：
在本发明实施例中，第一电压VAVDD大于最大灰阶电压VGMP，第二电压VREG_OUT大于或等于最大灰阶电压VGMP，因此，在整个第一阶段，数据线Data所接收的电压均大于或等于最大灰阶电压VGMP，从而保证显示面板屏幕全黑，不会出现人眼可识别到的亮屏现象。
而且，在第一子时段向数据线Data提供一个大于最大正性电压VGH的第一电压VAVDD，既可以满足现有驱动芯片所能支持的时序设定，与现有驱动芯片所能实现的功能相匹配，使本发明实施例显示装置中驱动芯片的可选择范围更广，而且还可以保证后续显示面板所需的全部正性电压均能够由该第一电压VAVDD衍生而来，保证显示面板正常功能的实现。
而在第一电压VAVDD与最大灰阶电压VGMP压差一定的情况下，在第二子时段通过向数据线Data提供一个小于第一电压VAVDD的第二电压VREG_OUT，可以减小第二电压VREG_OUT与最大灰阶电压VGMP之间的压差，那么，在由第二子时段进入显示阶段或是由显示阶段进入第二子时段时，数据线Data上的电压跳变幅度不会太大，可以减小冲击电流，进而降低电压跳变对屏幕的冲击，进一步避免瞬间屏幕闪屏问题。
此外，还需要说明的是，在理想情况下，希望在第一阶段能够直接向数据线Data提供最大灰阶电压VGMP，然而现有驱动芯片并不能支持该种时序设定，而本发明实施例所提供的这种时序，可以在满足现有驱动芯片所能支持的时序设定的前提下保证上下电过程中屏幕全黑。换句话说，本发明实施例采用现有驱动芯片即可输出上述时序，驱动芯片的可选择范围更广。
【附图说明】
为了更清楚地说明本发明实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1为本发明实施例所提供的显示面板的一种结构示意图；
图2为本发明实施例所提供的驱动过程中的一种信号时序图；
图3为本发明实施例所提供的驱动方法的一种流程图；
图4为本发明实施例所提供的驱动过程中的另一种信号时序图；
图5为本发明实施例所提供的驱动方法的另一种流程图；
图6为本发明实施例所提供的驱动过程中的再一种信号时序图；
图7为本发明实施例所提供的驱动方法的再一种流程图；
图8为本发明实施例所提供的发光移位寄存电路的一种结构示意图；
图9为本发明实施例所提供的驱动过程中的又一种信号时序图；
图10为本发明实施例所提供的驱动过程中的又一种信号时序图；
图11为本发明实施例所提供的驱动过程中的又一种信号时序图；
图12为本发明实施例所提供的显示装置的一种结构示意图。
【具体实施方式】
为了更好的理解本发明的技术方案，下面结合附图对本发明实施例进行详细描述。
应当明确，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本发明保护的范围。
在本发明实施例中使用的术语是仅仅出于描述特定实施例的目的，而非旨在限制本发明。在本发明实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
本发明实施例提供了一种显示面板的驱动方法，如图1所示，图1为本发明实施例所提供的显示面板的一种结构示意图，应用该驱动方法的显示面板包括数据线Data，数据线Data与子像素1电连接，用于向子像素1传输数据电压。
如图2和图3所示，图2为本发明实施例所提供的驱动过程中的一种信号时序图，图3为本发明实施例所提供的驱动方法的一种流程图，显示面板的驱动过程包括第一阶段T1和显示阶段T2。其中，第一阶段T1位于显示阶段T2之前或者之后，第一阶段T1包括第一子时段t11和第二子时段t12，第二子时段t12位于第一子时段t11与显示阶段T2之间。
其中，显示面板的驱动过程可以包括两个第一阶段T1，其中一个第一阶段T1位于显示阶段T2之前，对应显示面板在进行正常画面显示前的上电阶段，例如可以为开机阶段，而另一个第一阶段T1则位于显示阶段T2之后，对应显示面板显示结束后的下电阶段，例如可以为关机阶段。
基于此，本发明实施例所提供的驱动方法具体可包括：
步骤S1：在第一子时段t11，向数据线Data提供第一电压VAVDD，第一电压VAVDD大于或等于显示面板在显示阶段T2所需的最大正性电压VGH。其中，显示面板在显示阶段T2所需的正性电压可以包括由第一固定电位信号线提供的第一固定电压、或是由电源信号线提供的电源电压等。示例性的，最大正性电压VGH为6V，第一电压VAVDD也可以为6V。
步骤S2：在第二子时段t12，向数据线Data提供第二电压VREG_OUT，第二电压VREG_OUT小于第一电压VAVDD且大于或等于显示面板在显示阶段T2对应的最大灰阶电压VGMP。其中，显示面板在显示阶段T2对应的最大灰阶电压VGMP是指最高亮度等级下的最大灰阶电压，也就是高亮模式下的最大灰阶电压。示例性的，最大灰阶电压VGMP为5V，第二电压VREG_OUT可以为5.5V。
在本发明实施例中，第一电压VAVDD大于最大灰阶电压VGMP，第二电压VREG_OUT大于或等于最大灰阶电压VGMP，因此，在整个第一阶段T1，数据线Data所接收的电压均大于或等于最大灰阶电压VGMP，从而保证显示面板屏幕全黑，不会出现人眼可识别到的亮屏现象，有效改善上下电过程中的闪屏问题。
而且，在第一子时段t11向数据线Data提供一个大于最大正性电压VGH的第一电压VAVDD，既可以满足现有驱动芯片所能支持的时序设定，与现有驱动芯片所能实现的功能相匹配，使本发明实施例显示装置中驱动芯片的可选择范围更广，而且还可以保证后续显示面板所需的全部正性电压均能够由该第一电压VAVDD衍生而来，保证显示面板正常功能的实现。
而在第一电压VAVDD与最大灰阶电压VGMP压差一定的情况下，在第二子时段t12通过向数据线Data提供一个小于第一电压VAVDD的第二电压VREG_OUT，可以减小第二电压VREG_OUT与最大灰阶电压VGMP之间的压差，那么，在由第二子时段t12进入显示阶段T2或是由显示阶段T2进入第二子时段t12时，数据线Data上的电压跳变幅度不会太大，可以降低电压跳变对屏幕的冲击，从而进一步避免瞬间屏幕闪屏现象。
此外，还需要说明的是，在理想情况下，希望在第一阶段T1能够直接向数据线Data提供最大灰阶电压VGMP，但现有驱动芯片并不能支持该种时序设定，而本发明实施例所提供的这种时序，可以在满足现有驱动芯片所能支持的时序设定的前提下保证上下电过程中屏幕全黑。换句话说，本发明实施例采用现有驱动芯片即可输出上述时序，驱动芯片的可选择范围更广。
在一种可行的实施方式中，VAVDD＝VGH。如此设置，在满足显示面板正常功能实现的同时，一方面，第一电压VAVDD不会设置的太高，以第一阶段T1位于显示阶段T2之前为例，且第一阶段T1为开机阶段为例，在开机瞬间，可以减小瞬时向数据线Data所提供的电压，进而减小冲击电流，避免开机瞬间屏幕闪烁。另一方面，在最大灰阶电压VGMP一定时，还可以减小第一电压VAVDD与最大灰阶电压VGMP之间的压差，那么，在设定第二电压VREG_OUT时，第二电压VREG_OUT与第一电压VAVDD、最大灰阶电压VGMP之间的压差也可相应减小，如此一来，在第一子时段t11进入第二子时段t12或第二子时段t12进入第一子时段t11、以及在第二子时段t12进入显示阶段T2或显示阶段T2进入第二子时段t12时，可以减小数据线Data上电压的跳变幅度，进而降低对屏幕的冲击，更大程度的改善屏幕闪屏问题。
在一种可行的实施方式中，VREG_OUT＞VGMP。如此设置，数据电压的时序可适用于更多现有驱动芯片所能支持的时序设定，而且，第二电压VREG_OUT介于第一电压VAVDD与最大灰阶电压VGMP之间，可以进一步减小第二电压VREG_OUT与最大灰阶电压VGMP之间的压差，进而进一步避免因数据线Data上电压跳变导致的屏幕闪屏。
进一步地，为保证第二电压VREG_OUT与最大灰阶电压VGMP之间具有足够小的压差，第二电压VREG_OUT与最大灰阶电压VGMP可以满足：VREG_OUT-VGMP≤0.1V，以。
在一种可行的实施方式中，再次参见图1，显示面板还包括电源信号线PVDD，电源信号线PVDD用于向子像素1提供电源电压。
基于上述结构，如图4和图5所示，图4为本发明实施例所提供的驱动过程中的另一种信号时序图，图5为本发明实施例所提供的驱动方法的另一种流程图，上述步骤S1还包括在第一子时段t11不向电源信号线PVDD提供信号，步骤S2还包括在第二子时段t12向电源信号线PVDD提供电源电压VPower。
需要说明的是，在本发明实施例的时序图中，当第一阶段T1位于显示阶段T2之前时，第一阶段T1之前各信号所标注的0V表示驱动芯片未向相应的信号线提供信号，当第一阶段T1位于显示阶段T2之后时，第一阶段T1之后各信号所标注的0V也表示驱动芯片未向相应的信号线提供信号。
需要说明的是，结合图12，显示装置中具体可以包括第一驱动芯片200和第二驱动芯片300两种驱动芯片，第一驱动芯片200用于向数据线Data提供信号，第二驱动芯片300则用于向电源信号线PVDD提供信号。
在上述设置方式中，相较于第一驱动芯片200，第二驱动芯片300驱动时间较晚，在第二子时段t12才开始向电源信号线PVDD提供电源电压VPower，这样可以避免在第一子时段t11显示面板中的子像素1就接收到电源电压，从而更大程度的避免子像素1发光，以更好的保证屏幕全黑。
在一种可行的实施方式中，再次参见图1，显示面板还包括发光控制信号线Emit和发光移位寄存电路2，其中，发光移位寄存电路2分别与第一帧开始信号线STV1、第一正时钟信号线CK1、第一负时钟信号线XCK1和发光控制信号线Emit电连接。发光移位寄存电路2用于在第一帧开始信号线STV1、第一正时钟信号线CK1和第一负时钟信号线XCK1所提供的信号的作用下输出发光使能电平以控制子像素1发光，或者输出非发光使能电平以控制子像素1不发光。
基于上述结构，如图6和图7所示，图6为本发明实施例所提供的驱动过程中的再一种信号时序图，图7为本发明实施例所提供的驱动方法的再一种流程图，驱动方法还包括：在第一子时段t11和第二子时段t12，向第一帧开始信号线STV1提供第三电压V3、向第一正时钟信号线CK1提供第四电压V4以及向第一负时钟信号线XCK1提供第五电压V5，以控制发光移位寄存电路2向发光控制信号线Emit输出发光非使能电平。
需要说明的是，基于现有驱动芯片所能支持的时序设定，现有驱动芯片在第一阶段T1无法向发光移位寄存电路2对应的第一正时钟信号线CK1和第一负时钟信号线XCK1提供时钟信号。为此，在本发明实施例中，通过设定第一正时钟信号线CK1和第一负时钟信号线XCK1在第一阶段T1对应恒压信号的时序，可与现有驱动芯片的功能相匹配，进而更好的适用于当前的显示装置中。而且，在该种时序下，还可控制发光移位寄存电路2线在整个第一阶段T1输出发光非使能电平，以进一步保证显示面板中的子像素1在该阶段内无法正常发光，更大程度的保证在该阶段内屏幕全黑，避免屏幕闪烁。
进一步的，如图8所示，图8为本发明实施例所提供的发光移位寄存电路2的一种结构示意图，发光移位寄存电路2包括第一控制模块3、第二控制模块4、第三控制模块5和输出模块6。
其中，第一控制模块3分别与第一正时钟信号线CK1、第一负时钟信号线XCK1、第一帧开始信号线STV1、第一固定电位信号线VGH、第三节点N3与第二节点N2电连接。
具体地，第一控制模块3可以包括第一晶体管M1、第二晶体管M2和第三晶体管M3，其中，第一晶体管M1的栅极与第一正时钟信号线CK1电连接，第一晶体管M1的第一极与第一帧开始信号线STV1电连接，第一晶体管M1的第二极与第二节点N2电连接。第二晶体管M2的栅极与第三节点N3电连接，第二晶体管M2的第一极与第一固定电位信号线VGH电连接。第三晶体管M3的栅极与第一负时钟信号线XCK1电连接，第三晶体管M3的第一极与第二晶体管M2的第二极电连接，第三晶体管M3的第二极与第二节点N2电连接。
第二控制模块4分别与第一正时钟信号线CK1、第一帧开始信号线STV1、第二固定电位信号线VGL和第三节点N3电连接。
具体地，第二控制模块4可以包括第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7。其中，第四晶体管M4的栅极与第一正时钟信号线CK1电连接，第四晶体管M4的第一极与第一帧开始信号线STV1电连接。第五晶体管M5的栅极与第二固定电位信号线VGL电连接，第五晶体管M5的第一极与第三节点N3电连接。第六晶体管M6的栅极与第四晶体管M4的第二极电连接，第六晶体管M6的第一极与第一正时钟信号线CK1电连接。第七晶体管M7的栅极与第四晶体管M4的第二极电连接，第七晶体管M7的第一极与第六晶体管M6的第二极电连接，第七晶体管M7的第二极与第三节点N3电连接。
第三控制模块5分别与第一负时钟信号线XCK1、第一固定电位信号线VGH、第三节点N3、第二节点N2和第一节点N1电连接。
具体地，第三控制模块5可以包括第一电容C1、第八晶体管M8、第九晶体管M9和第十晶体管M10。其中，第一电容C1的第一极板与第三节点N3电连接，第一电容C1的第二极板与第四节点N4电连接。第八晶体管M8的栅极与第三节点N3电连接，第八晶体管M8的第一极与第一负时钟信号线XCK1电连接，第八晶体管M8的第二极与第四节点N4电连接。第九晶体管M9的栅极与第一负时钟信号线XCK1电连接，第九晶体管M9的第一极与第四节点N4电连接，第九晶体管M9的第二极与第一节点N1电连接。第十晶体管M10的栅极与第二节点N2电连接，第十晶体管M10的第一极与第一固定电位信号线VGH电连接，第十晶体管M10的第二极与第一节点N1电连接。
输出模块6分别与第一节点N1、第二节点N2、第一固定电位信号线VGH和第二固定电位信号线VGL和发光控制信号线Emit电连接。
具体地，输出模块6可以包括第十一晶体管M11和第十二晶体管M12。其中，第十一晶体管M11的栅极与第一节点N1电连接，第十一晶体管M11的第一极与第一固定电位信号线VGH电连接，第十一晶体管M11的第二极与发光控制信号线Emit电连接。第十二晶体管M12的栅极与第二节点N2电连接，第十二晶体管M12的第一极与第二固定电位信号线VGL电连接，第十二晶体管M12的第二极与发光控制信号线Emit电连接。
此外，发光移位寄存电路2还可以包括第二电容C2、第三电容C3和第四电容C4，其中第二电容C2的第一极板与第一固定电位信号线VGH电连接，第二电容C2的第二极板与第三节点N3电连接，第二电容C2用于稳定第三节点N3的电位。第三电容C3的第一极板与第一固定电位信号线VGH电连接，第三电容C3的第二极板与第一节点N1电连接，第三电容C3用于稳定第一节点N1的电位。第四电容C4的第一极板与第一负时钟信号线XCK1电连接，第四电容C4的第二极板与第二节点N2电连接，第四电容C4用于稳定第二节点N2的电位。
基于上述结构，发光移位寄存电路2向发光控制信号线Emit输出发光非使能电平的过程包括：
步骤K1：第一控制模块3在第三电压V3、第四电压V4和第五电压V5的作用下，向第二节点N2写入电压；第二控制模块4在第三电压V3和第四电压V4的作用下，向第三节点N3写入电压；第三控制模块5在第三节点N3的电压的作用下，向第一节点N1写入电压。
步骤K2：输出模块6在第一节点N1的电压的作用下，将第一固定电位信号线VGH提供的第一固定电位信号输出至发光控制信号线Emit，以实现向发光控制信号线Emit输出发光非使能电平，从而保证显示面板中的子像素1在发光非使能电平的作用下不发光，保证屏幕处于全黑状态。
进一步地，发光移位寄存电路2包括多个晶体管，如第一晶体管M1～第十一晶体管M11。
在一种可行的实施方式中，参见图6，第三电压V3为晶体管的非使能电压、第四电压V4和第五电压V5分别为晶体管的使能电压。以多个晶体管均为P型晶体管为例，第三电压V3为高电压，一般大于0V，第四电压V4和第五电压V5分别为低电压，一般小于0V。
结合图8，在第一阶段T1，当第三电压V3为高电压，第四电压V4和第五电压V5分别为低电压时，第一晶体管M1导通，将高电压写入第二节点N2，控制第十二晶体管M12截止。同时，第五晶体管M5导通，将第二固定电位信号线VGL提供的低电压写入第三节点N3，控制第八晶体管M8导通，将第一负时钟信号线XCK1提供的低电压写入第四节点N4，与此同时，第九晶体管M9响应第一负时钟信号线XCK1提供的低电压导通，将第四节点N4的低电压写入第一节点N1，控制第十一晶体管M11导通，将第第一固定电位信号线VGH提供的高电位(发光非使能电平)传输至发光控制信号线Emit中。
或者，在另一种可行的实施方式中，如图9所示，图9为本发明实施例所提供的驱动过程中的又一种信号时序图，第三电压V3为晶体管的非使能电压，第四电压V4为非使能电压，第五电压V5为使能电压。以多个晶体管均为P型晶体管为例，第三电压V3和第四电压V4分别为高电压，一般大于0V，第五电压V5为低电压，一般小于0V。
以多个晶体管均为P型晶体管为例，结合图8，在第一阶段T1，当第三电压V3和第四电压V4分别为高电压，第五电压V5为低电压时，第三节点N3和第四电位浮接，基于该电路结构，第三节点N3和第四电位会维持在第一固定电压和第二固定电压之间的且小于0的低电压上。此时，第八晶体管M8响应第三节点N3的低电压导通，将第一负时钟信号线XCK1提供的低电压写入第四节点N4，同时，第九晶体管M9响应第一负时钟信号线XCK1提供的低电位导通，进而将第四节点N4的低电压写入第一节点N1，控制第十一晶体管M11导通，将第一固定电位信号线VGH提供的高电位(发光非使能电平)传输至发光控制信号线Emit中。
再或者，在另一种可行的实施方式中，如图10所示，图10为本发明实施例所提供的驱动过程中的又一种信号时序图，第三电压V3为晶体管的非使能电压，第四电压V4和第五电压V5分别为0V。
以多个晶体管均为P型晶体管为例，晶体管的阈值电压Vth一般在-1V～-2V之间，结合图8，在第一阶段T1，当第三电压V3为高电压，第四电压V4和第五电压V5分别为0V时，基于该电路结构，第三节点N3为小于0V的低电位，第四节点N4接近0V，第九晶体管M9处于开关临界状态，此时，第十一晶体管M11的栅源电压小于其阈值电压，第十一晶体管M11导通，将第一固定电位信号线VGH提供的高电位(发光非使能电平)传输至发光控制信号线Emit中。
再或者，在另一种可行的实施方式中，如图11所示，图11为本发明实施例所提供的驱动过程中的又一种信号时序图，第三电压V3和第四电压V4分别为晶体管的非使能电压，第五电压V5为0V。
以多个晶体管均为P型晶体管为例，结合图8，在第一阶段T1，当第三电压V3和第四电压V4分别为高电压，第五电压V5为0V时，基于该电路结构，第三节点N3和第四电位浮接，维持在一个第一固定电位和第二固定电位之间的一个电位，第九晶体管M9处于开关临界状态，控制第十一晶体管M11的栅源电压小于其阈值电压，第十一晶体管M11导通，将第一固定电位信号线VGH提供的高电位(发光非使能电平)传输至发光控制信号线Emit中。
在一种可行的实施方式中，再次参见图1，显示面板还包括扫描信号线Scan和扫描移位寄存电路7，其中，扫描信号线Scan与子像素1电连接，扫描移位寄存电路7分别与第二帧开始信号线STV2、第二正时钟信号线CK2和第二负时钟信号线XCK2电连接，扫描移位寄存电路7用于向扫描信号线Scan提供扫描电压，进而将其传输至子像素1中。
基于现有驱动芯片所能支持的时序设定，在本发明实施例中，参见图6、图9～图11，在第一子时段t11和第二子时段t12，可以向第二帧开始信号线STV2、第二正时钟信号线CK2和第二负时钟信号线XCK2分别提供正常信号，如正常的时钟信号。受限于数据线Data、电源信号线PVDD和发光控制信号线Emit上传输的信号，此时仍能保证子像素1在第一阶段T1不发光，使屏幕维持全黑状态。
基于同一发明构思，本发明实施例还提供一种显示装置，如图12所示，图12为本发明实施例所提供的显示装置的一种结构示意图，该显示装置包括显示面板100和第一驱动芯200，其中，显示面板100包括数据线Data，第一驱动芯片200与数据线Data电连接。
结合图2，显示面板100的驱动过程包括第一阶段T1和显示阶段T2，第一阶段T1位于显示阶段T2之前或之后，第一阶段T1包括第一子时段t11和第二子时段t12，第二子时段t12位于第一子时段t11与显示阶段T2之间。
第一驱动芯片200用于：在第一子时段t11向数据线Data提供第一电压VAVDD，第一电压VAVDD大于或等于显示面板100在显示阶段T2所需的最大正性电压VGH；在第二子时段t12向数据线Data提供第二电压VREG_OUT，第二电压VREG_OUT小于第一电压VAVDD且大于或等于显示面板100在显示阶段T2对应的最大灰阶电压VGMP。
在本发明实施例中，第一电压VAVDD大于最大灰阶电压VGMP，第二电压VREG_OUT大于或等于最大灰阶电压VGMP，因此，在整个第一阶段T1，数据线Data所接收的电压均大于或等于最大灰阶电压VGMP，从而保证显示面板屏幕全黑，不会出现人眼可识别到的亮屏现象。
而且，在第一子时段t11向数据线Data提供一个大于最大正性电压VGH的第一电压VAVDD，既可以满足现有驱动芯片所能支持的时序设定，与现有驱动芯片所能实现的功能相匹配，使第一驱动芯片100的可选择范围更广。而且还可以保证后续显示面板所需的全部正性电压均能够由该第一电压VAVDD衍生而来，保证显示面板正常功能的实现。而在第一电压VAVDD与最大灰阶电压VGMP压差一定的情况下，在第二子时段t12通过向数据线Data提供一个小于第一电压VAVDD的第二电压VREG_OUT，可以减小第二电压VREG_OUT与最大灰阶电压VGMP之间的压差，那么，在由第二子时段t12进入显示阶段T2或是由显示阶段T2进入第二子时段t12时，数据线Data上的电压跳变幅度不会太大，可以减小冲击电流，进而降低电压跳变对屏幕的冲击，进一步避免瞬间屏幕闪屏问题。
进一步地，结合图5，再次参见图12，显示面板100还包括电源信号线PVDD。显示装置还包括第二驱动芯片300，第二驱动芯片300与电源信号线PVDD电连接，第二驱动芯片300用于：在第一子时段t11不向电源信号线PVDD提供信号，在第二子时段t12向电源信号线PVDD提供电源电压VPower。
在上述设置方式中，相较于第一驱动芯片200，第二驱动芯片300驱动时间较晚，在第二子时段t12才开始向电源信号线PVDD提供电源电压VPower，这样可以避免在第一子时段t11显示面板100中的子像素1接收到电源电压，更大程度的避免子像素1发光，以更好的保证屏幕全黑。
进一步地，结合图6、图9～图11，再次参见图12，显示面板100还包括发光控制信号线Emit和发光移位寄存电路2。其中，发光移位寄存电路2分别与第一帧开始信号线STV1、第一正时钟信号线CK1、第一负时钟信号线XCK1和发光控制信号线Emit电连接。
第一驱动芯片200还与第一帧开始信号线STV1、第一正时钟信号线CK1和第一负时钟信号线XCK1电连接，还用于：在第一子时段t11和第二子时段t12，向第一帧开始信号线STV1提供第三电压V3、向第一正时钟信号线CK1提供第四电压V4以及向第一负时钟信号线XCK1提供第五电压V5，以控制发光移位寄存电路2向发光控制信号线Emit输出发光非使能电平。
在上述设置方式中，还可控制发光移位寄存电路2线在整个第一阶段T1输出发光非使能电平，以进一步保证显示面板100中的子像素1在该阶段内无法正常发光，更大程度的保证在该阶段内屏幕全黑，避免屏幕闪烁。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明保护的范围之内。
最后应说明的是：以上各实施例仅用以说明本发明的技术方案，而非对其限制；尽管参照前述各实施例对本发明进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本发明各实施例技术方案的范围。

Claims (11)

1.一种显示面板的驱动方法，其特征在于，
所述显示面板包括数据线；
所述显示面板的驱动过程包括第一阶段和显示阶段，其中，所述第一阶段位于所述显示阶段之前或者之后，所述第一阶段包括第一子时段和第二子时段，所述第二子时段位于第一子时段与所述显示阶段之间；
所述驱动方法包括：
在所述第一子时段，向所述数据线提供第一电压VAVDD，所述第一电压VAVDD大于或等于所述显示面板在所述显示阶段所需的最大正性电压VGH；
在所述第二子时段，向所述数据线提供第二电压VREG_OUT，所述第二电压VREG_OUT小于所述第一电压VAVDD且大于或等于所述显示面板在所述显示阶段对应的最大灰阶电压VGMP。
2.根据权利要求1所述的驱动方法，其特征在于，
VAVDD＝VGH。
3.根据权利要求1所述的驱动方法，其特征在于，
VREG_OUT＞VGMP。
4.根据权利要求3所述的驱动方法，其特征在于，
VREG_OUT-VGMP≤0.1V。
5.根据权利要求1所述的驱动方法，其特征在于，
所述显示面板还包括电源信号线；
所述驱动方法还包括：在所述第一子时段不向所述电源信号线提供信号，在所述第二子时段向所述电源信号线提供电源电压VPower。
6.根据权利要求1所述的驱动方法，其特征在于，
所述显示面板还包括：
发光控制信号线；
发光移位寄存电路，所述发光移位寄存电路分别与第一帧开始信号线、第一正时钟信号线、第一负时钟信号线和所述发光控制信号线电连接；
所述驱动方法还包括：
在所述第一子时段和所述第二子时段，向所述第一帧开始信号线提供第三电压V3、向所述第一正时钟信号线提供第四电压V4以及向所述第一负时钟信号线提供第五电压V5，以控制所述发光移位寄存电路向所述发光控制信号线输出发光非使能电平。
7.根据权利要求6所述的驱动方法，其特征在于，
所述发光移位寄存电路包括：
第一控制模块，分别与所述第一正时钟信号线、所述第一负时钟信号线、所述第一帧开始信号线、第一固定电位信号线、第三节点与第二节点电连接；
第二控制模块，分别与所述第一正时钟信号线、所述第一帧开始信号线、第二固定电位信号线和所述第三节点电连接；
第三控制模块，分别与所述第一负时钟信号线、所述第一固定电位信号线、所述第三节点、所述第二节点和所述第一节点电连接；
输出模块，分别与所述第一节点、所述第二节点、所述第一固定电位信号线和所述第二固定电位信号线和所述发光控制信号线电连接；
所述发光移位寄存电路向所述发光控制信号线输出发光非使能电平的过程包括：
所述第一控制模块在所述第三电压V3、所述第四电压V4和所述第五电压V5的作用下，向所述第二节点写入电压；所述第二控制模块在所述第三电压V3和所述第四电压V4的作用下，向所述第三节点写入电压；所述第三控制模块在所述第三节点的电压的作用下，向所述第一节点写入电压；
所述输出模块在所述第一节点的电压的作用下，向所述发光控制信号线输出发光非使能电平。
8.根据权利要求7所述的驱动方法，其特征在于，
所述发光移位寄存电路包括多个晶体管；
所述第三电压V3为所述晶体管的非使能电压；
所述第四电压V4和所述第五电压V5分别为所述晶体管的使能电压；或者，所述第四电压V4为所述非使能电压，所述第五电压V5为所述使能电压；或者，所述第四电压V4和所述第五电压V5分别为0V；或者，所述第四电压V4分别为所述非使能电压，所述第五电压V5为0V。
9.一种显示装置，其特征在于，包括：
显示面板，包括数据线；
第一驱动芯片，与所述数据线电连接；
所述显示面板的驱动过程包括第一阶段和显示阶段，所述第一阶段位于所述显示阶段之前或之后，所述第一阶段包括第一子时段和第二子时段，所述第二子时段位于第一子时段与所述显示阶段之间；
所述第一驱动芯片用于：在所述第一子时段向所述数据线提供第一电压VAVDD，所述第一电压VAVDD大于或等于所述显示面板在所述显示阶段所需的最大正性电压VGH；在所述第二子时段向所述数据线提供第二电压VREG_OUT，所述第二电压VREG_OUT小于所述第一电压VAVDD且大于或等于所述显示面板在所述显示阶段对应的最大灰阶电压VGMP。
10.根据权利要求9所述的显示装置，其特征在于，
所述显示面板还包括电源信号线；
所述显示装置还包括第二驱动芯片，所述第二驱动芯片与所述电源信号线电连接，用于：在所述第一子时段不向所述电源信号线提供信号，在所述第二子时段向所述电源信号线提供电源电压VPower。
11.根据权利要求9所述的显示装置，其特征在于，
所述显示面板还包括：
发光控制信号线；
发光移位寄存电路，所述发光移位寄存电路分别与第一帧开始信号线、第一正时钟信号线、第一负时钟信号线和所述发光控制信号线电连接；
所述第一驱动芯片还与所述第一帧开始信号线、所述第一正时钟信号线和所述第一负时钟信号线电连接，还用于：在所述第一子时段和所述第二子时段，向所述第一帧开始信号线提供第三电压V3、向所述第一正时钟信号线提供第四电压V4以及向所述第一负时钟信号线提供第五电压V5，以控制所述发光移位寄存电路向所述发光控制信号线输出发光非使能电平。
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