CN114780480B - 数据传输方法、装置以及设备 - Google Patents
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Abstract
本申请实施例提供一种数据传输方法、装置以及设备,该方法包括:通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器;通过第二信号线接收辅助处理器发送的就绪信号;通过数据总线向辅助处理器发送待传输数据。通过该方式,由于采用第一信号线来唤醒辅助处理器,通过第二信号线来告知辅助处理器就绪,从而使得数据总线在不传输数据时可以休眠,进而降低了终端设备的功耗。
Description
技术领域
本发明涉及可穿戴设备技术领域,尤其涉及一种数据传输方法、装置以及设备。
背景技术
目前市场上的运动手表通常设置有两个微控制单元(Micro Controller Unit,MCU)。其中一个MCU用于运动手表的屏幕显示控制与业务逻辑处理,另一个MCU用于传感器的数据采集与运动健康算法的计算。
相关技术中,同一个运动手表内的两个MCU之间的通信均通过数据总线进行,例如,通过串行外设接口(Serial Peripheral Interface,SPI)总线或通用异步收发传输器(Universal Asynchronous Receiver/Transmitter,UART)总线。然而,当MCU休眠时,若仅通过数据总线实现两个MCU之间通信,会导致数据总线无法处于休眠状态,从而提高了设备的能耗。
发明内容
本申请实施例提供一种数据传输方法、装置以及设备,以解决现有技术中设备能耗高的技术问题。
第一方面,本申请实施例提供一种数据传输方法,应用于终端设备的主处理器,所述方法包括:
通过第一信号线向所述终端设备的辅助处理器发送第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
通过第二信号线接收所述辅助处理器发送的就绪信号;
通过数据总线向所述辅助处理器发送待传输数据。
一种可选的实施方式中,所述方法还包括:
通过第三信号线接收所述辅助处理器发送的第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;
通过所述数据总线接收所述辅助处理器发送的待传输数据。
一种可选的实施方式中,所述通过数据总线向所述辅助处理器发送待传输数据之前,所述方法还包括:
若所述待传输数据为预设数据类型,则取消对所述待传输数据进行编码。
一种可选的实施方式中,所述预设数据类型的待传输数据采用目标消息封装格式,所述目标消息封装格式中包括消息头标识、消息类型、消息体长度和消息体。
一种可选的实施方式中,所述预设数据类型包括日志数据。
一种可选的实施方式中,所述通过数据总线向所述辅助处理器发送待传输数据之前,所述方法还包括:
确定所述待传输数据中的第一数据包;
将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
一种可选的实施方式中,所述数据总线在传输所述待传输数据前处于休眠状态。
一种可选的实施方式中,所述数据总线包括串行外设接口总线或通用异步收发传输器总线。
第二方面,本申请实施例提供一种数据传输方法,应用于终端设备的辅助处理器,所述方法包括:
通过第一信号线接收所述终端设备的主处理器发送的第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
通过第二信号线向所述主处理器发送就绪信号;
通过数据总线接收所述主处理器发送的待传输数据。
一种可选的实施方式中,所述方法还包括:
通过第三信号线向所述主处理器发送第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;
通过所述数据总线向所述主处理器发送待传输数据。
一种可选的实施方式中,所述数据总线在传输所述待传输数据前处于休眠状态。
一种可选的实施方式中,所述数据总线包括串行外设接口总线或通用异步收发传输器总线。
第三方面,本申请实施例提供一种数据传输装置,所述装置包括:
第一发送模块,用于通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
第一接收模块,用于通过第二信号线接收所述辅助处理器发送的就绪信号;
所述第一发送模块,还用于通过数据总线向所述辅助处理器发送待传输数据。
一种可选的实施方式中,所述第一发送模块,还用于通过第三信号线接收所述辅助处理器发送的第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;
所述第一接收模块,还用于通过所述数据总线接收所述辅助处理器发送的待传输数据。
一种可选的实施方式中,所述装置还包括:
处理模块,用于若所述待传输数据为预设数据类型,则取消对所述待传输数据进行编码。
一种可选的实施方式中,所述预设数据类型的待传输数据采用目标消息封装格式,所述目标消息封装格式中包括消息头标识、消息类型、消息体长度和消息体。
一种可选的实施方式中,所述预设数据类型包括日志数据。
一种可选的实施方式中,所述处理模块,还用于确定所述待传输数据中的第一数据包;将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
一种可选的实施方式中,所述数据总线在传输所述待传输数据前处于休眠状态。
一种可选的实施方式中,所述数据总线包括串行外设接口总线或通用异步收发传输器总线。
第四方面,本申请实施例提供一种数据传输装置,所述装置包括:
第二接收模块,用于通过第一信号线接收终端设备的主处理器发送的第一唤醒信号,所述第一唤醒信号用于唤醒所述数据传输装置;
第二发送模块,用于通过第二信号线向所述主处理器发送就绪信号;
所述第二接收模块,还用于通过数据总线接收所述主处理器发送的待传输数据。
一种可选的实施方式中, 所述第二发送模块,还用于通过第三信号线向所述主处理器发送第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;通过所述数据总线向所述主处理器发送待传输数据。
一种可选的实施方式中,所述数据总线在传输所述待传输数据前处于休眠状态。
一种可选的实施方式中,所述数据总线包括串行外设接口总线或通用异步收发传输器总线。
第五方面,本申请实施例提供一种数据传输设备,包括:主处理器和辅助处理器;
所述主处理器和所述辅助处理器之间设置有第一信号线、第二信号线、第三信号线和数据总线;
所述第一信号线用于传输第一唤醒信号,所述第二信号线用于传输所述辅助处理器的就绪信号,所述第三信号线用于传输第二唤醒信号,所述数据总线用于传输待传输数据,所述第一唤醒信号用于唤醒所述辅助处理器,所述第二唤醒信号用于唤醒所述主处理器;
所述主处理器用于执行如第一方面所述的方法,所述辅助处理器用于执行如第二方面所述的方法。
第六方面,本申请还提供一种计算机程序产品,包括计算机程序,该计算机程序被处理器执行时实现第一方面任意一项所述的方法。
第七方面,本申请还提供一种计算机程序产品,包括计算机程序,该计算机程序被处理器执行时实现第二方面任意一项所述的方法。
第八方面,本发明还提供一种存储有计算机指令的非瞬时计算机可读存储介质,其上存储有计算机程序,所述计算机程序被处理器执行时实现第一方面中任意一种可能的方法。
第九方面,本发明还提供一种存储有计算机指令的非瞬时计算机可读存储介质,其上存储有计算机程序,所述计算机程序被处理器执行时实现第二方面中任意一种可能的方法。
本申请实施例提供的数据传输方法、装置以及设备,终端设备的主处理器首先通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器。随后,主处理器通过第二信号线接收辅助处理器发送的就绪信号。最后,主处理器通过数据总线向辅助处理器发送待传输数据。通过该方式,由于采用第一信号线来唤醒辅助处理器,通过第二信号线来告知辅助处理器就绪,从而使得数据总线在不传输数据时可以休眠,进而降低了终端设备的功耗。
附图说明
为了更清楚地说明本发明或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作一简单地介绍,显而易见地,下面描述中的附图是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的一种终端设备的结构示意图;
图2为本申请实施例提供的一种数据传输方法的信令交互图;
图3为本申请实施例提供的一种通信时序图;
图4为本申请实施例提供的另一种数据传输方法的信令交互图;
图5为本申请实施例提供的另一种通信时序图;
图6为本申请实施例提供的一种数据传输方法的流程示意图;
图7为本申请实施例提供的一种待传输数据的传输过程的原理示意图;
图8为本申请实施例提供的一种数据传输装置的结构示意图;
图9为本申请实施例提供的另一种数据传输装置的结构示意图;
图10为本申请实施例提供的一种电子设备的结构示意图。
具体实施方式
为使本申请实施例的目的、技术方案和优点更加清楚,下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
目前市场上的运动手表通常设置有两个微控制单元(Micro Controller Unit,MCU)。其中一个MCU用于运动手表的屏幕显示控制与业务逻辑处理,另一个MCU用于传感器的数据采集与运动健康算法的计算。
相关技术中,同一个运动手表内的两个MCU之间的通信均通过数据总线进行,例如,通过串行外设接口(Serial Peripheral Interface,SPI)总线或通用异步收发传输器(Universal Asynchronous Receiver/Transmitter,UART)总线。然而,当MCU休眠时,若仅通过数据总线实现两个MCU之间通信,会导致数据总线无法处于休眠状态,从而提高了设备的能耗。
为解决上述问题,本申请实施例提供一种数据传输方法、装置以及设备,通过额外增加的信号线来传输主处理器和辅助处理器之间的唤醒信号和就绪信号,从而使得数据总线在不传输数据时可以休眠,进而降低了终端设备的功耗。
下面首先对本申请实施例涉及的终端设备进行说明。
图1为本申请实施例提供的一种终端设备的结构示意图。如图1所示,该终端设备可以为一种数据传输设备,包含有主处理器101和辅助处理器102,主处理器101和辅助处理器102之间设置有第一信号线103、第二信号线104、第三信号线105和数据总线106。
其中,第一信号线103用于传输第一唤醒信号,第二信号线104用于传输辅助处理器102的就绪信号,第三信号线105用于传输第二唤醒信号,数据总线106用于传输待传输数据,第一唤醒信号用于唤醒辅助处理器102,第二唤醒信号用于唤醒主处理器101。
需要说明的是,本申请实施例对于主处理器101和辅助处理器102的型号不做限制,示例性的,主处理器101和辅助处理器102可以为MCU,主处理器101具体可以为Apollo,辅助处理器102具体可以为Stm32。
可以理解,本申请实施例提供的数据传输方法可以通过本申请实施例提供的数据传输装置实现,数据传输装置可以是某个设备的部分或全部,例如上述主处理器和辅助处理器。
下面以集成或安装有相关执行代码的主处理器和辅助处理器为例,以具体地实施例对本申请实施例的技术方案进行详细说明。下面这几个具体的实施例可以相互结合,对于相同或相似的概念或过程可能在某些实施例不再赘述。
图2为本申请实施例提供的一种数据传输方法的信令交互图,本实施例涉及的是如何终端设备中的主处理器和辅助处理器如何进行数据传输的过程。如图2所示,该方法包括:
S201、终端设备的主处理器通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器。
在本申请中,终端设备包含有主处理器和辅助处理器,主处理器和辅助处理器可以处于休眠状态。当主处理器需要向辅助处理器发送待传输数据前,主处理器可以通过第一信号线向辅助处理器发送第一唤醒信号。
应理解,本申请实施例对于终端设备的类型不做限制,示例性的,终端设备可以为运动设备、智能手机等。相应的,本申请实施例对于主处理器和辅助处理器的工作范围也不做限制,示例性的,主处理器可以用于屏幕显示控制与业务逻辑处理,辅助处理器用于传感器的数据采集与运动健康算法的计算。
应理解,本申请实施例对于第一信号线的类型也不做限制,示例性的,第一信号线可以为Local req信号线。
需要说明的是,本申请实施例涉及的第一唤醒信号可以为持续信号。示例性的,当主处理器向辅助处理器发送待传输数据前,主处理器可以开始向辅助处理器发送第一唤醒信号,直至主处理器完成待传输数据的传输后,主处理器停止向辅助处理器发送第一唤醒信号。相应的,辅助处理器在未接收到第一唤醒信号且自身无任务时,处于休眠状态。
S202、辅助处理器通过第二信号线向主处理器发送就绪信号。
在本步骤中,当辅助处理器接收到主处理器发送的第一唤醒信号后,可以被主处理器唤醒。随后,辅助处理器可以通过第二信号线向主处理器发送就绪信号,以使主处理器获知辅助处理器可以开始接收数据。
其中,就绪信号用于指示辅助处理器已被唤醒。
应理解,本申请实施例对于第二信号线的类型也不做限制,示例性的,第一信号线可以为Remote ready信号线。
需要说明的是,本申请实施例对于就绪信号的类型也不做限制,在一些实施例中,就绪信号也可以为持续信号。相应的,在主处理器向辅助处理器发送待传输数据的过程中,辅助处理器持续向主处理器发送就绪信号。
S203、主处理器通过数据总线向辅助处理器发送待传输数据。
在本步骤中,当主处理器接收到辅助处理器发送的就绪信号后,可以通过数据总线向辅助处理器发送待传输数据。
应理解,本申请实施例对于数据总线的类型不做限制,在一些实施例中,数据总线包括串行外设接口(Serial Peripheral Interface,SPI)总线或通用异步收发传输器(Universal Asynchronous Receiver/Transmitter,UART)总线。
可选的,本申请实施例中涉及的数据总线,可以仅包含MOSI、MISO、CLK 3个管脚,未使用CS管脚。
下面对于主处理器向辅助处理器发送待传输数据的通信时序进行说明。
图3为本申请实施例提供的一种通信时序图。如图3所示,主处理器在第3秒时开始通过第一信号线持续向辅助处理器发送第一唤醒信号直至第8.5秒。随后,辅助处理器被唤醒,在第3.5秒开始通过第二信号线持续向主处理器发送就绪信号直至第8秒。主处理器接收到就绪信号后,在第4秒开始向辅助处理器发送待传输数据直至第7.5秒。基于图3,采用上述数据传输方法,可以提高通信时序稳定性。
下面对于本申请实施例涉及的待传输数据进行说明。
在本申请中,待传输数据可以采用两种不同的数据封装格式。若待传输数据不属于预设数据类型,则采用第一种数据封装格式,若待传输数据属于预设数据类型,则采用第二种数据封装格式。
表1为本申请实施例提供的第一种数据封装格式。如表1所示,第一种数据封装格式中包含有消息头标识、消息协议版本、消息体长度、消息属性、包总数、包序号、消息体和校验。
表1
消息头标识 | 消息协议版本 | 消息体长度 | 消息属性 | 包总数 | 包序号 | 消息体 | 校验 |
1字节 | 1字节 | 1字节 | 1字节 | 4字节 | 4字节 | n字节 | 1字节 |
其中,消息头标识固定为0x7E。消息协议版本当前可以为0。消息属性的第0比特为分包标识,当第0比特为0时表示不分包,无包总数和包序号字段;当第0比特为1时表示分包,分包处理,包总数/包序号有效;消息属性的第1比特为优先标识,当第1比特为0时表示不优先,当第1比特为1时表示优先,一方接收到数据后将优先给出应答;消息属性的第2-7比特保留。包序号为从1开始。消息体为由nanopb编码的结构体数据。校验为从“消息协议版本”字段到“消息体”结束字段的crc8校验值。
需要说明的是,对于子端为Apollo3,单包传输长度最大不超过256字节,协议占用13字节,因此要保证每个nanopb的消息包编码出来的自己数不超过256-13=243字节。
表2为本申请实施例提供的第二种数据封装格式(目标消息封装格式)。如表2所示,第二种数据封装格式中包含有消息头标识、消息类型、消息体长度和消息体。
表2
消息头标识 | 消息类型 | 消息体长度 | 消息体 |
1字节 | 1字节 | 1字节 | n字节 |
其中,消息头标识可以固定为0x7F。消息类型为0时可以为对端处理器的数据,消息类型为1时可以为全球定位系统(Global Positioning System,GPS)的数据。消息体可以为无编码的实际消息内容。
需要说明的是,本申请实施例对于预设数据类型不做限制,示例性的,预设数据类型可以为日志数据。
在一些实施例中,若待传输数据不是预设数据类型,则在传输数据前需要对待传输数据进行编码,若待传输数据为预设数据类型,则取消对待传输数据进行编码。
在一些实施例中,过数据总线向辅助处理器发送待传输数据之前,还可以确定待传输数据中的第一数据包,并将多个第一数据包组包为第二数据包。
其中,第一数据包的数据量小于数据量阈值,第二数据包的数据量大于或等于数据量阈值。
本申请实施例提供的数据传输方法,终端设备的主处理器首先通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器。随后,主处理器通过第二信号线接收辅助处理器发送的就绪信号。最后,主处理器通过数据总线向辅助处理器发送待传输数据。通过该方式,由于采用第一信号线来唤醒辅助处理器,通过第二信号线来告知辅助处理器就绪,从而使得数据总线在不传输数据时可以休眠,进而降低了终端设备的功耗。
在上述实施例的基础上,下面对于辅助处理器如何向主处理器发送待传输数据进行说明。图4为本申请实施例提供的另一种数据传输方法的信令交互图,如图4所示,该方法包括:
S301、辅助处理器通过第三信号线向主处理器发送第二唤醒信号,第二唤醒信号用于唤醒主处理器。
在本申请中,当辅助处理器需要向主处理器发送待传输数据前,辅助处理器也可以通过第三信号线向主处理器发送第二唤醒信号。
应理解,本申请实施例对于第三信号线的类型也不做限制,示例性的,第三信号线可以为Remote req信号线。
需要说明的是,本申请实施例涉及的第三唤醒信号可以为持续信号。示例性的,当辅助处理器向主处理器发送待传输数据前,辅助处理器可以开始向主处理器发送第二唤醒信号,直至辅助处理器完成待传输数据的传输后,辅助处理器停止向主处理器发送第二唤醒信号。相应的,主处理器在未接收到第三唤醒信号且自身无任务时,处于休眠状态。
S302、辅助处理器通过数据总线向主处理器发送待传输数据。
在本申请中,主处理器接收到第二唤醒信号后,无需向辅助处理器发送就绪信号,可以直接进行数据传输,通过数据总线接收待传输数据。
图5为本申请实施例提供的另一种通信时序图。如图5所示,辅助处理器在第3秒时开始通过第三信号线持续向主处理器发送第二唤醒信号直至第8.5秒。随后,主处理器被唤醒,开始进行数据传输。辅助处理器在第4秒开始向主处理器发送待传输数据直至第7.5秒。基于图5,采用上述数据传输方法,可以提高通信时序稳定性。
在上述实施例的基础上,下面对于主处理器和辅助处理器之间传输待传输数据的过程进行说明。图6为本申请实施例提供的一种数据传输方法的流程示意图,图7为本申请实施例提供的一种待传输数据的传输过程的原理示意图,如图6和7所示,该方法包括:
S401、对待传输数据进行编码。
应理解,本申请实施例对于编码的类型不做限制,示例性的,可以为nanopb编码。
在一些实施例中,若待传输数据为预设数据类型,则取消对待传输数据进行编码。其中,预设数据类型可以为日志数据等数据量较大的数据。
本申请中,通过取消数据量较大的数据的编码,可以减少数据发送时间,提高传输时效。
S402、确定待传输数据中的第一数据包。
其中,第一数据包的数据量小于数据量阈值。
应理解,本申请实施例对于数据量阈值不做限制,可以根据实际情况具体设置。示例性的,可以为256字节。
S403、将多个第一数据包组包为第二数据包。
其中,第二数据包的数据量大于或等于数据量阈值。
本申请中,通过将第一数据包组包为第二数据包,可以增加传输效率。
S404、将组包后的待传输数据通过数据总线进行传输。
在一些实施例中,当接收端接收到待传输数据后,可以进行多包解包,并进行相应解码后分发给上层应用。
可选的,在一些实施例中,待传输数据还可以分为实施数据和非实时数据。针对实施数据,可以立即唤醒对应的处理器进行数据。对于非实时数据,可以将待传输数据缓存,当缓存的待传输数据达到预设的数据量后,再进行待传输数据的传输。
本申请实施例提供的数据传输方法,终端设备的主处理器首先通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器。随后,主处理器通过第二信号线接收辅助处理器发送的就绪信号。最后,主处理器通过数据总线向辅助处理器发送待传输数据。通过该方式,由于采用第一信号线来唤醒辅助处理器,通过第二信号线来告知辅助处理器就绪,从而使得数据总线在不传输数据时可以休眠,进而降低了终端设备的功耗。
图8为本申请实施例提供的一种数据传输装置的结构示意图。该数据传输装置可以通过软件、硬件或者两者的结合实现,可例如上述实施例中的主处理器,以执行上述实施例中的数据传输方法。如图8所示,该数据传输装置500包括:
第一发送模块501,用于通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,第一唤醒信号用于唤醒辅助处理器;
第一接收模块502,用于通过第二信号线接收辅助处理器发送的就绪信号;
第一发送模块501,还用于通过数据总线向辅助处理器发送待传输数据。
一种可选的实施方式中,第一发送模块501,还用于通过第三信号线接收辅助处理器发送的第二唤醒信号,第二唤醒信号用于唤醒主处理器;
第一接收模块502,还用于通过数据总线接收辅助处理器发送的待传输数据。
一种可选的实施方式中,装置还包括:
处理模块503,用于若待传输数据为预设数据类型,则取消对待传输数据进行编码。
一种可选的实施方式中,预设数据类型的待传输数据采用目标消息封装格式,目标消息封装格式中包括消息头标识、消息类型、消息体长度和消息体。
一种可选的实施方式中,预设数据类型包括日志数据。
一种可选的实施方式中,处理模块503,还用于确定待传输数据中的第一数据包;将多个第一数据包组包为第二数据包;
其中,第一数据包的数据量小于数据量阈值,第二数据包的数据量大于或等于数据量阈值。
一种可选的实施方式中,数据总线在传输待传输数据前处于休眠状态。
一种可选的实施方式中,数据总线包括串行外设接口总线或通用异步收发传输器总线。
需要说明的,图8所示实施例提供的数据传输装置,可用于执行上述任意实施例所提供的方法,具体实现方式和技术效果类似,这里不再进行赘述。
图9为本申请实施例提供的另一种数据传输装置的结构示意图。该数据传输装置可以通过软件、硬件或者两者的结合实现,可例如上述实施例中的辅助处理器,以执行上述实施例中的数据传输方法。如图9所示,该数据传输装置600包括:
第二接收模块601,用于通过第一信号线接收终端设备的主处理器发送的第一唤醒信号,第一唤醒信号用于唤醒数据传输装置;
第二发送模块602,用于通过第二信号线向主处理器发送就绪信号;
第二接收模块601,还用于通过数据总线接收主处理器发送的待传输数据。
一种可选的实施方式中,第二发送模块602,还用于通过第三信号线向主处理器发送第二唤醒信号,第二唤醒信号用于唤醒主处理器;通过数据总线向主处理器发送待传输数据。
一种可选的实施方式中,数据总线在传输待传输数据前处于休眠状态。
一种可选的实施方式中,数据总线包括串行外设接口总线或通用异步收发传输器总线。
需要说明的,图9所示实施例提供的数据传输装置,可用于执行上述任意实施例所提供的方法,具体实现方式和技术效果类似,这里不再进行赘述。
图10为本申请实施例提供的一种电子设备的结构示意图。如图10所示,该电子设备可以包括:主处理器701、辅助处理器702和存储器703。
存储器703,用于存放程序。具体地,程序可以包括程序代码,程序代码包括计算机操作指令。
存储器703可能包含高速RAM存储器,也可能还包括非易失性存储器(non-volatile memory),例如至少一个磁盘存储器。
主处理器701用于执行存储器703存储的计算机执行指令,以实现上述主处理器侧的数据传输方法;
辅助处理器702用于执行存储器703存储的计算机执行指令,以实现上述辅助处理器侧的数据传输方法;
其中,主处理器701辅助处理器702和可能是一个中央处理器(CentralProcessing Unit,简称为CPU),或者是特定集成电路(Application Specific IntegratedCircuit,简称为ASIC),或者是被配置成实施本申请实施例的一个或多个集成电路。
可选的,在具体实现上,如果通信接口、存储器703、主处理器701和辅助处理器702独立实现,则通信接口、存储器703、主处理器701和辅助处理器702可以通过总线相互连接并完成相互间的通信。总线可以是工业标准体系结构(Industry Standard Architecture,简称为ISA)总线、外部设备互连(Peripheral Component,简称为PCI)总线或扩展工业标准体系结构(Extended Industry Standard Architecture,简称为EISA)总线等。总线可以分为地址总线、数据总线、控制总线等,但并不表示仅有一根总线或一种类型的总线。
可选的,在具体实现上,如果通信接口、存储器703、主处理器701和辅助处理器702集成在一块芯片上实现,则通信接口、存储器703、主处理器701和辅助处理器702可以通过内部接口完成通信。
本申请实施例还提供了一种芯片,包括处理器和接口。其中接口用于输入输出处理器所处理的数据或指令。处理器用于执行以上方法实施例中提供的方法。该芯片可以应用于数据传输装置中。
本申请还提供了一种计算机可读存储介质,该计算机可读存储介质可以包括:U盘、移动硬盘、只读存储器(ROM,Read-Only Memory)、随机存取存储器(RAM,Random AccessMemory)、磁盘或者光盘等各种可以存储程序代码的介质,具体的,该计算机可读存储介质中存储有程序信息,程序信息用于上述数据传输方法。
本申请实施例还提供一种程序,该程序在被处理器执行时用于执行以上方法实施例提供的数据传输方法。
本申请实施例还提供一种程序产品,例如计算机可读存储介质,该程序产品中存储有指令,当其在计算机上运行时,使得计算机执行上述方法实施例提供的数据传输方法。
在上述实施例中,可以全部或部分地通过软件、硬件、固件或者其任意组合来实现。当使用软件实现时,可以全部或部分地以计算机程序产品的形式实现。计算机程序产品包括一个或多个计算机指令。在计算机上加载和执行计算机程序指令时,全部或部分地产生按照本发明实施例的流程或功能。计算机可以是通用计算机、专用计算机、计算机网络、或者其他可编程装置。计算机指令可以存储在计算机可读存储介质中,或者从一个计算机可读存储介质向另一个计算机可读存储介质传输,例如,计算机指令可以从一个网站站点、计算机、服务器或数据中心通过有线(例如同轴电缆、光纤、数字用户线(DSL))或无线(例如红外、无线、微波等)方式向另一个网站站点、计算机、服务器或数据中心进行传输。计算机可读存储介质可以是计算机能够存取的任何可用介质或者是包含一个或多个可用介质集成的服务器、数据中心等数据存储设备。可用介质可以是磁性介质,(例如,软盘、硬盘、磁带)、光介质(例如,DVD)、或者半导体介质(例如固态硬盘Solid State Disk (SSD))等。
最后应说明的是:以上各实施例仅用以说明本发明的技术方案,而非对其限制;尽管参照前述各实施例对本发明进行了详细的说明,本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分或者全部技术特征进行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本发明各实施例技术方案的范围。
Claims (13)
1.一种数据传输方法,其特征在于,应用于终端设备的主处理器,所述方法包括:
通过第一信号线向所述终端设备的辅助处理器发送第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
通过第二信号线接收所述辅助处理器发送的就绪信号,所述唤醒信号与所述就绪信号均为持续信号;
通过数据总线向所述辅助处理器发送待传输数据,所述数据总线包括串行外设接口总线或通用异步收发传输器总线;
若待传输数据不属于预设数据类型,则采用第一种数据封装格式,所述第一种数据封装格式中包含有消息头标识、消息协议版本、消息体长度、消息属性、包总数、包序号、消息体和校验,所述消息体为由nanopb编码的结构体数据,其中,对于子端为Apollo3,每个nanopb的消息包编码出来的字节数不超过243字节;
所述通过数据总线向所述辅助处理器发送待传输数据之前,所述方法还包括:
确定所述待传输数据中的第一数据包;
将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
2.根据权利要求1所述的方法,其特征在于,所述方法还包括:
通过第三信号线接收所述辅助处理器发送的第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;
通过所述数据总线接收所述辅助处理器发送的待传输数据。
3.根据权利要求1所述的方法,其特征在于,所述通过数据总线向所述辅助处理器发送待传输数据之前,所述方法还包括:
若所述待传输数据为预设数据类型,则取消对所述待传输数据进行编码。
4.根据权利要求3所述的方法,其特征在于,所述预设数据类型的待传输数据采用目标消息封装格式,所述目标消息封装格式中包括消息头标识、消息类型、消息体长度和消息体。
5.根据权利要求4所述的方法,其特征在于,所述预设数据类型包括日志数据。
6.根据权利要求1-5任一项所述的方法,其特征在于,所述数据总线在传输所述待传输数据前处于休眠状态。
7.一种数据传输方法,其特征在于,应用于终端设备的辅助处理器,所述方法包括:
通过第一信号线接收所述终端设备的主处理器发送的第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
通过第二信号线向所述主处理器发送就绪信号,所述唤醒信号与所述就绪信号均为持续信号;
通过数据总线接收所述主处理器发送的待传输数据,所述数据总线包括串行外设接口总线或通用异步收发传输器总线;
若待传输数据不属于预设数据类型,则采用第一种数据封装格式,所述第一种数据封装格式中包含有消息头标识、消息协议版本、消息体长度、消息属性、包总数、包序号、消息体和校验,所述消息体为由nanopb编码的结构体数据,其中,对于子端为Apollo3,每个nanopb的消息包编码出来的字节数不超过243字节;
所述通过数据总线向所述辅助处理器发送待传输数据之前,所述方法还包括:
确定所述待传输数据中的第一数据包;
将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
8.根据权利要求7所述的方法,其特征在于,所述方法还包括:
通过第三信号线向所述主处理器发送第二唤醒信号,所述第二唤醒信号用于唤醒所述主处理器;
通过所述数据总线向所述主处理器发送待传输数据。
9.根据权利要求7或8所述的方法,其特征在于,所述数据总线在传输所述待传输数据前处于休眠状态。
10.一种数据传输装置,其特征在于,所述装置包括:
发送模块,用于通过第一信号线向终端设备的辅助处理器发送第一唤醒信号,所述第一唤醒信号用于唤醒所述辅助处理器;
接收模块,用于通过第二信号线接收所述辅助处理器发送的就绪信号,所述唤醒信号与所述就绪信号均为持续信号;
所述发送模块,还用于通过数据总线向所述辅助处理器发送待传输数据,所述数据总线包括串行外设接口总线或通用异步收发传输器总线;
若待传输数据不属于预设数据类型,则采用第一种数据封装格式,所述第一种数据封装格式中包含有消息头标识、消息协议版本、消息体长度、消息属性、包总数、包序号、消息体和校验,所述消息体为由nanopb编码的结构体数据,其中,对于子端为Apollo3,每个nanopb的消息包编码出来的字节数不超过243字节;
所述数据传输装置还包括:处理模块,用于确定所述待传输数据中的第一数据包;将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
11.一种数据传输装置,其特征在于,所述装置包括:
接收模块,用于通过第一信号线接收终端设备的主处理器发送的第一唤醒信号,所述第一唤醒信号用于唤醒所述数据传输装置;
发送模块,用于通过第二信号线向所述主处理器发送就绪信号,所述唤醒信号与所述就绪信号均为持续信号;
所述接收模块,还用于通过数据总线接收所述主处理器发送的待传输数据,所述数据总线包括串行外设接口总线或通用异步收发传输器总线;
若待传输数据不属于预设数据类型,则采用第一种数据封装格式,所述第一种数据封装格式中包含有消息头标识、消息协议版本、消息体长度、消息属性、包总数、包序号、消息体和校验,所述消息体为由nanopb编码的结构体数据,其中,对于子端为Apollo3,每个nanopb的消息包编码出来的字节数不超过243字节;
所述数据传输装置还包括:处理模块,用于确定所述待传输数据中的第一数据包;将多个所述第一数据包组包为第二数据包;
其中,所述第一数据包的数据量小于数据量阈值,所述第二数据包的数据量大于或等于所述数据量阈值。
12.一种数据传输设备,其特征在于,包括:主处理器和辅助处理器;
所述主处理器和所述辅助处理器之间设置有第一信号线、第二信号线、第三信号线和数据总线;
所述第一信号线用于传输第一唤醒信号,所述第二信号线用于传输所述辅助处理器的就绪信号,所述第三信号线用于传输第二唤醒信号,所述数据总线用于传输待传输数据,所述第一唤醒信号用于唤醒所述辅助处理器,所述第二唤醒信号用于唤醒所述主处理器;
所述主处理器用于执行如权利要求1-6任意一项所述的方法,所述辅助处理器用于执行如权利要求7-9任意一项所述的方法。
13.一种计算机存储介质,其特征在于,所述计算机存储介质存储有多条指令,所述指令适于由处理器加载并执行如权利要求1-9任意一项的方法步骤。
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