CN113794543B - 一种七号信令fisu信令自动填充方法及装置 - Google Patents
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Abstract
本发明公开了一种七号信令FISU信令自动填充方法及装置，包括以下步骤：S1、收取上层软件下发的数据；S2、判断是否为信令信息；S3、若是信令信息，则判决信令信息长度是否等于3，若是，则进行步骤S5，若否，则进行步骤S4；S4、将该信令信息通过链路层封装后发送到64kbit/s链路；S5、记录当前信令信息，并进行重复复制，并将复制内容通过链路封装后发送到64kbit/s链路。识别上层应用发来的信令信息，区分出FISU后，针对FISU数量大的特点，通过FPGA技术实现不断的重发。降低了上层应用软件和FPGA的频繁写操作，降低了MCU的软件开销，提高了资源利用率。
Description
技术领域
本发明涉及通信技术领域，更具体的说是涉及一种七号信令FISU信令自动填充方法及装置。
背景技术
目前，七号信令，分类为公共信道信令，依时分的方式传送群话信令的信令方式，是通信网的重要组成部分。在中国使用的七号信令系统也成为中国七号信令系统，在固定电话网络或者ISDN网局间，完成本地、长途和国际的自动、半自动电话接续；在移动网内的交换局间提供各种电话呼叫业务，以及相关的移动业务，如短信业务；为固定网和移动网提供智能网业务和其他增值服务。
七号信令利用公共TS16来传送时，将组成信令单元的若干个8位位组，依次插入TS16。传送的信令和话路没有固定关系，TS16仅作为传送信令的载体和数据链路，依据HDLC作为链路帧格式。
七号信令系统中有一类是填充信令单元FISU(Filling Signal Unit),在网络节点空闲时发送的空信令。它不携带任何信息，作用是使信令链路保持激活状态。
但是，该填充信令FISU的发送目前一般是通过上层软件实现，由于填充信令数量很大，系统MCU会占用很多时间去处理，导致其他需要处理的信息处理不及时或处理不赢，由于消耗了大量系统资源，资源浪费严重
因此，如何降低上层应用软件和FPGA的频繁写操作，降低MCU的软件开销，提高资源利用率是本领域技术人员亟需解决的问题。
发明内容
有鉴于此，本发明提供了一种七号信令FISU信令自动填充方法及装置，识别上层应用发来的信令信息，区分出FISU后，针对FISU数量大的特点，通过FPGA技术实现不断的重发。降低了上层应用软件和FPGA的频繁写操作，降低了MCU的软件开销，提高了资源利用率。
为了实现上述目的，本发明采用如下技术方案：
一种七号信令FISU信令自动填充方法，包括以下步骤：
S1、收取上层软件下发的数据；
S2、判断是否为信令信息；
S3、若是信令信息，则判决信令信息长度是否等于3，若是，则进行步骤S5，若否，则进行步骤S4；
S4、将该信令信息通过链路层封装后发送到64kbit/s链路；
S5、记录当前信令信息，并进行重复复制，并将复制内容通过链路封装后发送到64kbit/s链路。
优选的，所述步骤S1所述的数据格式为目的Mac+源MAC+帧类型+信息ID+长度+净荷，其中，目的Mac为6字节，源MAC为6字节，帧类型为2字节，信息ID为两字节，长度为两字节。
优选的，所述步骤S2中是否为信令信息的判断方法为：判决帧类型是否为0x0700，判决信息ID是否为0x0701，若同时满足，则判定当前数据为信令信息。
优选的，所述步骤S3中判决信令信息长度是否等于3的方法为：判断信令信息的数据格式的长度是否为0x03，若是，则判定当前信令信息长度为3，若否，则当前信令信息长度不为3。
优选的，所述步骤S5中重复复制的3个字节内容为：BSN+BIB+FSN+FIB+LI+2bit，其中，BSN为7bit，BIB为1bit，FSN为7bit，FIB为1bit，LI为6bit。
优选的，所述步骤S5中，基于定时器逻辑对信令信息进行重复复制，复制时间间隔为125ms。
一种七号信令FISU信令自动填充装置，该装置包括：
FPGA模块，用于收取上层软件下发数据；判断是否为信令信息；如果是信令信息，则判决信令信息长度是否等于3，如果信令信息长度等于3则判决为需重复填充信令，并记录下该信令内容；如果记录的信令信息长度不等于3，FPGA无需复制该信令，将该信令信息通过链路层封装后发送到64kbit/s链路；如果记录的信息字节长度等于3，FPGA将该信令信息进行不断复制，通过链路封装后发送到64kbit/s链路。
经由上述的技术方案可知，与现有技术相比，本发明公开提供了一种七号信令FISU信令自动填充方法及装置，识别上层应用发来的信令信息，区分出FISU后，针对FISU数量大的特点，通过FPGA技术实现不断的重发。降低了上层应用软件和FPGA的频繁写操作，降低了MCU的软件开销，提高了资源利用率。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据提供的附图获得其他的附图。
图1附图为本发明提供的FISU填充信令单元帧格式示意图。
图2附图为本发明提供的自动填充流程结构示意图。
图3附图为本发明提供的数据格式示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例公开了一种七号信令FISU信令自动填充方法，，包括以下步骤：
S1、收取上层软件下发的数据；
S2、判断是否为信令信息；
S3、若是信令信息，则判决信令信息长度是否等于3，若是，则进行步骤S5，若否，则进行步骤S4；
S4、将该信令信息通过链路层封装后发送到64kbit/s链路；
S5、记录当前信令信息，并进行重复复制，并将复制内容通过链路封装后发送到64kbit/s链路。
为进一步优化上述技术方案，步骤S1所述的数据格式为目的Mac+源MAC+帧类型+信息ID+长度+净荷，其中，目的Mac为6字节，源MAC为6字节，帧类型为2字节，信息ID为两字节，长度为两字节。
为进一步优化上述技术方案，步骤S2中是否为信令信息的判断方法为：判决帧类型是否为0x0700，判决信息ID是否为0x0701，若同时满足，则判定当前数据为信令信息。
为进一步优化上述技术方案，步骤S3中判决信令信息长度是否等于3的方法为：判断信令信息的数据格式的长度是否为0x03，若是，则判定当前信令信息长度为3，若否，则当前信令信息长度不为3。
为进一步优化上述技术方案，步骤S5中重复复制的3个字节内容为：BSN+BIB+FSN+FIB+LI+2bit，其中，BSN为7bit，BIB为1bit，FSN为7bit，FIB为1bit，LI为6bit。
为进一步优化上述技术方案，步骤S5中，基于定时器逻辑对信令信息进行重复复制，复制时间间隔为125ms。
一种七号信令FISU信令自动填充装置，该装置包括：FPGA模块，用于收取上层软件下发数据；判断是否为信令信息；如果是信令信息，则判决信令信息长度是否等于3，如果信令信息长度等于3则判决为需重复填充信令，并记录下该信令内容；如果记录的信令信息长度不等于3，FPGA无需复制该信令，将该信令信息通过链路层封装后发送到64kbit/s链路；如果记录的信息字节长度等于3，FPGA将该信令信息进行不断复制，通过链路封装后发送到64kbit/s链路。
七号信令消息利用公共TS16传输，速率为64kbit/s，图1为FISU填充信令单元帧格式，从帧格式看仅有3个字节的有效信息，分别是BSN/BIB、FSN/FIB、LI，另外F字段用于帧定界标识，C字段用于校验，当LI＝0时，该消息为FISU填充信令。就上层软件发送FISU而言，上层应用软件只负责3个字节的发送且只需发送1次，FPGA实现F字段和C字段填充并完成整个报文的不断复制和发送。至于七号信令消息中的链路信令单元、消息信令单元，由于发送数量不多，不会占用过多CPU资源，这部分信令由CPU进行发送。
如图2所示，本技术方案的主要步骤如下：
上层应用软件将数据，包含七号信令、板间信令以及其它数据，根据图3中的数据格式发送给FPGA，FPGA收到后先把数据存储起来然后取出判决。
主线程首先判决的是帧类型字段和消息ID字段，如图3所示，如果帧类型字段等于0x0700且消息ID字段等于0x0701，该判决为信令消息，该信令消息包含了FISU以及链路信令消息等。由于本文内容为FISU消息的自动填充，所以判决为信令消息后需进一步判决是否为FISU消息，具体方法是读取消息ID后续字节的长度信息字节，如果长度信息字节等于3，则判决为FISU消息，长度信息字节后续读取的FISU内容净荷为BSN(7bit)+BIB(1bit)+FSN(7bit)+FIB(1bit)+LI(6bit)+2bit填充。如果长度信息字节不等于3，则该信令不是FISU信令，FPGA可直接把该条信令内容按照链路帧格式发送到64kbit/s链路，不需要重复发送。此时主线程进入到空闲状态，等待下一次处理。
如果信令长度等于3，则认定是FISU信息，则需要启动辅线程处理模块，辅线程处理模块通过FPGA定时器逻辑功能提供125微妙定时参数，连续复制当前3字节信息内容，按照链路帧格式发送到64kbit/s链路。
当前辅线程循环处理模块正在工作时，如果此时FPGA主线程收到了不等于3的七号信令，则主线程会检查并关闭辅线程的重传工作，保证当前的链路信令或者消息信令不会遭到阻塞。
上述处理的结果就是，上层应用软件发送FISU信息时仅需发送一次，大量的重复的FISU由FPGA产生。
本发明技术方案带来的有益效果有：识别上层应用发来的信令信息，区分出FISU后，针对FISU数量大的特点，通过FPGA技术实现不断的重发。降低了上层应用软件和FPGA的频繁写操作，降低了MCU的软件开销，提高了资源利用率，让MCU资源用在更需要的地方。
本说明书中各个实施例采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似部分互相参见即可。对于实施例公开的装置而言，由于其与实施例公开的方法相对应，所以描述的比较简单，相关之处参见方法部分说明即可。
对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本发明。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本发明的精神或范围的情况下，在其它实施例中实现。因此，本发明将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。
Claims (6)
1.一种七号信令FISU信令自动填充方法，其特征在于，包括以下步骤：
S1、收取上层软件下发的数据；
S2、判断是否为信令信息；判断方法为：判决帧类型是否为0x0700，判决信息ID是否为0x0701，若同时满足，则判定当前数据为信令信息；
S3、若是信令信息，则判决信令信息长度是否等于3，若是，则进行步骤S5，若否，则进行步骤S4；
S4、将该信令信息通过链路层封装后发送到64kbit/s链路；
S5、记录当前信令信息，并进行重复复制，并将复制内容通过链路封装后发送到64kbit/s链路。
2.根据权利要求1所述的一种七号信令FISU信令自动填充方法，其特征在于，所述步骤S1中，所述数据的格式为目的Mac+源MAC+帧类型+信息ID+长度+净荷，其中，目的Mac为6字节，源MAC为6字节，帧类型为2字节，信息ID为两字节，长度为两字节。
3.根据权利要求1所述的一种七号信令FISU信令自动填充方法，其特征在于，所述步骤S3中判决信令信息长度是否等于3的方法为：判断信令信息的数据格式的长度是否为0x03，若是，则判定当前信令信息长度为3，若否，则当前信令信息长度不为3。
4.根据权利要求1所述的一种七号信令FISU信令自动填充方法，其特征在于，所述步骤S5中重复复制的3个字节内容为：BSN+BIB+FSN+FIB+LI+2bit，其中，BSN为7bit，BIB为1bit，FSN为7bit，FIB为1bit，LI为6bit。
5.根据权利要求1所述的一种七号信令FISU信令自动填充方法，其特征在于，所述步骤S5中，基于定时器逻辑对信令信息进行重复复制，复制时间间隔为125ms。
6.一种七号信令FISU信令自动填充装置，其特征在于，该装置包括：
FPGA模块，用于收取上层软件下发数据；判断是否为信令信息；判断方法为：判决帧类型是否为0x0700，判决信息ID是否为0x0701，若同时满足，则判定当前数据为信令信息；如果是信令信息，则判决信令信息长度是否等于3，如果信令信息长度等于3则判决为需重复填充信令，并记录下该信令内容；如果记录的信令信息长度不等于3，FPGA无需复制该信令，将该信令信息通过链路层封装后发送到64kbit/s链路；如果记录的信息字节长度等于3，FPGA将该信令信息进行不断复制，通过链路封装后发送到64kbit/s链路。
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