CN113641537A - 一种服务器的启动系统，方法及介质 - Google Patents
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Abstract
本发明公开了一种本发明所提供的一种服务器的启动系统，包括：CPU，BIOS芯片，CPLD。CPU与BIOS芯片连接以获取该CPU启动所需的BIOS程序，其中，BIOS芯片包括主用BIOS芯片和备用BIOS芯片。CPLD分别与CPU和BIOS芯片连接，在预设时间内，若CPLD接收到CPU发出的有效信号，则确定CPU启动正常，若CPLD未接收到CPU发出的有效信号，则CPLD发送复位信号至CPU，并将主用BIOS芯片切换至备用BIOS芯片。由此可见，本发明所提供的技术方案，通过增加备用BIOS芯片，可以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
Description
技术领域
本发明涉及计算机领域，特别是涉及一种服务器的启动系统，方法及介质。
背景技术
服务器中的基本输入输出系统(Basic Input Output System，简称BIOS)是一组固化到计算机主板BIOS芯片上的程序，保存着计算机最重要的基本输入输出的程序、开机后的自检程序，以及系统自动启动的程序。BIOS芯片为计算机提供最底层的、最直接的硬件设置和控制，因此BIOS芯片是服务器中不可缺少的固件，它直接关系到整个服务器是否能够正常运行，如果BIOS芯片或BIOS程序损坏，中央处理器(central processing unit，简称CPU)甚至整个服务器就不能正常工作。
CPU通过读取BIOS芯片中的BIOS程序以实现服务器的正常启动，当CPU无法正常获取到启动所需的BIOS程序时，会导致CPU甚至整个服务器启动失败。
由此可见，如何解决由于无法获取到启动所需的BIOS程序导致服务器无法正常启动的问题，提高服务器可靠性，是本领域技术人员亟待解决的问题。
发明内容
本发明的目的是提供一种服务器的启动系统，方法及介质，保证当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以确保CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
为了解决上述技术问题，本发明提供了一种服务器的启动系统，包括：CPU，BIOS芯片，CPLD；
所述CPU与所述BIOS芯片连接，用于获取启动所需的BIOS程序，其中，所述BIOS芯片包括主用BIOS芯片和备用BIOS芯片；
所述CPLD分别与所述CPU以及所述BIOS芯片连接，用于判断在预设时间内是否接收到所述CPU发出的有效信号，若未接收到有效信号，则切换所述主用BIOS芯片至所述备用BIOS芯片以便于所述CPU获取重启所需的所述BIOS程序。
优选地，所述服务器的启动系统还包括BMC，第一逻辑控制开关，第二逻辑控制开关；
所述第一逻辑控制开关连接于所述CPU与所述BIOS芯片之间，所述第二逻辑控制开关连接于所述BMC与所述BIOS芯片之间；
所述CPLD分别与所述第一逻辑控制开关的控制端和所述第二逻辑控制开关的控制端连接，用于当所述CPLD接收到所述BMC发出的更新信号时，控制所述第一逻辑控制开关关闭，所述第二逻辑控制开关打开，以便于所述BMC更新所述BIOS芯片的所述BIOS程序。
优选地，所述备用BIOS芯片为多个。
为了解决上述技术问题，本发明还提供了一种服务器的启动方法，应用于上述服务器的启动系统，该方法包括：
判断在预设时间内是否接收到CPU发出的有效信号；
若未接收到有效信号，则切换主用BIOS芯片至备用BIOS芯片以便于所述CPU获取启动所需的BIOS程序。
优选地，所述服务器的启动方法还包括：
获取BMC发出的更新信号；
控制第一逻辑控制开关关闭，且第二逻辑控制开关打开，以便于所述BMC更新BIOS芯片中的所述BIOS程序。
优选地，在所述BMC更新BIOS芯片中的所述BIOS程序之后还包括：
判断更新所述BIOS程序前所述CPU是否为获取所述备用BIOS芯片所提供的所述BIOS程序；
若是，控制所述第一逻辑控制开关打开，所述第二逻辑控制开关关闭，并切换至所述主用BIOS芯片以便于所述CPU获取重启所需的所述BIOS程序；
判断预设时间内是否接收到所述CPU发出的有效信号，若接收到有效信号，则确定所述主用BIOS芯片的所述BIOS程序损坏，若未接收到有效信号，则切换至所述备用BIOS芯片。
优选地，在所述未接收有效信号，则切换至所述备用BIOS芯片之后还包括：
将所述主用BIOS芯片受损的信息上传至所述BMC。
为了解决上述技术问题，本发明还提供了一种服务器的启动装置，应用于上述服务器的启动系统，该装置包括：
判断模块，用于判断在预设时间内是否接收到CPU发出的有效信号；
若未接收到有效信号，则发送复位信号至所述CPU以重启，并切换主用BIOS芯片至备用BIOS芯片以便于所述CPU获取重启所需的BIOS程序。
为了解决上述技术问题，本发明还提供了一种服务器的启动装置，包括存储器，用于存储计算机程序；
处理器，用于执行所述计算机程序时实现如所述的服务器的启动方法的步骤。
为了解决上述技术问题，本发明还提供了一种计算机可读存储介质，所述计算机可读存储介质上存储有计算机程序，所述计算机程序被处理器执行时实现如所述的服务器的启动方法的步骤。
本发明所提供的一种服务器的启动系统，包括：CPU，BIOS芯片，CPLD。CPU与BIOS芯片连接以获取该CPU启动所需的BIOS程序，其中，BIOS芯片包括主用BIOS芯片和备用BIOS芯片。CPLD分别与CPU和BIOS芯片连接，在预设时间内，若CPLD接收到CPU发出的有效信号，则确定CPU启动正常，若CPLD未接收到CPU发出的有效信号，则CPLD发送复位信号至CPU以重新启动CPU，并将主用BIOS芯片切换至备用BIOS芯片以确保CPU获取到重启所需的BIOS程序。由此可见，本发明所提供的技术方案，通过增加备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
此外，本发明所提供的服务器的启动方法及介质与上述方法对应，效果同上。
附图说明
为了更清楚地说明本发明实施例，下面将对实施例中所需要使用的附图做简单的介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例所提供的一种服务器的启动系统示意图；
图2为本发明实施例所提供的一种服务器的启动方法流程图；
图3为本发明实施例所提供的另一种服务器的启动方法流程图；
图4为本发明实施例所提供的一种服务器的启动装置结构图；
图5为本发明实施例提供的另一种服务器的启动装置的结构图；
附图标记如下：1为CPLD，2为BIOS芯片，3为CPU，4为BMC，5为第一逻辑控制开关，6为第二逻辑控制开关。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护范围。
本发明的核心是提供一种服务器的启动系统，方法及介质，解决CPU无法获取到启动所需的BIOS程序无法正常启动的问题。
为了使本技术领域的人员更好地理解本发明方案，下面结合附图和具体实施方式对本发明作进一步的详细说明。
BIOS芯片上保存着服务器开机后的自检程序以及系统的自动启动程序，为计算机提供最基础、最直接的硬件设置和控制，直接关系到服务器能否正常运行，当BIOS芯片或BIOS芯片中的BIOS程序受损时，CPU则不能正常启动，进而导致服务器不能正常工作。为了解决CPU启动时无法获取到启动必需的BIOS程序导致服务器无法正常工作，本发明提出一种服务器的启动系统，通过增加设置备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序受损时，由主用BIOS芯片切换至备用BIOS芯片以获取CPU启动所需的BIOS程序，进而保证服务器正常工作，提高服务器的可靠性。
图1为本发明实施例所提供的一种服务器的启动系统示意图。如图1所示，该系统包括：CPLD1，BIOS芯片2，CPU3，其中，BIOS芯片2包括主用BIOS芯片和备用BIOS芯片。CPU3与BIOS芯片2连接，当CPU3启动时，从BIOS芯片2中获取启动所必需的BIOS程序。CPLD1分别与CPU3，主用BIOS芯片和备用BIOS芯片连接，需要说明的是，增加设置的备用BIOS芯片可以是一个，两个或多个，本发明对此不作限定。在预设时间内，CPLD1判断是否接收到CPU3发出的有效信号，如果接收到有效信号，则确定CPU3启动正常，若没有接收到有效信号，则CPLD1发送复位信号至CPU3以重启CPU3，并切换主用BIOS芯片至备用BIOS芯片以便于CPU3获取启动所需的BIOS程序。
需要说明的是，预设时间从CPU3接收到启动命令的时刻开始计时，启动命令可以是主板上电时接收到的启动命令，也可以是CPLD1发送的重启命令，本发明对此不作限定。此外，还需要注意的是，预设时间可以为3秒，5秒，10秒等，本发明对此也不作限定。
进一步地，为了更新BIOS芯片2的BIOS程序，以及检测切换至备用BIOS芯片以获取CPU3启动所需的BIOS程序是由于主用BIOS芯片受损还是主用BIOS芯片的BIOS程序损坏，在该系统中增加设置基板管理控制器(Baseboard Management Controller，简称BMC)，以便于更新BIOS芯片2中的程序。更新主用BIOS芯片和备用BIOS芯片的程序后，CPLD1发送复位信号至CPU3并调用主用BIOS芯片以便于CPU3获取主用BIOS芯片中的BIOS程序尝试重启，若重启成功，则确定是BIOS程序受损。
当然，需要注意的是，BMC4除了更新BIOS芯片2的程序外，还包括其他功能，本发明对此不作限定。例如BMC4中包含存储芯片，当检测出CPU3无法启动并非BIOS程序受损时，可以将主用BIOS芯片故障的信息传输至BMC4的日志中，以便于用户及时排除BIOS芯片2的故障。
此外，为了便于用户及时知晓BIOS芯片2故障或BIOS程序受损，可以增加设置一个报警装置，当CPU3无法从主用BIOS芯片中获取启动所必需的BIOS程序时，CPLD1除了切换至备用BIOS芯片外，还控制报警装置与电源接通以警示用户主用BIOS芯片或主用BIOS芯片的程序故障。当然，在BMC4刷新BIOS芯片2的程序后，CPLD1发送复位信号至CPU3以重启，进而判断是主用BIOS芯片故障还是BIOS程序受损，若CPU3重启成功，则确定为BIOS程序故障，并将结果传输至BMC4或传输至报警装置通知用户，若CPU3重启失败，则确定为BIOS芯片2故障，同样将BIOS芯片2故障的信息传输至BMC4或传输至报警装置通知用户。需要说明的是，报警装置可以是指示灯，也可以是蜂鸣器，还可以是显示屏，本发明对此不作限定。
本发明实施例所提供的服务器的启动系统，包括：CPU，BIOS芯片，CPLD。CPU与BIOS芯片连接以获取该CPU启动所需的BIOS程序，其中，BIOS芯片包括主用BIOS芯片和备用BIOS芯片。CPLD分别与CPU和BIOS芯片连接，在预设时间内，若CPLD接收到CPU发出的有效信号，则确定CPU启动正常，若CPLD未接收到CPU发出的有效信号，则CPLD发送复位信号至CPU以重新启动CPU，并将主用BIOS芯片切换至备用BIOS芯片以确保CPU获取到重启所需的BIOS程序。由此可见，本发明所提供的技术方案，通过增加备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
在上述实施例的基础上，考虑到CPU3与BIOS芯片2交互会产生高速的SPI信号，高速的SPI信号会伴有stub，而大量的stub会造成信号阻抗不连续，进而导致严重的信号反射。还考虑到对BIOS芯片2的程序进行更新，以及通过更新来检测若切换至备用BIOS芯片以获取CPU3启动所需的BIOS程序是主用BIOS芯片故障还是主用BIOS芯片的BIOS程序受损。
所以本发明实施例提供的技术方案，如图2所示，增加设置BMC4，第一逻辑控制开关5，第二逻辑控制开关6。第一逻辑控制开关5连接于CPU3与BIOS芯片2之间，第二逻辑控制开关6连接于BMC4与BIOS芯片之间，CPLD1分别与第一逻辑控制开关5的控制端和第二逻辑控制开关6的控制端连接。当CPLD1接收到BMC4发出的更新信号时，CPLD1控制第一逻辑控制开关5关闭和第二逻辑控制开关6打开，以便于BMC4写入新的程序至BIOS芯片2中。当然，增加设置了BMC4，可以在预设时间内更新BIOS芯片2的程序，当然，也可以是在检测出CPLD1切换主用BIOS芯片至备用BIOS芯片以便于CPU3正常启动时，更新BIOS芯片的程序以排除是否是主用BIOS芯片的程序故障，进而增长BIOS芯片2的使用寿命。需要注意的是，更新BIOS程序的预设时间可以是一周，一个月等，本发明对此不作限定。
需要说明的是，CPLD1检测出更新前CPU3启动获取所需的BIOS程序是从备用BIOS芯片中获取的，则BIOS芯片2的BIOS程序更新结束后，CPLD1控制第一逻辑控制开关5打开以及第二逻辑控制开关6关闭，同时发送复位信号至CPU3以尝试重新启动，并切换备用BIOS芯片至主用BIOS芯片以便于CPU3获取重启的BIOS程序。同样，CPLD1判断在预设时间内是否接收到CPU3发出的有效信号，若接收到有效信号，则CPU3重启成功，确定是主用BIOS芯片中的BIOS程序受损，若未接收到有效信号，则将主用BIOS芯片受损的信息上传至BMC4的日志中，以便于用户及时查看主用BIOS芯片故障并排除故障。
本发明实施例所提供的服务器的启动系统，增加设置第一逻辑控制开关，可以避免CPU与BIOS芯片交互产生高速的SPI信号而导致的信号阻抗不连续，进而导致严重的信号反射的问题。此外，增加设置BMC和第二逻辑控制开关，可以定期更新BIOS芯片中的程序，提高BIOS芯片的可靠性，进而提高服务器的可靠性。同时，当CPU无法从主用BIOS芯片中获取到启动必需的BIOS程序时，在BMC更新BIOS芯片的程序时，可以检测出是否是主用BIOS芯片中的BIOS程序受损导致CPU无法正常启动，若是主用BIOS芯片故障，可将主用BIOS芯片故障信息传输至BMC的日志中，以便于用户及时查看并排除故障，进一步提高服务器的可靠性。
在具体实施例中，考虑到若只设置一个备用BIOS芯片，当主用BIOS芯片和备用BIOS芯片均故障时，依旧会导致CPU无法正常启动，进而导致服务器无法正常工作。因此，备用BIOS芯片可以设置为多个，当然对于备用BIOS芯片的数量本发明不作限定，优选设置为多个。
本发明实施例所提供的服务器的启动系统，设置多个备用BIOS芯片，可以保证主用BIOS芯片和其中一个备用BIOS芯片均故障时，CPU还能获取到启动所需的BIOS程序，进而保证了服务器的正常工作，提高服务器的可靠性。
上述实施例中，对于一种服务器的启动系统的实施例进行了详细说明，此外，本发明实施例还提供了一种服务器的启动方法对应的实施例，该方法应用于上述实施例对应的系统。
图2为本发明实施例所提供的一种服务器的启动方法流程图，如图2所示，该方法包括：
S10：判断在预设时间内是否接收到CPU发出的有效信号，若未接收到有效信号，则进入S11。
S11：切换主用BIOS芯片至备用BIOS芯片以便于CPU获取启动所需的BIOS程序。
在具体实施例中，CPLD在预设时间内判断是否接收到CPU发出的有效信号，若接收到有效信号，则确定CPU正常启动，若未接收到有效信号，则CPLD发送复位信号至CPU以重新启动，并控制主用BIOS芯片切换至备用BIOS芯片以便CPU获取重启的BIOS程序，保证当CPU无法从主用BIOS芯片中获取启动所必需的BIOS程序时，可以切换至备用BIOS芯片以启动，进而保证服务器正常工作。
本发明所提供的服务器的启动方法，包括：判断在预设时间内是否接收到CPU发出的有效信号，若未接收到有效信号，则切换主用BIOS芯片至备用BIOS芯片以便于CPU获取启动所需的BIOS程序。由此可见，通过增加备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
在上述实施例的基础上，为了避免BIOS芯片中的BIOS程序受损或崩溃的情况出现，本发明技术方案通过增加BMC以更新BIOS芯片中的BIOS程序。图3为本发明实施例所提供的另一种服务器的启动方法流程图，如图3所示，该方法包括：
S20：获取BMC发出的更新信号。
S21：控制第一逻辑控制开关关闭，且第二逻辑控制开关打开，以便于BMC更新BIOS芯片中的BIOS程序。
在具体实施例中，当CPLD获取到BMC通过通用型之输入输出(General-purposeinput/output，简称GPIO)信号发送的更新BIOS程序的指令后，关闭第一逻辑控制开关，并打开第二逻辑控制开关，以便于BMC写入新的BIOS程序至BIOS芯片中。
本发明所提供的服务器的启动方法，通过BMC向CPLD发送更新BIOS程序的指令，并关闭第一逻辑控制开关以及打开第二逻辑控制开关，以便于BMC写入新的BIOS程序至BIOS芯片中，当BIOS芯片中的程序受损或崩溃时可以通过更新的手段刷新BIOS程序以保证CPU的正常启动，进一步提高了服务器的可靠性。
在上述实施例的基础上，考虑到若CPU无法从主用BIOS芯片中获取启动所必需的BIOS程序时，为了检测是否是BIOS程序受损导致CPU无法启动，还是主用BIOS芯片故障，以便于用户及时获取故障信息并排除故障。所以，在BMC更新BIOS芯片中的BIOS程序后，判断更新BIOS程序前CPU是否为获取备用BIOS芯片所提供的BIOS程序，若是，CPLD控制第一逻辑控制开关打开，第二逻辑控制开关关闭，并发送复位信号至CPU尝试重新启动，同时切换使用主用BIOS芯片以便于CPU获取重启的BIOS程序。在预设时间内，CPLD判断是否接收到CPU发出的有效信号，若接收到有效信号，则确定是主用BIOS芯片的BIOS程序损坏，若未接收到有效信号，则切换至备用BIOS芯片，并将主用BIOS芯片故障的信息上传至BMC以便于通知用户。
本发明所提供的服务器的启动方法，在BMC更新BIOS程序后，通过切换回主用BIOS芯片并尝试重新启动CPU，进而判断出是否是BIOS程序受损导致CPU无法正常启动，以便于用户采取相应的措施，提高服务器的可靠性。
在上述实施例的基础上，在BMC更新BIOS芯片中的BIOS程序后，若切换回主用BIOS芯片尝试重启CPU时，若CPU依旧启动失败，则确定主用BIOS芯片故障，可将主用BIOS芯片故障的信息上传至BMC的日志中，以便于用户查看并排除故障。此外，也可以通过CPLD控制报警装置与电源接通以警示用户BIOS芯片故障，而报警装置可以是指示灯，也可以是蜂鸣器，还可以是显示屏，对此本发明不作限定。
本发明所提供的服务器的启动方法，在尝试重启CPU，若CPU依旧启动失败后，将主用BIOS芯片故障的信息上传至BMC的日志，用户可以及时查看并更换主用BIOS芯片以排除故障，进而提升服务器的可靠性。
在上述实施例中，对于一种服务器的启动方法进行了详细描述，本发明还提供一种服务器的启动装置对应的实施例。需要说明的是，本发明从两个角度对装置部分的实施例进行描述，一种是基于功能模块的角度，另一种是基于硬件结构的角度。
由于装置部分的实施例与方法部分的实施例相互对应，因此装置部分的实施例请参见方法部分的实施例的描述，这里暂不赘述。
图4为本发明实施例所提供的一种服务器的启动装置结构图，如图4所示，该装置包括：
判断模块10，用于判断在预设时间内是否接收到CPU发出的有效信号，若未接收到有效信号，进入切换模块11。
切换模块11，用于切换主用BIOS芯片至备用BIOS芯片以便于CPU获取重启所需的BIOS程序。
本发明所提供的服务器的启动装置，包括：判断在预设时间内是否接收到CPU发出的有效信号，若未接收到有效信号，则切换主用BIOS芯片至备用BIOS芯片以便于CPU获取启动所需的BIOS程序。由此可见，通过增加备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
图5为本发明实施例提供的另一种服务器的启动装置的结构图，如图5所示，服务器的启动装置包括：存储器20，用于存储计算机程序；
处理器21，用于执行计算机程序时实现如上述实施例所提到的服务器的启动方法的步骤。
本实施例提供的服务器的启动装置可以包括但不限于智能手机、平板电脑、笔记本电脑或台式电脑等。
其中，处理器21可以包括一个或多个处理核心，比如4核心处理器、8核心处理器等。处理器21可以采用DSP(Digital Signal Processing，数字信号处理)、FPGA(Field－Programmable Gate Array，现场可编程门阵列)、PLA(Programmable Logic Array，可编程逻辑阵列)中的至少一种硬件形式来实现。处理器21也可以包括主处理器和协处理器，主处理器是用于对在唤醒状态下的数据进行处理的处理器，也称CPU(Central ProcessingUnit，CPU)；协处理器是用于对在待机状态下的数据进行处理的低功耗处理器。在一些实施例中，处理器21可以在集成有GPU(Graphics Processing Unit，图像处理器)，GPU用于负责显示屏所需要显示的内容的渲染和绘制。一些实施例中，处理器21还可以包括AI(Artificial Intelligence，人工智能)处理器，该AI处理器用于处理有关机器学习的计算操作。
存储器20可以包括一个或多个计算机可读存储介质，该计算机可读存储介质可以是非暂态的。存储器20还可包括高速随机存取存储器，以及非易失性存储器，比如一个或多个磁盘存储设备、闪存存储设备。本实施例中，存储器20至少用于存储以下计算机程序201，其中，该计算机程序被处理器21加载并执行之后，能够实现前述任一实施例公开的服务器的启动方法的相关步骤。另外，存储器20所存储的资源还可以包括操作系统202和数据203等，存储方式可以是短暂存储或者永久存储。其中，操作系统202可以包括Windows、Unix、Linux等。数据203可以包括但不限于启动服务器过程中涉及的数据等。
在一些实施例中，服务器的启动装置还可包括有显示屏22、输入输出接口23、通信接口24、电源25以及通信总线26。
本领域技术人员可以理解，图5中示出的结构并不构成对服务器的启动装置的限定，可以包括比图示更多或更少的组件。
本发明实施例提供的服务器的启动装置，包括存储器和处理器，处理器在执行存储器存储的程序时，能够实现如下方法：服务器的启动方法。
本发明所提供的服务器的启动装置，包括：判断在预设时间内是否接收到CPU发出的有效信号，若未接收到有效信号，则切换主用BIOS芯片至备用BIOS芯片以便于CPU获取启动所需的BIOS程序。由此可见，通过增加备用BIOS芯片，当主用BIOS芯片或主用BIOS芯片中的BIOS程序损坏时，可以切换至备用BIOS芯片以保证CPU获取到启动所需的BIOS程序，进而确保服务器的正常启动，提高了服务器的可靠性。
最后，本发明还提供一种计算机可读存储介质对应的实施例。计算机可读存储介质上存储有计算机程序，计算机程序被处理器执行时实现如上述方法实施例中记载的步骤。
可以理解的是，如果上述实施例中的方法以软件功能单元的形式实现并作为独立的产品销售或使用时，可以存储在一个计算机可读取存储介质中。基于这样的理解，本发明的技术方案本质上或者说对现有技术做出贡献的部分或者该技术方案的全部或部分可以以软件产品的形式体现出来，该计算机软件产品存储在一个存储介质中，执行本发明各个实施例所述方法的全部或部分步骤。而前述的存储介质包括：U盘、移动硬盘、只读存储器(Read-Only Memory，ROM)、随机存取存储器(Random Access Memory，RAM)、磁碟或者光盘等各种可以存储程序代码的介质。
以上对本发明所提供的一种服务器的启动系统，方法及介质，进行了详细介绍。说明书中各个实施例采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似部分互相参见即可。对于实施例公开的装置而言，由于其与实施例公开的方法相对应，所以描述的比较简单，相关之处参见方法部分说明即可。应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明原理的前提下，还可以对本发明进行若干改进和修饰，这些改进和修饰也落入本发明权利要求的保护范围内。
还需要说明的是，在本说明书中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
Claims (10)
1.一种服务器的启动系统，其特征在于，包括：CPU，BIOS芯片，CPLD；
所述CPU与所述BIOS芯片连接，用于获取启动所需的BIOS程序，其中，所述BIOS芯片包括主用BIOS芯片和备用BIOS芯片；
所述CPLD分别与所述CPU以及所述BIOS芯片连接，用于判断在预设时间内是否接收到所述CPU发出的有效信号，若未接收到有效信号，则切换所述主用BIOS芯片至所述备用BIOS芯片以便于所述CPU获取重启所需的所述BIOS程序。
2.根据权利要求1所述的服务器的启动系统，其特征在于，还包括BMC，第一逻辑控制开关，第二逻辑控制开关；
所述第一逻辑控制开关连接于所述CPU与所述BIOS芯片之间，所述第二逻辑控制开关连接于所述BMC与所述BIOS芯片之间；
所述CPLD分别与所述第一逻辑控制开关的控制端和所述第二逻辑控制开关的控制端连接，用于当所述CPLD接收到所述BMC发出的更新信号时，控制所述第一逻辑控制开关关闭，所述第二逻辑控制开关打开，以便于所述BMC更新所述BIOS芯片的所述BIOS程序。
3.根据权利要求1所述的服务器的启动系统，其特征在于，所述备用BIOS芯片为多个。
4.一种服务器的启动方法，应用于权利要求1至3任意一项所述的系统，其特征在于，包括：
判断在预设时间内是否接收到CPU发出的有效信号；
若未接收到有效信号，则切换主用BIOS芯片至备用BIOS芯片以便于所述CPU获取启动所需的BIOS程序。
5.根据权利要求4所述的服务器的启动方法，其特征在于，还包括：
获取BMC发出的更新信号；
控制第一逻辑控制开关关闭，且第二逻辑控制开关打开，以便于所述BMC更新BIOS芯片中的所述BIOS程序。
6.根据权利要求5所述的服务器的启动方法，其特征在于，在所述BMC更新BIOS芯片中的所述BIOS程序之后还包括：
判断更新所述BIOS程序前所述CPU是否为获取所述备用BIOS芯片所提供的所述BIOS程序；
若是，控制所述第一逻辑控制开关打开，所述第二逻辑控制开关关闭，并切换至所述主用BIOS芯片以便于所述CPU获取重启所需的所述BIOS程序；
判断预设时间内是否接收到所述CPU发出的有效信号，若接收到有效信号，则确定所述主用BIOS芯片的所述BIOS程序损坏，若未接收到有效信号，则切换至所述备用BIOS芯片。
7.根据权利要求6所述的服务器的启动方法，其特征在于，在所述未接收有效信号，则切换至所述备用BIOS芯片之后还包括：
将所述主用BIOS芯片受损的信息上传至所述BMC。
8.一种服务器的启动装置，应用于权利要求1至3任意一项所述的系统，其特征在于，包括：
判断模块，用于判断在预设时间内是否接收到CPU发出的有效信号；
若未接收到有效信号，则发送复位信号至所述CPU以重启，并切换主用BIOS芯片至备用BIOS芯片以便于所述CPU获取重启所需的BIOS程序。
9.一种服务器的启动装置，其特征在于，包括存储器，用于存储计算机程序；
处理器，用于执行所述计算机程序时实现如权利要求4至7任一项所述的服务器的启动方法的步骤。
10.一种计算机可读存储介质，其特征在于，所述计算机可读存储介质上存储有计算机程序，所述计算机程序被处理器执行时实现如权利要求4至7任一项所述的服务器的启动方法的步骤。
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- 2021-08-23 CN CN202110970059.3A patent/CN113641537A/zh active Pending
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