CN113411167B - 译码方法及装置、可读存储介质、终端 - Google Patents
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Abstract
一种译码方法及装置、可读存储介质、终端，所述方法包括：接收PDSCH；确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；如果所述第一剩余处理时长大于等于预设处理时长，则采用预设的第一首次迭代次数对第一个CB进行译码；如果所述第一剩余处理时长小于所述预设处理时长，则采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。本发明可以有效控制译码时长，减少译码时延，且有助于成本控制以及降低功耗。
Description
技术领域
本发明涉及通信技术领域，尤其涉及一种译码方法及装置、可读存储介质、终端。
背景技术
在现有技术中，需要对5G物理层下行共享信道(Physical Downlink SharedCHannel，PDSCH)进行译码。
为了保证数据吞吐率，减少第五代无线通信终端的功耗，通常采用迭代译码方法对PDSCH进行译码，具体地，设置最大迭代次数，且该最大迭代次数是静态的、不变的，导致在具体应用中，由于迭代次数多，容易导致处理速度过慢，功耗过大等问题。
在现有的一种改进技术中，为了降低译码处理时延，满足5G高速传输的要求，会采用相当高的并行度实现最大迭代次数的要求，这样虽然改进了时延问题，然而又面临面积成本较大、瞬间耗电较高等问题。
亟需一种译码方法，既能够改进时延问题，又能够避免面积成本较大、瞬间耗电较高。
发明内容
本发明解决的技术问题是提供一种译码方法及装置、可读存储介质、终端，可以有效控制译码时长，减少译码时延，且有助于成本控制以及降低功耗。
为解决上述技术问题，本发明实施例提供一种译码方法，包括：接收PDSCH；确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；如果所述第一剩余处理时长大于等于预设处理时长，则采用预设的第一首次迭代次数对第一个CB进行译码；如果所述第一剩余处理时长小于所述预设处理时长，则采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
可选的，所述第一首次迭代次数为所述第二首次迭代次数的预设倍数；其中，用于接收所述PDSCH的信道质量越好，所述预设倍数越大。
可选的，确定所述第一首次迭代次数：
其中，IH用于表示第一首次迭代次数，N1用于表示从接收PDSCH至上报确认信息之间的预定义时长，CBnum用于表示所述PDSCH包含的CB个数，TCB用于表示对单个CB进行译码的译码时长。
可选的，所述的译码方法，其特征在于，还包括：每当完成对第n-1个CB的译码时，确定当前时刻至上报所述确认信息之间的第n剩余处理时长；如果所述第n剩余处理时长大于等于对单个CB进行译码的译码时长，则根据当前剩余CB个数以及所述第n剩余处理时长，确定第n CB迭代次数，并采用所述第n CB迭代次数对第n个CB进行译码；其中，n为正整数，且n≥2。
可选的，采用下述公式，根据当前剩余CB个数以及所述第n剩余处理时长，确定所述第n CB迭代次数：
其中，In用于表示第n CB迭代次数，Tn用于表示所述第n剩余处理时长，CBrem用于表示所述当前剩余CB个数，TCB用于表示对单个CB进行译码的译码时长。
可选的，所述的译码方法还包括：如果所述第n剩余处理时长小于对单个CB进行译码的译码时长，则结束对所述PDSCH的译码并上报所述确认信息。
可选的，采用迭代译码算法进行译码；其中，所述迭代译码算法选自：置信度传播译码算法、最小和译码、分层最小和译码算法、分层置信度传播译码算法、带偏移因子的分层最小和译码算法。
为解决上述技术问题，本发明实施例提供一种译码装置，包括：接收模块，用于接收PDSCH；时长确定模块，用于确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；第一译码模块，用于当所述第一剩余处理时长大于等于预设处理时长时，采用预设的第一首次迭代次数对第一个CB进行译码；第二译码模块，用于当所述第一剩余处理时长小于所述预设处理时长时，采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
为解决上述技术问题，本发明实施例提供一种可读存储介质，其上存储有计算机程序，所述计算机程序被处理器运行时执行权利要求上述译码方法的步骤。
为解决上述技术问题，本发明实施例提供一种终端，包括存储器和处理器，所述存储器上存储有能够在所述处理器上运行的计算机程序，所述处理器运行所述计算机程序时执行上述译码方法的步骤。
与现有技术相比，本发明实施例的技术方案具有以下有益效果：
在本发明实施例中，通过设置确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长，并且在所述第一剩余处理时长大于等于预设处理时长时，则采用预设的较大的迭代次数对第一个CB进行译码，反之则采用预设的较小的迭代次数对第一个CB进行译码，从而可以从第一个CB起，就通过判断条件使用合适的迭代次数，相比于现有技术中仅能采用静态的最大迭代次数，往往由于不能满足该最大迭代次数而导致性能损失，采用本发明实施例的方案，可以选择适当的迭代次数，从而有效控制译码时长，减少译码时延，进一步地，采用本发明实施例的方案，没有并行度需求，有助于成本控制以及降低功耗。
进一步，所述第一首次迭代次数为所述第二首次迭代次数的预设倍数；其中，用于接收所述PDSCH的信道质量越好，所述预设倍数越大，从而可以根据信道质量较好选择两种迭代次数之间相差较小，从而在采用第二首次迭代次数时也能够达到足够的迭代次数，还可以根据信道质量较差时选择两种迭代次数之间相差较大，从而在采用第二首次迭代次数时适当减少迭代次数，避免导致进一步延迟。
进一步，当完成对第n-1个CB的译码时，确定当前时刻至上报所述确认信息之间的第n剩余处理时长，如果所述第n剩余处理时长大于等于对单个CB进行译码的译码时长，则根据当前剩余CB个数以及所述第n剩余处理时长，确定第n CB迭代次数，并采用所述第n CB迭代次数对第n个CB进行译码，由于在完成对第一个CB的译码后，各个剩余处理时长在理论上小于预设处理时长，此时通过计算得到第n CB迭代次数，也即自当前剩余CB的平均迭代次数，并采用该第n CB迭代次数对第n个CB进行译码，可以实现对动态迭代次数计算与应用，进一步在有效控制译码时长，减少译码时延的同时，控制成本以及降低功耗。
进一步，所述迭代译码算法选自：低密度奇偶校验译码算法、置信度传播译码算法(Belief-Propagation)、最小和译码(Min-Sum)、分层最小和译码算法、分层置信度传播译码算法、带偏移因子的分层最小和译码算法，由于这些译码算法具有采用静态最大迭代次数的特点，采用本发明实施例的方案，可以通过动态调整迭代次数，有效控制译码时长，减少译码时延的同时，控制成本以及降低功耗。
附图说明
图1是现有技术中一种译码系统的结构示意图；
图2是本发明实施例中一种译码方法的流程图；
图3是本发明实施例中另一种译码方法的流程图；
图4是本发明实施例中一种译码装置的结构示意图。
具体实施方式
在现有的对PDSCH进行译码的迭代译码方法中，存在处理速度过慢，功耗过大、面积成本较大、瞬间耗电较高等问题。
本发明的发明人经过研究发现，在现有技术中，由于设置最大迭代次数，且该最大迭代次数是静态的、不变的。具体而言，无论译码模块的负载高低、MCS高低、误码率大小，均采用同一最大迭代次数，导致在具体应用中，由于迭代次数多，容易出现处理速度过慢，功耗过大等问题。
本发明的发明人经过研究还发现，在现有的一种改进技术中，为了降低译码处理时延，满足5G高速传输的要求，会采用相当高的并行度实现最大迭代次数的要求，这样虽然改进了时延问题，然而又面临面积成本较大、瞬间耗电较高等问题。
参照图1，图1是现有技术中一种译码系统的结构示意图。所述译码系统可以包括输入数据模块101、多输入多输出(Multi Input Multi Output，MIMO)模块102、重传合并模块103、软比特(bit)数据存储空间104、迭代译码器105、双倍速率同步动态随机存储器(Double Data Rate，DDR)存储区106、重传数据空间107。
在现有的一种具体应用中，所述迭代译码器105可以采用低密度奇偶校验(Low-density Parity-check，LDPC)译码器。
如图1中，显示了迭代译码器105相关的上下游模块。其中，软比特(bit)数据存储空间104是有限的，在采用静态迭代次数的前提下，容易发生无法完全解耦MIMO模块102和迭代译码器105的问题；同理，DDR存储区106的存储空间也是有限的，在采用静态迭代次数的前提下，容易发生无法解耦后级模块的问题。
在本发明实施例中，通过设置确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长，并且在所述第一剩余处理时长大于等于预设处理时长时，则采用预设的较大的迭代次数对第一个码块(Code Block，CB)进行译码，反之则采用预设的较小的迭代次数对第一个CB进行译码，从而可以从第一个CB起，就通过判断条件使用合适的迭代次数，相比于现有技术中仅能采用静态的最大迭代次数，往往由于不能满足该最大迭代次数而导致性能损失，采用本发明实施例的方案，可以选择适当的迭代次数，从而有效控制译码时长，减少译码时延，进一步地，采用本发明实施例的方案，没有并行度需求，有助于成本控制以及降低功耗。
为使本发明的上述目的、特征和有益效果能够更为明显易懂，下面结合附图对本发明的具体实施例做详细的说明。
参照图2，图2是本发明实施例中一种译码方法的流程图。所述译码方法可以包括步骤S21至步骤S24：
步骤S21：接收PDSCH；
步骤S22：确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；
步骤S23：如果所述第一剩余处理时长大于等于预设处理时长，则采用预设的第一首次迭代次数对第一个CB进行译码；
步骤S24：如果所述第一剩余处理时长小于所述预设处理时长，则采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数。
其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
可以理解的是，在具体实施中，所述方法可以采用软件程序的方式实现，该软件程序运行于芯片或芯片模组内部集成的处理器中。
在步骤S21的具体实施中，终端可以从网络侧接收PDSCH。
在本发明实施例中，对于终端接收PDSCH的具体步骤不作限制。
在步骤S22的具体实施中，终端可以确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长。
其中，上报所述PDSCH的确认信息的步骤可以是终端向网络侧发送确认信息(ACK)或者非确认信息(NACK)。
在本发明实施例的一种具体实施方式中，可以在接收到PDSCH时，确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长，从而有助于得到第一剩余处理时长大于等于预设处理时长的情况，从而选择更大的迭代次数对第一个CB进行译码。
在本发明实施例的另一种具体实施方式中，还可以在接收到PDSCH之后的一定时长，确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长，从而可以在处理其他业务后再进行判断。
在步骤S23的具体实施中，如果所述第一剩余处理时长大于等于预设处理时长，则采用预设的第一首次迭代次数对第一个CB进行译码。
其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
进一步地，可以采用下述公式，确定所述第一首次迭代次数：
其中，IH用于表示第一首次迭代次数，N1用于表示从接收PDSCH至上报确认信息之间的预定义时长，CBnum用于表示所述PDSCH包含的CB个数，TCB用于表示对单个CB进行译码的译码时长，IH的取值为向下取整。
具体地，从接收PDSCH至上报确认信息之间的预定义时长N1可以是通信协议中规定的时长，例如在通信协议38.214.5.3中对N1进行了规定。
其中，所述PDSCH包含的CB个数CBnum可以根据PDSCH的传输块大小(TB size)、信息比特长度计算得到，还可以采用现有的常规技术计算得到。在本发明实施例中，对于计算PDSCH包含的CB个数的方式不作限制。
在步骤S24的具体实施中，如果所述第一剩余处理时长小于所述预设处理时长，则采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数。
在本发明实施例中，通过设置第二首次迭代次数小于第一首次迭代次数，可以在所述第一剩余处理时长大于等于预设处理时长时，采用预设的较大的迭代次数对第一个CB进行译码，反之则采用预设的较小的迭代次数对第一个CB进行译码，从而可以从第一个CB起，就通过判断条件使用合适的迭代次数。
进一步地，所述第一首次迭代次数为所述第二首次迭代次数的预设倍数；其中，用于接收所述PDSCH的信道质量越好，所述预设倍数越大。
在一个非限制性的例子中，可以采用上述公式计算所述第一首次迭代次数并得到IH等于27，然后可以设置当前信道质量的参数值大于等于预设阈值时，信道质量较好，所述预设倍数为9，此时可以计算得到第二首次迭代次数IL＝27/9＝3。
还可以设置当前信道质量的参数值小于所述预设阈值时，信道质量较差，所述预设倍数为3，此时可以计算得到第二首次迭代次数IL＝27/3＝9。
在本发明实施例中，所述第一首次迭代次数为所述第二首次迭代次数的预设倍数；其中，用于接收所述PDSCH的信道质量越好，所述预设倍数越大，从而可以根据信道质量较好选择两种迭代次数之间相差较小，从而在采用第二首次迭代次数时也能够达到足够的迭代次数，还可以根据信道质量较差时选择两种迭代次数之间相差较大，从而在采用第二首次迭代次数时适当减少迭代次数，避免导致进一步延迟。
在本发明实施例中，通过设置确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长，并且在所述第一剩余处理时长大于等于预设处理时长时，则采用预设的较大的迭代次数对第一个CB进行译码，反之则采用预设的较小的迭代次数对第一个CB进行译码，从而可以从第一个CB起，就通过判断条件使用合适的迭代次数，相比于现有技术中仅能采用静态的最大迭代次数，往往由于不能满足该最大迭代次数而导致性能损失，采用本发明实施例的方案，可以选择适当的迭代次数，从而有效控制译码时长，减少译码时延，进一步地，采用本发明实施例的方案，没有并行度需求，有助于成本控制以及降低功耗。
进一步地，所述译码方法还可以包括：每当完成对第n-1个CB的译码时，确定当前时刻至上报所述确认信息之间的第n剩余处理时长；如果所述第n剩余处理时长大于等于对单个CB进行译码的译码时长，则根据当前剩余CB个数以及所述第n剩余处理时长，确定第nCB迭代次数，并采用所述第n CB迭代次数对第n个CB进行译码；其中，n为正整数，且n≥2。
更进一步地，可以采用下述公式，根据当前剩余CB个数以及所述第n剩余处理时长，确定所述第n CB迭代次数：
其中，In用于表示第n CB迭代次数，Tn用于表示所述第n剩余处理时长，CBrem用于表示所述当前剩余CB个数，TCB用于表示对单个CB进行译码的译码时长。
进一步地，所述的译码方法还可以包括：如果所述第n剩余处理时长小于对单个CB进行译码的译码时长，则结束对所述PDSCH的译码并上报所述确认信息。
在本发明实施例中，当完成对第n-1个CB的译码时，确定当前时刻至上报所述确认信息之间的第n剩余处理时长，如果所述第n剩余处理时长大于等于对单个CB进行译码的译码时长，则根据当前剩余CB个数以及所述第n剩余处理时长，确定第n CB迭代次数，并采用所述第n CB迭代次数对第n个CB进行译码，由于在完成对第一个CB的译码后，各个剩余处理时长在理论上小于预设处理时长，此时通过计算得到第n CB迭代次数，也即自当前剩余CB的平均迭代次数，并采用该第n CB迭代次数对第n个CB进行译码，可以实现对动态迭代次数计算与应用，进一步在有效控制译码时长，减少译码时延的同时，控制成本以及降低功耗。
参照图3，图3是本发明实施例中另一种译码方法的流程图。所述另一种译码方法可以包括步骤S301至步骤S313，以下对各个步骤进行说明。
在步骤S301中，接收PDSCH并确定CB个数。
在步骤S302中，确定当前时刻至上报确认信息之间的剩余处理时长T1。
在步骤S303中，判断T1是否大于等于N1，如果判断结果为是，则转为执行步骤S304，如果判断结果为否，则转为执行步骤S305。
在步骤S304中，采用迭代次数IH对第一个CB进行译码。
在步骤S305中，采用迭代次数IL对第一个CB进行译码。
有关步骤S301至步骤S305的更多内容，请参照前文以及图2示出的内容执行，此处不在赘述。
在步骤S306中，当完成对第一个CB的译码时，确定当前时刻至上报确认信息之间的第二剩余处理时长T2。
需要指出的是，可以是通过判断译码器是否空闲，判断一个CB的译码是否完成，也即对译码器的空闲状态进行监控，当译码器从忙碌状态转为空闲状态时，可以判断为完成对当前CB的译码。
在步骤S307中，判断T2是否小于单个CB译码时长，如果判断结果为是，则转为执行步骤S313，如果判断结果为否，则转为执行步骤S308。
具体地，如果所述第二剩余处理时长大于等于对单个CB进行译码的译码时长，则根据剩余CB个数以及所述第二剩余处理时长，确定第二CB迭代次数，并采用所述第二CB迭代次数对第二个CB进行译码。
进一步地，可以采用下述公式，根据剩余CB个数以及所述第二剩余处理时长，确定所述第二CB迭代次数：
其中，I2用于表示第二CB迭代次数，T2用于表示所述第二剩余处理时长，CBnum用于表示所述剩余CB个数，TCB用于表示对单个CB进行译码的译码时长。
进一步地，所述译码方法可以还包括：如果所述第二剩余处理时长小于对单个CB进行译码的译码时长，则结束对所述PDSCH的译码并上报所述确认信息。
在步骤S308中，采用迭代次数I2对第二个CB进行译码。
在步骤S309中，当完成对第m-1个CB的译码时，确定当前时刻至上报确认信息之间的剩余处理时长Tm。
需要指出的是，由于在图3中，采用步骤S306至步骤S308对第二个CB的译码操作进行了描述，因此，图3中的m≥3，相当于前文中的n＝m-1。
在步骤S310中，判断Tm是否小于单个CB译码时长，如果判断结果为是，则转为执行步骤S313，如果判断结果为否，则转为执行步骤S311。
在步骤S311中，采用迭代次数Im对第m个CB进行译码。
进一步的，可以采用下述公式，根据当前剩余CB个数以及所述第n剩余处理时长，确定所述第m CB迭代次数：
其中，Im用于表示第m CB迭代次数，Tm用于表示所述第m剩余处理时长，CBrem用于表示所述当前剩余CB个数，TCB用于表示对单个CB进行译码的译码时长。
需要指出的是，由于在图3中，采用步骤S306至步骤S308对第二个CB的译码操作进行了描述，因此，图3中的m≥3，相当于前文中的n＝m-1。
在步骤S312中，当完成对第M-1个CB的译码时，确定当前时刻至上报确认信息之间的剩余处理时长TM，且TM小于单个CB译码时长。
需要指出的是，M可以小于等于所述PDSCH包含的CB个数，也即当最后一次译码后如果发现剩余处理时长TM不足以对单个CB进行译码时，无论是否还剩余多少个CB，都可以停止译码并且上报确认信息。
在步骤S313中，上报确认信息。
有关步骤S301至步骤S313的更多内容，可以参照前文以及图2示出的步骤进行执行，此处不再赘述。
进一步地，可以采用迭代译码算法进行译码；其中，所述迭代译码算法选自：置信度传播译码算法、最小和译码、分层最小和译码算法、分层置信度传播译码算法、带偏移因子的分层最小和译码算法。
具体地，迭代译码的思想最早出现在Gallager提出的低密度奇偶校验(Low-density Parity-check，LDPC)码的论文中。在那里，他提出了一种基于概率的译码方法。该方法对每个比特建立校验集合树，并层层递推下去，这实际上蕴含了迭代的思想。然而，直到Turbo码被发明以后，迭代译码的好处才真正被人们所认识，并由此直接导致了LDPC码的重新被重视。
其中，在现有技术中，低密度奇偶校验(Low-density Parity-check，LDPC)译码算法在最高速码流，调制与编码策略(Modulation and Coding Scheme，MCS)选择256QAM，MCS为27时，静态最大迭代次数可达30次。但在MCS为20时，仅可以达到平均17次的迭代计算。如果初传全错，在合并重传时，可能最低的迭代次数只有8次，较低的最大迭代次数会造成性能损失。
更具体地，所述LDPC译码算法可以选自置信度传播译码算法(Belief-Propagation)、最小和译码(Min-Sum)、分层最小和译码算法、分层置信度传播译码算法、带偏移因子的分层最小和译码算法。
需要指出的是，在本发明实施例中，对于各种LDPC译码算法的具体实施细节不作限制。
在本发明实施例中，由于上述译码算法具有采用静态最大迭代次数的特点，采用本发明实施例的方案，可以通过动态调整迭代次数，有效控制译码时长，减少译码时延的同时，控制成本以及降低功耗。
参照图4，图4是本发明实施例中一种译码装置的结构示意图。所述译码装置可以包括：
接收模块41，用于接收PDSCH；
时长确定模块42，用于确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；
第一译码模块43，用于当所述第一剩余处理时长大于等于预设处理时长时，采用预设的第一首次迭代次数对第一个CB进行译码；
第二译码模块44，用于当所述第一剩余处理时长小于所述预设处理时长时，采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；
其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
在具体实施中，上述装置可以对应于用户设备中具有数据处理功能的芯片；或者对应于用户设备中包括具有数据处理功能芯片的芯片模组，或者对应于用户设备。
关于该译码装置的原理、具体实现和有益效果请参照前文所述的关于译码方法的相关描述，此处不再赘述。
需要指出的是，本发明技术方案可适用于5G(5Generation)通信系统，还可适用于4G、3G通信系统，还可适用于未来新的各种通信系统，例如6G、7G等。
本发明实施例还提供了一种可读存储介质，其上存储有计算机程序，所述计算机程序被处理器运行时执行上述方法的步骤。所述可读存储介质可以是计算机可读存储介质，例如可以包括非挥发性存储器(non-volatile)或者非瞬态(non-transitory)存储器，还可以包括光盘、机械硬盘、固态硬盘等。
具体地，在本发明实施例中，所述处理器可以为中央处理单元(centralprocessing unit，简称CPU)，该处理器还可以是其他通用处理器、数字信号处理器(digital signal processor，简称DSP)、专用集成电路(application specificintegrated circuit，简称ASIC)、现成可编程门阵列(field programmable gate array，简称FPGA)或者其他可编程逻辑器件、分立门或者晶体管逻辑器件、分立硬件组件等。通用处理器可以是微处理器或者该处理器也可以是任何常规的处理器等。
还应理解，本申请实施例中的存储器可以是易失性存储器或非易失性存储器，或可包括易失性和非易失性存储器两者。其中，非易失性存储器可以是只读存储器(read-only memory，简称ROM)、可编程只读存储器(programmable ROM，简称PROM)、可擦除可编程只读存储器(erasable PROM，简称EPROM)、电可擦除可编程只读存储器(electricallyEPROM，简称EEPROM)或闪存。易失性存储器可以是随机存取存储器(random accessmemory，简称RAM)，其用作外部高速缓存。通过示例性但不是限制性说明，许多形式的随机存取存储器(random access memory，简称RAM)可用，例如静态随机存取存储器(staticRAM，简称SRAM)、动态随机存取存储器(DRAM)、同步动态随机存取存储器(synchronousDRAM，简称SDRAM)、双倍数据速率同步动态随机存取存储器(double data rate SDRAM，简称DDR SDRAM)、增强型同步动态随机存取存储器(enhanced SDRAM，简称ESDRAM)、同步连接动态随机存取存储器(synchlink DRAM，简称SLDRAM)和直接内存总线随机存取存储器(direct rambus RAM，简称DR RAM)。
本发明实施例还提供了一种终端，包括存储器和处理器，所述存储器上存储有能够在所述处理器上运行的计算机程序，所述处理器运行所述计算机程序时执行上述方法的步骤。所述终端包括但不限于手机、计算机、平板电脑等终端设备。
具体地，本申请实施例中的终端可以指各种形式的用户设备(user equipment，简称UE)、接入终端、用户单元、用户站、移动站、移动台(mobile station，简称MS)、远方站、远程终端、移动设备、用户终端、终端设备(terminal equipment)、无线通信设备、用户代理或用户装置。终端设备还可以是蜂窝电话、无绳电话、会话启动协议(Session InitiationProtocol，简称SIP)电话、无线本地环路(Wireless Local Loop，简称WLL)站、个人数字处理(Personal Digital Assistant，简称PDA)、具有无线通信功能的手持设备、计算设备或连接到无线调制解调器的其它处理设备、车载设备、可穿戴设备，未来5G网络中的终端设备或者未来演进的公用陆地移动通信网络(Public Land Mobile Network，简称PLMN)中的终端设备等，本申请实施例对此并不限定。
关于上述实施例中描述的各个装置、产品包含的各个模块/单元，其可以是软件模块/单元，也可以是硬件模块/单元，或者也可以部分是软件模块/单元，部分是硬件模块/单元。例如，对于应用于或集成于芯片的各个装置、产品，其包含的各个模块/单元可以都采用电路等硬件的方式实现，或者，至少部分模块/单元可以采用软件程序的方式实现，该软件程序运行于芯片内部集成的处理器，剩余的(如果有)部分模块/单元可以采用电路等硬件方式实现；对于应用于或集成于芯片模组的各个装置、产品，其包含的各个模块/单元可以都采用电路等硬件的方式实现，不同的模块/单元可以位于芯片模组的同一组件(例如芯片、电路模块等)或者不同组件中，或者，至少部分模块/单元可以采用软件程序的方式实现，该软件程序运行于芯片模组内部集成的处理器，剩余的(如果有)部分模块/单元可以采用电路等硬件方式实现；对于应用于或集成于终端的各个装置、产品，其包含的各个模块/单元可以都采用电路等硬件的方式实现，不同的模块/单元可以位于终端内同一组件(例如，芯片、电路模块等)或者不同组件中，或者，至少部分模块/单元可以采用软件程序的方式实现，该软件程序运行于终端内部集成的处理器，剩余的(如果有)部分模块/单元可以采用电路等硬件方式实现。
虽然本发明披露如上，但本发明并非限定于此。任何本领域技术人员，在不脱离本发明的精神和范围内，均可作各种更动与修改，因此本发明的保护范围应当以权利要求所限定的范围为准。
Claims (10)
1.一种译码方法，其特征在于，包括：
接收PDSCH；
确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；
如果所述第一剩余处理时长大于等于预设处理时长，则采用预设的第一首次迭代次数对第一个CB进行译码；
如果所述第一剩余处理时长小于所述预设处理时长，则采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；
其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
2.根据权利要求1所述的译码方法，其特征在于，所述第一首次迭代次数为所述第二首次迭代次数的预设倍数；
其中，用于接收所述PDSCH的信道质量越好，所述预设倍数越大。
3.根据权利要求1所述的译码方法，其特征在于，采用下述公式，确定所述第一首次迭代次数：
其中，IH用于表示第一首次迭代次数，N1用于表示从接收PDSCH至上报确认信息之间的预定义时长，CBnum用于表示所述PDSCH包含的CB个数，TCB用于表示对单个CB进行译码的译码时长。
4.根据权利要求1所述的译码方法，其特征在于，还包括：
每当完成对第n-1个CB的译码时，确定当前时刻至上报所述确认信息之间的第n剩余处理时长；
如果所述第n剩余处理时长大于等于对单个CB进行译码的译码时长，则根据当前剩余CB个数以及所述第n剩余处理时长，确定第n CB迭代次数，并采用所述第n CB迭代次数对第n个CB进行译码；
其中，n为正整数，且n≥2。
5.根据权利要求4所述的译码方法，其特征在于，采用下述公式，根据当前剩余CB个数以及所述第n剩余处理时长，确定所述第n CB迭代次数：
其中，In用于表示第n CB迭代次数，Tn用于表示所述第n剩余处理时长，CBrem用于表示所述当前剩余CB个数，TCB用于表示对单个CB进行译码的译码时长。
6.根据权利要求4所述的译码方法，其特征在于，还包括：
如果所述第n剩余处理时长小于对单个CB进行译码的译码时长，则结束对所述PDSCH的译码并上报所述确认信息。
7.根据权利要求1所述的译码方法，其特征在于，
采用迭代译码算法进行译码；
其中，所述迭代译码算法选自：置信度传播译码算法、最小和译码、分层最小和译码算法、分层置信度传播译码算法、带偏移因子的分层最小和译码算法。
8.一种译码装置，其特征在于，包括：
接收模块，用于接收PDSCH；
时长确定模块，用于确定当前时刻至上报所述PDSCH的确认信息之间的第一剩余处理时长；
第一译码模块，用于当所述第一剩余处理时长大于等于预设处理时长时，采用预设的第一首次迭代次数对第一个CB进行译码；
第二译码模块，用于当所述第一剩余处理时长小于所述预设处理时长时，采用预设的第二首次迭代次数对第一个CB进行译码，其中，第二首次迭代次数小于第一首次迭代次数；
其中，所述预设处理时长为从接收PDSCH至上报确认信息之间的预定义时长。
9.一种可读存储介质，其上存储有计算机程序，其特征在于，所述计算机程序被处理器运行时执行权利要求1至7任一项所述译码方法的步骤。
10.一种终端，包括存储器和处理器，所述存储器上存储有能够在所述处理器上运行的计算机程序，其特征在于，所述处理器运行所述计算机程序时执行权利要求1至7任一项所述译码方法的步骤。
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