CN113066443B - 像素驱动电路及驱动方法 - Google Patents

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Abstract

本申请提供一种像素驱动电路及驱动方法，包括：存储器，用于存储数据信号；控制模块，分别与发光元件的供电电压端、存储器和驱动模块连接，用于检测存储器的工作电压和供电电压端的供电电压，并在存储器在上电下电的过程中，根据供电电压和存储器的工作电压控制驱动模块关断；驱动模块，与发光元件的第一端连接，用于向发光元件提供驱动电流；发光元件，发光元件的第二端与公共电极连接，能够在存储器在上电下电的过程中，避免微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。

Description

像素驱动电路及驱动方法
技术领域
本申请属于显示技术领域，尤其涉及一种像素驱动电路及驱动方法。
背景技术
微显示器中包括存储器，用于存储数据信号。相关技术中，存储器在上电或下电的过程会导致微显示器显示的画面出现乱码，残影等现象。
发明内容
本申请实施例提供了一种像素驱动电路及驱动方法，能够避免微显示器显示的画面出现乱码，残影等现象，硅基微显示器的显示效果。
第一方面，本申请实施例提供一种像素驱动电路，包括：
存储器，用于存储数据信号；
控制模块，分别与发光元件的供电电压端和存储器连接，用于检测存储器的工作电压，并在供电电压端或存储器在上电下电的过程中，根据供电电压端输入的供电电压和存储器的工作电压控制驱动模块关断；
驱动模块，分别与控制模块和发光元件的第一端连接，用于向发光元件提供驱动电流；
发光元件，发光元件的第二端与公共电极连接。
在一种可能的实现方式中，控制模块包括：
第一开关，第一开关的第一端与存储器连接，第一开关的第二端与驱动模块的控制端连接；
第二开关，第二开关的第一端与供电电压端连接，第二开关的第二端与驱动模块的控制端连接；
电压检测单元，分别与存储器、供电电压端和第二开关的控制端连接，用于检测存储器的工作电压，并在供电电压端或存储器在上电下电的过程中，根据供电电压和存储器的工作电压生成第一电位信号，根据第一电位信号控制第二开关的控制端的电位为第一电位，以使驱动模块关断。
在一种可能的实现方式中，电压检测单元包括：
逻辑电路，用于在供电电压端或存储器在上电下电的过程中，对供电电压和存储器的工作电压进行逻辑组合运算，生成第一电位信号。
在一种可能的实现方式中，第一开关为N型晶体管，第二开关为第一P型晶体管；
第一P型晶体管的第一端与供电电压端连接，第一P型晶体管的第二端与驱动模块的控制端连接，第一P型晶体管的控制端与电压检测单元连接；
N型晶体管的控制端与第一P型晶体管的控制端连接，N型晶体管的第一端与存储器连接，N型晶体管的第二端与驱动模块的控制端连接。
在一种可能的实现方式中，驱动模块包括晶体管；
晶体管的第一端与供电电压端连接，晶体管的第二端与发光元件的第二端连接，晶体管的控制端与第一P型晶体管的第二端连接，晶体管的控制端与N型晶体管的第二端连接。
在一种可能的实现方式中，控制模块包括：
第三开关，第三开关的第一端与供电电压端连接，第三开关的第二端与驱动模块的第一端连接；
电压检测单元，分别与存储器、供电电压端和第三开关的控制端连接，用于检测存储器的工作电压，并在供电电压端或存储器在上电下电的过程中，根据供电电压和存储器的工作电压生成第三电位信号，控制第三开关的控制端的电位为第三电位，以使驱动模块关断。
在一种可能的实现方式中，电压检测单元包括：
逻辑电路，用于在供电电压端或存储器在上电下电的过程中，对供电电压和存储器的工作电压进行逻辑组合运算，生成第三电位信号。
在一种可能的实现方式中，第三开关为第二P型晶体管；
第二P型晶体管的控制端与电压检测单元连接，第二P型晶体管的第一端与供电电压端连接，第二P型晶体管的第二端与驱动模块的第一端连接。
在一种可能的实现方式中，驱动模块包括晶体管；
晶体管的控制端与存储器连接，晶体管的第二端与发光元件连接，晶体管的第一端与第二P型晶体管的第二端连接。
第二方面，提供了一种驱动方法，应用于第一方面以及第一方面任一种可能的实现方式中的像素驱动电路，包括：
像素驱动电路中的控制模块检测像素驱动电路中存储器的工作电压；在供电电压端或存储器在上电下电的过程中，根据像素驱动电路中发光元件的供电电压端输入的供电电压和存储器的工作电压控制像素驱动电路中的驱动模块关断；
在驱动模块导通的情况下，驱动模块向发光元件提供驱动电流，以驱动发光元件发光。
第三方面，提供了一种显示面板，包括第一方面以及第一方面任一种可能的实现方式中的像素驱动电路。
第四方面，提供了一种微显示器，包括第三方面的显示面板。
在本申请中，通过控制模块与供电电压和存储器连接，从而能够检测存储器的工作电压，在供电电压端或存储器在上电下电的过程中，能够根据供电电压和工作电压控制驱动模块关断，由于存储器在上电下电的过程中工作电压是不稳定的，导致存储器中的数据处于乱码状态，而控制模块能够控制驱动模块关断，如此，微显示器不会显示乱码状态的数据对应的图片、视频等，避免了微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。
附图说明
从下面结合附图对本发明的具体实施方式的描述中可以更好地理解本申请。其中，相同或相似的附图标记表示相同或相似的特征。
图1为本申请实施例提供的一种像素驱动电路的结构示意图之一；
图2为本申请实施例提供的一种像素驱动电路的结构示意图之二；
图3为本申请实施例提供的一种像素驱动电路的结构示意图之三；
图4为本申请实施例提供的一种像素驱动电路的驱动时序图之一；
图5为本申请实施例提供的一种像素驱动电路的驱动时序图之二；
图6为本申请实施例提供的一种像素驱动电路的结构示意图之四；
图7为本申请实施例提供的一种像素驱动电路的结构示意图之五；
图8为本申请实施例提供的一种像素驱动电路的驱动时序图之三；
图9为本申请实施例提供的一种像素驱动电路的驱动时序图之四；
图10为本申请一实施例提供的驱动方法的流程示意图。
具体实施方式
下面将详细描述本发明的各个方面的特征和示例性实施例，为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本发明进行进一步详细描述。应理解，此处所描述的具体实施例仅被配置为解释本发明，并不被配置为限定本发明。对于本领域技术人员来说，本发明可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本发明的示例来提供对本发明更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，在描述部件的结构时，当将一层、一个区域称为位于另一层、另一个区域“上面”或“上方”时，可以指直接位于另一层、另一个区域上面，或者在其与另一层、另一个区域之间还包含其它的层或区域。并且，如果将部件翻转，该一层、一个区域将位于另一层、另一个区域“下面”或“下方”。
本申请实施例提供了一种像素驱动电路及驱动方法，能够避免微显示器显示的画面出现乱码，残影等现象，提高了微显示器的显示效果。
图1为本申请实施例提供的一种像素驱动电路100的结构示意图。如图1所示，该像素驱动电路100可以包括存储器11、控制模块12、驱动模块13和发光元件D1。
存储器11能够存储数据信号。例如，视频数据、图像数据等。其中，存储器11可以是静态随机存取存储器(Static Random-Access Memory，SRAM)。
发光元件D1可根据显示面板的类型选定，在此并不限定。具体的，发光元件D1的第二端与公共电极VCOM连接。
驱动模块13与发光元件D1的第一端连接，可用于向发光元件D1提供驱动电流。具体地，可通过控制驱动模块13的导通和关断，以控制驱动电流是否能通过驱动模块13流向发光元件D1。
控制模块12分别与发光元件D1的供电电压端VOLED、存储器11和驱动模块13连接，控制模块12能够控制驱动模块的导通或关断。具体地，控制模块12用于实时检测存储器11的工作电压和供电电压端VOLED的供电电压，并在检测到供电电压端VOLED或存储器11在上电下电过程中的情况下，控制模块12根据供电电压和工作电压，控制驱动模块13关断。由于供电电压端VOLED或存储器11在上电下电的过程中电压均是不稳定的，导致存储器11中的数据处于乱码状态，而控制模块12能够控制驱动模块13关断，如此，微显示器不会显示乱码状态的数据对应的图片、视频等，避免了微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。
控制模块12可以通过工作电压和供电电压生成电位信号，进而控制驱动模块13的导通或关断。下面控制模块12的具体结构进行详细介绍。
在本申请的一些实施例中，如图2所示，为了避免微显示器显示的画面出现乱码，残影等现象，控制模块12可以包括第一开关21、第二开关22和电压检测单元23。
第一开关21的第一端与存储器11连接，第一开关21的第二端与驱动模块13的控制端连接。
第二开关22的第一端与供电电压端VOLED连接，第二开关22的第二端与驱动模块13的控制端连接。
电压检测单元23，分别与存储器11、供电电压端VOLED和第二开关22的控制端连接。电压检测单元23能够检测存储器11的工作电压，并在存储器11在上电下电的过程中，根据供电电压和存储器11的工作电压生成第一电位信号，根据第一电位信号控制第二开关22的控制端的电位为第一电位，以使驱动模块13关断。
在本申请的一个实施例中，电压检测单元23包括逻辑电路。在检测到存储器11处在上电或下电的过程中时，对供电电压和存储器11的工作电压进行逻辑组合运算后，生成第一电位信号。其中，第一电位信号为低电位信号。
需要说明的是，供电电压和工作电压均为数字信号。在一些实施例中，电压检测单元23检测到的供电电压和存储器的工作电压均可以为数字信号，也可以为模拟信号，当供电电压和存储器的工作电压均为模拟信号的情况下，可以预先对存储器的工作电压和供电电压进行模数转换处理，将存储器的工作电压对应的模拟信号转换为工作电压对应的数字信号，将供电电压对应的模拟信号转换为供电电压对应的数字信号，然后逻辑电路根据存储器的工作电压对应的数字信号和供电电压对应的数字信号进行组合逻辑运算，从而得到电位信号。
在本申请一些实施例中，可以通过电压检测单元23对工作电压和供电电压进行模数转换处理。例如，电压检测单元23还可以包括第一电压检测器和第二电压检测器，第一电压检测器用于检测供电电压，并将供电电压进行模数转换处理，得到数字信号形式的供电电压。第二电压检测器用于检测存储器的工作电压，并将存储器的工作电压进行模数转换处理，得到数字信号形式的工作电压。
本申请实施例中的像素驱动电路可由晶体管等器件实现。其中，晶体管可为P型晶体管或N型晶体管，在此并不限定。具体地，在本申请的一些实施例中，如图3所示，第一开关可以是N型晶体管N1，第二开关为第一P型晶体管P1。
第一P型晶体管P1的第一端与供电电压连接，第一P型晶体管P1的第二端与驱动模块13的控制端连接，第一P型晶体管P1的控制端与电压检测单元23连接。
N型晶体管N1的控制端与第一P型晶体管P1的控制端连接，N型晶体管N1的第一端与存储器11连接，N型晶体管N1的第二端与驱动模块13的控制端连接。
在本申请的一些实施例中，驱动模块13包括晶体管P2。以晶体管P2为P型晶体管为例，晶体管P2的第一端与供电电压端VOLED连接，晶体管P2的第二端与发光元件D1的第二端连接，晶体管P2的控制端与第一P型晶体管P1的第二端连接，晶体管P2的控制端与N型晶体管N1的第二端连接。
在图3所示的像素驱动电路中，N型晶体管N1的控制端为栅极，N型晶体管N1的第一端可以为漏极，N型晶体管N1的第二端可以为源极。第一P型晶体管P1的控制端为栅极、第一P型晶体管P1的第一端为源极，第一P型晶体管P1的第二端为漏极。晶体管P2的控制端为栅极、晶体管P2的第一端为源极，晶体管P2的第二端为漏极。
如图4所示的时序图，在供电电压端VOLED上电(t11)过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成低电位信号，从而使得在供电电压端VOLED上电(t11)过程中，当第一P型晶体管P1的控制端A为低电位时，第一P型晶体管P1导通，晶体管P2的控制端B的电位跟随供电电压端VOLED的电压，从而控制晶体管P2关断，如此，晶体管P2无法控制发光元件D1发光，即使供电电压端在上电过程中的供电电压不稳定，微显示器也不会显示乱码状态的数据对应的图片、视频等。
在存储器11上电(t12)的过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成低电位信号，进而第一P型晶体管P1的控制端A的电位为低电位。当第一P型晶体管P1的控制端A为低电位时，N型晶体管关断，进而将存储器和晶体管P2隔开，且第一P型晶体管P1导通，晶体管P2的控制端B的电位跟随供电电压端VOLED的电压，从而控制晶体管P2关断，如此，晶体管P2无法控制发光元件D1发光，即使存储器在上电过程中的工作电压不稳定，微显示器不会显示乱码状态的数据对应的图片、视频等。
在存储器11的电压稳定且供电电压端VOLED的供电电压稳定后(t13)，电压检测单元能够根据存储器11的工作电压和供电电压输出高电位信号，进而第一P型晶体管P1的控制端A的电位为高电位。当第一P型晶体管P1的控制端A为高电位时，N型晶体管导通，进而向晶体管P2提供数据信号。第一P型晶体管P1关断，晶体管P2的控制端B的电位跟随存储器11的电压，从而控制晶体管P2导通，控制发光元件D1发光。
如图5所示的时序图，在存储器11下电(t21)的过程中，电压检测单元能够根据存储器11的工作电压和供电电压输出低电位信号，进而第一P型晶体管P1的控制端A的电位为低电位。当第一P型晶体管P1的控制端A为低电位时，N型晶体管关断，进而将存储器和晶体管P2隔开。第一P型晶体管P1导通，晶体管P2的控制端B的电位跟随供电电压端VOLED的电压，从而控制晶体管P2关断，如此，晶体管P2无法控制发光元件D1发光，即使存储器的工作电压不稳定，造成存储器中的数据乱码，微显示器不会显示乱码状态的数据对应的图片、视频等。
在供电电压端VOLED下电(t22)过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成低电位信号，从而使得在供电电压端VOLED上电(t21)过程中，当第一P型晶体管P1的控制端A为低电位时，晶体管P2的控制端B的电位跟随供电电压端VOLED的电压，从而控制晶体管P2关断，如此，晶体管P2无法控制发光元件D1发光，即使供电电压端在下电过程中的供电电压不稳定，微显示器也不会显示乱码状态的数据对应的图片、视频等。
在存储器11和供电电压端VOLED均完成下电后(t23)，电压检测单元能够根据存储器11的工作电压和供电电压输出低电位信号，进而第一P型晶体管P1的控制端A的电位为低电位。当第一P型晶体管P1的控制端A为低电位时，第一P型晶体管P1导通，N型晶体管关断。晶体管P2的控制端B的电位跟随存储器11的电压为低电位，而存储器11和供电电压端VOLED均完成下电，也即晶体管P2没有供电电压，且晶体管P2的控制端也没有任何数据电压，因此，晶体管P2关断，如此，晶体管P2在存储器开始下电的瞬间关断，从而避免了微显示器出现乱码。残影等现象。
如此，在存储器处于上电下电的过程中，电压检测单元23能够将第一P型晶体管的控制端的电位维持在低电位，从而使得在存储器处于上电下电的过程中，晶体管P2的控制端电位瞬间拉高，从而变为关断状态，如此，微显示器可以瞬间熄灭，不会显示乱码状态的数据对应的图片、视频等，避免了微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。
在本申请的另一些实施例中，如图6所示，为了避免微显示器显示的画面出现乱码，残影等现象，控制模块12可以包括第三开关61和电压检测单元62。
第三开关61的第一端与供电电压端VOLED连接，第三开关61的第二端与驱动模块13的第一端连接；
电压检测单元62分别与存储器11、供电电压端VOLED和第三开关61的控制端连接，用于检测存储器11的工作电压，并在存储器11在上电下电的过程中，根据供电电压和存储器11的工作电压生成第三电位信号，控制第三开关61的控制端的电位为第三电位，以使驱动模块13关断。
在本申请的一些实施例中，电压检测单元52包括逻辑电路。逻辑电路在检测到存储器11在上电或下电过程中时，对供电电压和存储器11的工作电压进行逻辑组合运算后，生成第三电位信号。其中，第三电位信号为高电位信号。
本申请实施例中的像素驱动电路可由晶体管等器件实现。其中，晶体管可为P型晶体管或N型晶体管，在此并不限定。下面以第三开关为P型晶体管为例，对本申请实施例中的像素驱动电路进行详细说明。
在本申请的一些实施例中，如图7所示，第三开关为第二P型晶体管P3。第二P型晶体管P3的控制端与电压检测单元23连接，第二P型晶体管的第一端与供电电压端VOLED连接，第二P型晶体管P3的第二端与驱动模块13的第一端连接。驱动模块包括晶体管P4。晶体管P4的控制端与存储器11连接，晶体管P4的第二端与发光元件D1连接，晶体管P4的第一端与第二P型晶体管P3的第二端连接。
在图7所示的像素驱动电路中，第二P型晶体管P3的控制端为栅极、第二P型晶体管P3的第一端为源极、第二P型晶体管P3的第二端为漏极。晶体管P4的控制端为栅极、晶体管P4的第一端为源极，晶体管P4的第二端为漏极。
如图8所示的时序图，在供电电压端VOLED上电(t31)的过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成高电位信号，从而使得在供电电压端VOLED上电(t31)过程中，第二P型晶体管P3的控制端A为高电位，第二P型晶体管P3关断，晶体管P4关断，如此，晶体管P2无法控制发光元件D1发光，即使供电电压端在上电过程中的供电电压不稳定，微显示器也不会显示乱码状态的数据对应的图片、视频等。
在存储器11上电(t32)的过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成高电位信号，从而使得在供电电压端VOLED上电(t31)过程中，第二P型晶体管P3的控制端A为高电位，第二P型晶体管P3关断，晶体管P4关断，如此，晶体管P2无法控制发光元件D1发光，微显示器不会显示乱码状态的数据对应的图片、视频等。
在存储器11的电压稳定且供电电压端VOLED的供电电压稳定后(t33)，电压检测单元能够供电电压VOLED和存储器的工作电压Vsram生成输出低电位信号，第二P型晶体管P3的控制端A为低电位，第二P型晶体管P3导通，从而控制晶体管P4导通，控制发光元件D1发光。
如图9所示的时序图，在存储器11下电(t41)的过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成高电位信号，从而使得在供电电压端VOLED上电(t31)过程中，第二P型晶体管P3的控制端A为高电位，第二P型晶体管P3关断，晶体管P4关断，如此，晶体管P2无法控制发光元件D1发光，微显示器不会显示乱码状态的数据对应的图片、视频等。
在供电电压端VOLED下电(t42)的过程中，电压检测单元可以根据供电电压VOLED和存储器的工作电压Vsram生成高电位信号，从而使得在供电电压端VOLED上电(t42)过程中，第二P型晶体管P3的控制端A为高电位，第二P型晶体管P3关断，晶体管P4关断，如此，晶体管P2无法控制发光元件D1发光，微显示器不会显示乱码状态的数据对应的图片、视频等。
在存储器11和供电电压端VOLED均完成下电后(t43)，电压检测单元能够供电电压VOLED和存储器的工作电压Vsram生成输出低电位信号，第二P型晶体管P3的控制端A为低电位，而存储器11和供电电压端VOLED均完成下电，从而使得第二P型晶体管P3关断，从而控制晶体管P4关断。
在本申请实施例中，通过控制模块与供电电压和存储器连接，从而能够检测存储器的工作电压，在存储器在上电下电的过程中，能够根据供电电压和工作电压控制驱动模块关断，由于存储器在上电下电的过程中工作电压是不稳定的，导致存储器中的数据处于乱码状态，而控制模块能够控制驱动模块关断，如此，微显示器不会显示乱码状态的数据对应的图片、视频等，避免了微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。
基于上述实施例中的像素驱动电路，本申请实施例还提供了一种驱动方法。
如图10所示，本申请实施例提供的驱动方法，可以包括S1001和S1002。
S1001：像素驱动电路中的控制模块检测像素驱动电路中存储器的工作电压；在供电电压端或存储器在上电下电的过程中，根据像素驱动电路中发光元件的供电电压端输入的供电电压和存储器的工作电压控制像素驱动电路中的驱动模块关断。
S1002：在驱动模块导通的情况下，驱动模块向发光元件提供驱动电流，以驱动发光元件发光。
需要说明的是，S1001和S1002为上述图1至图9对应实施例的驱动方法，因此，S1001和S1002的内容与图1至图9对应实施例的内容相同，为了简要起见，S1001和S1002的详细说明请参见图1至图9对应实施例的详细说明，此处不在重复。
在本申请实施例中，通过控制模块与供电电压和存储器连接，从而能够检测存储器的工作电压，在存储器在上电下电的过程中，能够根据供电电压和工作电压控制驱动模块关断，由于存储器在上电下电的过程中工作电压是不稳定的，导致存储器中的数据处于乱码状态，而控制模块能够控制驱动模块关断，如此，微显示器不会显示乱码状态的数据对应的图片、视频等，避免了微显示器显示的画面出现乱码，残影等现象，提高了显示器的显示效果。
本申请还提供了一种显示面板，该显示面板可包括上述实施例中的像素驱动电路。该显示面板具体可以是硅基液晶(Liquid Crystal on Silicon，LCOS)显示面板，MicroLED显示面板和Micro OLED显示面板等，在此并不限定。
本申请还提供了一种微显示器。该微显示器可包括设备本体以及上述实施例中的显示面板，该显示面板覆盖在设备本体上。设备本体中可设置有各类器件，如传感器件、处理器件等，在此并不限定。显示装置具体可以为手机、计算机、平板电脑、数码相框、电视机、电子纸等具有显示功能的装置，在此并不限定。
需要明确的是，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同或相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。对于显示面板实施例和显示装置实施例而言，相关之处可以参见像素驱动电路实施例和阵列基板实施例的说明部分。本申请并不局限于上文所描述并在图中示出的特定结构。本领域的技术人员可以在领会本申请的精神之后，作出各种改变、修改和添加。并且，为了简明起见，这里省略对已知技术的详细描述。
本领域技术人员应能理解，上述实施例均是示例性而非限制性的。在不同实施例中出现的不同技术特征可以进行组合，以取得有益效果。本领域技术人员在研究附图、说明书及权利要求书的基础上，应能理解并实现所揭示的实施例的其他变化的实施例。在权利要求书中，术语“包括”并不排除其他结构；数量涉及“一个”但不排除多个；术语“第一”、“第二”用于标示名称而非用于表示任何特定的顺序。权利要求中的任何附图标记均不应被理解为对保护范围的限制。某些技术特征出现在不同的从属权利要求中并不意味着不能将这些技术特征进行组合以取得有益效果。

Claims (8)

1.一种像素驱动电路，其特征在于，包括：
存储器，用于存储数据信号；
控制模块，分别与发光元件的供电电压端、所述存储器和驱动模块连接，用于检测所述存储器的工作电压和所述供电电压端的供电电压，并在所述供电电压端或存储器在上电下电的过程中，根据所述供电电压和所述存储器的工作电压控制所述驱动模块关断；
所述驱动模块，与所述发光元件的第一端连接，用于向所述发光元件提供驱动电流；
所述发光元件，所述发光元件的第二端与公共电极连接；
所述控制模块包括：
第一开关，所述第一开关的第一端与所述存储器连接，所述第一开关的第二端与所述驱动模块的控制端连接；
第二开关，所述第二开关的第一端与所述供电电压端连接，所述第二开关的第二端与所述驱动模块的控制端连接；
电压检测单元，分别与所述存储器、所述供电电压端和所述第二开关的控制端连接，用于检测所述存储器的工作电压，并在所述供电电压端或所述存储器在上电下电的过程中，根据所述供电电压和所述存储器的工作电压生成第一电位信号，根据所述第一电位信号控制所述第二开关的控制端的电位为第一电位，以使所述驱动模块关断；
或，所述控制模块包括：
第三开关，所述第三开关的第一端与所述供电电压端连接，所述第三开关的第二端与所述驱动模块的第一端连接；
电压检测单元，分别与所述存储器、所述供电电压端和所述第三开关的控制端连接，用于检测所述存储器的工作电压，并在所述供电电压端或所述存储器在上电下电的过程中，根据所述供电电压和所述存储器的工作电压生成第三电位信号，控制所述第三开关的控制端的电位为第三电位，以使所述驱动模块关断。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述电压检测单元包括：
逻辑电路，用于在所述供电电压端或所述存储器在上电下电的过程中，对所述供电电压和所述存储器的工作电压进行逻辑组合运算，生成所述第一电位信号。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述第一开关为N型晶体管，所述第二开关为第一P型晶体管；
所述第一P型晶体管的第一端与所述供电电压端连接，所述第一P型晶体管的第二端与所述驱动模块的控制端连接，所述第一P型晶体管的控制端与所述电压检测单元连接；
所述N型晶体管的控制端与所述第一P型晶体管的控制端连接，所述N型晶体管的第一端与所述存储器连接，所述N型晶体管的第二端与所述驱动模块的控制端连接。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述驱动模块包括晶体管；
所述晶体管的第一端与所述供电电压连接，所述晶体管的第二端与所述发光元件的第二端连接，所述晶体管的控制端与所述第一P型晶体管的第二端连接，所述晶体管的控制端与所述N型晶体管的第二端连接。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述电压检测单元包括：
逻辑电路，用于在所述供电电压端或所述存储器在上电下电的过程中，对所述供电电压和所述存储器的工作电压进行逻辑组合运算，生成所述第三电位信号。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述第三开关为第二P型晶体管；
所述第二P型晶体管的控制端与所述电压检测单元连接，所述第二P型晶体管的第一端与所述供电电压端连接，所述第二P型晶体管的第二端与所述驱动模块的第一端连接。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述驱动模块包括晶体管；
所述晶体管的控制端与所述存储器连接，所述晶体管的第二端与所述发光元件连接，所述晶体管的第一端与所述第二P型晶体管的第二端连接。
8.一种驱动方法，其特征在于，应用于权利要求1-7任一项所述的像素驱动电路，包括：
所述像素驱动电路中的控制模块检测所述像素驱动电路中存储器的工作电压；在所述供电电压端或所述存储器在上电下电的过程中，根据像素驱动电路中发光元件的供电电压端输入的供电电压和所述存储器的工作电压控制所述像素驱动电路中的驱动模块关断；
在所述驱动模块导通的情况下，驱动模块向所述发光元件提供驱动电流，以驱动所述发光元件发光。
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