CN111769835A - 一种基于fpga和iec60044-8标准的曼彻斯特码解码方法 - Google Patents
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Abstract
本发明提供一种基于FPGA和IEC60044‑8标准的曼彻斯特码解码方法,该曼彻斯特码解码方法包括步骤S1,对曼彻斯特码信号进行滤波处理;步骤S2,生成接收时钟并用于检测曼彻斯特码中的电平信号,接收时钟的频率为编码时钟频率的2倍;步骤S3,将接收时钟的下降沿与曼彻斯特码的电平下降沿对齐;步骤S4,采用接收时钟检测帧头;步骤S5,生成与编码时钟同频率的解码时钟,步骤S6,解码,采用解码时钟对接收时钟所检测到的曼彻斯特码进行采样,得到曼彻斯特码的比特信息。本发明很好的解决现有技术存在的曼彻斯特码解码对于时钟要求过高和解码逻辑较为复杂的问题。
Description
技术领域
本发明属于电力系统设备通信技术领域,具体涉及一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法。
背景技术
曼彻斯特编码是一种自同步的编码方式,即时钟同步信号就隐藏在数据波形中。曼彻斯特编码电平跳变的原则是:在时钟信号中间时刻进行下降沿跳变表示0,进行上升沿跳变表示1。这样可以防止时钟同步的丢失,或者因为时钟和数据传输的不同步导致数据接收错误等问题。但每一个码元都被调成两个电平,所以数据传输速率只有调制速率的一半。
解码时需要从接收信号中分离出曼彻斯特码中的时钟和数据信号,一般通过过采样的方式,推荐采用16倍曼彻斯特码信号频率的时钟信号,同时需要配合一个与曼彻斯特码同频的时钟信号。以高频对曼彻斯特码进行采样,如果发现当前采样值与前一个采样值不同,即检测到曼彻斯特码的跳变边沿,则可进行数据解码。
现有技术中的曼彻斯特码解码存在对于时钟要求过高和解码逻辑较为复杂的问题,因此,需要提供一种针对现有技术不足的改进技术方案。
发明内容
本发明的目的是提供一种基于FPGA和IEC60044-8标准的曼彻斯特解码方法,以解决现有技术中存在的曼彻斯特解码对于时钟要求过高和解码逻辑较为复杂的问题。
为了实现上述目的,本发明提供如下技术方案:
本发明提供一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述曼彻斯特码解码方法包括以下步骤:
步骤S1,对曼彻斯特码信号进行滤波处理;
步骤S2,生成接收时钟,所述接收时钟用于检测曼彻斯特码中的电平信号,所述接收时钟的频率为编码时钟频率的2倍;
步骤S3,将接收时钟的下降沿与曼彻斯特码的电平下降沿对齐;
步骤S4,采用接收时钟检测帧头,所述帧头与曼彻斯特码的电平相对应;
步骤S5,生成与编码时钟同频率的解码时钟,所述解码时钟可用于解析曼彻斯特码;
步骤S6,解码,采用解码时钟对接收时钟所检测到的曼彻斯特码进行采样,得到曼彻斯特码的比特信息。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,所述步骤S4具体为:当接收时钟检测到帧头时,生成与编码时钟同频率的解码时钟;当接收时钟未检测到帧头时,则继续利用接收时钟检测帧头。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,所述步骤S1中进行滤波处理是对曼彻斯特码信号中的短脉冲进行滤除。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,所述滤波处理具体为,将输入的曼彻斯特码存入到缓存中,始终检测缓存中的曼彻斯特码数据,当检测到的全为0时,则输出的曼彻斯特码为0,当检测到的全为1时,则输出的曼彻斯特码为1,当检测到的即有0也有1时,则输出的曼彻斯特码保持上一次状态不变。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,滤波器对小于4个滤波时钟的毛刺完全滤除。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,所述步骤S3中接收时钟中的上升沿对应曼彻斯特码相邻两次电平跳变正中间位置。
依据上述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,作为优选方案,所述步骤S4中的帧头是基于IEC60044-8标准所规定的帧头。
与最接近的现有技术相比,本发明提供的技术方案具有如下优异效果:
本发明提供一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,以解决现有技术存在的曼彻斯特码解码对于时钟要求过高和解码逻辑较为复杂的问题。现场可编程逻辑门阵列FPGA因为其并行处理的特性,相对于单片机或数字信号处理器DSP,FPGA可处理高速计算,适合用来进行高速曼彻斯特码解码,IEC60044-8标准规定了电子式互感器通信协议,该协议也广泛应用于电力系统设备通信,该协议采用曼彻斯特码。
本发明只在滤波器部分需要较高的时钟频率,但仍然低于常用曼彻斯特码解码方法所需频率,即16倍曼彻斯特码信号频率,其余部分最高是2倍曼彻斯特码频率,控制逻辑较为简单,FPGA代码编写工作量小,时序要求较低。
附图说明:
图1为本发明实施例中的曼彻斯特码解码流程示意图。
具体实施方式
下面将对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明的一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员所获得的所有其他实施例,都属于本发明保护的范围。
下面将参考附图并结合实施例来详细说明本发明。需要说明的是,在不冲突的情况下,本发明中的实施例及实施例中的特征可以相互组合。
如图1所示,本发明提供一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,该曼彻斯特码解码方法包括以下步骤:
步骤S1,对曼彻斯特码信号进行滤波处理,将输入的曼彻斯特码存入到缓存中,始终检测缓存中的曼彻斯特码,经过滤波处理后,若检测到的全为0,则输出为0,若检测全为1,则输出为1,若检测到的数据即有0也有1,则输出的曼彻斯特码保持上一次的输出状态不变。
步骤S2,生成接收时钟,接收时钟用于检测曼彻斯特码中的电平信号,接收时钟的频率为编码时钟频率的2倍。
步骤S3,接收时钟的下降沿与曼彻斯特码的电平下降沿对齐,此时,接收时钟上升沿对应曼彻斯特码相邻两次电平跳变正中间的位置,有利于接收时钟读取稳定的曼彻斯特的电平。
步骤S4,采用接收时钟检测帧头,采用IEC60044-8标准规定接收时钟的帧头,当接收时钟检测到帧头时,生成与编码时钟同频率的解码时钟;当接收时钟未检测到帧头时,则继续利用接收时钟检测帧头;当然在具体应用时,不同设备选用不同的标准进行检测,帧头也存在差异。
步骤S5,生成与编码时钟同频率的解码时钟,解码时钟可直接用于解析曼彻斯特码。
步骤S6,解码,采用解码时钟对接收时钟所检测到的曼彻斯特码的电平进行采样,得到曼彻斯特码所代表的具体比特信息。
为更好的理解本发明,下面用一组实施例对本发明做进一步的解释说明,以曼彻斯特码传输信息10Mbit/s,其对应的编码时钟为10MHz为例:
步骤S1,对曼彻斯特码信号进行滤波,滤除短脉冲,使用120MHz时钟进行滤波运算,滤波运算的逻辑为将输入的曼彻斯特数据存入到宽度为4的缓存中,一直检测缓存中的曼彻斯特数据,若全为0,则输出数据为0,若全为1,则输出为1。若数据既有0也有1,则输出数据保持上一次输出状态不变,滤波器对于正常波形延迟4个时钟,小于4个时钟的毛刺被完全滤除。
毛刺被完全滤除具体为:例如对于数据1111 1111 1111,滤波后变为1111 11111111;对于数据1111 0111 1111,滤波后变为1111 1111 1111;对于数据1111 0011 1111,滤波后变为1111 1111 1111;对于数据1111 0001 1111,滤波后变为1111 1111 1111;对于数据1111 0000 1111,滤波后变为1111 0000 1111;
步骤S2,生成接收时钟,接收时钟用于检测曼彻斯特码中的电平信号,接收时钟的频率为编码时钟频率的2倍,即20MHz的接收时钟。
步骤S3,将接收时钟下降沿与曼彻斯特码中电平下降沿对齐,此时接收时钟上升沿基本对应曼彻斯特相邻两次电平跳变正中间,有利于读取稳定的曼彻斯特电平。
步骤S4,利用接收时钟检测帧头,本发明实施例中的帧头为16进制数据0564,所对应的曼彻斯特电平则为16进制数据AA99969A;例如,16进制数据转换为二进制为0101,转换成曼彻斯特电平则为16进制数据99。
步骤S5,生成与编码时钟同频率的10MHz解码时钟,解码时钟可直接用于解析曼彻斯特码。
步骤S6,解码,利用解码时钟对接收时钟检测到的曼彻斯特码电平进行采样,得到20Mbit/s的曼彻斯特电平信号,10MHz解码时钟对此进行采样,即可实现曼彻斯特码解码,得到曼彻斯特电平信号所包含的10Mbit/s比特信息,然后还可以将比特信息转换为字节,进而对字节进行效验或CRC(Cyclic Redundancy Check循环冗余校验)校验等操作,校验成功后可得到具体的通信内容。
综上所述,本发明提供一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,以解决现有技术存在的曼彻斯特码解码对于时钟要求过高和解码逻辑较为复杂的问题。现场可编程逻辑门阵列FPGA因为其并行处理的特性,相对于单片机或数字信号处理器DSP,FPGA可处理高速计算,适合用来进行高速曼彻斯特码解码,IEC60044-8标准规定了电子式互感器通信协议,该协议也广泛应用于电力系统设备通信,该协议采用曼彻斯特码。
本发明只在滤波器部分需要较高的时钟频率,但仍然低于常用曼彻斯特码解码方法所需频率,即16倍曼彻斯特码信号频率,其余部分最高是2倍曼彻斯特码频率,控制逻辑较为简单,FPGA代码编写工作量小,时序要求较低。
以上所述仅为本发明的较佳实施例而已,并不用以限制本发明,凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均在本发明待批权利要求保护范围之内。
Claims (7)
1.一种基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述曼彻斯特码解码方法包括以下步骤:
步骤S1,对曼彻斯特码信号进行滤波处理;
步骤S2,生成接收时钟,所述接收时钟用于检测曼彻斯特码中的电平信号,所述接收时钟的频率为编码时钟频率的2倍;
步骤S3,将接收时钟的下降沿与曼彻斯特码的电平下降沿对齐;
步骤S4,采用接收时钟检测帧头,所述帧头与曼彻斯特码的电平相对应;
步骤S5,生成与编码时钟同频率的解码时钟,所述解码时钟可用于解析曼彻斯特码;
步骤S6,解码,采用解码时钟对接收时钟所检测到的曼彻斯特码进行采样,得到曼彻斯特码的比特信息。
2.根据权利要求1所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述步骤S4具体为:当接收时钟检测到帧头时,生成与编码时钟同频率的解码时钟;
当接收时钟未检测到帧头时,则继续利用接收时钟检测帧头。
3.根据权利要求1所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述步骤S1中进行滤波处理是对曼彻斯特码信号中的短脉冲进行滤除。
4.根据权利要求3所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述滤波处理具体为,将输入的曼彻斯特码存入到缓存中,始终检测缓存中的曼彻斯特码数据,当检测到的全为0时,则输出的曼彻斯特码为0,当检测到的全为1时,则输出的曼彻斯特码为1,当检测到的即有0也有1时,则输出的曼彻斯特码保持上一次状态不变。
5.根据权利要求4所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,滤波器对小于4个滤波时钟的毛刺完全滤除。
6.根据权利要求3所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述步骤S3中接收时钟中的上升沿对应曼彻斯特码相邻两次电平跳变正中间位置。
7.根据权利要求1所述的基于FPGA和IEC60044-8标准的曼彻斯特码解码方法,其特征在于,所述步骤S4中的帧头是基于IEC60044-8标准所规定的帧头。
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