CN111413861A - 一种高压变频电机的主从控制系统及方法 - Google Patents

一种高压变频电机的主从控制系统及方法 Download PDF

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CN111413861A
CN111413861A CN202010243523.4A CN202010243523A CN111413861A CN 111413861 A CN111413861 A CN 111413861A CN 202010243523 A CN202010243523 A CN 202010243523A CN 111413861 A CN111413861 A CN 111413861A
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耿宏涛
陆炜
闻静远
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Suzhou Saner Electric Co ltd
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Suzhou Saner Electric Co ltd
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    • G—PHYSICS
    • G05—CONTROLLING; REGULATING
    • G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B9/00—Safety arrangements
    • G05B9/02—Safety arrangements electric
    • G05B9/03—Safety arrangements electric with multiple-channel loop, i.e. redundant control systems

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Automation & Control Theory (AREA)
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Abstract

本发明涉及电气控制技术领域，尤其为一种高压变频电机的主从控制系统及方法，包括ID1主控箱、ID2主控箱、ID3主控箱、F1光纤以及F2光纤，所述ID1主控箱配置在01模式，FPGA仅判断F1口接收通信故障；所述ID2主控箱配置在11模式，FPGA判断F1、F2口接收通信故障；所述ID3主控箱配置在10模式，FPGA仅判断F2口接收通信故障；所述F1光纤：Master port；所述F2光纤：Slave port；包括以下步骤：A、主机模式(ID1)；B、从机模式(ID3)；C、主机、从机模式(ID2)。本发明通过改进各阶段的控制模式，使得F1、F2处的串口通信更加稳定可靠，并分类调节主从控制运行时各阶段的数据读存，兼容性极强，从而大大提高了该系统运行时的稳定性并有效降低控制误差。

Description

一种高压变频电机的主从控制系统及方法
技术领域
本发明涉及电气控制技术领域，具体为一种高压变频电机的主从控制系统及方法。
背景技术
常见的高压变频电机基本采用三相供电方式，并通过外置的变频器对电机电源及输入电信号进行滤波、调压、稳压等处理，使得电机的电子电路具有更快的数据处理速度和更强的数据执行功能，进而提高该电机的运行性能。
但现有的高压变频电机中的主从控制系统及方法依然存在一定的问题，具体问题在于许多变频器中仅采用单一的主控模块，当用于调节电机正反转、转子转速等参数时，串口通信容易发生停顿或混乱，导致数据读存效率降低，进而造成电机运行不稳定或发生偏差等状况。
发明内容
本发明的目的在于提供一种高压变频电机的主从控制系统及方法，具备提高运行时的稳定性并降低控制误差的优点，以解决上述背景技术中提出的问题。
为实现上述目的，本发明提供如下技术方案：
一种高压变频电机的主从控制系统，包括ID1主控箱、ID2主控箱、ID3主控箱、F1光纤以及F2光纤，
所述ID1主控箱配置在01模式，FPGA仅判断F1口接收通信故障；
所述ID2主控箱配置在11模式，FPGA判断F1、F2口接收通信故障；
所述ID3主控箱配置在10模式，FPGA仅判断F2口接收通信故障；
所述F1光纤：Master port；
所述F2光纤：Slave port。
优选的，所述FPGA不需要关心ID1、ID2、ID3、F1以及F2这五个数据的具体定义，只需要使用串口协议正确循环传输。
优选的，所述F1光纤、F2光纤皆用作串口通信，并在配套的扩展板上预留有光纤位置。
一种高压变频电机的主从控制方法，包括以下步骤：
A、主机模式(ID1)：ID1_FPGA通过F1端口循环，依次发送从ID1_DSP接收来的地址Ram_16-21的数据；同时从F1端口接收来的数据依次放在Ram_141-146地址中，待DSP读取；
B、从机模式(ID3)：ID3_FPGA通过F2端口循环，依次发送从ID3_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，待DSP读取；
C、主机、从机模式(ID2)：ID2_FPGA会做步骤A和步骤B这两部分动作，即通过F1端口循环，依次发送从ID2_DSP接收来的地址Ram_16-21的数据(包括主从站信息)；通过F2端口发送从ID2_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，从F1口接收来的数据依次放在Ram_141-146地址中，待DSP读取。
与现有技术相比，本发明的有益效果如下：
通过分出主机模式(ID1)、从机模式(ID3)以及主机、从机模式(ID2)，使得F1、F2处的串口通信更加稳定可靠，并分类调节主从控制运行时各阶段的数据读存，兼容性极强，从而大大提高了该系统运行时的稳定性并有效降低控制误差。
附图说明
图1为本发明系统结构示意图；
图2为本发明系统流程示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
请参阅图1-2，实施例：
一种高压变频电机的主从控制系统，包括ID1主控箱、ID2主控箱、ID3主控箱、F1光纤以及F2光纤，
所述ID1主控箱配置在01模式，FPGA仅判断F1口接收通信故障；
所述ID2主控箱配置在11模式，FPGA判断F1、F2口接收通信故障；
所述ID3主控箱配置在10模式，FPGA仅判断F2口接收通信故障；
所述F1光纤：Master port；
所述F2光纤：Slave port。
所述FPGA不需要关心ID1、ID2、ID3、F1以及F2这五个数据的具体定义，只需要使用串口协议正确循环传输。
所述F1光纤、F2光纤皆用作串口通信，并在配套的扩展板上预留有光纤位置。
一种高压变频电机的主从控制方法，包括以下步骤：
A、主机模式(ID1)：ID1_FPGA通过F1端口循环，依次发送从ID1_DSP接收来的地址Ram_16-21的数据；同时从F1端口接收来的数据依次放在Ram_141-146地址中，待DSP读取；
B、从机模式(ID3)：ID3_FPGA通过F2端口循环，依次发送从ID3_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，待DSP读取；
C、主机、从机模式(ID2)：ID2_FPGA会做步骤A和步骤B这两部分动作，即通过F1端口循环，依次发送从ID2_DSP接收来的地址Ram_16-21的数据(包括主从站信息)；通过F2端口发送从ID2_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，从F1口接收来的数据依次放在Ram_141-146地址中，待DSP读取。
尽管已经示出和描述了本发明的实施例，对于本领域的普通技术人员而言，可以理解在不脱离本发明的原理和精神的情况下可以对这些实施例进行多种变化、修改、替换和变型，本发明的范围由所附权利要求及其等同物限定。

Claims (4)

1.一种高压变频电机的主从控制系统，包括ID1主控箱、ID2主控箱、ID3主控箱、F1光纤以及F2光纤，其特征在于：
所述ID1主控箱配置在01模式，FPGA仅判断F1口接收通信故障；
所述ID2主控箱配置在11模式，FPGA判断F1、F2口接收通信故障；
所述ID3主控箱配置在10模式，FPGA仅判断F2口接收通信故障；
所述F1光纤：Master port；
所述F2光纤：Slave port。
2.根据权利要求1所述的一种高压变频电机的主从控制系统，其特征在于：所述FPGA不需要关心ID1、ID2、ID3、F1以及F2这五个数据的具体定义，只需要使用串口协议正确循环传输。
3.根据权利要求1所述的一种高压变频电机的主从控制系统，其特征在于：所述F1光纤、F2光纤皆用作串口通信，并在配套的扩展板上预留有光纤位置。
4.根据权利要求1-3中任一所述的一种高压变频电机的主从控制方法，其特征在于：包括以下步骤：
A、主机模式(ID1)：ID1_FPGA通过F1端口循环，依次发送从ID1_DSP接收来的地址Ram_16-21的数据；同时从F1端口接收来的数据依次放在Ram_141-146地址中，待DSP读取；
B、从机模式(ID3)：ID3_FPGA通过F2端口循环，依次发送从ID3_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，待DSP读取；
C、主机、从机模式(ID2)：ID2_FPGA会做步骤A和步骤B这两部分动作，即通过F1端口循环，依次发送从ID2_DSP接收来的地址Ram_16-21的数据(包括主从站信息)；通过F2端口发送从ID2_DSP接收来的地址Ram_16-21的数据；同时从F2端口接收来的数据依次放在Ram_135-140地址中，从F1口接收来的数据依次放在Ram_141-146地址中，待DSP读取。
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US5202822A (en) * 1990-09-26 1993-04-13 Honeywell Inc. Universal scheme of input/output redundancy in a process control system
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CN203643761U (zh) * 2013-12-19 2014-06-11 上海新华控制技术集团科技有限公司 三重冗余同期控制模块
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