CN111352889A - 一种基于mctp协议的设备管理方法、设备、装置和介质 - Google Patents
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Abstract
本发明提供一种基于MCTP协议的设备管理方法、设备、装置和介质，该方法包括以下步骤：将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。本发明采用MCTP协议，符合Intel‑CPU的规范要求，较目前市面上主流的SMBus的传输方式，速率更快，并且一次传输的消息数据量更大。
Description
技术领域
本发明涉及计算机领域，并且更具体地，涉及一种基于MCTP协议的设备管理方法、设备、装置和介质。
背景技术
长期以来，设备管理被广泛应用于服务器或台式机行业，目前行业内普遍使用的是基于系统管理总线(SMBus)的设备管理系统。SMBus是一个两线接口，通过它各种设备之间以及设备与系统的其它部分之间可以通信。
但现有基于SMBus的设备管理存在以下缺陷：基于SMBus总线，传输速度慢，结构单一，容发生拥堵；基于SMBus的设备管理系统已经达到发展瓶颈；抗干扰能力差。
发明内容
鉴于此，本发明实施例的目的在于提出一种基于MCTP协议的设备管理方法、设备、装置和介质，将PCIE和MCTP结合，使其在设备管理中符合MCTP协议传输要求。
基于上述目的，本发明实施例的一方面提供了一种基于MCTP协议的设备管理方法，包括以下步骤：
将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；
顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；
响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
在一些实施方式中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中包括：
从所述MCTP包缓存模块中读取第一个128比特数据包，解析出传输媒介物理头字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给是所述PCIE主端的IP核进行处理。
在一些实施方式中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
从所述MCTP包缓存模块中读取第二个128比特数据包，按照保留位、头字段版本、目的EID、源EID、头标签、尾标签、包排序、方向和消息标签依次进行解析。
在一些实施方式中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
继续从所述MCTP包缓存模块中读取128比特数据包，以进行消息主体的解析，并将所述解析的消息主体存放在所述设备传输数据缓存中。
在一些实施方式中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
从所述MCTP包缓存模块中最后读取128比特数据包，解析出传输媒介物理尾字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给所述PCIE主端的IP核进行处理。
在一些实施方式中，所述方法基于FPGA实现。
本发明实施例的另一方面提供了一种基于MCTP协议的设备管理设备，包括：
PCIE协议层模块，配置为将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；
MCTP协议层模块，配置为顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；
数据响应模块，配置为响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
在一些实施方式中，所述MCTP协议层模块包括缓存控制模块，配置用于实现对所述MCTP包缓存模块进行丢包、乱序汇能和地址再分配。
本发明实施例的又一方面提供了一种基于MCTP协议的设备管理装置，包括：
至少一个处理器；和
存储器，所述存储器存储有处理器可运行的程序代码，所述程序代码在被处理器运行时实施上述任一项所述的方法。
本发明实施例的又一方面提供了一种计算机介质，包括可被处理器执行的程序代码，所述程序代码在被处理器执行时实施上述任一项所述的方法。
本发明具有以下有益技术效果：本发明实施例提供的一种基于MCTP协议的设备管理方法、设备、装置和介质解决了在CPU需要获取PCIE设备状态信息时，不能直接获取并且BMC与CPU交互时SMbus速率过慢的问题；采用MCTP协议，符合Intel-CPU的规范要求，较目前市面上主流的SMBus的传输方式，速率更快，并且一次传输的消息数据量更大，为MCTP后续广泛应用于BMC上提供了设计参考。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的实施例。
图1是实现PCIE设备与服务器CPU信息传递的示意图；
图2是根据本发明的一种基于MCTP协议的设备管理方法的流程图；
图3是根据本发明的数据传递的流向图；
图4是根据本发明的MCTP协议包字段图；
图5是根据本发明的进行数据解析的结构原理示意图；
图6是根据本发明的一种基于MCTP协议的设备管理装置的硬件结构示意图。
具体实施方式
以下描述了本发明的实施例。然而，应该理解，所公开的实施例仅仅是示例，并且其他实施例可以采取各种替代形式。附图不一定按比例绘制；某些功能可能被夸大或最小化以显示特定部件的细节。因此，本文公开的具体结构和功能细节不应被解释为限制性的，而仅仅是作为用于教导本领域技术人员以各种方式使用本发明的代表性基础。如本领域普通技术人员将理解的，参考任何一个附图所示出和描述的各种特征可以与一个或多个其他附图中所示的特征组合以产生没有明确示出或描述的实施例。所示特征的组合为典型应用提供了代表性实施例。然而，与本发明的教导相一致的特征的各种组合和修改对于某些特定应用或实施方式可能是期望的。
为使本发明的目的、技术方案和优点更加清楚明白，以下结合具体实施例，并参照附图，对本发明实施例进一步详细说明。
如图1所示，在设备管理系统中通过PCIE-HOST(PCIE主端)与PCIE总线上的PCIE设备交互，发送请求，主动获取其配置和状态信息，并将其转存到BMC内，BMC内完成消息的解析和缓存；并在服务器CPU的请求下，将对应的解析后的设备信息通过PCIE-SLAVE(PCIE从端)发送给服务器CPU。为解决现有技术中的基于SMBus总线传输的问题，本发明主要基于PCIE总线，传输速度快，多个虚通道不易发生拥堵；将PCIE协议和MCTP协议结合，使其符合MCTP协议传输要求；从结构完成对HOST-CPU的反馈，主结构收集PCIE设备的信息。
基于上述目的，本发明的实施例一方面提出了一种基于MCTP协议的设备管理方法，如图2所示，包括以下步骤：
步骤S201：将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；
步骤S202：顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；
步骤S203：响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
在一些实施例中，如图3所示，PCIE设备中的设备状态信息，例如温度、功耗、电源等，在BMC-PCIE-HOST(PCIE主端)的请求下，通过MCTP协议发送给BMC，BMC在收到后，缓存在内部DDR中，待服务器CPU通过BMC-PCIE-SLAVE(PCIE从端)从BMC中读取。
在一些实施例中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中包括：从所述MCTP包缓存模块中读取第一个128比特数据包，解析出传输媒介物理头字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给是所述PCIE主端的IP核进行处理。
在一些实施例中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：从所述MCTP包缓存模块中读取第二个128比特数据包，按照保留位、头字段版本、目的EID、源EID、头标签、尾标签、包排序、方向和消息标签依次进行解析。
在一些实施例中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：继续从所述MCTP包缓存模块中读取128比特数据包，以进行消息主体的解析，并将所述解析的消息主体存放在所述设备传输数据缓存中。
在一些实施例中，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：从所述MCTP包缓存模块中最后读取128比特数据包，解析出传输媒介物理尾字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给所述PCIE主端的IP核进行处理。
在一些实施例中，MCTP协议包字段图如图4所示，传播媒介物理头字段为PCIE的物理协议部分，使用PCIE-4.0协议；保留位：56bit；头字段版本：8bit；目的EID：8bit；源EID：8bit；头标签：8bit；尾标签：8bit；包排序：8bit；方向：8bit；消息标签：16bit；传播媒介物理尾字段为PCIE的物理协议部分，使用PCIE-4.0协议。
在根据本发明的一个实施例中，将MCTP协议包从MCTP包缓存中第一次提取128bit，解析出传输媒介物理字段，确定为PCIE-4.0总线，并将PCIE协议的配置信息交给PCIE IP处理。然后，提取第二段128bit逐字节解析，解析字段头版本，确定是否达到或兼容当前版本的硬件设计，应用于出现硬件更迭时，对硬件设备进行识别。识别出EID，在PCIE中传输，每个设备在PCIE总线中都会被分配一个EID，需要用目的EID来识别最终在PCIE需要传输到的设备，即检测本设备是否是该消息报文要送达的设备(此处的EID作用与PCIE总线中的相似，但并不等于PCIE总线的EID，而是应用于MCTP协议)；与PCIE类似，识别出源EID，根据PCIE初始化时按设备分配的源EID将消息分类缓存，保存至当前源EID对应的缓存空间。但不同之处是PCIE总线上会有地址空间，虽然一个EID，但EID上会有很多子设备，此时的子设备即此时MCTP中的源EID，例如PCIE EID0对应风扇类设备，MCTP中的EID对应风扇0～99，此处仅为示例，并不代表实际应用情况。本发明采用8段报文设计，即将消息主体分为四段，头标签即第一段，尾标签为第八段，此时解析出来，确定该次传输是否完成；正常报文段顺序为1,2,3,4…8，但设计有包排序选项，即顺序排序和乱序排序两种情况；消息标签即上所描述的报文段顺序编号，在本发明中报文段汇集之后，按照顺序编号恢复正常顺序；方向包括离开该设备和发送至该设备。
解析消息主体，确认校验位正确，并按照上述编号，重新汇集成完整的消息，若头尾标签、源目的ID、方向、版本都符合该设计及当前传输情景要求，则将消息主体存放至设备传输数据缓存中；未完整的消息放回MCTP包缓存模块，继续等待其余消息段。本发明还包括丢包功能，采用断开式丢包，即出现任何上述所描述错误，不等待其完整，直接丢弃，并通过请求消息，要求目的设备重新发送。解析传输媒介物理尾字段，确定当前依赖的PCIE传输层协议已结束，并将PCIE相关信息发送给PCIE IP。当前传输完成后，需对MCTP包缓存进行整理，当前地址空间占用删除，再分配给其余待完成的MCTP消息体。
在一些实施例中，所述方法基于FPGA实现。即通过FPGA实现基于PCIE协议和MCTP协议的接收的PCIE设备的数据与服务器CPU之间的交互。
在技术上可行的情况下，以上针对不同实施例所列举的技术特征可以相互组合，或者改变、添加以及省略等等，从而形成本发明范围内的另外实施例。
从上述实施例可以看出，本发明实施例提供的一种基于MCTP协议的设备管理方法解决了在CPU需要获取PCIE设备状态信息时，不能直接获取并且BMC与CPU交互时SMbus速率过慢的问题；本发明采用MCTP协议，符合Intel-CPU的规范要求，可以基于高速总线PCIE与CPU交互，并且采用PCIE主端IP核，可以获取PCIE总线上设备的状态信息，快速反馈给CPU，较目前市面上主流的SMBus的传输方式，速率更快，并且一次传输的消息数据量更大；目前基于MCTP的协议硬件结构设计基本没有，本设计为MCTP后续广泛应用于BMC上提供了设计参考。
基于上述目的，本发明实施例的另一个方面，提出了一种基于MCTP协议的设备管理设备，包括：PCIE协议层模块，配置为将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；MCTP协议层模块，配置为顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；数据响应模块，配置为响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
在一些实施例中，所述MCTP协议层模块包括缓存控制模块，缓存控制模块配置用于实现对所述MCTP包缓存模块进行丢包、乱序汇能和地址再分配。
在一些实施例中，如图5所示，PCIE协议层模块包括PCIE-HOST请求消息组包模块、PCIE-HOST包解析模块、PCIE-SLAVE包解析模块和PCIE-SLAVE应答消息组包模块，其中PCIE-HOST请求消息组包模块实现PCIE的主动请求包的发送和组包功能；PCIE-HOST包解析模块作为PCIE-HOST端，接收数据包，对包解析，获得其中MCTP部分；PCIE-SLAVE包解析模块作为PCIE-SLAVE端，接收数据包，对包解析，获得MCTP部分；PCIE-SLAVE应答消息组包模块实现PCIE的被动应答，完成组包和发送功能。MCTP协议层模块包括MCTP包缓存_0、MCTP包缓存_1、缓存控制模块_0和缓存控制模块_1，其中MCTP包缓存_0接收并缓存来自于PCIE-HOST解析的MCTP包；MCTP包缓存_1接收并缓存来自于PCIE-SLAVE解析的MCTP包；缓存控制模块_0对缓存0具有丢包功能、乱序汇集功能、地址再分配功能；缓存控制模块_1对缓存0具有丢包功能、乱序汇集功能、地址再分配功能。
在一些实施例中，还包括MCTP协议解析模块，MCTP协议解析模块按照图4所示格式解析出所有的MCTP数据，并将主体消息发送给设备传输数据缓存，其余的根据功能特点配置缓存控制模块0/1。设备传输数据缓存模块保存从MCTP包中解析出的设备端发送来的数据。
在一些实施例中，基于MCTP协议的设备管理设备可以基于FPGA实现，以实现基于MCTP协议的硬件结构设计，为MCTP后续广泛应用于BMC上提供设计参考。
在技术上可行的情况下，以上针对不同实施例所列举的技术特征可以相互组合，或者改变、添加以及省略等等，从而形成本发明范围内的另外实施例。
基于上述目的，本发明实施例的又一个方面，提出了一种基于MCTP协议的设备管理装置，包括：
至少一个处理器；和
存储器，所述存储器存储有处理器可运行的程序代码，所述程序代码在被处理器运行时实施上述任一项所述的方法。
基于上述目的，本发明实施例的又一个方面，提出了一种计算机介质，包括可被处理器执行的程序代码，所述程序代码在被处理器执行时实施上述任一项所述的方法。
如图6所示，为本发明提供的基于MCTP协议的设备管理装置的一个实施例的硬件结构示意图。
以如图6所示的计算机设备为例，在该计算机设备中包括处理器601以及存储器602，并还可以包括：输入装置603和输出装置604。
处理器601、存储器602、输入装置603和输出装置604可以通过总线或者其他方式连接，图6中以通过总线连接为例。
存储器602作为一种非易失性计算机可读存储介质，可用于存储非易失性软件程序、非易失性计算机可执行程序以及模块，如本申请实施例中的所述基于MCTP协议的设备管理方法对应的程序指令/模块。处理器601通过运行存储在存储器602中的非易失性软件程序、指令以及模块，从而执行服务器的各种功能应用以及数据处理，即实现上述方法实施例的基于MCTP协议的设备管理方法。
存储器602可以包括存储程序区和存储数据区，其中，存储程序区可存储操作系统、至少一个功能所需要的应用程序；存储数据区可存储根据基于MCTP协议的设备管理方法所创建的数据等。此外，存储器602可以包括高速随机存取存储器，还可以包括非易失性存储器，例如至少一个磁盘存储器件、闪存器件、或其他非易失性固态存储器件。在一些实施例中，存储器602可选包括相对于处理器601远程设置的存储器，这些远程存储器可以通过网络连接至本地模块。上述网络的实例包括但不限于互联网、企业内部网、局域网、移动通信网及其组合。
输入装置603可接收输入的数字或字符信息，以及产生与基于MCTP协议的设备管理方法的计算机设备的用户设置以及功能控制有关的键信号输入。输出装置604可包括显示屏等显示设备。
所述一个或者多个基于MCTP协议的设备管理方法对应的程序指令/模块存储在所述存储器602中，当被所述处理器601执行时，执行上述任意方法实施例中的基于MCTP协议的设备管理方法。
所述执行所述基于MCTP协议的设备管理方法的计算机设备的任何一个实施例，可以达到与之对应的前述任意方法实施例相同或者相类似的效果。
最后需要说明的是，本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，可以通过计算机程序来指令相关硬件来完成，所述的程序可存储于计算机可读取存储介质中，该程序在执行时，可包括如上述各方法的实施例的流程。其中，所述的存储介质可为磁碟、光盘、只读存储记忆体(ROM)或随机存储记忆体(RAM)等。
此外，典型地，本发明实施例公开所述的装置、设备等可为各种电子终端设备，例如手机、个人数字助理(PDA)、平板电脑(PAD)、智能电视等，也可以是大型终端设备，如服务器等，因此本发明实施例公开的保护范围不应限定为某种特定类型的装置、设备。本发明实施例公开所述的客户端可以是以电子硬件、计算机软件或两者的组合形式应用于上述任意一种电子终端设备中。
此外，根据本发明实施例公开的方法还可以被实现为由CPU执行的计算机程序，该计算机程序可以存储在计算机可读存储介质中。在该计算机程序被CPU执行时，执行本发明实施例公开的方法中限定的上述功能。
此外，上述方法步骤以及系统单元也可以利用控制器以及用于存储使得控制器实现上述步骤或单元功能的计算机程序的计算机可读存储介质实现。
此外，应该明白的是，本文所述的计算机可读存储介质(例如，存储器)可以是易失性存储器或非易失性存储器，或者可以包括易失性存储器和非易失性存储器两者。作为例子而非限制性的，非易失性存储器可以包括只读存储器(ROM)、可编程ROM(PROM)、电可编程ROM(EPROM)、电可擦写可编程ROM(EEPROM)或快闪存储器。易失性存储器可以包括随机存取存储器(RAM)，该RAM可以充当外部高速缓存存储器。作为例子而非限制性的，RAM可以以多种形式获得，比如同步RAM(DRAM)、动态RAM(DRAM)、同步DRAM(SDRAM)、双数据速率SDRAM(DDR SDRAM)、增强SDRAM(ESDRAM)、同步链路DRAM(SLDRAM)、以及直接Rambus RAM(DRRAM)。所公开的方面的存储设备意在包括但不限于这些和其它合适类型的存储器。
本领域技术人员还将明白的是，结合这里的公开所描述的各种示例性逻辑块、模块、电路和算法步骤可以被实现为电子硬件、计算机软件或两者的组合。为了清楚地说明硬件和软件的这种可互换性，已经就各种示意性组件、方块、模块、电路和步骤的功能对其进行了一般性的描述。这种功能是被实现为软件还是被实现为硬件取决于具体应用以及施加给整个系统的设计约束。本领域技术人员可以针对每种具体应用以各种方式来实现所述的功能，但是这种实现决定不应被解释为导致脱离本发明实施例公开的范围。
结合这里的公开所描述的各种示例性逻辑块、模块和电路可以利用被设计成用于执行这里所述功能的下列部件来实现或执行：通用处理器、数字信号处理器(DSP)、专用集成电路(ASIC)、现场可编程门阵列(FPGA)或其它可编程逻辑器件、分立门或晶体管逻辑、分立的硬件组件或者这些部件的任何组合。通用处理器可以是微处理器，但是可替换地，处理器可以是任何传统处理器、控制器、微控制器或状态机。处理器也可以被实现为计算设备的组合，例如，DSP和微处理器的组合、多个微处理器、一个或多个微处理器结合DSP和/或任何其它这种配置。
结合这里的公开所描述的方法或算法的步骤可以直接包含在硬件中、由处理器执行的软件模块中或这两者的组合中。软件模块可以驻留在RAM存储器、快闪存储器、ROM存储器、EPROM存储器、EEPROM存储器、寄存器、硬盘、可移动盘、CD-ROM、或本领域已知的任何其它形式的存储介质中。示例性的存储介质被耦合到处理器，使得处理器能够从该存储介质中读取信息或向该存储介质写入信息。在一个替换方案中，所述存储介质可以与处理器集成在一起。处理器和存储介质可以驻留在ASIC中。ASIC可以驻留在用户终端中。在一个替换方案中，处理器和存储介质可以作为分立组件驻留在用户终端中。
在一个或多个示例性设计中，所述功能可以在硬件、软件、固件或其任意组合中实现。如果在软件中实现，则可以将所述功能作为一个或多个指令或代码存储在计算机可读介质上或通过计算机可读介质来传送。计算机可读介质包括计算机存储介质和通信介质，该通信介质包括有助于将计算机程序从一个位置传送到另一个位置的任何介质。存储介质可以是能够被通用或专用计算机访问的任何可用介质。作为例子而非限制性的，该计算机可读介质可以包括RAM、ROM、EEPROM、CD-ROM或其它光盘存储设备、磁盘存储设备或其它磁性存储设备，或者是可以用于携带或存储形式为指令或数据结构的所需程序代码并且能够被通用或专用计算机或者通用或专用处理器访问的任何其它介质。此外，任何连接都可以适当地称为计算机可读介质。例如，如果使用同轴线缆、光纤线缆、双绞线、数字用户线路(DSL)或诸如红外线、无线电和微波的无线技术来从网站、服务器或其它远程源发送软件，则上述同轴线缆、光纤线缆、双绞线、DSL或诸如红外线、无线电和微波的无线技术均包括在介质的定义。如这里所使用的，磁盘和光盘包括压缩盘(CD)、激光盘、光盘、数字多功能盘(DVD)、软盘、蓝光盘，其中磁盘通常磁性地再现数据，而光盘利用激光光学地再现数据。上述内容的组合也应当包括在计算机可读介质的范围内。
应当理解的是，在本文中使用的，除非上下文清楚地支持例外情况，单数形式“一个”旨在也包括复数形式。还应当理解的是，在本文中使用的“和/或”是指包括一个或者一个以上相关联地列出的项目的任意和所有可能组合。
上述本发明实施例公开实施例序号仅仅为了描述，不代表实施例的优劣。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成，也可以通过程序来指令相关的硬件完成，所述的程序可以存储于一种计算机可读存储介质中，上述提到的存储介质可以是只读存储器、磁盘或光盘等。
上述实施例是实施方式的可能示例，并且仅仅为了清楚理解本发明的原理而提出。所属领域的普通技术人员应当理解：以上任何实施例的讨论仅为示例性的，并非旨在暗示本发明实施例公开的范围(包括权利要求)被限于这些例子；在本发明实施例的思路下，以上实施例或者不同实施例中的技术特征之间也可以进行组合，并存在如上所述的本发明实施例的不同方面的许多其它变化，为了简明它们没有在细节中提供。因此，凡在本发明实施例的精神和原则之内，所做的任何省略、修改、等同替换、改进等，均应包含在本发明实施例的保护范围之内。
Claims (10)
1.一种基于MCTP协议的设备管理方法，其特征在于，包括以下步骤：
将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；
顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；
响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
2.根据权利要求1所述的方法，其特征在于，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中包括：
从所述MCTP包缓存模块中读取第一个128比特数据包，解析出传输媒介物理头字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给是所述PCIE主端的IP核进行处理。
3.根据权利要求2所述的方法，其特征在于，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
从所述MCTP包缓存模块中读取第二个128比特数据包，按照保留位、头字段版本、目的EID、源EID、头标签、尾标签、包排序、方向和消息标签依次进行解析。
4.根据权利要求3所述的方法，其特征在于，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
继续从所述MCTP包缓存模块中读取128比特数据包，以进行消息主体的解析，并将所述解析的消息主体存放在所述设备传输数据缓存中。
5.根据权利要求4所述的方法，其特征在于，所述顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中还包括：
从所述MCTP包缓存模块中最后读取128比特数据包，解析出传输媒介物理尾字段和PCIE协议的配置信息，并将所述解析出的PCIE协议的配置信息交给所述PCIE主端的IP核进行处理。
6.根据权利要求1所述的方法，其特征在于，所述方法基于FPGA实现。
7.一种基于MCTP协议的设备管理设备，其特征在于，包括：
PCIE协议层模块，配置为将PCIE主端通过PCIE总线获取的来自PCIE设备的数据包进行PCIE协议层的解析，并将解析获得的MCTP协议部分的数据存放在MCTP包缓存模块中；
MCTP协议层模块，配置为顺序每次读取128比特所述MCTP包缓存模块中的数据包，以根据MCTP协议包字段进行解析，并将解析的所述MCTP包缓存模块中的主体消息存放在设备传输数据缓存中；
数据响应模块，配置为响应于服务器CPU的请求，将所述设备传输数据缓存中的数据通过PCIE从端发送到所述服务器CPU。
8.根据权利要求7所述的设备，其特征在于，所述MCTP协议层模块包括缓存控制模块，配置用于实现对所述MCTP包缓存模块进行丢包、乱序汇能和地址再分配。
9.一种基于MCTP协议的设备管理装置，其特征在于，包括：
至少一个处理器；和
存储器，所述存储器存储有处理器可运行的程序代码，所述程序代码在被处理器运行时实施如权利要求1-6中任一项所述的方法。
10.一种计算机介质，其特征在于，包括可被处理器执行的程序代码，所述程序代码在被处理器执行时实施如权利要求1-6中任一项所述的方法。
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