CN111313698A - 基于固定导通时间控制buck电路的方法、装置、介质及电路 - Google Patents
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Abstract
本发明公开了一种基于固定导通时间控制buck电路的方法、系统、设备、存储介质及buck电路，方法包括以下步骤：采集buck电路中与电感的电流同步相位的电压，并判断电压是否小于参考电压；响应于电压小于参考电压，将第一MOS管导通以对电感充电；判断第一MOS管导通的时间是否达到阈值；以及响应于第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。本发明提出的基于固定导通时间控制buck电路的方法、系统、设备、介质及buck电路通过采集buck电路中与电感的电流同步相位的电压,提高环路工作的稳定性；调整反馈电压值，提高电压调整精度；控制开关频率，减少电磁干扰。
Description
技术领域
本发明涉及buck电路领域，更具体地，特别是指一种基于固定导通时间控制buck电路的方法、系统、计算机设备、可读介质及buck电路。
背景技术
buck变换器是服务器主板上的主要电源变换模块之一，研究其性能的改善具有重要意义。传统buck电路控制使用脉宽调制(pulse width modulation，PWM)技术，但PWM技术瞬时响应速度较慢，轻载时传输效率较低。现有基于COT(固定导通时间)的buck控制电路如图1所示，控制电路主要由比较器、RS触发器、导通定时器组成。工作原理如下：输出电压VO与基准电压VREF进行比较，当VO小于VREF时，比较器输出高电平，RS触发器置位，Q输出高电平，功率mosS1开通，L充电，输出电压升高。S1开通固定导通时间tON后，导通定时器置高，RS触发器复位，S1关断，S2导通，L放电续流，输出电压降低。当VO降低到VREF后，S1再次开通，并开始下一周期的循环。
输出电压VO为滤波电容C及其等效电阻RESR的两端电压叠加。因为buck电路开关频率远大于电路特征频率，电感L产生的纹波电流流入C。由RESR产生的电压vesr与电感变化电流成正比例关系，但由C产生的电压vc滞后于电感变化电流。当vesr幅值小于vc时，采样电压VO滞后于电感电流的变化，可能产生S1关断后VO仍然小于Vref的情况，导致出现多开关周期振荡现象。但通过增加RESR使vesr占据VO相位主导地位，会增大VO纹波幅值，降低变换效率，改变电路稳态性能。此外，开关周期实时变化，高次谐波频率上下波动，给滤波电路设计增加难度，降低供电电能质量，产生电磁干扰影响周边电路正常工作。
发明内容
有鉴于此，本发明实施例的目的在于提出一种基于固定导通时间控制buck电路的方法、系统、计算机设备及计算机可读存储介质，通过采集buck电路中与电感的电流同步相位的电压,提高环路工作的稳定性；调整反馈电压值，提高电压调整精度；控制开关频率，减少电磁干扰。
基于上述目的，本发明实施例的一方面提供了一种基于固定导通时间控制buck电路的方法，包括如下步骤：采集buck电路中与电感的电流同步相位的电压，并判断所述电压是否小于参考电压；响应于所述电压小于所述参考电压，将第一MOS管导通以对所述电感充电；判断所述第一MOS管导通的时间是否达到阈值；以及响应于所述第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
在一些实施方式中，还包括：响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
在一些实施方式中，还包括：基于采样电压波动调整所述参考电压。
在一些实施方式中，还包括：基于所述参考电压调整所述阈值。
本发明实施例的另一方面，还提供了一种基于固定导通时间控制buck电路的系统，包括：采集模块，配置用于采集buck电路中与电感的电流同步相位的电压，并判断所述电压是否小于参考电压；充电模块，配置用于响应于所述电压小于所述参考电压，将第一MOS管导通以对所述电感充电；判断模块，配置用于判断所述第一MOS管导通的时间是否达到阈值；以及执行模块，配置用于响应于所述第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
在一些实施方式中，还包括：第二充电模块，配置用于响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
本发明实施例的再一方面，还提供了一种buck电路，包括：超前电压采集电路组件，所述超前电压采集电路组件电流输入的一端连接电感的电流输入端；比较器，所述比较器的反相输入端连接所述超前电压采集电路组件的电压输出端，所述比较器的同相输入端连接参考电压；RS触发器，所述RS触发器的置位信号输入端连接所述比较器的输出端，所述RS触发器的第一输出端连接第一MOS管的栅极，所述RS触发器的第二输出端连接第二MOS管的栅极；以及导通时间调节器，所述导通时间调节器输入端分别连接所述RS触发器的第二输出端和所述比较器的同相输入端，所述导通时间调节器的输出端连接所述RS触发器的复位信号输入端。
在一些实施方式中，所述超前电压采集电路组件包括第一电阻和第一电容，所述第一电阻和第一电容串联，所述第一电阻电流输入的一端连接所述电感的电流输入端，所述第一电阻电流输出的一端连接所述比较器的反相输入端。
本发明实施例的又一方面，还提供了一种计算机设备，包括：至少一个处理器；以及存储器，所述存储器存储有可在所述处理器上运行的计算机指令，所述指令由所述处理器执行时实现如上方法的步骤。
本发明实施例的再一方面，还提供了一种计算机可读存储介质，计算机可读存储介质存储有被处理器执行时实现如上方法步骤的计算机程序。
本发明具有以下有益技术效果：通过采集buck电路中与电感的电流同步相位的电压,提高环路工作的稳定性；调整反馈电压值，提高电压调整精度；控制开关频率，减少电磁干扰。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的实施例。
图1为现有技术中buck电路图；
图2为本发明提供的基于固定导通时间控制buck电路的方法的实施例的示意图；
图3为本发明提供的buck电路图；
图4为本发明提供的超前电压采集电路和参考电压调整电路的示意图；
图5为本发明提供的基于固定导通时间控制buck电路的计算机设备的实施例的硬件结构示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白，以下结合具体实施例，并参照附图，对本发明实施例进一步详细说明。
需要说明的是，本发明实施例中所有使用“第一”和“第二”的表述均是为了区分两个相同名称非相同的实体或者非相同的参量，可见“第一”“第二”仅为了表述的方便，不应理解为对本发明实施例的限定，后续实施例对此不再一一说明。
基于上述目的，本发明实施例的第一个方面，提出了一种基于固定导通时间控制buck电路的方法的实施例。图2示出的是本发明提供的基于固定导通时间控制buck电路的方法的实施例的示意图。如图2所示，本发明实施例包括如下步骤：
S1、采集buck电路中与电感的电流同步相位的电压，并判断电压是否小于参考电压；
S2、响应于电压小于参考电压，将第一MOS管导通以对电感充电；
S3、判断第一MOS管导通的时间是否达到阈值；以及
S4、响应于第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
在一些实施方式中，还包括：响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
在一些实施方式中，还包括：基于采样电压波动调整所述参考电压。参考电压VREF减掉采样电压波动Ve后得到新的参考电压。
在一些实施方式中，还包括：基于所述参考电压调整所述阈值。
基于上述目的，本发明实施例的第二个方面，提出了一种基于固定导通时间控制buck电路的系统，包括：采集模块，配置用于采集buck电路中与电感的电流同步相位的电压，并判断所述电压是否小于参考电压；充电模块，配置用于响应于所述电压小于所述参考电压，将第一MOS管导通以对所述电感充电；判断模块，配置用于判断所述第一MOS管导通的时间是否达到阈值；以及执行模块，配置用于响应于所述第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
在一些实施方式中，还包括：第二充电模块，配置用于响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
在一些实施方式中，还包括：参考电压调整模块，配置用于基于采样电压波动调整所述参考电压。
在一些实施方式中，还包括：阈值调整模块，配置用于基于所述参考电压调整所述阈值。
基于上述目的，本发明实施例的第三个方面，提出了一种buck电路，包括：超前电压采集电路组件，所述超前电压采集电路组件电流输入的一端连接电感的电流输入端；比较器，所述比较器的反相输入端连接所述超前电压采集电路组件的电压输出端，所述比较器的同相输入端连接参考电压；RS触发器，所述RS触发器的置位信号输入端连接所述比较器的输出端，所述RS触发器的第一输出端连接第一MOS管的栅极，所述RS触发器的第二输出端连接第二MOS管的栅极；以及导通时间调节器，所述导通时间调节器输入端分别连接所述RS触发器的第二输出端和所述比较器的同相输入端，所述导通时间调节器的输出端连接所述RS触发器的复位信号输入端。
在一些实施方式中，所述超前电压采集电路组件包括第一电阻和第一电容，所述第一电阻和第一电容串联，所述第一电阻电流输入的一端连接所述电感的电流输入端，所述第一电阻电流输出的一端连接所述比较器的反相输入端。
图3示出的是本发明提供的buck电路图，图4示出的是本发明提供的超前电压采集电路组件和参考电压调整电路组件的示意图。结合图3和图4对控制方法进行进一步的说明。如图3所示，超前电压采集电路组件电流输入的一端连接电感L的电流输入端；超前电压采集电路组件的电压输出端连接比较器的反相输入端；比较器的同相输入端连接参考电压；比较器的输出端连接RS触发器的置位信号输入端S，RS触发器的第一输出端Q连接第一MOS管S1的栅极，RS触发器的第二输出端Q*连接第二MOS管S2的栅极和导通时间调节器输入端，第一MOS管S1的源极和第二MOS管S2的漏极也连接电感L的电流输入端；导通时间调节器的输出端连接RS触发器的复位信号输入端，导通时间调节器的输入端还连接比较器的同相输入端。在SW点，即电感电流输入端引入超前电压采集电路，采集与电感的电流同步相位的电压，与参考电压比较放大，输出信号可输入RS触发器的置位信号输入端。采集的电压小于参考电压VREF时，RS触发器置位，第一MOS管S1开通，电感L充电，输出电压升高。S1开通时间达到阈值tON后，RS触发器复位，S1关断，第二MOS管S2导通，L放电续流，输出电压降低。当输出电压VO降低到VREF后，S1再次开通。如图4所示，超前电压采集电路组件由第一电阻Rd与第一电容Cd串联组成。因为Cd的电压波形vd与电感电流波形同步变化，不存在相位滞后情况，因此可选取vd作为采样反馈点，
参考电压调整电路由在Rd两端并联的第二电阻Re与第二电容Ce串联组成。Rd两端的电压波形与Cd两端的电流波形一致，因为电容两端电压由电流积分得到，所以可以用于表示电压的波动大小。经Re与Ce滤波后得到的Ce两端电压Ve可以表示Rd稳态电压值，即vd的波动幅值。参考电压VREF削减掉采样电压波动Ve后得到的参考电压更接近采样电压波动的谷值，因而具有更高的采样精度。
具体工作过程分析如下：
在t∈[0，DT]时，S1导通，VI通过Rd对Cd充电。此时，
其中，vd0为vd在t＝0时的电压值。
在t∈(DT，T]时，S2导通，Cd通过Rd放电。此时，
其中，vd1为vd在t＝ton时的电压值。
显而易见，Cd的电压波形vd与电感电流波形iL同步变化，能够实现反馈的快速控制，避免多开关周期振荡，提高电路工作稳态性。
已知
则Cd有效电压值
又因为其稳态电压值为Vd＝VO+ILRESRL
令
同时为提高稳态电压精度，RdCd可取较大值，此时有
则
因此，RdCd取值非常大时，电压调整精度无误差。
最后，考虑对工作频率的控制。根据上文，易知
又因为在t＝T时，有等式
联立二式，可得
令T为合理的周期值，则其系数都为已知量。至此，可以根据二元一次方程组解与系数的关系，得出ton与T的关系式。通过固定T，实时调节ton数值，可以达到等效开关控制、调节电压的效果，同时稳定了开关频率，减轻后级LC滤波电路设计压力，减少对周边电路的电磁干扰。
本发明实施例在SW点引入超前电压采集电路对vd进行反馈调节，分析超前电压采集电路工作原理，建立数学模型，验证所提采集方式的可行性与正确性，从而为实现较高的瞬态响应速度、输出电容RESR较小时电路稳定工作指出一种不同的控制方案。本实施例调整反馈电压值，在传统反馈电压基础上减去采样电压波动值，从而提高电压调整精度。本实施例实时采集
值，并根据ton与T的关系式确定当前时刻ton数值，控制上管导通时间，达到稳定工作频率的效果。
需要特别指出的是，上述基于固定导通时间控制buck电路的方法的各个实施例中的各个步骤均可以相互交叉、替换、增加、删减，因此，这些合理的排列组合变换之于基于固定导通时间控制buck电路的方法也应当属于本发明的保护范围，并且不应将本发明的保护范围局限在实施例之上。
基于上述目的，本发明实施例的第四个方面，提出了一种计算机设备，包括：至少一个处理器；以及存储器，存储器存储有可在处理器上运行的计算机指令，指令由处理器执行以实现如下步骤：S1、采集buck电路中与电感的电流同步相位的电压，并判断电压是否小于参考电压；S2、响应于电压小于参考电压，将第一MOS管导通以对电感充电；S3、判断第一MOS管导通的时间是否达到阈值；以及S4、响应于第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
在一些实施方式中，还包括：响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
在一些实施方式中，还包括：基于采样电压波动调整所述参考电压。
在一些实施方式中，还包括：基于所述参考电压调整所述阈值。
如图5所示，为本发明提供的上述基于固定导通时间控制buck电路的计算机设备的一个实施例的硬件结构示意图。
以如图5所示的装置为例，在该装置中包括一个处理器301以及一个存储器302，并还可以包括：输入装置303和输出装置304。
处理器301、存储器302、输入装置303和输出装置304可以通过总线或者其他方式连接，图5中以通过总线连接为例。
存储器302作为一种非易失性计算机可读存储介质，可用于存储非易失性软件程序、非易失性计算机可执行程序以及模块，如本申请实施例中的基于固定导通时间控制buck电路的方法对应的程序指令/模块。处理器301通过运行存储在存储器302中的非易失性软件程序、指令以及模块，从而执行服务器的各种功能应用以及数据处理，即实现上述方法实施例的基于固定导通时间控制buck电路的方法。
存储器302可以包括存储程序区和存储数据区，其中，存储程序区可存储操作系统、至少一个功能所需要的应用程序；存储数据区可存储根据基于固定导通时间控制buck电路的方法的使用所创建的数据等。此外，存储器302可以包括高速随机存取存储器，还可以包括非易失性存储器，例如至少一个磁盘存储器件、闪存器件、或其他非易失性固态存储器件。在一些实施例中，存储器302可选包括相对于处理器301远程设置的存储器，这些远程存储器可以通过网络连接至本地模块。上述网络的实例包括但不限于互联网、企业内部网、局域网、移动通信网及其组合。
输入装置303可接收输入的用户名和密码等信息。输出装置304可包括显示屏等显示设备。
一个或者多个基于固定导通时间控制buck电路的方法对应的程序指令/模块存储在存储器302中，当被处理器301执行时，执行上述任意方法实施例中的基于固定导通时间控制buck电路的方法。
执行上述基于固定导通时间控制buck电路的方法的计算机设备的任何一个实施例，可以达到与之对应的前述任意方法实施例相同或者相类似的效果。
本发明还提供了一种计算机可读存储介质，计算机可读存储介质存储有被处理器执行时执行如上方法的计算机程序。
最后需要说明的是，本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，可以通过计算机程序来指令相关硬件来完成，基于固定导通时间控制buck电路的方法的程序可存储于一计算机可读取存储介质中，该程序在执行时，可包括如上述各方法的实施例的流程。其中，程序的存储介质可为磁碟、光盘、只读存储记忆体(ROM)或随机存储记忆体(RAM)等。上述计算机程序的实施例，可以达到与之对应的前述任意方法实施例相同或者相类似的效果。
此外，根据本发明实施例公开的方法还可以被实现为由处理器执行的计算机程序，该计算机程序可以存储在计算机可读存储介质中。在该计算机程序被处理器执行时，执行本发明实施例公开的方法中限定的上述功能。
此外，上述方法步骤以及系统单元也可以利用控制器以及用于存储使得控制器实现上述步骤或单元功能的计算机程序的计算机可读存储介质实现。
此外，应该明白的是，本文的计算机可读存储介质(例如，存储器)可以是易失性存储器或非易失性存储器，或者可以包括易失性存储器和非易失性存储器两者。作为例子而非限制性的，非易失性存储器可以包括只读存储器(ROM)、可编程ROM(PROM)、电可编程ROM(EPROM)、电可擦写可编程ROM(EEPROM)或快闪存储器。易失性存储器可以包括随机存取存储器(RAM)，该RAM可以充当外部高速缓存存储器。作为例子而非限制性的，RAM可以以多种形式获得，比如同步RAM(DRAM)、动态RAM(DRAM)、同步DRAM(SDRAM)、双数据速率SDRAM(DDRSDRAM)、增强SDRAM(ESDRAM)、同步链路DRAM(SLDRAM)、以及直接Rambus RAM(DRRAM)。所公开的方面的存储设备意在包括但不限于这些和其它合适类型的存储器。
本领域技术人员还将明白的是，结合这里的公开所描述的各种示例性逻辑块、模块、电路和算法步骤可以被实现为电子硬件、计算机软件或两者的组合。为了清楚地说明硬件和软件的这种可互换性，已经就各种示意性组件、方块、模块、电路和步骤的功能对其进行了一般性的描述。这种功能是被实现为软件还是被实现为硬件取决于具体应用以及施加给整个系统的设计约束。本领域技术人员可以针对每种具体应用以各种方式来实现的功能，但是这种实现决定不应被解释为导致脱离本发明实施例公开的范围。
结合这里的公开所描述的各种示例性逻辑块、模块和电路可以利用被设计成用于执行这里功能的下列部件来实现或执行：通用处理器、数字信号处理器(DSP)、专用集成电路(ASIC)、现场可编程门阵列(FPGA)或其它可编程逻辑器件、分立门或晶体管逻辑、分立的硬件组件或者这些部件的任何组合。通用处理器可以是微处理器，但是可替换地，处理器可以是任何传统处理器、控制器、微控制器或状态机。处理器也可以被实现为计算设备的组合，例如，DSP和微处理器的组合、多个微处理器、一个或多个微处理器结合DSP和/或任何其它这种配置。
结合这里的公开所描述的方法或算法的步骤可以直接包含在硬件中、由处理器执行的软件模块中或这两者的组合中。软件模块可以驻留在RAM存储器、快闪存储器、ROM存储器、EPROM存储器、EEPROM存储器、寄存器、硬盘、可移动盘、CD-ROM、或本领域已知的任何其它形式的存储介质中。示例性的存储介质被耦合到处理器，使得处理器能够从该存储介质中读取信息或向该存储介质写入信息。在一个替换方案中，存储介质可以与处理器集成在一起。处理器和存储介质可以驻留在ASIC中。ASIC可以驻留在用户终端中。在一个替换方案中，处理器和存储介质可以作为分立组件驻留在用户终端中。
在一个或多个示例性设计中，功能可以在硬件、软件、固件或其任意组合中实现。如果在软件中实现，则可以将功能作为一个或多个指令或代码存储在计算机可读介质上或通过计算机可读介质来传送。计算机可读介质包括计算机存储介质和通信介质，该通信介质包括有助于将计算机程序从一个位置传送到另一个位置的任何介质。存储介质可以是能够被通用或专用计算机访问的任何可用介质。作为例子而非限制性的，该计算机可读介质可以包括RAM、ROM、EEPROM、CD-ROM或其它光盘存储设备、磁盘存储设备或其它磁性存储设备，或者是可以用于携带或存储形式为指令或数据结构的所需程序代码并且能够被通用或专用计算机或者通用或专用处理器访问的任何其它介质。此外，任何连接都可以适当地称为计算机可读介质。例如，如果使用同轴线缆、光纤线缆、双绞线、数字用户线路(DSL)或诸如红外线、无线电和微波的无线技术来从网站、服务器或其它远程源发送软件，则上述同轴线缆、光纤线缆、双绞线、DSL或诸如红外线、无线电和微波的无线技术均包括在介质的定义。如这里所使用的，磁盘和光盘包括压缩盘(CD)、激光盘、光盘、数字多功能盘(DVD)、软盘、蓝光盘，其中磁盘通常磁性地再现数据，而光盘利用激光光学地再现数据。上述内容的组合也应当包括在计算机可读介质的范围内。
以上是本发明公开的示例性实施例，但是应当注意，在不背离权利要求限定的本发明实施例公开的范围的前提下，可以进行多种改变和修改。根据这里描述的公开实施例的方法权利要求的功能、步骤和/或动作不需以任何特定顺序执行。此外，尽管本发明实施例公开的元素可以以个体形式描述或要求，但除非明确限制为单数，也可以理解为多个。
应当理解的是，在本文中使用的，除非上下文清楚地支持例外情况，单数形式“一个”旨在也包括复数形式。还应当理解的是，在本文中使用的“和/或”是指包括一个或者一个以上相关联地列出的项目的任意和所有可能组合。
上述本发明实施例公开实施例序号仅仅为了描述，不代表实施例的优劣。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成，也可以通过程序来指令相关的硬件完成，程序可以存储于一种计算机可读存储介质中，上述提到的存储介质可以是只读存储器，磁盘或光盘等。
所属领域的普通技术人员应当理解：以上任何实施例的讨论仅为示例性的，并非旨在暗示本发明实施例公开的范围(包括权利要求)被限于这些例子；在本发明实施例的思路下，以上实施例或者不同实施例中的技术特征之间也可以进行组合，并存在如上的本发明实施例的不同方面的许多其它变化，为了简明它们没有在细节中提供。因此，凡在本发明实施例的精神和原则之内，所做的任何省略、修改、等同替换、改进等，均应包含在本发明实施例的保护范围之内。
Claims (10)
1.一种基于固定导通时间控制buck电路的方法，其特征在于，包括以下步骤：
采集buck电路中与电感的电流同步相位的电压，并判断所述电压是否小于参考电压；
响应于所述电压小于所述参考电压，将第一MOS管导通以对所述电感充电；
判断所述第一MOS管导通的时间是否达到阈值；以及
响应于所述第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
2.根据权利要求1所述的方法，其特征在于，还包括：
响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
3.根据权利要求1所述的方法，其特征在于，还包括：
基于采样电压波动调整所述参考电压。
4.根据权利要求3所述的方法，其特征在于，还包括：
基于所述参考电压调整所述阈值。
5.一种基于固定导通时间控制buck电路的系统，其特征在于，包括：
采集模块，配置用于采集buck电路中与电感的电流同步相位的电压，并判断所述电压是否小于参考电压；
充电模块，配置用于响应于所述电压小于所述参考电压，将第一MOS管导通以对所述电感充电；
判断模块，配置用于判断所述第一MOS管导通的时间是否达到阈值；以及
执行模块，配置用于响应于所述第一MOS管导通的时间达到阈值，将第一MOS管关断并打开第二MOS管以降低输出电压。
6.根据权利要求5所述的系统，其特征在于，还包括：
第二充电模块，配置用于响应于输出电压降低到所述参考电压，再次导通所述第一MOS管。
7.一种buck电路，其特征在于，包括：
超前电压采集电路组件，所述超前电压采集电路组件电流输入的一端连接电感的电流输入端；
比较器，所述比较器的反相输入端连接所述超前电压采集电路组件的电压输出端，所述比较器的同相输入端连接参考电压；
RS触发器，所述RS触发器的置位信号输入端连接所述比较器的输出端，所述RS触发器的第一输出端连接第一MOS管的栅极，所述RS触发器的第二输出端连接第二MOS管的栅极；以及
导通时间调节器，所述导通时间调节器输入端分别连接所述RS触发器的第二输出端和所述比较器的同相输入端，所述导通时间调节器的输出端连接所述RS触发器的复位信号输入端。
8.根据权利要求7所述的buck电路，其特征在于，所述超前电压采集电路组件包括第一电阻和第一电容，所述第一电阻和第一电容串联，所述第一电阻电流输入的一端连接所述电感的电流输入端，所述第一电阻电流输出的一端连接所述比较器的反相输入端。
9.一种计算机设备，其特征在于，包括：
至少一个处理器；以及
存储器，所述存储器存储有可在所述处理器上运行的计算机指令，所述指令由所述处理器执行时实现权利要求1-4任意一项所述方法的步骤。
10.一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，其特征在于，所述计算机程序被处理器执行时实现权利要求1-4任意一项所述方法的步骤。
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