CN110782839B - 像素驱动电路及其驱动方法、显示面板和显示装置 - Google Patents

像素驱动电路及其驱动方法、显示面板和显示装置 Download PDF

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Abstract

本公开的实施例提出了像素驱动电路及其驱动方法、显示面板和显示装置。该像素驱动电路包括：驱动模块，与扫描信号端、数据信号端、发光控制信号端、第一电压信号端和发光元件的第一端耦接，并被配置为能够在来自所述扫描信号端的扫描信号、来自数据信号端的数据信号以及来自发光控制信号端的发光控制信号的控制下向所述发光元件输出来自第一电压信号端的第一电压信号；以及静电释放模块，与第二电压信号端和所述发光元件的第一端耦接，并被配置为能够在所述发光元件的所述第一端处产生静电时向所述第二电压信号端导出所述静电。

Description

像素驱动电路及其驱动方法、显示面板和显示装置
技术领域
本公开涉及显示技术领域，且更具体地涉及像素驱动电路及其驱动方法、显示面板和显示装置。
背景技术
近年来，随着显示技术的快速发展，薄膜晶体管(TFT)技术由原来的非晶硅(a-Si)薄膜晶体管发展到现在的低温多晶硅(LTPS)薄膜晶体管、金属诱导横向晶化(MILC)薄膜晶体管、氧化物(Oxide)薄膜晶体管等，而发光技术也由原来的液晶显示器(LCD)、等离子显示面板(PDP)发展为现在的有机发光二极管(OLED)显示器。
OLED是新一代的显示器件，其与液晶显示器相比，具有很多优点，例如：自发光、响应速度快、宽视角等等。其可以用于柔性显示、透明显示、3D显示等。有源矩阵有机发光显示器(AMOLED)为每一个像素配备了用于控制该像素的开关，例如薄膜晶体管。因此，通过驱动电路，可以独立控制每一个像素，同时不会对其它像素造成串扰等的影响。目前，新型的OLED显示越来越受到关注。
然而，OLED显示器也有其自身的缺点。例如，在OLED的驱动背板制作过程中其存在防静电能力弱的问题。在实际生产、测试和/或运输过程中可能发生静电放电(ESD)现象。静电在由OLED元件的阳极电极引入到像素驱动电路之后，通常会损坏最近的TFT，例如用于复位的TFT。因此，在产生ESD的情况下，会导致元件受损，进而造成产品不良。
发明内容
为了至少解决或减轻上述技术问题，根据本公开一些实施例，提供了像素驱动电路及其驱动方法、显示面板和显示装置。
根据一个方面，本公开的实施例提供了一种像素驱动电路。该像素驱动电路包括：驱动模块，与扫描信号端、数据信号端、发光控制信号端、第一电压信号端和发光元件的第一端耦接，并被配置为能够在来自所述扫描信号端的扫描信号、来自数据信号端的数据信号以及来自发光控制信号端的发光控制信号的控制下向所述发光元件输出来自第一电压信号端的第一电压信号；以及静电释放模块，与第二电压信号端和所述发光元件的第一端耦接，并被配置为能够在所述发光元件的所述第一端处产生静电时向所述第二电压信号端导出所述静电。
在一些实施例中，所述静电释放模块包括：第一晶体管，其控制端和第一端与所述发光元件的第一端耦接，以及第二端与所述第二电压信号端耦接。
在一些实施例中，所述静电释放模块还包括：第二晶体管，其控制端和第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接。
在一些实施例中，所述驱动模块包括：第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第四晶体管的控制端耦接；所述第四晶体管，其控制端与所述第三晶体管的第二端耦接，第一端与第五晶体管的第二端耦接，以及第二端与第六晶体管的第一端耦接；所述第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第四晶体管的第一端耦接；所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；以及第一电容，其一端与所述第三晶体管的第二端耦接，以及另一端与所述第一电压信号端耦接。
在一些实施例中，所述驱动模块包括：第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第一电容的一端耦接；第四晶体管，其控制端与所述第一电容的另一端耦接，第一端与所述第一电压信号端耦接，以及第二端与第六晶体管的第一端耦接；第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第一电容的所述一端耦接；所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；第八晶体管，其控制端与所述扫描信号端耦接，第一端与所述第一电容的所述另一端耦接，以及第二端与所述第六晶体管的第一端耦接；以及所述第一电容，其所述一端与所述第三晶体管的第二端耦接，以及所述另一端与所述第八晶体管的第一端耦接。
在一些实施例中，所述驱动模块还包括：第七晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接。
在一些实施例中，所述驱动模块包括：第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第四晶体管的第一端耦接；第四晶体管，其控制端与第一电容的一端耦接，第一端与第五晶体管的第二端耦接，以及第二端与第六晶体管的第一端耦接；所述第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第四晶体管的第一端耦接；所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；第八晶体管，其控制端与所述扫描信号端耦接，第一端与所述第一电容的所述一端耦接，以及第二端与所述第六晶体管的第一端耦接；以及所述第一电容，其所述一端与所述第四晶体管的控制端耦接，以及另一端与所述第一电压信号端耦接。
在一些实施例中，所述驱动模块还包括：第七晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接；以及第九晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述第一电容的所述一端耦接。
在一些实施例中，所述像素驱动电路中的各个晶体管是P型晶体管，来自所述第一电压信号端的第一电压信号是低电平信号，以及来自所述第二电压信号端的第二电压信号是高电平信号。
在一些实施例中，所述第一晶体管和所述第二晶体管的沟道的宽长比为3/6。
根据另一方面，提供了一种显示面板，该显示面板包括上述像素驱动电路。
根据又一方面，提供了一种显示装置，包括上述显示面板。
根据再一方面，提供了一种用于驱动上述像素驱动电路的方法。该方法在一帧周期中包括以下操作：在复位阶段，扫描信号端输入高电平的扫描信号，数据信号端输入数据信号，复位信号端输入低电平的复位信号，发光控制信号端输入高电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向相应的有机发光二极管“OLED”元件输出高电平的驱动信号；在信号写入阶段，扫描信号端输入低电平的扫描信号，数据信号端输入数据信号，复位信号端输入高电平的复位信号，发光控制信号端输入高电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向相应的所述OLED元件输出高电平的驱动信号；以及在发光阶段，扫描信号端输入高电平的扫描信号，数据信号端输入数据信号，复位信号端输入高电平的复位信号，发光控制信号端输入低电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向所述OLED元件输出与所述信号写入阶段的数据信号相对应的驱动信号，以驱动所述OLED元件以相应灰阶发光。
在一些实施例中，所述方法还包括：当在所述OLED元件与所述像素驱动电路之间出现静电时，所述像素驱动电路的静电释放模块将所述静电从所述第二电压信号端导出。
通过使用根据本公开实施例的像素驱动电路及其驱动方法、显示面板和显示装置，可以在像素驱动电路或OLED元件中产生静电时有效释放静电，避免在生产和/或测试时静电对OLED显示器所可能产生的损坏，从而提高了产品良率、降低了生产成本。
附图说明
通过下面结合附图说明本公开的优选实施例，将使本公开的上述及其它目的、特征和优点更加清楚，其中：
图1是示出了根据本公开实施例的像素驱动电路的示例构造的示意图。
图2是示出了图1所示的像素驱动电路的示例具体构造的示意图。
图3是示出了根据本公开实施例的多个像素之间的电连接关系的示意图。
图4是示出了图2所示的像素驱动电路的示例工作时序图。
图5A～图5C是示出了图2所示的像素驱动电路在不同阶段的示例等效电路图。
图6是示出了图1所示的像素驱动电路的另一示例具体构造的示意图。
图7是示出了图1所示的像素驱动电路的又一示例具体构造的示意图。
图8是示出了在采用根据本公开实施例的具有不同晶体管宽长比的像素驱动电路的情况下OLED驱动电流的对比图。
图9是示出了根据本公开实施例的用于驱动像素驱动电路的示例方法的流程图。
具体实施方式
下面参照附图对本公开的部分实施例进行详细说明，在描述过程中省略了对于本公开来说是不必要的细节和功能，以防止对本公开的理解造成混淆。在本说明书中，下述用于描述本公开原理的各种实施例只是说明，不应该以任何方式解释为限制公开的范围。参照附图的下述描述用于帮助全面理解由权利要求及其等同物限定的本公开的示例性实施例。下述描述包括多种具体细节来帮助理解，但这些细节应认为仅仅是示例性的。因此，本领域普通技术人员应认识到，在不脱离本公开的范围和精神的情况下，可以对本文中描述的实施例进行多种改变和修改。此外，为了清楚和简洁起见，省略了公知功能和结构的描述。此外，贯穿附图，相同的附图标记用于相同或相似的功能、器件和/或操作。此外，在附图中，各部分并不一定按比例来绘制。换言之，附图中的各部分的相对大小、长度等并不一定与实际比例相对应。
在本公开中，术语“包括”和“含有”及其派生词意为包括而非限制；术语“或”是包含性的，意为和/或。此外，在本公开的以下描述中，所使用的方位术语，例如“上”、“下”、“左”、“右”等均用于指示相对位置关系，以辅助本领域技术人员理解本公开实施例，且因此本领域技术人员应当理解：在一个方向上的“上”/“下”，在相反方向上可变为“下”/“上”，且在另一方向上，可能变为其它位置关系，例如“左”/“右”等。
以下，以本公开实施例应用于OLED显示装置的像素驱动电路为例来详细说明。然而本领域技术人员应当理解本公开的应用领域不限于此。此外，尽管在以下描述中以晶体管为P型晶体管为例进行了描述，然而本公开不限于此。事实上，如本领域技术人员所能够理解的：当以下提及的各个晶体管中的一个或多个为N型晶体管时同样可以实现本申请的技术方案，只需对电平设置/耦接关系进行相应的调整即可。
如前所述，在生产、测试和/或运输OLED显示面板期间，可能在像素驱动电路和OLED元件之间产生静电并造成电路中的器件损坏。为了解决或至少部分减轻上述问题，提出了根据本公开实施例的像素驱动电路及其驱动方法、以及包括像素驱动电路在内的显示面板和显示装置。
总体上，可以通过设置用于向其它像素放电的模块来减少单个像素中静电所可能造成的损害，由此提升像素驱动电路乃至显示面板、显示装置的防静电能力，从而提升OLED的信耐性和产品良率。更具体地，在一些实施例中，可以在每个像素驱动电路中设置例如静电放电模块，例如下文所述的第一晶体管和/或第二晶体管，以使得静电能够通过第一晶体管被放电到其它像素，和/或能够通过第二晶体管来分担其它像素中产生的静电，从而避免ESD导致的器件损坏。
以下，将结合图1～图5C来描述根据本公开实施例的示例像素驱动电路的构造和工作原理。
图1是示出了根据本公开实施例的像素驱动电路100的示例构造的示意图。如图1所示，像素驱动电路100可以包括驱动模块110和静电释放模块120。在一些实施例中，驱动模块110可以与扫描信号端GATE、数据信号端DATA、发光控制信号端EM、第一电压信号端VDD和发光元件OLED的第一端(例如，OLED的阳极)耦接，并被配置为能够在来自扫描信号端GATE的扫描信号、来自数据信号端DATA的数据信号以及来自发光控制信号端EM的发光控制信号的控制下向发光元件OLED输出来自第一电压信号端VDD的第一电压信号。此外，在一些实施例中，静电释放模块120可以与第二电压信号端Vint和发光元件OLED的第一端耦接，并被配置为能够在发光元件OLED的第一端处产生静电时向第二电压信号端Vint导出该静电。
通过采用这样的结构，当在例如发光元件OLED的阳极处产生静电时，静电可被静电释放模块120导出至第二电压信号端Vint，并进而分散到其它像素驱动电路中，从而避免由于对单一像素驱动电路造成较大的静电放电而产生的像素驱动电路损坏。
图2是示出了图1所示的像素驱动电路100的一个示例具体构造200的示意图。如图2所示，像素驱动电路200可以包括驱动模块210和静电释放模块220。
如图2所示，静电释放模块220可以包括第一晶体管M1和第二晶体管M2。在一些实施例中，第一晶体管M1的控制端和第一端可与发光元件OLED的第一端耦接，以及第二端可与第二电压信号端Vint耦接。在一些实施例中，第二晶体管M2的控制端和第一端可与第二电压信号端Vint耦接，以及第二端可与发光元件OLED的第一端耦接。
通过采用这样的设置，当在图2所示的例如B节点(例如，OLED的阳极)处产生或引入静电时，静电可以通过第一晶体管M1导向第二电压信号端Vint，并进而如图3所示经由Vint线构成的网络传导至其它像素处，并经由其它像素驱动电路中设置的第二晶体管M2传导至相应OLED元件的阳极，以避免在单一像素中产生较大的静电放电现象，从而对像素驱动电路200起到保护作用。
此外，如图2所示，驱动模块210可采用5T1C(5个晶体管和1个电容)的结构。具体地，驱动模块210可以包括第三晶体管M3～第七晶体管M7。在一些实施例中，第三晶体管M3的控制端可与扫描信号端GATE耦接，第一端可与数据信号端DATA耦接，以及第二端可与第四晶体管M4的控制端耦接。在一些实施例中，第四晶体管M4的控制端可与第三晶体管M3的第二端耦接，第一端可与第五晶体管M5的第二端耦接，以及第二端可与第六晶体管M6的第一端耦接。在一些实施例中，第五晶体管M5的控制端可与发光控制信号端EM耦接，第一端可与第一电压信号端VDD耦接，以及第二端可与第四晶体管M4的第一端耦接。在一些实施例中，第六晶体管M6的控制端可与发光控制信号端EM耦接，第一端可与第四晶体管M4的第二端耦接，以及第二端可与发光元件OLED的第一端耦接。在一些实施例中，第一电容C1的一端可与第三晶体管M3的第二端耦接，以及另一端可与第一电压信号端VDD耦接。此外，在一些实施例中，第七晶体管M7的控制端可与复位信号端RESET耦接，第一端可与第二电压信号端Vint耦接，以及第二端可与发光元件OLED的第一端耦接。下文中，将结合图2和图4来更详细地描述像素驱动电路200的工作流程。
图3是示出了根据本公开实施例的多个像素310之间的电连接关系的示意图。如图3所示，显示面板300可包括多个像素310。在至少一个像素310中，均可设置有像素电极312和公共电极314。如图3所示意性示出的，对应的像素电极312和公共电极314可以是上下重叠的，以使得在工作期间在这二者之间形成电势差，从而使得二者之间的OLED元件正常工作并发光。然而需要注意的是：像素电极312和公共电极314的位置关系不限于图3所示的上下重叠关系，而可以根据需要具有任何恰当的位置关系。
此外，在图2和图3所示实施例中，像素310的像素电极312可以是OLED元件的阳极或与其电连接且公共电极314可以是OLED元件的阴极或与其电连接。然而本公开不限于此。事实上，像素310的像素电极312也可以是OLED元件的阴极或与其电连接且公共电极314也可以是OLED元件的阳极或与其电连接。
在例如静电产生于或引入到OLED的阳极或像素电极312处时(例如，在生产、测试或运输过程中，阳极312处聚集了大量静电时)，该静电可以通过相应像素310的单向导通元件316(例如，图2所示的第一晶体管M1)传导至Vint线上，并经由Vint线构成的网络、其它像素310的单向导通元件318(例如，图2所示的第二晶体管M2)分散至其它像素中OLED的阳极或像素电极312处，从而避免在该单一像素310中过多的静电导致元件被损坏(例如，可能导致图2所示的用于复位的第七晶体管M7被击穿等)。
此外，如图3所示，各个像素310中的阴极或公共电极314可以是相互电连接的，并最终都连接到外围具有网状结构的VSS信号线上。此外，VSS信号线与Vint信号线之间通过静电电路320电连接，从而进一步形成静电放电电路，避免单一像素内的大量静电对该像素造成损伤。
通过采用如图3所示的像素连接布置，当任何一个像素的阴极或公共电极314上电压过高时，则可以通过VSS线路传输到外围的静电释放电路320，并进而被释放到Vint线路上，再进而通过例如单向导通元件318释放到各个像素的阳极或像素电极312。这样，可以将各像素的阴极或公共电极处的静电也释放到各个像素中，从而避免大量静电对相应像素的损伤。因此，采用上述防静电设计，可以提升OLED的背板的防静电能力，特别是在后续的蒸镀和封装工艺过程中的防静电能力，从而提升产品良率。
接下来，将结合图4、图5A～图5C来详细描述根据本公开实施例的像素驱动电路的工作时序。以下描述将以像素驱动电路中采用P型晶体管为例来详加说明，即低电平信号为使得像素驱动电路中各个晶体管导通的有效电平，例如来自第一电压信号端VDD的第一电压信号；而高电平信号为使得像素驱动电路中各个晶体管截止或关断的无效电平，例如，来自第二电压信号端Vint的第二电压信号。然而需要注意的是，当例如像素驱动电路中采用N型晶体管时，则低电平信号为使得像素驱动电路中各个晶体管截止或关断的无效电平，而高电平信号为使得像素驱动电路中各个晶体管导通的有效电平。因此，本领域技术人员根据以下描述同样可以实现根据本公开实施例的采用N型晶体管的像素驱动电路。
图4是示出了图2所示的像素驱动电路200的示例工作时序图，以及图5A～图5C是分别示出了图2所示的像素驱动电路200在不同阶段t1～t3的示例等效电路图。
如图4所示，在第一阶段t1(复位阶段)中，扫描信号端GATE可输入高电平的扫描信号，数据信号端DATA可输入数据信号(任何电平均可)，复位信号端RESET可输入低电平的复位信号，发光控制信号端EM可输入高电平的发光控制信号，第一电压信号端VDD可输入低电平的第一电压信号，第二电压信号端Vint可输入高电平的第二电压信号，以及像素驱动电路(例如，像素驱动电路200)可向相应的有机发光二极管(OLED)元件输出高电平的驱动信号。此时，由于VSS线上的电平也为高电平，所以OLED元件两端的电位差为零或接近于零，从而OLED元件不发光。
具体地，如图5A所示，由于来自扫描信号端GATE的扫描信号和来自发光控制信号端EM的发光控制信号为具有高电平的无效信号，因此第三晶体管M3、第五晶体管M5和第六晶体管M6均关断。此时，不管第四晶体管M4是关断还是导通，由于其两侧的第五晶体管M5和第六晶体管M6均关断，其并不影响像素驱动电路其它部分的操作，因此可以将第四晶体管M4也视为关断。此外，由于来自复位信号端RESET的复位信号为具有低电平的有效信号，因此第七晶体管M7导通，从而将OLED元件的第一端(例如，阳极)复位为来自第二电压信号端Vint的高电平的无效信号。因此，OLED元件不发光，且第一晶体管M1和第二晶体管M2均截止。
如图4所示，在第二阶段t2(信号写入阶段)中，扫描信号端GATE可输入低电平的扫描信号，数据信号端DATA可输入数据信号(例如，具有与该像素的预期灰阶相对应的电平的数据信号)，复位信号端RESET可输入高电平的复位信号，发光控制信号端EM可输入高电平的发光控制信号，第一电压信号端VDD可输入低电平的第一电压信号，第二电压信号端Vint可输入高电平的第二电压信号，以及像素驱动电路可向相应的OLED元件输出高电平的驱动信号。此时，由于VSS线上的电平也为高电平，所以OLED元件两端的电位差为零或接近于零，从而OLED元件不发光。
具体地，如图5B所示，由于来自复位信号端RESET的复位信号、来自发光控制信号端EM的发光控制信号为具有高电平的无效信号，因此第七晶体管M7、第五晶体管M5和第六晶体管M6均关断。此外，由于来自扫描信号端GATE的扫描信号为具有低电平的有效信号，因此第三晶体管M3导通，从而将来自数据信号端DATA的数据信号传导至节点A，并进而存储在第一电容C1处，且使得第四晶体管M4导通。然而，由于第四晶体管M4两侧的第五晶体管M5和第六晶体管M6均关断，因此节点B处依然保持前一阶段的高电平状态。此时，OLED元件不发光，且第一晶体管M1和第二晶体管M2也均截止。
如图4所示，在第三阶段t3(发光阶段)中，扫描信号端GATE可输入高电平的扫描信号，数据信号端DATA可输入数据信号(任何电平均可)，复位信号端RESET可输入高电平的复位信号，发光控制信号端EM可输入低电平的发光控制信号，第一电压信号端VDD可输入低电平的第一电压信号，第二电压信号端Vint可输入高电平的第二电压信号，以及像素驱动电路可向OLED元件输出与前一阶段中的数据信号相对应的驱动信号，以驱动OLED元件以相应灰阶发光。
具体地，如图5C所示，由于来自复位信号端RESET的复位信号、来自扫描信号端GATE的扫描信号为具有高电平的无效信号，因此第七晶体管M7和第三晶体管M3均关断。此外，由于来自发光控制信号端EM的发光控制信号为具有低电平的有效信号，因此第五晶体管M5和第六晶体管M6导通。同时，由于第一电容C1在节点A的一侧处于浮置状态且另一端与具有低电平信号的第一电压信号端VDD耦接，因此其保持节点A的电平，从而使得第四晶体管M4继续保持导通状态。因此，第五晶体管M5、第四晶体管M4和第六晶体管M6的导通使得来自第一电压信号端VDD的具有低电平的第一电压信号传导至节点B，并进而驱动OLED元件发光，直至一帧周期结束。接下来，可以开始下一帧的工作周期，与前面描述的类似。
此时，与静电产生时的高电压相比，用于驱动OLED元件发光的驱动电压较低，且因此第一晶体管M1仅存在少许漏电现象，并不实质上影响像素驱动电路的正常工作。此外，下文中将结合图8来讨论第一晶体管M1的宽长比对漏电的影响并尝试解决或至少减轻该问题。另外，第二晶体管M2在第二电压信号端Vint的高电平的第二电压信号控制下也关断。
需要注意的是：图4所示的工作时序图仅仅是用于说明的一个实施例，其与实际的工作时序图可能并不相同。例如，在一些实施例中，各输入/输出电压信号可能不像图4所示的那样为方波，而是会出现随时间发生微小抖动、持续下降或持续上升的波形，或者脉冲的上升沿/下降沿并非如图4一样竖直，而是存在一定斜率变化，或者来自各个不同信号端的信号不一定严格同步，但这些并不影响像素驱动电路200的正常工作。
此外，不管在哪个阶段，当在OLED元件与像素驱动电路200之间出现静电时，像素驱动电路200的静电释放模块220(例如，第一晶体管M1)可将静电从第二电压信号端Vint导出。具体地，当在例如节点B处出现静电时，其将使得第一晶体管M1瞬间导通，并经由第二电压信号端Vint传导至例如图3所示的Vint网络，并进而通过其它像素驱动电路中设置的静电释放模块220(例如，第二晶体管M2)分散到其它像素驱动电路中。从而，可以避免静电对单一像素驱动电路200造成损害。
此外，尽管在上述实施例中，采用了P型晶体管作为示例之用，但本公开不限于此。在另一些实施例中，也可以采用N型晶体管。此时，第一电压信号端VDD可以提供高电平的第一电压信号，而第二电压信号端Vint可以提供低电平的第二电压信号。此时，电压信号端VSS也可以提供低电平的电压信号。
此外，需要注意的是：图2所示的像素驱动电路200仅是实现图1所示的像素驱动电路100的一种可能方式，而本公开不限于此。例如，以下结合图6和图7描述了像素驱动电路100的部分其它具体实现方式。实际上，对于任何能够实现像素驱动功能的电路，只需要相应添加静电释放模块，均可实现像素驱动电路的静电防护功能。
接下来，将结合图6来描述根据本公开另一实施例的示例像素驱动电路的构造。图6是示出了图1所示的像素驱动电路100的另一示例具体构造600的示意图。与图2所示的像素驱动电路200相比，图6的像素驱动电路600采用了8T1C的配置，其中，静电释放模块620与静电释放模块220大体相同，而驱动模块610不同于驱动模块210。为了简洁和清楚起见，以下将仅描述像素驱动电路600与像素驱动电路200的不同之处。
如图6所示，驱动模块600可以包括第三晶体管M3～第八晶体管M8。在一些实施例中，第三晶体管M3的控制端可与扫描信号端GATE耦接，第一端可与数据信号端DATA耦接，以及第二端可与第一电容C1的一端耦接。在一些实施例中，第四晶体管M4的控制端可与第一电容C1的另一端耦接，第一端可与第一电压信号端VDD耦接，以及第二端可与第六晶体管M6的第一端耦接。在一些实施例中，第五晶体管M5的控制端可与发光控制信号端EM耦接，第一端可与第一电压信号端VDD耦接，以及第二端可与第一电容C1的一端耦接。在一些实施例中，第六晶体管M6的控制端可与发光控制信号端EM耦接，第一端可与第四晶体管M4的第二端耦接，以及第二端可与发光元件OLED的第一端耦接。在一些实施例中，第八晶体管M8的控制端可与扫描信号端GATE耦接，第一端可与第一电容C1的另一端耦接，以及第二端可与第六晶体管M6的第一端耦接。在一些实施例中，第一电容C1的一端可与第三晶体管M3的第二端耦接，以及另一端可与第八晶体管M8的第一端耦接。此外，在一些实施例中，第七晶体管M7的控制端可与复位信号端RESET耦接，第一端可与第二电压信号端Vint耦接，以及第二端可与发光元件OLED的第一端耦接。
该像素驱动电路600的工作时序类似于图2所示的像素驱动电路200，且因此这里不再赘述。其静电释放模块620同样可以实现静电防护功能，提升OLED产品在生产、测试和/或运输期间的静电防护性能。
接下来，将结合图7来描述根据本公开又一实施例的示例像素驱动电路的构造。图7是示出了图1所示的像素驱动电路100的又一示例具体构造700的示意图。与图2所示的像素驱动电路200和图6所示的像素驱动电路600相比，图7的像素驱动电路700采用了9T1C的配置，其中，静电释放模块720与静电释放模块220和620大体相同，而驱动模块710则不同于驱动模块210和610。为了简洁和清楚起见，以下将仅描述像素驱动电路700与像素驱动电路200或600的不同之处。
如图7所示，驱动模块710可以包括第三晶体管M3～第九晶体管M9。在一些实施例中，第三晶体管M3的控制端可与扫描信号端GATE耦接，第一端可与数据信号端DATA耦接，以及第二端可与第四晶体管M4的第一端耦接。在一些实施例中，第四晶体管M4的控制端可与第一电容C1的一端耦接，第一端可与第五晶体管M5的第二端耦接，以及第二端可与第六晶体管M6的第一端耦接。在一些实施例中，第五晶体管M5的控制端可与发光控制信号端EM耦接，第一端可与第一电压信号端VDD耦接，以及第二端可与第四晶体管M4的第一端耦接。在一些实施例中，第六晶体管M6的控制端可与发光控制信号端EM耦接，第一端可与第四晶体管M4的第二端耦接，以及第二端可与发光元件OLED的第一端耦接。在一些实施例中，第八晶体管M8的控制端可与扫描信号端GATE耦接，第一端可与第一电容C1的一端耦接，以及第二端可与第六晶体管M6的第一端耦接。在一些实施例中，第一电容C1的一端可与第四晶体管M4的控制端耦接，以及另一端可与第一电压信号端VDD耦接。此外，在一些实施例中，第七晶体管M7的控制端可与复位信号端RESET耦接，第一端可与第二电压信号端Vint耦接，以及第二端可与发光元件OLED的第一端耦接。在一些实施例中，第九晶体管M9的控制端可与复位信号端RESET耦接，第一端可与第二电压信号端Vint耦接，以及第二端可与第一电容C1的一端耦接。
类似地，该像素驱动电路700的工作时序类似于图2所示的像素驱动电路200和/或图6所示的像素驱动电路600，且因此这里不再赘述。其静电释放模块720同样可以实现静电防护功能，提升OLED产品在生产、测试和/或运输期间的静电防护性能。
此外，如前所述，静电释放模块中的第一晶体管M1和/或第二晶体管M2处可能会存在少许漏电问题。以下将结合图8来详细说明如何解决或至少减轻该问题。图8是示出了在采用根据本公开实施例的具有不同晶体管宽长比的像素驱动电路的情况下OLED驱动电流的对比图。
如图8所示，分别示出了五种情况下的OLED驱动电流。这五种情况包括不采用根据本公开实施例的静电释放模块的普通7T1C像素驱动电路(例如，图7中的9T1C像素驱动电路700中的驱动模块710)以及采用根据本公开实施例的具有四种不同宽长比的晶体管(例如，第一晶体管M1和第二晶体管M2)的静电释放模块的像素驱动电路。
如从图8中可明显看出的，当静电释放模块中的晶体管采用例如宽长比3/3(宽度3微米且长度3微米)时，其驱动电流远小于普通像素驱动电路中的驱动电流，存在明显的漏电流，从而造成了较高的能耗以及显示性能劣化。随着宽长比从3/3(宽度3微米且长度3微米)下降到3/4(宽度3微米且长度4微米)、3/5(宽度3微米且长度5微米)，直至下降到3/6(宽度3微米且长度6微米)，驱动电流逐渐升高，且在3/6时已基本接近普通7T1C像素驱动电路的驱动电流，此时漏电流已经非常小。因此，通过调整静电释放模块中的晶体管的宽长比，可以很好地控制漏电流。
以下，将结合图9来详细描述根据本公开实施例的用于驱动像素驱动电路的方法。
图9是示出了根据本公开实施例的驱动像素驱动电路200、600和/或700的示例方法900的流程图。如图9所示，方法900可以包括步骤S910、S920和S930。根据本公开，方法900的一些步骤可以单独执行或组合执行，以及可以并行执行或顺序执行，并不局限于图9所示的具体操作顺序。在一些实施例中，方法900可以由本文所述各像素驱动电路或另一外部设备执行。
方法900可以开始于步骤S910，在复位阶段，扫描信号端可输入高电平的扫描信号，数据信号端可输入数据信号，复位信号端可输入低电平的复位信号，发光控制信号端可输入高电平的发光控制信号，第一电压信号端可输入低电平的第一电压信号，第二电压信号端可输入高电平的第二电压信号，以及像素驱动电路可向相应的OLED元件输出高电平的驱动信号。
在步骤S920，在信号写入阶段，扫描信号端可输入低电平的扫描信号，数据信号端可输入数据信号，复位信号端可输入高电平的复位信号，发光控制信号端可输入高电平的发光控制信号，第一电压信号端可输入低电平的第一电压信号，第二电压信号端可输入高电平的第二电压信号，以及像素驱动电路可向相应的OLED元件输出高电平的驱动信号。
在步骤S930，在发光阶段，扫描信号端可输入高电平的扫描信号，数据信号端可输入数据信号，复位信号端可输入高电平的复位信号，发光控制信号端可输入低电平的发光控制信号，第一电压信号端可输入低电平的第一电压信号，第二电压信号端可输入高电平的第二电压信号，以及像素驱动电路可向OLED元件输出与信号写入阶段中的数据信号相对应的驱动信号，以驱动OLED元件以相应灰阶发光。
此外，在一些实施例中，方法900还可以包括：当在OLED元件与像素驱动电路之间出现静电时，像素驱动电路的静电释放模块可将静电从第二电压信号端导出。
此外，根据本公开的一些实施例，还提供了显示面板，其可以包括如上所述的任一种或多种像素驱动电路。
此外，根据本公开的一些实施例，还提供了显示装置，其可以包括如上所述的显示面板。
通过使用根据本公开实施例的像素驱动电路及其驱动方法、显示面板和显示装置，可以在像素驱动电路或OLED元件中产生静电时有效释放静电，避免在生产和/或测试时静电对OLED显示器所可能产生的损坏，从而提高了产品良率、降低了生产成本。
至此已经结合优选实施例对本公开进行了描述。应该理解，本领域技术人员在不脱离本公开的精神和范围的情况下，可以进行各种其它的改变、替换和添加。因此，本公开的范围不局限于上述特定实施例，而应由所附权利要求所限定。
此外，在本文中被描述为通过纯硬件、纯软件和/或固件来实现的功能，也可以通过专用硬件、通用硬件与软件的结合等方式来实现。例如，被描述为通过专用硬件(例如，现场可编程门阵列(FPGA)、专用集成电路(ASIC)等)来实现的功能，可以由通用硬件(例如，中央处理单元(CPU)、数字信号处理器(DSP))与软件的结合的方式来实现，反之亦然。

Claims (12)

1.一种像素驱动电路，包括：
驱动模块，与扫描信号端、数据信号端、发光控制信号端、第一电压信号端和发光元件的第一端耦接，并被配置为能够在来自所述扫描信号端的扫描信号、来自数据信号端的数据信号以及来自发光控制信号端的发光控制信号的控制下向所述发光元件输出来自第一电压信号端的第一电压信号；以及
静电释放模块，与第二电压信号端和所述发光元件的第一端耦接，并被配置为能够在所述发光元件的所述第一端处产生静电时向所述第二电压信号端导出所述静电，
其中，所述静电释放模块包括：
第一晶体管，其控制端和第一端与所述发光元件的第一端耦接，以及第二端与所述第二电压信号端耦接；以及
第二晶体管，其控制端和第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接。
2.根据权利要求1所述的像素驱动电路，其中，所述驱动模块包括：
第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第四晶体管的控制端耦接；
所述第四晶体管，其控制端与所述第三晶体管的第二端耦接，第一端与第五晶体管的第二端耦接，以及第二端与第六晶体管的第一端耦接；
所述第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第四晶体管的第一端耦接；
所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；以及
第一电容，其一端与所述第三晶体管的第二端耦接，以及另一端与所述第一电压信号端耦接。
3.根据权利要求1所述的像素驱动电路，其中，所述驱动模块包括：
第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第一电容的一端耦接；
第四晶体管，其控制端与所述第一电容的另一端耦接，第一端与所述第一电压信号端耦接，以及第二端与第六晶体管的第一端耦接；
第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第一电容的所述一端耦接；
所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；
第八晶体管，其控制端与所述扫描信号端耦接，第一端与所述第一电容的所述另一端耦接，以及第二端与所述第六晶体管的第一端耦接；以及
所述第一电容，其所述一端与所述第三晶体管的第二端耦接，以及所述另一端与所述第八晶体管的第一端耦接。
4.根据权利要求2或3所述的像素驱动电路，其中，所述驱动模块还包括：
第七晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接。
5.根据权利要求1所述的像素驱动电路，其中，所述驱动模块包括：
第三晶体管，其控制端与所述扫描信号端耦接，第一端与所述数据信号端耦接，以及第二端与第四晶体管的第一端耦接；
第四晶体管，其控制端与第一电容的一端耦接，第一端与第五晶体管的第二端耦接，以及第二端与第六晶体管的第一端耦接；
所述第五晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第一电压信号端耦接，以及第二端与所述第四晶体管的第一端耦接；
所述第六晶体管，其控制端与所述发光控制信号端耦接，第一端与所述第四晶体管的第二端耦接，以及第二端与所述发光元件的第一端耦接；
第八晶体管，其控制端与所述扫描信号端耦接，第一端与所述第一电容的所述一端耦接，以及第二端与所述第六晶体管的第一端耦接；以及
所述第一电容，其所述一端与所述第四晶体管的控制端耦接，以及另一端与所述第一电压信号端耦接。
6.根据权利要求5所述的像素驱动电路，其中，所述驱动模块还包括：
第七晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述发光元件的第一端耦接；以及
第九晶体管，其控制端与复位信号端耦接，第一端与所述第二电压信号端耦接，以及第二端与所述第一电容的所述一端耦接。
7.根据权利要求1所述的像素驱动电路，其中，所述像素驱动电路中的各个晶体管是P型晶体管，来自所述第一电压信号端的第一电压信号是低电平信号，以及来自所述第二电压信号端的第二电压信号是高电平信号。
8.根据权利要求1所述的像素驱动电路，其中，所述第一晶体管和所述第二晶体管的沟道的宽长比为3/6。
9.一种显示面板，包括根据权利要求1～8中任一项所述的像素驱动电路。
10.一种显示装置，包括根据权利要求9所述的显示面板。
11.一种用于驱动根据权利要求1～8中任一项所述的像素驱动电路的方法，在一帧周期中包括以下操作：
在复位阶段，扫描信号端输入高电平的扫描信号，数据信号端输入数据信号，复位信号端输入低电平的复位信号，发光控制信号端输入高电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向相应的有机发光二极管OLED元件输出高电平的驱动信号；
在信号写入阶段，扫描信号端输入低电平的扫描信号，数据信号端输入数据信号，复位信号端输入高电平的复位信号，发光控制信号端输入高电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向相应的所述OLED元件输出高电平的驱动信号；以及
在发光阶段，扫描信号端输入高电平的扫描信号，数据信号端输入数据信号，复位信号端输入高电平的复位信号，发光控制信号端输入低电平的发光控制信号，第一电压信号端输入低电平的第一电压信号，第二电压信号端输入高电平的第二电压信号，以及所述像素驱动电路向所述OLED元件输出与所述信号写入阶段的数据信号相对应的驱动信号，以驱动所述OLED元件以相应灰阶发光。
12.根据权利要求11所述的方法，还包括：
当在所述OLED元件与所述像素驱动电路之间出现静电时，所述像素驱动电路的静电释放模块将所述静电从所述第二电压信号端导出。
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