CN110390916A - 显示装置 - Google Patents
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Abstract
将图像显示部内的多个像素形成部(PIX)分组,以使各像素组由K个(K为2以上的整数)像素形成部(PIX)形成。形成各像素组的K个像素形成部(PIX)连接到相同的源极总线SL。各像素形成部(PIX)设置有连接控制晶体管(12),其用于控制对应的源极总线(SL)和像素电极(13)之间的电连接状态。形成各像素组的K个像素形成部中所包括的K个连接控制晶体管(12)被控制以在相互不同的期间变为导通状态。源极驱动器在各水平扫描期间分时地将视频信号施加到各源极总线(SL)。
Description
技术领域
以下的公开涉及一种显示装置,特别是涉及分时地驱动视频信号线的显示装置。
背景技术
近年来,关于显示装置的显示图像的高分辨率化、高清晰度的发展是显著的。为了进行高分辨率化,需要增加传输视频信号的视频信号线(源极总线)的个数。对此,例如在一般的液晶显示装置中,通过以IC芯片等的方式安装在边框区域的源极驱动器,将视频信号供给到显示区域内的视频信号线。因此,当高分辨率化发展时,产生在安装源极驱动器的区域设置大量的焊盘(用于将视频信号从源极驱动器向显示区域内输入)91的必要性。另外,必须确保从焊盘91到显示区域的用于布线的区域92。根据以上,随着高分辨率化的发展,产生加宽边框区域的必要性,而设计自由度降低。
鉴于以上情况,提出了“将两个以上的视频信号线作为一组使视频信号线成组,将源极驱动器的一个输出端子(焊盘)分配到构成各组的多个视频信号线,并分时地在各水平扫描期间驱动构成各组的多个视频信号线”这样的驱动方式。这样的驱动方式称为“SSD方式”。此外,SSD为“Source Shared Driving:源共享驱动”的简称。这样的SSD方式通过在源极驱动器的输出端子和视频信号线之间设置多路分配器电路来实现。采用SSD方式的液晶显示装置的发明例如为日本特开2009-224869号公报所公开的。若采用SSD方式,由于减少了源极驱动器所需的输出端子的数量,因此能够缩小边框区域。
然而,根据日本特开2009-224869号公报所公开的液晶显示装置,构成多路分配器的多个开关元件(TFT)设置在边框区域。这些多个开关元件的存在妨碍了设计自由度的提升。另外,特别是近年来,具有用于车载的显示装置等矩形以外的形状的显示装置的需求正在增加。从这个观点来看,强烈需要实现边框区域的狭窄化以提高显示装置的设计自由度。
发明内容
因此,以下的公开涉及一种显示装置,其目的在于,实现边框区域的狭窄化以提高设计自由度。
根据若干个实施方式的显示装置包括:多个视频信号线;与所述多个视频信号线交叉的多个扫描信号线;图像显示部,其包含分别连接到所述多个视频信号线的一个和所述多个扫描信号线的一个的多个像素形成部;将视频信号施加到所述多个视频信号线的视频信号线驱动电路;以及将扫描信号施加到所述多个扫描信号线的扫描信号线驱动电路,
所述多个像素形成部被分组以使各像素组由K个(K为2以上的整数)像素形成部形成,
形成各像素组的K个像素形成部连接到相同的源极总线,
各像素形成部包括:
作为形成电容的电极的一个的像素电极;以及
连接控制晶体管,其用于控制对应的视频信号线和所述显示像素电极之间的电连接状态,
形成各像素组的K个像素形成部中所包括的K个连接控制晶体管在相互不同的期间变为导通状态,
所述视频信号线驱动电路在各水平扫描期间分时地将视频信号施加到各视频信号线。
根据这样的构成,一个像素组由K个(K为2以上的整数)像素形成部形成,并且形成各像素组的K个像素形成部连接到相同的视频信号线。另外,各像素形成部包括连接控制晶体管,其用于控制对应的视频信号线和像素电极之间的电连接状态。根据这样的构成,形成各像素组的K个像素形成部中所包括的K个连接控制晶体管在相互不同的期间变为导通状态。由此,能够利用施加到一个视频信号线的视频信号对形成各像素组的K个像素形成部进行所期望的充电。此处,在图像显示部内设置为了分配视频信号而发挥功能的连接控制晶体管,而不需要在边框区域设置用于分配视频信号的开关元件(晶体管等)。因此,关于进行视频信号线的分时驱动的显示装置,能够使边框区域比现有的更狭窄。即,能够进行显示装置的高分辨率化而不损害设计自由度。如上所述,关于显示装置,能够实现边框区域的狭窄化以提高设计自由度。
参考附图,根据下面对本发明的详细描述,本发明的这些及其他目的、特征、方式以及效果将变得更加明显。
附图说明
图1是示出第一实施方式中的像素组的构成的电路图。
图2是示出上述第一实施方式涉及的液晶显示装置的整体构成的框图。
图3是示出上述第一实施方式中的图像显示部以及边框区域的构成的图。
图4是示出上述第一实施方式中的一个像素形成部的构成的电路图。
图5是用于对上述第一实施方式中的驱动方法进行说明的时序图。
图6是用于对上述第一实施方式中的效果进行说明的图。
图7是示出第二实施方式中的图像显示部以及边框区域的构成的图。
图8是示出上述第二实施方式中的像素组的构成的电路图。
图9是用于对上述第二实施方式中的驱动方法进行说明的时序图。
图10是用于说明边框区域的图。
具体实施方式
以下,对实施方式进行说明。此外,关于n沟道型晶体管,漏极和源极中具有较高电位的被称为漏极,但在本说明书的说明中,一个被定义为漏极而另一个被定义为源极,因此有时源极电位高于漏极电位。另外,栅极端子相当于控制端子,漏极端子相当于第一导通端子,源极端子相当于第二导通端子。
<1.第一实施方式>
<1.1整体构成以及动作概要>
图2是示出第一实施方式涉及的液晶显示装置的整体构成的框图。该液晶显示装置由具有绝缘性的两块玻璃基板构成。一块玻璃基板称为阵列基板,另一块玻璃基板称为相对基板。阵列基板和相对基板例如通过密封材料贴合而成。阵列基板的面积大于相对基板的面积。因此,阵列基板上的区域中存在不与相对基板相对的区域即边框区域6。另外,本说明书中,将阵列基板与相对基板完全相对的区域(图2中付有附图标记5的区域)称为“显示区域”。
如图2所示,该液晶显示装置在功能上具备像素显示部10、栅极驱动器(扫描信号线驱动电路)20、源极驱动器(视频信号线驱动电路)30和显示控制电路40。图像显示部10和栅极驱动器20设置于显示区域5中。即,图像显示部10和栅极驱动器20单片地形成在阵列基板上。源极驱动器30例如以IC芯片的方式设置在边框区域6中。显示控制电路40例如设置在两块玻璃基板之外的基板上。
图像显示部10配设有多个栅极总线(扫描信号线)GL、多个源极总线(视频信号线)SL和后述的多个连接控制线(图2中未图示)。另外,形成像素的多个像素形成部以矩阵状设置在图像显示部10中(图2中未图示)。此外,之后将说明图像显示部10的更详细的构成。
显示控制电路40接收从外部发送的图像信号DAT、以及水平同步信号和垂直同步信号等的定时信号组TG,输出数字视频信号DV、用于控制源极驱动器30的动作的源极控制信号SCTL、用于控制栅极驱动器20的动作的栅极控制信号GCTL以及后述的连接控制信号SEL。此外,栅极控制信号GCTL包含有栅极起始脉冲信号以及栅极时钟信号,源极控制信号SCTL包含有源极起始脉冲信号、源极时钟信号以及锁存选通信号。
基于从显示控制电路40发送的栅极控制信号GCTL,栅极驱动器20以一个垂直扫描期间作为周期重复向各栅极总线GL施加有源扫描信号。
基于从显示控制电路40发送的数字视频信号DV和源极控制信号SCTL,源极驱动器30分时地将视频信号施加到各源极总线SL。此时,源极驱动器30中,在生成源极时钟信号的脉冲的时刻,依次保持表示要施加到各源极总线SL的数据电压的数字视频信号DV。并且,在生成锁存选通信号的脉冲的时刻,上述保持的数字视频信号DV被转换为模拟电压(数据电压)。该转换后的模拟电压作为驱动用的视频信号同时施加到所有的源极总线SL。
如上所述,通过将扫描信号施加到栅极总线GL,将视频信号施加到源极总线SL,基于从外部发送的图像数据DAT的图像被显示于图像显示部10中。
<1.2图像显示部的详细构成以及边框区域>
接着,一边参照图1、图3以及图4一边说明图像显示部10的详细构成以及边框区域6。如图3所示,图像显示部10配设有m个栅极总线GL1~GLm、n个源极总线SL1~SLn以及2n个连接控制线CL1a~CLna、CL1b~CLnb。另外,如图3所示,图像显示部10以矩阵状设置有(m×2n)个像素形成部PIX。
图4是示出一个像素形成部PIX的构成的电路图。如图4所示,像素形成部PIX包括:像素电极13、用于控制向像素电极3施加2视频信号的像素晶体管11、用于控制对应的源极总线SL和像素电极13的电连接状态的连接控制晶体管12、共用地设置在图像显示部10内的所有像素形成部PIX的共用电极15、以及由像素电极13和共用电极15形成的液晶电容14。像素晶体管11以及连接控制晶体管12为n沟道型的TFT(薄膜晶体管)。像素晶体管11中,栅极端子连接到对应的栅极总线GL,漏极端子连接到对应的连接控制线CL,源极端子连接到连接控制晶体管12的栅极端子。连接控制晶体管12中,栅极端子连接到像素晶体管11的源极端子,漏极端子连接到像素电极13,并且源极端子连接到对应的源极总线SL。
此外,在本实施方式中,如图3所示,各源极总线SL在像素矩阵的各行中连接到两个像素形成部PIX。包括在像素矩阵的奇数列中的像素形成部PIX被连接到在图3的右边的源极总线SL,包括在像素矩阵的偶数列中的像素形成部PIX被连接到在图3的左边的源极总线SL。另外,包括在像素矩阵的各行的2n个像素形成部PIX连接到相同的栅极总线GL。利用上述构成,关于(m×2n)个像素形成部PIX,在本实施方式中,一个像素组由两个像素形成部PIX形成。像素组对应于m个栅极总线GL1~GLm与n个源极总线SL1~SLn的各交叉点形成。即,图像显示部10形成有(m×n)个像素组。
图1是示出对应于栅极总线GL1与源极总线SL1的交叉点的像素组的构成的电路图。此外,包括在该像素组的两个像素形成部中的一个以及构成要素附加参照附图标记“(A)”,包括在该像素组的两个像素形成部中的另一个以及构成要素附加参照附图标记“(B)”。但是,对于共用电极15,由于是在所有像素形成部PIX共用设置的构成要素,因此不附加“(A)”和“(B)”。另外,关于像素形成PIX(A),将附图标记N(A)附加到像素晶体管11(A)的源极端子和连接控制晶体管12(A)的栅极端子之间的节点上。同样地,关于关于像素形成PIX(B),将附图标记N(B)附加到像素晶体管11(B)的源极端子和连接控制晶体管12(B)的栅极端子之间的节点上。
像素晶体管11(A)的栅极端子和像素晶体管11(B)的栅极端子均连接到栅极总线GL1。连接控制晶体管12(A)的源极端子和连接控制晶体管12(B)的源极端子均连接到源极总线SL1。像素晶体管11(A)的漏极端子和像素晶体管11(B)的漏极端子连接到不同的连接控制线CL。具体而言,像素晶体管11(A)的漏极端子连接到连接控制线CL1a,像素晶体管11(B)的漏极端子连接到连接控制线CL1b。
此外,图1示出了对应于栅极总线GL1与源极总线SL1的交叉点的像素组的构成,但其它像素组的构成也是同样的。
本实施方式中,作为连接控制信号SEL而使用第一连接控制信号SEL1以及第二连接控制信号SEL2。第一连接控制信号SEL1被提供给连接控制线CL1a~CLna,第二连接控制信号SEL2被提供给连接控制线CL1b~CLnb。与此相对应地,第一连接控制信号SEL1用的焊盘61(1)以及第二连接控制信号SEL2用的焊盘61(2)设置在边框区域6。另外,视频信号D1~Dn分别被提供给源极总线SL1~SLn。与此相对应地,视频信号D1~Dn用的焊盘62(1)~62(n)设置在边框区域6。
<1.3驱动方法>
接着,一边参照图5所示的时序图一边说明本实施方式中的驱动方法。此处,注意图1所示的像素组(像素形成部PIX(A)、PIX(B))。扫描信号G1被提供到栅极总线GL1,第一连接控制信号SEL1被提供到连接控制线CL1a,第二连接控制信号SEL2被提供到连接控制线CL1b。此外,图5中的PIX(A)、PIX(B)的波形分别表示液晶电容14(A)、14(B)的充电电位(图9也是同样的)。
在期间T11中,扫描信号G1以及第一连接控制信号SEL1为高电平(有效)。当扫描信号G1变为高电平时,像素晶体管11(A)以及像素晶体管11(B)变为导通状态。此时,第二连接控制信号SEL2处于低电平,但是第一连接控制信号SEL1处于高电平。因此,像素形成部PIX(B)中的节点N(B)的电位维持在低电平,但是像素形成部分PIX(A)中的节点N(A)的电位变为高电平。由此,连接控制晶体管12(A)变为导通状态。其结果,视频信号D1被施加到像素电极13(A),并基于此时的数据电位(视频信号D1的电位)对液晶电容器14(A)充电。
在期间T12中,第一连接控制信号SEL1变为低电平。此时,由于扫描信号G1维持在高电平,因此节点N(A)的电位经由像素晶体管11(A)变为低电平。由此,连接控制晶体管12(A)变为断开状态。
在期间T13中,第二连接控制信号SEL2在扫描信号G1维持在高电平的状态下变为高电平。由于扫描信号G1维持在高电平,因此像素晶体管11(A)以及像素晶体管11(B)维持导通状态。此时,第一连接控制信号SEL1处于低电平,但是第二连接控制信号SEL2处于高电平。因此,像素形成部PIX(A)中的节点N(A)的电位维持在低电平,但是像素形成部分PIX(B)中的节点N(B)的电位变为高电平。由此,连接控制晶体管12(B)变为导通状态。其结果,视频信号D1被施加到像素电极13(B),并基于此时的数据电位(视频信号D1的电位)对液晶电容器14(B)充电。此处,通过使期间T13中的数据电位与期间T11中的数据电位不同,能够利用施加到一个源极总线SL1的视频信号D1对两个像素形成部PIX(A)、PIX(B)进行所期望的充电。
在期间T14中,第二连接控制信号SEL2变为低电平。此时,由于扫描信号G1维持在高电平,因此节点N(B)的电位经由像素晶体管11(B)变为低电平。由此,连接控制晶体管12(B)变为断开状态。
若在期间T15中,则扫描信号G1变为低电平。由此,像素晶体管11(A)以及像素晶体管11(B)变为断开状态。此外,在期间T15以后的期间中,在像素矩阵的第二行以后的行所包括的像素组进行与上述相同的动作。
<1.4效果>
根据本实施方式,一个像素组由两个像素形成部PIX形成,并且形成各像素组的两个像素形成部PIX连接到相同的源极总线SL。另外,各像素形成部PIX包括连接控制晶体管12,其用于控制对应的源极总线SL和像素电极13之间的电连接状态。在这样的构成中,连接控制晶体管12的导通/断开状态由经由像素晶体管11提供的连接控制信号SEL控制。与此相关地,不同的连接控制信号SEL被提供到形成各像素组的两个像素形成部PIX。因此,形成各像素组的两个像素形成部PIX中所包括的两个连接控制晶体管12在相互不同的期间变为导通状态。由此,能够利用施加到一个源极总线SL的视频信号对形成各像素组的两个像素形成部PIX进行所期望的充电。此处,用于将施加到一个源极总线SL的视频信号分配到两个像素形成部PIX的连接控制晶体管12设置在显示区域5内,边框区域6内未设置用于分配视频信号的晶体管(开关元件)。另外,作为用于分配视频信号的信号,整体上仅使用两个连接控制信号SEL(第一连接控制信号SEL1和第二连接控制信号SEL2),无论分辨率如何,仅需要在边框区域6设置两个焊盘以用于这两个连接控制信号SEL。根据以上,关于进行源极总线SL的分时驱动的液晶显示装置,如图6所示,能够使边框区域6比现有的窄。即,能够进行液晶显示装置的高分辨率化而不损害设计自由度。这样,根据本实施方式,关于液晶显示装置,能够实现边框区域6的狭窄化以提高设计自由度。
<2.第二实施方式>
<2.1概略以及整体构成>
第一实施方式中,由两个像素形成部PIX形成了一个像素组。与此相对,在本实施例中,由四个像素形成部PIX形成一个像素组。对于整体构成,由于与第一实施方式相同,因此省略说明(参照图2)。
<2.2图像显示部的详细构成以及边框区域>
接着,一边参照图4、图7以及图8一边说明图像显示部10的详细构成以及边框区域6。如图7所示,在本实施方式中,图像显示部10配设有2m个栅极总线GL1a~GLma,GL1b~GLmb、n个源极总线SL1~SLn以及4n个连接控制线CL1a~CLna、CL1b~CLnb、CL1c~CLnc以及CL1d~CLnd。另外,如图7所示,图像显示部10以矩阵状设置有(m×4n)个像素形成部PIX。各像素形成部PIX的内部构成与第一实施方式相同(参照图4)。
在本实施方式中,如图7所示,各源极总线SL在像素矩阵的各行中连接到形成像素组的四个像素形成部PIX。关于各像素组,四个像素形成部PIX中的两个相对于对应的源极总线SL位于图7中的左边,四个像素形成部PIX中的剩余两个相对于对应的源极总线SL位于图7中的右边。但是,源极总线SL和像素形成部PIX之间的位置关系并不限定于此。另外,关于各像素组,相对于源极总线SL位于左边的两个像素形成部PIX与相对于源极总线SL位于右边的两个像素形成部PIX连接到不同的栅极总线GL。
图8是示出对应于两个栅极总线GL1a、GL1b与源极总线SL1的像素组的构成的电路图。此外,对包括在该像素组中的四个像素形成部分别附加“A”~“D”(对于这些构成要素也是相同的)。
像素晶体管11(A)的栅极端子和像素晶体管11(B)的栅极端子连接到栅极总线GL1a。像素晶体管11(C)的栅极端子和像素晶体管11(D)的栅极端子连接到栅极总线GL1b。连接控制晶体管12(A)~12(D)的源极端子均连接到源极总线SL1。像素晶体管11(A)~11(D)的漏极端子连接到相互不同的连接控制线CL。具体而言,像素晶体管11(A)的漏极端子连接到连接控制线CL1a,像素晶体管11(B)的漏极端子连接到连接控制线CL1b,像素晶体管11(C)的漏极端子连接到连接控制线CL1c,像素晶体管11(D)的漏极端子连接到连接控制线CL1d。
此外,图8示出了对应于两个栅极总线GL1a、GL1b与源极总线SL1的像素组的构成,但其它像素组的构成也是同样的。
本实施方式中,与第一实施方式相同,作为连接控制信号SEL而使用第一连接控制信号SEL1以及第二连接控制信号SEL2。第一连接控制信号SEL1被提供给连接控制线CL1a~CLna、CL1c~CL1c,第二连接控制信号SEL2被提供给连接控制线CL1b~CLnb、CL1d~CL1d。与此相对应地,第一连接控制信号SEL1用的焊盘61(1)以及第二连接控制信号SEL2用的焊盘61(2)设置在边框区域6。另外,视频信号D1~Dn分别被提供给源极总线SL1~SLn。与此相对应地,视频信号D1~Dn用的焊盘62(1)~62(n)设置在边框区域6。
<2.3驱动方法>
接着,一边参照图9所示的时序图一边说明本实施方式中的驱动方法。此处,注意图8所示的像素组(像素形成部PIX(A)~PIX(D))。扫描信号G1a被提供到栅极总线GL1a,扫描信号G1b被提供到栅极总线GL1b,第一连接控制信号SEL1被提供到连接控制线CL1a、CL1c,第二连接控制信号SEL2被提供到连接控制线CL1b、CL1d。
在期间T21中,扫描信号G1a以及第一连接控制信号SEL1为高电平。通过使扫描信号G1a变为高电平,像素晶体管11(A)以及像素晶体管11(B)变为导通状态。此时,第二连接控制信号SEL2处于低电平,但是第一连接控制信号SEL1处于高电平。因此,像素形成部PIX(B)中的节点N(B)的电位维持在低电平,但是像素形成部分PIX(A)中的节点N(A)的电位变为高电平。由此,连接控制晶体管12(A)变为导通状态。其结果,视频信号D1被施加到像素电极13(A),并基于此时的数据电位(视频信号D1的电位)对液晶电容器14(A)充电。
在期间T22中,第一连接控制信号SEL1变为低电平。此时,由于扫描信号G1a维持在高电平,因此节点N(A)的电位经由像素晶体管11(A)变为低电平。由此,连接控制晶体管12(A)变为断开状态。
在期间T23中,第二连接控制信号SEL2在扫描信号G1a维持在高电平的状态下变为高电平。由于扫描信号G1a维持在高电平,因此像素晶体管11(A)以及像素晶体管11(B)维持导通状态。此时,第一连接控制信号SEL1处于低电平,但是第二连接控制信号SEL2处于高电平。因此,像素形成部PIX(A)中的节点N(A)的电位维持在低电平,但是像素形成部分PIX(B)中的节点N(B)的电位变为高电平。由此,连接控制晶体管12(B)变为导通状态。其结果,视频信号D1被施加到像素电极13(B),并基于此时的数据电位(视频信号D1的电位)对液晶电容器14(B)充电。
在期间T24中,第二连接控制信号SEL2变为低电平。此时,由于扫描信号G1a维持在高电平,因此节点N(B)的电位经由像素晶体管11(B)变为低电平。由此,连接控制晶体管12(B)变为断开状态。
若在期间T25中,则扫描信号G1a变为低电平。由此,像素晶体管11(A)以及像素晶体管11(B)变为断开状态。另外,在期间T25~期间T28中,扫描信号G1b变为高电平。由此,期间T25~期间T28中,在像素形成部PIX(C)、PIX(D)中进行与期间T21~期间T24中的像素形成部PIX(A)、PIX(B)同样的动作。
在期间T29以后的期间中,在像素矩阵的第二行以后的行所包括的像素组进行与上述相同的动作。
此外,通过使期间T21中的数据电位、期间T23中的数据电位、期间T25中的数据电位以及期间T27中的数据电位相互不同,能够利用施加到一个源极总线SL1的视频信号D1对四个像素形成部PIX(A)~PIX(D)进行所期望的充电。
<2.4效果>
根据本实施方式,一个像素组由四个像素形成部PIX形成,并且形成各像素组的四个像素形成部PIX连接到相同的源极总线SL。关于形成各像素组的四个像素形成部PIX,不同的扫描信号被提供给两个像素形成部PIX和剩余的两个像素形成部PIX。另外,各像素形成部PIX包括连接控制晶体管12,其用于控制对应的源极总线SL和像素电极13之间的电连接状态。在这样的构成中,连接控制晶体管12的导通/断开状态由经由像素晶体管11提供的连接控制信号SEL控制。此处,在形成各像素组的四个像素形成部PIX中,被提供的扫描信号、连接控制信号的组合相互不同。因此,形成各像素组的四个像素形成部PIX中所包括的四个连接控制晶体管12在相互不同的期间变为导通状态。由此,能够利用施加到一个源极总线SL的视频信号对形成各像素组的四个像素形成部PIX进行所期望的充电。此处,用于将施加到一个源极总线SL的视频信号分配到四个像素形成部PIX的连接控制晶体管12设置在显示区域5内,边框区域6内未设置用于分配视频信号的晶体管(开关元件)。另外,与第一实施方式同样地,作为用于分配视频信号的信号,整体上仅使用两个连接控制信号SEL(第一连接控制信号SEL1和第二连接控制信号SEL2),无论分辨率如何,仅需要在边框区域6设置两个焊盘以用于这两个连接控制信号SEL。根据以上,与第一实施方式同样地,关于液晶显示装置,能够实现边框区域6的狭窄化以提高设计自由度。
<3.变形例>
第一实施方式中采用图3所示的构成,并且在各水平扫描期间将各视频信号分配给两个像素形成部PIX。第二实施方式中采用图7所示的构成,并且在各水平扫描期间将各视频信号分配给四个像素形成部PIX。但是,本发明并不限定于这样的构成。例如,可以由三个像素形成部PIX形成一个像素组并且在各水平扫描期间将各视频信号分配给三个像素形成部PIX,也可以由五个以上的像素形成部PIX形成一个像素组并且在各水平扫描期间将各视频信号分配给该五个以上的像素形成部PIX。
另外,第二实施方式中在像素矩阵的每一行设置了两个栅极总线GL,但是,例如,通过将相互不同的四个连接控制信号提供到形成各像素组的四个像素形成部PIX,即使在在像素矩阵的每一行仅设置一个栅极总线GL的情况下,也能够在各水平扫描期间将各视频信号分配给四个像素形成部PIX。
若概括而言,则能够采用如下的构成。
将图像显示部10中的多个像素形成部PIX分组,以使各像素组由K个(K为2以上的整数)像素形成部PIX形成。
形成各像素组的K个像素形成部PIX连接到相同的源极总线SL。
包括在形成各像素组的K个像素形成部PIX中的K个像素晶体管11的控制端子连接到J个栅极总线GL以使(K/J)个像素形成部PIX对应于一个栅极总线GL。
准备在相互不同时刻的有效的(K/J)个连接控制信号SEL作为连接控制信号SEL,。
关于形成各像素组的K个像素形成部PIX中包括的K个像素晶体管11,连接到相同栅极总线GL的(K/J)个像素晶体管11的第一导电端子连接到传输相互不同的连接控制信号SEL的连接控制信号线。
<4.其他>
上述各实施方式中,举出在矩形的显示区域5中以矩阵状配置像素形成部PIX的示例并进行了说明,但本发明并不限定于此,也可以将本发明应用于具有矩形以外的形状的显示区域的显示装置。由此,例如当实现用于车载的显示装置时,提高了设计自由度。
另外,在上述各实施方式中,以在像素晶体管11、连接控制晶体管12中采用n沟道型TFT的情况为例进行了说明,但本发明也可以应用于采用p沟道型TFT的情况。
进一步地,在上述各实施方式中,以液晶显示装置为例进行了说明,但本发明并不限定于此。例如,也能将本发明应用于有机EL显示装置等其他的显示装置。
以上详细地说明了本发明,但以上的说明在所有方面都是示例性的而不是限制性的。应该理解,在不脱离本发明的范围的情况下,可以想到多个其他变更、变形。
Claims (6)
1.一种显示装置,其包括:多个视频信号线;与所述多个视频信号线交叉的多个扫描信号线;图像显示部,其包含分别连接到所述多个视频信号线的一个和所述多个扫描信号线的一个的多个像素形成部;将视频信号施加到所述多个视频信号线的视频信号线驱动电路;以及将扫描信号施加到所述多个扫描信号线的扫描信号线驱动电路,所述显示装置的特征在于,
所述多个像素形成部被分组以使各像素组由K个(K为2以上的整数)像素形成部形成,
形成所述各像素组的K个像素形成部连接到相同的源极总线,
各像素形成部包括:
作为形成电容的电极的一个的像素电极;以及
连接控制晶体管,其用于控制对应的视频信号线和所述显示像素电极之间的电连接状态,
形成所述各像素组的K个像素形成部中所包括的K个连接控制晶体管在相互不同的期间变为导通状态,
所述视频信号线驱动电路在各水平扫描期间分时地将视频信号施加到各视频信号线。
2.如权利要求1所述的显示装置,其特征在于,
所述图像显示部还包括多个连接控制信号线,其传输用于控制包括在所述多个显示形成部中的连接控制晶体管的导通/断开状态的连接控制信号,
各像素形成部还包括像素晶体管,其具有连接到对应的扫描信号线的控制端子、连接到对应的连接控制信号线的第一导通端子、以及连接到所述连接控制晶体管的控制端子的第二导通端子,
所述连接控制晶体管具有连接到所述像素晶体管的第二导通端子的控制端子、连接到所述像素电极的第一导通端子,以及连接到对应的视频信号线的第二导通端子。
3.如权利要求2所述的显示装置,其特征在于,
形成所述各像素组的K个像素形成部中所包括的K个像素晶体管的控制端子连接到相同的扫描信号线,
准备在相互不同时刻的有效的K个连接控制信号作为所述连接控制信号,
形成所述各像素组的K个像素形成部中所包括的K个像素晶体管的第一导通端子连接到传输相互不同的连接控制信号的连接控制信号线。
4.如权利要求2所述的显示装置,其特征在于,
所述K为2,
准备在不同时刻的有效的第一连接控制信号以及第二连接控制信号作为所述连接控制信号,
若将形成所述各像素组的两个像素形成部定义为第一像素形成部和第二像素形成部,则关于所述各像素组,
所述第一像素形成部所包括的像素晶体管的控制端子和所述第二像素形成部所包括的像素晶体管的控制端子连接到相同的扫描信号线,
所述第一像素形成部所包括的像素晶体管的第一导通端子连接到传输所述第一连接控制信号的连接控制信号线,
所述第二像素形成部所包括的像素晶体管的第一导通端子连接到传输所述第二连接控制信号的连接控制信号线。
5.如权利要求2所述的显示装置,其特征在于,
形成所述各像素组的K个像素形成部中所包括的K个像素晶体管的控制端子连接到J个栅极总线以使(K/J)个像素形成部对应于一个栅极总线,
准备在相互不同的时刻的有效的(K/J)个连接控制信号作为所述连接控制信号,
关于形成所述各像素组的K个像素形成部中所包括的K个像素晶体管,连接到相同的扫描信号线的(K/J)个像素晶体管的第一导通端子连接到传输相互不同的连接控制信号的连接控制信号线。
6.如权利要求2所述的显示装置,其特征在于,
所述K为4,
准备在不同时刻的有效的第一连接控制信号以及第二连接控制信号作为所述连接控制信号,
若将形成所述各像素组的四个像素形成部定义为第一像素形成部、第二像素形成部、第三像素形成部和第四像素形成部,则关于所述各像素组,
所述第一像素形成部所包括的像素晶体管的控制端子和所述第二像素形成部所包括的像素晶体管的控制端子连接到相同的扫描信号线,
所述第三像素形成部所包括的像素晶体管的控制端子和所述第四像素形成部所包括的像素晶体管的控制端子连接到相同的扫描信号线,
所述第一像素形成部所包括的像素晶体管的控制端子和所述第三像素形成部所包括的像素晶体管的控制端子连接到不同的扫描信号线,
所述第一像素形成部所包括的像素晶体管的第一导通端子和所述第三像素形成部所包括的像素晶体管的第一导通端子连接到传输所述第一连接控制信号的连接控制信号线,
所述第二像素形成部所包括的像素晶体管的第一导通端子和所述第四像素形成部所包括的像素晶体管的第一导通端子连接到传输所述第二连接控制信号的连接控制信号线。
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