CN110198194A - 无线电调制信号发生装置 - Google Patents

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Abstract

本发明公开了一种无线电调制信号发生装置，属于通信技术领域。所述无线电调制信号发生装置集成在一块FPGA上，所述装置包括：音频源产生模块，被配置为利用DDS产生音频源；调制模块，被配置为对所述音频源产生模块产生的音频源进行调制，得到调制信号，所述调制的方式为SSB调制、AM调制和FM调制中的一种；调整模块，被配置为对所述调制模块输出的调制信号进行处理，以调整所述调制信号的带宽和采样速率；频率合成模块，被配置为基于所述调整模块处理后的所述调制信号合成射频信号。

Description

无线电调制信号发生装置
技术领域
本发明涉及通信技术领域，特别涉及一种无线电调制信号发生装置。
背景技术
随着电台设备的广泛应用，各类电台检测仪器设备也应用而生。无线电波看不见摸不着，要靠仪器测量才能了解其特性。早期的电台测量设备都是单一功能的仪器，为了测量电台通信设备的多个重要参数必须使用多个仪器。测量实验室往往需要摆放很多仪器,测量时需要分别连接不同的仪器，这使得测量工作不但繁琐，而且影响效率，而且众多仪器堆在一起使用，往往线缆凌乱，不便于管理。为此，人们就期望将一些常用测量仪器整合在一起，成为一台多功能的综合性仪器，来提高测量效率和满足现场检测的需要，这就是电台综合测试仪的由来。
现代无线电台综合测试仪与时俱进，为了满足日益复杂的数字通信信号测量、更高的性能和更加便携，产品硬件上向着数字化软件无线电方向发展。电台综测仪的无线电调制信号发生装置是电台综测仪中一个非要重要的部分，相关技术中无线电调制信号发生装置多采用模拟电路实现，体积和功耗大，且无法实现灵活配置。
发明内容
本发明实施例提供了一种无线电调制信号发生装置。所述技术方案如下：
本发明实施例提供了一种无线电调制信号发生装置，所述无线电调制信号发生装置集成在一块FPGA上，所述装置包括：
音频源产生模块，被配置为利用DDS产生音频源；
调制模块，被配置为对所述音频源产生模块产生的音频源进行调制，得到调制信号，所述调制的方式为SSB调制、AM调制和FM调制中的一种；
调整模块，被配置为对所述调制模块输出的调制信号进行处理，以调整所述调制信号的带宽和采样速率；
频率合成模块，被配置为基于所述调整模块处理后的所述调制信号合成射频信号。
在本发明实施例的一种实现方式中，所述音频源产生模块，被配置产生采样速率为200Ksps、音频频率在0～25KHz范围内、精度高于1Hz的音频源。
在本发明实施例的另一种实现方式中，所述调制模块，包括：
SSB调制电路，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；若选择上边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号作为所述SSB调制电路的Q路输出；若选择下边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号取反后作为所述SSB调制电路的Q路输出，得到所述SSB调制电路的基带输出；
AM调制电路，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号与调幅深度进行相乘得到输出p0_out；将所述p0_out叠加一个直流偏置dc_offset得到输出add_out；把所述add_out赋值给am_data_i，将0赋值给am_data_q，得到所述AM调制电路的基带输出；
FM调制电路，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号与调频频偏相乘得到输出p1_out；对所述p1_out的相位进行归一化处理得到cordic_phase；使用cordic算法计算所述cordic_phase每个相位下的正余弦值，得到cordic_data_i和cordic_data_q；将所述cordic_data_i和所述cordic_data_q分别赋值给fm_data_i和fm_data_q，得到所述FM调制电路的基带输出。
在本发明实施例的另一种实现方式中，所述调整模块，包括：
信道滤波器，被配置为对所述调制模块输出的调制信号进行滤波处理，以限制所述调制信号的带宽；
内插滤波器组，被配置对所述信道滤波器处理后的调制信号进行内插滤波处理，以得到采样速率为150Msps的调制信号。
在本发明实施例的另一种实现方式中，所述内插滤波器组，包括：
半带滤波器，被配置将所述调制信号的采样速率由200Ksps调整为400Ksps；
低通滤波器，配置将所述调制信号的采样速率由400Ksps调整为1.2Msps；
CIC滤波器，配置将所述调制信号的采样速率由1.2Msps调整为150Msps。
在本发明实施例的另一种实现方式中，所述频率合成模块包括：JESD204B接口和高速DAC，所述JESD204B接口同时与所述调整模块的输出端以及所述高速DAC的输入端电连接。
在本发明实施例的另一种实现方式中，所述JESD204B接口，包括：
XILINX的IP CORE，被配置为采用JESD204B协议对所述调制信号进行打包，得到JESD204B协议打包数据；
GTX模块，被配置为将所述JESD204B协议打包数据转换成高速串行数据，输出给所述高速DAC。
在本发明实施例的另一种实现方式中，所述高速DAC，被配置为从所述高速串行数据中解析出所述调制信号；将所述调制信号的采样速率调整为2.4Gsps；经过一个48bit的数字控制振荡器NCO处理完成射频频率合成。
在本发明实施例的另一种实现方式中，所述装置还包括：
依次连接在所述频率合成模块的输出端的运算放大器和多级衰减模块。
在本发明实施例的另一种实现方式中，所述装置还包括：
检波电路，被配置为对所述频率合成模块输出的射频信号的进行检波处理，得到检波数据；采用所述检波数据控制所述音频源产生模块工作，使得所述射频信号的功率值锚定在用户设定功率值上。
本发明实施例提供的技术方案带来的有益效果是：
在本发明实施例中，该无线电调制信号发生装置支持SSB、AM、FM等多种调制音频源的产生，能够满足电台综测仪的需求。无线电调制信号发生装置采用FPGA实现，上述各个模块均集成在FPGA上。由于整个方案采用FPGA+软件无线电的思想，具有运算速度快，实时性好，指标精度高和性能好，灵活可维护性好，功耗低体积小等众多优点。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的一种无线电调制信号发生装置的结构示意图；
图2是本发明实施例提供的一种调制模块的结构示意图；
图3是本发明实施例提供的SSB调制示意图；
图4是本发明实施例提供的AM调制示意图；
图5是本发明实施例提供的FM调制示意图；
图6是本发明实施例提供的一种调整模块的结构示意图；
图7是本发明实施例提供的一种频率合成模块的结构示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
图1是本发明实施例提供的一种无线电调制信号发生装置的结构示意图。参见图1，该无线电调制信号发生装置集成在一块现场可编程门阵列(Field－Programmable GateArray，FPGA)上，该装置包括：
音频源产生模块101，被配置为利用直接数字频率合成器(Direct DigitalSynthesizer，DDS)产生音频源；
调制模块102，被配置为对所述音频源产生模块产生的音频源进行调制，得到调制信号，所述调制的方式为单边带(Single Side Band，SSB)调制、调幅(AmplitudeModulation，AM)调制和调频(Frequency Modulation，FM)调制中的一种；
调整模块103，被配置为对所述调制模块输出的调制信号进行处理，以调整所述调制信号的带宽和采样速率；
频率合成模块104，被配置为基于所述调整模块处理后的所述调制信号合成射频信号。
在本发明实施例中，该无线电调制信号发生装置支持SSB、AM、FM等多种调制音频源的产生，能够满足电台综测仪的需求。无线电调制信号发生装置采用FPGA实现，上述各个模块均集成在FPGA上。由于整个方案采用FPGA+软件无线电的思想，具有运算速度快，实时性好，指标精度高和性能好，灵活可维护性好，功耗低体积小等众多优点。
其中，软件无线电是是指在开放的硬件平台上利用软件技术来实现各种功能。例如，本发明首先利用FPGA搭建了一个软件无线电硬件平台，然后利用数字信号处理，把音频源的产生及各种调制过程写在软件中，这样能够获得更好的性能，更灵活，体积功耗小等优点，而常规的电台综合测试仪的信号发生装置不是基于软件无线电平台+数字信号处理的方法实现的。
其中，在该装置工作的过程中，音频频率、调制模式(SSB/AM/FM)、调制度、射频频率和功率等参数由用户事先设置。无线电调制信号发生装置只需要根据这些参数产生射频信号即可。也即，该装置还可以包括一参数设置模块，用于实现人机交互，完成监控、管理等功能。音频频率、调制度等可灵活设置。
在音频源产生模块101中，DDS根据配置的频率控制字，进行查表得到所需频率的余弦信号；这里的音频源不是真实的语音，是为了能测试电台接收机性能而发的有规律的余弦信号。
在本发明实施例的一种实现方式中，所述音频源产生模块101，被配置产生采样速率为200Ksps、音频频率在0～25KHz范围内、精度高于1Hz的音频源。将音频源产生模块101产生的音频源的参数设置在上述数值下，可以实现SSB及另外2种方式的后续调制。
图2是本发明实施例提供的一种调制模块102的结构示意图。参见图2，所述调制模块102，包括：
SSB调制电路121，该SSB调制电路121支持上边带和下边带。SSB是幅度调制中的一种，它只传输频带幅度调制信号的一个边带，使用的带宽只有双边带调制信号的一半，具有更高的频率利用率，成为一种广泛使用的调制方式。具体地，图3是本发明实施例提供的SSB调制示意图，如图3所示，SSB调制电路121被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ(audio_data_i/audio_data_q)，其中，复数IQ分为两路，两路信号相互正交，IQ中的I表示in-phase(同相)，Q表示quadrature(正交)；若选择上边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号作为所述SSB调制电路的Q路输出，即ssb_data_i＝audio_data_i，ssb_data_q＝audio_data_q；若选择下边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号取反后作为所述SSB调制电路的Q路输出，即ssb_data_i＝audio_data_i，ssb_data_q＝-audio_data_q，得到所述SSB调制电路的基带输出。
AM调制电路122，AM是使载波的振幅按照所需传送信号的变化规律而变化，但频率保持不变的调制方法，AM信号的表达式：SAM(t)＝A[1+ma*m(t)]*cos(wct)，其中A为直流，ma为调幅深度，m(t)为被调信号，cos(wct)为载波信号。具体地，图4是本发明实施例提供的AM调制示意图，如图4所示，AM调制电路122被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号(audio_data_i)与调幅深度(md_config)进行相乘得到输出p0_out；将所述p0_out叠加一个直流偏置dc_offset得到输出add_out；把所述add_out赋值给am_data_i，将0赋值给am_data_q，即am_data_i＝add_out，am_data_q＝0，得到所述AM调制电路的基带输出。该AM调制电路122的参数可以由用户进行设置，例如AM调制电路122的调制度范围0～99％，调制度分辨率0.1％，调制度误差不大于3％标称值，解调失真度不大于2％(30％，1KHz)。
其中，dc_offset可以等于32768。
FM调制电路123，FM调制是载频信号的频率，随调制的音频信号而变，幅度不变，FM信号的表达式为SFM(t)＝Acos[wct+Kf∫m(τ)d(τ)]，其中Kf为调频灵敏度，m(t)为被调制信号，Kf∫m(τ)d(τ)表示瞬时相位偏移。具体地，图5是本发明实施例提供的FM调制示意图，如图5所示，FM调制电路123被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号(audio_data_i)与调频频偏(mf_config)相乘得到输出p1_out；对所述p1_out的相位进行归一化处理得到cordic_phase；使用cordic算法计算所述cordic_phase每个相位下的正余弦值，得到cordic_data_i和cordic_data_q；将所述cordic_data_i和所述cordic_data_q分别赋值给fm_data_i和fm_data_q，得到所述FM调制电路的基带输出。该FM调制电路123的参数可以由用户进行设置，例如FM调制电路123的调制度范围0～25KHz，调制度分辨率0.1KHz，调制度误差不大于3％标称值，解调失真度不大于2％(5KHz，1KHz)。
其中，FM调制电路123采用如下方式进行归一化处理：将p1_out除以229，根据商的奇偶和余数的正负把结果归一化到-pi～+pi之间，这是由于后面的cordic ip核输入相位只能支持-pi～+pi。示例性地，如果商为偶数，余数为正，归一化结果为余数；如果商为偶数，余数为负，归一化结果为232-余数；如果商为奇数，余数为正，归一化结果为232-(229-余数)；如果商为奇数，余数为负，归一化结果为229+X，这样就能把相位归一化到-pi～+pi。其中，pi是角的度量单位，pi表示180°，-pi表示-180°。
其中，调制模块102具体选用哪个调制电路来进行调制，根据用户设定的调制模式选择。
其中，调制模块102中的各个电路可以按照基带正交调制理论对所述音频源进行数字化。在软件无线电中，信号调制的实现基于正交调制理论，通过数字上变频完成。正交调制要求输入的基带信号为正交信号，因此，数字化的调制信号需要根据不同的调制方式进行相应的正交处理，这就是基带信号调制理论。
通常，相关技术中上述三种调制采用模拟器件来实现，而本申请采用数字方式实现，灵活性更好。
图6是本发明实施例提供的一种调整模块103的结构示意图，参见图6，所述调整模块103，包括：
信道滤波器131，被配置为对所述调制模块输出的调制信号进行滤波处理，以限制所述调制信号的带宽；
内插滤波器组132，被配置对所述信道滤波器处理后的调制信号进行内插滤波处理，以得到采样速率为150Msps的调制信号。
其中，信道滤波器131可以为FPGA中有限冲击响应(Finite Impulse Response，FIR)滤波器，其滤波器系数可以采用matlab中fdatool工具生成，使用信道滤波器后已调信号的采样速率是200Ksps。例如，用户在matlab的命令行输入fdatool命令，打开了matlab滤波器设计图形界面，在里面输入通带和阻带值，工具自动生成系数，生成系数导入到FIR滤波器中即可。其中，通带和阻带值的确定是根据调制信号最大带宽来确定，例如，三种调制方式中调频信号的最大带宽最宽，所以只需确定调频信号的最大带宽就行，调频的最大带宽BW约＝2*(音频源频率+调频频偏)；通带设置为BW/2，考虑资源以及对信号带宽的限制阻带设置为(BW/2)*1.2。
如图6所示，所述内插滤波器组132，包括：
半带滤波器1321，被配置将所述调制信号的采样速率由200Ksps调整为400Ksps；也即使用半带滤波器内插2倍后采样速率为400Ksps；
低通滤波器1322，配置将所述调制信号的采样速率由400Ksps调整为1.2Msps；也即使用低通滤波器内插3倍后采样速率为1.2Msps
三级积分-梳状级联(Cascaded integrator–comb，CIC)滤波器1323，配置将所述调制信号的采样速率由1.2Msps调整为150Msps；也即使用3级CIC滤波器内插125倍后采样速率为150Msps。
由于调整模块103输出的信号最终被送入频率合成模块104的高速数模转换器(Digital to analog converter，DAC)中，DAC的信噪比和采样速率是正比关系，采样速率越高，DAC输出的信噪比就越好，所以为了获得高的信噪比，需要提高调制信号的采样速率后给DAC。需要说明的是，这里采用多级内插到150Msps采样速率而不是一级内插到150Msps是为了节省FPGA中数字信号处理器(Digital Signal Processor，DSP)资源。
图7是本发明实施例提供的一种频率合成模块104的结构示意图，参见图7，所述频率合成模块104包括：JESD204B接口141和高速DAC 142，所述JESD204B接口141同时与所述调整模块103的输出端以及所述高速DAC 142的输入端电连接。
其中，JESD204B是由JEDEC委员会(固态技术协会)制定的一种高速串行互连互通的协议，目前主要应用在宽带模数转换器(Analog to Digital converter，ADC)和DAC的互连互通。
如图7所示，所述JESD204B接口141，包括：
赛灵思(XILINX)的因特网协议内核(Internet Protocol CORE，IP CORE)1411，被配置为采用JESD204B协议对所述调制信号进行打包，得到JESD204B协议打包数据；
吉比特收发器(Gigabit Transceiver，GTX)模块1412，被配置为将所述JESD204B协议打包数据转换成高速串行数据，输出给所述高速DAC。
在本发明实施例中，所述高速DAC 142，被配置为从所述高速串行数据中解析出所述调制信号；将所述调制信号的采样速率调整为2.4Gsps；经过一个48bit的数字控制振荡器(numerically controlled oscillator，NCO)处理完成射频频率合成。高速DAC 142输出的射频信号的频率1.6MHz～520MHz，频率分辨率1Hz，能够满足短波以及超短波电台应用需求。
其中，48bit表示这个NCO的频率控制字达到48bit，位数越高，输出的射频频率精度就高，经过DAC内插后的调制信号最终采用速率达到2.4Gsps，将调制信号(调制IQ信号)和NCO产生的本地振荡频率(Fc)的IQ载波信号进行复数相乘，完成频率搬移，然后再经过数模转换输出Fc频率的已调信号。
在本发明实施例中，JESD204B接口141连接数据转换器(DAC)和逻辑器件(PL)的高速串行接口(参见图1)，JESD204B接口141使用的是ClassB。本发明实施例中选取的高速DAC142为DAC38J82，量化位宽为16bit，最高采样速率为2.5Gsps，基带IQ数据速率为150Msps，所以选择Lane＝1，每Lane线性速率为6Gsps，在FPGA中实现JESD协议以及GTX的例化。配置JESD以及DAC参数，JESD的配置是PS端通过先进可扩展接口(Advanced eXtensibleInterface，AXI)完成配置，DAC的配置由PS端的SPI接口直接进行配置，DAC在接收端解析出数据，并在内部完成16倍内插处理，输出数据速率为2.4Gsps，选择DAC38J82的一路输出给后续的射频处理。射频频率的合成是通过DAC38J82的48bit NCO来完成的，由上层配置用户频率给DAC 48bit NCO，完全能够满足输出频率1.6MHz～520MHz，频率精度高于1Hz的需求，由于采样速率为2.4Gsps，后面的镜像用低通滤波器也很容易就消掉。
本发明实施例中的FPGA可以为XILINX ZYNQ-7000系列FPGA，参见图1，此系列FPGA中带硬核微控制单元(Microcontroller Unit，MCU)，通常称它为PS端，PS端完成和上层软件的交互以及PL端的交互。而可编程逻辑称为PL端，PL端FPGA算法实现，主要实现电台所需调制信号的产生；和高速DAC的数据交互，前述音频源产生模块101、调制模块102、调整模块103和JESD204B接口141均采用PL端实现。PS端和PL端交互是通过AXI接口总线来实现的。
在本发明实施例中，所述装置还可以包括：依次连接在所述频率合成模块的输出端的运算放大器105和多级衰减模块106。这两个模块主要是用来调整发射功率，来满足用户设定的发送功率值。
可选地，在运算放大器105和频率合成模块104之间还可以设置一低通滤波器，滤除掉DAC采样后的镜像。
在本发明实施例的另一种实现方式中，所述装置还包括：
检波电路107，被配置为对所述频率合成模块输出的射频信号的进行检波处理，得到检波数据；采用所述检波数据控制所述音频源产生模块101工作，完成自动增益控制(AGC功能)，使得所述射频信号的功率值锚定在用户设定功率值上。
输出的射频信号一路通过天线输出，一路反馈给检波电路107，检波电路主要是完成对射频信号功率的检测，保证发送链路功率在温度变化的情况下能保持用户设定的功率，检波电路把射频信号的功率变换为到电压值，然后这个电压值由ADC变成数字信号，PS端根据得到的数字值转到电压值，再由电压值转换到功率值，PS端通过线程周期性读取这个数字结果，并完成转换到功率值，当前的功率和用户设置的功率值进行比较，如果超过允许的范围，通过调整前述运算放大器105和多级衰减模块106达到用户设定发送功率值。
本发明实施例提供的无线电调制信号发生装置具有以下优点：
1)实时性高、灵活性强。本发明音频的产生及各种调制都是放在FPGA中实现，FPGA的特点是并行运算，所以在实时性上有很大的优势，各种参数是通过FPGA中硬核中央处理器(Central Processing Unit，CPU)配置给FPGA逻辑部分，能够随意修改和灵活配置，因此相比传统方法具有很强的灵活性、可维护性、可移植性。
2)指标性能好、精度高。本发明音频的产生及各种调制都是放在FPGA中实现，区别与传统方法通过模拟方法(这里的模拟方式是指使用分离器件或芯片完成音频信号的产生、调制，射频信号通过本振超外差方式输出)实现，且通过高速DAC直接完成射频频率合成，减少射频变频环节及射频链路，整个方法更多是用软件无线电架构实现，减少模拟和射频链路环节，因此减小了模拟链路带来的非线性和各种杂散、谐波，因此相比传统方法具有更好的指标性能以及精度。
3)体积小、功耗低。本发明采用了软件无线电框架，使用XILINX的ZYNQ系列作为系统主处理系统和TI的DAC38J82高速DAC直接完成射频频率合成，ZYNQ-7000系列，它将ARMCotex-A9处理系统与可编程逻辑紧密集成在一起，拥有更小的功耗和体积，使用DAC的NCO直接射频频率合成，而不需要模拟变频器件，因此相比传统方法在体积和功耗上有着显著的优势。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成，也可以通过程序来指令相关的硬件完成，所述的程序可以存储于一种计算机可读存储介质中，上述提到的存储介质可以是只读存储器，磁盘或光盘等。
以上所述仅为本发明的较佳实施例，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (10)

1.一种无线电调制信号发生装置，其特征在于，所述无线电调制信号发生装置集成在一块FPGA上，所述装置包括：
音频源产生模块(101)，被配置为利用DDS产生音频源；
调制模块(102)，被配置为对所述音频源产生模块(101)产生的音频源进行调制，得到调制信号，所述调制的方式为SSB调制、AM调制和FM调制中的一种；
调整模块(103)，被配置为对所述调制模块(102)输出的调制信号进行处理，以调整所述调制信号的带宽和采样速率；
频率合成模块(104)，被配置为基于所述调整模块(104)处理后的所述调制信号合成射频信号。
2.根据权利要求1所述的装置，其特征在于，所述音频源产生模块(101)，被配置产生采样速率为200Ksps、音频频率在0～25KHz范围内、精度高于1Hz的音频源。
3.根据权利要求1所述的装置，其特征在于，所述调制模块(102)，包括：
SSB调制电路(121)，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；若选择上边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号作为所述SSB调制电路的Q路输出；若选择下边带，则将所述复数IQ的I路信号作为所述SSB调制电路的I路输出，将所述复数IQ的Q路信号取反后作为所述SSB调制电路的Q路输出，得到所述SSB调制电路(121)的基带输出；
AM调制电路(122)，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号与调幅深度进行相乘得到输出p0_out；将所述p0_out叠加一个直流偏置dc_offset得到输出add_out；把所述add_out赋值给am_data_i，将0赋值给am_data_q，得到所述AM调制电路(122)的基带输出；
FM调制电路(123)，被配置为对所述音频源进行数字化，生成表示所述音频源的复数IQ；将所述复数IQ的I路信号与调频频偏相乘得到输出p1_out；对所述p1_out的相位进行归一化处理得到cordic_phase；使用cordic算法计算所述cordic_phase每个相位下的正余弦值，得到cordic_data_i和cordic_data_q；将所述cordic_data_i和所述cordic_data_q分别赋值给fm_data_i和fm_data_q，得到所述FM调制电路(123)的基带输出。
4.根据权利要求1所述的装置，其特征在于，所述调整模块(103)，包括：
信道滤波器(131)，被配置为对所述调制模块(102)输出的调制信号进行滤波处理，以限制所述调制信号的带宽；
内插滤波器组(132)，被配置对所述信道滤波器(131)处理后的调制信号进行内插滤波处理，以得到采样速率为150Msps的调制信号。
5.根据权利要求4所述的装置，其特征在于，所述内插滤波器组(132)，包括：
半带滤波器(1321)，被配置将所述调制信号的采样速率由200Ksps调整为400Ksps；
低通滤波器(1322)，配置将所述调制信号的采样速率由400Ksps调整为1.2Msps；
CIC滤波器(1323)，配置将所述调制信号的采样速率由1.2Msps调整为150Msps。
6.根据权利要求1所述的装置，其特征在于，所述频率合成模块(104)包括：JESD204B接口(141)和高速DAC(142)，所述JESD204B接口(141)同时与所述调整模块(103)的输出端以及所述高速DAC(142)的输入端电连接。
7.根据权利要求6所述的装置，其特征在于，所述JESD204B接口(141)，包括：
XILINX的IP CORE(1411)，被配置为采用JESD204B协议对所述调制信号进行打包，得到JESD204B协议打包数据；
GTX模块(1412)，被配置为将所述JESD204B协议打包数据转换成高速串行数据，输出给所述高速DAC(142)。
8.根据权利要求7所述的装置，其特征在于，所述高速DAC(142)，被配置为从所述高速串行数据中解析出所述调制信号；将所述调制信号的采样速率调整为2.4Gsps；经过一个48bit的数字控制振荡器NCO处理完成射频频率合成。
9.根据权利要求1至8任一项所述的装置，其特征在于，所述装置还包括：
依次连接在所述频率合成模块(104)的输出端的运算放大器(105)和多级衰减模块(106)。
10.根据权利要求1至8任一项所述的装置，其特征在于，所述装置还包括：
检波电路(107)，被配置为对所述频率合成模块(104)输出的射频信号的进行检波处理，得到检波数据；采用所述检波数据控制所述音频源产生模块(101)工作，使得所述射频信号的功率值锚定在用户设定功率值上。
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