CN110189701A - 像素驱动电路及其驱动方法、显示面板与显示装置 - Google Patents

像素驱动电路及其驱动方法、显示面板与显示装置 Download PDF

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Abstract

本发明公开了一种像素驱动电路及其驱动方法、显示面板与显示装置，像素驱动电路包括：驱动电路；储能电路；数据及感测线；第一初始化电路；第二初始化电路；数据写入电路；其中，在显示模式，数据及感测线通过数据写入电路将数据电压写入驱动电路的控制端，在感测模式，数据及感测线接收驱动电路通过第二初始化电路输出的感测数据，以便获取驱动电路的外部补偿值，由此，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度。

Description

像素驱动电路及其驱动方法、显示面板与显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示面板与显示装置。
背景技术
相关技术的OLED(Organic Light-Emitting Diode，有机发光二极管)外部补偿像素电路中，数据线和感测线为两条独立的控制线，但是，相关技术存在的问题在于，源级驱动芯片通道数量较多，不利于提高面板的物理分辨率，限制补偿速度。
发明内容
本发明旨在至少在一定程度上解决相关技术中的技术问题之一。
为此，本发明的第一个目的在于提出一种像素驱动电路，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性。
本发明的第二个目的在于提出一种像素驱动电路的驱动方法。
本发明的第三个目的在于提出一种显示面板。
本发明的第四个目的在于提出一种显示装置。
为达上述目的，本发明第一方面实施例提出了一种像素驱动电路，包括：驱动电路，所述驱动电路的第一端与第一电源相连，所述驱动电路的第二端与发光元件相连；储能电路，所述储能电路与所述驱动电路的控制端相连；数据及感测线；第一初始化电路，所述第一初始化电路与电压提供端、所述驱动电路的控制端和第三控制线相连；第二初始化电路，所述第二初始化电路与所述数据及感测线、所述驱动电路的第二端和第二控制线相连；数据写入电路，所述数据写入电路与所述数据及感测线、所述驱动电路的控制端和第一控制线相连；其中，在显示模式，所述数据及感测线通过所述数据写入电路将数据电压写入所述驱动电路的控制端，在感测模式，所述数据及感测线接收所述驱动电路通过所述第二初始化电路输出的感测数据，以便获取所述驱动电路的外部补偿值。
根据本发明实施例提出的像素驱动电路，驱动电路的第一端与第一电源相连，驱动电路的第二端与发光元件相连，储能电路与驱动电路的控制端相连，第一初始化电路与电压提供端、驱动电路的控制端和第三控制线相连，第二初始化电路与数据及感测线、驱动电路的第二端和第二控制线相连，数据写入电路与数据及感测线、驱动电路的控制端和第一控制线相连，其中，在显示模式，数据及感测线通过数据写入电路将数据电压写入驱动电路的控制端，在感测模式，数据及感测线接收驱动电路通过第二初始化电路输出的感测数据，以便获取驱动电路的外部补偿值。由此，本发明实施例的像素驱动电路，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
根据本发明的一个实施例，在所述感测模式，所述驱动电路在基准电压的控制下，通过所述第二初始化电路输出感测数据，其中，所述电压提供端通过所述第一初始化电路向所述驱动电路提供所述基准电压。
根据本发明的一个实施例，所述第一初始化电路包括：第三晶体管，所述第三晶体管的第一极与所述电压提供端相连，所述第三晶体管的第二极与所述驱动电路的控制端相连，所述第三晶体管的控制极与所述第三控制线相连。
根据本发明的一个实施例，所述第二初始化电路包括：第二晶体管，所述第二晶体管的第一极与所述数据及感测线相连，所述第二晶体管的第二极与所述驱动电路的第二端相连，所述第二晶体管的控制极与所述第二控制线相连。
根据本发明的一个实施例，所述数据写入电路包括：第一晶体管，所述第一晶体管的第一极与所述数据及感测线相连，所述第一晶体管的第二极与所述驱动电路的控制端相连，所述第一晶体管的控制极与所述第一控制线相连。
根据本发明的一个实施例，所述驱动电路包括驱动晶体管，所述驱动晶体管的第一极与所述第一电源相连，所述驱动晶体管的第二极与所述发光元件相连，所述驱动晶体管的控制极与所述储能电路、所述第一初始化电路和所述数据写入电路相连；所述储能电路包括第一电容，所述第一电容的一端与所述驱动晶体管的控制极相连，所述第一电容的另一端与所述驱动晶体管的第二极相连。
根据本发明的一个实施例，所述感测模式包括迁移率感测和驱动阈值感测，其中，在开启显示过程中的两帧画面之间的空白时间执行迁移率感测；在关闭显示过程中，执行驱动阈值感测。
为达上述目的，本发明第二方面实施例提出了一种像素驱动电路的驱动方法，包括以下步骤：在所述显示模式的数据写入阶段，所述数据写入电路在所述第一控制线的第一导通信号的控制下，将所述数据及感测线的数据电压写入所述驱动电路的控制端；在所述感测模式的数据输出阶段，所述第二初始化电路在所述第二控制线的第二导通信号的控制下，将所述驱动电路输出的感测数据提供至所述数据及感测线，以便获取所述驱动电路的外部补偿值。
根据本发明实施例提出的像素驱动电路的驱动方法，在显示模式的数据写入阶段，数据写入电路在第一控制线的第一导通信号的控制下，将数据及感测线的数据电压写入驱动电路的控制端，在感测模式的数据输出阶段，第二初始化电路在第二控制线的第二导通信号的控制下，将驱动电路输出的感测数据提供至数据及感测线，以便获取驱动电路的外部补偿值。由此，本发明实施例的像素驱动电路的驱动方法，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
根据本发明的一个实施例，所述的像素驱动电路的驱动方法还包括：在所述感测模式的感测初始化阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，将所述电压提供端提供的基准电压输入到所述驱动电路的控制端，以便在所述数据输出阶段，所述驱动电路在基准电压的控制下通过所述第二初始化电路输出的感测数据。
根据本发明的一个实施例，在所述显示模式的显示初始化阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，将所述电压提供端提供的初始化电压提供至所述驱动电路的控制端，以对所述驱动电路的控制端进行初始化，所述第二初始化电路在所述第二控制线的控制下，将所述数据及感测线提供的初始化电压提供至所述驱动电路的第二端，以对所述驱动电路的第二端进行初始化；在所述显示模式的发光阶段，所述驱动电路在所述数据电压的控制下，驱动所述发光元件发光。
根据本发明的一个实施例，在所述感测模式的数据输出阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，继续将所述电压提供端提供的基准电压输入到所述驱动电路的控制端；或者，在所述感测模式的数据输出阶段，所述第一初始化电路在所述第三控制线的第三关断信号的控制下，停止将所述电压提供端提供的基准电压输入到所述驱动电路的控制端。
为达上述目的，本发明第三方面实施例提出了一种显示面板，包括：显示基板；设置于显示基板上的多行多列如本发明第一方面实施例所述的像素驱动电路。
根据本发明实施例提出的显示面板，通过设置于显示基板上的多行多列的像素驱动电路，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
为达上述目的，本发明第四方面实施例提出了一种显示装置，包括本发明第三方面实施例所述的显示面板。
根据本发明实施例提出的显示装置，通过设置的显示面板，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
附图说明
图1为根据本发明实施例的像素驱动电路的方框示意图；
图2为根据本发明一个实施例的像素驱动电路的电路原理图；
图3为根据本发明一个实施例的像素驱动电路的时序图；
图4为根据本发明另一个实施例的像素驱动电路的时序图；
图5为根据本发明实施例的像素驱动电路的驱动方法的流程示意图；
图6为根据本发明实施例的显示面板的方框示意图。
具体实施方式
下面详细描述本发明的实施例，所述实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，旨在用于解释本发明，而不能理解为对本发明的限制。
下面结合附图描述本发明实施例的像素驱动电路及其驱动方法、显示面板与显示装置。
图1为根据本发明实施例的像素驱动电路的方框示意图。如图1所示，本发明实施例的像素驱动电路100包括：驱动电路10、储能电路20、数据及感测线30、第一初始化电路40、第二初始化电路50和数据写入电路60。
其中，驱动电路10的第一端与第一电源VDD相连，驱动电路10的第二端与发光元件80相连；储能电路20与驱动电路10的控制端相连；第一初始化电路40与电压提供端Vref、驱动电路10的控制端和第三控制线G3相连；第二初始化电路50与数据及感测线30、驱动电路10的第二端和第二控制线G2相连；数据写入电路60与数据及感测线30、驱动电路10的控制端和第一控制线G1相连。
其中，在显示模式，数据及感测线30通过数据写入电路60将数据电压写入驱动电路10的控制端，在感测模式，数据及感测线30接收驱动电路10通过第二初始化电路50输出的感测数据，以便获取驱动电路10的外部补偿值。
可理解，在感测模式中，数据及感测线30根据接收到的驱动电路10通过第二初始化电路50输出的感测数据，获取驱动电路10的外部补偿值，然后，在显示模式中，可利用外部补偿值将输入的图像数据转换为外部补偿图像数据，并且可通过数据及感测线30将对应于外部补偿图像数据的数据电压通过数据写入电路60写入驱动电路10的控制端。
由此，通过将数据线与感测线合并成一条数据及感测线30，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度。
具体地，根据本发明的一个实施例，在感测模式，驱动电路10在基准电压的控制下，通过第二初始化50电路输出感测数据，其中，电压提供端Vref通过第一初始化电路40向驱动电路10提供基准电压。
需要说明的是，基准电压为高电平电压。
其中，根据本发明的一个实施例，感测模式包括迁移率感测和驱动阈值感测，其中，在开启显示过程中的两帧画面之间的空白时间执行迁移率感测；在关闭显示过程中，执行驱动阈值感测。
其中，空白时间可指发光元件80处于两帧画面之间的显示空闲阶段。另外，由于驱动阈值感测的时间比较长，所以可以在关闭显示过程中即关机黑画下执行驱动阈值感测。
具体地，根据本发明的一个实施例，如图2所示，第一初始化电路40包括：第三晶体管T3，第三晶体管T3的第一极与电压提供端Vref相连，第三晶体管T3的第二极与驱动电路10的控制端相连，第三晶体管T3的控制极与第三控制线G3相连。
进一步地，根据本发明的一个实施例，如图2所示，第二初始化电路50包括：第二晶体管T2，第二晶体管T2的第一极与数据及感测线30相连，第二晶体管T2的第二极与驱动电路10的第二端相连，第二晶体管T2的控制极与第二控制线G2相连。
进一步地，根据本发明的一个实施例，如图2所示，数据写入电路60包括：第一晶体管T1，第一晶体管T1的第一极与数据及感测线30相连，第一晶体管T1的第二极与驱动电路10的控制端相连，第一晶体管T1的控制极与第一控制线G1相连。
进一步地，根据本发明的一个实施例，如图2所示，驱动电路10包括驱动晶体管DrT，驱动晶体管DrT的第一极与第一电源VDD相连，驱动晶体管DrT的第二极与发光元件80相连，驱动晶体管DrT的控制极与储能电路20、第一初始化电路40和数据写入电路60相连；储能电路20包括第一电容C1，第一电容C1的一端与驱动晶体管DrT的控制极相连，第一电容C1的另一端与驱动晶体管DrT的第二极相连。
结合图3和图4的时序图，图2实施例的工作原理如下：
其中，图3为显示模式以及迁移率感测的时序图，图4为显示模式以及驱动阈值感测的时序图，其中，G1’为第一控制线G1的输入信号，G2’为第二控制线G2的输入信号，G3’为第三控制线G3的输入信号，Data’为数据及感测线30的输入信号，Vref’为电压提供端Vref提供的电压信号，VG为驱动晶体管DrT的控制极的电压信号，VS为驱动晶体管DrT的第二极的电压信号。
如图3所示，在显示模式的显示初始化阶段T1，第一控制线G1的输入信号为低电平，第一晶体管T1关断，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的初始化电压即低电平电压提供至驱动晶体DrT的控制极，以对驱动晶体管DrT的控制极进行初始化，也就是说，此时G点电位为低电平电位，第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2在第二导通信号的控制下导通，并将数据及感测线30提供的初始化电压即低电平电压提供至驱动晶体管DrT的第二极，以对驱动晶体管DrT的第二极进行初始化，也就是说，此时S点电位为低电平电位。
在显示模式的数据写入阶段T2，第二控制线G2的输入信号为第二关断信号即低电平信号，第二晶体管T2在第二关断信号的控制下关断，第三控制线G3的输入信号为第三关断信号即低电平信号，第三晶体管T3在第三关断信号的控制下关断，第一控制线G1的输入信号为第一导通信号即高电平信号，第一晶体管T1在第一导通信号的控制下导通，数据及感测线30提供的的数据电压即高电平电压通过第一晶体管T1写入驱动晶体管DrT的控制极，具体地，写入G点，并通过第一电容C1保持。
在显示模式的发光阶段T3，第一控制线G1的输入信号为第一关断信号即低电平信号，第二控制线G2的输入信号为第二关断信号即低电平信号，第三控制线G3的输入信号为第三关断信号即低电平信号，第一晶体管T1、第二晶体管T2和第三晶体管T3均关断，此时，G点的电压即驱动晶体管DrT的控制极的电压通过第一电容C1保持在高电平，驱动晶体管DrT导通，从而第一电源VDD的电压即高电平电压通过驱动晶体管DrT写入发光元件80，具体地，写入发光元件80的阳极，发光元件80的阴极施加低电平电压，从而产生电流流经发光元件80，驱动发光元件80发光。
在迁移率感测的感测初始化阶段T4，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的基准电压即高电平电压写入驱动晶体DrT的控制极，具体地，写入G点，并通过第一电容C1保持。
在迁移率感测的数据输出阶段T5，第三控制线G3的输入信号变为第三关断信号即低电平信号，第三晶体管T3关断，驱动晶体DrT的控制极即G点的电压通过第一电容C1仍保持在基准电压即高电平电压，驱动晶体DrT导通，第一电源VDD的电压即高电平电压通过驱动晶体管DrT写入驱动晶体DrT的第二极即S点，此时，由于第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2导通，因此，流过驱动晶体管DrT的电流即感测数据通过第二晶体管T2提供至数据及感测线30，从而，可通过流至数据及感测线30的电流获取驱动电路10的外部补偿值。
在迁移率感测的感测阶段T6，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的低电平电压写入驱动晶体DrT的控制极，具体地，写入G点，驱动晶体DrT关断，第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2导通，源极驱动芯片开始感测提供至数据及感测线30的感测数据。
如图4所示，在显示模式的显示初始化阶段T1，第一控制线G1的输入信号为低电平，第一晶体管T1关断，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的初始化电压即低电平电压提供至驱动晶体DrT的控制极，以对驱动晶体管DrT的控制极进行初始化，也就是说，此时G点电位为低电平电位，第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2在第二导通信号的控制下导通，并将数据及感测线30提供的初始化电压即低电平电压提供至驱动晶体管DrT的第二极，以对驱动晶体管DrT的第二极进行初始化，也就是说，此时S点电位为低电平电位。
在显示模式的数据写入阶段T2，第二控制线G2的输入信号为第二关断信号即低电平信号，第二晶体管T2在第二关断信号的控制下关断，第三控制线G3的输入信号为第三关断信号即低电平信号，第三晶体管T3在第三关断信号的控制下关断，第一控制线G1的输入信号为第一导通信号即高电平信号，第一晶体管T1在第一导通信号的控制下导通，数据及感测线30提供的的数据电压即高电平电压通过第一晶体管T1写入驱动晶体管DrT的控制极，具体地，写入G点，并通过第一电容C1保持。
在显示模式的发光阶段T3，第一控制线G1的输入信号为第一关断信号即低电平信号，第二控制线G2的输入信号为第二关断信号即低电平信号，第三控制线G3的输入信号为第三关断信号即低电平信号，第一晶体管T1、第二晶体管T2和第三晶体管T3均关断，此时，G点的电压即驱动晶体管DrT的控制极的电压通过第一电容C1保持在高电平，驱动晶体管DrT导通，从而第一电源VDD的电压即高电平电压通过驱动晶体管DrT写入发光元件80，具体地，写入发光元件80的阳极，发光元件80的阴极施加低电平电压，从而产生电流流经发光元件80，驱动发光元件80发光。
在驱动阈值感测的感测初始化阶段T7，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的基准电压即高电平电压写入驱动晶体管DrT的控制极，具体地，写入G点，并通过第一电容C1保持。
在驱动阈值感测的数据输出阶段T8，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3导通，并继续将电压提供端Vref提供的基准电压即高电平信号写入驱动晶体管DrT的控制极，驱动晶体管DrT导通，第一电源VDD的电压即高电平电压通过驱动晶体管DrT写入驱动晶体管DrT的第二极即S点，并且在第一电容C1的作用下，S点的电位为Vref1-Vth，其中，Vref1为电压提供端Vref提供的基准电压，Vth为驱动晶体管DrT的阈值电压，第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2导通，因此，流过驱动晶体管DrT的电流即感测数据通过第二晶体管T2提供至数据及感测线30，也就是说，在电压提供端Vref提供的基准电压的控制下，数据及感测线30充电至Vref1-Vth，从而，可通过流至数据及感测线30的电流获取驱动电路10的外部补偿值。
在驱动阈值感测的感测阶段T9，第三控制线G3的输入信号为第三导通信号即高电平信号，第三晶体管T3在第三导通信号的控制下导通，并将电压提供端Vref提供的基准电压写入驱动晶体管DrT的控制极，具体地，写入G点，驱动晶体管DrT继续导通，第二控制线G2的输入信号为第二导通信号即高电平信号，第二晶体管T2继续导通，此时，源极驱动芯片开始感测提供至数据及感测线30的感测数据。
由此，通过将数据线与感测线合并，可实现显示模式和感测模式的驱动波形的合并，并且能够实现在开启显示过程中补偿迁移率和在关闭显示过程中补偿驱动阈值的功能。
综上，根据本发明实施例提出的像素驱动电路，驱动电路的第一端与第一电源相连，驱动电路的第二端与发光元件相连，储能电路与驱动电路的控制端相连，第一初始化电路与电压提供端、驱动电路的控制端和第三控制线相连，第二初始化电路与数据及感测线、驱动电路的第二端和第二控制线相连，数据写入电路与数据及感测线、驱动电路的控制端和第一控制线相连，其中，在显示模式，数据及感测线通过数据写入电路将数据电压写入驱动电路的控制端，在感测模式，数据及感测线接收驱动电路通过第二初始化电路输出的感测数据，以便获取驱动电路的外部补偿值。由此，本发明实施例的像素驱动电路，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
基于上述实施例的像素驱动电路，本发明实施例还提出了一种像素驱动电路的驱动方法。
图5为根据本发明实施例的像素驱动电路的驱动方法的流程示意图。如图5所示，本发明实施例的像素驱动电路的驱动方法包括以下步骤：
S1，在显示模式的数据写入阶段，数据写入电路在第一控制线的第一导通信号的控制下，将数据及感测线的数据电压写入驱动电路的控制端。
S2，在感测模式的数据输出阶段，第二初始化电路在第二控制线的第二导通信号的控制下，将驱动电路输出的感测数据提供至数据及感测线，以便获取驱动电路的外部补偿值。
在本发明的一个实施例中，感测模式包括迁移率感测和驱动阈值感测，其中，在开启显示过程中的两帧画面之间的空白时间执行迁移率感测；在关闭显示过程中，执行驱动阈值感测。
根据本发明的一个实施例，像素驱动电路的驱动方法还包括：在感测模式的感测初始化阶段，第一初始化电路在第三控制线的第三导通信号的控制下，将电压提供端提供的基准电压输入到驱动电路的控制端，以便在数据输出阶段，驱动电路在基准电压的控制下通过第二初始化电路输出的感测数据。
根据本发明的一个实施例，在显示模式的显示初始化阶段，第一初始化电路在第三控制线的第三导通信号的控制下，将电压提供端提供的初始化电压提供至驱动电路的控制端，以对驱动电路的控制端进行初始化，第二初始化电路在第二控制线的控制下，将数据及感测线提供的初始化电压提供至驱动电路的第二端，以对驱动电路的第二端进行初始化；在显示模式的发光阶段，驱动电路在数据电压的控制下，驱动发光元件发光。
根据本发明的一个实施例，在感测模式的数据输出阶段，第一初始化电路在第三控制线的第三导通信号的控制下，继续将电压提供端提供的基准电压输入到驱动电路的控制端；或者，在感测模式的数据输出阶段，第一初始化电路在第三控制线的第三关断信号的控制下，停止将电压提供端提供的基准电压输入到驱动电路的控制端。
可理解，在驱动阈值感测的数据输出阶段，第一初始化电路在第三控制线的第三导通信号的控制下，继续将电压提供端提供的基准电压输入到驱动电路的控制端。
在迁移率感测的数据输出阶段，第一初始化电路在第三控制线的第三关断信号的控制下，停止将电压提供端提供的基准电压输入到驱动电路的控制端。
需要说明的是，前述对像素驱动电路实施例的解释说明，也适用于本实施例的像素驱动电路的驱动方法，此处不再赘述。
综上，根据本发明实施例提出的像素驱动电路的驱动方法，在显示模式的数据写入阶段，数据写入电路在第一控制线的第一导通信号的控制下，将数据及感测线的数据电压写入驱动电路的控制端，在感测模式的数据输出阶段，第二初始化电路在第二控制线的第二导通信号的控制下，将驱动电路输出的感测数据提供至数据及感测线，以便获取驱动电路的外部补偿值。由此，本发明实施例的像素驱动电路的驱动方法，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
基于上述的实施例的像素驱动电路，本发明实施例还提出了一种显示面板。
图6为根据本发明实施例的显示面板的方框示意图。如图6所示，本发明实施例的显示面板200包括：显示基板70和多行多列的前述的像素驱动电路100。
其中，多行多列的前述的像素驱动电路100设置于显示基板70上。
根据本发明实施例提出的显示面板，通过设置于显示基板上的多行多列的像素驱动电路，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度。
基于上述的实施例的显示面板，本发明实施例还提出了一种显示装置，包括前述的显示面板。
根据本发明实施例提出的显示装置，通过设置的显示面板，将数据线与感测线合并，可减少源级驱动芯片通道数量，同时还可确保获取到的外部补偿值的精确性，有利于提高面板的物理分辨率，提升补偿速度，另外，还具有驱动波形简单，容易进行栅极驱动集成的优点。
在本发明的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”“内”、“外”、“顺时针”、“逆时针”、“轴向”、“径向”、“周向”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本发明和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本发明的限制。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本发明的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
在本发明中，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”、“固定”等术语应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或成一体；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系，除非另有明确的限定。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本发明中的具体含义。
在本发明中，除非另有明确的规定和限定，第一特征在第二特征“上”或“下”可以是第一和第二特征直接接触，或第一和第二特征通过中间媒介间接接触。而且，第一特征在第二特征“之上”、“上方”和“上面”可是第一特征在第二特征正上方或斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”可以是第一特征在第二特征正下方或斜下方，或仅仅表示第一特征水平高度小于第二特征。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。
尽管上面已经示出和描述了本发明的实施例，可以理解的是，上述实施例是示例性的，不能理解为对本发明的限制，本领域的普通技术人员在本发明的范围内可以对上述实施例进行变化、修改、替换和变型。

Claims (13)

1.一种像素驱动电路，其特征在于，包括：
驱动电路，所述驱动电路的第一端与第一电源相连，所述驱动电路的第二端与发光元件相连；
储能电路，所述储能电路与所述驱动电路的控制端相连；
数据及感测线；
第一初始化电路，所述第一初始化电路与电压提供端、所述驱动电路的控制端和第三控制线相连；
第二初始化电路，所述第二初始化电路与所述数据及感测线、所述驱动电路的第二端和第二控制线相连；
数据写入电路，所述数据写入电路与所述数据及感测线、所述驱动电路的控制端和第一控制线相连；
其中，在显示模式，所述数据及感测线通过所述数据写入电路将数据电压写入所述驱动电路的控制端，在感测模式，所述数据及感测线接收所述驱动电路通过所述第二初始化电路输出的感测数据，以便获取所述驱动电路的外部补偿值。
2.根据权利要求1所述的像素驱动电路，其特征在于，在所述感测模式，所述驱动电路在基准电压的控制下，通过所述第二初始化电路输出感测数据，其中，所述电压提供端通过所述第一初始化电路向所述驱动电路提供所述基准电压。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第一初始化电路包括：
第三晶体管，所述第三晶体管的第一极与所述电压提供端相连，所述第三晶体管的第二极与所述驱动电路的控制端相连，所述第三晶体管的控制极与所述第三控制线相连。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第二初始化电路包括：
第二晶体管，所述第二晶体管的第一极与所述数据及感测线相连，所述第二晶体管的第二极与所述驱动电路的第二端相连，所述第二晶体管的控制极与所述第二控制线相连。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述数据写入电路包括：
第一晶体管，所述第一晶体管的第一极与所述数据及感测线相连，所述第一晶体管的第二极与所述驱动电路的控制端相连，所述第一晶体管的控制极与所述第一控制线相连。
6.根据权利要求1所述的像素驱动电路，其特征在于，
所述驱动电路包括驱动晶体管，所述驱动晶体管的第一极与所述第一电源相连，所述驱动晶体管的第二极与所述发光元件相连，所述驱动晶体管的控制极与所述储能电路、所述第一初始化电路和所述数据写入电路相连；
所述储能电路包括第一电容，所述第一电容的一端与所述驱动晶体管的控制极相连，所述第一电容的另一端与所述驱动晶体管的第二极相连。
7.根据权利要求1-6中任一项所述的像素驱动电路，其特征在于，所述感测模式包括迁移率感测和驱动阈值感测，其中，
在开启显示过程中的两帧画面之间的空白时间执行迁移率感测；
在关闭显示过程中，执行驱动阈值感测。
8.一种如权利要求1-7中任一项所述的像素驱动电路的驱动方法，其特征在于，包括以下步骤：
在所述显示模式的数据写入阶段，所述数据写入电路在所述第一控制线的第一导通信号的控制下，将所述数据及感测线的数据电压写入所述驱动电路的控制端；
在所述感测模式的数据输出阶段，所述第二初始化电路在所述第二控制线的第二导通信号的控制下，将所述驱动电路输出的感测数据提供至所述数据及感测线，以便获取所述驱动电路的外部补偿值。
9.根据权利要求8所述的像素驱动电路的驱动方法，其特征在于，还包括：
在所述感测模式的感测初始化阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，将所述电压提供端提供的基准电压输入到所述驱动电路的控制端，以便在所述数据输出阶段，所述驱动电路在基准电压的控制下通过所述第二初始化电路输出的感测数据。
10.根据权利要求8所述的像素驱动电路的驱动方法，其特征在于，
在所述显示模式的显示初始化阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，将所述电压提供端提供的初始化电压提供至所述驱动电路的控制端，以对所述驱动电路的控制端进行初始化，所述第二初始化电路在所述第二控制线的控制下，将所述数据及感测线提供的初始化电压提供至所述驱动电路的第二端，以对所述驱动电路的第二端进行初始化；
在所述显示模式的发光阶段，所述驱动电路在所述数据电压的控制下，驱动所述发光元件发光。
11.根据权利要求8所述的像素驱动电路的驱动方法，其特征在于，
在所述感测模式的数据输出阶段，所述第一初始化电路在所述第三控制线的第三导通信号的控制下，继续将所述电压提供端提供的基准电压输入到所述驱动电路的控制端；
或者，在所述感测模式的数据输出阶段，所述第一初始化电路在所述第三控制线的第三关断信号的控制下，停止将所述电压提供端提供的基准电压输入到所述驱动电路的控制端。
12.一种显示面板，其特征在于，包括：
显示基板；
设置于显示基板上的多行多列如权利要求1至7中任一权利要求所述的像素驱动电路。
13.一种显示装置，其特征在于，包括如权利要求12所述的显示面板。
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