CN110189696A - 一种显示装置及其驱动方法 - Google Patents

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Abstract

本发明公开了一种显示装置及其驱动方法，显示装置包括主板、可编程器件、显示面板和多个驱动芯片；显示面板的子像素按照第一子像素排列方式排列，主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据；可编程器件将包含有第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，将包含有第二原始数据和对应第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；第一、第二原始数据、第一和第二冗余数据均为具有第二子像素排列格式的图像数据。通过本发明的技术方案，有效避免了对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。

Description

一种显示装置及其驱动方法
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种显示装置及其驱动方法。
背景技术
SPR(Sub-pixel Rendering，子像素渲染)技术与Real RGB子像素排列相比，SPR子像素排列可以有效提高显示装置的PPI，以及减少驱动芯片的通道数，因而SPR技术已经得到了广泛的应用。
针对中大尺寸的显示装置，需要采用两颗或者更多的驱动芯片，并相应地将显示面板的显示区划分为由各驱动芯片驱动的多个显示区域。客户端无法向驱动芯片提供与该驱动芯片对应的显示区相邻的显示区的冗余数据，进而导致驱动芯片无法进行正常的SPR算法，在相邻显示区之间的边界附近会出现分屏问题或者出现亮线或者暗线问题。
发明内容
本发明提供一种显示装置及其驱动方法，使得第一驱动芯片以及第二驱动芯片能够进行正常的对应第一子像素排列方式的算法，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
第一方面，本发明实施例提供了一种显示装置，包括：
主板、可编程器件、显示面板和多个驱动芯片；
所述显示面板的子像素按照第一子像素排列方式排列，所述显示面板包括沿所述子像素排列的行方向设置的多个显示区，第一显示区和第二显示区为相邻的两个显示区，围绕所述第一显示区与所述第二显示区之间的边界设置有位于所述第一显示区的第一边界区和位于所述第二显示区的第二边界区；
所述主板向所述可编程器件发送对应所述第一显示区的第一原始数据和对应所述第二显示区的第二原始数据；
所述可编程器件将包含有所述第一原始数据和对应所述第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有所述第二原始数据和对应所述第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；其中，所述第一原始数据、所述第二原始数据、所述第一冗余数据和所述第二冗余数据均为具有第二子像素排列格式的图像数据；
所述第一驱动芯片根据对应所述第一子像素排列方式的算法以及所述第一数据驱动所述第一显示区进行显示，所述第二驱动芯片根据对应所述第一子像素排列方式的算法以及所述第二数据驱动所述第二显示区进行显示。
进一步地，所述可编程器件包括第一缓存器和第二缓存器两个缓存器；
所述第一缓存器用于在第一时段接收所述主板发送的第一原始数据和第二原始数据，以及在第二时段向所述第一驱动芯片发送包含有所述第一缓存器在第一时段接收的第一原始数据的第一数据，以及在第二时段向所述第二驱动芯片发送包含有所述第一缓存器在第一时段接收的第二原始数据的第二数据；
所述第二缓存器用于在第二时段接收所述主板发送的第一原始数据和第二原始数据，以及在第三时段向所述第一驱动芯片发送包含有所述第二缓存器在第二时段接收的第一原始数据的第一数据，以及在第三时段向所述第二驱动芯片发送包含有所述第二缓存器在第二时段接收的第二原始数据的第二数据。
进一步地，所述第一缓存器和所述第二缓存器均为行缓存器；
所述第一缓存器用于在第一时段接收所述主板发送的对应第i行子像素的第一原始数据和第二原始数据，以及在第二时段向所述第一驱动芯片发送对应第i行子像素的第一数据，以及在第二时段向所述第二驱动芯片发送对应第i行子像素的第二数据；
所述第二缓存器用于在第二时段接收所述主板发送的对应第i+1行子像素的第一原始数据和第二原始数据，以及在第三时段向所述第一驱动芯片发送对应第i+1行子像素的第一数据，以及在第三时段向所述第二驱动芯片发送对应第i+1行子像素的第二数据；其中，i为正整数。
进一步地，所述可编程器件还包括多个第一接口和多个第二接口，两个缓存器均与所述第一接口以及所述第二接口电连接；
所述第一接口用于接收所述主板发送的第一原始数据和第二原始数据并对所述第一原始数据和所述第二原始数据解码后发送至对应的缓存器；
所述第二接口用于接收对应的缓存器发送的第一数据和第二数据并对所述第一数据和所述第二数据编码后发送至对应的驱动芯片。
进一步地，所述第一接口采用MIPI接口、LVDS接口或者HDMI接口中的一种，所述第二接口采用MIPI接口、LVDS接口或者HDMI接口中的一种。
进一步地，所述显示装置还包括：
柔性电路板，所述驱动芯片通过所述柔性电路板向所述显示面板中的子像素提供显示信号，所述可编程器件设置于所述主板上或者设置于所述柔性电路板上。
进一步地，所述可编程器件包括FPGA芯片或者CPLD芯片。
第二方面，本发明实施例还提供了一种显示装置的驱动方法，由如第一方面所述的显示装置执行，所述驱动方法包括：
主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据；
所述可编程器件将包含有所述第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有所述第二原始数据和对应第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；
所述第一驱动芯片根据对应第一子像素排列方式的算法以及所述第一数据驱动所述第一显示区进行显示，所述第二驱动芯片根据对应所述第一子像素排列方式的算法以及所述第二数据驱动所述第二显示区进行显示。
进一步地，所述可编程器件包括第一缓存器和第二缓存器两个缓存器；
在第一时段，所述第一缓存器接收所述主板发送的第一原始数据和第二原始数据；
在第二时段，所述第一缓存器向所述第一驱动芯片发送包含有所述第一缓存器在第一时段接收的第一原始数据的第一数据，以及向所述第二驱动芯片发送包含有所述第一缓存器在第一时段接收的第二原始数据的第二数据，所述第二缓存器接收所述主板发送的第一原始数据和第二原始数据；
在第三时段，所述第二缓存器向所述第一驱动芯片发送包含有所述第二缓存器在第二时段接收的第一原始数据的第一数据，以及向所述第二驱动芯片发送包含有所述第二缓存器在第二时段接收的第二原始数据的第二数据。
进一步地，所述第一缓存器和所述第二缓存器均为行缓存器；
在所述第一时段，所述第一缓存器接收所述主板发送的对应第i行子像素的第一原始数据和第二原始数据；
在所述第二时段，所述第一缓存器向所述第一驱动芯片发送对应第i行子像素的第一数据，以及向所述第二驱动芯片发送对应第i行子像素的第二数据，所述第二缓存器接收所述主板发送的对应第i+1行子像素的第一原始数据和第二原始数据；
在所述第三时段，所述第二缓存器向所述第一驱动芯片发送对应第i+1行子像素的第一数据，以及向所述第二驱动芯片发送对应第i+1行子像素的第二数据；其中，i为正整数。
本发明实施例提供了一种显示装置及其驱动方法，设置显示装置包括主板、可编程器件、显示面板和多个驱动芯片，显示面板的子像素按照第一子像素排列方式排列，显示面板包括沿子像素排列的行方向设置的多个显示区，第一显示区和第二显示区为相邻的两个显示区，围绕第一显示区和第二显示区之间的边界设置有位于第一显示区的第一边界区和位于第二显示区的第二边界区，设置主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据，可编程器件将包含有第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有第二原始数据和对饮第一边界区的第二冗余数据的第二数据发送至第二驱动芯片，第一原始数据、第二原始数据、第一冗余数据和第二冗余数据均为具有第二子像素排列格式的图像数据，第一驱动芯片根据对应第一子像素排列方式的算法以及第一数据驱动第一显示区进行显示，第二驱动芯片根据对应第一子像素排列方式的算法以及第二数据驱动第二显示区进行显示，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
附图说明
通过阅读参照以下附图所作的对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显：
图1为本发明实施例提供的一种显示装置的结构示意图；
图2为本发明实施例提供的一种可编程器件的结构示意图；
图3为本发明实施例提供的另一种可编程器件的结构示意图；
图4为本发明实施例提供的一种显示装置的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。贯穿本说明书中，相同或相似的附图标号代表相同或相似的结构、元件或流程。需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。
本发明实施例提供了一种显示装置，包括主板、可编程器件、显示面板和多个驱动芯片，显示面板的子像素按照第一子像素排列方式排列，显示面板包括沿子像素排列的行方向设置的多个显示区，第一显示区和第二显示区为相邻的两个显示区，围绕第一显示区与第二显示区之间的边界设置有位于第一显示区的第一边界区和位于第二显示区的第二边界区。主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据，可编程器件将包含有第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有第二原始数据和对应第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；其中，第一原始数据、第二原始数据、第一冗余数据和第二冗余数据均为具有第二子像素排列格式的图像数据，第一驱动芯片根据对应第一子像素排列方式的算法以及第一数据驱动第一显示区进行显示，第二驱动芯片根据对应第一子像素排列方式的算法以及第二数据驱动第二显示区进行显示。
SPR(Sub-pixel Rendering，子像素渲染)技术与Real RGB子像素排列相比，SPR子像素排列可以有效提高显示装置的PPI，以及减少驱动芯片的通道数，因而SPR技术已经得到了广泛的应用。
针对中大尺寸的显示装置，单颗驱动芯片无法支持显示装置的显示，需要采用两颗或者更多的驱动芯片，并相应地将显示面板的显示区划分为由各驱动芯片驱动的多个显示区域。对于SPR像素排列的显示面板，驱动芯片要实现SPR算法，需要获取到与该驱动芯片对应的显示区相邻的显示区的冗余数据，但是客户端无法向驱动芯片提供与该驱动芯片对应的显示区相邻的显示区的冗余数据，驱动芯片也就无法获取与该驱动芯片对应的显示区相邻的显示区的冗余数据，进而导致驱动芯片无法进行正常的SPR算法，在相邻显示区之间的边界附近会出现分屏问题或者出现亮线或者暗线问题。
目前，可以利用专门定制的驱动芯片实现相邻显示区对应的驱动芯片之间冗余数据的传输，例如可以利用SPI(Serial Peripheral Interface，串行外设接口)接口或者I2C接口实现驱动芯片之间冗余数据的传输，但是这种专门定制的驱动芯片价格及其昂贵，无疑增加了显示装置的生产成本，而常规的驱动芯片又无法为与该驱动芯片对应的显示区相邻的显示区所对应的驱动芯片提供冗余数据，客户端也无法为驱动芯片提供相应的冗余数据，对于SPR像素排列的显示面板，也就无法避免在相邻显示区之间的边界附近会出现分屏问题或者出现亮线或者暗线问题。
本发明实施例提供的显示装置利用可编程器件使得第一驱动芯片能够获取包含有对应第二边界区的第一冗余数据的第一数据，以及使得第二驱动芯片能够获取包含有对应第一边界区的第二冗余数据的第二数据，进而使得第一驱动芯片以及第二驱动芯片能够进行正常的对应第一子像素排列方式的算法，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
图1为本发明实施例提供的一种显示装置的结构示意图。如图1所示，显示装置包括主板1、可编程器件2、显示面板3和多个驱动芯片，图1仅示例性地示出显示装置包括第一驱动芯片41和第二驱动芯片42两个驱动芯片，显示面板3的子像素按照第一子像素排列方式排列，显示面板3包括沿子像素排列的行方向设置的多个显示区，第一显示区A1和第二显示区A2为相邻的两个显示区，围绕第一显示区A1与第二显示区A2之间的边界a设置有位于第一显示区A1的第一边界区B1和位于第二显示区A2的第二边界区B2。
主板1向可编程器件2发送对应第一显示区A1的第一原始数据和对应第二显示区A2的第二原始数据，图1中的箭头d1表示主板1发送的第一原始数据，箭头d2表示主板1发送的第二原始数据，可编程器件2将包含有第一原始数据d1和对应第二边界区B2的第一冗余数据的第一数据d10发送至第一驱动芯片41，以及将包含有第二原始数据d2和对应第一边界区B1的第二冗余数据的第二数据d20发送至第二驱动芯片42，第一原始数据d1、第二原始数据d2、第一冗余数据和第二冗余数据均为具有第二子像素排列格式的图像数据。
具体地，可以设置第一子像素排列为SPR排列，即像素之间存在子像素的借用关系，例如相邻的三个像素分别包括R像素和G像素、B像素和R像素以及G像素和B像素，相邻的像素彼此关联，可以设置第二子像素排列为Real RGB排列，即每个像素由R像素、G像素和B像素三个子像素组成。第一原始数据d1和第二原始数据d2为具有第二子像素排列格式的图像数据，即第一原始数据d1为对应第一显示区A1且对应Real RGB排列的子像素的图像数据，第二原始数据d2为对应第二显示区A2且对应Real RGB排列的子像素的图像数据。第一冗余数据和第二冗余数据同样均为具有第二子像素排列格式的图像数据，第一冗余数据为对应第二边界区B2且对应Real RGB排列的子像素的图像数据，第二冗余数据为对应第一边界区B1且对应Real RGB排列的子像素的图像数据。
示例性地，可编程器件2可以采用FPGA(Field Programmable Gate Array，现场可编程门阵列)芯片或者CPLD(Complex Programmable Logic Device，复杂可编程逻辑器件)芯片，可以将第一冗余数据和第二冗余数据提前烧录在可编程器件2中，可编程器件2接收主板1发送的第一原始数据d1和第二原始数据d2，在可编程器件2向第一驱动芯片41提供第一数据d10以及向第二驱动芯片42提供第二数据d20时，可编程器件2则可以调用相应的第一冗余数据和第二冗余数据使得第一数据d10包含有对应第一显示区A1的第一原始数据d1以及对应第二边界区B2的第一冗余数据，以及使得第二数据d20包含有对应第二显示区A2的第二原始数据d2和对应第一边界区B1的第二冗余数据。
第一驱动芯片41根据对应第一子像素排列方式的算法，即SPR算法以及第一数据d10驱动第一显示区A1进行显示，第二驱动芯片42根据对应第一子像素排列方式的算法，即SPR算法以及第二数据d20驱动第二显示区A2进行显示。
具体地，针对多颗驱动芯片驱动显示装置进行显示的情况，驱动芯片之间采用级联的方式，一颗驱动芯片为主控驱动芯片，启用TCON功能，即启动时序控制功能，其余驱动芯片为从属驱动芯片，关闭TCON功能并接收主控驱动芯片发出的同步信号，即所有从属驱动芯片遵从主动驱动芯片的驱动时序，本发明实施例对第一驱动芯片41和第二驱动芯片42中哪个驱动芯片为主控驱动芯片不作具体限定。
具体地，第一驱动芯片41接收到包含有Real RGB格式的对应第一显示区A1的第一原始数据d1以及对应第二边界区B2的第一冗余数据的第一数据d10，并采用采用SPR算法将Real RGB格式的第一数据d10转换为SPR格式的图像数据，并对应转换后的图像数据向显示面板3的第一显示区A1中的子像素发送发光驱动信号。同样的，第二驱动芯片42接收到包含有Real RGB格式的对应第二显示区A2的第二原始数据d2以及对应第一边界区B1的第二冗余数据的第二数据d20，并采用SPR算法将Real RGB格式的第二数据d20转换为SPR格式的图像数据，并对应转换后的图像数据向显示面板3的第二显示区A2中的子像素发送发光驱动信号。
可编程器件2的设置使得第一驱动芯片41能够获取对应第二边界区B2的第一冗余数据，以及使得第二驱动芯片42能够获取对应第一边界区B1的第二冗余数据，进而使得第一驱动芯片41以及第二驱动芯片42能够进行正常的SPR算法，即第一驱动芯片41和第二驱动芯片42能够将Real RGB格式的图像数据转换为SPR格式的图像数据，解决了主板无法向驱动芯片提供与该驱动芯片对应的显示区相邻的显示区的冗余数据，驱动芯片也就无法获取与该驱动芯片对应的显示区相邻的显示区的冗余数据，进而导致驱动芯片无法进行正常的SPR算法，在相邻显示区之间的边界附近会出现分屏问题或者出现亮线或者暗线问题的同时，无需使用专门定制的驱动芯片，仅需常规驱动芯片即可实现相邻显示区域对应的冗余数据的获取，降低了显示装置实现SPR技术的成本。
需要说明的是，图1仅示例性地设置显示装置包括第一驱动芯片41和第二驱动芯片42两个驱动芯片，且显示面板3包括第一显示区A1和第二显示区A2两个显示区，也可以设置显示面包括更多的显示区和驱动芯片，第一显示区A1和第二显示区A2何以表示任意两个相邻的显示区，第一驱动芯片41和第二驱动芯片42则为对应前述任意两个相邻显示区的驱动芯片。另外，第一显示区A1与第二显示区A2之间具有边界a，围绕该边界a限定出一个边界区，边界区位于第一显示区A1的部分定义为第一边界区B1，边界区位于第二显示区A2的部门定义为第二边界区B2，边界区的尺寸取决于第一驱动芯片41以及第二驱动芯片42在执行像素格式的转换时，即将Real RGB格式的原始数据以及冗余数据转换为SPR格式的图像数据时需要借用的像素个数，本发明实施例对边界区的具体尺寸不作具体限定。另外需要说明的是，将Real RGB格式的图像数据转换为SPR格式的图像数据涉及的转换过程为常规技术，本发明实施例不涉及像素格式转换的具体算法。
图2为本发明实施例提供的一种可编程器件的结构示意图。结合图1和图2，可以设置可编程器件2包括第一缓存器21和第二缓存器22两个缓存器，第一缓存器21用于在第一时段接收主板1发送的第一原始数据d1和第二原始数据d2，在第二时段向第一驱动芯片41发送包含有第一缓存器21在第一时段接收的第一原始数据d1的第一数据d10，以及在第二时段向第二驱动芯片42发送包含有第一缓存器21在第一时段接收的第二原始数据d2的第二数据d20。第二缓存器22用于在第二时段接收主板1发送的第一原始数据d1和第二原始数据d2，在第三时段向第一驱动芯片41发送包含有第二缓存器22在第二时段接收的第一原始数据d1的第一数据d10，以及在第三时段向第二驱动芯片42发送包含有第二缓存器22在第二时段接收的第二原始数据d2的第二数据d20。
具体地，结合图1和图2，可以提前向每个缓存器烧录对应的冗余数据，在第一时段，第一缓存器21接收主板1发送的第一原始数据d1和第二原始数据d2。在第二时段，第一缓存器21向第一驱动芯片41发送包含有第一缓存器21在第一时段接收的第一原始数据d1的第一数据d10，以及向第二驱动芯片42发送包含有第一缓存器21在第一时段接收的第二原始数据d2的第二数据d20，第二缓存器22接收主板1发送的第一原始数据d1和第二原始数据d2。在第三时段，第二缓存器22向第一驱动芯片41发送包含有第二缓存器22在第二时段接收的第一原始数据d1的第一数据d10，以及向第二驱动芯片42发送包含有第二缓存器22在第二时段接收的第二原始数据d2的第二数据d20。
具体地，在同一时段，两个缓存器中的一个缓存器接收主板1发送的原始数据，另一个缓存器将包含有上一时段接收的包含有原始数据以及对应的冗余数据发送至对应的驱动芯片，驱动芯片据此驱动显示面板3中的子像素进行显示。在下一时段，两个缓存器的收发功能倒置，即上一时段实现接收功能的缓存器在这一时段将包含有上一时段接收到的原始数据以及对应的冗余图像数据的第一数据或者第二数据发送至对应的驱动芯片，驱动芯片据此驱动显示面板3中的子像素进行显示，上一时段实现发送功能的缓存器在这一时段则接收主板1发送的原始数据，这样，两个缓存器采用乒乓工作方式，即不同时段，两个行缓存器的收发功能倒置，图像数据的收发时段的交替周期可以对应一帧显示画面对应的显示周期，实现了显示面板3的显示功能，且可编程器件2使得第一驱动芯片41能够获取对应第二边界区B2的第一冗余数据，以及使得第二驱动芯片42能够获取对应第一边界区B1的第二冗余数据，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
可选地，可以设置第一缓存器21和第二缓存器22均为行缓存器，则第一缓存器21用于在第一时段接收主板1发送的对应第i行子像素的第一原始数据d1和第二原始数据d2，以及在第二时段向第一驱动芯片41发送对应第i行子像素的第一数据d10，以及在第二时段向第二驱动芯片42发送对应第i行子像素的第二数据d20。第二缓存器22用于在第二时段接收主板1发送的对应第i+1行子像素的第一原始数据d1和第二原始数据d2，以及在第三时段向第一驱动芯片41发送对应第i+1行子像素的第一数据d10，以及在第三时段向第二驱动芯片42发送对应第i+1行子像素的第二数据d20，i为正整数。
在第一时段，第一缓存器21例如可以接收主板1发送的对应显示面板3中第一行子像素的第一原始数据d1和第二原始数据d2，即第一缓存器21在第一时段实现对应显示面板3第一行子像素的原始数据的接收。
示例性地，例如可以设置显示面板3中一行有2H个子像素，则对应显示面板3中第一行子像素的第一原始数据d1和第二原始数据d2均包括H个子像素数据，第一原始数据d1为对应第一显示区A1的第一行子像素的H个子像素数据，第二原始数据d2为对应第二显示区A2的第一行子像素的H个子像素数据。
在第二时段，第一缓存器21向第一驱动芯片41发送包含有第一缓存器21在第一时段接收的对应第一显示区A1的第一行子像素的第一原始数据d1以及对应第二边界区B2的第一行子像素的第一冗余数据的第一数据d10，以及向第二驱动芯片42发送包含有第一缓存器21在第一时段接收的对应第二显示区A2的第一行子像素的第二原始数据d2以及对应第一边界区B1的第一行子像素的第二冗余数据的第二数据d20，即第一缓存器21在第二时段实现向对应驱动芯片的对应第一行子像素的图像数据的发送。在第二时段，第二缓存器22接收主板1发送的对应显示面板3中第二行子像素的第一原始数据d1和第二原始数据d2，即第二缓存器22在第二时段实现对应显示面板3第二行子像素的原始数据的接收。
示例性地，可以设置针对显示面板3中的每行子像素，SPR排列的子像素在相邻显示区，例如第一显示区A1和第二显示区A3之间借用的子像素的个数为x，x例如可以为子像素借用的最小单位6，则对应第二边界区B1的第一冗余数据包含6个像素数据，对应第一边界区B2设置的第二冗余数据同样包含6个像素数据，则第一缓存器21在第二时段向第一驱动芯片41发送的第一数据d10包括H加6个像素数据，第一缓存器21在第二时段向第二驱动芯片42发送的第二数据d20包括H加6个像素数据。
在第三时段，第二缓存器22向第一驱动芯片41发送包含有第二缓存器22在第二时段接收的对应第一显示区A1的第二行子像素的第一原始数据d1以及对应第二边界区B2的第二行子像素的第一冗余数据的第一数据d10，以及向第二驱动芯片42发送包含有第二缓存器22在第二时段接收的对应第二显示区A2的第二行子像素的第二原始数据d2以及对应第二边界区B2的第二行子像素的第一冗余数据的第二数据d20，即第二缓存器22在第三时段实现向对应的驱动芯片的对应第二行子像素的数据的发送。
同理，第二缓存器22在第三时段向第一驱动芯片41发送的第一数据d10包括H加6个像素数据，第二缓存器22在第三时段向第二驱动芯片42发送的第二数据d20包括H加6个像素数据。
设置第一缓存器21以及第二缓存器22均为行缓存器，且在同一时段，两个行缓存器中的一个行缓存器接收主板1发送的对应第i行子像素的原始数据，一个行缓存器将包含有上一时段接收的对应第i-1行子像素的原始数据以及对应第i-1行的冗余数据的第一数据或第二数据发送至对应的驱动芯片，驱动芯片据此驱动显示面板3中的第i-1行子像素进行显示。在下一时段，两个行缓存器的收发功能倒置，即上一时段实现接收功能的行缓存器在这一时段将包含有上一时段接收到的对应第i行子像素的原始数据以及对应第i行的冗余图像数据的第一数据或第二数据发送至对应的驱动芯片，驱动芯片据此驱动显示面板3中的第i行子像素进行显示，上一时段实现发送功能的行缓存器在这一时段则接收主板1发送的对应第i+1行子像素的原始数据，这样，两个行缓存器采用乒乓工作方式，即不同时段，两个行缓存器的收发功能倒置，实现了对显示面板3中每一行子像素的逐行驱动，且利用可编程器件2使得第一驱动芯片41能够获取对应第二边界区B2的第一冗余数据，以及使得第二驱动芯片42能够获取对应第一边界区B1的第二冗余数据，进而使得第一驱动芯片41以及第二驱动芯片42能够进行正常的对应第一子像素排列方式的算法，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
图3为本发明实施例提供的另一种可编程器件的结构示意图。结合图1至图3，可编程器件2还可以包括多个第一接口5和多个第二接口6，两个缓存器均与第一接口5以及第二接口6电连接，图1示例性地设置显示装置包括第一驱动芯片41和第二驱动芯片42两个驱动芯片，驱动芯片与第一接口5一一对应设置，第一接口5与第二接口6一一对应设置，即示例性地设置可编程器件2包括两个第一接口5和两个第二接口6，第一缓存器21与两个第一接口5以及两个第二接口6均电连接，第二缓存器22与两个第一接口5以及两个第二接口6均电连接。
第一接口5用于接收主板1发送的第一原始数据d1和第二原始数据d2并对第一原始数据d1和第二原始数据d2解码后发送至对应的缓存器，具体地，第一接口51接收主板1发送的对应第一显示区A1的第一原始数据d1并将第一原始数据d1解码后发送至对应的缓存器，第一接口52接收主板1发送的对应第二显示区A2的第二原始数据d2并将第二原始数据d2解码后发送至对应的缓存器，这里对应的缓存器可以指第一缓存器21与第二缓存器22中在该时段实现接收功能的缓存器。
第二接口6用于接收对应的缓存器发送的第一数据d10和第二数据d20并对第一数据d10和第二数据d20编码后发送至对应的驱动芯片，这里对应的缓存器可以指第一缓存器21与第二缓存器22中在该时段实现发送功能的缓存器，具体地，第二接口61接收对应的缓存器发送的对应第一显示区A1的第一数据d10并对第一数据d10解码后发送至第一驱动芯片41，第二接口62接收对应的缓存器发送的对应第二显示区A2的第二数据d20并对第二数据d20解码后发送至第二驱动芯片42。
当第一缓存器21与第二缓存器22均为行缓存器时，第一接口5则以行为单位对第一原始数据d1和第二原始数据d2进行解码，解码后将对应一行子像素的解码后的第一原始数据d1和第二原始数据d2发送至该时段执行接收功能的缓存器，第二接口6同样以行为单位接收该时段执行发送功能的缓存器发送的第一数据d10和第二数据d20，并将对应一行子像素的编码后的第一数据d10和第二数据d20发送至对应的驱动芯片。
示例性地，结合图1至图3，第一接口5可以采用MIPI(Mobile Industry ProcessorInterface，移动产业处理器)接口、LVDS(Low Voltage Differential Signaling，低压差分信号)接口或者HDMI(High Definition Multimedia Interface，高清多媒体)接口中的一种，第二接口6采用MIPI接口、LVDS接口或者HDMI接口中的一种，第一接口5与第二接口6的类型相同，例如第一接口5与第二接口6可以均为MIPI接口，或者均为LVDS接口，或者均为HDMI接口，图3示例性地设置第一接口5和第二接口6均采用MIPI接口，图1以及图2中的第一原始数据d1、第二原始数据d2、第一数据d10以及第二数据d20均包括图2所示的对应MIPI接口的五路信号CLK以及D0至D3。主板1可设置有相应的MIPI接口与第一接口5对接，实现无冗余数据的原始数据的传输，驱动芯片同样设置有相应的MIPI接口与对应的第二接口6对应，实现对应显示区的带冗余数据的第一数据d10和第二数据d20的接收。
可选地，显示装置还可以包括柔性电路板(图1至图3中未示出)，驱动芯片通过柔性电路板向显示面板3中的子像素提供显示信号，可以将可编程器件2设置在主板1上，也可以将可编程器件2设置在柔性电路板上，避免可编程器件2影响显示面板3的边框宽度。
可选地，如图1所示，驱动芯片还可以包括初始化端口c1，主板1通过初始化端口对驱动芯片进行初始化，具体地，主板1可以通过驱动芯片的初始化端口向驱动芯片中的寄存器写入参考值，无需经过信号的处理，因此驱动芯片的初始化端口直接与主板1电连接，无需经过可编程器件2，该端口可以采用SPI接口实现信号的传输。
示例性地，显示装置可以是有机发光显示装置，也可以是液晶显示装置，显示装置可以是手机，或者可以是电脑或可穿戴设备等电子设备，本发明实施例对显示装置的具体形式不作限定。
本发明实施例还提供了一种显示装置的驱动方法，图4为本发明实施例提供的一种显示装置的驱动方法的流程示意图，该驱动方法可以由上述实施例的显示装置执行，如图4所示，显示装置的驱动方法包括：
S110、主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据。
S120、可编程器件将包含有第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有第二原始数据和对应第一边界区的第二冗余数据的第二数据发送至第二驱动芯片。
可选地，结合图1至图3，可编程器件2包括第一缓存器21和第二缓存器22两个缓存器，在第一时段，第一缓存器21接收主板1发送的第一原始数据d1和第二原始数据d2。在第二时段，第一缓存器21向第一驱动芯片41发送包含有第一缓存器21在第一时段接收的第一原始数据d1的第一数据d10，以及向第二驱动芯片42发送包含有第一缓存器21在第一时段接收的第二原始数据d2的第二数据d20，第二缓存器22接收主板1发送的第一原始数据d1和第二原始数据d2。在第三时段，第二缓存器22向第一驱动芯片41发送包含有第二缓存器22在第二时段接收的第一原始数据d1的第一数据d10，以及向第二驱动芯片42发送包含有第二缓存器22在第二时段接收的第二原始数据d2的第二数据d20。
可选地，结合图1至图3，第一缓存器21和第二缓存器22均为行缓存器，在第一时段，第一缓存器21接收主板1发送的对应第i行子像素的第一原始数据d1和第二原始数据d2。在第二时段，第一缓存器21向第一驱动芯片41发送对应第i行子像素的第一数据d10，以及向第二驱动芯片42发送对应第i行子像素的第二数据d20，第二缓存器22接收主板1发送的对应第i+1行子像素的第一原始数据d1和第二原始数据d2。在第三时段，第二缓存器22向第一驱动芯片41发送对应第i+1行子像素的第一数据d10，以及向第二驱动芯片42发送对应第i+1行子像素的第二数据d20；其中，i为正整数。
S130、第一驱动芯片根据对应第一子像素排列方式的算法以及第一数据驱动第一显示区进行显示，第二驱动芯片根据对应第一子像素排列方式的算法以及第二数据驱动第二显示区进行显示。
本发明实施例提供的显示装置利用可编程器件使得第一驱动芯片能够获取包含有对应第二边界区的第一冗余数据的第一数据，以及使得第二驱动芯片能够获取包含有对应第一边界区的第二冗余数据的第二数据，进而使得第一驱动芯片以及第二驱动芯片能够进行正常的对应第一子像素排列方式的算法，有效避免了当显示面板中的子像素按照第一子像素排列方式排列时，对应不同驱动芯片的相邻显示区出现分屏或者出现亮线等异常显示问题。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种显示装置，其特征在于，包括：
主板、可编程器件、显示面板和多个驱动芯片；
所述显示面板的子像素按照第一子像素排列方式排列，所述显示面板包括沿所述子像素排列的行方向设置的多个显示区，第一显示区和第二显示区为相邻的两个显示区，围绕所述第一显示区与所述第二显示区之间的边界设置有位于所述第一显示区的第一边界区和位于所述第二显示区的第二边界区；
所述主板向所述可编程器件发送对应所述第一显示区的第一原始数据和对应所述第二显示区的第二原始数据；
所述可编程器件将包含有所述第一原始数据和对应所述第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有所述第二原始数据和对应所述第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；其中，所述第一原始数据、所述第二原始数据、所述第一冗余数据和所述第二冗余数据均为具有第二子像素排列格式的图像数据；
所述第一驱动芯片根据对应所述第一子像素排列方式的算法以及所述第一数据驱动所述第一显示区进行显示，所述第二驱动芯片根据对应所述第一子像素排列方式的算法以及所述第二数据驱动所述第二显示区进行显示。
2.根据权利要求1所述的显示装置，其特征在于，所述可编程器件包括第一缓存器和第二缓存器两个缓存器；
所述第一缓存器用于在第一时段接收所述主板发送的第一原始数据和第二原始数据，以及在第二时段向所述第一驱动芯片发送包含有所述第一缓存器在第一时段接收的第一原始数据的第一数据，以及在第二时段向所述第二驱动芯片发送包含有所述第一缓存器在第一时段接收的第二原始数据的第二数据；
所述第二缓存器用于在第二时段接收所述主板发送的第一原始数据和第二原始数据，以及在第三时段向所述第一驱动芯片发送包含有所述第二缓存器在第二时段接收的第一原始数据的第一数据，以及在第三时段向所述第二驱动芯片发送包含有所述第二缓存器在第二时段接收的第二原始数据的第二数据。
3.根据权利要求2所述的显示装置，其特征在于，所述第一缓存器和所述第二缓存器均为行缓存器；
所述第一缓存器用于在第一时段接收所述主板发送的对应第i行子像素的第一原始数据和第二原始数据，以及在第二时段向所述第一驱动芯片发送对应第i行子像素的第一数据，以及在第二时段向所述第二驱动芯片发送对应第i行子像素的第二数据；
所述第二缓存器用于在第二时段接收所述主板发送的对应第i+1行子像素的第一原始数据和第二原始数据，以及在第三时段向所述第一驱动芯片发送对应第i+1行子像素的第一数据，以及在第三时段向所述第二驱动芯片发送对应第i+1行子像素的第二数据；其中，i为正整数。
4.根据权利要求2或3所述的显示装置，其特征在于，所述可编程器件还包括多个第一接口和多个第二接口，两个缓存器均与所述第一接口以及所述第二接口电连接；
所述第一接口用于接收所述主板发送的第一原始数据和第二原始数据并对所述第一原始数据和所述第二原始数据解码后发送至对应的缓存器；
所述第二接口用于接收对应的缓存器发送的第一数据和第二数据并对所述第一数据和所述第二数据编码后发送至对应的驱动芯片。
5.根据权利要求4所述的显示装置，其特征在于，所述第一接口采用MIPI接口、LVDS接口或者HDMI接口中的一种，所述第二接口采用MIPI接口、LVDS接口或者HDMI接口中的一种。
6.根据权利要求1所述的显示装置，其特征在于，还包括：
柔性电路板，所述驱动芯片通过所述柔性电路板向所述显示面板中的子像素提供显示信号，所述可编程器件设置于所述主板上或者设置于所述柔性电路板上。
7.根据权利要求1所述的显示装置，其特征在于，所述可编程器件包括FPGA芯片或者CPLD芯片。
8.一种显示装置的驱动方法，其特征在于，由如权利要求1-7任一项所述的显示装置执行，所述驱动方法包括：
主板向可编程器件发送对应第一显示区的第一原始数据和对应第二显示区的第二原始数据；
所述可编程器件将包含有所述第一原始数据和对应第二边界区的第一冗余数据的第一数据发送至第一驱动芯片，以及将包含有所述第二原始数据和对应第一边界区的第二冗余数据的第二数据发送至第二驱动芯片；
所述第一驱动芯片根据对应第一子像素排列方式的算法以及所述第一数据驱动所述第一显示区进行显示，所述第二驱动芯片根据对应所述第一子像素排列方式的算法以及所述第二数据驱动所述第二显示区进行显示。
9.根据权利要求8所示的驱动方法，其特征在于，所述可编程器件包括第一缓存器和第二缓存器两个缓存器；
在第一时段，所述第一缓存器接收所述主板发送的第一原始数据和第二原始数据；
在第二时段，所述第一缓存器向所述第一驱动芯片发送包含有所述第一缓存器在第一时段接收的第一原始数据的第一数据，以及向所述第二驱动芯片发送包含有所述第一缓存器在第一时段接收的第二原始数据的第二数据，所述第二缓存器接收所述主板发送的第一原始数据和第二原始数据；
在第三时段，所述第二缓存器向所述第一驱动芯片发送包含有所述第二缓存器在第二时段接收的第一原始数据的第一数据，以及向所述第二驱动芯片发送包含有所述第二缓存器在第二时段接收的第二原始数据的第二数据。
10.根据权利要求9所示的驱动方法，其特征在于，所述第一缓存器和所述第二缓存器均为行缓存器；
在所述第一时段，所述第一缓存器接收所述主板发送的对应第i行子像素的第一原始数据和第二原始数据；
在所述第二时段，所述第一缓存器向所述第一驱动芯片发送对应第i行子像素的第一数据，以及向所述第二驱动芯片发送对应第i行子像素的第二数据，所述第二缓存器接收所述主板发送的对应第i+1行子像素的第一原始数据和第二原始数据；
在所述第三时段，所述第二缓存器向所述第一驱动芯片发送对应第i+1行子像素的第一数据，以及向所述第二驱动芯片发送对应第i+1行子像素的第二数据；其中，i为正整数。
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