CN109509446A - 显示模组及显示装置 - Google Patents
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Abstract
本发明公开一种显示模组及显示装置,包括:栅极驱动器,包括多个第一输出端和第二输出端;显示面板,具有靠近栅极驱动器设置的第一显示区和远离栅极驱动器设置的第二显示区;薄膜晶体管阵列,包括设置于第一显示区内的多行第一薄膜晶体管及设置于第二显示区内的多行第二薄膜晶体管;多个第一输出端通过多条奇数行扫描线与多行第一薄膜晶体管的栅极一一对应连接;多个第二输出端通过多条偶数行扫描线与多行第二薄膜晶体管的栅极一一对应连接;第一薄膜晶体管的导通时间小于与其处于同一行的第二薄膜晶体管的导通时间。本发明解决了由于显示面板远离栅极驱动器的区域与靠近栅极驱动器的区域因扫描线走线电阻的不均而出现亮度不均的问题。
Description
技术领域
本发明涉及电子电路技术领域,特别涉及一种显示模组及显示装置。
背景技术
为了顺应液晶电视的大尺寸化和高解析度潮流的发展,越来越多的液晶显示面板采用窄边框设计。
然而,栅极驱动器一般设置于显示面板侧边框位置,使得各扫描线与栅极驱动器之间无法进行等电阻设置走线,即靠近栅极驱动器处的扫描线与栅极驱动器之间的走线较短、电阻较小,远离侧边缘位置处的扫描线与栅极驱动器之间的走线较长、电阻较大,导致面板出现远离栅极驱动器的区域与靠近栅极驱动器的区域充电不均匀的问题。
发明内容
本发明的主要目的是提出一种显示模组及显示装置,旨在解决由于显示面板远离栅极驱动器的区域与靠近栅极驱动器的区域因扫描线走线电阻的不均而出现亮度不均的问题。
为实现上述目的,本发明提出一种显示模组,包括:
栅极驱动器,包括多个第一输出端和第二输出端;
显示面板,具有靠近所述栅极驱动器设置的第一显示区和远离所述栅极驱动器设置的第二显示区;
薄膜晶体管阵列,包括设置于所述第一显示区内的多行第一薄膜晶体管及设置于所述第二显示区内的多行第二薄膜晶体管;
多条奇数行扫描线,多个所述第一输出端通过多条所述奇数行扫描线与多行所述第一薄膜晶体管的栅极一一对应连接;
多条偶数行扫描线,多个所述第二输出端通过多条所述偶数行扫描线与多行所述第二薄膜晶体管的栅极一一对应连接;
所述第一薄膜晶体管的导通时间小于与其处于同一行的所述第二薄膜晶体管的导通时间。
可选地,所述第一薄膜晶体管的导通时间和其处于同一行的所述第二薄膜晶体管同时导通,或者同时关断。
可选地,所述栅极驱动器的数量为多个,
多个所述栅极驱动器分设于所述显示面板的两相对侧边;
或者,多个所述栅极驱动器设置于所述显示面板的同一侧边。
可选地,所述显示模组还包括时序控制器,所述时序控制器包括用于输出奇数行时序控制信号的第一控制端和用于输出偶数行时序控制信号的第二控制端,所述第一控制端与多个所述栅极驱动器的第一受控端连接,所述第二控制端与多个所述栅极驱动器的第二受控端连接;其中,
多个所述栅极驱动器,用于在接收到所述奇数行时序控制信号时,控制所述第一薄膜晶体管导通,以及在接收到所述偶数行时序控制信号时,控制与所述第一薄膜晶体管位于同一行的多个所述第二薄膜晶体管导通。
可选地,所述时序控制器包括存储有奇数行时序控制信息的第一存储器、存储有偶数行时序控制信息的第二存储器及控制信号转换电路,所述第一存储器和所述第二存储器的输出端分别与所述控制信号转换电路的输入端连接,所述控制信号转换电路的第一输出端为所述时序控制器的第一控制端,所述控制信号转换电路的第输出端为所述第二控制端;其中,
所述控制信号转换电路,用于将接收到的所述奇数行时序控制信息转换为对应的所述奇数行时序控制信号;和/或,将接收到的所述偶数行时序控制信息转换为对应的所述偶数行时序控制信号。
可选地,所述栅极驱动器包括移位寄存器、电位变换器及输出缓冲器,所述移位寄存器的第一输入端为所述栅极驱动器的第一受控端,所述移位寄存器的第二输入端为所述栅极驱动器的第二受控端,所述移位寄存器的多个输出端与所述电位变换器的多个信号输入端一一对应连接;所述电位变换器的输出端与所述输出缓冲器的多个输入端一一对应连接;所述输出缓冲器的第一输出端为所述栅极驱动器的第一输出端,所述输出缓冲器的第二输出端为所述栅极驱动器的第二输出端。
可选地,所述栅极驱动器还包括用于接收时钟信号及帧起始脉冲信号的输入缓冲器,所述输入缓冲器的输入端与时序控制器连接,所述输入缓冲器的输出端与所述移位寄存器连接。
可选地,所述显示模组还包括源极驱动器及多条数据线,所述源极驱动器的输出端经多条数据线,与所述薄膜晶体管阵列中薄膜晶体管的源极对应连接。
本发明还提出一种显示装置,包括如上项所述的显示模组;该显示模组,包括:栅极驱动器,包括多个第一输出端和第二输出端;显示面板,具有靠近所述栅极驱动器设置的第一显示区和远离所述栅极驱动器设置的第二显示区;薄膜晶体管阵列,包括设置于所述第一显示区内的多行第一薄膜晶体管及设置于所述第二显示区内的多行第二薄膜晶体管;多条奇数行扫描线,多个所述第一输出端通过多条所述奇数行扫描线与多行所述第一薄膜晶体管的栅极一一对应连接;多条偶数行扫描线,多个所述第二输出端通过多条所述偶数行扫描线与多行所述第二薄膜晶体管的栅极一一对应连接;所述第一薄膜晶体管的导通时间小于与其处于同一行的所述第二薄膜晶体管的导通时间。
可选地,所述显示装置为液晶电视,或者计算机。
本发明显示模组包括栅极驱动器、显示面板及设置于显示面板上的薄膜晶体管阵列,以及多条奇数行扫描线和偶数行扫描线;其中,显示面板分为靠近栅极驱动器设置的第一显示区和远离栅极驱动器设置的第二显示区,将薄膜晶体管阵列分为设置于第一显示区内的多行第一薄膜晶体管及设置于第一显示区内的多行第二薄膜晶体管;多个第一输出端通过多条所述奇数行扫描线与多行所述第一薄膜晶体管的栅极一一对应连接;多个第二输出端通过多条所述偶数行扫描线与多行所述第二薄膜晶体管的栅极一一对应连接;本发明通过栅极驱动器控制第一薄膜晶体管的导通时间小于位于同一行的第二薄膜晶体管的导通时间,从而使第一薄膜晶体管对应的像素充电时间小于第二薄膜晶体管对应的像素充电时间,进而保证第一薄膜晶体管对应的像素充电电压饱和度与第二薄膜晶体管对应的像素充电电压饱和度相同或者基本一致。本发明解决了由于显示面板远离栅极驱动器的区域与靠近栅极驱动器的区域因扫描线走线电阻的不均而出现亮度不均的问题。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图示出的结构获得其他的附图。
图1为本发明显示模组一实施例的结构示意图;
图2为本发明显示模组一实施例的电路结构示意图;
图3为本发明显示模组一实施例的时序示意图;
图4为本发明显示模组中时序控制器一实施例的电路结构示意图;
图5为本发明显示模组中栅极驱动器一实施例的电路结构示意图。
附图标号说明:
标号 | 名称 | 标号 | 名称 |
10 | 栅极驱动器 | 14 | 输入缓冲器 |
20 | 显示面板 | 21 | 第一显示区 |
30 | 薄膜晶体管阵列 | 22 | 第二显示区 |
40 | 时序控制器 | 31 | 第一薄膜晶体 |
50 | 源极驱动器 | 32 | 第二薄膜晶体管 |
11 | 移位寄存器 | 41 | 第一存储器 |
12 | 电位变换器 | 42 | 第二存储器 |
13 | 输出缓冲器 | 43 | 控制信号转换电路 |
本发明目的的实现、功能特点及优点将结合实施例,参照附图做进一步说明。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明的一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
需要说明,若本发明实施例中有涉及方向性指示(诸如上、下、左、右、前、后……),则该方向性指示仅用于解释在某一特定姿态(如附图所示)下各部件之间的相对位置关系、运动情况等,如果该特定姿态发生改变时,则该方向性指示也相应地随之改变。
另外,若本发明实施例中有涉及“第一”、“第二”等的描述,则该“第一”、“第二”等的描述仅用于描述目的,而不能理解为指示或暗示其相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。另外,各个实施例之间的技术方案可以相互结合,但是必须是以本领域普通技术人员能够实现为基础,当技术方案的结合出现相互矛盾或无法实现时应当认为这种技术方案的结合不存在,也不在本发明要求的保护范围之内。
本发明提出一种显示模组,应用于液晶电视、计算机等具有液晶显示屏的显示装置中。
随着液晶电视、计算机的显示屏向超大尺寸,以及高解析度方向的发展,越来越多的液晶显示面板采用窄边框设计,以增大显示屏的显示面积。
相应地,驱动窄边框设计的液晶显示面板工作的板栅极驱动器则一般设置于显示面板侧边框位置,这样将使用于连接薄膜晶体管阵列与栅极驱动器的各扫描线无法进行等电阻设置走线,即靠近栅极驱动器处的薄膜晶体管阵列,两者之间的扫描线走线较短,而远离侧边缘位置,也即栅极驱动器处的薄膜晶体管阵列,两者之间的扫描线与栅极驱动器之间的走线较长。而根据电阻的计算公式R=ρL/S可知,在横截面积相等的走线中,走线的长度越长,则电阻越大,反之则电阻越小(其中,R表示走线电阻值、S表示走线的截面积、L表示走线长度、ρ表示走线的电阻率)。而位于同一行的各薄膜晶体管相当于并联设置于同一扫面线上,因此靠近栅极驱动器设置的像素充电电压会大于远离栅极驱动器设置的像素充电电压。可以理解的是,像素充电电压的饱和度越高,显示面板的亮度则越亮,反之则会越暗,这样,整个面板由于靠近栅极驱动器的显示区亮度大于远离栅极驱动器的显示区亮度,使得面板远离栅极驱动器的区域与靠近栅极驱动器的区域因充电不均匀而出现亮度不均的问题。
为了解决上述问题,参照图1至图5,在本发明一实施例中,该显示模组包括:
栅极驱动器10,包括多个第一输出端(G1、G3、…、G2n+1)和第二输出端(G2、G4、…、G2n+2);
显示面板20,具有靠近所述栅极驱动器10设置的第一显示区21和远离所述栅极驱动器10设置的第二显示区22;
薄膜晶体管阵列30,包括设置于所述第一显示区21内的多行第一薄膜晶体管31及设置于所述第二显示区22内的多行第二薄膜晶体管32;
多条奇数行扫描线(图未标示),多个所述第一输出端通过多条所述奇数行扫描线与多行所述第一薄膜晶体管31的栅极一一对应连接;
多条偶数行扫描线(图未标示),多个所述第二输出端通过多条所述偶数行扫描线与多行所述第二薄膜晶体管32的栅极一一对应连接;
所述第一薄膜晶体管31的导通时间小于与其处于同一行的所述第二薄膜晶体管32的导通时间。
本实施例中,显示模组还包括用于安装栅极驱动器10的PCB板(图未示出),栅极驱动器10对应设置于PCB板的安装位上,PCB板可以螺钉、卡扣、胶粘等形式固定安装在显示面板20的侧边上,PCB板的形状可以是L形,I形或者为π形,具体可根据显示面板20的尺寸、栅极驱动器10的数量及位置进行设置,此处不做限制。
本实施例中,显示模组还包括用于输出奇数行和偶数行的时序控制信号的时序控制器40、用于输出栅极开启电压和/或栅极关断电压的驱动电源(图未示出),以及用于输入数据信号的源极驱动器50,源极驱动器50安装与驱动板PCBA上,时序控制器40分别与栅极驱动器10、源极驱动器50以及驱动电源连接,时序控制器40用于接收外部电路模块,例如电视机的控制系统SOC输出的数据信号、控制信号以及时钟信号,并转换成适合于栅极驱动器10、源极驱动器50的数据信号、控制信号以及时钟信号,实现显示面板20的图像显示。时序控制器40输入的信号格式一般由晶体管-晶体管逻辑信号TTL,低压差分信号(LVDS)、嵌入式显示信号(eDP)信号和V-by-One信号等格式。时序控制器40输出的控制信号包括栅极控制信号和源极控制信号,源极驱动信号包括行起始信号(Start Horizontal,STH)、行时钟脉冲信号(Clock Pulse Horizontal,CPH)、数据输出信号(TP)和数据极性翻转信号(MPOL或POL)。栅极驱动信号包括帧起始信号(Start Vertical,STV)、扫描时钟脉冲信号(ClockPulse Vertical,CPV)及使能信号(Output Enable,OE)。
其中,驱动电源集成了多个不同电路功能的直流-直流转换电路,每个转换电路输出不同的电压值。驱动电源的输入端输入的电压一般为5V或12V,输出的电压包括给时序控制器40提供的工作电压DVDD,以及给栅极驱动器10提供的栅极开启电压VGH和关断电压VGL。
本实施例中,显示面板20可以是OLED(Organic Light-Emitting Diode,有机发光二极管)显示面板20,也可以是TFT-LCD(Thin Film Transistor Liquid CrystalDisplay)显示面板20。显示面板20由多个像素组成,每个像素又由红绿蓝三个亚像素组成。每个亚像素电路结构一般设置有一个薄膜晶体管和一个电容,薄膜晶体管的栅极通过扫描线与栅极驱动器10连接,薄膜晶体管的源极通过数据线与源极驱动器50连接,薄膜晶体管的漏极与电容的一端连接。其中,多个薄膜晶体管构成了本实施例的薄膜晶体管阵列30。显示面板20根据与栅极驱动器10的相对位置关系分为第一显示区21和第二显示区22,第一显示区21靠近栅极驱动器10设置,第二显示区22远离栅极驱动器10设置,薄膜晶体管阵列30中的多行第一薄膜晶体管31设置在第一显示区21,多行第二薄膜晶体管32设置在第二显示区22。薄膜晶体管阵列30中,位于同一行的第一薄膜晶体管31和第二薄膜晶体管32分别通过一奇数行扫描线和一偶数行扫描线与栅极驱动器10连接,也即采用双栅走线方式,以使第一薄膜晶体管31通过一奇数行扫描线并联设置后连接至栅极驱动器10,位于同一行的第二薄膜晶体管32通过一偶数行扫描线并联设置后连接至栅极驱动器10,并采用双栅像素驱动方式(Dual-gate),在某一时段同时打开第一薄膜晶体管31,以及与第一薄膜晶体管31位于同一行的第二薄膜晶体管32。
需要说明的是,薄膜晶体管阵列30中,每一横行的薄膜晶体管一般通过一条扫描线连接至栅极驱动器10,每一纵列的薄膜晶体管则通过一条数据线连接至源极驱动器50。栅极驱动器10在接收到时序控制器40输出的时序控制信号时,则逐行控制薄膜晶体管导通,以使源极驱动器50将数据信号输出至对应的像素,进而显示待显图像。然而,在同一横行上的薄膜晶体管在分布于显示面板20上时,会由于面板远离栅极驱动器10的区域与靠近栅极驱动器10的区域因扫描线走线电阻的不均而出现亮度不均的问题。
为了改善面板亮度的均匀性,本实施例将原本一整条扫描走线切开为两条,并根据距离栅极驱动器10的距离将每一横行上的薄膜晶体管分为远端薄膜晶体管,也即第二薄膜晶体管32和近端薄膜晶体管,也即第一薄膜晶体管31,并通过栅极驱动器10的第一输出端输出栅极驱动信号控制近端薄膜晶体管打开/关断,第二输出端控制远端薄膜晶体管打开/关断。并将连接近端薄膜晶体管的近端线称之为奇数行扫描线,而将远端薄膜晶体管的远端线称之为偶数行扫描线。
可以理解的是,本实施例将一整条扫描走线切割并分为两条,并将同一行的薄膜晶体管变更为两条扫描线连接,薄膜晶体管在显示面板20上的位置未改变。并且位于同一行的薄膜晶体管在进行充电时,在同一时段内相邻的奇和偶行仍然同时打开,也即位于同一行近端薄膜晶体管和远端晶体管相当于一组薄膜晶体管,并控制奇数行扫描线上的近端薄膜晶体管的导通时间小于,与位于同一行的偶数行扫描线上的远端薄膜晶体管的导通时间,以使近端薄膜晶体管对应的像素充电时间小于远端薄膜晶体管对应的像素充电时间,从而保证整个显示面板20的充电均匀,以改善面板亮度的均匀性。
具体地,栅极驱动器10在接收到时序控制器40输出的栅极驱动信号,即帧起始信号(Start Vertical,STV)、扫描时钟脉冲信号(Clock Pulse Vertical,CPV)及使能信号(Output Enable,OE)时,同时输出奇数行扫描信号和偶数行扫描信号,以驱动第一薄膜晶体管31和与之位于同一行的第二薄膜晶体管32构成的一组薄膜晶体管逐组打开。
本发明显示模组包括栅极驱动器10、显示面板20及设置于显示面板20上的薄膜晶体管阵列30,以及多条奇数行扫描线和偶数行扫描线;其中,显示面板20分为靠近栅极驱动器10设置的第一显示区21和远离栅极驱动器10设置的第二显示区22,将薄膜晶体管阵列30分为设置于第一显示区21内的多个第一薄膜晶体管31及设置于第一显示区21内的多个第二薄膜晶体管32;第一输出端通过多条所述奇数行扫描线与多行第一薄膜晶体管的31栅极一一对应连接;多个第二输出端通过多条所述偶数行扫描线与位于同一行的多行所述第一薄膜晶体管31的栅极一一对应连接;本发明通过栅极驱动器10控制位于同一奇数行扫描线上的近端薄膜晶体管的导通时间小于位于同一行远端第二薄膜晶体管32的导通时间,从而使第一薄膜晶体管31对应的像素充电时间小于第二薄膜晶体管32对应的像素充电时间,进而保证第一薄膜晶体管31对应的像素充电电压饱和度与第二薄膜晶体管32对应的像素充电电压饱和度相同或者基本一致。本发明解决了由于显示面板20远离栅极驱动器10的区域与靠近栅极驱动器10的区域因扫描线走线电阻的不均而出现亮度不均的问题。
可以理解的是,在一些实施例中,根据相对于栅极驱动器10的距离的远近,显示面板20还可以划分为两个以上的显示区,例如三个、四个、五个等,并将各显示区中的薄膜晶体管采用对应条数的行扫描线连接,再通过栅极驱动器10驱动各显示区位于同一行的薄膜晶体管在同一时间段内同时导通,从而提高亮度均匀性,使各显示区内的像素的充电饱和度相同或者基本一致。
参照图1至图5,在一可选实施例中,所述第一薄膜晶体管31的导通时间和其处于同一行的所述第二薄膜晶体管32同时导通,或者同时关断。
本实施例中,第一薄膜晶体管31,也即近端晶体管与位于同一行的第二薄膜晶体管32,也即远端晶体管在同一时间段内是同时打开的,第一薄膜晶体管31的导通时间小于第二薄膜晶体管32的导通时间。换言之,近端薄膜晶体管与远端薄膜晶体管同时导通,则近端薄膜晶体管先于远端薄膜晶体管,或者,则近端薄膜晶体管后于远端薄膜晶体管导通,近端薄膜晶体管与远端薄膜晶体管同时关断,如此设置,以保证第一薄膜晶体管31的导通时间小于第二薄膜晶体管32的导通时间,实现第一薄膜晶体管31对应的像素充电电压饱和度与第二薄膜晶体管32对应的像素充电电压饱和度相同或者基本一致。
参照图1至图5,在一可选实施例中,所述栅极驱动器10的数量为多个,多个所述栅极驱动器10分设于所述显示面板20的两相对侧边,
或者多个所述栅极驱动器10依次设置于所述显示面板20的同一侧边。
本实施例中,栅极驱动器10的数量可以是一个也可以是多个,具体可根据显示面板20的尺寸、解析度等进行设置,此处不做限制。栅极驱动器10可以依次设置于显示面板20的一侧边,也可以设置于显示面板20的两相对侧边,具体可根据显示面板20的尺寸进行设置,本实施例在超大尺寸的显示面板20中,可选设置于显示面板20的两相对侧边,一侧边的栅极驱动器10与另一侧边的栅极驱动器10一一对应设置,并同时驱动同一行的第一薄膜晶体管31打开,或者驱动同一行的第二薄膜晶体管32打开。
可以理解的是,上述实施例中,当栅极驱动器10分设于所述显示面板20的两相对侧边时,第一显示区21的数量可以为两个,两个第一显示区21分设于第二显示区22的两侧,并且第一薄膜晶体管31分设于两个第一显示区21,位于同一行的第一薄膜晶体管31可以同时被两个栅极驱动器10驱动,以实现处于同一行的薄膜晶体管同时导通,以使源极驱动器50将数据信号输出至对应的像素,进而显示待显图像。
进一步地,所述时序控制器40包括用于输出奇数行时序控制信号OE1的第一控制端和用于输出偶数行时序控制信号OE2的第二控制端,所述第一控制端与多个所述栅极驱动器10的第一受控端连接,所述第二控制端与多个所述栅极驱动器10的第二受控端连接;其中,
多个所述栅极驱动器10,用于在接收到所述奇数行时序控制信号OE1时,控制多个所述第一薄膜晶体管31导通,以及在接收到所述偶数行时序控制信号OE2时,控制与多个所述第一薄膜晶体管31位于同一行的多个所述第二薄膜晶体管32导通。
本实施例中,多个栅极驱动器10基于时序控制器40的控制,并在接收到对应的时序控制信号时,驱动薄膜晶体管阵列30工作。
参照图1至图5,在一可选实施例中,所述时序控制器40包括存储有奇数行时序控制信息的第一存储器41、存储有偶数行时序控制信息的第二存储器42及控制信号转换电路43,所述第一存储器41和所述第二存储器42的输出端分别与所述控制信号转换电路43的输入端连接,所述控制信号转换电路43的第一输出端为所述时序控制器40的第一控制端,所述控制信号转换电路43的第输出端为所述第二控制端;其中,
所述控制信号转换电路43,用于将接收到的所述奇数行时序控制信息转换为对应的所述奇数行时序控制信号OE1;和/或将接收到的所述偶数行时序控制信息转换为对应的所述偶数行时序控制信号OE2。
本实施例中,时序控制器40在其内部集成有多个存储器,其中,第一存储器41用于存储奇数行时序控制信息,第二存储器42用于存储偶数行时序控制信息。在显示模组工作时,第一存储器41和第二存储器42将存储的时序控制信号输出至控制信号转换电路43,控制信号转换电路43将时序信息转换成对应的时序控制信号,并将时序控制信号输出至栅极驱动器10,以控制栅极驱动器10工作。
奇数行时序控制信号OE1和偶数行时序控制信号OE2可以为高电平信号也可以为低电平信号,例如奇数行时序控制信号OE1为高电平时,则控制栅极驱动器10驱动对应奇数行的近端薄膜晶体管导通,在为低电平时,则控制栅极驱动器10驱动对应近端薄膜晶体管关断。
奇数行时序控制信号OE1的脉冲宽度小于偶数行时序控制信号OE2的脉冲宽度,也即奇数行时序控制信号OE1的高电平持续时间要比偶数行时序控制信号OE2的高电平持续时间短,从而使栅极驱动器10输出的近端栅极驱动信号的波形小于远端栅极驱动信号的波形。如此设置,可以提升远端薄膜晶体管对应的像素充电效果,同时近端像素也不至于牺牲太多,从而提高面板整体的穿透率。
可以理解的是,第一存储器41和第二存储器42均集成于时序控制器40中,无需另设存储器,并且在时序控制器40中,一般预留有空白的存储器,在实际应用中,将奇数行时序控制信息和偶数行时序控制信息存储进空白的存储器中即可,以避免生产成本的增加。
参照图1至图5,在一可选实施例中,所述栅极驱动器10包括移位寄存器11、电位变换器12及输出缓冲器13,所述移位寄存器11的第一输入端为所述栅极驱动器10的第一受控端,所述移位寄存器11的第二输入端为所述栅极驱动器10的第二受控端,所述移位寄存器11的多个输出端与所述电位变换器12的多个信号输入端一一对应连接;所述电位变换器12的输出端与所述输出缓冲器13的多个输入端一一对应连接;所述输出缓冲器13的第一输出端为所述栅极驱动器10的第一输出端,所述输出缓冲器13的第二输出端为所述栅极驱动器10的第二输出端。
本实施例中,移位寄存器11在接收到时序控制器40输出的时钟信号CKV时,逐行打开,以输出栅极驱动起始信号,从而控制电位变换器12将驱动电源输入的栅极开启电压VGH和关断电压VGL转换为对应的逻辑电平信号,并输出至输出缓存器,以使输出缓冲器13(Output buffer)对栅极开启电压信号进行放大处理,进而增强VGH的驱动能力。
上述实施例中,所述栅极驱动器10还包括用于接收时钟信号及帧起始脉冲信号的输入缓冲器14,所述输入缓冲器14的输入端与时序控制器40连接,所述输入缓冲器14的输出端与所述移位寄存器11连接。
本发明还提出一种显示装置,所述显示装置包括如上所述的显示模组。该显示模组的详细结构可参照上述实施例,此处不再赘述;可以理解的是,由于在本发明显示装置中使用了上述显示模组,因此,本发明显示装置的实施例包括上述显示模组全部实施例的全部技术方案,且所达到的技术效果也完全相同,在此不再赘述。
上述显示装置可以为液晶电视,或者电脑,或者投影仪,或者手机中的任意一种具有上述显示模组的显示装置。
以上所述仅为本发明的优选实施例,并非因此限制本发明的专利范围,凡是在本发明的发明构思下,利用本发明说明书及附图内容所作的等效结构变换,或直接/间接运用在其他相关的技术领域均包括在本发明的专利保护范围内。
Claims (10)
1.一种显示模组,其特征在于,包括:
栅极驱动器,包括多个第一输出端和第二输出端;
显示面板,具有靠近所述栅极驱动器设置的第一显示区和远离所述栅极驱动器设置的第二显示区;
薄膜晶体管阵列,包括设置于所述第一显示区内的多行第一薄膜晶体管及设置于所述第二显示区内的多行第二薄膜晶体管;
多条奇数行扫描线,多个所述第一输出端通过多条所述奇数行扫描线与多行所述第一薄膜晶体管的栅极一一对应连接;
多条偶数行扫描线,多个所述第二输出端通过多条所述偶数行扫描线与多行所述第二薄膜晶体管的栅极一一对应连接;
所述第一薄膜晶体管的导通时间小于与其处于同一行的所述第二薄膜晶体管的导通时间。
2.如权利要求1所述的显示模组,其特征在于,所述第一薄膜晶体管的导通时间和其处于同一行的所述第二薄膜晶体管同时导通,或者同时关断。
3.如权利要求1所述的显示模组,其特征在于,所述栅极驱动器的数量为多个,
多个所述栅极驱动器分设于所述显示面板的两相对侧边;
或者,多个所述栅极驱动器设置于所述显示面板的同一侧边。
4.如权利要求3所述的显示模组,其特征在于,所述显示模组还包括时序控制器,所述时序控制器包括用于输出奇数行时序控制信号的第一控制端和用于输出偶数行时序控制信号的第二控制端,所述第一控制端与多个所述栅极驱动器的第一受控端连接,所述第二控制端与多个所述栅极驱动器的第二受控端连接;其中,
多个所述栅极驱动器,用于在接收到所述奇数行时序控制信号时,控制所述第一薄膜晶体管导通,以及在接收到所述偶数行时序控制信号时,控制与所述第一薄膜晶体管位于同一行的多个所述第二薄膜晶体管导通。
5.如权利要求4所述的显示模组,其特征在于,所述时序控制器包括存储有奇数行时序控制信息的第一存储器、存储有偶数行时序控制信息的第二存储器及控制信号转换电路,所述第一存储器和所述第二存储器的输出端分别与所述控制信号转换电路的输入端连接,所述控制信号转换电路的第一输出端为所述时序控制器的第一控制端,所述控制信号转换电路的第输出端为所述第二控制端;其中,
所述控制信号转换电路,用于将接收到的所述奇数行时序控制信息转换为对应的所述奇数行时序控制信号;和/或,将接收到的所述偶数行时序控制信息转换为对应的所述偶数行时序控制信号。
6.如权利要求1所述的显示模组,其特征在于,所述栅极驱动器包括移位寄存器、电位变换器及输出缓冲器,所述移位寄存器的第一输入端为所述栅极驱动器的第一受控端,所述移位寄存器的第二输入端为所述栅极驱动器的第二受控端,所述移位寄存器的多个输出端与所述电位变换器的多个信号输入端一一对应连接;所述电位变换器的输出端与所述输出缓冲器的多个输入端一一对应连接;所述输出缓冲器的第一输出端为所述栅极驱动器的第一输出端,所述输出缓冲器的第二输出端为所述栅极驱动器的第二输出端。
7.如权利要求6所述的显示模组,其特征在于,所述栅极驱动器还包括用于接收时钟信号及帧起始脉冲信号的输入缓冲器,所述输入缓冲器的输入端与时序控制器连接,所述输入缓冲器的输出端与所述移位寄存器连接。
8.如权利要求1至7任意一项所述的显示模组,其特征在于,所述显示模组还包括源极驱动器及多条数据线,所述源极驱动器的输出端经多条数据线,与所述薄膜晶体管阵列中薄膜晶体管的源极对应连接。
9.一种显示装置,其特征在于,包括如权利要求1至8任意一项所述的显示模组。
10.如权利要求9所述的显示装置,其特征在于,所述显示装置为液晶电视,或者计算机。
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