CN109507839A - 阵列基板和显示装置 - Google Patents
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Abstract
本发明公开一种阵列基板和显示装置。该阵列基板包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;所述首级移位寄存器单元和末级移位寄存器单元中至少一者的竖向尺寸小于所述主级移位寄存器单元。本发明技术方案能实现GOA显示产品的窄边框需求。
Description
技术领域
本发明涉及显示产品技术领域,特别涉及一种阵列基板和显示装置。
背景技术
显示屏的工艺架构,以驱动设计来划分,可以分为芯片驱动(System on chip,SOC)和阵列驱动(Gate driver on array,GOA)两种。就产品需求的角度来看,边框越小,也是大家所期望的,所以相较SOC版设计,GOA有较小的边框。GOA在面板设计上是一项重要技术,主要优点是可以免去驱动器芯片,降低成本,所以GOA产品势必是未来的主流趋势。
随着科技进步,解析度只能越来越高,才有办法满足人眼的视觉需求。而越来越多的液晶面板,追求越来越窄的边框,甚至需要使用无边框显示器,才会给人生身临其境的感觉,所以大边框设计是消费者无法接受的,因为有新的观赏经验,所以如何做到高解析度及窄边框产品是我们面临的重大挑战。
发明内容
本发明的主要目的是提出一种阵列基板,旨在实现GOA显示产品的窄边框需求。
为实现上述目的,本发明提出的阵列基板,包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;所述首级移位寄存器单元和末级移位寄存器单元中至少一者的竖向尺寸小于所述主级移位寄存器单元。
可选地,所述主级移位寄存器单元的竖向尺寸为S,所述首级移位寄存器单元的竖向尺寸为S1,满足以下公式:S1≤S/2。
可选地,所述主级移位寄存器单元的竖向尺寸为S,所述末级移位寄存器单元的竖向尺寸为S2,满足以下公式:S2≤S/2。
可选地,所述首级移位寄存器单元的竖向尺寸为S1,所述末级移位寄存器单元的竖向尺寸为S2,满足以下公式:S1=S2。
可选地,所述首级移位寄存器单元和末级移位寄存器单元中至少一者的薄膜晶体管的竖向尺寸小于所述主级移位寄存器单元的薄膜晶体管。
可选地,所述首级移位寄存器单元和末级移位寄存器单元中至少一者的薄膜晶体管的横向尺寸小于所述主级移位寄存器单元的薄膜晶体管。
可选地,所述末级移位寄存器单元的竖向尺寸小于所述主级移位寄存器单元,所述阵列基板的电路板隔设于所述末级移位寄存器单元背离所述首级移位寄存器单元的一侧;
所述阵列基板的数据线包括位于显示区域外的多条连接线,所述连接线自所述首级移位寄存器单元对应的一侧朝所述末级移位寄存器单元所在的一侧依次连接各所述栅线,穿过所述末级移位寄存器单元与所述电路板之间的竖向间隔,以与所述电路板相连。
可选地,所述连接线包括依次连接的竖直段、横向段以及倾斜段,所述竖直段与各所述栅线相接,所述倾斜段与所述电路板相接;
各所述连接线的横向段均匀间隔排布于所述末级移位寄存器单元与所述电路板之间的竖向间隔内。
本发明还提出一种阵列基板,该阵列基板包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;
所述首级移位寄存器单元和末级移位寄存器单元的薄膜晶体管的竖向尺寸相等且均小于所述主级移位寄存器单元的薄膜晶体管的竖向尺寸。
本发明还提出一种显示装置,包括阵列基板,该阵列基板包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;所述首级移位寄存器单元和末级移位寄存器单元中至少一者的竖向尺寸小于所述主级移位寄存器单元。
本发明技术方案通过将首级移位寄存器单元和末级移位寄存器单元区别于主级移位寄存器单元设计,以减小首级移位寄存器单元和末级移位寄存器单元的竖向尺寸,从而减小用以遮盖首级移位寄存器单元和末级移位寄存器单元的边框尺寸,实现GOA显示产品的窄边框需求。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图示出的结构获得其他的附图。
图1为本发明阵列基板一实施例的结构示意图。
附图标号说明:
标号 | 名称 | 标号 | 名称 |
1 | 基板 | 11 | 显示区域 |
2 | 电路板 | 3 | 首级移位寄存器单元 |
4 | 主级移位寄存器单元 | 5 | 末级移位寄存器单元 |
6 | 连接线 | 61 | 竖直段 |
62 | 横向段 | 63 | 倾斜段 |
本发明目的的实现、功能特点及优点将结合实施例,参照附图做进一步说明。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明的一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
需要说明,若本发明实施例中有涉及方向性指示(诸如上、下、左、右、前、后……),则该方向性指示仅用于解释在某一特定姿态(如附图所示)下各部件之间的相对位置关系、运动情况等,如果该特定姿态发生改变时,则该方向性指示也相应地随之改变。
另外,若本发明实施例中有涉及“第一”、“第二”等的描述,则该“第一”、“第二”等的描述仅用于描述目的,而不能理解为指示或暗示其相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。另外,各个实施例之间的技术方案可以相互结合,但是必须是以本领域普通技术人员能够实现为基础,当技术方案的结合出现相互矛盾或无法实现时应当认为这种技术方案的结合不存在,也不在本发明要求的保护范围之内。
本发明提出一种阵列基板、以及具有该阵列基板的显示装置,该显示装置包括但不限于液晶显示装置、有机发光二极管显示装置、场发射显示装置、等离子显示装置、曲面型装置,液晶显示装置的液晶面板包括薄膜晶体管液晶显示面板、TN面板、VA类面板、IPS面板等。
参照图1,本发明实施例中,该阵列基板包括基板1、沿横向排布于基板1上的多条栅线(图未示)、沿纵向排布于基板1上的多条数据线以及设于基板1上的电路板2,阵列基板1还包括栅极驱动电路,该栅极驱动电路包括多级移位寄存器单元,每一移位寄存器单元与一行栅线相连,多级移位寄存器单元包括若干首级移位寄存器单元3、末级移位寄存器单元5以及主级移位寄存器单元4;首级移位寄存器单元3和末级移位寄存器单元5中至少一者的竖向尺寸小于主级移位寄存器单元4。
容易理解的是,首级移位寄存器单元3位于所有移位寄存器单元的首位,仅用以向下一级移位寄存器单元匹配阻抗,末级移位寄存器单元5是位于所有移位寄存器单元的末位,无需对后续电路施加复位信号的单元,而主级移位寄存器单元4是位于首级移位寄存器单元3和末级移位寄存器单元5之间的多个常规移位寄存器单元。
在示例性技术中,为了简化栅极驱动电路的设计难度、降低设计成本,通常将每一级移位寄存器单元的结构设计为完全一致,如此,导致了首级移位寄存器单元3和末级移位寄存器单元5的竖向尺寸较大,由于首级移位寄存器单元3和末级移位寄存器单元5均需要被显示装置上下两侧的边框所遮挡,因此,首级移位寄存器单元3和末级移位寄存器单元5较大的竖向尺寸,也就增大了显示装置的边框宽度。在本实施例中,考虑到首级移位寄存器单元3和末级移位寄存器单元5的功能用途少于各主级移位寄存器单元4,因而,将首级移位寄存器单元3和末级移位寄存器单元5中至少一者的结构区别于主级移位寄存器单元4设计,以减小首级移位寄存器单元3和/或末级移位寄存器单元5的竖向尺寸,继而实现显示装置的窄边框需求。
不失一般性,为了更好地降低显示装置的边框尺寸,本实施例中,将首级移位寄存器单元3和末级移位寄存器单元5均相较于主级移位寄存器单元4进行简化设计,例如但不限于,将首级移位寄存器单元3和末级移位寄存器单元5中的薄膜晶体管的竖向尺寸减小,以减小首级移位寄存器单元3和末级移位寄存器单元5的竖向尺寸,当然,于其他实施例中,还可具体通过其他方式减小首级移位寄存器单元3和末级移位寄存器单元5的竖向尺寸,本设计不限于此。
本发明技术方案通过将首级移位寄存器单元3和末级移位寄存器单元5区别于主级移位寄存器单元4设计,以减小首级移位寄存器单元3和末级移位寄存器单元5的竖向尺寸,从而减小用以遮盖首级移位寄存器单元3和末级移位寄存器单元5的边框尺寸,实现GOA显示产品的窄边框需求。
本实施例中,定义主级移位寄存器单元4的竖向尺寸为S,首级移位寄存器单元3的竖向尺寸为S1,满足以下公式:S1≤S/2。换言之,首级移位寄存器单元3的竖向尺寸至少比主级移位寄存器单元4的竖向尺寸小一半,基于本实施例中,通过减小移位寄存器内TFT的方式减小首级移位寄存器单元3的尺寸,则可以理解为,首级移位寄存器单元3中TFT的竖向尺寸至少比主级移位寄存器单元4中TFT的竖向尺寸小一半。另外,定义主级移位寄存器单元4的竖向尺寸为S,末级移位寄存器单元5的竖向尺寸为S2,基于与首级移位寄存器单元3相同的考虑,S和S2满足以下公式:S2≤S/2;可以理解,该末级移位寄存器单元5的尺寸至少比主级移位寄存器单元4的竖向尺寸小一半同样通过减小TFT的方式。应当说明的是,本设计不限于此,于其他实施例中,S/2≤S1≤S。不失一般性,首级移位寄存器单元3的竖向尺寸为S1,末级移位寄存器单元5的竖向尺寸为S2,满足以下公式:S1=S2。可以理解,如此设置,有利于方便栅极驱动电路于阵列基板上的排布。应当说明的是,本设计不限于此,于其他实施例中,S1>S2。
容易理解的是,对于基板1尺寸一定的情况,栅极驱动电路的占用空间的大小还会影响到阵列基板上排线的便捷性;因此,本实施例中,在进行首级移位寄存器单元3和末级移位寄存器单元5的设计时,还将两者中至少一者的横向尺寸设置为小于主级移位寄存器单元4的横向尺寸,从而避让出更多的空间以供阵列基板排线。例如但不限于,首级移位寄存器单元3和末级移位寄存器单元5中至少一者的薄膜晶体管的横向尺寸小于主级移位寄存器单元4的薄膜晶体管,即减小首级移位寄存器单元3、末级移位寄存器单元5横向尺寸的方式也采用减小TFT横向尺寸的形式实现,当然,于其他实施例中,还可具体通过其他方式实现首级移位寄存器单元3和末级移位寄存器单元5横向尺寸的减小。可以理解,对于首级移位寄存器单元3、末级移位寄存器单元5的TFT可以采用相较于主级移位寄存器单元4的TFT等比例缩小的方式,以同时缩小首级移位寄存器单元3、末级移位寄存器单元5的TFT的横向尺寸和竖向尺寸。
容易理解,阵列基板的电路板2隔设于末级移位寄存器单元5背离首级移位寄存器单元3的一侧;阵列基板的数据线包括位于显示区域11外的多条连接线6,连接线6自首级移位寄存器单元3对应的一侧朝末级移位寄存器单元5所在的一侧依次连接各栅线,穿过末级移位寄存器单元5与电路板2之间的竖向间隔,以与电路板2相连。可以理解,多条连接线6均需要从末级移位寄存器单元5与电路板2之间的竖向间隔穿过,以连接电路板2,因此,将末级移位寄存器单元5的竖向尺寸减小,无疑能增大该竖向间隔,以方便多条连接线6穿过竖向间隔时的排线。
可选地,连接线6包括依次连接的竖直段61、横向段62以及倾斜段63,竖直段61与各栅线相接,倾斜段63与电路板2相接;各连接线6的横向段62均匀间隔排布于末级移位寄存器单元5与电路板2之间的竖向间隔内。可以理解,末级移位寄存器单元5的下侧缘往往沿横向延伸,将各连接线6的横向段62于竖向间隔内并行排布,无疑有利于避免各连接线6之间发生不便要的磕碰、或者连接线6与末级移位寄存器单元5之间发生磕碰,同时也提高了阵列基板上结构排布的齐整性。
本发明还提出一种显示装置,该显示装置包括阵列基板,该阵列基板的具体结构参照上述实施例,由于本显示装置采用了上述所有实施例的全部技术方案,因此至少具有上述实施例的技术方案所带来的所有有益效果,在此不再一一赘述。
以上所述仅为本发明的优选实施例,并非因此限制本发明的专利范围,凡是在本发明的发明构思下,利用本发明说明书及附图内容所作的等效结构变换,或直接/间接运用在其他相关的技术领域均包括在本发明的专利保护范围内。
Claims (10)
1.一种阵列基板,其特征在于,包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;所述首级移位寄存器单元和末级移位寄存器单元中至少一者的竖向尺寸小于所述主级移位寄存器单元。
2.如权利要求1所述的阵列基板,其特征在于,所述主级移位寄存器单元的竖向尺寸为S,所述首级移位寄存器单元的竖向尺寸为S1,满足以下公式:S1≤S/2。
3.如权利要求1所述的阵列基板,其特征在于,所述主级移位寄存器单元的竖向尺寸为S,所述末级移位寄存器单元的竖向尺寸为S2,满足以下公式:S2≤S/2。
4.如权利要求1所述的阵列基板,其特征在于,所述首级移位寄存器单元的竖向尺寸为S1,所述末级移位寄存器单元的竖向尺寸为S2,满足以下公式:S1=S2。
5.如权利要求1至4任意一项所述的阵列基板,其特征在于,所述首级移位寄存器单元和末级移位寄存器单元中至少一者的薄膜晶体管的竖向尺寸小于所述主级移位寄存器单元的薄膜晶体管。
6.如权利要求5所述的阵列基板,其特征在于,所述首级移位寄存器单元和末级移位寄存器单元中至少一者的薄膜晶体管的横向尺寸小于所述主级移位寄存器单元的薄膜晶体管。
7.如权利要求1所述的阵列基板,其特征在于,所述末级移位寄存器单元的竖向尺寸小于所述主级移位寄存器单元,所述阵列基板的电路板隔设于所述末级移位寄存器单元背离所述首级移位寄存器单元的一侧;
所述阵列基板的数据线包括位于显示区域外的多条连接线,所述连接线自所述首级移位寄存器单元对应的一侧朝所述末级移位寄存器单元所在的一侧依次连接各所述栅线,穿过所述末级移位寄存器单元与所述电路板之间的竖向间隔,以与所述电路板相连。
8.如权利要求7所述的阵列基板,其特征在于,所述连接线包括依次连接的竖直段、横向段以及倾斜段,所述竖直段与各所述栅线相接,所述倾斜段与所述电路板相接;
各所述连接线的横向段均匀间隔排布于所述末级移位寄存器单元与所述电路板之间的竖向间隔内。
9.一种阵列基板,其特征在于,包括栅极驱动电路,所述栅极驱动电路包括多级移位寄存器单元,每一所述移位寄存器单元与一行栅线相连,所述多级移位寄存器单元包括若干首级移位寄存器单元、末级移位寄存器单元以及主级移位寄存器单元;
所述首级移位寄存器单元和末级移位寄存器单元的薄膜晶体管的竖向尺寸相等且均小于所述主级移位寄存器单元的薄膜晶体管的竖向尺寸。
10.一种显示装置,其特征在于,包括如权利要求1至8任意一项所述的阵列基板。
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Legal Events
Date | Code | Title | Description |
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PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
RJ01 | Rejection of invention patent application after publication | ||
RJ01 | Rejection of invention patent application after publication |
Application publication date: 20190322 |