CN109491165A - 具有非显示区域的显示系统 - Google Patents

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李锡烈
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AU Optronics Corp
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Abstract

本发明公开了一种显示系统，包含以外周定义且具有边缘区域的第一基板；位于边缘区域内侧且由多个子像素定义的显示区域；位于边缘区域内侧的非显示区域；数据线与伪数据线。数据线包含第一组、第二组及第三组，第一组从在第一基板的第一侧的边缘区域沿第一方向延伸至在第一基板的第二侧的边缘区域，第二组从在第一侧的边缘区域沿第一方向延伸至非显示区域的第一侧，第三组从非显示区域的第二侧沿第一方向延伸至在第一基板的第二侧的边缘区域。伪数据线沿第一方向延伸且与数据线交错，至少部分的伪数据线是用于将信号从第二组数据线传送至对应的第三组数据线。

Description

具有非显示区域的显示系统
技术领域
本发明关于一种显示器。
背景技术
各种显示技术(例如：液晶显示器(liquid crystal display；LCD))广泛地用于电子元件中，例如：笔电、智慧型手机、数码相机、告示牌类显示器与高解析度电视。此外，其他显示技术，像是有机发光二极管(organic light-emitting diodes；OLEDs)与电子纸(electronic pater displays；EPDs)显示器逐渐受到注目。
液晶显示面板可为，举例而言，如在Wu等人的美国专利号US 6,956,631(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文。在US 6,956,631案的图1中，液晶显示器面板可包含顶部极化器、底部极化器、液晶单元与背光。光从背光通过底部极化器，并穿过液晶单元然后到顶部极化器。进一步而言，在图1中，液晶单元可具有底部玻璃基板与包含彩色滤光器的顶部基板，具有薄膜晶体管(thin film transistor；TFT)元件的多个像素可在玻璃基板上形成阵列，液晶分子可填充于玻璃基板和彩色滤光器基板之间的空间而形成液晶材料层。
此外，显示器中的薄膜晶体管基板的结构是多样的。举例而言，薄膜晶体管、栅极、数据线与像素电极可形成于多层结构，如在Lai等人的美国专利号US 7,170,092(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文，如图1与图2E所示，多层结构可包含依序设置于基板上的第一导电层、第一绝缘层、半导体层、掺杂的半导体层及第二导电层，多层结构更包含第二绝缘层与设置于第二绝缘层上的像素电极，第一导电层可包含栅极线和栅极电极至少其中之一，掺杂的半导体层可包含源极与漏极，第二导电层可包含源极电极和漏极电极，多层结构可由一连串的湿式与干式蚀刻制程所形成，如US 7,170,092案中的图2A至图2D。
形成薄膜晶体管的额外的制程如在Chen等人的美国专利号US 7,652,285(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文。在US 7,652,285案中，为了形成薄膜晶体管的通道，第二金属层被蚀刻，以在栅极电极上的第二金属层上形成开口与分离源极与漏极。这样的蚀刻可以多个方式执行，包含如US 7,652,285案的图2A-2E中的后通道蚀刻制程所述，US 7,652,285案揭露薄膜晶体管漏电流可通过加入间隔物层于导电的掺杂非晶硅层的侧壁上而将导电的非晶硅层与绝缘层隔离而降低，US 7,652,285案揭露间隔物层可以在对第二金属层执行蚀刻之后，将导电的非晶硅层的露出面氧化而形成，表面可由多个不同的技术所氧化，包含氧气电浆灰化或在四氟化碳和六氟化硫存在下使用臭氧电浆。
如在Sawasaki等人的美国专利号US 7,557,895(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文。为了避免液晶显示面板的亮度不均匀，液晶层的厚度一般而言可被均匀的控制，需要的均匀性可由设置多个柱状间隔物于薄膜晶体管基板与彩色滤光基板之间而达到，柱状间隔物可由不同的高度所形成，例如部分的间隔物的高度大于基板之间的间隙，其他间隔物的高度大于基板之间的间隙。这样的结构允许基板之间的间隔可随温度而改变，并且避免当面板被施加力量时的过度变形。
US 7,557,895案更揭露组装具有液晶材料于其间的基板的方法，这个方法包含准备两个基板、涂布密封材料于此两基板其一的周边的周长上，滴入适合的体积的液晶于此两基板其一，以及在真空中填充液晶于此两基板之间而贴合此两基板，然后将贴合的此两基板回到常压下。
在液晶显示面板中，形成薄膜晶体管通道的半导体材料可为非晶硅。然而，如在Chen等人的美国专利号US US 6,818,967(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文。多晶硅通道薄膜晶体管提供许多优点给非晶硅薄膜晶体管，包含较低功率与较大的电子迁移速率。多晶硅可通过激光结晶或激光退火技术来将非晶硅转变成多晶硅所形成，激光的使用使得的制程的温度可以低于600℃，且制程的技术因此被称为低温多晶硅(low temperature poly-silicon；LTPS)，如US 7,652,285案所揭露，低温多晶硅的结晶制程使得多晶硅的表面形成隆起，这些隆起影响低温多晶硅薄膜晶体管的电流特性。US 7,652,285案揭露降低低温多晶硅表面隆起的尺寸的方法，是可藉于执行第一退火处理，接着执行表面蚀刻处理(例如使用氢氟酸(hydrofluoric acid)液体)，并接着执行第二退火处理而达成，得到的低温多晶硅表面的隆起的高度/宽度比小于0.2。栅极隔离层、栅极、介电层以及源极与漏极可接着被沉积于低温多晶硅层上，以形成完整的低温多晶硅薄膜晶体管。
如在Sun等人的美国专利号US 8,115,209(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文，相较于非晶硅薄膜晶体管，低温多晶硅薄膜晶体管的缺点是当薄膜晶体管在关闭状态时的漏电流较高，使用多栅极可降低漏电流，US8,115,209案揭露用于多晶硅薄膜晶体管的多个不同的多栅极结构，包含如US 8,115,209案所揭露的图2A-2B与图3-6。
主动矩阵(active matrix)有机发光元件可置换液晶显示面板，例如在Huang等人的美国专利号US 6,831,410(其让与给本申请公司友达光电股份有限公司)，并且其全部内容通过引用并入本文。如其中所公开的，薄膜晶体管形成于基板上，绝缘层形成并覆盖基板，接触开口形成于绝缘层中，并露出薄膜晶体管的漏极端，阳极层形成于绝缘层与露出的开口上，接触形成于阳极层与薄膜晶体管漏极之间。发光层形成于阳极层上，阴极层形成于发光层上，如US6,831,410案所述，阴极层可能通过接触开口而与阳极层形成短路，发光层与阴极层接着形成于极化层上。
一般而言，不管使用何种显示技术，显示器的形状倾向为长方形且于显示器的显示面的长与宽形成连续的显示区域，然而，于部分应用中，非连续的显示区域也是被需要的，但现有的技术不足以解决问题。
发明内容
具有非显示区域的显示系统被提供。于部分实施方式中，一种显示系统，包含第一基板、显示区域、非显示区域、多条数据线以及多条伪数据线。第一基板以外周所定义且具有从外周向内延伸的边缘区域。显示区域以排成阵列的多个子像素所定义，显示区域位于边缘区域的内侧。非显示区域位于该边缘区域的内侧。数据线包含第一组数据线、第二组数据线以及第三组数据线。第一组数据线从位于第一基板的第一侧的边缘区域沿第一方向延伸至位于第一基板的第二侧的边缘区域。第二组数据线从位于第一基板的第一侧的边缘区域沿第一方向延伸至非显示区域的第一侧。第三组数据线从非显示区域的第二侧沿第一方向延伸至第一基板的第二侧。伪数据线沿第一方向延伸且与数据线交错，至少一部分的伪数据线用于将数据信号从第二组数据线传送至第三组数据线。
于部分实施方式中，显示系统更包含栅极控制电路以及多条扫描线。栅极控制电路位于边缘区域中且沿第一方向延伸。扫描线电性连接栅极控制电路且沿第二方向延伸。
于部分实施方式中，显示系统的伪数据线包含第一组伪数据线、第二组伪数据线以及第三组伪数据线。第一组伪数据线与第一组数据线交错。第二组伪数据线与第二组数据线交错。第三组伪数据线与第三组数据线交错。
于部分实施方式中，显示系统更包含多条起始总线以及多条终止总线。多条起始总线包含第一组起始总线与第二组起始总线，第一组起始总线连接第一组数据线的数据线至该第一组伪数据线的对应的数据线，第二组起始总线连接第二组数据线的数据线至第二组伪数据线的对应的数据线。终止总线将第二组伪数据线的数据线连接至第三组数据线的对应的数据线。
于部分实施方式中，第二组数据线包含第一数据线和第二数据线。第二组伪数据线包含第一伪数据线与第二伪数据线。第二数据线与第二伪数据线位于第一数据线和第一伪数据线之间。
于部分实施方式中，非显示区域具有中央线，沿第一方向延伸，第一数据线比第二数据线更靠近中央线。
于部分实施方式中，其中起始总线与终止总线沿第二方向延伸。
于部分实施方式中，其中非显示区域被显示区域包围。
于部分实施方式中，显示系统更包含第四组数据线，第四组数据线从位于第一基板的第一侧的边缘区域沿第一方向延伸至位于第一基板的第二侧的边缘区域，且第二组数据线与第三组数据线位于第一组数据线与第四组数据线之间。
于部分实施方式中，显示系统更包含第一栅极驱动电路、第二栅极驱动电路、多条第一扫描线以及多条第二扫描线。第一栅极驱动电路位于边缘区域且沿第一方向延伸。第二栅极驱动电路位于边缘区域且沿第一方向延伸。第一扫描线电性连接至该栅极驱动电路且从边缘区域沿第二方向延伸至非显示区域的第三侧。第二扫描线电性连接至第二栅极驱动电路且从边缘区域沿第二方向延伸至非显示区域的第四侧。
于部分实施方式中，显示系统更包含数据控制电路，数据控制电路位于第一基板的第一侧的边缘区域，数据控制电路用于直接提供数据信号给第一组数据线与第二组数据线。
于部分实施方式中，数据控制电路用于通过第二组数据线及至少部分的伪数据线提供数据信号给第三组数据线。
于部分实施方式中，伪数据线之一延伸于子像素的一子像素对之间。
于部分实施方式中，数据线用于提供对应的数据信号给对应的子像素对。
于部分实施方式中，子像素的第一对包含第一子像素与第二子像素。显示系统更包含第一扫描线与第二扫描线，沿第二方向延伸。第一扫描线电性连接至第一子像素，第二扫描线电性连接至第二子像素。
于部分实施方式中，第二对子像素邻近于第一对子像素，第二对子像素包含第三子像素与第四子像素，伪数据线之另一延伸于第二对子像素之间，第二扫描线电性连接至第四子像素。
于部分实施方式中，第一基板包含从第一侧延伸至第二侧的第三侧以及从第一侧延伸至第二侧的第四侧，第三侧与第四侧长于第一侧与第二侧，第三侧与第四侧对齐于第一方向。
于部分实施方式中，子像素包含位于阵列的第一列的第一对与第二对，子像素的第一对包含第一子像素与第二子像素，子像素的第二对包含第三子像素与第四子像素，第二子像素邻近于第三子像素。数据线的第一数据线电性连接至各第一子像素与第二子像素且延伸于第一子像素与第二子像素之间。数据线的第二数据线电性连接至各第三子像素与第四子像素且延伸于第三子像素与第四子像素之间。伪数据线的第一者延伸于子像素的第一对与子像素的第二对之间。
于部分实施方式中，显示系统更包含第一扫描线与第二扫描线，第一扫描线与第二扫描线沿第二方向延伸。第一扫描线电性连接至第一子像素与第三子像素，第二扫描线电性连接至第二子像素与第四子像素。
于部分实施方式中，伪数据线的至少另一电性耦合于一共用信号线。
以上所述仅系用以阐述本发明所欲解决的问题、解决问题的技术手段、及其产生的功效等等，本发明的具体细节将在下文的实施方式及相关图式中详细介绍。
附图说明
为让本发明的上述和其他目的、特征、优点与实施例能更明显易懂，所附图式的说明如下：
图1绘示显示系统的部分实施方式的示意图；
图2绘示显示系统的另一实施方式的示意图；
图3绘示显示系统的另一实施方式的示意图；
图4绘示显示数个相邻子像素的阵列的部分实施方式的示意图；
图5绘示图4的数个子像素的充电周期的时间表；
图6绘示一对子像素的阵列的实施方式的示意图；
图7-12绘示可用于形成一对子像素的部分实施方式的布局示意图；
图13绘示控制使用成对子像素的阵列的方法的流程图；
图14绘示数个相邻子像素的阵列的部分实施方式的示意图；以及
图15绘示数个相邻子像素的阵列的另一实施方式的示意图。
其中，附图标记：
100、200、300：显示系统
110：液晶显示器面板
120、216：数据控制电路
130、218：栅极控制电路
140、150：像素
152、154：线
202、302：基板
204、304：外周
206、208、210、211、213、227、229、231、306、308、310、312、327、329、331、333：侧边
214、314：边缘区域
220、320：显示区域
222、322：非显示区域
224、226、P11、P12、P13、P14、P21、P22、P23、P24：子像素
230、250、252、260、262、350、352、360、362、D1、D2、D3：数据线
232、332：第一组数据线
234、334：第二组数据线
236、336：第三组数据线
338：第四组数据线
240、242、340、342、370、DM1、DM2、DM3：伪数据线
251：起始总线
253：终止总线
316、317：数据驱动器
318、319：栅极驱动器
324：时间控制器
335：中央线
372、374、S1、S2、S3、S4：扫描线
400、1400、1500：阵列
410、420：晶体管
414、424：源极电极
416、426：漏极电极
422：栅极
702：栅极金属
706：内连接
802：半导体材料
804、806：位置
902、904、1102、1104：通孔
1002：源极/漏极金属
1200：电极材料
1202、1204：像素电极
1310、1320：方块
1402、1502：第一列
1504：第二列
1410、1510：第一对子像素
1420、1520：第二对子像素
1530：第三对子像素
1540：第四对子像素
Cst：储存电容器
R1：第一方向
R2：第二方向
Vcom：共用信号线
具体实施方式
以下将以图式揭露本发明的多个实施方式，为明确说明起见，许多实务上的细节将在以下叙述中一并说明。然而，熟悉本领域的技术人员应当了解到，在本发明部分实施方式中，这些实务上的细节并非必要的，因此不应用以限制本发明。此外，为简化图式起见，一些习知惯用的结构与元件在图式中将以简单示意的方式绘示之。
为了方便解释，接下来的讨论描述使用液晶显示技术的显示系统的实施方式，可以理解的是，本发明不限于应用于下述特定的结构，因本发明亦可应用于其他的实施方式，例如使用有机发光二极管或电子纸，使用于此的技术只是为了描述方便，而非用于限制本发明。
于此，具有非显示区域的显示系统被提供，并在接下来将会被详细地讨论，这样的系统可包含使用与伪数据线交错的数据线，以传送非显示区域周围的数据信号，本发明的较佳实施方式将一同与图示作论述。
参照图1，显示系统100的部分实施方式被描述。显示系统100包含液晶显示器面板110，液晶显示器面板110具有数据控制电路120及栅极控制电路130(例如：栅极驱动电路(gate control on array,GOA)，本揭露的部分实施方式的电路和功能可由硬件、软件或硬件与软件的组合(例如微控制器(microcontroller)、特殊应用集成电路(application-specific integrated circuits；ASIC)及可编程微控制器(programmablemicrocontroller)执行。
继续参照图1，液晶显示器面板110包含多个像素(一般而言为数千个像素，例如像素140、150)，像素排列为二维阵列，二维阵列包含多行与多列。为了描述方便，在图1只有绘示数个像素。在薄膜晶体管(thin film transistor；TFT)液晶显示器面板中，像素一般是从三个像素元素(子像素)所形成：一个红色、一个绿色、一个蓝色，但本发明不限制于此。举例而言，像素150被描述为包含三个子像素：红色(red)子像素R、绿色(green)子像素G及蓝色(blue)子像素B。一或多个晶体管、以及一或多个储存电容器(storage capacitor)一般结合于各个像素，以形成相关的子像素的驱动电路。
一般而言，具有像素以行排列的晶体管具有连接于栅极(扫描)线(例如：线154)的栅极电极与连接于数据线(例如：线152)的源极电极。栅极控制电路130与数据控制电路120控制施加于各自的栅极线与数据线的电压，以各别处理各面板中的子像素。藉由可控制各自的子像素驱动晶体管产生脉冲，控制电路可控制各子像素的透射率(transmissivity)，以控制各像素的颜色，储存电容器有助于维持连续脉冲(以连续的影格传递)之间的各像素的电荷。值得注意的是，图1所示的显示系统100呈现连续的显示区域，然而，图2叙述包含非显示区域的细节的显示系统的另一实施方式。
如图2所示，显示系统200包含基板202，基板202由沿着侧边206、208、210、211、213、227、229及231延伸的外周204所定义。边缘区域214从外周204向内沿着侧边206、208、210、213、231、229、227及211延伸。除了由侧边227、229及231所定义的部分之外(即形成提供非显示区域的开口)，基板202的形状一般为长方形，在这方面，显示系统200包含显示区域220与非显示区域222，显示区域220(位于边缘区域214内侧)是由多个子像素(例如224、226)所定义，子像素用于显示数据且为阵列中所显示的众多子像素中的数个，非显示区域222亦位于边缘区域214(缺乏子像素)的内侧且至少部分由侧壁227、229及231所定义。进一步而言，非显示区域不包含子像素或任何相关的信号线(例如：栅极线和数据线)。于此实施方式中，非显示区域222是空的区域(例如：基板202不位于非显示区域222)。
此外，显示系统200包含位于边缘区域214的数据控制电路216与栅极控制电路218。于此实施方式中，数据控制电路216沿面板的短边206设置，栅极控制电路218沿面板的长边208设置。多条数据线(例如：数据线230)与多条伪数据线(例如：伪数据线240)从各自的控制电路延伸遍布显示区域220。进一步而言，数据线包含：第一组数据线232从在侧边206的边缘区域214沿第一方向R1延伸至在侧边210的边缘区域214，第二组数据线234从在侧边206的边缘区域214沿第一方向R1延伸至非显示区域222的侧边227，第三组数据线236从非显示区域的侧边231沿第一方向R1延伸至位于侧边210的边缘区域214。伪数据线亦沿第一方向R1延伸且与多条数据线交错。于部分实施方式中，数据线与伪数据线为交替的结构。举例来说，即沿第二方向R2依序数据线和伪数据线交错排列，于部分实施方式中，即一条数据线和一条伪数据线交替排列，然不以此为限。
因为非显示区域222延伸至跨过部分数据线的路径，至少部分的伪数据线用于传送非显示区域周围的数据信号。如此一来，至少部分的伪数据线(例如：伪数据线240、242)用于从第二组数据线234的数据线传送信号至对应的第三组数据线236的数据线。举例而言，于此实施方式中，伪数据线240将经由数据控制电路216提供给第二组数据线234的数据线250的数据信号传送至第三组数据线236的数据线260，伪数据线242传送提供给第二组数据线234的数据线252的数据信号给第三组数据线236的数据线262。重要的是，伪数据线并非如数据线直接耦合于数据控制电路，在如此的配置下，数据信号从数据控制电路藉由部分的伪数据线被传送至非显示区域的背侧。
为了传送数据信号至非显示区域222的背侧(例如：相对于数据控制电路的侧边)，多条起始总线(例如：起始总线251)与多条终止总线(例如：终止总线253)被提供。进一步而言，起始总线将第二组数据线234电性连接至对应的伪数据线。举例而言，起始总线251将数据线250电性连接至伪数据线240。此外，终止总线将伪数据线电性连接至对应的第三组数据线236的数据线。举例而言，终止总线253将伪数据线240电性连接至数据线260。于部分实施方式中，起始总线与终止总线沿第二方向R2延伸且位于边缘区域中。
于部分实施方式中，栅极控制电路218是作为栅极驱动电路(gate driver onarray；GOA)。栅极控制电路218沿第一方向R1延伸且电性连接至沿第二方向R2延伸的多条扫描线(例如：扫描线264)。第一方向R1与第二方向R2交叉。于部分实施方式中，第一方向R1与第二方向R2彼此垂直。
图3绘示具有非显示区域的显示系统的另一实施方式。进一步而言，如图3所示，显示系统300包含由外周304定义的基板302，外周沿侧边306、308、310及312延伸。于此实施方式中，基板为具有侧边308及312大于侧边306及310的长方形。边缘区域314从外周304向内延伸。显示系统300具有显示区域320及非显示区域322，具有以阵列排列的子像素的显示区域320位于边缘区域314内侧。非显示区322亦位于边缘区域314的内侧并被显示区域320环绕。非显示区域322由侧边327、329、331及333定义且显示沿第一方向R1延伸的中央线335。
显示系统300亦具有数据控制电路(包含数据驱动器316、317以及栅极控制电路318、319。数据驱动器与栅极驱动器位于边缘区域314中。具体而言，数据驱动器316及317位于邻近于侧边306的边缘区域，栅极驱动器318及319分别位于邻近于侧边308及312的边缘区域314。时间控制器(timing controller；T-con)324提供时间信号以同步处理数据控制电路和栅极控制电路。
多条数据线(例如：数据线350)与多条伪数据线(例如：伪数据线340)延伸遍及显示区域320。进一步而言，数据线包含：从位于侧边306的边缘区域314沿第一方向R1延伸至位于侧边310的边缘区域314的第一组数据线332；从位于侧边306的边缘区域314沿第一方向R1延伸至非显示区域322的侧边327的第二组数据线334；从非显示区域322的侧边331沿第一方向R1延伸至位于侧边310的边缘区域314的第三组数据线336；以及从位于侧边306的边缘区域314沿第一方向R1延伸至位于侧边310的边缘区域314的第四组数据线338。值得注意的是，第一组数据线332与第四组数据线位于非显示区域322的相对侧。这样的设置，使得第二组数据线334与第三组数据线336位于第一组数据线332与第四组数据线338之间。伪数据线(例如：伪数据线340、342)沿第一方向R1(一般而言是平行于长边308、312)延伸。伪数据线亦与多条数据线交错。于部分实施方式中，数据线与伪数据线以交替的结构提供，即沿第二方向R2上数据线和伪数据线交替排列。
至少部分的伪数据线(例如：伪数据线340、342)用于从第二组数据线传送非显示区域周围的数据信号至对应的第三组数据线的数据线。举例而言，于此实施方式中，伪数据线340藉由数据控制电路317传送提供给第二组数据线334的数据线350的数据信号至第三组数据线336的数据线360。伪数据线342传送提供给第二组数据线334的数据线352的数据信号给第三组数据线336的数据线362。于此实施方式中，数据线352、362以及伪数据线342位于数据线350、360与伪数据线340之间。此外，数据线350比数据线352更靠近非显示区322的中央线335的位置，伪数据线340比伪数据线342更远离中央线335。于此实施方式中，数据线与伪数据线的设置为对中央线对称的结构。如前所述，伪数据线不像数据线直接耦合于数据控制电路，这样的结构使数据信号藉由一些伪数据线从数据控制电路被传送至非显示区域的背侧。
为了传送数据信号至非显示区域322的背侧(非数据控制侧)，多条起始总线(例如：起始总线351)与多条终止总线(例如：终止总线353)被提供。进一步而言，起始总线将第二组数据线334电性连接至对应的伪数据线。举例而言，起始总线351将数据线350电性连接至伪数据线340。此外，终止总线将伪数据线电性连接至对应的第三组数据线336。举例而言，终止总线353将伪数据线340电性连接至数据线360。于部分实施方式中，起始总线与终止总线沿第二方向R2延伸且位于边缘区域314。
如图3所示为非用于传送对应的数据线之间的数据信号的数个伪数据线，例如伪数据线370。于部分实施方式中，非用于传送对应的数据线之间的数据信号的伪数据线可被电性耦合于共用信号线(Vcom)，以平衡这些伪数据线周围的子像素的寄生电容。
各个栅极驱动器318及319沿第一方向R1延伸且电性连接至沿第二方向R2延伸的多条扫描线。进一步而言，栅极驱动器318沿位于边缘区域314的侧边308延伸，栅极驱动器319沿位于边缘区域314的侧边312延伸。包含扫描线372及374的多条扫描线电性连接至栅极驱动器318且从位于侧边308的边缘区域314沿第二方向R2延伸至位于非显示区域322的侧边329。包含扫描线376及378的另一些扫描线电性连接至栅极驱动器319且从位于侧边312的边缘区域314沿第二方向R2延伸至非显示区域322的侧边333。沿着第二方向R2跨过显示区域320的其他扫描线亦被提供。于部分实施方式中，这些栅极线的子集受各栅极驱动器318、319控制。举例而言，侧边306与侧边327之间的栅极线受栅极控制器318控制，然而，侧边331与侧边310之间的栅极线可受栅极驱动器319控制。于其他实施例中，侧边306与侧边327之间的栅极线以及侧边331与侧边310之间的栅极线信号可交错式的被栅极驱动器318及319控制，举例来说，即沿第一方向R1依序一条栅极线由栅极驱动器318提供信号，下一条栅极线由栅极驱动器319提供信号，再下一条栅极线由栅极驱动器318提供信号，以此类推。值得注意的是，第一方向R1与第二方向R2交叉。于部分实施方式中，第一方向R1与第二方向R2互相垂直。
许多子像素结构亦可用于此显示系统。关于此点，图4为显示可被使用的数个相邻的子像素的像素阵列400的部分实施方式的示意图。阵列400包含第一列的子像素P11-P14与第二(相邻)列的子像素P21-P24，子像素P11及P21、P12及P22、P13及P23、与P14及P24位于各自的行。此外，子像素P11及P12、P13及P14、P21及P22、与P23及P24建立成对的子像素，基于各自配对来接收数据信号。即例如子像素对P11及P12、子像素对P13及P14、子像素对P21及P22、与子像素对P23及P24。进一步而言，子像素P11及P12从数据线D1接收数据信号，子像素P13及P14从数据线D2接收数据信号，子像素P21及P22从数据线D2接收信号，子像素P23及P24从数据线D3接收数据信号。值得注意的是，于此实施方式中，伪数据线在对应的一对子像素的各子像素之间延伸。举例而言，伪数据线DM1延伸于子像素P11及P12之间且亦延伸于子像素P21及P22之间。数据线与伪数据线沿第一方向R1延伸。
阵列400亦具有沿第二方向R2延伸的扫描线(例如：扫描线S1-S4)。对于各子像素对而言，对应的扫描线电性连接至子像素对的其一子像素，另一扫描线电性连接至子像素对的另一个子像素。举例而言，扫描线S1电性连接至子像素P12(亦至子像素P14)，扫描线S2电性连接至子像素P11(亦至子像素P13)，扫描线S3电性连接至子像素P21(亦至子像素P23)，扫描线S4电性连接至子像素P22(亦至子像素P24)。
各子像素包含用于连接至对应的扫描线的晶体管，子像素的各对的晶体管其中之一亦连接至数据线。举例而言，子像素P11及P12分别包含晶体管(例如：薄膜晶体管)410及420。晶体管410的栅极412电性连接至扫描线S2，晶体管420的栅极422电性连接至扫描线S1。此外，晶体管410的源极电极414电性连接至数据线D1，晶体管410的漏极电极416电性连接至晶体管420的源极电极424，例如通过储存电容器，储存电容器连接至子像素P11的像素电极，在接下来将做讨论。晶体管420的漏极电极426电性连接至子像素P12的像素电极。
图5绘示图4的数个子像素的充电周期的时间表。进一步而言，图5显示在时间t1时，提供给扫描线S1的对应的扫描信号开始一个子像素P12(以及子像素P14)的充电周期，接着进行至时间t2，因扫描线S2(子像素P13亦在时间t2开始充电)提供的扫描信号而将子像素对的另一子像素P11充电。如前所述，给子像素P11及P12的数据是由数据线D1提供。在时间t3时，扫描线S3提供的对应的扫描信号使子像素P21(及子像素P23)的充电周期开始，接着进行至时间t4，因扫描线S4(子像素P14亦在时间t4开始充电)提供的扫描信号而将子像素对的另一子像素P22充电。如前所述，给子像素P21及P22的数据是由数据线D2提供，在这样的结构下，位于阵列的不同行的子像素对的充电是独立进行，成对的子像素从相同的(共享的)数据线接收数据信号。
图6绘示可用于显示系统的一对子像素的阵列的实施方式的示意图，为了容易叙述，图6的元件符号相似于图4。关于此点，图6绘示包含子像素对P11及P12的阵列400的一部分以及数据线D1及D2、伪数据线DM1以及扫描线S1及S2。晶体管410及420、以及储存电容器Cst亦被绘示。
图7-12绘示可用于形成一对子像素(例如图6的部分实施方式)的部分实施方式的布局示意图。如图7所示，栅极金属702(例如：铝、钼、铜、钛)被沉积于基板上，以形成扫描线S1及S2、储存电容器Cst以及用于连接子像素P11的晶体管410的漏极电极至子像素P12的晶体管420的源极电极的内连接706。如图8所示，半导体材料802(例如：多晶硅(polycrystalline silicon；poly-Si)、非晶硅(amorphous silicon；a-Si)、氧化铟镓锌(indium gallium zinc oxide；IGZO)沉积于位置804及806，以开始形成晶体管。接着，如图9所示，栅极绝缘材料(例如：氮化硅(SiNx)、氧化硅(SiOx))的通孔902及904形成于内连接706中。
如图10所示，源极/漏极金属1002(例如：铝、钼、铜、钛)被沉积以形成数据线D1及D2、伪数据线DM1以及多个晶体管电极。在图11中，具有通孔1102及1104的钝化物(例如：氮化硅(SiNx)、氧化硅(SiOx))形成于各自的储存电容器。电极材料1200(例如：透明的电极材料，例如氧化铟锡(indium tin oxide；ITO))被沉积以形成像素电极1202及1204上(如图12所示)以完成阵列。
图13绘示控制使用成对子像素的阵列的方法的流程图。进一步而言，此方法可被理解为从方块1310开始，具有子像素对的阵列被提供，其中此子像素对的第一子像素(例如图4所示的子像素P11)位于阵列的第一行，此子像素对的第二子像素(例如图4的子像素P12)位于阵列的另一行。于部分实施方式中，第一子像素直接电性连接至数据线(第二子像素不则否)，伪数据线在此对第一及第二子像素之间延伸)，各子像素直接电性连接至不同的扫描线。在方块1320中，子像素对的各子像素的充电独自进行，子像素对的各子像素从数据线接收数据信号。
图14绘示数个相邻子像素的阵列的部分实施方式的示意图。如图14所示，阵列1400包含位于阵列的第一列的子像素的第一对1410及子像素的第二对1420，子像素的第一对1410包含子像素P11及P12，子像素的第二对1420包含子像素P13及P14。于此实施方式中，子像素P12及子像素P13彼此相邻。
阵列1400亦具有数据线D1及D2及伪数据线DM1、DM2及DM3，伪数据线DM2位于数据线D1及D2之间，数据线D1在子像素对的第一对1410的两个子像素之间延伸且电性连接于第一对1410的两个子像素。同样地，数据线D2在子像素对的第二对1420的两个子像素之间延伸且电性连接于第二对1420的两个子像素，其中伪数据线(伪数据线DM2)在子像素对的第一对1410及第二对1420之间(尤其是子像素P12及子像素P13之间)延伸。对比于先前所述的阵列，阵列1400不包含将数据信号从子像素其一传送至另一对子像素。进一步而言，一对子像素中各个子像素连接于不同的扫描线。于此实施方式中，举例而言，子像素P11及P13连接于扫描线S1，子像素P12及P14连接于扫描线S2。这样的结构即数据信号通过各对子像素其一被传送至子像素另一者，将需要两倍的扫描线。
图15绘示数个相邻子像素的阵列的另一实施方式的示意图。如图15所示，阵列1500具有数据线(例如数据线D1、D2及D3)与交错的伪数据线(例如；伪数据线DM1及DM2)。阵列1500亦包含在阵列的第一列1502中的子像素对的第一对1510及子像素对的第二对1520，阵列1500亦包含在第二列1504中的子像素对的第三对1530及子像素对的第四对1540。第一对1510包含子像素P11及P12、第二对1520包含子像素P13及P14，第三对1530包含子像素P21及P22，第四对1540包含子像素P23及P24。
以使用数据线D2为例，数据线D2延伸于子像素对的两对之间且电性连接于子像素的两对。进一步而言，数据线D2连接于子像素的第一对1510及第三对1530，第一对1510及第三对1530中的各子像素连接于不同的扫描线。于此实施方式中，举例而言，子像素P11连接于扫描线S1，子像素P12连接于扫描线S2，子像素P21连接于扫描线S3，子像素P22连接于扫描线S4。值得注意的是，于此实施方式中，数据线在相邻的子像素对之间延伸，伪数据线在子像素对的子像素之间延伸。举例而言，数据线D2延伸于相邻的第一对1510及第二对1520之间，伪数据线DM1延伸于第一对子像素1510的子像素P11及P12之间。
虽然本发明已以实施方式揭露如上，然其并非用以限定本发明，任何熟习此技艺者，在不脱离本发明的精神和范围内，当可作各种的更动与润饰，因此本发明的保护范围当视后附的申请专利范围所界定者为准。

Claims (19)

1.一种显示系统，其特征在于，包含：
一第一基板，以一外周所定义且具有从该外周向内延伸的一边缘区域；
一显示区域，以排成一阵列的多个子像素所定义，该显示区域位于该边缘区域的内侧；
一非显示区域，不具有该些子像素或与该些子像素相关的信号线，该非显示区域位于该边缘区域的内侧；
多条数据线，包含：
一第一组数据线，从位于该第一基板的一第一侧的该边缘区域沿一第一方向延伸至位于该第一基板的一第二侧的该边缘区域；
一第二组数据线，从位于该第一基板的该第一侧的该边缘区域沿该第一方向延伸至该非显示区域的一第一侧；以及
一第三组数据线，从该非显示区域的一第二侧沿该第一方向延伸至该第一基板的该第二侧；以及
多条伪数据线，沿该第一方向延伸且与该些数据线交错，至少一部分的该些伪数据线用于将多个数据信号从该第二组数据线传送至该第三组数据线。
2.如权利要求1所述的显示系统，其特征在于，更包含：
一栅极控制电路，位于该边缘区域中且沿该第一方向延伸；以及
多条扫描线，电性连接该栅极控制电路且沿一第二方向延伸。
3.如权利要求1所述的显示系统，其特征在于：
该些伪数据线，包含：
一第一组伪数据线，与该第一组数据线交错；
一第二组伪数据线，与该第二组数据线交错；以及
一第三组伪数据线，与该第三组数据线交错；
该显示系统更包含：
多条起始总线，包含一第一组起始总线与一第二组起始总线，该第一组起始总线连接该第一组数据线的该些数据线至该第一组伪数据线的对应的该些数据线，该第二组起始总线连接该第二组数据线的该些数据线至该第二组伪数据线的对应的该些数据线；以及
多条终止总线，将该第二组伪数据线的该些数据线连接至该第三组数据线的对应的该些数据线。
4.如权利要求3所述的显示系统，其特征在于：
该第二组数据线，包含一第一数据线和一第二数据线；
该第二组伪数据线，包含一第一伪数据线与一第二伪数据线；以及
该第二数据线与该第二伪数据线位于该第一数据线和该第一伪数据线之间。
5.如权利要求4所述的显示系统，其特征在于：
该非显示区域具有一中央线，沿该第一方向延伸，该第一数据线比该第二数据线更靠近该中央线。
6.如权利要求3所述的显示系统，其特征在于，该些起始总线与该些终止总线沿该第二方向延伸。
7.如权利要求1所述的显示系统，其特征在于，该非显示区域被该显示区域包围。
8.如权利要求7所述的显示系统，其特征在于：
该显示系统更包含一第四组数据线，该第四组数据线从位于该第一基板的该第一侧的该边缘区域沿该第一方向延伸至位于该第一基板的该第二侧的该边缘区域，且该第二组数据线与该第三组数据线位于该第一组数据线与该第四组数据线之间。
9.如权利要求7所述的显示系统，其特征在于，更包含：
一第一栅极驱动电路，位于该边缘区域且沿该第一方向延伸；
一第二栅极驱动电路，位于该边缘区域且沿该第一方向延伸；
多条第一扫描线，电性连接至该第一栅极驱动电路且从该边缘区域沿一第二方向延伸至该非显示区域的一第三侧；以及
多条第二扫描线，电性连接至该第二栅极驱动电路且从该边缘区域沿该第二方向延伸至该非显示区域的一第四侧。
10.如权利要求1所述的显示系统，其特征在于，更包含：
数据控制电路，位于该第一基板的该第一侧的该边缘区域，该数据控制电路用于直接提供数据信号给该第一组数据线与该第二组数据线。
11.如权利要求10所述的显示系统，其特征在于，该数据控制电路用于通过该第二组数据线及至少部分的该些伪数据线提供数据信号给该第三组数据线。
12.如权利要求1所述的显示系统，其特征在于，该些伪数据线之一延伸于该些子像素的一子像素对之间。
13.如权利要求12所述的显示系统，其特征在于，各该些数据线用于提供对应的数据信号给对应的该些子像素对。
14.如权利要求13所述的显示系统，其特征在于：
该些子像素的一第一对包含一第一子像素与一第二子像素；
该显示系统更包含一第一扫描线与一第二扫描线，沿一第二方向延伸；以及
该第一扫描线电性连接至该第一子像素，该第二扫描线电性连接至该第二子像素。
15.如权利要求14所述的显示系统，其特征在于：
该些子像素的一第二对邻近于该些子像素的该第一对，该些子像素的该第二对包含一第三子像素与一第四子像素，该些伪数据线之另一延伸于该些子像素的该第二对之间，该第二扫描线电性连接至该第四子像素。
16.如权利要求1所述的显示系统，其特征在于：
该第一基板包含从该第一侧延伸至该第二侧的一第三侧以及从该第一侧延伸至该第二侧的一第四侧，该第三侧与该第四侧长于该第一侧与该第二侧，该第三侧与该第四侧对齐于该第一方向。
17.如权利要求1所述的显示系统，其特征在于：
该些子像素更包含一第一对与一第二对，位于该阵列的一第一列，该些子像素的该第一对包含一第一子像素与一第二子像素，该些子像素的该第二对包含一第三子像素与一第四子像素，该第二子像素邻近于该第三子像素，其中：
该些数据线的一第一数据线，电性连接至各该第一子像素与该第二子像素，且延伸于该第一子像素与该第二子像素之间；
该些数据线的一第二数据线，电性连接至各该第三子像素与该第四子像素，且延伸于该第三子像素与该第四子像素之间；以及
该些伪数据线之一延伸于该些子像素的该第一对与该些子像素的该第二对之间。
18.如权利要求17所述的显示系统，其特征在于：
该显示系统更包含一第一扫描线与一第二扫描线，该第一扫描线与该第二扫描线沿一第二方向延伸；以及
该第一扫描线电性连接至该第一子像素与该第三子像素，该第二扫描线电性连接至该第二子像素与该第四子像素。
19.如权利要求1所述的显示系统，其特征在于，该些伪数据线的至少另一电性耦合于一共用信号线。
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