CN108399604B - 一种在打印机SoC芯片上支持大尺寸图片旋转的方法 - Google Patents

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Abstract

本发明公开了一种在打印机SoC芯片上支持大尺寸图片旋转的方法，将一幅图片在高度上分割成多个块，并在硬件加速器的存取上加入地址翻译单元，将硬件加速器给出的逻辑地址转换为物理地址来实现大尺寸图片的旋转，避免单个颜色的像素数据占用64MB以上的连续物理内存。

Description

一种在打印机SoC芯片上支持大尺寸图片旋转的方法
技术领域
本发明属于打印机SoC芯片领域，具体是一种在打印机SoC芯片上支持大尺寸图片旋转的方法。
背景技术
在一些应用场景中，旋转图片时，如果只是软件进行处理，速度会很慢，需要用到图像旋转硬件加速器。为了提高降低总线带宽和芯片面积，硬件加速器每次处理单个通道的数据，多通道的图片需要多次启动硬件加速器。但是图像旋转硬件加速器处理大尺寸图片时，大图片的单个颜色数据占用内存总计达到64MB以上，由于硬件加速器发出的地址是连续的，如果使用这么一块大的内存块来存放，则会给整个系统的内存机制设计造成很大的困难，在系统运行过程中地址连续的大块物理内存是很难保证的。
发明内容
为了解决现有技术中存在的上述技术问题，本发明提供了一种在打印机SoC芯片上支持大尺寸图片旋转的方法，将一幅图片在高度上分割成多个块，并在硬件加速器的存取上加入地址翻译单元，将硬件加速器给出的逻辑地址转换为物理地址来实现大尺寸图片的旋转。
进一步的，包括如下步骤：
（一）将一幅图片在高度上分割成多个块；
（二）将各个大小不固定的块数据重组到4MB内存块，生成输入的4M内存块链表；
（三）将输入的4M内存块链表的地址通过地址翻译单元翻译出相应的逻辑地址，配置到硬件加速器中；
（四）在硬件加速器处理完4MB内存块后，将输出的4M内存块链表中的4MB内存块分割成所需大小的块。
进一步的，所述硬件加速器对连续存储的像素数据的单个颜色分量进行旋转处理，对于多个颜色分量的图像，需要多次启动硬件加速器逐个颜色处理。
进一步的，所述地址翻译单元将一块逻辑上连续的逻辑内存地址告知硬件，实现地址连续。
进一步的，4M内存块链表通过地址翻译单元生成翻译表。
本发明将一幅图片在高度上分割成多个块，并在硬件加速器的存取上加入一个地址翻译单元，将硬件加速器给出的逻辑地址转换为物理地址方法来实现大尺寸图片的旋转，避免单个颜色的像素数据占用64MB以上的连续物理内存。
附图说明
图1是将一幅图片分割成多个块的示意图；
图2是翻译单元ATU将硬件加速器发出的逻辑地址转换为物理地址的示意图；
图3是图像数据被写到了不正确的内存区域的示意图；
图4a-图4c是各个大小不固定的块数据重组到4MB内存块中的示意图；
图5a和图5b是4M内存块链表通过ATU生成翻译表的过程示意图；
图6是ATU通过翻译表进行翻译的过程示意图；
图7a-图7c是将4MB内存块分割成所需大小的块示意图；
图8a-图8d是ROT设计流程图。
具体实施方式
下面结合附图对本发明作进一步说明。
本发明将一幅图片在高度上分割成如图1所示的多个块，并在硬件加速器的存取上加入一个地址翻译单元，将硬件加速器给出的逻辑地址转换为物理地址来实现大尺寸图片的旋转。
硬件加速器ROT是一个对连续存储的像素数据的单个颜色分量进行旋转的硬件加速器，对于多个颜色分量的图像，需要多次启动硬件加速器逐个颜色处理。
如图2所示，为了解决ROT访问地址连续和图像数据存储不连续的问题，引入地址翻译单元ATU。ATU进行地址翻译的最小粒度是4MB。ATU是将硬件加速器发出的逻辑地址转换为物理地址并在总线发出，工作时将一块逻辑上连续的逻辑内存地址告知硬件，实现地址连续，让ROT可以正常工作。
如图3所示，在像素数据块的逐个处理中，一张图片会被分割成一个个大小不固定的块进行处理。例如，当小于4M（以3M为例）的块传入时，由于ROT发出的地址是连续的，而ATU会以4M为单位进行映射，这样后面1MB数据也会被ROT读取到作为图像数据处理，与此类似，数据写入会发生图像数据被写到了不正确的内存区域。
如图4a-图4c所示，需要将各个大小不固定的块数据重组到4MB内存块中。
如图5a和图5b所示，4M内存块链表通过ATU生成翻译表的过程。
如图6所示，ATU通过翻译表进行翻译的过程。
如图7a-图7c所示，在使用硬件加速器ROT处理完4MB内存块后，需要再将4MB内存块分割成所需大小的块。
如图8a-图8d所示为ROT设计流程图，有图片输入时，图像旋转将图片分割成一个个大小不固定的块，放在输入的图像数据链表中，如果检测到输入的图像数据链表中有大小不固定的块，则申请由4M大小的块组成的输入的4M内存块链表；
将输入的图像数据链表中所有的大小不固定的块重组后，放入输入的4M内存块链表，然后将输入的图像数据销毁；
当所有大小不固定的块重组并放入输入的4M内存块链表后，申请输出的4M内存块链表，然后通过ATU翻译出相应的逻辑地址，配置到ROT硬件加速器中。
收到硬件中断后，需要将输出的4M内存块链表中的4M内存块分割成所需的一个个块放入输出的图像数据链表中，再组成图片输出。
在多功能打印机芯片的应用中，图像旋转使用硬件ROT来实现算法处理的加速。ROT需要一块连续的内存才能正常工作，对于大尺寸图像而言，单个颜色数据占用内存总计达到64MB以上，如果使用连续内存来存储图像数据，则系统内存机制需要进行重新设计或调整。为了解决ROT访问地址连续和图像数据存储不连续的问题，引入地址翻译单元ATU。ATU进行地址翻译的最小粒度是4MB。
ATU是将硬件加速器发出的逻辑地址转换为物理地址并在总线发出，工作时将一块逻辑上连续的逻辑内存地址告知硬件，实现地址连续，让ROT可以正常工作。
在像素数据的处理中，一张图片会被分割成一个个大小不固定的块进行处理。例如，当小于4M（以3M为例）的块传入时，由于ROT发出的地址是连续的，而ATU会以4M为单位进行翻译，这样后面1MB数据也会被ROT读取到作为图像数据处理，与此类似，数据写入会发生图像数据被写到了不正确的内存区域。因此需要将大小不固定的块数据重组到4MB内存块中或将4MB内存块中分割成所需大小的块。

Claims (2)

1.一种在打印机SoC芯片上支持大尺寸图片旋转的方法，其特征在于：将一幅图片在高度上分割成多个块，并在硬件加速器的存取上加入地址翻译单元，将硬件加速器给出的逻辑地址转换为物理地址来实现大尺寸图片的旋转；包括如下步骤：
（一）将一幅图片在高度上分割成多个块；
（二）将各个大小不固定的块数据重组到4MB内存块，生成输入的4M内存块链表；
（三）将输入的4M内存块链表的地址通过地址翻译单元翻译出相应的逻辑地址，配置到硬件加速器中；
（四）在硬件加速器处理完4MB内存块后，将输出的4M内存块链表中的4MB内存块分割成所需大小的块；
所述硬件加速器对连续存储的像素数据的单个颜色分量进行旋转处理，对于多个颜色分量的图像，需要多次启动硬件加速器逐个颜色处理；
所述地址翻译单元将一块逻辑上连续的逻辑内存地址告知硬件，实现地址连续。
2.如权利要求1所述的在打印机SoC芯片上支持大尺寸图片旋转的方法，其特征在于：4M内存块链表通过地址翻译单元生成翻译表。
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