CN108335668B - 像素电路、其驱动方法、电致发光显示面板及显示装置 - Google Patents

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Abstract

本发明公开了一种像素电路、其驱动方法、电致发光显示面板及显示装置，该像素电路包括第一开关模块、第二开关模块、发光模块、以及双驱动模块，通过对像素电路的改进，使得双驱动模块的第一驱动端与第一节点连接，第二驱动端与第二节点连接，在第一栅线信号端和第二栅线信号端交替输入栅线扫描信号时，第一开关模块与第二开关模块交替工作，进而使得双驱动模块的第一驱动端与第二驱动端交替工作，从而驱动至发光模块发光；如此，通过两个驱动端的交替工作，避免了双驱动模块的一个驱动端因长期处于工作状态而导致的电压不稳定，保证了像素灰阶亮度的稳定性，消除了显示不良。

Description

像素电路、其驱动方法、电致发光显示面板及显示装置
技术领域
本发明涉及发光技术领域，尤指一种像素电路、其驱动方法、电致发光显示面板及显示装置。
背景技术
有机发光二极管(Organic Light Emitting Display,OLED)按照驱动方式可以分为无源矩阵型OLED(Passive Matrix OLED,PMOLED)和有源矩阵型OLED(Active MatrixOLED,AMOLED)两大类，其中，AMOLED具有呈阵列式排布的像素，属于主动显示类型，具有发光效能高、对比度高、视角宽等优点，通常被用于高清晰的大尺寸显示装置。目前，常用的AMOLED像素电路为电流型驱动电路，当有电流经过有机发光二极管时，有机发光二极管发光，且像素灰阶亮度可以通过控制流经有机发光二极管自身的电流大小来实现亮度的变化。
在现有技术中，典型的AMOLED的像素电路的基本结构如图1所示的2T1C结构，即两个薄膜晶体管和一个电容；当像素电路工作时，栅线信号端输入的栅线扫描信号Gate1控制开关薄膜晶体管T1导通，数据线信号端输入的数据信号Data通过开关薄膜晶体管T1传输至驱动薄膜晶体管T2的栅极，并对电容C充电；在驱动薄膜晶体管T2导通时，驱动有机发光二极管D发光；并且在电容C的作用下，可以使驱动薄膜晶体管T2的栅极电位保持到下一帧画面的切换，以保证画面的连续性。
然而，因像素电路中的驱动薄膜晶体管T2长期处于栅极偏压的作用下，导致驱动薄膜晶体管T2的阈值电压发生漂移，使得有机发光二极管D的亮度发生显著的变化，从而造成各种显示的不良。
基于此，如何抑制驱动薄膜晶体管的阈值电压漂移，保证像素灰阶亮度的稳定，避免显示不良现象的发生，是本领域技术人员亟待解决的技术问题。
发明内容
本发明实施例提供一种像素电路、其驱动方法、电致发光显示面板及显示装置，用以解决现有技术中如何抑制驱动薄膜晶体管的阈值电压漂移，保证像素灰阶亮度的稳定，避免显示不良现象的发生。
本发明实施例提供了一种像素电路，包括：第一开关模块、第二开关模块、发光模块、以及双驱动模块；其中，
所述第一开关模块的信号控制端与第一栅线信号端相连，信号输入端与数据线信号端相连，信号输出端与第一节点相连；所述第一开关模块用于在所述第一栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至所述第一节点；
所述第二开关模块的信号控制端与第二栅线信号端相连，信号输入端与所述数据线信号端相连，信号输出端与第二节点相连；所述第二开关模块用于在所述第二栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至所述第二节点；
所述双驱动模块的第一驱动端与所述第一节点相连，第二驱动端与所述第二节点相连，信号输入端与第一参考信号端相连，信号输出端与所述发光模块的第一端相连；所述发光模块的第二端与第二参考信号端相连；所述双驱动模块用于在所述第一节点或所述第二节点的电位控制下，驱动所述发光模块发光。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述双驱动模块，具体包括：双栅薄膜晶体管、第一电容、以及第二电容；其中，
所述双栅薄膜晶体管的第一栅极与所述第一节点相连，第二栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述发光模块的第一端相连；
所述第一电容连接于所述第一节点与所述发光模块的第一端之间；
所述第二电容连接于所述第二节点与所述发光模块的第一端之间。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述数据线信号端提供的数据信号为高电平信号，所述双栅薄膜晶体管为N型薄膜晶体管；或，所述数据线信号端提供的数据信号为低电平信号，所述双栅薄膜晶体管为P型薄膜晶体管。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述双栅薄膜晶体管为P型薄膜晶体管时，所述发光模块的正极与所述双栅薄膜晶体管的漏极相连；或，所述双栅薄膜晶体管为N型薄膜晶体管，所述发光模块的负极与所述双栅薄膜晶体管的漏极相连。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述第一开关模块包括：第一薄膜晶体管；其中，
所述第一薄膜晶体管的栅极与所述第一栅线信号端相连，源极与所述数据线信号端相连，漏极与所述第一节点相连。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述第一栅线信号端输入的栅线扫描信号为高电平信号，第一薄膜晶体管为N型薄膜晶体管；或，所述第一栅线信号端输入的栅线扫描信号为低电平信号，第一薄膜晶体管为P型薄膜晶体管。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述第二开关模块包括：第二薄膜晶体管；其中，
所述第二薄膜晶体管的栅极与所述第二栅线信号端相连，源极与所述数据线信号端相连接，漏极与所述第二节点相连。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述第二栅线信号端输入的栅线扫描信号为高电平信号，第二薄膜晶体管为N型薄膜晶体管；或，所述第二栅线信号端输入的栅线扫描信号为低电平信号，第二薄膜晶体管为P型薄膜晶体管。
在一种可能的实施方式中，在本发明实施例提供的上述像素电路中，所述发光模块包括：有机发光二极管；其中，
所述有机发光二极管的第一端与所述双驱动模块的信号输出端相连，第二端与所述第二参考信号端连接。
本发明实施例还提供了一种本发明实施例提供的上述像素电路的驱动方法，包括：
当第一栅线信号端输入栅线扫描信号时，第一开关模块在所述第一栅线信号端输入的栅线扫描信号的控制下，将数据线信号端提供的数据信号传输至第一节点；双驱动模块在所述第一节点的电位为所述数据线信号端提供的数据信号的电位时，驱动发光模块发光；
当第二栅线信号端输入栅线扫描信号时，第二开关模块在所述第二栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至第二节点；所述双驱动模块在所述第二节点的电位为所述数据线信号端提供的数据信号的电位时，驱动所述发光模块发光。
本发明实施例还提供了一种电致发光显示面板，包括至少一个本发明实施例提供的上述像素电路。
本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述电致发光显示面板。
本发明有益效果如下：
本发明实施例提供的一种像素电路、其驱动方法、电致发光显示面板及显示装置，该像素电路包括第一开关模块、第二开关模块、发光模块、以及双驱动模块，双驱动模块的第一驱动端与第一节点相连，第二驱动端与第二节点相连，信号输入端与第一参考信号端相连，信号输出端与发光模块的第一端相连；发光模块的第二端与第二参考信号端相连；双驱动模块用于在第一节点或第二节点的电位控制下，驱动发光模块发光；因此，通过对像素电路的改进，使得双驱动模块的第一驱动端与第一节点连接，第二驱动端与第二节点连接，在第一栅线信号端和第二栅线信号端交替输入栅线扫描信号时，第一开关模块与第二开关模块交替工作，进而使得双驱动模块的第一驱动端与第二驱动端交替工作，从而驱动至发光模块发光；如此，通过两个驱动端的交替工作，避免了双驱动模块的一个驱动端因长期处于工作状态而导致的电压不稳定，保证了像素灰阶亮度的稳定性，消除了显示不良。
附图说明
图1为现有技术中像素电路的结构示意图；
图2为本发明实施例中提供的一种像素电路的整体结构示意图；
图3为本发明实施例中提供的一种像素电路的具体结构示意图；
图4为本发明实施例中提供的与图3所示的像素电路对应的像素电路工作时序图。
具体实施方式
下面将结合附图对本发明实施例提供的一种像素电路、其驱动方法、电致发光显示面板及显示装置的具体实施方式进行详细地说明。
本发明实施例提供了一种像素电路，如图2所示，可以包括：第一开关模块10、第二开关模块20、发光模块30、以及双驱动模块40；其中，
第一开关模块10的信号控制端与第一栅线信号端Gate1相连，信号输入端与数据线信号端Data相连，信号输出端与第一节点P1相连；第一开关模块10用于在第一栅线信号端Gate1输入的栅线扫描信号的控制下，将数据线信号端Data提供的数据信号传输至第一节点P1；
第二开关模块20的信号控制端与第二栅线信号端Gate2相连，信号输入端与数据线信号端Data相连，信号输出端与第二节点P2相连；第二开关模块20用于在第二栅线信号端Gate2输入的栅线扫描信号的控制下，将数据线信号端Data提供的数据信号传输至第二节点P2；
双驱动模块40的第一驱动端与第一节点P1相连，第二驱动端与第二节点P2相连，信号输入端与第一参考信号端GND相连，信号输出端与发光模块30的第一端相连；发光模块30的第二端与第二参考信号端VDD相连；双驱动模块40用于在第一节点P1或第二节点P2的电位控制下，驱动发光模块30发光。
本发明实施例提供的上述像素电路，通过对像素电路的改进，使得双驱动模块40的第一驱动端与第一节点P1连接，第二驱动端与第二节点P2连接，在第一栅线信号端Gate1和第二栅线信号端Gate2交替输入栅线扫描信号时，第一开关模块10与第二开关模块20交替工作，进而使得双驱动模块40的第一驱动端与第二驱动端交替工作，从而驱动至发光模块30发光；如此，通过两个驱动端的交替工作，避免了双驱动模块40的一个驱动端因长期处于工作状态而导致的电压不稳定，保证了像素灰阶亮度的稳定性，消除了显示不良。
在具体实施时，为了更清楚的说明双驱动模块40的两个驱动端交替工作，在本发明实施例提供的上述像素电路中，如图3所示，双驱动模块40，可以具体包括：双栅薄膜晶体管Td、第一电容C1、以及第二电容C2；其中，
双栅薄膜晶体管Td的第一栅极与第一节点P1相连，第二栅极与第二节点P2相连，源极与第一参考信号端GND相连，漏极与发光模块30的第一端相连；
第一电容C1连接于第一节点P1与发光模块30的第一端之间；
第二电容C2连接于第二节点P2与发光模块30的第一端之间。
具体地，双栅薄膜晶体管Td抑制阈值电压漂移的工作原理，可以根据如下所示的薄膜晶体管的阈值电压漂移经验公式说明：
△Vth∝│Vgate│βtγ
其中，△Vth表示阈值电压的漂移量，Vgate表示栅极电压，t表示时间，β和γ表示与薄膜晶体管本身特性相关的常数。
在本发明实施例提供的上述像素电路中，以在第一帧内，双栅薄膜晶体管Td的第一栅极处于工作状态，在相邻的第二帧内，双栅薄膜晶体管Td的第二栅极处于工作状态为例，双栅薄膜晶体管Td的第一栅极的阈值电压漂移量为＝k1×│Vdata1│β1tγ1，k1为一常数，第二栅极的阈值电压漂移量为＝k2×│Vdata2│β2tγ2，k2为一常数；在第一帧内的第一栅极与第二帧内的第二栅极的偏压对薄膜晶体管沟道的作用相反，因此，在两帧信号加载完成后，阈值电压漂移量为k1×│Vdata1│β1tγ1-k2×│Vdata2│β2tγ2；具体地，可以通过工艺调整使β和γ等参数一致，即data1和data2相等，以便使得在两帧信号加载完成后阈值电压漂移量尽量接近于0，从而实现由于第一栅极和第二栅极的交替工作，使得一组奇偶帧的阈值电压漂移量互相抵消，避免薄膜晶体管的电学特性变化带来的亮度变化。
当然，双栅薄膜晶体管Td的第一栅极和第二栅极的交替工作，并不限于在连接的两帧内进行，还可以在间隔的不同帧内进行，在此不作限定。
具体地，数据线信号端Data提供的数据信号为高电平信号，双栅薄膜晶体管Td为N型薄膜晶体管；或，数据线信号端Data提供的数据信号为低电平信号，双栅薄膜晶体管Td为P型薄膜晶体管。
以上仅是举例说明双驱动模块40的具体结构，在具体实施时，双驱动模块40的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作赘述。
具体地，在本发明实施例提供的上述像素电路中，双栅薄膜晶体管Td为P型薄膜晶体管，发光模块30的正极与双栅薄膜晶体管Td的漏极相连；或，当双栅薄膜晶体管Td为N型薄膜晶体管，发光模块30的负极与双栅薄膜晶体管Td的漏极相连。
当双栅薄膜晶体管Td为P型薄膜晶体管时，发光模块30的第一端为正极，第二端为负极。第一参考信号端为高电平电压端，如电压VDD，第二参考信号端为低电平电压端，例如电压可以为接地GND或者为VSS。
当双栅薄膜晶体管Td为N型薄膜晶体管时，发光模块30的第一端为负极，第二端为正极。第一参考信号端为低电平电压端，如电压可以为接地GND或者为VSS，第二参考信号端为高电平电压端，例如电压可以为VDD。其中，VDD>GND>VSS。
在具体实施时，在本发明实施例提供的上述像素电路中，如图3所示，第一开关模块10，可以包括：第一薄膜晶体管T1；其中，
第一薄膜晶体管T1的栅极与第一栅线信号端Gate1相连，源极与数据线信号端Data相连，漏极与第一节点P1相连。
具体地，第一薄膜晶体管T1在第一栅线信号端Gate1输入的栅线扫描信号的控制下，将数据线信号端Data提供的数据信号传输至第一节点P1。
进一步地，第一栅线信号端Gate1输入的栅线扫描信号为高电平信号，第一薄膜晶体管T1为N型薄膜晶体管；或，第一栅线信号端Gate1输入的栅线扫描信号为低电平信号，第一薄膜晶体管T1为P型薄膜晶体管。
以上仅是举例说明第一开关模块10的具体结构，在具体实施时，第一开关模块10的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作赘述。
在具体实施时，在本发明实施例提供的上述像素电路中，如图3所示，第二开关模块20，可以包括：第二薄膜晶体管T2；其中，
第二薄膜晶体管T2的栅极与第二栅线信号端Gate2相连，源极与数据线信号端Data相连接，漏极与第二节点P2相连。
具体地，第二薄膜晶体管T2在第二栅线信号端Gate2输入的栅线扫描信号的控制下，将数据线信号端Data提供的数据信号传输至第二节点P2。
进一步地，第二栅线信号端Gate2输入的栅线扫描信号为高电平信号，第二薄膜晶体管T2为N型薄膜晶体管；或，第二栅线信号端Gate2输入的栅线扫描信号为低电平信号，第二薄膜晶体管T2为P型薄膜晶体管。
以上仅是举例说明第二开关模块20的具体结构，在具体实施时，第二开关模块20的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作赘述。
当然，在本发明实施例提供的上述像素电路中涉及的各晶体管并不只是限于薄膜晶体管(Thin Film Transistor，TFT)，还可以是金属氧化物半导体场效应管(Metal OxideSemiconductor，MOS)；并且，上述各薄膜晶体管(包括第一薄膜晶体管T1、第二薄膜晶体管T2、以及双栅薄膜晶体管Td)的源极和漏极的制作工艺相同，名称上是可以互换的，其可根据电压的方向在名称上改变。
在具体实施时，为了实现发光，在本发明实施例提供的上述像素电路中，如图3所示，发光模块30，可以包括：有机发光二极管D；其中，
有机发光二极管D的第一端与双驱动模块40的信号输出端相连，第二端与第二参考信号端VDD连接。
当然，在本发明实施例提供的上述像素电路中涉及的有机发光二极管D为有源矩阵型电致发光器件，因此并不只限于有机发光二极管，还可以是量子点发光二极管。
需要说明的是，本发明实施例提供的对像素电路的改进，并不限于如图2和图3所示的像素电路的结构，还可以是其他结构的像素电路，在此不作限定。
下面结合图3所示的像素电路和图4所示的像素电路工作时序图，对本发明实施例提供的上述像素电路的工作过程作以描述。
如图4所示，为本实施例中提供的像素电路的时序图，在连续两帧内每一帧均可分为两个时间段；在如图3所示的像素电路中，以各薄膜晶体管均为N型薄膜晶体管，第一参考信号端的电压为接地GND，第二参考信号端的电压为VDD为例。
在t1阶段，第一栅线信号端Gate1输入栅线扫描信号，第一薄膜晶体管T1导通，将数据线信号端Data提供的数据信号VData1传输至第一节点P1，同时为第一电容C1充电；此时，双栅薄膜晶体管Td的第一栅极导通，保持有机发光二极管D的负极的电压为低电平，因有机发光二极管D的正极的电压为高电平电压VDD，因此驱动有机发光二极管D发光。
在t2阶段，第一栅线信号端Gate1停止输入栅线扫描信号，第一薄膜晶体管T1截止，此时第一电容C1开始放电，双栅薄膜晶体管Td的第一栅极继续导通，并且继续保持有机发光二极管D的负极的电压为低电平，从而继续驱动有机发光二极管D发光。
在t3阶段，第二栅线信号端Gate2输入栅线扫描信号，第二薄膜晶体管T2导通，将数据线信号端Data提供的数据信号VData2传输至第二节点P2，同时为第二电容C2充电；此时，双栅薄膜晶体管Td的第二栅极导通，因此驱动有机发光二极管D发光。
在t4阶段，第二栅线信号端Gate2停止输入栅线扫描信号，第二薄膜晶体管T2截止，此时第二电容C2开始放电，双栅薄膜晶体管Td的第二栅极继续导通，并且继续保持有机发光二极管D的负极的电压为低电平，从而继续驱动有机发光二极管D发光。
此后，直至下一次的t1阶段的出现，即第一栅线信号端Gate1再次输入栅线扫描信号时，第一薄膜晶体管T1处于工作导通的状态，而第二薄膜晶体管T2处于关断状态；因此，利用第一薄膜晶体管T1和第二薄膜晶体管T2的交替工作，进而带动双栅薄膜晶体管Td的第一栅极和第二栅极的交替工作，避免了因一个栅极长期处于工作状态而导致的阈值电压漂移，保证了像素灰阶亮度的稳定性，消除了显示不良。
基于同一发明构思，本发明实施例还提供了一种本发明实施例提供的上述像素电路的驱动方法，可以包括：
当第一栅线信号端输入栅线扫描信号时，第一开关模块在第一栅线信号端输入的栅线扫描信号的控制下，将数据线信号端提供的数据信号传输至第一节点；双驱动模块在第一节点的电位为数据线信号端提供的数据信号的电位时，驱动发光模块发光；
当第二栅线信号端输入栅线扫描信号时，第二开关模块在第二栅线信号端输入的栅线扫描信号的控制下，将数据线信号端提供的数据信号传输至第二节点；双驱动模块在第二节点的电位为数据线信号端提供的数据信号的电位时，驱动发光模块发光。
基于同一发明构思，本发明实施例还提供了一种电致发光显示面板，可以包括至少一个本发明实施例提供的上述像素电路，其具体实施可参见本发明实施例提供的上述像素电路描述，相同之处不再赘述。
本发明实施例还提供了一种显示装置，可以包括本发明实施例提供的上述电致发光显示面板，该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。该显示装置的实施可以参见上述电致发光显示面板的实施例，重复之处不再赘述。
本发明实施例提供了一种像素电路、其驱动方法、电致发光显示面板及显示装置，该像素电路包括第一开关模块、第二开关模块、发光模块、以及双驱动模块，双驱动模块的第一驱动端与第一节点相连，第二驱动端与第二节点相连，信号输入端与第一参考信号端相连，信号输出端与发光模块的第一端相连；发光模块的第二端与第二参考信号端相连；双驱动模块用于在第一节点或第二节点的电位控制下，驱动发光模块发光；因此，通过对像素电路的改进，使得双驱动模块的第一驱动端与第一节点连接，第二驱动端与第二节点连接，在第一栅线信号端和第二栅线信号端交替输入栅线扫描信号时，第一开关模块与第二开关模块交替工作，进而使得双驱动模块的第一驱动端与第二驱动端交替工作，从而驱动至发光模块发光；如此，通过两个驱动端的交替工作，避免了双驱动模块的一个驱动端因长期处于工作状态而导致的电压不稳定，保证了像素灰阶亮度的稳定性，消除了显示不良。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (9)

1.一种像素电路，其特征在于，包括：第一开关模块、第二开关模块、发光模块、以及双驱动模块；其中，
所述第一开关模块包括第一薄膜晶体管；其中，所述第一薄膜晶体管的栅极与所述第一栅线信号端相连，源极与所述数据线信号端相连，漏极与所述第一节点相连，所述第一开关模块的信号控制端与第一栅线信号端相连，信号输入端与数据线信号端相连，信号输出端与第一节点相连；所述第一开关模块用于在所述第一栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至所述第一节点；
所述第二开关模块包括第二薄膜晶体管；其中，所述第二薄膜晶体管的栅极与所述第二栅线信号端相连，源极与所述数据线信号端相连接，漏极与所述第二节点相连；
所述第二开关模块的信号控制端与第二栅线信号端相连，信号输入端与所述数据线信号端相连，信号输出端与第二节点相连；所述第二开关模块用于在所述第二栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至所述第二节点；
所述双驱动模块，具体包括双栅薄膜晶体管、第一电容、以及第二电容；其中，所述双栅薄膜晶体管的第一栅极与所述第一节点相连，第二栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述发光模块的第一端相连；所述第一电容连接于所述第一节点与所述发光模块的第一端之间；所述第二电容连接于所述第二节点与所述发光模块的第一端之间，所述双驱动模块的第一驱动端与所述第一节点相连，第二驱动端与所述第二节点相连，信号输入端与第一参考信号端相连，信号输出端与所述发光模块的第一端相连；所述发光模块的第二端与第二参考信号端相连；所述双驱动模块用于在所述第一节点或所述第二节点的电位控制下，驱动所述发光模块发光。
2.如权利要求1所述的像素电路，其特征在于，所述数据线信号端提供的数据信号为高电平信号，所述双栅薄膜晶体管为N型薄膜晶体管；或，所述数据线信号端提供的数据信号为低电平信号，所述双栅薄膜晶体管为P型薄膜晶体管。
3.如权利要求2所述的像素电路，其特征在于，所述双栅薄膜晶体管为P型薄膜晶体管，所述发光模块的正极与所述双栅薄膜晶体管的漏极相连；或，所述双栅薄膜晶体管为N型薄膜晶体管，所述发光模块的负极与所述双栅薄膜晶体管的漏极相连。
4.如权利要求1所述的像素电路，其特征在于，所述第一栅线信号端输入的栅线扫描信号为高电平信号，第一薄膜晶体管为N型薄膜晶体管；或，所述第一栅线信号端输入的栅线扫描信号为低电平信号，第一薄膜晶体管为P型薄膜晶体管。
5.如权利要4所述的像素电路，其特征在于，所述第二栅线信号端输入的栅线扫描信号为高电平信号，第二薄膜晶体管为N型薄膜晶体管；或，所述第二栅线信号端输入的栅线扫描信号为低电平信号，第二薄膜晶体管为P型薄膜晶体管。
6.如权利要求1所述的像素电路，其特征在于，所述发光模块包括：有机发光二极管；其中，
所述有机发光二极管的第一端与所述双驱动模块的信号输出端相连，第二端与所述第二参考信号端连接。
7.一种如权利要求1-6任一项所述的像素电路的驱动方法，其特征在于，包括：
当第一栅线信号端输入栅线扫描信号时，第一开关模块在所述第一栅线信号端输入的栅线扫描信号的控制下，将数据线信号端提供的数据信号传输至第一节点；双驱动模块在所述第一节点的电位为所述数据线信号端提供的数据信号的电位时，驱动发光模块发光；
当第二栅线信号端输入栅线扫描信号时，第二开关模块在所述第二栅线信号端输入的栅线扫描信号的控制下，将所述数据线信号端提供的数据信号传输至第二节点；所述双驱动模块在所述第二节点的电位为所述数据线信号端提供的数据信号的电位时，驱动所述发光模块发光。
8.一种电致发光显示面板，其特征在于，包括至少一个如权利要求1-6任一项所述的像素电路。
9.一种显示装置，其特征在于，包括如权利要求8所述的电致发光显示面板。
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