CN108206720B - 终端及其慢时钟频偏的调整方法 - Google Patents
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Abstract
本发明提供了一种终端及其慢时钟频偏的调整方法中，所述终端包括用于产生基准时钟的数字补偿晶体振荡器DCXO，确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容；根据所述最小负载电容获取与其对应的第一频偏，所述第一频偏即为调整后的频偏。利用所述第一频偏对所述终端的慢时钟进行频偏补偿，即可提高所述终端在睡眠状态下的慢时钟的精度。
Description
技术领域
本发明涉及移动通信领域，尤其是一种终端及其慢时钟频偏的调整方法。
背景技术
移动终端中一般会有两个独立时钟：一个快时钟，采用VCTCXO(VoltageControlled Temperature Compensation Crystal Oscillator压控温补晶体振荡器)，用作系统主时钟；一个慢时钟，采用XTAL(External Crystal Oscillator，外部晶振)，用作睡眠时钟。随着DCXO(Digitally Compensated Crystal Oscillator数字补偿晶体振荡器)的普及，其成本低，功耗低，很多终端已经逐渐使用DCXO替代VCTCXO。同时在DCXO电路中加入一个分频器，可分频得到慢时钟。
在终端睡眠状态下，DCXO负载会被调整到最低，以降低功耗，此时分频得到的慢时钟的频偏会很大，由于快慢时钟同源，采用快时钟校准慢时钟的方法已不可用，进而无法获得精确的慢时钟的频偏。
发明内容
本发明的目的在于提供一种终端及其慢时钟频偏的调整方法，以能够精确的获得终端慢时钟的频偏。
为了达到上述目的，本发明提供了一种终端的慢时钟频偏的调整方法，所述终端包括用于产生基准时钟的数字补偿晶体振荡器DCXO，所述方法包括：
确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；
确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；
根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容；
根据所述最小负载电容获取与其对应的第一频偏，所述第一频偏即为调整后的频偏。
优选的，在上述的终端的慢时钟频偏的调整方法中，确定CDAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CDAC的第一值CDAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；
再获取所述CDAC的又一值CDAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；
根据CDAC1、CDAC2、FCDAC1以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的关系。
优选的，在上述的终端的慢时钟频偏的调整方法中，确定CFAC与DCXO的输出频率之间的关系的步骤包括：
固定一CDAC值；
获取所述CFAC的第一值CFAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC1；
再获取所述CFAC的又一值CFAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC2；
根据CFAC1、CFAC2、FCFAC1以及FCFAC2获取所述CFAC与所述DCXO的输出频率之间的关系。
优选的，在上述的终端的慢时钟频偏的调整方法中，所述第一负载电容由以下公式获得：
其中，CL1表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F1表示所述CDAC最小时对应的DCXO的输出频率。
优选的，在上述的终端的慢时钟频偏的调整方法中，所述第二负载电容由以下公式获得：
其中，CL2表示第二负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F2表示所述CFAC最小时对应的DCXO的输出频率。
优选的，在上述的终端的慢时钟频偏的调整方法中，所述最小负载电容由以下公式获得：
CLMIN＝CL1+CL2-CL，
其中，CLMIN表示所述最小负载电容；CL1表示所述第一负载电容；CL2表示第二负载电容；CL表示所述终端工作需要的负载电容。
优选的，在上述的终端的慢时钟频偏的调整方法中，所述第一频偏由以下公式获得：
其中，F1为所述第一频偏；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；CLMIN表示所述最小负载电容。
优选的，在上述的终端的慢时钟频偏的调整方法中，获取当前温度下所述DCXO的第二频偏，所述DCXO调整后的频偏由以下公式获得：
FL＝F1+F2，
其中，FL为当前温度下所述DCXO调整后的频偏；F1为第一频偏；F2为第二频偏。
优选的，在上述的终端的慢时钟频偏的调整方法中，所述第二频偏由以下公式获得：
F2＝M3(t-t0)3+M2(t-t0)2+M1(t-t0)+M0，
其中，F2表示第二频偏，M3、M2、M1以及M0表示所述DCXO的温度参数；t表示当前温度；t0表示基准温度。
本发明还提供了一种终端，包括用于产生基准时钟的数字补偿晶体振荡器DCXO，还包括：
第一调频单元，用于获取所述DCXO的最小负载电容，根据所述最小负载电容获取与其对应的第一频偏。
优选的，在上述的终端中，所述第一调频单元获取DCXO的最小负载电容的步骤包括：
确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；
确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；
根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容。
优选的，在上述的终端中，确定CDAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CDAC的中间值CDAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；
再获取所述CDAC的任意值CDAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；
根据CDAC1、CDAC2、FCDAC1以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的关系。
优选的，在上述的终端中，确定CFAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CFAC的中间值CFAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC1；
再获取所述CFAC的任意值CFAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC2；
根据CFAC1、CFAC2、FCFAC1以及FCFAC2获取所述CFAC与所述DCXO的输出频率之间的关系。
优选的，在上述的终端中，所述第一负载电容由以下公式获得：
其中，CL1表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F1表示所述CDAC最小时对应的DCXO的输出频率。
优选的，在上述的终端中，所述第二负载电容由以下公式获得：
其中，CL2表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F2表示所述CFAC最小时对应的DCXO的输出频率。
优选的，在上述的终端中，所述最小负载电容由以下公式获得：
CLMIN＝CL1+CL2-CL，
其中，CLMIN表示所述最小负载电容；CL1表示所述第一负载电容；CL2表示第二负载电容；CL表示所述终端工作需要的负载电容。
优选的，在上述的终端中，所述第一频偏由以下公式获得：
其中，F1为所述第一频偏；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；CLMIN表示所述最小负载电容。
优选的，在上述的终端中，还包括第二调频单元，用于获取当前温度下所述DCXO的第二频偏，所述第二频偏由以下公式获得：
F2＝M3(t-t0)3+M2(t-t0)2+M1(t-t0)+M0，
其中，F2表示第二频偏，M3、M2、M1以及M0表示所述DCXO的温度参数；t表示当前温度；t0表示基准温度。
优选的，在上述的终端中，还包括一处理单元，用于根据所述第一频偏和第二频偏获取所述DCXO调整后的频偏，所述DCXO调整后的频偏由以下公式获得：
FL＝F1+F2，
其中，FL为当前温度下所述DCXO调整后的频偏；F1为第一频偏；F2为第二频偏。
在本发明提供的终端及其慢时钟频偏的调整方法中，获得所述DCXO在其负载电容为最小值时的频偏，即，在睡眠状态下，所述DCXO的负载电容最小时的频偏。利用所述第一频偏对所述终端的慢时钟进行频偏补偿，即可提高所述终端在睡眠状态下的慢时钟的精度。
附图说明
图1为本发明实施例中获取终端的慢时钟频偏的调整方法的流程图；
图2为本发明实施例中DCXO的等效电路；
图3为本发明实施例中终端的结构示意图。
具体实施方式
下面将结合示意图对本发明的具体实施方式进行更详细的描述。根据下列描述和权利要求书，本发明的优点和特征将更清楚。需说明的是，附图均采用非常简化的形式且均使用非精准的比例，仅用以方便、明晰地辅助说明本发明实施例的目的。
本发明实施例提供了一种终端的慢时钟频偏的调整方法，所述终端包括用于产生基准时钟的数字补偿晶体振荡器DCXO。具体的，所述方法包括两部分，第一部分：获取所述DCXO的最小负载电容，根据所述最小负载电容获取与其对应的第一频偏。第二部分：获取当前温度下所述DCXO的第二频偏。在考虑温度对所述DCXO的频偏的影响时，将所述第一频偏和第二频偏之后作为所述DCXO调整后的频偏。当不考虑温度对所述DCXO的频偏的影响或者温度对所述DCXO的频偏的影响较小时，将所述第一频偏作为所述DCXO调整后的频偏。
在本发明的实施例中，优选的，将所述第一频偏和第二频偏之后作为所述DCXO调整后的频偏。
获取所述第一频偏的过程包括以下步骤：确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容；根据所述最小负载电容获取与其对应的第一频偏。
具体的，如图1所示，图1为本发明实施例中获取终端的慢时钟频偏的调整方法的流程图。在步骤S1中，确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容。
确定CDAC与DCXO的输出频率之间的关系的步骤具体如下：首先获取所述CDAC的第一值CDAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；再获取所述CDAC的又一值CDAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；根据CDAC1、CDAC2、FCDACl以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的关系。
具体而言，所述CDAC与DCXO的输出频率之间可以被设计为线性关系，也可以为非线性关系。当所述CDAC与DCXO的输出频率之间为线性关系时，确定CDAC与DCXO的输出频率之间的关系的步骤如下：首先获取所述CDAC的中间值CDAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；再获取所述CDAC的任意其他值CDAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；根据CDAC1、CDAC2、FCDAC1以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的线性关系。
然后，从给定的多个CDAC值中选取其中的最小值，根据CDAC与DCXO的输出频率之间的线性关系获取CDAC为该最小值时DCXO的输出频率，然后再根据该输出频率获取此时(CDAC为该最小值时)DCXO的负载电容，该负载电容即为所述第一负载电容。
具体的，所述第一负载电容由以下公式获得：
其中，CL1表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F1表示所述CDAC最小时对应的DCXO的输出频率。
所述DCXO的等效电路如图2所示，C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；R1表示所述DCXO的等效电路的动态电阻。
当所述CDAC与DCXO的输出频率之间为非线性关系时，可以采用以下方式。首先，设定所述CDAC的最小调整量CDACa，在所述DCXO的电路中使用若干个CDAC并联，各个CDAC的电容值分别为：CDACa、2*CDACa、4*CDACa、8*CDACa、16*CDACa等以及更多，通过这种方式，可以将所述DCXO电路中的CDAC的电容值配置成任意值N*CDACa，其中，N为大于等于1的正整数。
在校准所述CDAC的过程中，选取两个CDAC，分别为CDAC1a和CDAC1b，其值分别为N*CDACa和M*CDACa，可以得到两个频率值F1a和F1b。
由此，可以获取F1a和F1b分别对应的负载电容CL1a和CL1b。
同时可以获取所述CDAC的最小调整量CDACa的值：
所述CDAC的等效电容即为N*CDACa，当N为1时，其值最小，即为CDACa，此时，第一负载电容即为CDACa，即所述第一负载电容由上式决定。
在实际设计中，为了减轻计算负担，同时为了在实际工作中能够更好的对CAFC进行调整。因此，在本发明实施例中，将CDAC和CAFC与DCXO的输出频偏之间的关系均设计为线性关系
在步骤S2中，确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容。
所述CFAC与DCXO的输出频率之间的关系也可以为线性关系或者为非线性关系。在本发明实施例中，所述CFAC与DCXO的输出频率之间为线性关系。确定CFAC与DCXO的输出频率之间的关系的步骤包括：固定一CDAC值，在固定的CDAC值下，获取所述CFAC的一个值CFAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC1；再获取所述CFAC的又一值CFAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC2；根据CFAC1、CFAC2、FCFAC1以及FCFAC2获取所述CFAC与所述DCXO的输出频率之间的线性关系。
然后，从给定的多个CFAC值中选取其中的最小值，根据CFAC与DCXO的输出频率之间的线性关系获取CFAC为该最小值时DCXO的输出频率，然后再根据该输出频率获取此时(CFAC为该最小值时)DCXO的负载电容，该负载电容即为所述第二负载电容。
所述第二负载电容由以下公式获得：
其中，CL2表示第二负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F2表示所述CFAC最小时对应的DCXO的输出频率。
在步骤S3中，根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容。
具体的，所述DCXO的最小负载电容由以下公式获得：
CLMIN＝CL1+CL2-CL， (式3)
其中，CLMIN表示所述最小负载电容；CL1表示所述第一负载电容；CL2表示第二负载电容；CL表示所述终端工作需要的负载电容。
在步骤S4中，根据所述DCXO的最小负载电容获取与该最小负载电容对应的第一频偏。
所述第一频偏由以下公式获得：
其中，F1为所述第一频偏；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；CLMIN表示所述最小负载电容。
至此，获得所述DCXO在其负载电容为最小值时的频偏，即，在睡眠状态下，所述DCXO的负载电容最小时的频偏。利用所述第一频偏对所述终端的慢时钟进行频偏补偿，即可提高所述终端在睡眠状态下的慢时钟的精度。
在考虑负载电容对所述DCXO的输出频率的影响的同时，还需要考虑到温度对所述DCXO的输出频率的影响。即还需要获得当前温度下所述DCXO的第二频偏。
在步骤S4中，获取当前温度下所述DCXO的第二频偏。
所述第二频偏由以下公式获得：
F2＝M3(t-t0)3+M2(t-t0)2+M1(t-t0)+M0， (式5)
其中，F2表示第二频偏，M3、M2、M1以及M0表示所述DCXO的温度参数；t表示当前温度；t0表示基准温度。
在步骤S5中，根据所述第一频偏和第二频偏获取所述DCXO调整后的频偏。
所述DCXO调整后的频偏由以下公式获得：
FL＝F1+F2， (式6)
其中，FL为当前温度下所述DCXO调整后的频偏；F1为第一频偏；F2为第二频偏。
至此，分别获取所述DCXO在其最小负载电容下的第一频偏，以及其在当前温度下的第二频偏，既考虑了降低负载对所述DCXO的输出频率的影响，也考虑到了温度对所述DCXO的输出频率的影响，综合考虑降低负载和温度因素，获得所述DCXO调整后的频偏，以便所述终端在睡眠唤醒时能够快速的获得精确时钟。
在本发明实施例中，还提供了一种终端，如图3所示，图3为本发明实施例中终端的结构示意图。所述终端包括用于产生基准时钟的数字补偿晶体振荡器DCXO，还包括一第一调频单元、一第二调频单元以及一处理单元。所述第一调频单元用于获取所述DCXO的最小负载电容，根据所述最小负载电容获取与其对应的第一频偏，所述第二调频单元用于获取当前温度下所述DCXO的第二频偏，所述处理单元用于根据所述第一频偏和第二频偏获取所述DCXO调整后的频偏。
具体的，所述第一频偏由上述(式4)获得，所述第二频偏由上述(式5)获得，所述DCXO调整后的频偏由上述(式6)获得。
综上，在本发明实施例提供的终端及其慢时钟频偏的调整方法中，获得所述DCXO在其负载电容为最小值时的频偏，即，在睡眠状态下，所述DCXO的负载电容最小时的频偏。利用所述第一频偏对所述终端的慢时钟进行频偏补偿，即可提高所述终端在睡眠状态下的慢时钟的精度。
上述仅为本发明的优选实施例而已，并不对本发明起到任何限制作用。任何所属技术领域的技术人员，在不脱离本发明的技术方案的范围内，对本发明揭露的技术方案和技术内容做任何形式的等同替换或修改等变动，均属未脱离本发明的技术方案的内容，仍属于本发明的保护范围之内。
Claims (15)
1.一种终端的慢时钟频偏的调整方法，所述终端包括用于产生基准时钟的数字补偿晶体振荡器DCXO，其特征在于，所述方法包括：
确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；
确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；
根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容；
根据所述最小负载电容获取与其对应的第一频偏；
获取当前温度下所述DCXO的第二频偏，所述DCXO调整后的频偏由以下公式获得：
FL＝F1+F2，
其中，FL为当前温度下所述DCXO调整后的频偏；F1为第一频偏；F2为第二频偏；所述第二频偏由以下公式获得：
F2＝M3(t-t0)3+M2(t-t0)2+M1(t-t0)+M0，
其中，M3、M2、M1以及M0表示所述DCXO的温度参数；t表示当前温度；t0表示基准温度。
2.如权利要求1所述的终端的慢时钟频偏的调整方法，其特征在于，确定CDAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CDAC的第一值CDAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；
再获取所述CDAC的又一值CDAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；
根据CDAC1、CDAC2、FCDAC1以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的关系。
3.如权利要求1所述的终端的慢时钟频偏的调整方法，其特征在于，确定CFAC与DCXO的输出频率之间的关系的步骤包括：
固定一CDAC值；
获取所述CFAC的第一值CFAC1，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC1；
再获取所述CFAC的又一值CFAC2，控制所述终端进入发射状态，获取此时所述DCXO的输出频率FCFAC2；
根据CFAC1、CFAC2、FCFAC1以及FCFAC2获取所述CFAC与所述DCXO的输出频率之间的关系。
4.如权利要求1所述的终端的慢时钟频偏的调整方法，其特征在于，所述第一负载电容由以下公式获得：
其中，CL1表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F1表示所述CDAC最小时对应的DCXO的输出频率。
5.如权利要求1所述的终端的慢时钟频偏的调整方法，其特征在于，所述第二负载电容由以下公式获得：
其中，CL2表示第二负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F2表示所述CFAC最小时对应的DCXO的输出频率。
6.如权利要求1所述的终端的慢时钟频偏的调整方法，其特征在于，所述最小负载电容由以下公式获得：
CLMIN＝CL1+CL2-CL，
其中，CLMIN表示所述最小负载电容；CL1表示所述第一负载电容；CL2表示第二负载电容；CL表示所述终端工作需要的负载电容。
7.如权利要求6所述的终端的慢时钟频偏的调整方法，其特征在于，所述第一频偏由以下公式获得：
其中，F1为所述第一频偏；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；CLMIN表示所述最小负载电容。
8.一种移动终端，包括用于产生基准时钟的数字补偿晶体振荡器DCXO，其特征在于，还包括：
第一调频单元，用于获取所述DCXO的最小负载电容，根据所述最小负载电容获取与其对应的第一频偏；
第二调频单元，用于获取当前温度下所述DCXO的第二频偏，所述第二频偏由以下公式获得：
F2＝M3(t-t0)3+M2(t-t0)2+M1(t-t0)+M0，
其中，F2表示第二频偏，M3、M2、M1以及M0表示所述DCXO的温度参数；t表示当前温度；t0表示基准温度；
一处理单元，用于根据所述第一频偏和所述第二频偏获取当前温度下所述DCXO调整后的频偏，并由以下公式获得：
FL＝F1+F2，
其中，FL为当前温度下所述DCXO调整后的频偏；F1为第一频偏。
9.如权利要求8所述的移动终端，其特征在于，所述第一调频单元获取DCXO的最小负载电容的步骤包括：
确定CDAC与DCXO的输出频率之间的关系，并获取所述CDAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第一负载电容，所述CDAC为DCXO的工作电路的粗调电容；
确定CFAC与DCXO的输出频率之间的关系，并获取所述CFAC最小时对应的DCXO的输出频率，进而获取此时所述DCXO的第二负载电容，所述CFAC为DCXO的工作电路的精调电容；
根据所述第一负载电容和第二负载电容获取所述DCXO的最小负载电容。
10.如权利要求9所述的移动终端，其特征在于，确定CDAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CDAC的中间值CDAC1，控制所述移动终端进入发射状态，获取此时所述DCXO的输出频率FCDAC1；
再获取所述CDAC的任意值CDAC2，控制所述移动终端进入发射状态，获取此时所述DCXO的输出频率FCDAC2；
根据CDAC1、CDAC2、FCDAC1以及FCDAC2获取所述CDAC与所述DCXO的输出频率之间的关系。
11.如权利要求9所述的移动终端，其特征在于，确定CFAC与DCXO的输出频率之间的关系的步骤包括：
获取所述CFAC的中间值CFAC1，控制所述移动终端进入发射状态，获取此时所述DCXO的输出频率FCFAC1；
再获取所述CFAC的任意值CFAC2，控制所述移动终端进入发射状态，获取此时所述DCXO的输出频率FCFAC2；
根据CFAC1、CFAC2、FCFAC1以及FCFAC2获取所述CFAC与所述DCXO的输出频率之间的关系。
12.如权利要求9所述的移动终端，其特征在于，所述第一负载电容由以下公式获得：
其中，CL1表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F1表示所述CDAC最小时对应的DCXO的输出频率。
13.如权利要求9所述的移动终端，其特征在于，所述第二负载电容由以下公式获得：
其中，CL2表示第一负载电容；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；F2表示所述CFAC最小时对应的DCXO的输出频率。
14.如权利要求9所述的移动终端，其特征在于，所述最小负载电容由以下公式获得：
CLMIN＝CL1+CL2-CL，
其中，CLMIN表示所述最小负载电容；CL1表示所述第一负载电容；CL2表示第二负载电容；CL表示所述移动终端工作需要的负载电容。
15.如权利要求14所述的移动终端，其特征在于，所述第一频偏由以下公式获得：
其中，F1为所述第一频偏；C1表示所述DCXO的等效电路中的动态电容；C0表示所述DCXO的等效电路中的静态电容；L1表示所述DCXO的等效电路中的动态电感；CLMIN表示所述最小负载电容。
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