CN107851010A - 针对宽数据元素使用寄存器对的具有偶数元素和奇数元素运算的混合宽度simd运算 - Google Patents
针对宽数据元素使用寄存器对的具有偶数元素和奇数元素运算的混合宽度simd运算 Download PDFInfo
- Publication number
- CN107851010A CN107851010A CN201680041468.2A CN201680041468A CN107851010A CN 107851010 A CN107851010 A CN 107851010A CN 201680041468 A CN201680041468 A CN 201680041468A CN 107851010 A CN107851010 A CN 107851010A
- Authority
- CN
- China
- Prior art keywords
- data element
- simd
- source data
- register
- source
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000013598 vector Substances 0.000 claims abstract description 163
- 238000000034 method Methods 0.000 claims abstract description 45
- 230000006870 function Effects 0.000 claims description 19
- 238000004364 calculation method Methods 0.000 claims description 4
- 230000009471 action Effects 0.000 description 4
- 238000004422 calculation algorithm Methods 0.000 description 4
- 230000006399 behavior Effects 0.000 description 3
- RAQQRQCODVNJCK-JLHYYAGUSA-N N-[(4-amino-2-methylpyrimidin-5-yl)methyl]-N-[(E)-5-hydroxy-3-(2-hydroxyethyldisulfanyl)pent-2-en-2-yl]formamide Chemical compound C\C(N(Cc1cnc(C)nc1N)C=O)=C(\CCO)SSCCO RAQQRQCODVNJCK-JLHYYAGUSA-N 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 238000005192 partition Methods 0.000 description 2
- 230000008569 process Effects 0.000 description 2
- 238000012545 processing Methods 0.000 description 2
- 241001269238 Data Species 0.000 description 1
- 230000008901 benefit Effects 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 239000004744 fabric Substances 0.000 description 1
- 230000002349 favourable effect Effects 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 239000006249 magnetic particle Substances 0.000 description 1
- 238000013507 mapping Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000005381 potential energy Methods 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 238000011144 upstream manufacturing Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
- G06F9/3001—Arithmetic instructions
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
- G06F9/30032—Movement instructions, e.g. MOVE, SHIFT, ROTATE, SHUFFLE
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
- G06F9/30036—Instructions to perform operations on packed data, e.g. vector, tile or matrix operations
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
- G06F9/30105—Register structure
- G06F9/30109—Register structure having multiple operands in a single register
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3885—Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units
- G06F9/3887—Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by a single instruction for multiple data lanes [SIMD]
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/76—Architectures of general purpose stored program computers
- G06F15/80—Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors
- G06F15/8007—Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors single instruction multiple data [SIMD] multiprocessors
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/76—Architectures of general purpose stored program computers
- G06F15/80—Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors
- G06F15/8053—Vector processors
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
- G06F9/30105—Register structure
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
- G06F9/30105—Register structure
- G06F9/30112—Register structure comprising data of variable length
Landscapes
- Engineering & Computer Science (AREA)
- Software Systems (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- Mathematical Physics (AREA)
- Computational Mathematics (AREA)
- Mathematical Optimization (AREA)
- Pure & Applied Mathematics (AREA)
- Mathematical Analysis (AREA)
- Advance Control (AREA)
- Executing Machine-Instructions (AREA)
- Complex Calculations (AREA)
Abstract
系统和方法涉及一种混合宽度单指令多数据SIMD指令,所述混合宽度单指令多数据指令至少具有包括第一位宽数据元素的源向量操作数以及包括第二位宽数据元素的目的地向量操作数,其中所述第二位宽是所述第一位宽的一半或两倍。对应地,所述源向量或目的地向量操作数中的一个表达为寄存器对:第一寄存器和第二寄存器。另一向量操作数表达为单个寄存器。所述第一寄存器的数据元素对应于表达为单个寄存器的另一向量操作数的偶数编号的数据元素,且所述第二寄存器的数据元素对应于表达为单个寄存器的另一向量操作数的数据元素。
Description
技术领域
本揭示的各方面涉及包括两个或多于两个向量的运算,其中至少一个向量的数据元素与至少另一向量的数据元素具有不同位宽。此类运算被称为混合宽度运算。更具体地说,一些方面涉及包括至少第一向量操作数和第二向量操作数的混合宽度单指令多数据(SIMD)运算,其中第一或第二向量操作数中的至少一个具有可存储在偶数或奇数个寄存器对中的数据元素。
背景技术
单指令多数据(SIMD)指令可用于处理系统以采用数据并行性。当需要在例如数据向量的两个或多于两个数据元素上进行相同或共同任务时存在数据并行性。可通过使用单条SIMD指令而不是使用多条指令对两个或多于两个数据元素并行地进行共同任务,所述单条SIMD指令限定有待对对应多个SIMD通道中的多个数据元素进行的相同指令。
SIMD指令可包含一或多个向量操作数,例如源向量操作数和目的地向量操作数。每个向量操作数将包含两个或多于两个数据元素。对于SIMD指令,属于相同向量操作数的所有数据元素可大体上具有相同位宽。然而,一些SIMD指令可指定混合宽度操作数,其中第一向量操作数的数据元素可具有第一位宽且第二向量操作数的数据元素可具有第二位宽,其中第一和第二位宽彼此不同。具有混合宽度操作数的SIMD指令的执行可包括若干挑战。
图1A到C示出包括在用于执行具有混合宽度操作数的SIMD指令的常规实施方案中的挑战的实例。参考图1A,示出用于执行SIMD指令100的第一常规实施方案。假定SIMD指令100可由支持64位指令集体系结构(ISA)的常规处理器(未示出)执行。这意味着例如SIMD指令100等指令可指定具有高达64位位宽的操作数。可就64位寄存器或32位寄存器对来指定64位操作数。
SIMD指令100的目标是对源操作数102的每个数据元素执行相同指令。源操作数102是包括标记为0到7的八个8位数据元素的64位向量。源操作数102可存储在单个64位寄存器或32位寄存器对中。有待对八个数据元素0到7中的每一个执行的相同指令或共同运算可例如是乘法、平方函数、左移位函数、增量函数、加法(例如,根据指令中的一常数值或立即数字段或根据由另一向量操作数提供的值)等,所述相同指令或共同运算的结果针对八个所得数据元素中的每一个可消耗多于8位且高达16位存储容量。这意味着SIMD指令100的结果可消耗源操作数102可消耗的存储空间两倍的存储空间,即,两个64位寄存器或两个32位寄存器对。
由于被配置成实施SIMD指令100的常规处理器并不包含指定大于64位位宽的操作数的指令,因此SIMD指令100可分成两个分量SIMD指令:100X和100Y。SIMD指令100X指定有待对标记有源操作数102的偶数(或“偶数编号的数据元素”)0、2、4和6的数据元素进行的共同运算。SIMD指令100X指定目的地操作数104x,所述目的地操作数104x的宽度是64位且包含标记为A、C、E和G的16位数据元素,其中的每一个包括高(H)8位和低(L)8位。对源操作数102的偶数编号的8位数据元素0、2、4和6的共同运算的结果对应地写入目到的地操作数104x的16位数据元素A、C、E和G。SIMD指令100Y类似于SIMD指令100X,其中的区别在于,SIMD指令100Y指定对标记有源操作数102的奇数(或“奇数编号的数据元素”)1、3、5和7的数据元素的共同运算,同时结果有待写入到目的地操作数104y的16位数据元素B、D、F、H,所述目的地操作数104y还是类似于SIMD指令100X的目的地操作数104x的64位操作数。以此方式,SIMD指令100X和100Y中的每一个可指定一个64位目的地操作数,且SIMD指令100X和100Y可一起实现对源操作数102的数据元素0到7中的每一个的共同运算的执行。然而,由于需要实施的两条单独指令,因此SIMD指令100增加了代码空间。
图1B示出使用分量SIMD指令120X和120Y的不同集合的SIMD指令100的第二常规实施方案。SIMD指令120X和120Y各自指定对源操作数102的8位数据元素0到7中的每一个的共同运算。SIMD指令120X将目的地操作数124x(低(L)8位结果有待写入到所述目的地操作数124x)指定为目的地操作数124x的对应8位结果数据元素A到H(同时丢弃结果的高(H)8位)。类似地,指令120Y将目的地操作数124y(高(H)8位结果有待写入到所述目的地操作数124y)指定为目的地操作数124y的对应8位数据元素A到H(同时丢弃结果的低(L)8位)。SIMD指令100的此第二常规实施方案的不足之处还在于针对两个分量SIMD指令120X和120Y增加的代码空间。此外,如可理解的,第二常规实施方案还引发针对源操作数102的数据元素0到7中的每一个计算和丢弃高(H)8位(例如,在执行指令120X时)或低(L)8位(例如,在执行指令120Y时)时的功率损耗。
图1C示出使用分量SIMD指令140X和140Y的又一集合的SIMD指令100的第三常规实施方案,所述分量SIMD指令140X和140Y在某些方面类似于图1A的SIMD指令100X和100Y。区别在于每条SIMD指令对源操作数102的数据元素中的哪些数据元素进行运算。更详细地,SIMD指令140X指定有待对源操作数102的下游四个数据元素0到3而不是偶数编号的8位数据元素进行的共同运算。结果写入到目的地操作数144x的16位数据元素A、B、C、D。然而,SIMD指令140X的执行包括将对下游四个8位数据元素(生成32位)的运算结果跨目的地操作数140X的所有64位扩散出去。SIMD指令144y是类似的且指定将对源操作数102的上游四个8位数据元素4到7的运算结果跨64位目的地操作数144y的16位数据元素E、F、G、H扩散出去。除了如第一和第二常规实施方案中增加的代码大小外,如第三常规实施方案中所见的这些扩散出去的数据移动可能需要例如交叉开关等额外硬件。
因此,需要一种避开常规实施方案的以上提及的缺点的混合宽度SIMD指令的改进的实施方案。
发明内容
示范性方面包含关于混合宽度单指令多数据(SIMD)指令的系统和方法,所述混合宽度单指令多数据指令具有包括第一位宽数据元素的至少源向量操作数以及包括第二位宽数据元素的目的地向量操作数,其中所述第二位宽是所述第一位宽的一半或两倍。对应地,源向量操作数或目的地向量操作数中的一个表达为寄存器对:第一寄存器和第二寄存器。另一向量操作数表达为单个寄存器。第一寄存器的数据元素对应于表达为单个寄存器的另一向量操作数的偶数编号的数据元素,且第二寄存器的数据元素对应于表达为单个寄存器的另一向量操作数的数据元素。
举例来说,示范性方面涉及进行混合宽度单指令多数据(SIMD)运算的方法,所述方法包括:由处理器接收SIMD指令,所述SIMD指令包括:包括第一位宽源数据元素的第一集合的至少第一源向量操作数以及包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的两倍。目的地向量操作数包括寄存器对,所述寄存器对包含:包括目的地数据元素的第一子集的第一寄存器以及包括目的地数据元素的第二子集的第二寄存器。基于源数据元素的第一集合的顺序次序,所述方法包含在处理器中执行SIMD指令,包括:从第一集合的偶数编号的源数据元素生成第一寄存器中的目的地数据元素的第一子集,以及从第一集合的奇数编号的源数据元素生成第二寄存器中的目的地数据元素的第二子集。
另一示范性方面涉及进行混合宽度单指令多数据(SIMD)运算的方法,所述方法包括:由处理器接收SIMD指令,所述SIMD指令包括:包括第一位宽源数据元素的至少源向量操作数以及包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的一半。源向量操作数包括寄存器对,所述寄存器对包含:包括源数据元素的第一子集的第一寄存器以及包括源数据元素的第二子集的第二寄存器。基于目的地数据元素的顺序次序,所述方法包含在处理器中执行SIMD指令,包括:从第一寄存器中的源数据元素的对应第一子集生成偶数编号的目的地数据元素,以及从第二寄存器中的源数据元素的对应第二子集生成奇数编号的目的地数据元素。
另一示范性方面涉及包括可由处理器执行的指令的非暂时性计算机可读存储媒体,所述指令在由所述处理器执行时致使处理器进行混合宽度单指令多数据(SIMD)运算。所述非暂时性计算机可读存储媒体包括SIMD指令,所述SIMD指令包括:包括第一位宽源数据元素的第一集合的至少第一源向量操作数以及包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的两倍。目的地向量操作数包括寄存器对,所述寄存器对包含:包括目的地数据元素的第一子集的第一寄存器以及包括目的地数据元素的第二子集的第二寄存器。基于源数据元素的第一集合的顺序次序,所述非暂时性计算机可读存储媒体包含:用于从第一集合的偶数编号的源数据元素生成第一寄存器中的目的地数据元素的第一子集的代码,以及从第一集合的奇数编号的源数据元素生成第二寄存器中的目的地数据元素的第二子集的代码。
又一示范性方面涉及包括可由处理器执行的指令的非暂时性计算机可读存储媒体,所述指令在由所述处理器执行时致使处理器进行混合宽度单指令多数据(SIMD)运算,所述非暂时性计算机可读存储媒体包括SIMD指令。所述SIMD指令包括:包括第一位宽源数据元素的至少源向量操作数以及包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的一半。源向量操作数包括寄存器对,所述寄存器对包含:包括源数据元素的第一子集的第一寄存器以及包括源数据元素的第二子集的第二寄存器。基于目的地数据元素的顺序次序,所述非暂时性计算机可读存储媒体包含:用于从第一寄存器中的源数据元素的对应第一子集生成偶数编号的目的地数据元素的代码,以及从在第二寄存器中的源数据元素的对应第二子集生成奇数编号的目的地数据元素的代码。
附图说明
呈现附图以辅助描述本发明的各方面且仅仅为了说明而非限制所述方面而提供附图。
图1A到C示出混合宽度SIMD指令的常规实施方案。
图2A到C示出根据本揭示的各方面的混合宽度SIMD指令的示范性实施方案。
图3A到B示出进行混合宽度单指令多数据(SIMD)运算的方法。
图4示出本揭示的一方面可有利地用于其中的示范性无线装置400。
具体实施方式
在以下针对本发明的具体方面的描述和相关图式中揭示本发明的各方面。可在不脱离本发明的范围的情况下设计替代方面。另外,将不会详细描述或将省略本发明的众所周知的元件以免混淆本发明的相关细节。
词语“示范性”在本文中用于意指“充当实例、例子或说明”。本文中描述为“示范性”的任何方面不必解释为比其它方面优选或有利。同样,术语“本发明的各方面”并不要求本发明的所有方面都包含所论述的特征、优点或操作模式。
本文中所使用的术语仅出于描述特定方面的目的,且并不打算限制本发明的各方面。如本文中所使用,单数形式“一(a/an)”和“所述”打算还包含复数形式,除非上下文另外清楚地指示。将进一步理解,术语“包括”和/或“包含”当在本文中使用时指定所叙述的特征、整数、步骤、操作、元件和/或组件的存在,但并不排除一或多个其它特征、整数、步骤、操作、元件、组件和/或其群组的存在或添加。
此外,就待由例如计算装置的元件进行的动作序列来描述许多方面。将认识到,本文中所描述的各种动作可由特定电路(例如,专用集成电路(ASIC))、由正由一或多个处理器执行的程序指令或由所述两者的组合来进行。另外,本文中所描述的这些动作序列可被视为全部在任何形式的计算机可读存储媒体内体现,在所述计算机可读存储媒体中存储有对应计算机指令集,所述计算机指令集在执行时将致使相关联的处理器进行本文中所描述的功能性。因此,本发明的各种方面可以数个不同形式来体现,预期所有形式属于所要求的主题的范围内。另外,对于本文中所描述的各方面中的每一个,任何此类方面的对应形式可在本文中描述为例如“逻辑被配置成”进行所描述动作。
本揭示的示范性方面涉及混合宽度SIMD运算的实施方案,其避免跨SIMD通道的数据移动且减小代码大小。举例来说,示范性方面包含将一或多个向量操作数指定为操作数对(其可就寄存器对来表达)的单条SIMD指令,而不是将SIMD操作分解成两条或多于两条分量SIMD指令(例如,图1A到C中的SIMD指令100的常规执行)。通过将至少一个向量操作数(源操作数或目的地操作数中的任一个)指定为寄存器对或一寄存器对,所述单条示范性SIMD指令可用于代替两条或多于两条分量常规SIMD指令。因此,代码大小减小以实现混合宽度SIMD运算。
应指出,在本揭示中,对就寄存器来表达的操作数进行引用以便遵循惯例的指令格式,其中指令指定有待在一或多个寄存器上进行的运算。因此,SIMD指令可具有一定格式,其中对就寄存器来表达的一或多个操作数指定共同运算。因此,根据本揭示的示范性混合宽度SIMD指令包含就单个寄存器来表达的至少一个向量操作数和就寄存器对来表达的至少另一向量操作数。对寄存器的这些引用可涉及由包括示范性SIMD指令的程序使用的逻辑或体系结构寄存器。对寄存器的这些引用还可非限制地涉及物理寄存器堆的物理寄存器。大体上,对寄存器的引用意指传达某一大小的存储元件。
因此,在耦合到寄存器堆的处理器中执行混合宽度单指令多数据(SIMD)运算的示范性方法可包括指定具有包括第一位宽数据元素的至少第一向量操作数以及包括第二位宽数据元素的至少第二向量操作数的SIMD指令。第一向量操作数可以是源向量操作数且第二向量操作数可以是目的地向量操作数。对应地,源向量操作数的数据元素可被称为源数据元素且目的地向量操作数的数据元素可被称为目的地数据元素。
一一对应存在于示范性混合宽度SIMD指令中的源数据元素与目的地数据元素之间。大体上,当对源数据元素进行混合宽度SIMD指令中指定的运算时,生成具体的对应目的地数据元素。举例来说,考虑到混合宽度SIMD运算以使源向量操作数左移位,从而形成目的地向量操作数。在此实例中,当进行源数据元素的左移位时,每个源数据元素生成具体目的地数据元素。
在本揭示的一个示范性方面中,目的地数据元素的第二位宽可小于源数据元素的第一位宽的大小,且具体地说是后者的一半。在此方面中,目的地向量操作数可表达为一对寄存器且源向量操作数可表示为单个寄存器。
在本揭示的另一示范性方面中,目的地数据元素的第二位宽可大于源数据元素的第一位宽的大小,且具体地说是后者的两倍。在此方面中,源向量操作数可表达为单个寄存器且目的地向量操作数可表达为寄存器对。
为了示出源向量操作数和目的地向量操作数各自的源向量数据元素与向量数据元素之间的具体映射,对向量操作数的数据元素(其数据源数据具有更小位宽)分配顺序次序。举例来说,对表达为单个寄存器的向量操作数的数据元素分配顺序次序。基于顺序次序,对表达为单个寄存器的向量操作数标识偶数编号的数据元素(例如,对应于编号0、2、4、6等)和奇数编号的数据元素(例如,对应于编号1、3、5、7等)。另一向量操作数的寄存器对被称为第一寄存器和第二寄存器,所述第一寄存器和第二寄存器各自包括数据元素的第一子集和第二子集。因此,表达为单个寄存器的向量操作数的偶数编号的数据元素接着分配有与第一子集或第一寄存器的数据元素的对应关系,且奇数编号的数据元素分配有与第二子集或第二寄存器的数据元素的对应关系。以此方式,避免了源数据元素在执行指定SIMD运算以生成对应目的地数据元素期间跨SIMD通道的大的数据移动。
示范性方面还可涉及指定多于两个向量操作数(例如包含第三位宽的第三操作数及超过)的SIMD运算。揭示其中两个源向量操作数的一个实例,对混合宽度SIMD指令指定表达为单个寄存器的每个源向量操作数以生成表达为寄存器对的目的地向量操作数。众多其它此类指令格式在本揭示的范围内是可能的。为简单起见,将关于操作数的一些实例SIMD指令和位宽描述用于实施混合宽度SIMD运算的示范性方面,同时记住这些仅仅是为了解释起见。由此,本文中所论述的特征可扩展到数据元素的任何数目的操作数和位宽以实现混合宽度向量运算。
在图2A到C中,示出关于SIMD指令200、220和240的示范性方面。这些SIMD指令200、220和240中的每一个可由被配置成执行SIMD指令的处理器(例如,图4到5中所示出的处理器402)执行。更具体地说,这些SIMD指令200、220和240中的每一个可指定一或多个源向量操作数和一或多个目的地向量操作数,其中所述源向量操作数和目的地向量操作数可就寄存器(例如,64位寄存器)来表达。SIMD指令200、220和240的源向量操作数和目的地向量操作数包含对应源数据元素和目的地数据元素,其中的每一个落在一或多个SIMD通道下。执行SIMD指令时SIMD通道的数目对应于执行SIMD指令时进行的并行运算的数目。被配置成实施实例SIMD指令200、220和240的处理器或执行逻辑可因此包含实施由SIMD指令200、220和240指定的并行运算所需的硬件(例如,包括多个左/右移位器、加法器、乘法器等的算术和逻辑单元(ALU))。
因此,参考图2A,示出SIMD指令200的执行的第一示范性方面。在一个实例中,采用处理器以能够支持64位指令集体系结构(ISA)。SIMD指令200可指定有待对就单个64位寄存器来表达的源向量操作数的源数据元素进行的相同运算或共同指令。
SIMD指令200中指定的相同运算或共同指令可以是例如根据一常数值等对八个8位源数据元素的平方函数、左移位函数、增量函数、加法(其可运用例如八个8位左移位器、八个8位加法器等逻辑元件实施),所述相同运算或共同指令产生可消耗高达16位存储容量的对应八个所得目的地数据元素。如所示出,SIMD指令200可指定包括八个8位数据元素的源向量操作数202。可对源向量操作数202的这八个8位数据元素分配数字次序,所述八个8位数据元素由附图标记0到7示出。可使用八个16位目的地数据元素或总共128位来表达SIMD指令200的无法存储在单个64位寄存器中的结果。将目的地向量操作数指定为分量向量操作数对,而不是将SIMD指令200分解成两条或多于两条指令以处置此问题(例如,如图1A到C中所示出的SIMD指令100的常规实施方案中那样)。分量目的地向量操作数对可表达为对应寄存器204x、204y对。应指出,寄存器对无需存储在寄存器堆中的连续物理位置中或甚至具有连续逻辑寄存器编号。由此,SIMD指令200指定就分量向量操作数或寄存器204x、204y对(例如,64位寄存器对)来表达的目的地向量操作数,以及表达为单个寄存器202的源向量操作数202。
此外,表达为所述对的第一寄存器204x的第一分量目的地向量操作数包含SIMD指令200的对源向量操作数202的偶数编号的源数据元素0、2、4和6进行的结果的第一子集。这些结果由目的地数据元素A、C、E和G示出,所述目的地数据元素A、C、E和G与偶数编号的源数据元素0、2、4和6具有一一对应关系,这意味着由于目的地数据元素A、C、E和G的此示范性布置中的结果而避免了跨SIMD通道的大的移动。类似地,表达为所述对的第二寄存器204y的第二分量目的地向量操作数包含SIMD指令200的对源向量操作数202的奇数编号的源数据元素1、3、5和7进行的结果的第二子集。这些结果由目的地数据元素B、D、F和H示出,所述目的地数据元素B、D、F和H与奇数编号的源数据元素1、3、5和7具有一一对应关系,这同样意味着由于目的地数据元素B、D、F和H的此示范性布置中的结果而避免了跨SIMD通道的大的移动。因此,在此情况下,源向量操作数202的偶数编号的源数据元素0、2、4和6对应于或生成第一寄存器204x的目的地数据元素A、C、E和G;且源向量操作数202的奇数编号的源数据元素1、3、5和7对应于或生成第二寄存器204y的目的地数据元素B、D、F和H。
考虑到八个8位SIMD通道(例如,被称为SIMD通道0到7),其中每个通道包括相应源数据元素0到7,看出生成对应目的地数据元素A到H所包括的移动量包含在相同SIMD通道或邻近SIMD通道内。换句话说,源数据元素的第一集合(例如,源数据元素0到7)是在相应SIMD通道中,且从源数据元素中的每一个在相应SIMD通道或邻近于相应SIMD通道的SIMD通道中生成目的地数据元素(例如,对应目的地数据元素A到H)。举例来说,各自在SIMD通道0、2、4和6中的偶数编号的源数据元素0、2、4和6生成目的地数据元素A、C、E、和G,所述目的地数据元素A、C、E、和G各自包含在SIMD通道0到1、2到3、4到5和6到7内。类似地,各自在SIMD通道0、2、4和6中的奇数编号的源数据元素1、3、5和7生成目的地数据元素B、D、F和H,所述目的地数据元素B、D、F和H也各自包含在SIMD通道0到1、2到3、4到5和6到7内。
因此,在图2A的第一示范性方面中,混合宽度SIMD指令200包括指令空间或代码空间的有效使用(由于仅使用一条SIMD指令而不是两条或多于两条分量SIMD指令),其实施或执行避免了跨SIMD通道的大的数据移动。
现在参考图2B,关于混合宽度SIMD指令220示出另一示范性方面。SIMD指令220包括两个源向量操作数:表达为单个寄存器222的第一源向量操作数和表达为单个寄存器223的第二源向量操作数,其各自具有四个16位源数据元素的第一集合和第二集合。SIMD指令220可指定对两个源向量操作数的例如乘法等相同或共同运算(例如,运用四舍五入),其中第一集合的四个16位源数据元素(在寄存器222中)乘以第二集合的对应四个16位源数据元素(在寄存器223中)以产生四个32位结果(其中SIMD指令220的实施方案可包括例如四个16×16乘法器等逻辑元件)。由于需要128位能够存储这四个32位结果,因此就分量向量操作数对来指定目的地向量操作数:第一分量目的地向量操作数和第二分量目的地向量操作数(这些可对应地表达为第一64位寄存器224x和第二64位寄存器224y)。应指出,SIMD指令220还可适用于第一集合的源数据元素与第二集合的对应源数据元素的相加,其中对应结果可消耗每个目的地数据元素的多于16位(即使并非全是32位)。
在图2B中,第一和第二集合的源数据元素分配有顺序次序,代表性地各自示出为0、1、2、3和0'、1'、2'、3'。第一寄存器224x中的第一分量目的地向量操作数保留SIMD指令220的对应于源操作数222和223的偶数编号的源数据元素的结果的第一子集(示出为32位目的地数据元素A和C);且类似地,第二寄存器224y中的第二分量目的地向量操作数保留SIMD指令220的对应于源操作数222和223的奇数编号的源数据元素的结果的第二子集(示出为32位数据元素B和D)。在此情况下,看出第一源向量操作数222和第二源向量操作数223各自的偶数编号的源数据元素(0、0')和(2、2')生成第一目的地向量操作数224x的数据元素A和C;且第一源向量操作数222和第二源向量操作数223各自的奇数编号的数据元素(1、1')和(3、3')生成第二目的地向量操作数224y的数据元素B和D。
同样,在图2B的第二示范性方面中看出,混合宽度SIMD指令220通过利用单条混合宽度SIMD指令而不是两条或多于两条分量SIMD指令来实现代码空间效率。此外,还看出在此方面中也最小化了跨SIMD通道的移动。大体上,源数据元素的第一集合和源数据元素的第二集合在相应SIMD通道中,且从第一集合的源数据元素中的每一个和第二集合的源数据元素中的对应一个在相应SIMD通道或邻近于相应SIMD通道的SIMD通道中生成目的地数据元素。举例来说,考虑到各自包括源数据元素的第一集合0到3(或源数据元素的第二集合0'到3')的四个16位SIMD通道0到3,第一和第二的源数据元素的用以生成对应目的地数据元素A到D的数据移动包含在相同SIMD通道且最多邻近SIMD通道内(例如,各自在SIMD通道0和2中的偶数编号的源数据元素(0、0')和(2、2')在SIMD通道0到1和2到4中生成目的地数据元素A和C;且类似地,各自在SIMD通道1和3中的奇数编号的源数据元素(1、1')和(3、3')在SIMD通道0到1和2到4中生成目的地数据元素B和D)。
图2C表示关于混合宽度SIMD指令240的第三示范性方面。不同于混合宽度SIMD指令200和220,混合宽度SIMD指令240的源向量操作数被指定为分量向量操作数对或表达为一寄存器对。应指出,混合宽度SIMD指令240不同于混合宽度SIMD指令220,原因是混合宽度SIMD指令220包含两个单独源向量操作数,其中一个源向量操作数的数据元素被指定为与另一源向量操作数的数据元素交互(例如,相乘)。另一方面,在混合宽度SIMD指令240中,指定分量源向量操作数对,原因是如果不这样做将会消耗两条单独指令。举例来说,SIMD指令240可包括有待对八个16位源数据元素进行的从16位到8位的右移位函数的共同运算以便获得八个8位目的地数据元素的结果(其中SIMD指令240的实施方案可包括例如八个8位右移位器等逻辑元件)。然而,由于八个16位源数据元素消耗128位,因此常规实施方案将使用两条分量SIMD指令分离有待进行的此运算。另一方面,在图2C的示范性方面中,包括第一寄存器242x中的第一分量源向量操作数和第二寄存器242y中的第二分量源向量操作数的源向量操作数对由SIMD指令240指定。因此,代码空间得以有效地使用。
目的地向量操作数在此情况下表达为单个64位寄存器244且包括是SIMD指令240的结果的八个8位目的地数据元素。因此,对寄存器244中的目的地向量操作数的目的地数据元素分配顺序次序,所述目的地数据元素由附图标记0到7示出。分量源向量操作数对(表达为寄存器对242x、242y)的源数据元素被布置成使得包括源数据元素的第一子集A、C、E和G的第一寄存器242x将生成各自对应于寄存器244中的目的地向量操作数的偶数编号的目的地数据元素0、2、4和6的结果;且包括源数据元素的第二子集B、D、F和H的第二寄存器242y将生成各自对应于寄存器244中的目的地向量操作数的奇数编号的目的地数据元素1、3、5和7的结果。
因此,通过指定分量源向量操作数对或将源向量操作数表达为寄存器对,可有效地利用代码空间且可最小化跨SIMD通道的数据移动,即使在源向量操作数比目的地向量操作数更宽的情况下也同样如此。还最小化了在执行SIMD指令240时跨SIMD通道的移动。大体上,看出目的地数据元素是在相应SIMD通道中,且从源数据元素在相应SIMD通道或邻近于相应SIMD通道的SIMD通道中生成目的地数据元素中的每一个。举例来说,考虑到八个8位SIMD通道对应于八个目的地数据元素0到7,看出源数据元素A、C、E和G将各自从通道0到1、2到3、4到5和6到7移动以生成对应于SIMD通道中的偶数编号的目的地数据元素0、2、4和6的结果;且源数据元素B、D、F和H将各自从SIMD通道0到1、2到3、4到5和6到7移动以生成对应于SIMD通道中的偶数编号的目的地数据元素1、3、5和7的结果。在任一情况下,移动包含在两个SIMD通道内。
因此,应了解,各方面包含用于进行本文中所揭示的过程、功能和/或算法的各种方法。举例来说,如图3A中所示出,一方面可包含例如根据图2A到B的进行混合宽度单指令多数据(SIMD)运算的方法300。
在块302中,方法300包含由处理器(例如,图4的处理器402,其将在下文解释)且例如参考图2A接收SIMD指令(例如,SIMD指令200),所述SIMD指令包括:包括第一位宽(例如,8位)源数据元素的第一集合(例如,源数据元素0到7)的至少第一源向量操作数(在寄存器202中);以及包括第二位宽(例如,16位)目的地数据元素(例如,目的地数据元素A到H)的至少目的地向量操作数(例如,在寄存器对204x、204y中),其中所述第二位宽是所述第一位宽的两倍,其中所述目的地向量操作数包括寄存器对,所述寄存器对包含:包括目的地数据元素的第一子集(例如,目的地数据元素A、C、E、G)的第一寄存器(例如,204x)以及包括目的地数据元素的第二子集(例如,目的地数据元素B、D、F、H)的第二寄存器。
在块303(其示出包含块304和306)中,方法300进一步包含在处理器中执行混合宽度SIMD指令。具体地说,考虑到在块304中对源数据元素分配的顺序次序(例如,0到7),块306包含在处理器中执行SIMD指令。进一步详细地,块306由可并行进行的分量块306a和306b组成。
块306a包含从第一集合的偶数编号的源数据元素(例如,源数据元素0、2、4、6)生成第一寄存器(例如,第一寄存器204x)中的目的地数据元素的第一子集(例如,目的地数据元素A、C、E、G)。
块306b包含从第一集合的奇数编号的源数据元素(例如,源数据元素1、3、5、7)生成第二寄存器(例如,第二寄存器204y)中的目的地数据元素的第二子集(例如,目的地数据元素B、D、F、H)。
大体上,方法300的SIMD指令可以是第一集合的源数据元素根据一常数值的平方函数、左移位函数、递增或加法中的一个。在方法300中通过利用单条SIMD指令来实现代码空间效率。在方法300中还最小化了跨SIMD通道的移动,其中源数据元素的第一集合是在相应SIMD通道中,且方法300包含从源数据元素中的每一个(例如,SIMD通道0中的源数据元素0)在相应SIMD通道(例如,SIMD通道0)或邻近于相应SIMD通道的SIMD通道(例如,SIMD通道1)中生成目的地数据元素(例如,目的地数据元素A)。
还将指出,尽管未单独示出,但方法300还可包含用于实施图2B的SIMD指令220的方法,所述方法进一步包括例如在块302中接收第二源向量操作数,所述第二源向量操作数包括第一位宽源数据元素的第二集合(例如,寄存器222和223中的第一和第二源向量操作数),且源数据元素的第一集合的顺序次序对应于源数据元素的第二集合的顺序次序。在此情况下,基于块304中所分配的顺序次序,块306包含在处理器中执行SIMD指令,所述块306包括:块306a,其用于从第一集合的偶数编号的源数据元素和第二集合的偶数编号的源数据元素生成第一寄存器中的目的地数据元素的第一子集;以及块306b,其用于从第一集合的奇数编号的源数据元素和第二集合的偶数编号的源数据元素生成第二寄存器中的目的地数据元素的第二子集。在此情况下,SIMD指令可以是第一集合的源数据元素与第二集合的对应源数据元素的相乘或相加,其中所述源数据元素的第一集合和源数据元素的第二集合是在相应SIMD通道中,且从第一集合的源数据元素中的每一个和第二集合的源数据元素中的对应一个在相应SIMD通道或邻近于相应SIMD通道的SIMD通道中生成目的地数据元素。
参考图3B,示出用于进行本文中所揭示的过程、功能和/或算法的另一方法。举例来说,如图3B中所示出,方法300包含例如根据图2C的进行混合宽度单指令多数据(SIMD)运算的另一方法。
在块352中,方法350包含由处理器(例如,处理器402)接收SIMD指令(例如,SIMD指令240),所述SIMD指令包括:包括第一位宽(例如,16位)源数据元素(例如,源数据元素A到H)的至少源向量操作数(例如,在寄存器242x、242y中);以及包括第二位宽(例如,8位)目的地数据元素(例如,目的地数据元素0到7)的至少目的地向量操作数(例如,在寄存器244中),其中所述第二位宽是所述第一位宽的一半,其中所述源向量操作数包括寄存器对,所述寄存器对包含:包括源数据元素的第一子集(例如,目的地数据元素0、2、4、6)的第一寄存器(例如,第一寄存器242x)以及包括源数据元素的第二子集(例如,目的地数据元素1、3、5、7)的第二寄存器(例如,第二寄存器242y)。
在块354中,对目的地数据元素分配顺序次序,且在块356中执行SIMD指令。块356包含也可并行进行的子块356a和356b。
块356a包含从第一寄存器中的源数据元素的对应第一子集(例如,源数据元素A、C、E、G)生成偶数编号的目的地数据元素(例如,目的地数据元素0、2、4、6)。
块356b包含从第二寄存器中的源数据元素的对应第二子集(例如,源数据元素B、D、F、H)生成奇数编号的目的地数据元素(例如,目的地数据元素1、3、5、7)。
在示范性方面中,方法350的SIMD指令可以是源数据元素的右移位函数,其中目的地数据元素是在相应SIMD通道(例如,SIMD通道0到7)中,且从源数据元素(例如,源数据元素A)在相应SIMD(例如,SIMD通道0)或邻近于相应SIMD通道的SIMD通道(例如,SIMD通道1)中生成目的地数据元素中的每一个(例如,目的地数据元素0)。
参考图4,根据示范性方面的无线装置400的特定说明性方面的块图。无线装置400包含处理器402,所述处理器402可被配置成(例如,包含执行逻辑)例如各自根据图3A的方法300和图3B方法350支持和实施示范性混合宽度SIMD指令的执行。如图4中所示出,处理器402可与存储器432通信。处理器402可包含寄存器堆(未示出),所述寄存器堆保持对应于寄存器(例如,逻辑寄存器)的物理寄存器,就所述物理寄存器来表达示范性SIMD指令的操作数。在一些方面中,寄存器堆可供应有来自存储器432的数据。尽管未示出,但一或多个高速缓存或其它存储器结构还可包含在无线装置400中。
图4还示出耦合到处理器402和显示器428的显示控制器426。编解码器(DODEC)434(例如,音频和/或语音CODEC)可耦合到处理器402。还示出例如无线控制器440(其可包含调制解调器)等其它组件。扬声器436和麦克风438可耦合到编解码器434。图4还指示无线控制器440可耦合到无线天线442。在特定方面中,处理器402、显示控制器426、存储器432、编解码器434和无线控制器440包含在封装内系统或芯片上系统装置422中。
在特定方面中,输入装置430和电力供应器444耦合到芯片上系统装置422。此外,在特定方面中,如图4中所示出,显示器428、输入装置430、扬声器436、麦克风438、无线天线442和电力供应器444在芯片上系统装置422的外部。然而,显示器428、输入装置430、扬声器436、麦克风438、无线天线442和电力供应器444中的每一个可耦合到芯片上系统装置422的组件(例如接口或控制器)。
应指出,尽管图4描绘无线通信装置,但处理器402和存储器432还可集成到机顶盒、音乐播放器、视频播放器、娱乐单元、导航装置、个人数字助理(PDA)、固定位置数据单元、通信装置或计算机中。此外,无线装置400的至少一或多个示范性方面可集成在至少一个半导体裸片中。
所属领域的技术人员将了解,可使用多种不同技术和技艺中的任一种来表示信息和信号。举例来说,可通过电压、电流、电磁波、磁场或磁粒子、光场或光粒子或其任何组合来表示在整个上文描述中可能参考的数据、指令、命令、信息、信号、位、码元和芯片。
此外,所属领域的技术人员将了解,结合本文中所揭示的各方面而描述的各种说明性逻辑块、模块、电路和算法步骤可实施为电子硬件、计算机软件或两者的组合。为清晰地说明硬件与软件的此可互换性,上文已大体上就其功能性来描述了各种说明性组件、块、模块、电路和步骤。此类功能性是实施为硬件还是软件取决于特定应用和强加于整个系统的设计约束。熟练的技术人员可针对每个特定应用以不同方式来实施所描述的功能性,但这样的实施决策不应被解释为会引起脱离本发明的范围。
结合本文中所揭示的方面描述的方法、序列和/或算法可直接以硬件、以由处理器执行的软件模块或以硬件和软件模块的组合来体现。软件模块可驻留在RAM存储器、快闪存储器、ROM存储器、EPROM存储器、EEPROM存储器、寄存器、硬盘、可移动磁盘、CD-ROM,或所属领域中已知的任何其它形式的存储媒体中。示范性存储媒体耦合到处理器,使得处理器可从存储媒体读取信息并将信息写入到存储媒体。在替代方案中,存储媒体可与处理器成整体。
因此,本发明的一方面可包含电脑可读媒体(例如,非暂时性计算机可读存储媒体),其体现用于实施混合宽度SIMD指令的方法(例如,根据上文所描述的方法300和350,用于实施图2A到C的SIMD指令)。因此,本发明不限于所说明的实例,且任何用于执行本文中所描述的功能性的装置包含在本发明的各方面中。
虽然前述揭示内容示出本发明的说明性方面,但应指出,在不脱离如所附权利要求书界定的本发明的范围的情况下,可在其中做出各种改变和修改。无需以任何特定次序来进行根据本文中所描述的本发明的各方面的方法权利要求的功能、步骤和/或动作。此外,尽管可以单数形式描述或主张本发明的元件,但除非明确陈述限于单数,否则也涵盖复数形式。
Claims (18)
1.一种进行混合宽度单指令多数据SIMD运算的方法,所述方法包括:
由处理器接收SIMD指令,所述SIMD指令包括:
包括第一位宽源数据元素的第一集合的至少第一源向量操作数;以及
包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的两倍,
其中所述目的地向量操作数包括寄存器对,所述寄存器对包含:包括所述目的地数据元素的第一子集的第一寄存器以及包括所述目的地数据元素的第二子集的第二寄存器;以及
基于源数据元素的所述第一集合的顺序次序,在所述处理器中执行所述SIMD指令,包括:
从所述第一集合的偶数编号的源数据元素生成所述第一寄存器中的目的地数据元素的所述第一子集;以及
从所述第一集合的奇数编号的源数据元素生成所述第二寄存器中的目的地数据元素的所述第二子集。
2.根据权利要求1所述的方法,其中所述SIMD指令是所述第一集合的所述源数据元素根据常数值的平方函数、左移位函数、递增或加法中的一个。
3.根据权利要求1所述的方法,其中源数据元素的所述第一集合是在相应SIMD通道中,且从所述源数据元素中的每一个在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成目的地数据元素。
4.根据权利要求1所述的方法,其中所述SIMD指令进一步包括:包括所述第一位宽源数据元素的第二集合的第二源向量操作数,且源数据元素的所述第一集合的所述顺序次序对应于源数据元素的所述第二集合的顺序次序,其中在所述处理器中执行所述SIMD指令包括:
从所述第一集合的偶数编号的源数据元素和所述第二集合的偶数编号的源数据元素生成所述第一寄存器中的目的地数据元素的所述第一子集;以及
从所述第一集合的奇数编号的源数据元素和所述第二集合的偶数编号的源数据元素生成所述第二寄存器中的目的地数据元素的所述第二子集。
5.根据权利要求4所述的方法,其中所述SIMD指令是所述第一集合的所述源数据元素与所述第二集合的对应源数据元素的相乘或相加。
6.根据权利要求4所述的方法,其中源数据元素的所述第一集合和源数据元素的第二集合是在相应SIMD通道中,且从所述第一集合的所述源数据元素中的每一个和所述第二集合的所述源数据元素中的对应一个在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成目的地数据元素。
7.一种进行混合宽度单指令多数据SIMD运算的方法,所述方法包括:
由处理器接收SIMD指令,所述SIMD指令包括:
包括第一位宽源数据元素的至少源向量操作数;以及
包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的一半,
其中所述源向量操作数包括寄存器对,所述寄存器对包含:包括所述源数据元素的第一子集的第一寄存器以及包括所述源数据元素的第二子集的第二寄存器;以及
基于所述目的地数据元素的顺序次序,在所述处理器中执行所述SIMD指令,包括:
从所述第一寄存器中的源数据元素的对应第一子集生成偶数编号的目的地数据元素;以及
从所述第二寄存器中的源数据元素的对应第二子集生成奇数编号的目的地数据元素。
8.根据权利要求7所述的方法,其中所述SIMD指令是所述源数据元素的右移位函数。
9.根据权利要求7所述的方法,其中所述目的地数据元素是在相应SIMD通道中,且从源数据元素在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成所述目的地数据元素中的每一个。
10.一种包括可由处理器执行的指令的非暂时性计算机可读存储媒体,所述指令在由所述处理器执行时致使所述处理器进行混合宽度单指令多数据SIMD运算,所述非暂时性计算机可读存储媒体包括:
SIMD指令,所述SIMD指令包括:
包括第一位宽源数据元素的第一集合的至少第一源向量操作数;以及
包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的两倍,
其中所述目的地向量操作数包括寄存器对,所述寄存器对包含:包括所述目的地数据元素的第一子集的第一寄存器以及包括所述目的地数据元素的第二子集的第二寄存器;以及
基于源数据元素的所述第一集合的顺序次序:
用于从所述第一集合的偶数编号的源数据元素生成所述第一寄存器中的目的地数据元素的所述第一子集的代码;以及
用于从所述第一集合的奇数编号的源数据元素生成所述第二寄存器中的目的地数据元素的所述第二子集的代码。
11.根据权利要求10所述的非暂时性计算机可读存储媒体,其中所述SIMD指令是所述第一集合的所述源数据元素根据常数值的平方函数、左移位函数、递增或加法中的一个。
12.根据权利要求10所述的非暂时性计算机可读存储媒体,其中源数据元素的所述第一集合是在相应SIMD通道中,且包括用于从所述源数据元素中的每一个在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成目的地数据元素的代码。
13.根据权利要求10所述的非暂时性计算机可读存储媒体,其中所述SIMD指令进一步包括:包括所述第一位宽源数据元素的第二集合的第二源向量操作数,且源数据元素的所述第一集合的所述顺序次序对应于源数据元素的所述第二集合的顺序次序,所述非暂时性计算机可读存储媒体包括:
用于从所述第一集合的偶数编号的源数据元素和所述第二集合的偶数编号的源数据元素生成所述第一寄存器中的目的地数据元素的所述第一子集的代码;以及
用于从所述第一集合的奇数编号的源数据元素和所述第二集合的偶数编号的源数据元素生成所述第二寄存器中的目的地数据元素的所述第二子集的代码。
14.根据权利要求13所述的非暂时性计算机可读存储媒体,其中所述SIMD指令是所述第一集合的所述源数据元素与所述第二集合的对应源数据元素的相乘或相加。
15.根据权利要求13所述的非暂时性计算机可读存储媒体,其中源数据元素的所述第一集合和源数据元素的第二集合是在相应SIMD通道中,包括用于从所述第一集合的所述源数据元素中的每一个和所述第二集合的所述源数据元素中的对应一个在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成目的地数据元素的代码。
16.一种包括可由处理器执行的指令的非暂时性计算机可读存储媒体,所述指令在由所述处理器执行时致使所述处理器进行混合宽度单指令多数据SIMD运算,所述非暂时性计算机可读存储媒体包括:
SIMD指令,所述SIMD指令包括:
包括第一位宽源数据元素的至少源向量操作数;以及
包括第二位宽目的地数据元素的至少目的地向量操作数,其中所述第二位宽是所述第一位宽的一半,
其中所述源向量操作数包括寄存器对,所述寄存器对包含:包括所述源数据元素的第一子集的第一寄存器以及包括所述源数据元素的第二子集的第二寄存器;以及
基于所述目的地数据元素的顺序次序:
用于从所述第一寄存器中的源数据元素的对应第一子集生成偶数编号的目的地数据元素的代码;以及
用于从所述第二寄存器中的源数据元素的对应第二子集生成奇数编号的目的地数据元素的代码。
17.根据权利要求16所述的非暂时性计算机可读存储媒体,其中所述SIMD指令是所述源数据元素的右移位函数。
18.根据权利要求16所述的非暂时性计算机可读存储媒体,其中所述目的地数据元素是在相应SIMD通道中,且包括用于从源数据元素在所述相应SIMD通道或邻近于所述相应SIMD通道的SIMD通道中生成所述目的地数据元素中的每一个的代码。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US14/805,456 US10489155B2 (en) | 2015-07-21 | 2015-07-21 | Mixed-width SIMD operations using even/odd register pairs for wide data elements |
US14/805,456 | 2015-07-21 | ||
PCT/US2016/038487 WO2017014892A1 (en) | 2015-07-21 | 2016-06-21 | Mixed-width simd operations having even-element and odd-element operations using register pair for wide data elements |
Publications (2)
Publication Number | Publication Date |
---|---|
CN107851010A true CN107851010A (zh) | 2018-03-27 |
CN107851010B CN107851010B (zh) | 2021-11-12 |
Family
ID=56204087
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201680041468.2A Active CN107851010B (zh) | 2015-07-21 | 2016-06-21 | 针对宽数据元素使用寄存器对的具有偶数元素和奇数元素运算的混合宽度simd运算 |
Country Status (9)
Country | Link |
---|---|
US (1) | US10489155B2 (zh) |
EP (1) | EP3326060B1 (zh) |
JP (1) | JP6920277B2 (zh) |
KR (1) | KR102121866B1 (zh) |
CN (1) | CN107851010B (zh) |
BR (1) | BR112018001208B1 (zh) |
ES (1) | ES2795832T3 (zh) |
HU (1) | HUE049260T2 (zh) |
WO (1) | WO2017014892A1 (zh) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN111324354A (zh) * | 2019-12-27 | 2020-06-23 | 湖南科技大学 | 一种融合寄存器对需求的寄存器选择方法 |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB2540943B (en) * | 2015-07-31 | 2018-04-11 | Advanced Risc Mach Ltd | Vector arithmetic instruction |
US10698685B2 (en) * | 2017-05-03 | 2020-06-30 | Intel Corporation | Instructions for dual destination type conversion, mixed precision accumulation, and mixed precision atomic memory operations |
CN109298886A (zh) * | 2017-07-25 | 2019-02-01 | 合肥君正科技有限公司 | Simd指令执行方法、装置及处理器 |
US20190272175A1 (en) * | 2018-03-01 | 2019-09-05 | Qualcomm Incorporated | Single pack & unpack network and method for variable bit width data formats for computational machines |
US10528346B2 (en) * | 2018-03-29 | 2020-01-07 | Intel Corporation | Instructions for fused multiply-add operations with variable precision input operands |
Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005174295A (ja) * | 2003-12-09 | 2005-06-30 | Arm Ltd | Simdデータ処理における算術演算の実行のためのデータ処理装置及び方法 |
US20050235025A1 (en) * | 2004-04-16 | 2005-10-20 | Aldrich Bradley C | Dual-multiply-accumulator operation optimized for even and odd multisample calculations |
US20070033381A1 (en) * | 2001-06-11 | 2007-02-08 | Broadcom Corporation | Conditional execution with multiple destination stores |
US7219212B1 (en) * | 2002-05-13 | 2007-05-15 | Tensilica, Inc. | Load/store operation of memory misaligned vector data using alignment register storing realigned data portion for combining with remaining portion |
CN1964490A (zh) * | 2005-11-09 | 2007-05-16 | 松下电器产业株式会社 | 一种滤波器及滤波方法 |
CN101243441A (zh) * | 2005-06-21 | 2008-08-13 | 国际字符股份有限公司 | 用于处理字符流的方法与设备 |
CN104011644A (zh) * | 2011-12-22 | 2014-08-27 | 英特尔公司 | 用于产生按照数值顺序的相差恒定跨度的整数的序列的处理器、方法、系统和指令 |
US20150154024A1 (en) * | 2013-07-09 | 2015-06-04 | Texas Instruments Incorporated | Vector SIMD VLIW Data Path Architecture |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5673321A (en) | 1995-06-29 | 1997-09-30 | Hewlett-Packard Company | Efficient selection and mixing of multiple sub-word items packed into two or more computer words |
US6202141B1 (en) | 1998-06-16 | 2001-03-13 | International Business Machines Corporation | Method and apparatus for performing vector operation using separate multiplication on odd and even data elements of source vectors |
US6922716B2 (en) | 2001-07-13 | 2005-07-26 | Motorola, Inc. | Method and apparatus for vector processing |
US7107305B2 (en) | 2001-10-05 | 2006-09-12 | Intel Corporation | Multiply-accumulate (MAC) unit for single-instruction/multiple-data (SIMD) instructions |
KR100553252B1 (ko) * | 2002-02-01 | 2006-02-20 | 아바고테크놀로지스코리아 주식회사 | 휴대용 단말기의 전력 증폭 장치 |
US7668897B2 (en) | 2003-06-16 | 2010-02-23 | Arm Limited | Result partitioning within SIMD data processing systems |
US7275148B2 (en) * | 2003-09-08 | 2007-09-25 | Freescale Semiconductor, Inc. | Data processing system using multiple addressing modes for SIMD operations and method thereof |
GB2409068A (en) * | 2003-12-09 | 2005-06-15 | Advanced Risc Mach Ltd | Data element size control within parallel lanes of processing |
US9235414B2 (en) | 2011-12-19 | 2016-01-12 | Intel Corporation | SIMD integer multiply-accumulate instruction for multi-precision arithmetic |
-
2015
- 2015-07-21 US US14/805,456 patent/US10489155B2/en active Active
-
2016
- 2016-06-21 WO PCT/US2016/038487 patent/WO2017014892A1/en active Application Filing
- 2016-06-21 HU HUE16732213A patent/HUE049260T2/hu unknown
- 2016-06-21 CN CN201680041468.2A patent/CN107851010B/zh active Active
- 2016-06-21 KR KR1020187001696A patent/KR102121866B1/ko active IP Right Grant
- 2016-06-21 JP JP2018502231A patent/JP6920277B2/ja active Active
- 2016-06-21 ES ES16732213T patent/ES2795832T3/es active Active
- 2016-06-21 EP EP16732213.0A patent/EP3326060B1/en active Active
- 2016-06-21 BR BR112018001208-4A patent/BR112018001208B1/pt active IP Right Grant
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070033381A1 (en) * | 2001-06-11 | 2007-02-08 | Broadcom Corporation | Conditional execution with multiple destination stores |
US7219212B1 (en) * | 2002-05-13 | 2007-05-15 | Tensilica, Inc. | Load/store operation of memory misaligned vector data using alignment register storing realigned data portion for combining with remaining portion |
JP2005174295A (ja) * | 2003-12-09 | 2005-06-30 | Arm Ltd | Simdデータ処理における算術演算の実行のためのデータ処理装置及び方法 |
US20050235025A1 (en) * | 2004-04-16 | 2005-10-20 | Aldrich Bradley C | Dual-multiply-accumulator operation optimized for even and odd multisample calculations |
CN101243441A (zh) * | 2005-06-21 | 2008-08-13 | 国际字符股份有限公司 | 用于处理字符流的方法与设备 |
CN1964490A (zh) * | 2005-11-09 | 2007-05-16 | 松下电器产业株式会社 | 一种滤波器及滤波方法 |
CN104011644A (zh) * | 2011-12-22 | 2014-08-27 | 英特尔公司 | 用于产生按照数值顺序的相差恒定跨度的整数的序列的处理器、方法、系统和指令 |
US20150154024A1 (en) * | 2013-07-09 | 2015-06-04 | Texas Instruments Incorporated | Vector SIMD VLIW Data Path Architecture |
Non-Patent Citations (2)
Title |
---|
J. PENG: "An Efficient SIMD Architecture with Parallel Memory for 2D Cosine Transforms of Video Coding", 《2007 IEEE INTERNATIONAL CONF. ON APPLICATION-SPECIFIC SYSTEMS, ARCHITECTURES AND PROCESSORS》 * |
刘胜: "超宽SIMD DSP片上并行数据访存关键技术研究", 《中国优秀博硕士学位论文全文数据库(博士)信息科技辑》 * |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN111324354A (zh) * | 2019-12-27 | 2020-06-23 | 湖南科技大学 | 一种融合寄存器对需求的寄存器选择方法 |
CN111324354B (zh) * | 2019-12-27 | 2023-04-18 | 湖南科技大学 | 一种融合寄存器对需求的寄存器选择方法 |
Also Published As
Publication number | Publication date |
---|---|
CN107851010B (zh) | 2021-11-12 |
ES2795832T3 (es) | 2020-11-24 |
WO2017014892A1 (en) | 2017-01-26 |
HUE049260T2 (hu) | 2020-09-28 |
US20170024209A1 (en) | 2017-01-26 |
BR112018001208A2 (pt) | 2018-09-11 |
JP6920277B2 (ja) | 2021-08-18 |
KR20180030986A (ko) | 2018-03-27 |
EP3326060B1 (en) | 2020-03-25 |
EP3326060A1 (en) | 2018-05-30 |
KR102121866B1 (ko) | 2020-06-11 |
JP2018525731A (ja) | 2018-09-06 |
US10489155B2 (en) | 2019-11-26 |
BR112018001208B1 (pt) | 2023-12-26 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CN107851010A (zh) | 针对宽数据元素使用寄存器对的具有偶数元素和奇数元素运算的混合宽度simd运算 | |
KR20140001910A (ko) | 데이터 처리장치 및 방법 | |
CN102385504B (zh) | 改进的处理器架构 | |
Rocki et al. | Accelerating 2-opt and 3-opt local search using GPU in the travelling salesman problem | |
US20130067203A1 (en) | Processing device and a swizzle pattern generator | |
CN107430760A (zh) | 用于图像处理器的二维移位阵列 | |
CN107851013B (zh) | 数据处理装置和方法 | |
CN103914278B (zh) | 高效矢量滚转操作的装置和方法 | |
CN108140417B (zh) | 具有降低布线复杂度的移位寄存器 | |
CN108242051A (zh) | 中位数确定 | |
CN107851016A (zh) | 向量算术指令 | |
TWI680435B (zh) | 用於影像處理之設備及方法 | |
CN107924306A (zh) | 使用simd指令的表查找 | |
TWI531966B (zh) | 計算裝置、計算方法及非暫態機器可讀儲存媒體 | |
TWI794423B (zh) | 用於影像處理器之大查找表 | |
Zhou et al. | Orthogonal drawings of series-parallel graphs with minimum bends | |
Szkoda et al. | Accelerating cellular automata simulations using AVX and CUDA | |
Zekri | Restructuring and implementations of 2D matrix transpose algorithm using SSE4 vector instructions | |
Honda et al. | GPU-accelerated bulk execution of multiple-length multiplication with warp-synchronous programming technique |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |