CN106792778A - 一种测量lte系统中上行srs信号功率的方法及装置 - Google Patents

一种测量lte系统中上行srs信号功率的方法及装置 Download PDF

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Abstract

本发明实施例公开了一种测量LTE系统中上行SRS信号功率的方法及装置。该方法包括：FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。

Description

一种测量LTE系统中上行SRS信号功率的方法及装置
技术领域
本发明实施例涉及无线通信的技术领域，尤其涉及一种测量SRS功率的方法及装置。
背景技术
无线通信接收端一般需要进行数字下变频，得到基带数据。在LTE系统中，基站通过接收UE的前导检测，获取各个UE的上行同步，并告知各UE上行定时提前量并进行定期更新，使各UE上行数据到达基站的时间都与基站的上行子帧边界对齐。现场可编程门阵列(Field programmable gate array，FPGA)实现上行信道探测参考信号(SoundingReference Signal，SRS)功率测量时，必须保证和用户的上行无线帧保持同步。
在LTE系统中，由于FPGA接收上行数据，并不知道用户的上行数据帧头，无法确认上行SRS信号的位置，为了找到用户的上行数据帧头，需要根据FPGA接收到的下行主同步信号(primary synchronization signal，PSS)信号和辅同步信号(secondarysynchronization signal，SSS)信号，通过与本地扰码做相关，得到下行同步，进而得到接收用户的上行数据帧头；根据上行数据帧头以及高层配置，确定SRS信号的位置，再利用获取的SRS所在OFDM符号数据做信道估计。
发明内容
本发明实施例的目的在于提出一种测量SRS功率的方法及装置，旨在解决如何用FPGA产生本地SRS信号以及用FPGA实现信道估计的问题。
为达此目的，本发明实施例采用以下技术方案：
第一方面，一种测量SRS功率的方法，所述方法包括：
FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
优选地，所述获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号，包括：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv；
其中，所述pucch_fss是上行控制信道序列移位图样，mod(cellID，30)是对配置小区ID模30计算；所述pucch_u_tbl是产生u序列、列表为20个pucch_fss数值的重复；所述pusch_v_tbl是v序列、列表为20个0；所述alpha根据n_cs_SRS的配置确定属于第几象限；所述r_SRS是根据所在象限得到复数值，再用此复数与r_uv基序列进行乘累加。
优选地，所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计，包括：
所述FPGA对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换，根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
所述FPGA对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
所述FPGA对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
优选地，所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率，包括：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
第二方面，一种测量SRS功率的装置，所述装置包括：
生成模块，用于获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
接收模块，用于根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
信道估计模块，用于对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
获取模块，用于根据信道估计后的数据进行累加并获取所述SRS信号的功率。
优选地，所述生成模块，具体用于：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv；
其中，所述pucch_fss是上行控制信道序列移位图样，mod(cellID，30)是对配置小区ID模30计算；所述pucch_u_tbl是产生u序列、列表为20个pucch_fss数值的重复；所述pusch_v_tbl是v序列、列表为20个0；所述alpha根据n_cs_SRS的配置确定属于第几象限；所述r_SRS是根据所在象限得到复数值，再用此复数与r_uv基序列进行乘累加。
优选地，所述信道估计模块，具体用于：
对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换，根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
优选地，所述获取模块，具体用于：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
本发明实施例提供的一种测量SRS功率的方法及装置，FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
附图说明
图1是本发明实施例提供的一种测量SRS功率的方法的流程示意图；
图2是本发明实施例提供的一种信道估计的方法流程示意图；
图3是本发明实施例提供的一种功率测量的方法流程示意图；
图4是本发明实施例提供的一种测量SRS功率的装置的功能模块示意图。
具体实施方式
下面结合附图和实施例对本发明实施例作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明实施例，而非对本发明实施例的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明实施例相关的部分而非全部结构。
参考图1，图1是本发明实施例提供的一种测量SRS功率的方法的流程示意图。
如图1所示，所述测量SRS功率的方法包括：
步骤101，FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
具体的，根据物理层协议，结合算法实现的技巧，简单介绍一下本地SRS信号产生步骤。
SRS信号的基本序列生成方式同上行解调参考信号相同，SRS的由下式生成：
其中：
u为序列组跳变序号，u＝(fgh(ns)+fss)mod30，
这里，fgh(ns)为组跳变图样，由下式确定：
fss(ns)为序列移位图样，由下式确定：
序列组跳变功能可以打开或关闭，由高层配置信息Group-hopping-enabled决定。
为简单起见，建议Group-hopping-enabled配置为关闭状态。
v为序列跳变序号，
序列跳变功能可以打开或关闭，由高层配置信息Sequence-hopping-enabled决定。
为简单起见，本发明中Sequence-hopping-enabled配置为关闭状态。为循环移位值，由下式决定：
其中，由高层配置给每个UE，
综上所述，SRS产生所需要的参数列在表1中。
表1
设备接收到的上行数据经过数字下变频，变为采样率为30.72MHz的数据，LTE系统中，10ms为一帧，所以一帧数据的长度为307200个样点。
优选地，所述获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号，包括：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv。
具体的，产生基序列时，根据表2、表3，和1320之内的素数，需要四个块ROM分别存储表1、表2，1320内素数和1320内素数的倒数，表2和表3来自3GPP TS 36.211协议中的表5.5.1.2-1和5.5.1.2-2，其中倒数值得取值bit位数有一定的范围，位数不能太少，少了影响精度，也不能太多，多了占用FPGA资源太多，本发明中，倒数用了29bit表示，用1bit表示整数部分，28bit表示小数部分。根据需要相位时需要用到32位的cordic IP核。
表2
表3
步骤102，所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
步骤103，所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
优选地，所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计，包括：
所述FPGA对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
所述FPGA对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
所述FPGA对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
具体的，如图2所示，获取下行同步后，根据已知高层配置的SRS信息，接收SRS信号，并通过一系列处理进行信道估计，得到信道冲击响应，以进行后续的信号测量工作。
步骤104，所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
优选地，所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率，包括：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
具体的，如图3所示，信号测量包括RSRP，两个测量之间存在一定的依赖关系。
本发明实施例提供的一种测量SRS功率的方法，FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
参考图4，图4是本发明实施例提供的一种测量SRS功率的装置的功能模块示意图。
如图4所示，所述装置包括：
生成模块401，用于获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
优选地，所述生成模块401，具体用于：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝pn_seq(1:20)，否则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv；
其中，所述pucch_fss是上行控制信道序列移位图样，mod(cellID，30)是对配置小区ID模30计算；所述pucch_u_tbl是产生u序列、列表为20个pucch_fss数值的重复；所述pusch_v_tbl是v序列、列表为20个0；所述alpha根据n_cs_SRS的配置确定属于第几象限；所述r_SRS是根据所在象限得到复数值，再用此复数与r_uv基序列进行乘累加。
接收模块402，用于根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
信道估计模块403，用于对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
优选地，所述信道估计模块403，具体用于：
对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换，根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
获取模块404，用于根据信道估计后的数据进行累加并获取所述SRS信号的功率。
优选地，所述获取模块404，具体用于：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
本发明实施例提供的一种测量SRS功率的装置，FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
以上结合具体实施例描述了本发明实施例的技术原理。这些描述只是为了解释本发明实施例的原理，而不能以任何方式解释为对本发明实施例保护范围的限制。基于此处的解释，本领域的技术人员不需要付出创造性的劳动即可联想到本发明实施例的其它具体实施方式，这些方式都将落入本发明实施例的保护范围之内。

Claims (8)

1.一种测量SRS功率的方法，其特征在于，所述方法包括：
FPGA获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
所述FPGA根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率。
2.根据权利要求1所述的方法，其特征在于，所述获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号，包括：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv；
其中，所述pucch_fss是上行控制信道序列移位图样，mod(cellID，30)是对配置小区ID模30计算；所述pucch_u_tbl是产生u序列、列表为20个pucch_fss数值的重复；所述pusch_v_tbl是v序列、列表为20个0；所述alpha根据n_cs_SRS的配置确定属于第几象限；所述r_SRS是根据所在象限得到复数值，再用此复数与r_uv基序列进行乘累加。
3.根据权利要求1所述的方法，其特征在于，所述FPGA对所述本地r_SRS信号和所述上行SRS信号进行信道估计，包括：
所述FPGA对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换，根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
所述FPGA对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
所述FPGA对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
4.根据权利要求3所述的方法，其特征在于，所述FPGA根据信道估计后的数据进行累加并获取所述SRS信号的功率，包括：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
5.一种测量SRS功率的装置，其特征在于，所述装置包括：
生成模块，用于获取配置参数，生成组号u和组内序号v，再生成基本序列r_uv，并生成产生本地r_SRS信号；
接收模块，用于根据下行同步帧头，找出上行数据起始位置，并根据SRS参考信号位于子帧的最后一个OFDM确定SRS参考信号所在的位置，根据所述SRS参考信号所在的位置接收上行SRS信号；
信道估计模块，用于对所述本地r_SRS信号和所述上行SRS信号进行信道估计；
获取模块，用于根据信道估计后的数据进行累加并获取所述SRS信号的功率。
6.根据权利要求5所述的装置，其特征在于，所述生成模块，具体用于：
获取B_SRS、N_RB_sc、n_cs_SRS、subframe_idx、Group-hopping-enabled序列和Sequence-hopping-enabled序列，所述B_SRS为SRS带宽，值为0～3的整数；所述N_RB_sc为子载波个数，值为12；所述n_cs_SRS为SRS带宽，值为0～7的整数；所述subframe_idx为子帧索引，SRS所在子帧；所述Group-hopping-enabled序列是组跳变使能开关；所述Sequence-hopping-enabled序列是跳变使能开关；
根据小区ID生成pucch_fss＝mod(cellID，30)，若不需要组跳频，则pucch_u_tbl＝pucch_fss*ones(1，20)；若需要组跳频，则需要生成pn序列；若不需要组跳频和序列跳频，则pusch_v_tbl＝zeros(1，20)；
根据基序列r_uv和相位alpha＝2*pi*n_cs_SRS/8得到r_SRS＝exp(1i*alpha*(0:M_RS_sc-1)).*r_uv；
其中，所述pucch_fss是上行控制信道序列移位图样，mod(cellID，30)是对配置小区ID模30计算；所述pucch_u_tbl是产生u序列、列表为20个pucch_fss数值的重复；所述pusch_v_tbl是v序列、列表为20个0；所述alpha根据n_cs_SRS的配置确定属于第几象限；所述r_SRS是根据所在象限得到复数值，再用此复数与r_uv基序列进行乘累加。
7.根据权利要求5所述的装置，其特征在于，所述信道估计模块，具体用于：
对所述上行2048点SRS时域信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048个点的FFT变换，根据物理资源映射关系及K0指示，得到频域SRS信号，用所述频域SRS信号与所述本地的r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第一频域信号；
对所述第一频域信号进行IFFT变换，变成第一时域信号，再对所述第一时域信号分别计算功率，确定最大功率位置max_idx，所述最大功率位置为所述上行SRS信号的起始位置，根据所述上行SRS信号的起始位置完成所述上行SRS信号的初始同步；
对2048个点的SRS信号进行(max_idx-1)/2循环左移，对左移后的SRS信号进行7.5KHz的频偏补偿，再对补偿后的时域信号进行2048点的FFT计算，再根据物理资源映射关系及K0指示，得到第二频域信号，根据所述第二频域信号与所述本地r_SRS信号进行相关，对相关后的结果进行填充得到2048个点的第三频域信号，再对所述第三频域信号进行IFFT变换，得到第二时域信号。
8.根据权利要求7所述的装置，其特征在于，所述获取模块，具体用于：
对所述第二时域信号分别计算功率，每个功率值与12倍的噪声功率值()进行比较，并把功率值大于12的功率进行累加，累加结果得到SRS信号的功率。
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