CN106569557A - 一种板卡Bypass智能控制系统及方法 - Google Patents

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Abstract

本发明公开了一种板卡Bypass智能控制系统及方法，所述系统包括：设于主板上的多个第一PCIE插槽，用于插接扩展卡；SMBUS控制模块，用于给所述各第一PCIE插槽分配唯一的SMBUS地址；SMBUS地址寄存器，存储第一PCIE插槽的SMBUS地址信息；CPU，用于读取所述SMBUS地址寄存器存储的地址信息，根据SMBUS地址信息识别各第一PCIE插槽的槽位。本发明有效实现了对扩展卡槽位、扩展卡类型进行智能识别和单独控制、对不同槽位不同类型的板卡单独控制，避免板卡槽位及类型识别错误引起的控制失效或者造成不必要的损失。

Description

一种板卡Bypass智能控制系统及方法
技术领域
本发明涉及板卡技术领域，尤其涉及一种板卡Bypass（旁路）智能控制系统和方法。
背景技术
随着电子技术的发展，各种功能各种类型的板卡融入各种设备中。随着板卡数量和功能的增加，CPU对其控制也复杂多样，这样势必增加CPU处理开销和处理方式复杂化，并且会出现控制板卡错位的情况。因此有必要提出具有一种板卡Bypass智能控制方法及其系统，能灵活分辨出当前所控制的是扩展槽的哪个槽位，扩展卡的类型是什么，也能对不同的板卡槽位进行单独控制。
发明内容
本发明的目的是针对上述现有技术存在的缺陷，提供一种板卡Bypass智能控制系统及方法。
本发明提出的板卡Bypass智能控制系统包括：设于主板上的多个第一PCIE插槽，用于插接扩展卡；SMBUS控制模块，用于给所述各第一PCIE插槽分配唯一的SMBUS地址；SMBUS地址寄存器，存储第一PCIE插槽的SMBUS地址信息；CPU，用于读取所述SMBUS地址寄存器存储的地址信息，根据SMBUS地址信息识别各第一PCIE插槽的槽位。
所述扩展卡包括CPLD芯片，用于通过对CPLD芯片的IO口进行标识符的定义后，CPLD固件通过读取IO口的值在CPLD内部生成只读I2C寄存器，所述CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
所述扩展卡包括PCIE转接卡，所述PCIE转接卡设有下行单元，所述下行单元设有多个第二PCIE插槽，用于插接外部扩展设备，所述第二PCIE插槽各接口分别通过连接到所述CPLD芯片的信号引脚来分配第二PCIE插槽的CPLD的SMBus从端地址，所述CPU通过读取各第二PCIE插槽的从端地址来识别该插槽的槽位。
所述CPLD芯片的IO口通过上下拉设计进行标识符的定义。
本发明还提出了一种板卡Bypass智能控制方法，包括以下步骤：
给主板上的第一PCIE插槽分配唯一的SMBUS地址，并存入SMBUS地址寄存器；
CPU读取SMBUS地址寄存器内存储的SMBUS地址信息，根据所述地址信息识别与所述地址信息对应的各第一PCIE插槽的槽位。
当主板上插接有扩展卡时，对设于所述扩展卡上的CPLD芯片的IO口进行标识符的定义后，CPLD固件读取IO口的值在CPLD内部生成只读I2C寄存器，所述CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
设于所述扩展卡上的第二PCIE插槽分别连接到所述CPLD芯片的信号引脚，分配插槽槽的CPLD的SMBus从端地址，所述CPU通过读取各插槽的从端地址来识别该插槽的槽位。
所述CPLD芯片的IO口通过上下拉设计进行标识符的定义。
与现有技术相比，本发明的有益效果是：通过合理的分配主板插槽的SMBUS地址及转接卡的插槽的CPLD的SMBUS从端地址来对槽位进行识别，同时通过定义引脚标识符来识别扩展卡的类型，从而达到了对扩展卡槽位、扩展卡类型进行智能识别和单独控制、对不同槽位不同类型的板卡单独控制的目的，避免板卡槽位及类型识别错误引起的控制失效或者造成不必要的损失。
附图说明
图1为本发明系统的功能结构示意图；
图2为本发明主板的槽位图；
图3为本发明识别主板上的PCIE插槽的流程图；
图4是本发明识别扩展卡类型的流程图；
图5是本发明识别转接卡插槽槽位的流程图。
具体实施方式
下面结合附图和实施例对发明进行详细的说明。
如图1所示，本发明提出的板卡Bypass（旁路）智能控制系统包括：设于主板上的多个第一PCIE插槽，用于插接扩展卡；SMBUS控制模块，用于给所述各第一PCIE插槽分配唯一的SMBUS地址；SMBUS地址寄存器，存储第一PCIE插槽的SMBUS地址信息；CPU，用于读取所述SMBUS地址寄存器存储的地址信息，根据SMBUS地址信息识别各第一PCIE插槽的槽位。
如图2所示，在一实施例中，主板的第一PCIE插槽共10个，其中，SLOT1、SLOT2、SLOT3为主板正面插槽，SLOT4-5、SLOT4-6、SLOT4-7、SLOT4-8、SLOT4-9、SLOT4-10为主板侧插槽，各插槽分配的SMBUS地址如表1所示：
表1 SLOT，SMBUS地址及设备对应列表
CPU根据各插槽的SMBUS地址识别该插槽的具体槽位。
扩展卡包括CPLD芯片，用于通过对CPLD芯片的IO口进行标识符的定义后，CPLD固件通过读取IO口的值在CPLD内部生成只读I2C寄存器，CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
在本实施例中，对CPLD的IOA-IOD四个输入引脚进行上下拉设计，定义扩展卡的标识符，通过各扩展卡标识符来识别各扩展卡的类型，具体标识符设计如表2所示：
表2 IOA，IOB，IOC，IOD设计对应表
扩展卡包括多个第二PCIE插槽，用于插接外部扩展设备，第二PCIE插槽通过上下拉电阻与所述主板连接，同时分别通过连接到所述CPLD芯片的信号引脚来分配扩展槽的CPLD的SMBUS从端地址，CPU通过读取各扩展槽的从端地址来识别该扩展槽的槽位。
在本实施例中，第二PCIE插槽的四个地址线JTAG1、JTAG2、JTAG3和JTAG4分别连接到CPLD芯片的四个信号引脚来分配从端地址，具体地址分配设计如表3所示：
表3 SLOT，JTAG1，JTAG2，JTAG3，JTAG4设计对应表
SLOT JTAG4 JTAG3 JTAG2 JTAG1
1 L L L L
2 L L L H
3 L L H L
4-5 L L H H
4-6 L H L L
4-7 L H L H
4-8 L H H L
4-9 L H H H
4-10 H L L L
本发明还提出了一种板卡Bypass智能控制方法。图3是识别主板上的插槽的流程图，包括以下步骤：
给主板上的第一PCIE插槽分配唯一的SMBUS地址，并存入SMBUS地址寄存器；
CPU读取SMBUS地址寄存器内存储的SMBUS地址信息，根据所述地址信息识别与所述地址信息对应的各第一PCIE插槽的槽位。
图4是识别扩展卡类型的流程图，包括以下步骤：当主板上插接有扩展卡时，对设于所述扩展卡上的CPLD芯片的IO口进行标识符的定义后，CPLD固件读取IO口的值在CPLD内部生成只读I2C寄存器，所述CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
图5是识别转接卡插槽槽位的流程图，包括以下步骤：设于转接卡上的第二PCIE插槽分别连接到所述CPLD芯片的信号引脚，分配扩展槽的CPLD的SMBUS从端地址，CPU通过读取各扩展槽的从端地址来识别该扩展槽的槽位。
本发明通过合理的分配主板插槽的SMBUS地址及转接卡的插槽的CPLD的SMBUS从端地址来对槽位进行识别，同时通过定义引脚标识符来识别扩展卡的类型，从而达到了对扩展卡槽位、扩展卡类型进行智能识别和单独控制、对不同槽位不同类型的板卡单独控制的目的，避免板卡槽位及类型识别错误引起的控制失效或者造成不必要的损失。
上述实施例仅用于说明本发明的具体实施方式。应当指出的是，对于本领域的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干变形和变化，这些变形和变化都应属于本发明的保护范围。

Claims (8)

1.一种板卡Bypass智能控制系统，其特征在于，包括设于主板上的多个第一PCIE插槽，用于插接扩展卡；SMBUS控制模块，用于给所述各第一PCIE插槽分配唯一的SMBUS地址；SMBUS地址寄存器，存储第一PCIE插槽的SMBUS地址信息；CPU，用于读取所述SMBUS地址寄存器存储的地址信息，根据SMBUS地址信息识别各第一PCIE插槽的槽位。
2.如权利要求1所述的系统，其特征在于，所述扩展卡包括CPLD芯片，用于通过对CPLD芯片的IO口进行标识符的定义后，CPLD固件通过读取IO口的值在CPLD内部生成只读I2C寄存器，所述CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
3.如权利要求2所述的系统，其特征在于，所述扩展卡包括PCIE转接卡，所述PCIE转接卡设有下行单元，所述下行单元设有多个第二PCIE插槽，用于插接外部扩展设备，所述第二PCIE插槽各接口分别通过连接到所述CPLD芯片的信号引脚来分配第二PCIE插槽的CPLD的SMBus从端地址，所述CPU通过读取各第二PCIE插槽的从端地址来识别该插槽的槽位。
4.如权利要求2所述的系统，其特征在于，所述CPLD芯片的IO口通过上下拉设计进行标识符的定义。
5.一种板卡Bypass智能控制方法，其特征在于，包括以下步骤：
给主板上的第一PCIE插槽分配唯一的SMBUS地址，并存入SMBUS地址寄存器；
CPU读取SMBUS地址寄存器内存储的SMBUS地址信息，根据所述地址信息识别与所述地址信息对应的各第一PCIE插槽的槽位。
6.如权利要求5所述的控制方法，其特征在于，还包括以下步骤：
当主板上插接有扩展卡时，对设于所述扩展卡上的CPLD芯片的IO口进行标识符的定义后，CPLD固件读取IO口的值在CPLD内部生成只读I2C寄存器，所述CPU通过I2C总线读取所述只读I2C寄存器来识别所述扩展卡的类型。
7.如权利要求6所述的控制方法，其特征在于，还包括以下步骤：
设于所述扩展卡上的第二PCIE插槽分别连接到所述CPLD芯片的信号引脚，分配插槽槽的CPLD的SMBus从端地址，所述CPU通过读取各插槽的从端地址来识别该插槽的槽位。
8.如权利要求6所述的控制方法，其特征在于，所述CPLD芯片的IO口通过上下拉设计进行标识符的定义。
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