CN105867523A - 放电电路及应用该放电电路的主板 - Google Patents

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Abstract

本发明的主板包括一放电电路，所述放电电路包括：一平台控制器、一第一电子开关、第二电子开关、第一至第三电阻及第一、第二电容，所述第一电子开关的控制端通过一第一电阻连接所述平台控制器的待机引脚，所述第一电子开关的第二端通过一第二电阻连接一待机电源，所述第二电子开关的控制端连接所述第一电子开关的第二端，所述第二电子开关的第二端通过一第三电阻连接第一电压源，当平台控制器的待机引脚输出一低电平信号时，所述第一电子开关迅速截止，且第二电子开关迅速导通，所述第一电压源的电压通过第三电阻迅速放电。本发明的主板可实现快速放电的效果。

Description

放电电路及应用该放电电路的主板
技术领域
本发明涉及一种放电电路。
背景技术
通常电脑在关机以后，由于主板上稳压电容的存在，系统电源的电压需通过稳压电容经十几秒的放电后才能完全断电，倘若有测试人员没有等到系统电源完全放电，就更换内存、显卡、CPU等元件，就会造成带电插拔的不规范操作，进而导致主板损坏。
发明内容
鉴于以上内容，有必要提供一种快速放电的放电电路及应用该放电电路的主板。
一种放电电路，包括：
一平台控制器，包括一待机引脚；
一第一控制单元，包括一第一电阻、第二电阻及第一电子开关，所述第一电子开关的控制端通过第一电阻连接所述平台控制器的待机引脚，所述第一电子开关的第一端接地，所述第一电子开关的第二端通过第二电阻连接一待机电压源；及
一第二控制单元，包括一第三电阻、第一电容及第二电子开关，所述第二电子开关的控制端连接所述第一电子开关的第二端，所述第二电子开关的第一端接地，所述第二电子开关的第二端通过所述第三电阻连接一第一电压源，所述第一电容并联于所述第三电阻两侧；当所述平台控制器的待机引脚输出一低电平信号时，所述第一电子开关截止，所述第二电子开关导通，所述第一电压源的电压通过所述第三电阻接地。
一种主板，包括一放电电路，所述放电电路包括：
一平台控制器，包括一待机引脚；
一第一控制单元，包括一第一电阻、第二电阻及第一电子开关，所述第一电子开关的控制端通过第一电阻连接所述平台控制器的待机引脚，所述第一电子开关的第一端接地，所述第一电子开关的第二端通过第二电阻连接一待机电压源；及
一第二控制单元，包括一第三电阻、第一电容及第二电子开关，所述第二电子开关的控制端连接所述第一电子开关的第二端，所述第二电子开关的第一端接地，所述第二电子开关的第二端通过所述第三电阻连接一第一电压源，所述第一电容并联于所述第三电阻两侧；当主板关机时，所述平台控制器的待机引脚输出一低电平信号，所述第一电子开关截止，所述第二电子开关导通，所述第一电压源的电压通过所述第三电阻接地。
上述放电电路可以在平台控制器的待机引脚输出一低电平信号时，迅速控制第一电子开关截止，且第二电子开关导通，所述第一电压源的电压通过第三电阻可迅速放电。
附图说明
图1是本发明主板的较佳实施方式的电路图。
图2是本发明放电电路的较佳实施方式的电路图。
主要元件符号说明
主板 200
放电电路 100
PCH 10
电阻 R1-R4
电容 C1、C2
场效应管 Q1、Q2、Q3
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
下面结合附图及较佳实施方式对本发明作进一步详细描述：
请参考图1和图2，本发明的主板200应用于一电脑，该主板200包括一放电电路100，所述放电电路100的较佳实施例包括一平台控制器(Platform Controller Hub, PCH) 10、一第一控制单元20、一第二控制单元30及一第三控制单元40。所述第一控制单元20包括电阻R1、R2及场效应管Q1。所述第二控制单元30包括电容C1、电阻R3及场效应管Q2。所述第三控制单元40包括电容C2、电阻R4及场效应管Q3。
所述场效应管Q1的栅极通过电阻R1连接所述PCH10的待机引脚SLP_S3，所述场效应管Q1的漏极接地，所述场效应管Q1的源极通过一电阻R2连接一待机电压源P3V_S5。所述场效应管Q2的栅极与所述场效应管Q1的漏极相连，所述场效应管Q2的源极接地，所述场效应管Q2的漏极通过电阻R3连接一第一电源P3V。所述电容C1并联于所述电阻R3两端，用以滤波。所述场效应管Q3的栅极与所述场效应管Q1的漏极相连，所述场效应管Q3的源极接地，所述场效应管Q3的漏极通过电阻R4连接一第二电源P5V。所述电容C2并联于所述电阻R4两端，用以滤波。所述第一电源P3V输出的电压为3V，所述第二电源P5V输出的电压为5V。所述场效应管Q1、Q2、Q3也可以采用其他电子开关替代。
下面将对上述放电电路100的工作原理进行说明：
当电脑处于工作状态，所述PCH10的待机引脚SLP_S3输出一个高电平信号，所述场效应管Q1导通，所述场效应管Q2及Q3截止。
当电脑待机或关机以后，所述PCH10的待机引脚SLP_S3立即输出一个低电平信号，所述场效应管Q1截止，所述场效应管Q2的栅极及场效应管Q3的栅极均接收所述待机电压源P3V_S5输出的待机电压3V，所述场效应管Q2及Q3导通。所述第一电源P3V通过电阻R3迅速放电，且放电时间为T1。所述第二电源P5V通过电阻R4迅速放电，且放电时间为T2。在本实施例中，所述电阻R3及R4的电阻值为100Ω。故，所述第一电源P3V的放电时间T1=2.2*100*C1，所述第二电源P5V的放电时间T2=2.2*100*C2。
综上，当电脑待机或关机后，通过PCH10的待机引脚SLP_S3立即输出的低电平信号控制场效应管Q1截止，场效应管Q2导通，从而主板200上的第一电源P3V及第二电源P5V均可通过100Ω的电阻就可以迅速放电。

Claims (10)

1.一种放电电路，包括：
一平台控制器，包括一待机引脚；
一第一控制单元，包括一第一电阻、第二电阻及第一电子开关，所述第一电子开关的控制端通过第一电阻连接所述平台控制器的待机引脚，所述第一电子开关的第一端接地，所述第一电子开关的第二端通过第二电阻连接一待机电压源；及
一第二控制单元，包括一第三电阻、第一电容及第二电子开关，所述第二电子开关的控制端连接所述第一电子开关的第二端，所述第二电子开关的第一端接地，所述第二电子开关的第二端通过所述第三电阻连接一第一电压源，所述第一电容并联于所述第三电阻两侧；当所述平台控制器的待机引脚输出一低电平信号时，所述第一电子开关截止，所述第二电子开关导通，所述第一电压源的电压通过所述第三电阻接地。
2.如权利要求1所述的放电电路，其特征在于：所述放电电路还包括一第三控制单元，所述第三控制单元包括一第四电阻、第二电容及第三电子开关，所述第三电子开关的控制端连接所述第一电子开关的第二端，所述第三电子开关的第一端接地，所述第三电子开关的第二端通过所述第四电阻连接一第二电压源，所述第二电容并联于所述第四电阻两侧；当所述平台控制器的待机引脚输出一低电平信号时，所述第一电子开关截止，所述第二电子开关导通，所述第二电压源的电压通过所述第四电阻接地。
3.如权利要求1所述的放电电路，其特征在于：所述第一、第二电子开关均为NMOS场效应管，所述第一、第二电子开关的控制端、第一端及第二端分别对应NMOS场效应管的栅极、源极及漏极。
4.如权利要求2所述的放电电路，其特征在于：所述第一至第三电子开关均为NMOS场效应管，所述第一至第三电子开关的控制端、第一端及第二端分别对应NMOS场效应管的栅极、源极及漏极。
5.如权利要求3所述的放电电路，其特征在于：所述第一电压源输出的电压为3V。
6.如权利要求4所述的放电电路，其特征在于：所述第一电压源输出的电压为3V，所述第二电压源输出的电压为5V。
7.如权利要求5所述的放电电路，其特征在于：所述第三电阻的阻值为100Ω。
8.如权利要求6所述的放电电路，其特征在于：所述第三电阻及第四电阻的阻值均为100Ω。
9.一种主板，包括一放电电路，所述放电电路包括：
一平台控制器，包括一待机引脚；
一第一控制单元，包括一第一电阻、第二电阻及第一电子开关，所述第一电子开关的控制端通过第一电阻连接所述平台控制器的待机引脚，所述第一电子开关的第一端接地，所述第一电子开关的第二端通过第二电阻连接一待机电压源；及
一第二控制单元，包括一第三电阻、第一电容及第二电子开关，所述第二电子开关的控制端连接所述第一电子开关的第二端，所述第二电子开关的第一端接地，所述第二电子开关的第二端通过所述第三电阻连接一第一电压源，所述第一电容并联于所述第三电阻两侧；当主板关机时，所述平台控制器的待机引脚输出一低电平信号，所述第一电子开关截止，所述第二电子开关导通，所述第一电压源的电压通过所述第三电阻接地。
10.如权利要求9所述的主板，其特征在于：所述放电电路还包括一第三控制单元，所述第三控制单元包括一第四电阻、第二电容及第三电子开关，所述第三电子开关的控制端连接所述第一电子开关的第二端，所述第三电子开关的第一端接地，所述第三电子开关的第二端通过所述第四电阻连接一第二电压源，所述第二电容并联于所述第四电阻两侧；当所述平台控制器的待机引脚输出一低电平信号时，所述第一电子开关截止，所述第二电子开关导通，所述第二电压源的电压通过所述第四电阻接地。
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