CN104581898B - 多模终端的省电方法及装置 - Google Patents

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Abstract

本发明公开了一种多模终端的省电方法及装置。其中，该方法包括：使用多模终端的DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制RF TRX输出CLK1_OUT/CLK2_OUT；将CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的MODEM和SOC/BUS/Peripheral。通过本发明，可以使多模终端在一个DRX周期内缩短modem子系统的醒来时间，加长睡眠时间，进而达到了减少待机功耗的效果。

Description

多模终端的省电方法及装置
技术领域
本发明涉及通信领域，具体而言，涉及一种多模终端的省电方法及装置。
背景技术
随着4G时代的到来，LTE（Long Term Evolution，长期演进）宽带高速（LTEcategory420MHz带宽，150Mbps下行/50Mbps上行的速率及LTE CA category7<20+20>MHz带宽，300Mbps下行/100Mbps上行速率）的数据业务具有很大传输优势，同时又能保持现有2G/3G（尤其是2G）优良的语音业务优势，使用这种先进技术可以达到投资少，网络运营成本少的效果。由于多模双待/双通可以达成这样的目标，因此，双待/双通将会是移动网络通讯运营商倾向的运营模式，然而，此模式目前最大的瓶颈之一是待机功耗问题。
针对相关技术中如何降低多模双待/双通终端待机功耗较大的问题，目前尚未提出有效的解决方案。
发明内容
本发明提供了一种多模终端的省电方法及装置，以至少解决上述问题。
根据本发明的一个方面，提供了一种多模终端的省电方法，包括：使用多模终端的DBB（Digital Baseband，数字基带）的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制射频收发信机RF TRX输出CLK1_OUT/CLK2_OUT；将CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的调制解调器MODEM和SOC（System On Chip，系统级芯片）/总线BUS/外围设备Peripheral。
优选地，DBB具有Weak Pull High Function功能。
优选地，在使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制射频收发信件RF TRX输出CLK1_OUT/CLK2_OUT之前，该方法还包括：控制PMIC（Power Management IntegratedCircuit，电源管理集成电路）打开/关闭输出电源VLK1_EN/VLK2_EN；通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
优选地，多模终端的制式包括以下组合之一：4G/3G作为一待一通，以及2G作为另一待一通；4G作为一待一通，以及3G/2G作为另一待一通。
根据本发明的另一方面，提供了一种多模终端的省电装置，位于多模终端，包括：第一控制模块，用于使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；第二控制模块，用于使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制射频收发信件RF TRX输出CLK1_OUT/CLK2_OUT；发送模块，用于将CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的调制解调器MODEM和系统级芯片SOC/总线BUS/外围设备Peripheral。
优选地，DBB具有Weak Pull High Function功能。
优选地，该装置还包括：第三控制模块，连接于第二控制模块，用于控制电源管理集成电路PMIC打开/关闭输出电源VLK1_EN/VLK2_EN；第四控制模块，连接于第三控制模块，用于通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
优选地，多模终端的制式包括以下组合之一：4G/3G作为一待一通，以及2G作为另一待一通；4G作为一待一通，以及3G/2G作为另一待一通。
根据本发明的又一方面，提供了一种多模终端的省电方法，应用于制式为4G/3G、2G的多模终端，包括：使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；根据CLK1_EN/CLK2_EN控制电源管理集成电路PMIC输出电源V_3G/4G和V_2G；将V_3G/4G和V_2G提供给各个调制解调器MODEM子系统的射频收发信机RF TRX和RF FEM。
根据本发明的还一方面，提供了一种多模终端的省电装置，位于制式为4G/3G、2G的多模终端，包括：第一控制模块，用于使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；第二控制模块，用于根据CLK1_EN/CLK2_EN控制电源管理集成电路PMIC输出电源V_3G/4G和V_2G；提供模块，用于将V_3G/4G和V_2G提供给各个调制解调器MODEM子系统的射频收发信机RF TRX和RF FEM。
通过本发明，采用将控制RF TRX输出的CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的MODEM和SOC/BUS/Peripheral，或者，将控制PMIC输出的电源V_3G/4G和V_2G提供给各个调MODEM子系统的RF TRX和RF FEM的方式，解决了相关技术中如何降低多模双待/双通终端待机功耗较大的问题，可以使多模终端在一个DRX周期内缩短modem子系统的醒来时间，加长睡眠时间，进而达到了减少待机功耗的效果。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本申请的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1是根据本发明实施例一的多模终端的省电方法流程图；
图2是根据本发明实施例一的多模终端的省电装置的结构框图；
图3是根据本发明实施例一的优选多模终端的省电装置的结构框图；
图4是根据本发明实施例二的多模终端的省电方法流程图；
图5是根据本发明实施例二的多模终端的省电装置的结构框图；
图6是根据本发明优选实施例的手持终端的多模（双待/双通）省电方法的流程示意图。
具体实施方式
下文中将参考附图并结合实施例来详细说明本发明。需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。
本发明主要涉及多模（双待/双通）移动通讯终端（尤其是LTE多模终端）的功耗领域，通过本发明方案的实施可以解决双待/双通因功耗较大，从而导致待机时间短的问题，最终实现较好的用户体验。
为了解决上述技术问题，本发明的下述实施例一和实施例二主要针对终端核心套片之间如何通过硬件自动切换及相关控制，以达成最短工作时间目的而做出的改进方案。
本发明实施例一提供了一种多模终端的省电方法。图1是根据本发明实施例一的多模终端的省电方法流程图，如图1所示，该方法主要包括以下步骤（步骤S102-步骤S106）：
步骤S102，使用多模终端的DBB（数字基带）的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；
步骤S104，使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制射频收发信机RF TRX输出CLK1_OUT/CLK2_OUT；
步骤S106，将CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的调制解调器MODEM和SOC（System On Chip，系统级芯片）/总线BUS/外围设备Peripheral。
在本实施例中，DBB具有Weak Pull High Function功能。
在本实施例中，在执行步骤S104之前，还可以先控制PMIC（Power ManagementIntegrated Circuit，电源管理集成电路）打开/关闭输出电源VLK1_EN/VLK2_EN；再通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
在本实施例中，多模终端的制式包括以下组合之一：4G/3G作为一待一通，以及2G作为另一待一通；4G作为一待一通，以及3G/2G作为另一待一通。当然，在实际应用中，不仅仅局限于此处所述的制式组合构成。
本发明实施例一还提供了一种多模终端的省电装置，位于多模终端，用以实施例一提供的多模终端的省电方法。图2是根据本发明实施例一的多模终端的省电装置的结构框图，如图2所示，该装置主要包括：第一控制模块10、第二控制模块20以及发送模块30。
其中，第一控制模块10，用于使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；第二控制模块20，用于使用CLK1/CLK2和CLK1_EN/CLK2_EN，控制射频收发信件RF TRX输出CLK1_OUT/CLK2_OUT；发送模块30，用于将CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的调制解调器MODEM和系统级芯片SOC/总线BUS/外围设备Peripheral。
图3是根据本发明实施例一的优选多模终端的省电装置的结构框图，如图3所示，该优选多模终端的省电装置还可以包括：第三控制模块40，连接于第二控制模块20，用于控制电源管理集成电路PMIC打开/关闭输出电源VLK1_EN/VLK2_EN；第四控制模块50，连接于第三控制模块40，用于通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
对于图2所示的多模终端的省电装置和图3所示的多模终端的省电装置而言，DBB是具有Weak Pull High Function功能的。在实际应用中，多模终端的制式可以包括以下组合之一：4G/3G作为一待一通，以及2G作为另一待一通；4G作为一待一通，以及3G/2G作为另一待一通。当然，在实际应用中，不仅仅局限于此处所述的制式组合构成。
本发明实施例二提供了一种多模终端的省电方法，可以应用于制式为4G/3G、2G的多模终端。图4是根据本发明实施例二的多模终端的省电方法流程图，如图4所示，该方法主要包括以下步骤（步骤S402-步骤S406）：
步骤S402，使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；
步骤S404，根据CLK1_EN/CLK2_EN控制电源管理集成电路PMIC输出电源V_3G/4G和V_2G；
步骤S406，将V_3G/4G和V_2G提供给各个调制解调器MODEM子系统的射频收发信机RF TRX和RF FEM。
本发明实施例二提供了一种多模终端的省电装置，该装置位于制式为4G/3G、2G的多模终端，用以实现实施例二提供的多模终端的省电方法。图5是根据本发明实施例二的多模终端的省电装置的结构框图，如图5所示，该装置主要包括：第一控制模块10，用于使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；第二控制模块20，用于根据CLK1_EN/CLK2_EN控制电源管理集成电路PMIC输出电源V_3G/4G和V_2G；提供模块30，用于将V_3G/4G和V_2G提供给各个调制解调器MODEM子系统的射频收发信机RF TRX和RF FEM。
采用上述实施例提供的多模终端的省电方法及装置，解决了相关技术中如何降低多模双待/双通终端待机功耗较大的问题，可以使多模终端在一个DRX周期内缩短modem子系统的醒来时间，加长睡眠时间，进而达到了减少待机功耗的效果。
以下通过图6以及优选实施例对上述实施例一和实施例二提供的多模终端的省电方法及装置的实现过程进行更加详细的描述。
首先，对本优选实施例解决技术问题的思路进行一个简要介绍：（1）通过硬件自动打开/关闭时钟源，以缩短sleep与wake up切换时间；（2）DBB芯片中公用模块的时钟源，固定与一个modem子系统的时钟源共用或硬件灵活配置选择其中一个modem子系统的时钟源共用（为两种不同的方式），从而在一个DRX（Discontinuous Reception，非连续接收）周期里面，缩短modem子系统wake up时间，加长sleep时间，以达到减少功耗的目的。
在本优选实施例中，将以采用4G/3G作为一待一通，2G作为另一待一通的制式组合为例进行说明。当然，对于4G作为一待一通，3G/2G作为另一待一通及其他不同制式或同制式的双待/双通，本优选实施例同样适用。
在结合图6对本优选实施例进行详细描述之前，先对本优选实施例的实现过程作一个简要说明：对于DBB芯片中共用模块的时钟源，本优选实施例提出两个方案：A、采用硬件灵活配置方式，选择其中一个modem子系统的时钟源共用。B、固定与一个modem子系统的时钟源共用。其中，A方案相对B方案，待机功耗更低，即更省电。
图6是根据本发明优选实施例的手持终端的多模（双待/双通）省电方法的流程示意图，以下结合图6对A方案和B方案进行进一步说明。
A方案（时钟源供电方案）通过下步骤实现：
（1）DBBPWRCTRL[0]/PWRCTRL[1]有weak pull high function功能，以此保证整个终端默认有系统时钟可用。
（2）使用DBB的sleep,wake up模式，控制并输出PWRCTRL[1]/PWRCTRL[2]不同的状态值；
（3）控制PMIC(power management Integrated circuit)使得PMIC打开/关闭其输出电源VCLK1_EN/VCLK2_EN；
（4）通过对电源VCLK1_EN/VCLK2_EN的控制，达到对VCTCXO OR CYSTAL与否有时钟输出的控制；
（5）CLK1/CLK2结合CLK1_EN/CLK2_EN(DBB输出的PWRCTRL[1]/PWRCTRL[2])，使得RF TRX（transceiver）输出合适的CLK1_OUT/CLK2_OUT；
（6）CLK1_OUT/CLK2_OUT,作为待机wake up及工作态高速时钟源提供给DBB的MODEM及SOC/BUS/Peripheral等。
B方案（4G/3G，2G modem子系统RF TRX，RF FEM（front-end module）供电方案）主要通过下步骤实现：
（1）使用DBB的sleep，wake up模式，控制并输出PWRCTRL[1]/PWRCTRL[2]不同的状态值；
（2）控制PMIC，使得PMIC输出合适的电源V_3G/4G/V_2G，提供给各modem子系统的RF TRX及RF FEM，从而缩短对4G/3G，2G RF TRX及RF FEM的供电时间（请参见附图6中的加黑连线部分）。
通过这两种实现方案，各芯片之间及芯片内部模块之间均是通过硬件直接进行控制的，这种控制方式是可以在软件初始化时写入DBB的常供电区（即开机状态下一直有供电的区域）的。其中，（1）在时钟软/硬件控制方面：硬件控制方式减少了sleep与wake切换需在32K慢时钟下通过软件配置并执行的时间，从而减少耗电；（2）在时钟源选择方面：DBB SOC/BUS/Peripheral clock源在一个modem wake up另一个modem sleep条件下，从需要两个CLK1_OUT，CLK2_OUT优化为仅需一个CLK*，从而可以减少耗电。
以下对本优选实施例做进一步详细说明，通过以下步骤实现：
步骤1：TPU（3G/4G），TPU（2G）（Time Processing Unit），实现硬件自动计时及不同频率时钟源计时等效拟合时间的功能，其时钟源为低速32K crystal或高速26MHz或19.2MHz或其他频率。
步骤2：采用硬件灵活配置选择其中一个modem子系统的时钟源共用。
具体地，Control MUX（multiplexer）可以实现对输入高速时钟CLK1_OUT，CLK2_OUT的选择，通过modem（4G/3G，2G）与PWRCTRL[1]，PWRCTRL[2]的配置，进行硬件自动切换，输出选择出的clock给SOC/BUS/Peripheral etc。各不同场景输入时钟选择如下：
在4G/3G数据/语音业务，2G待机wake/sleep期间，选择CLK1_OUT；
在4G/3G数据/语音业务，2G语音/数据业务期间，选择CLK1_OUT；
在4G/3G待机wake/sleep期间，2G语音/数据业务期间，选择CLK2_OUT；
在4G/3G待机wake期间，2G待机wake期间，选择CLK1_OUT；
在4G/3G待机wake期间，2G待机sleep期间，选择CLK1_OUT；
在4G/3G待机sleep期间，2G待机wake up期间，选择CLK2_OUT。
固定与一个modem子系统的时钟源共用，排除图6中的logic MUX模块，各不同场景输入时钟均可以选择与3G/4G子系统的时钟源共用。
步骤3：MODEM（3G/4G），MODEM（2G），实现各自MODEM模式设置及控制：MODEM各状态（TX/RX/idle/clock/sleep），工作业务模式（语音，数据），待机模式（wake up/sleep）的控制及其输出给PWRCTRL[1]，PWRCTRL[2]及control MUX进行相关状况的控制。
步骤4：SOC/BUS/Peripheral，实现此模块工作与待机sleep状态的输出，送给PWRCTRL[1]，PWRCTRL[0]进行相关省电控制。
步骤5：PWRCTRL[1]，PWRCTRL[0]，实现整机工作与待机sleep状态的输出，控制PMIC的各类电源。为了便于理解，这里以两个例子进行说明：
例一、采用硬件灵活配置选择其中一个modem子系统的时钟源共用。以PWRCTRL[1]为例进行说明：当MODEM（3G/4G），SOC/BUS/Peripheral，从工作态进入待机的sleep态，通过硬件切换（软件初始化时设置，并保存在DBB的常供电区），使得PWRCTRL[1]自动输出“0”sleep状态给PMIC；当3G/4G modem到达睡眠入口时设置的唤醒时刻点，则通过TPU模块输出硬件唤醒中断给PWRCTRL[1]，使得PWRCTRL[1]硬件自动输出“1”wake状态给PMIC；PWRCTRL[2]同理。
例二、固定与一个modem子系统的时钟源共用。以PWRCTRL[1]为例进行说明：当MODEM（3G/4G），SOC/BUS/Peripheral，MODEM（2G）均从工作态进入待机的sleep态，通过硬件切换（软件初始化时设置，并保存在DBB的常供电区），使得PWRCTRL[1]自动输出“0”sleep状态给PMIC；当3G/4G modem或2G modem到达睡眠入口时设置的唤醒时刻点，则通过TPU模块输出硬件唤醒中断给PWRCTRL[1]，使得PWRCTRL[1]硬件自动输出“1”wake状态给PMIC；PWRCTRL[2]同上述例一。
步骤6：PMIC，根据PWRCTRL[1]，PWRCTRL[2]不同的输入状态，实现不同的电源配置输出。例：PWRCTRL[1]为“0”，PMIC将关闭提供给3G/4G相关的电源；PWRCTRL[1]为“1”，PMIC将打开提供给3G/4G相关的电源。
步骤7：RF TRX，实现transceiver26MHz or19.2MHz或其他DBB所需的系统的时钟输出，其时钟输出电路的使能控制为DBB输出的PWRCTRL[1]，PWRCTRL[2]。
在实际应用中，手持终端的待机功耗在一定程度上决定了其商用化程度。本优选实施例将有利于待机功耗的进一步降低，从而使得用户既能体验到高速的数据业务，又能享受到高质量的语音业务。
需要说明的是，上述各个模块是可以通过硬件来实现的。例如：一种处理器，包括上述各个模块，或者，上述各个模块分别位于一个处理器中。
在另外一个实施例中，还提供了一种软件，该软件用于执行上述实施例及优选实施方式中描述的技术方案。
在另外一个实施例中，还提供了一种存储介质，该存储介质中存储有上述软件，该存储介质包括但不限于：光盘、软盘、硬盘、可擦写存储器等。
从以上的描述中，可以看出，本发明实现了如下技术效果：采用将控制RF TRX输出的CLK1_OUT/CLK2_OUT作为多模终端待机状态和工作状态的高速时钟源发送给DBB的MODEM和SOC/BUS/Peripheral，或者，将控制PMIC输出的电源V_3G/4G和V_2G提供给各个调MODEM子系统的RF TRX和RF FEM的方式，解决了相关技术中如何降低多模双待/双通终端待机功耗较大的问题，可以使多模终端在一个DRX周期内缩短modem子系统的醒来时间，加长睡眠时间，进而达到了减少待机功耗的效果。
显然，本领域的技术人员应该明白，上述的本发明的各模块或各步骤可以用通用的计算装置来实现，它们可以集中在单个的计算装置上，或者分布在多个计算装置所组成的网络上，可选地，它们可以用计算装置可执行的程序代码来实现，从而，可以将它们存储在存储装置中由计算装置来执行，并且在某些情况下，可以以不同于此处的顺序执行所示出或描述的步骤，或者将它们分别制作成各个集成电路模块，或者将它们中的多个模块或步骤制作成单个集成电路模块来实现。这样，本发明不限制于任何特定的硬件和软件结合。
以上所述仅为本发明的优选实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (6)

1.一种多模终端的省电方法，其特征在于，包括：
使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；
使用CLK1/CLK2和所述CLK1_EN/CLK2_EN，控制射频收发信机RF TRX输出CLK1_OUT/CLK2_OUT；
将所述CLK1_OUT/CLK2_OUT作为所述多模终端待机状态和工作状态的高速时钟源发送给所述DBB的调制解调器MODEM和系统级芯片SOC/总线BUS/外围设备Peripheral；
其中，在使用CLK1/CLK2和所述CLK1_EN/CLK2_EN，控制射频收发信件RF TRX输出CLK1_OUT/CLK2_OUT之前，所述方法还包括：控制电源管理集成电路PMIC打开/关闭输出电源VLK1_EN/VLK2_EN；通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
2.根据权利要求1所述的方法，其特征在于，所述DBB具有Weak Pull High Function功能。
3.根据权利要求1至2中任一项所述的方法，其特征在于，所述多模终端的制式包括以下组合之一：
4G/3G作为一待一通，以及2G作为另一待一通；
4G作为一待一通，以及3G/2G作为另一待一通。
4.一种多模终端的省电装置，位于多模终端，其特征在于，包括：
第一控制模块，用于使用多模终端的数字基带DBB的睡眠模式和醒来模式，控制并输出PWRCTRL1/PWRCTRL2的状态值CLK1_EN/CLK2_EN；
第二控制模块，用于使用CLK1/CLK2和所述CLK1_EN/CLK2_EN，控制射频收发信件RFTRX输出CLK1_OUT/CLK2_OUT；
发送模块，用于将所述CLK1_OUT/CLK2_OUT作为所述多模终端待机状态和工作状态的高速时钟源发送给所述DBB的调制解调器MODEM和系统级芯片SOC/总线BUS/外围设备Peripheral；
其中，所述装置还包括：第三控制模块，连接于第二控制模块，用于控制电源管理集成电路PMIC打开/关闭输出电源VLK1_EN/VLK2_EN；第四控制模块，连接于第三控制模块，用于通过控制VLK1_EN/VLK2_EN的方式控制VCTCXO OR CYSTAL是否输出时钟。
5.根据权利要求4所述的装置，其特征在于，所述DBB具有Weak Pull High Function功能。
6.根据权利要求4至5中任一项所述的装置，其特征在于，所述多模终端的制式包括以下组合之一：
4G/3G作为一待一通，以及2G作为另一待一通；
4G作为一待一通，以及3G/2G作为另一待一通。
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