CN104579299B - 用于畸变信号的校正的集成电路模块 - Google Patents

用于畸变信号的校正的集成电路模块 Download PDF

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Abstract

本发明公开了一种用于畸变信号的校正的集成电路模块，该集成电路模块包括：电路器件、陶瓷基板、金属可伐壳体以及盖板，其中，所述电路器件粘接到所述陶瓷基板上，所述陶瓷基板固定于所述金属可伐壳体，所述盖板固接于所述金属可伐壳体，以将所述电路器件和陶瓷基板密封于所述金属可伐壳体中。该集成电路模块面积体积小，集成度高。

Description

用于畸变信号的校正的集成电路模块
技术领域
本发明涉及集成电路，具体地，涉及一种用于畸变信号的校正的集成电路模块。
背景技术
目前国内的畸变信号校正电路多采用传统的PCB板及分立器件制作而成，电路集成比较低，且电路的面积、体积较大，那么设计一种电路面积、体积小、高集成度的畸变信号校正电路成为一种亟需解决的问题。
发明内容
本发明的目的是克服现有技术中的集成电路模块精度相对较低的问题，提供一种用于畸变信号的校正的集成电路模块，该集成电路模块面积体积小，集成度高。
为了实现上述目的，本发明提供了一种用于畸变信号的校正的集成电路模块，该集成电路模块包括：电路器件、陶瓷基板、金属可伐壳体以及盖板，其中，所述电路器件粘接到所述陶瓷基板上，所述陶瓷基板固定于所述金属可伐壳体，所述盖板固接于所述金属可伐壳体，以将所述电路器件和陶瓷基板密封于所述金属可伐壳体中。
优选地，所述陶瓷基板为Al2O3陶瓷材料。
优选地，所述电路器件包括依次连接的运算放大电路、乘法运算电路和加法运算电路，其中，原始畸变信号的第一信号和第二信号依次经过所述运算放大电路、乘法运算电路和加法运算电路以实现所述原始畸变信号的校正，所述加法运算电路输出所述第一校正信号和所述第二校正信号。
优选地，所述运算放大电路包括：第一放大器，其中，所述第一放大器的第一引脚和第八引脚空接；
所述第一放大器的第二引脚通过第二电阻连接于所述第二信号输入端，所述第一放大器的第二引脚和第六引脚之间并联有第十电阻和第二电容；
所述第一放大器的第三引脚通过第四电阻接地；
所述第一放大器的第四引脚连接负电压电源且通过第十电容接地；
所述第一放大器的第七引脚连接正电压电源且通过第十二电容接地；
所述第一放大器的第五引脚通过第十一电容连接于所述正电压电源；
所述第一放大器的第六引脚为所述第一放大器的输出端，以输出第二放大信号。
优选地，所述运算放大电路还包括：第四放大器，其中，所述第四放大器的第一引脚和第八引脚空接；
所述第四放大器的第二引脚通过第二电阻连接于所述第一信号输入端，所述第四放大器的第二引脚和第六引脚之间并联有第九电阻和第一电容；
所述第四放大器的第三引脚通过第四电阻接地；
所述第四放大器的第四引脚连接负电压电源且通过第七电容接地；
所述第四放大器的第七引脚连接正电压电源且通过第九电容接地；
所述第四放大器的第五引脚通过第八电容连接于所述正电压电源；
所述第四放大器的第六引脚为所述第四放大器的输出端，以输出第一放大信号。
优选地，所述乘法运算电路包括：第二乘法器，所述第二乘法器的两个输入端都连接于所述第一放大器的输出端以得到第二平方信号；
第三乘法器，所述第三乘法器的两个输入端分别连接于所述第二乘法器和所述第二信号输入端以得到第二三次方信号；
第五乘法器，所述第五乘法器的两个输入端分别连接于所述第四放大器的输出端和所述第一放大器的输出端；
第六乘法器，所述第六乘法器的两个输入端分别连接于所述第二乘法器的输出端和所述第一信号输入端；
第七乘法器，所述第七乘法器的两个输入端都连接于所述第四放大器的输出端以得到第一平方信号；
第八乘法器，所述第八乘法器的两个出入端分别连接于所述第七乘法器的输出端和所述第二信号输入端；
第九乘法器，所述第九乘法器的两个出入端分别连接于所述第七乘法器的输出端和所述第一信号输入端以得到第一三次方信号。
优选地，所述加法运算电路包括：第十放大器，所述第十放大器的第一引脚和第八引脚空接，所述第十放大器的第三引脚通过第五电阻接地，所述第十放大器的第二引脚通过第十五电阻连接于所述第五乘法器的输出端且通过第十六电阻连接于所述第六乘法器的输出端，所述第十放大器的第二引脚和第六引脚之间还并联有第十一电阻和第三电容，所述第十放大器的第四引脚连接所述负电压电源且通过第二十七电容接地，所述第十放大器的第七引脚连接所述正电压电源且通过第二十九电容接地；所述第十放大器的第五引脚通过第二十八电容连接于所述正电压电源。
优选地，所述加法运算电路还包括：第十一放大器，所述第十一放大器的第一引脚和第八引脚空接，所述第十一放大器的第三引脚通过第六电阻接地，所述第十一放大器的第二引脚通过第十七电阻连接于所述第十放大器的第六引脚，所述第十一放大器的第二引脚通过第十八电阻连接于第四放大器的第六引脚，所述第十一放大器的第二引脚还通过第十九电阻连接于所述第九乘法器的输出端；所述第十一放大器的第二引脚和第六引脚之间还并联有第十二电阻和第四电容，所述第六引脚为所述第一校正信号的输出端，所述第十一放大器的第四引脚连接所述负电压电源且通过第三十电容接地，所述第十一放大器的第七引脚连接于所述正电压电源且通过第三十二电容接地；所述第十一放大器的第五引脚通过第三十一电容连接于所述正电压电源。
优选地，所述加法运算电路还包括：
第十二放大器，所述第十二放大器的第一引脚和第八引脚空接，所述第十二放大器的第三引脚通过第七电阻接地，所述第十二放大器的第二引脚通过第二十电阻连接于所述第一放大器的第六引脚，所述第十二放大器的第二引脚通过第二十一电阻连接于所述第三乘法器的输出端，所述第十二放大器的第二引脚还通过第二十二电阻连接于所述第七乘法器的输出端，所述第十二放大器的第二引脚和第六引脚之间还并联有第十三电阻和第五电容，所述第十二放大器的第四引脚连接所述负电压电源且通过第三十三电容接地，所述第十二放大器的第七引脚连接所述正电压电源且通过第三十五电容接地；所述第十二放大器的第五引脚通过第三十四电容连接于所述正电压电源。
优选地，所述加法运算电路还包括：第十三放大器，所述第十三放大器的第一引脚和第八引脚空接，所述第十三放大器的第三引脚通过第八电阻接地，所述第十三放大器的第二引脚通过第二十三电阻连接于所述第十二放大器的第六引脚，所述第十三放大器的第二引脚通过第二十四电阻连接于所述第二乘法器的输出端，所述第十三放大器的第二引脚还通过第二十五电阻连接于所述第八乘法器的输出端；所述第十三放大器的第二引脚和第六引脚之间还并联有第十四电阻和第六电容，所述第六引脚为所述第二校正信号的输出端，所述第十三放大器的第四引脚连接所述负电压电源且通过第三十六电容接地，所述第十三放大器的第七引脚连接于所述正电压电源且通过第三十八电容接地；所述第十三放大器的第五引脚通过第三十七电容连接于所述正电压电源。
通过上述实施方式，本发明的集成电路模块体积小，为整个系统减小体积提供了空间，本发明采用混合集成电路技术将运算放大器、乘法器等分离器件封装在同一个金属管壳内。
本发明的其他特征和优点将在随后的具体实施方式部分予以详细说明。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1是说明本发明的芯片N1、N2、N3、N4、N5和N6的一种电路图；
图2是说明本发明的一种用于畸变信号的校正的集成电路模块的电路图；
图3是说明本发明的芯片N10和N11相连接的一种电路图；以及
图4是说明本发明的芯片N12和N13相连接的一种电路图。
具体实施方式
以下结合附图对本发明的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。
在本发明的一种用于畸变信号的校正的集成电路模块，该集成电路模块包括：电路器件、陶瓷基板、金属可伐壳体以及盖板，其中，所述电路器件粘接到所述陶瓷基板上，所述陶瓷基板固定于所述金属可伐壳体，所述盖板固接于所述金属可伐壳体，以将所述电路器件和陶瓷基板密封于所述金属可伐壳体中。
通过上述实施方式，本发明的集成电路模块体积小，为整个系统减小体积提供了空间，本发明采用混合集成电路技术将运算放大器、乘法器等分离器件封装在同一个金属管壳内。
在本发明中，集成电路模块的制作方法可以为：
首先根据电路原理和模块尺寸大小要求画出版图，利用厚膜工艺制作陶瓷电路基板；2、利用环氧胶将测试合格的陶瓷电路基板粘接在金属可伐壳体中，并在高温下进行固化；3、利用导电环氧胶将电路所需的运算放大器、乘法器裸芯片和电容粘接到陶瓷电路基板对应的位置上，并在高温下进行固化；4、利用引线键合技术将裸芯片和陶瓷电路基板、陶瓷电路基板和金属可伐壳体管脚引线之间进行金丝键合，从而完成整个电路模块的电气互连；5、最后利用平行缝焊技术，将装有陶瓷电路基板的金属可伐壳体以及配套金属盖板进行气密性封焊；至此，信号畸变校正混合集成电路模块制作完成。
以下结合附图1、图2、图3以及图4对本发明进行进一步的说明，在本发明中的集成电路模块结构简单，校正精度高，信号畸变校正的效果被提高了。
在本发明的一种实施方式中，为了实现上述功能，本发明的所述陶瓷基板为Al2O3陶瓷材料。
在该种实施方式中，为了实现信号畸变的校正，所述电路器件包括依次连接的运算放大电路、乘法运算电路和加法运算电路，其中，原始畸变信号的第一信号和第二信号依次经过所述运算放大电路、乘法运算电路和加法运算电路以实现所述原始畸变信号的校正，所述加法运算电路输出所述第一校正信号和所述第二校正信号。
所述的运算放大电路由运算放大器芯片第一放大器N1、第四放大器N4以及第一电阻～第四电阻(R1～R4)、第九电阻R9、第十电阻R10、第一电容C1、第二电容C2、第七到第十二电容(C7～C12)组成；
在该种实施方式中，所述运算放大电路包括：第一放大器，其中，所述第一放大器的第一引脚和第八引脚空接；
所述第一放大器的第二引脚通过第二电阻连接于所述第二信号输入端，所述第一放大器的第二引脚和第六引脚之间并联有第十电阻和第二电容；
所述第一放大器的第三引脚通过第四电阻接地；
所述第一放大器的第四引脚连接负电压电源且通过第十电容接地；
所述第一放大器的第七引脚连接正电压电源且通过第十二电容接地；
所述第一放大器的第五引脚通过第十一电容连接于所述正电压电源；
所述第一放大器的第六引脚为所述第一放大器的输出端，以输出第二放大信号。
具体的连接电路参见图1所示的电路连接，在电路中，第一放大器的连接关系如下：如图1所示，第一放大器的第二引脚通过第二电阻R2接到第二信号Y输入端Pin8，第一放大器的第三引脚通过第四电阻R4接地，第二引脚和第六引脚之间接并联的第十电阻R10和第二电容C2，第四引脚接-15V电源并通过第十电容C10接地，第五引脚通过第十一电容C11接到+15V电源，第七引脚接+15V电源并通过第十二电容C12接地，第一引脚和第八引脚悬空；
在该种实施方式中，所述运算放大电路还包括：第四放大器，其中，所述第四放大器的第一引脚和第八引脚空接；
所述第四放大器的第二引脚通过第二电阻连接于所述第一信号输入端，所述第四放大器的第二引脚和第六引脚之间并联有第九电阻和第一电容；
所述第四放大器的第三引脚通过第四电阻接地；
所述第四放大器的第四引脚连接负电压电源且通过第七电容接地；
所述第四放大器的第七引脚连接正电压电源且通过第九电容接地；
所述第四放大器的第五引脚通过第八电容连接于所述正电压电源；
所述第四放大器的第六引脚为所述第四放大器的输出端，以输出第一放大信号。
第四放大器N4的引脚连接关系如下：第二引脚通过R1接到第一信号X信号输入端Pin1，第三引脚通过R3接地，2脚和6脚之间接并联的电阻R9和电容C1，4脚接-15V电源并通过电容C7接地，5脚通过电容C8接到+15V电源，7脚接+15V电源并通过电容C9接地，1脚和8脚悬空。
在该种实施方式中，所述乘法运算电路包括：第二乘法器，所述第二乘法器的两个输入端都连接于所述第一放大器的输出端以得到第二平方信号；
第三乘法器，所述第三乘法器的两个输入端分别连接于所述第二乘法器和所述第二信号输入端以得到第二三次方信号；
第五乘法器，所述第五乘法器的两个输入端分别连接于所述第四放大器的输出端和所述第一放大器的输出端；
第六乘法器，所述第六乘法器的两个输入端分别连接于所述第二乘法器的输出端和所述第一信号输入端；
第七乘法器，所述第七乘法器的两个输入端都连接于所述第四放大器的输出端以得到第一平方信号；
第八乘法器，所述第八乘法器的两个出入端分别连接于所述第七乘法器的输出端和所述第二信号输入端；
第九乘法器，所述第九乘法器的两个出入端分别连接于所述第七乘法器的输出端和所述第一信号输入端以得到第一三次方信号。
在该种实施方式中，所述加法运算电路包括：第十放大器，所述第十放大器的第一引脚和第八引脚空接，所述第十放大器的第三引脚通过第五电阻接地，所述第十放大器的第二引脚通过第十五电阻连接于所述第五乘法器的输出端且通过第十六电阻连接于所述第六乘法器的输出端，所述第十放大器的第二引脚和第六引脚之间还并联有第十一电阻和第三电容，所述第十放大器的第四引脚连接所述负电压电源且通过第二十七电容接地，所述第十放大器的第七引脚连接所述正电压电源且通过第二十九电容接地；所述第十放大器的第五引脚通过第二十八电容连接于所述正电压电源。
在该种实施方式中，所述加法运算电路还包括：第十一放大器，所述第十一放大器的第一引脚和第八引脚空接，所述第十一放大器的第三引脚通过第六电阻接地，所述第十一放大器的第二引脚通过第十七电阻连接于所述第十放大器的第六引脚，所述第十一放大器的第二引脚通过第十八电阻连接于第四放大器的第六引脚，所述第十一放大器的第二引脚还通过第十九电阻连接于所述第九乘法器的输出端；所述第十一放大器的第二引脚和第六引脚之间还并联有第十二电阻和第四电容，所述第六引脚为所述第一校正信号的输出端，所述第十一放大器的第四引脚连接所述负电压电源且通过第三十电容接地，所述第十一放大器的第七引脚连接于所述正电压电源且通过第三十二电容接地；所述第十一放大器的第五引脚通过第三十一电容连接于所述正电压电源。
在该种实施方式中，所述加法运算电路还包括：
第十二放大器，所述第十二放大器的第一引脚和第八引脚空接，所述第十二放大器的第三引脚通过第七电阻接地，所述第十二放大器的第二引脚通过第二十电阻连接于所述第一放大器的第六引脚，所述第十二放大器的第二引脚通过第二十一电阻连接于所述第三乘法器的输出端，所述第十二放大器的第二引脚还通过第二十二电阻连接于所述第七乘法器的输出端，所述第十二放大器的第二引脚和第六引脚之间还并联有第十三电阻和第五电容，所述第十二放大器的第四引脚连接所述负电压电源且通过第三十三电容接地，所述第十二放大器的第七引脚连接所述正电压电源且通过第三十五电容接地；所述第十二放大器的第五引脚通过第三十四电容连接于所述正电压电源。
在该种实施方式中，所述加法运算电路还包括：第十三放大器，所述第十三放大器的第一引脚和第八引脚空接，所述第十三放大器的第三引脚通过第八电阻接地，所述第十三放大器的第二引脚通过第二十三电阻连接于所述第十二放大器的第六引脚，所述第十三放大器的第二引脚通过第二十四电阻连接于所述第二乘法器的输出端，所述第十三放大器的第二引脚还通过第二十五电阻连接于所述第八乘法器的输出端；所述第十三放大器的第二引脚和第六引脚之间还并联有第十四电阻和第六电容，所述第六引脚为所述第二校正信号的输出端，所述第十三放大器的第四引脚连接所述负电压电源且通过第三十六电容接地，所述第十三放大器的第七引脚连接于所述正电压电源且通过第三十八电容接地；所述第十三放大器的第五引脚通过第三十七电容连接于所述正电压电源。
在本发明的一种实施方式中，原始畸变信号第一信号X、第二信号Y分别通过信号输入端Pin1和Pin8进入，经过运算放大电路的比例放大处理后，分别由芯片N4和N1的6脚输出n4·X和n1·Y信号。
所述的乘法运算电路由集成乘法器芯片第二乘法器N2、第三乘法器N3、第五乘法器～第九乘法器(N5～N9)以及第十三电容～第二十六电容(C13～C26)组成；
芯片N2的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C13接地，第九引脚接+15V电源并通过电容C14接地，第七引脚和第八引脚连接，第三引脚、第十引脚接到芯片N1的第六引脚；
芯片N3的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C15接地，第九引脚接+15V电源并通过电容C16接地，第七引脚和第八引脚连接，第三引脚接到Y信号输入端Pin8，第十引脚接到芯片N2的第七引脚和第八引脚；
芯片N5的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C17接地，第九引脚接+15V电源并通过电容C18接地，第七引脚和第八引脚连接，第三引脚、第十引脚分别接到芯片N4、N1的第六引脚；
芯片N6的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C19接地，第九引脚接+15V电源并通过电容C20接地，第七引脚和第八引脚连接，第三引脚接到X信号输入端Pin1，第十引脚接到芯片N2的第七引脚和第八引脚；
芯片N7的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C21接地，第九引脚接+15V电源并通过电容C22接地，第七引脚和第八引脚连接，第三引脚、第十引脚接到芯片N4的第六引脚；
芯片N8的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C23接地，第九引脚接+15V电源并通过电容C24接地，第七引脚和第八引脚连接，第三引脚接到Y信号输入端Pin8，第十引脚接到芯片N7的第七引脚和第八引脚；
芯片N9的引脚关系连接如下：第一引脚、第四引脚和第六引脚接地，第二引脚悬空，第五引脚接-15V电源并通过电容C25接地，第九引脚接+15V电源并通过电容C26接地，第七引脚和第八引脚连接，第三引脚接到X信号输入端Pin1，第十引脚接到芯片N7的第七引脚和第八引脚。
所述的加法运算电路由运算放大器芯片N10～N13以及电阻R5～R8、R11～R14、R15～R25、电容C3～C6、C27～C38组成；
芯片N10的引脚连接关系如下：第二引脚分别通过电阻R15、R16接到芯片N5、N6的第七引脚和第八引脚，第三引脚通过电阻R5接地，第二引脚和第六引脚之间接并联的电阻R11和电容C3，第四引脚接-15V电源并通过电容C27接地，第五引脚通过电容C28接到+15V电源，第七引脚接+15V电源并通过电容C29接地，第一引脚和第八引脚悬空；
芯片N11的引脚连接关系如下：第二引脚分别通过电阻R17～R19接到芯片N10的第六引脚、芯片N4、N9的第七引脚和第八引脚连接，第三引脚通过电阻R6接地，第二引脚和第六引脚之间接并联的电阻R12和电容C4，且第六引脚接到ΔX信号输出端Pin16，第四引脚接-15V电源并通过电容C30接地，第五引脚通过电容C31接到+15V电源，第七引脚接+15V电源并通过电容C32接地，第一引脚和第八引脚悬空；
芯片N12的引脚连接关系如下：第二引脚分别通过电阻R20～R22接到芯片N1、N3、N7的第七引脚和第八引脚连接，第三引脚通过电阻R7接地，第二引脚和第六引脚之间接并联的电阻R13和电容C5，第四引脚接-15V电源并通过电容C33接地，第五引脚通过电容C34接到+15V电源，第七引脚接+15V电源并通过电容C35接地，第一引脚和第八引脚悬空；
芯片N13的引脚连接关系如下：第二引脚分别通过电阻R23～R25接到芯片N12的第六引脚、芯片N2、N8的第七引脚和第八引脚连接，第三引脚通过电阻R8接地，第二引脚和第六引脚之间接并联的电阻R14和电容C6，且第六引脚接到ΔY信号输出端Pin9，第四引脚接-15V电源并通过电容C36接地，第五引脚通过电容C37接到+15V电源，第七引脚接+15V电源并通过电容C38接地，第一引脚和第八引脚悬空。
由运算放大电路和乘法器电路处理后的信号n5·XY、n6·XY2、n4·X、n9·X3经过芯片N10、N11的加法运算处理后由芯片N11的第六引脚输出，完成了对原始输入畸变信号X的校正处理，即ΔX＝a4·X+a5·XY+a6·XY2+a9·X3，其中a4、a5、a6、a9是校正系数；
由运算放大电路和乘法器电路处理后的信号n1·Y、n3·Y3、n7·X2、n2·Y2、n8·X2Y经过芯片N12、N13的加法运算处理后由芯片N13的6脚输出，完成了对原始输入畸变信号Y的校正处理，即：
ΔY＝b1·Y+b2·Y2+b3·Y3+b7·X2+b8·X2Y，其中b1、b2、b3、b7、b8是校正系数。
如下表所示，该畸变校正混合集成电路模块的各功能引脚定义为：
引脚 名称 定义
Pin1 Input_X X信号输入端
Pin2、Pin3 Gnd 接地端
Pin4、Pin5 -15V -15V电源端
Pin6、Pin7 Gnd 接地端
Pin8 Input_Y Y信号输入端
Pin9 Output_ΔY ΔY信号输出端
Pin10、Pin11 Gnd 接地端
Pin12、Pin13 +15V +15V电源端
Pin14、Pin15 Gnd 接地端
Pin16 Output_ΔX ΔX信号输出端
原始输入畸变信号X、Y由Pin1和Pin8端输入，经过电路模块校正后从Pin9和Pin16端输出，剩余的引脚按照引脚定义端接。
按照本发明实施办法，该信号畸变校正电路模块的尺寸为56mm×30mm×6mm，与传统的PCB板电路相比，体积小，为整个系统减小体积提供了空间；该信号畸变校正电路模块的厚膜电阻采用激光调阻，其阻值精度达到0.5％，模块校正误差≤5％，具有较高的校正精度；该信号畸变校正电路模块采用全金属管壳气密封装，完全与外界环境隔离，模块具有较高可靠性、稳定性。
以上结合附图详细描述了本发明的优选实施方式，但是，本发明并不限于上述实施方式中的具体细节，在本发明的技术构思范围内，可以对本发明的技术方案进行多种简单变型，这些简单变型均属于本发明的保护范围。
另外需要说明的是，在上述具体实施方式中所描述的各个具体技术特征，在不矛盾的情况下，可以通过任何合适的方式进行组合，为了避免不必要的重复，本发明对各种可能的组合方式不再另行说明。
此外，本发明的各种不同的实施方式之间也可以进行任意组合，只要其不违背本发明的思想，其同样应当视为本发明所公开的内容。

Claims (6)

1.一种用于畸变信号的校正的集成电路模块，其特征在于，该集成电路模块包括：电路器件、陶瓷基板、金属可伐壳体以及盖板，其中，所述电路器件粘接到所述陶瓷基板上，所述陶瓷基板固定于所述金属可伐壳体，所述盖板固接于所述金属可伐壳体，以将所述电路器件和陶瓷基板密封于所述金属可伐壳体中；
所述电路器件包括依次连接的运算放大电路、乘法运算电路和加法运算电路，其中，原始畸变信号的第一信号和第二信号依次经过所述运算放大电路、乘法运算电路和加法运算电路以实现所述原始畸变信号的校正，所述加法运算电路输出第一校正信号和第二校正信号；
所述运算放大电路包括：第一放大器，其中，所述第一放大器的第一引脚和第八引脚空接；
所述第一放大器的第二引脚通过第二电阻连接于所述第二信号输入端，所述第一放大器的第二引脚和第六引脚之间并联有第十电阻和第二电容；
所述第一放大器的第三引脚通过第四电阻接地；
所述第一放大器的第四引脚连接负电压电源且通过第十电容接地；
所述第一放大器的第七引脚连接正电压电源且通过第十二电容接地；
所述第一放大器的第五引脚通过第十一电容连接于所述正电压电源；
所述第一放大器的第六引脚为所述第一放大器的输出端，以输出第二放大信号；
所述运算放大电路还包括：第四放大器，其中，所述第四放大器的第一引脚和第八引脚空接；
所述第四放大器的第二引脚通过第二电阻连接于所述第一信号输入端，所述第四放大器的第二引脚和第六引脚之间并联有第九电阻和第一电容；
所述第四放大器的第三引脚通过第四电阻接地；
所述第四放大器的第四引脚连接负电压电源且通过第七电容接地；
所述第四放大器的第七引脚连接正电压电源且通过第九电容接地；
所述第四放大器的第五引脚通过第八电容连接于所述正电压电源；
所述第四放大器的第六引脚为所述第四放大器的输出端，以输出第一放大信号；
所述乘法运算电路包括：第二乘法器，所述第二乘法器的两个输入端都连接于所述第一放大器的输出端以得到第二平方信号；
第三乘法器，所述第三乘法器的两个输入端分别连接于所述第二乘法器和所述第二信号输入端以得到第二三次方信号；
第五乘法器，所述第五乘法器的两个输入端分别连接于所述第四放大器的输出端和所述第一放大器的输出端；
第六乘法器，所述第六乘法器的两个输入端分别连接于所述第二乘法器的输出端和所述第一信号输入端；
第七乘法器，所述第七乘法器的两个输入端都连接于所述第四放大器的输出端以得到第一平方信号；
第八乘法器，所述第八乘法器的两个输入端分别连接于所述第七乘法器的输出端和所述第二信号输入端；
第九乘法器，所述第九乘法器的两个输入端分别连接于所述第七乘法器的输出端和所述第一信号输入端以得到第一三次方信号。
2.根据权利要求1所述的集成电路模块，其特征在于，所述陶瓷基板为Al2O3陶瓷材料。
3.根据权利要求1所述的集成电路模块，其特征在于，所述加法运算电路包括：第十放大器，所述第十放大器的第一引脚和第八引脚空接，所述第十放大器的第三引脚通过第五电阻接地，所述第十放大器的第二引脚通过第十五电阻连接于所述第五乘法器的输出端且通过第十六电阻连接于所述第六乘法器的输出端，所述第十放大器的第二引脚和第六引脚之间还并联有第十一电阻和第三电容，所述第十放大器的第四引脚连接所述负电压电源且通过第二十七电容接地，所述第十放大器的第七引脚连接所述正电压电源且通过第二十九电容接地；所述第十放大器的第五引脚通过第二十八电容连接于所述正电压电源。
4.根据权利要求3所述的集成电路模块，其特征在于，所述加法运算电路还包括：第十一放大器，所述第十一放大器的第一引脚和第八引脚空接，所述第十一放大器的第三引脚通过第六电阻接地，所述第十一放大器的第二引脚通过第十七电阻连接于所述第十放大器的第六引脚，所述第十一放大器的第二引脚通过第十八电阻连接于第四放大器的第六引脚，所述第十一放大器的第二引脚还通过第十九电阻连接于所述第九乘法器的输出端；所述第十一放大器的第二引脚和第六引脚之间还并联有第十二电阻和第四电容，所述第六引脚为所述第一校正信号的输出端，所述第十一放大器的第四引脚连接所述负电压电源且通过第三十电容接地，所述第十一放大器的第七引脚连接于所述正电压电源且通过第三十二电容接地；所述第十一放大器的第五引脚通过第三十一电容连接于所述正电压电源。
5.根据权利要求4所述的集成电路模块，其特征在于，所述加法运算电路还包括：
第十二放大器，所述第十二放大器的第一引脚和第八引脚空接，所述第十二放大器的第三引脚通过第七电阻接地，所述第十二放大器的第二引脚通过第二十电阻连接于所述第一放大器的第六引脚，所述第十二放大器的第二引脚通过第二十一电阻连接于所述第三乘法器的输出端，所述第十二放大器的第二引脚还通过第二十二电阻连接于所述第七乘法器的输出端，所述第十二放大器的第二引脚和第六引脚之间还并联有第十三电阻和第五电容，所述第十二放大器的第四引脚连接所述负电压电源且通过第三十三电容接地，所述第十二放大器的第七引脚连接所述正电压电源且通过第三十五电容接地；所述第十二放大器的第五引脚通过第三十四电容连接于所述正电压电源。
6.根据权利要求5所述的集成电路模块，其特征在于，所述加法运算电路还包括：第十三放大器，所述第十三放大器的第一引脚和第八引脚空接，所述第十三放大器的第三引脚通过第八电阻接地，所述第十三放大器的第二引脚通过第二十三电阻连接于所述第十二放大器的第六引脚，所述第十三放大器的第二引脚通过第二十四电阻连接于所述第二乘法器的输出端，所述第十三放大器的第二引脚还通过第二十五电阻连接于所述第八乘法器的输出端；所述第十三放大器的第二引脚和第六引脚之间还并联有第十四电阻和第六电容，所述第六引脚为所述第二校正信号的输出端，所述第十三放大器的第四引脚连接所述负电压电源且通过第三十六电容接地，所述第十三放大器的第七引脚连接于所述正电压电源且通过第三十八电容接地；所述第十三放大器的第五引脚通过第三十七电容连接于所述正电压电源。
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